JPS5814333B2 - 直流給電回路 - Google Patents
直流給電回路Info
- Publication number
- JPS5814333B2 JPS5814333B2 JP53020552A JP2055278A JPS5814333B2 JP S5814333 B2 JPS5814333 B2 JP S5814333B2 JP 53020552 A JP53020552 A JP 53020552A JP 2055278 A JP2055278 A JP 2055278A JP S5814333 B2 JPS5814333 B2 JP S5814333B2
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- JP
- Japan
- Prior art keywords
- semiconductor
- power supply
- circuit
- breaker
- current
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- Emergency Protection Circuit Devices (AREA)
- Direct Current Feeding And Distribution (AREA)
Description
【発明の詳細な説明】
本発明は半導体開閉装置を有する複数組の直流饋電回路
で構成される半導体式直流給電回路に関するものである
。
で構成される半導体式直流給電回路に関するものである
。
半導体を用いた直流開閉装置には転流回路を有し電流を
シャ断出来るもの（以下半導体シャ断器と呼ぶ）と、転
流回路を持たないでサイリスクの電流が零になったとき
ゲート信号を停止してサイリスクをターンオフさせ阻止
状態にするもの（以下半導体断路器と呼ぶ）かあるが（
以下半導体シャ断器と半導体断路器を総称して半導体開
閉装置と呼ぶ）、いずれも負荷電流は一方向にしか流す
事が出来ない。
シャ断出来るもの（以下半導体シャ断器と呼ぶ）と、転
流回路を持たないでサイリスクの電流が零になったとき
ゲート信号を停止してサイリスクをターンオフさせ阻止
状態にするもの（以下半導体断路器と呼ぶ）かあるが（
以下半導体シャ断器と半導体断路器を総称して半導体開
閉装置と呼ぶ）、いずれも負荷電流は一方向にしか流す
事が出来ない。
このため例えば電鉄用直流変電所などで車両の回生制動
電力を吸収する場合、あるいは延長饋電を行なう場合な
どにけ半導体シャ断器を逆並列に接続しなければならず
饋電回路数の多い変電所では饋電回路のコストが非常に
高いものとなった。
電力を吸収する場合、あるいは延長饋電を行なう場合な
どにけ半導体シャ断器を逆並列に接続しなければならず
饋電回路数の多い変電所では饋電回路のコストが非常に
高いものとなった。
即ち第１図の従来の装置についてさらに詳しく説明する
と、１ａ，１ｂ，１ｃは複数組の直流饋電回路で、半導
体断略器２ａ，２ｂ，２ｃと、これらと逆方向に並列接
続された半導体シャ断器３ａ，３ｂ，３ｃを有しており
共通の電源回路４に接続されている。
と、１ａ，１ｂ，１ｃは複数組の直流饋電回路で、半導
体断略器２ａ，２ｂ，２ｃと、これらと逆方向に並列接
続された半導体シャ断器３ａ，３ｂ，３ｃを有しており
共通の電源回路４に接続されている。
５はカ行電力を供給するためのサイリスク整流器、６は
回生電力を吸収するためのインバータで、夫々共通電源
回路４に接続する。
回生電力を吸収するためのインバータで、夫々共通電源
回路４に接続する。
この様な構成において力行時は例えば饋電回路１ａの半
導体断路器２ａのサイリスタ７にゲート信号を送り導通
状態にしてサイリスク整流器５からの電流を、図示され
てない負荷に供給する。
導体断路器２ａのサイリスタ７にゲート信号を送り導通
状態にしてサイリスク整流器５からの電流を、図示され
てない負荷に供給する。
一方この負荷電流をシャ断する場合はサイリスク整流器
５のゲートシャ断を行ない負荷電流を零にすると同時に
サイリスタ７へのゲート信号を停止して、サイリスタ７
を阻止状態にする事により半導体断路器を開放状態にす
る。
５のゲートシャ断を行ない負荷電流を零にすると同時に
サイリスタ７へのゲート信号を停止して、サイリスタ７
を阻止状態にする事により半導体断路器を開放状態にす
る。
かくして２ａはシャ断能力のないものでよい。
一方饋電回路１ａの負荷が回生状態になると、半導体シ
ャ断器３ａを導通せしめ、図示されてない負荷からの回
生電力は半導体シャ断器３ａを経由して、インバータ６
へ送られる。
ャ断器３ａを導通せしめ、図示されてない負荷からの回
生電力は半導体シャ断器３ａを経由して、インバータ６
へ送られる。
この時回生電流をシャ断するために饋回路の半導体開閉
装置はシャ断機能を有する半導体シャ断器３ａを用いな
ければならない。
装置はシャ断機能を有する半導体シャ断器３ａを用いな
ければならない。
この様に従来の方式では回生電力吸収を行なう場合、各
饋電回路毎に転流回路を有する半導体シャ断器が必要と
なり饋電回路数の増加と共に設備が莫大なものとなった
。
饋電回路毎に転流回路を有する半導体シャ断器が必要と
なり饋電回路数の増加と共に設備が莫大なものとなった
。
本発明はかかる従来装置の問題点を解決するためのもの
で、各饋電回路に共通に逆方向半導体シャ断器を設ける
事により半導体シャ断器を設ける事により半導体シャ断
器数を大巾に低減し、小形でコストの安い直流給電回路
を可能にするものである。
で、各饋電回路に共通に逆方向半導体シャ断器を設ける
事により半導体シャ断器を設ける事により半導体シャ断
器数を大巾に低減し、小形でコストの安い直流給電回路
を可能にするものである。
以下第２図，第３図に示す実施例にもとづいて本発明の
詳細を説明する。
詳細を説明する。
第２図に示す本発明の一実施例において、複数組の饋電
回路１ａ，１ｂ，１ｃはそれぞれ半導体開閉装置８ａ，
８ｂ，８ｃで構成する。
回路１ａ，１ｂ，１ｃはそれぞれ半導体開閉装置８ａ，
８ｂ，８ｃで構成する。
半導体開閉装置８ａ，８ｂ，８ｃは半導体シャ断器であ
ってもよいし、あるいは半導体断略器であってもよい。
ってもよいし、あるいは半導体断略器であってもよい。
複数組の半導体開閉装置８ａ，８ｂ，８ｃの一方は共通
の電源回路４に接続され、負荷電流が電源側から負荷に
流れる方向（以下順方向と呼ぶ：になる様に接続する。
の電源回路４に接続され、負荷電流が電源側から負荷に
流れる方向（以下順方向と呼ぶ：になる様に接続する。
半導体開閉装置８ａ，８ｂｔ８ｃの負荷側の点９ａ，９
ｂ，９ｃはダイオード１０ａ，１０ｂ，１０ｃを介して
、点１１で共通になる様に接続する。
ｂ，９ｃはダイオード１０ａ，１０ｂ，１０ｃを介して
、点１１で共通になる様に接続する。
ダイオード１０ａはアノード側か点９ａ，カソード側が
点１１の側になる様に接続する。
点１１の側になる様に接続する。
以下ダイオード１０ｂ，１０ｃについても同様である。
点１１は、電流シャ断能力を有する半導体シャ断器１２
を介して電源回略４に接続する。
を介して電源回略４に接続する。
１３は電源用整流器、６は回生用インバータ装置で直流
側は共に共通電源回略４に接続されている。
側は共に共通電源回略４に接続されている。
次に第２図の実施例において８ａ，８ｂ，８ｃが半導体
断略器，１３がサイリスタ整流器で構成される場合につ
いて動作を説明する。
断略器，１３がサイリスタ整流器で構成される場合につ
いて動作を説明する。
カ行時は、例えば饋電回略１ａの半導体開閉装置８ａの
サイリスク７にゲート信号を送り導通状態［こして、整
流器１３からの電流を図示されてない負荷に供給する。
サイリスク７にゲート信号を送り導通状態［こして、整
流器１３からの電流を図示されてない負荷に供給する。
また同時に他の饋電回略１６の負荷が回生状態になった
ときは、回生電流は点９ｂ−ダイオード１０ｂ一半導体
シャ断器１２一半導体開閉装置８ａ一饋電回路１ａの負
荷の経路及び点９ｂ一ダイオード１０ｂ一半導体シャ断
器１２−インバータ６の経路で流れる。
ときは、回生電流は点９ｂ−ダイオード１０ｂ一半導体
シャ断器１２一半導体開閉装置８ａ一饋電回路１ａの負
荷の経路及び点９ｂ一ダイオード１０ｂ一半導体シャ断
器１２−インバータ６の経路で流れる。
この時饋電回略１ａの順方向電流をシャ断ずるときは、
整流器１３のゲートシャ断により整流器１３の電流を零
とすると同時に、半導体シャ断器１２により回生電流を
シャ断し饋電回路１ａの電流を零にする。
整流器１３のゲートシャ断により整流器１３の電流を零
とすると同時に、半導体シャ断器１２により回生電流を
シャ断し饋電回路１ａの電流を零にする。
と同時にサイリスタＴへのゲート信号を停止してサイリ
スタ７を阻止状態にする事により半導体開閉装置８ａを
開放状態にする。
スタ７を阻止状態にする事により半導体開閉装置８ａを
開放状態にする。
逆方向に接続された半導体シャ断器１２は、夫々ダイオ
ード１０ａ，１０ｂ，１０ｃを介して、各饋電回略１ａ
，１ｂ，１ｃに対して共通に設けられているので、半導
体シャ断器１２で回生電流をシャ断する事により、いず
れの饋電回略の電流もシャ断する事が出来る。
ード１０ａ，１０ｂ，１０ｃを介して、各饋電回略１ａ
，１ｂ，１ｃに対して共通に設けられているので、半導
体シャ断器１２で回生電流をシャ断する事により、いず
れの饋電回略の電流もシャ断する事が出来る。
従って複数組の饋電回路に対して逆方向の半導体シャ断
器は１組でよい事になる。
器は１組でよい事になる。
また第１図の従来方式では、インバータ６の回生能力を
フルに活用するためには各饋電回路の逆方向半導体シャ
断器３ａ，３ｂ，３ｃは夫々インバータ最大回生可能電
流ＩＩＮＶに等しい通電容量を持たせなければならず、
変電所全体としては逆方向半導体シャ断器総通電容量が
３ＩＩＮＶとなり不経済であったが、第２図の本発明に
よれば、半導体シャ断器１２の通電容量をインバータ６
の最大回生可能電流■ＩＮＶに等しくしておけばインバ
ータ６の回生能力をフルに活用出来る事になるので、変
電所全体としての逆方向半導体シャ断器総通電容量は第
１図の従来方式の１／３で済み、非常に経済的である。
フルに活用するためには各饋電回路の逆方向半導体シャ
断器３ａ，３ｂ，３ｃは夫々インバータ最大回生可能電
流ＩＩＮＶに等しい通電容量を持たせなければならず、
変電所全体としては逆方向半導体シャ断器総通電容量が
３ＩＩＮＶとなり不経済であったが、第２図の本発明に
よれば、半導体シャ断器１２の通電容量をインバータ６
の最大回生可能電流■ＩＮＶに等しくしておけばインバ
ータ６の回生能力をフルに活用出来る事になるので、変
電所全体としての逆方向半導体シャ断器総通電容量は第
１図の従来方式の１／３で済み、非常に経済的である。
本発明によると饋電回路数がＮ個あるとき第１図の如き
従来方式にくらべ、逆方向半導体シャ断器の所要総容量
は１／Ｎで適むので饋電回路数が増加すると本発明の効
果はますます増大する。
従来方式にくらべ、逆方向半導体シャ断器の所要総容量
は１／Ｎで適むので饋電回路数が増加すると本発明の効
果はますます増大する。
次に第２図の実施例において、延長饋電を行なう場合に
ついて説明する。
ついて説明する。
今例えば図示されてない隣接変電所からの電流を饋電回
路１ｂに送り込み、別の饋電回路１ａより、図示されて
ない負荷回路に電流を送る場合、半導体シャ断器１２と
半導体開閉装置８ａを導通状態にし、半導体開閉装置８
ｂは非導通の状態にしておく。
路１ｂに送り込み、別の饋電回路１ａより、図示されて
ない負荷回路に電流を送る場合、半導体シャ断器１２と
半導体開閉装置８ａを導通状態にし、半導体開閉装置８
ｂは非導通の状態にしておく。
かくする事により隣接変電所からの電流は饋電回略１ｂ
から流入し点９−ダイオード１０ｂ一点１１一半導体シ
ャ断器１２一電源回路４一半導体開閉装置８ａを経由し
て饋電回路１ａより負荷回路へ送り出される。
から流入し点９−ダイオード１０ｂ一点１１一半導体シ
ャ断器１２一電源回路４一半導体開閉装置８ａを経由し
て饋電回路１ａより負荷回路へ送り出される。
また、この延長給電電流は、同様にして半導体シャ断器
１２を介して同時に饋電回路１ｃからも送り出す事か出
来る。
１２を介して同時に饋電回路１ｃからも送り出す事か出
来る。
従って、延長給電々流はすべて半導体シャ断器１２によ
ってシャ断出来るので半導体開閉装置８ａ，８ａは転流
回路を持たない半導体断路器で構成する事が出来る。
ってシャ断出来るので半導体開閉装置８ａ，８ａは転流
回路を持たない半導体断路器で構成する事が出来る。
第３図は本発明の他の実施例で、回生用電源回路４′と
、カ行用電源回路４を電気的に分離した場合を示してお
り、他の符号は第２図の実施例と同一である。
、カ行用電源回路４を電気的に分離した場合を示してお
り、他の符号は第２図の実施例と同一である。
第３図の実施例においては電源回路４と４′が分離され
ているので半導体シャ断器１２のシャ断動作の際に、半
導体シャ断器１２の図示されてない転流回路電流が不要
なバイパス回路を流れてシャ断能力を低下させる事を防
止するものである。
ているので半導体シャ断器１２のシャ断動作の際に、半
導体シャ断器１２の図示されてない転流回路電流が不要
なバイパス回路を流れてシャ断能力を低下させる事を防
止するものである。
すなわち第２図の実施例では半導体シャ断器１２の主サ
イリスクを消弧させるための転流電流が、例えば半導体
シャ断器１２一半導体開閉装置８ｃ−ダイオード１０ｃ
一点１１一半導体シャ断器１２の閉路を流れて、半導体
シャ断器１２のシャ断能力を低下させるか、第３図の実
施例ではこれを防止出来る。
イリスクを消弧させるための転流電流が、例えば半導体
シャ断器１２一半導体開閉装置８ｃ−ダイオード１０ｃ
一点１１一半導体シャ断器１２の閉路を流れて、半導体
シャ断器１２のシャ断能力を低下させるか、第３図の実
施例ではこれを防止出来る。
しかしいずれにしても第２図，第３図の実施例共本発明
の主旨とするところの、半導体シャ断器数の低減による
小形でコストの安い直流給電回路を可能にする事には変
りはない。
の主旨とするところの、半導体シャ断器数の低減による
小形でコストの安い直流給電回路を可能にする事には変
りはない。
第１図は従来の直流給電回路を示す回路構成図、第２図
は本発明の一実施例を示す回路構成図、第３図は本発明
の他の実施例を示す回路構成図である。 図中１ａ，１ｂ，１ｃは饋電回路、２ａ，２ｂ，２ｃは
半導体開閉装置、３ａ，３ｂ，３ｃは半導体シャ断器、
４，４′は電源回路、５はサイリスタ整流器、６は回生
用インバータ、７はサイリスタ、Ｂａ，８ｂ，８ｃは半
導体開閉装置、９ａ，９ｂ，９ｃは回路位置を示す点、
１０ａ，１０ｂ，１０ｃはダイオード、１１は回路位置
を示す点、１２は半導体シャ断器、１３は整流器である
。 尚図中同一符号は同一又は相当部分を示す。
は本発明の一実施例を示す回路構成図、第３図は本発明
の他の実施例を示す回路構成図である。 図中１ａ，１ｂ，１ｃは饋電回路、２ａ，２ｂ，２ｃは
半導体開閉装置、３ａ，３ｂ，３ｃは半導体シャ断器、
４，４′は電源回路、５はサイリスタ整流器、６は回生
用インバータ、７はサイリスタ、Ｂａ，８ｂ，８ｃは半
導体開閉装置、９ａ，９ｂ，９ｃは回路位置を示す点、
１０ａ，１０ｂ，１０ｃはダイオード、１１は回路位置
を示す点、１２は半導体シャ断器、１３は整流器である
。 尚図中同一符号は同一又は相当部分を示す。
Claims (1)
- １ 半導体開閉装置を有する複数組の饋電回路を、共通
の第１の電源回路に接続して成る直流給電回路において
、前記複数組の饋電回略の出力側をダイオードを介して
共通に接続し、前記ダイオードを介して共通に接続した
点と、前記第１の電源回路又は、回生装置を有する第２
の電源回路の間を半導体シャ断器を介して接続し、かつ
前記半導体シャ断器の電流方向は、前記饋電同路の半導
体開閉装置の電流方向と逆方向になる様に接続して構成
した事を特徴とする直流給電回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53020552A JPS5814333B2 (ja) | 1978-02-23 | 1978-02-23 | 直流給電回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53020552A JPS5814333B2 (ja) | 1978-02-23 | 1978-02-23 | 直流給電回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54113038A JPS54113038A (en) | 1979-09-04 |
| JPS5814333B2 true JPS5814333B2 (ja) | 1983-03-18 |
Family
ID=12030309
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53020552A Expired JPS5814333B2 (ja) | 1978-02-23 | 1978-02-23 | 直流給電回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5814333B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63111450U (ja) * | 1987-01-14 | 1988-07-18 | ||
| JPH01168439U (ja) * | 1989-01-04 | 1989-11-28 | ||
| JPH0344668Y2 (ja) * | 1985-01-08 | 1991-09-19 |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5656128A (en) * | 1979-10-15 | 1981-05-18 | Japan National Railway | Dc feeding circuit |
| JPH0780430B2 (ja) * | 1989-09-06 | 1995-08-30 | 株式会社日立製作所 | 直流給電回路システム |
-
1978
- 1978-02-23 JP JP53020552A patent/JPS5814333B2/ja not_active Expired
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0344668Y2 (ja) * | 1985-01-08 | 1991-09-19 | ||
| JPS63111450U (ja) * | 1987-01-14 | 1988-07-18 | ||
| JPH01168439U (ja) * | 1989-01-04 | 1989-11-28 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54113038A (en) | 1979-09-04 |
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