JPS58132824A - デ−タ転送制御装置 - Google Patents

デ−タ転送制御装置

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Publication number
JPS58132824A
JPS58132824A JP1344582A JP1344582A JPS58132824A JP S58132824 A JPS58132824 A JP S58132824A JP 1344582 A JP1344582 A JP 1344582A JP 1344582 A JP1344582 A JP 1344582A JP S58132824 A JPS58132824 A JP S58132824A
Authority
JP
Japan
Prior art keywords
data transfer
transfer speed
speed value
controller
register
Prior art date
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Pending
Application number
JP1344582A
Other languages
English (en)
Inventor
Fujio Sekiya
関谷 冨士男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP1344582A priority Critical patent/JPS58132824A/ja
Publication of JPS58132824A publication Critical patent/JPS58132824A/ja
Pending legal-status Critical Current

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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38Information transfer, e.g. on bus
    • G06F13/382Information transfer, e.g. on bus using universal interface adapter
    • G06F13/385Information transfer, e.g. on bus using universal interface adapter for adaptation of a particular data processing system to different peripheral devices

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、データ転送制御装置に関し、特に、データ転
送制御装置に例えばファクシミリ装置。
計測機器等の外部の装置を接続せずにシステムとして試
験が可能な手段を有するデータ転送制御装置に関する。
従来、この種のデータ転送制御装置をシステムに近い状
態で試験する場合に杜、データ転送制御−置内で折返し
良状態、即ち、自装置の出力を自装置の入力にいわゆる
ループバックした状態で他の制御装置と同時に試験をし
ていえ。しかしながら、データ転送制御装置は通常、最
大のデータ転送スピード能力で動作する友めに、共通パ
ス方式のシステムにお−てはパス能力の全てがデータ転
送制御装置に占有され、実システムに近い動作ができな
いという欠点があつ友。
本発明は従来の上記実情に鑑みてなされ一#−ものであ
)、従って本発明の目的は、データ転送制御装置のデー
タ転送スピード値を任意に設定で亀るようにすることに
より1前記欠点を解決し、データ転送制御装置を、他の
外部輪重を接続せずに実システムに近い状態で試験する
九めの新規な手段を提供することにある。
本発明の上記目的は、データ転送スピード値を設定する
データ転送スピード設定手段と、前記データ転送スピー
ド設定手段に格納され喪前記データ転送スピード値を読
堆如、対応するデータ転送スピード値でデータの転送を
行うデータ転送スピード制御回路を備え良デー1転送制
御装置、によって達成される。
次に本発明をその良好な一実施例について図面を参照し
て詳細に説明する。
本発明の一実施例を示す第1図において、本発v40デ
ータ転送制御装置/は、データ転送制御装置のデータ転
送スピード値をプログラムにより設定可能なデータ転送
スピードレジスタ10と、データ転送スピード制御回路
Xとから構成される。データ転送制御装置lは共通パス
コに接続されている。
本発明の一実施例においては、プログ2ムによj*lI
K*続される装置Xのデータ転送スピード値をデータ転
送スピードレジスタ10に設定する。
データ転送が要求されると、データ転送スピード制御回
路〃は、データ転送スピードレジスタlD。
値に従って、データ転送スピードを制御する。
本実施例の説明では、データ転送スピード値の設定をグ
ログ2ムにより設定させているが、直接、外部よシ操作
可能なスイッチ等によプ設定すると・とも可能である。
本発明は、以上説明し良ように、データ転送スとにより
、実際のシステムに近い状態でデータ転送制御装置を試
験できる効果がある。
【図面の簡単な説明】
第1図は、本発明の一実施例を示し九ブロック図である
。 /・・・データ転送制御装置、−一・共通パス、IO・
・・データ転送スピードレジスタ、X・・・データ転送
スピード制御回路、X・・・装置。 特許出願人 日本電気株式会社 代理人 弁理士熊谷雄太部

Claims (1)

    【特許請求の範囲】
  1. データ転送スピード値を設定するデータ転送スピード設
    定手段と、前記データ転送スピード設定手段に格納され
    た前記データ転送スピード値を読取って対応するデータ
    転送スピード値でデータの転送を行うデータ転送スピー
    ド制御回路とを具備することを41像とし九データ転送
    制御装置。
JP1344582A 1982-01-30 1982-01-30 デ−タ転送制御装置 Pending JPS58132824A (ja)

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JP1344582A JPS58132824A (ja) 1982-01-30 1982-01-30 デ−タ転送制御装置

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JPS58132824A true JPS58132824A (ja) 1983-08-08

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