JPH11506846A - 効率的なディジタル・モデリング及びテクスチャ・マッピングのための方法並びに装置 - Google Patents
効率的なディジタル・モデリング及びテクスチャ・マッピングのための方法並びに装置Info
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Abstract
Description
Claims (1)
- 【特許請求の範囲】 1.画素の第1ラスタから画素の第2ラスタにテクスチャをマップする方法にお いて、前記第1ラスタの画素は後退成分qを含む値を有しており、前記第2ラス タの画素は後退成分wを含む値を有しており、マッピング関係に従って前記第1 ラスタの画素は前記第2ラスタの画素に対応しており、当該方法は、次の工程を 含むことを特徴とする。 a. 前記第2ラスタにおける画素の領域を特定する工程、 b. 量q/wが一定になるように前記第1ラスタ画素に対応する前記第2ラ スタの画素を通過する線に沿って領域内の画素を突き止める工程、 c. 画素を前記第1のラスタから前記第2のラスタにおける突き止められた 画素にマップする工程。 2.請求項1に記載の方法において、マッピング関係に従って前記第1ラスタか らマップされた画素は突き止められた画素に対応しており、少なくともいくつか の突き止められた画素はそれぞれ複数の前記第1ラスタ画素に対応しており、さ らにマッピングの工程は、次の工程を含むことを特徴とする。 a. 複数の前記第1ラスタ画素に対応して突き止められた画素毎に、補間値 を得るために対応する前記第1ラスタ画素値間で線形補間する工程、 b. 突き止められた値に補間値を割り当てる工程。 3.請求項2に記載の方法において、線形補間処理の工程が、次の工程を含むこ とを特徴とする。 a. 対応する前記第1ラスタ画素それぞれの値をwで割る工程、 b. 補間値を得るためにそのように割られた前記第1ラスタ画素値間で線形 補間する工程、 c. 補間値にq/wを掛ける工程。 3.請求項1に記載の方法において、前記線が互いに平行していることを特徴と する。 5.請求項1に記載の方法において、さらに、次の工程を含むことを特徴とする 。 a. 異なる詳細度をそれぞれ表す複数の予めフィルタ処理されたテクスチャ ・マップを提供する工程と、 b. 前記テクスチャ・マップの一つを選択する工程、 c. 前記テクスチャ・マップを前記第1ラスタに取り入れる工程、 d. 画素を選択された前記テクスチャ・マップから前記第2ラスタで突き止 められた画素にマップする工程。 6.画素の第1ラスタから画素の第2ラスタにテクスチャをマップする方法にお いて、各画素はある長さを一辺とする正方形として表現されており、前記第1ラ スタの画素は後退成分qを含む値を有しており、前記第2ラスタの画素は後退成 分wを有する値を有しており、マッピング関係に従って前記第1ラスタの画素は 前記第2ラスタの画素に対応しており、当該方法は、次の工程を含むことを特徴 とする。 a. 前記第2ラスタにおける画素の領域を特定する工程であり、当該領域は 複数の辺で境界をなし、 b. 量q/wが一定である勾配を有し、且つ領域の第1及び第2の辺 と交差する第1線に沿った画素を突き止める工程であり、突き止められた画素は 前記第1及び前記第2の辺の内側か上にあり、 c. 画素を前記第1ラスタから前記第2ラスタで突き止められた画素にマッ プする工程、 d. 量q/wが一定の勾配を有し、且つ前記第1及び前記第2の辺と交差す る新しい線に沿って画素を突き止める工程であり、当該新しい線はその前の線か ら少なくとも前記第1及び前記第2の線に沿って一辺の長さに等しい距離だけず れ、突き止められた画素は前記第1及び前記第2の辺の内側か上にあり、 e. 画素を前記第1ラスタから前記第2ラスタで突き止められた画素にマッ プする工程、 f. 領域の辺の上か内側に存在する全ての画素が突き止められるまで工程(d )と(c)を繰り返す工程。 7.請求項6に記載の方法において、マッピング関係に従って前記第1ラスタか らマップされた画素は突き止められた画素に対応しており、突き止められた画素 の少なくともいくつかはそれぞれ複数の前記第1ラスタ画素に対応しており、さ らにそれぞれのマッピングの工程は、次の工程を含むことを特徴とする。 a. 複数の前記第1ラスタ画素に対応する突き止められた画素毎に、補間値 を得るために、対応する前記第1ラスタ画素値間で線形補間する工程、 b. 前記補間値を突き止められた画素に割り当てる工程。 7.請求項7に記載の方法において、前記線形補間処理の工程が、次の工程を含 むことを特徴とする。 a. 対応する前記第1画素それぞれの値をwで割る工程、 b. 補間値を得るためにそのように割った前記第1ラスタ画素値間で線形補 間する工程、 c. 前記補間値にq/wを掛ける工程。 9.テクスチャを画素の第1ラスタから画素の第2ラスタにマップする装置にお いて、次の構成を有することを特徴とする。 a. 画素の前記第1ラスタを定義し、後退成分qを含む画素値を符号化する データを格納している第1のコンピュータメモリ、 b. 画素の前記第2ラスタを定義し、後退成分wを含む画素値を符号化する データを格納している第2のコンピュータメモリ、 c. マッピング関係に従って前記第1ラスタの画素が前記第2ラスタの画素 に対応するようにラスタ間のマッピング関係を符号化する手段、 d. i. 前記第2ラスタにおける画素の領域を特定する手段と、 ii. 量q/wが一定になるように前記第1ラスタにおける画素に対応す る前記第2ラスタにおける画素を通過する線に沿った領域内の画素を突き止める 手段と、 iii.画素値を前記第1ラスタから前記第2ラスタで突き止められた画素 にマップする手段とからなる画素処理手段。 10.請求項9に記載の装置において、次の構成を有することを特徴とする。 a. マッピング関係に従って前記第1ラスタからマップされた画素が突き止 められた画素に対応しており、突き止められた画素の少なくともいくつかはそれ ぞれ複数の前記第1ラスタ画素に対応しており、 b. 前記画素処理手段はさらに、複数の前記第1ラスタ画素に対応する突き 止められた画素毎に、補間値を得るために対応する前記第1ラスタ画素値間で線 形補間し、その後突き止められた画素に補間値を割り当てるように構成されてい る。 10.請求項10に記載の装置において、前記画素処理手段は、次の構成により 線形補間を行っていることを特徴とする。 a. 対応する前記第1ラスタ画素それぞれの値をwで割る構成、 b. 補間値を得るためにそのように割られた前記第1ラスタの画素値間で線 形補間する構成、 c. 前記補間値にq/wを掛ける構成。 10.請求項10に記載の装置において、それぞれが異なる詳細度を表現する複 数の予めフィルタ処理されたテクスチャ・マップを格納する第3のコンピュータ メモリをさらに有し、前記画素処理手段はさらに、次のように構成されているこ とを特徴とする。 a. 前記テクスチャ・マップの一つを選択する構成、 b. 前記テクスチャ・マップを定義するデータを前記第1ラスタに取り入れ る構成、 c. 画素値を選択された前記テクスチャ・マップから前記第2ラスタで突き 止められた画素にマップする構成。 13.請求項10に記載の装置において、ラスタはそれぞれ表面を符号化してお り、画素はそれぞれある長さを一辺とする表面の正方面積に対応しており、さら に画素の領域は複数の辺からなり、前記画素処理手段は複数の線に沿って画素を 突き止めるように構成されており、 前記線はそれぞれ量q/wが一定の勾配を有しており、且つ領域の第1及び第2 の辺と交差しており、突き止められた画素は前記第1及び前記第2の辺の上か内 側にあることを特徴とする。 14.請求項10に記載の装置において、前記線はそれぞれ一辺の長さに等しい 距離だけ、少なくとも一つの第1及び第2の辺に沿って、少なくとも一つ他の線 からずれていることを特徴とする。 15.テクスチャを画素の第1ラスタから画素の第2ラスタにマップする装置に おいて、当該装置は、次の構成を有することを特徴とする。 a. 中央演算処理ユニット(CPU)、 b. 前記CPUを動作させるための格納された命令を含むシステムメモリ、 c. 表示可能な画素データからなるピックスマップを格納するフレームバッ ファであって、そのデータは後退成分qを含む画素値を符号化しており、 d. 表示可能な画素データからなるピックスマップを格納するテクスチャ・ マップ・バッファであって、そのデータは後退成分wを含む画素値を符号化して おり、フレームバッファ・ピックスマップ及びテクスチャ・マップ・ピックスマ ップはマッピング関係に従って互いに関連しており、 e. 前記フレームバッファ及び前記テクスチャ・マップ・バッファに動作的 に接続された画素プロセッサであって、当該画素プロセッサは、 i. 前記フレームバッファ内の画素の領域を特定し、 ii. 量q/wが一定になるように前記テクスチャ・マップ・バッ ファ内の画素に対応する前記フレームバッファ内の画素を通過する線に沿って領 域内の画素を突き止め、 iii.マッピング関係に従って画素値を前記第1ラスタから前記第2ラス タで突き止められた画素にマップする構成となっている。 16.請求項15に記載の装置において、さらに次の構成を有することを特徴と する。 a. 実行可能な命令を収納するシステムメモリと、 b. 前記CPU及び前記システムメモリ間のデータ交換を促進するバスと、 c. 前記CPUによって実行可能で、且つ前記システムメモリに格納された 、命令からなる前記画素プロセッサであって、前記CPUはバスを通って前記シ ステムメモリからフェッチされる命令の通りに動作する構成となっている。 17.請求項15に記載の装置において、前記画素プロセッサは、前記CPUとは 別の個別プロセッサからなることを特徴とする。 18.請求項15に記載の装置において、目に見える内容を有し、前記フレームバ ッファと動作的に結合されたディスプレイからなり、前記ディスプレイの目に見 える内容は、前記フレームバッファに格納されたデータによって決定されること を特徴とする。 19.a.表示内容を有するディスプレイと、 b.テクスチャを前記ディスプレイにマップする手段とからなり、当該手 段は、 i. 画素の前記第1ラスタを定義し、並びに後退成分qを含む画素値を 符号化し且つ表示内容を定義するデータを格納している第1のコンピュータメモ リと、 ii. 画素の前記第2ラスタを定義し、並びに後退成分wを含む画素値を 符号化し且つテクスチャを定義するデータを格納ししている第2のコンピュータ メモリと、 iii.マッピング関係に従って、前記第1ラスタの画素が前記第2ラスタ の画素に対応するように、ラスタ間のマッピング関係を符号化する手段と、 iv. (a) 前記第2ラスタにおける画素の領域を特定し、(b)量q/wが一 定になるように前記第1ラスタの画素に対応する前記第2ラスタの画素を通過す る線に沿った領域内の画素を突き止め、(c)画素値を前記第1ラスタから前記第 2ラスタで突き止められた画素にマップする画素処理手段と、 からなることを特徴とするコンピュータシステム。 19.請求項19に記載のシステムにおいて、前記画素処理手段は、次の工程に より、線形補間を行うことを特徴とする。 a. 対応するそれぞれの前記第1ラスタの画素の値をwで割る工程、 b. 補間値を得るために、そうして割られた前記第1ラスタの画素値の間で 線形補間する工程、 c. 補間値にq/wを掛ける工程。 19.請求項19に記載のシステムにおいて、それぞれが異なる詳細度を表す複 数の予めフィルタ処理されたテクスチャ・マップを格納す る第3のコンピュータメモリをさらに有し、前記画素処理手段は、さらに次の構 成を有することを特徴とする。 a. 前記テクスチャ・マップの一つを選択し、 b. 前記テクスチャ・マップを定義するデータを前記第1ラスタに取り入れ 、 c. 画素値を選択されたテクスチャ・マップから前記第2ラスタで突き止め られた画素にマップする構成。 19.請求項19に記載のシステムにおいて、それぞれのラスタが表面を符号化 しており、それぞれの画素は或る一辺を長さとする表面の正方形面積に対応して おり、画素の領域は複数の辺からなり、前記画素処理手段は複数の線に沿って画 素を突き止めるように構成されており、線はそれぞれ量q/wが一定になる勾配 を有し且つ領域の第1及び第2の辺と交差しており、突き止められた画素は前記 第1及び前記第2の辺の内側かその上にあることを特徴とする。 20.請求項19に記載のシステムにおいて、それぞれの線は一辺の長さに等しい 距離だけ、第1及び第2の辺の少なくとも一つに沿って互いにずれていることを 特徴とする。 21.請求項19に記載のシステムにおいて、 a. マッピング関係に従って前記第1ラスタからマップされた画素は、突き 止められた画素に対応しており、突き止められた画素の少なくともいくつかは、 それぞれ複数の前記第1ラスタ画素に対応しており、 b. 前記画素処理手段はさらに、複数の前記第1ラスタ画素に対応 する突き止められた画素毎に、補間値を得るために対応する前記第1ラスタ画素 の値の間で線形補間し、その後突き止められた画素に補間値を割り当てるように 構成されていることを特徴とする。
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