JPH11506580A - 中間周波増幅器/リミッタ - Google Patents
中間周波増幅器/リミッタInfo
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- JPH11506580A JPH11506580A JP8536326A JP53632696A JPH11506580A JP H11506580 A JPH11506580 A JP H11506580A JP 8536326 A JP8536326 A JP 8536326A JP 53632696 A JP53632696 A JP 53632696A JP H11506580 A JPH11506580 A JP H11506580A
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Abstract
(57)【要約】
中間周波制限増幅器は、制限利得を維持すると共に付加的な小さい信号の利得を与えるため、各増幅器段に局部的な正帰還を使用する。余分な小さい信号の利得は、より小さいバイアス電流の受信器に対し、より高い全体的な感度を生じさせる。同一の信号応答を行うため必要とされる段数の減少により、回路による電力消費の著しい削減が得られる。
Description
【発明の詳細な説明】
中間周波増幅器/リミッタ
本発明は、中間周波増幅器/リミッタに関する。
典型的な多段中間周波増幅器/リミッタは直流源から回路を安定化させるため
帰還ループを使用する。これは、小さい入力信号に対し大きな利得を与え、大き
い入力信号に対し制御された制限を与える。このような中間周波増幅器/リミッ
タは、FMラジオ、アナログセル式電話機及びコードレス電話機に使用される。
典型的な中間周波増幅器/リミッタは欧州特許出願第EP0 517 305
A1号に提案されている。
本発明は、大きい方の信号に対する制限利得を維持すると共に付加的な小さい
信号の利得を与えるため各段に局部的な正帰還を利用する中間周波増幅器/リミ
ッタ回路を提供する。
本発明によれば、局部的な正帰還は、第2のトランジスタの差動ペアを回路に
付加することにより第1の差動増幅器ペアに採り入れられる。第2の差動ペアは
、交差構造の形で第1の差動ペアの出力に接続される。付加的な抵抗は、余分な
小さい信号の利得の直線性の範囲を調整すると共に、第1の差動ペアの利得ブロ
ックに採り入れられた正帰還の量を調整するため回路に付加される。
従って、本発明の目的は、大きい方の入力信号に対する制限利得を維持すると
共に、小さい方の入力信号に対し増加された小さい信号の利得を生成する中間周
波増幅器/リミッタを提供することである。
本発明の他の目的は、特に、感度の改善のため、各段に局部的な正帰還を使用
する中間周波増幅器/リミッタを提供することである。
本発明の他の目的は、より小さいバイアス電流の受信器に対しより良い全体的
な感度を有する中間周波増幅器/リミッタを提供する
ことである。
本発明の更なる目的は、同一の信号応答を与えるため非常に削減された量の電
力しか必要としない中間周波増幅器/リミッタを提供することである。
本発明の更なる目的は、高い信頼性で効率よく動作する中間周波増幅器/リミ
ッタを提供することである。
本発明の他の目的及び特徴は、本発明の幾つかの実施例を開示する添付図面と
共に以下の詳細な説明から明らかになる。しかし、図面は、本発明の制限の定義
としてではなく例示のためだけに描かれている点に注意が必要である。
幾つかの図面を通じて類似した参照名は類似した素子を表わす図面において、
図1aは先行技術の典型的な中間周波回路の図であり、
図1bは、図1aの先行技術の中間周波回路の1段だけを示す図であり、
図2は、本発明の局部的な正帰還を備えた中間周波増幅器/リミッタの第1の
実施例の図であり、
図3は、本発明の局部的な正帰還を備えた中間周波増幅器/リミッタの第2の
実施例の図であり、
図4は、本発明の局部的な正帰還を備えた汎用的な中間周波増幅器/リミッタ
構築ブロックの図であり、
図5aは、シミュレーションのため回路構成部品に特定の値が割当てられた従
来技術の標準的な中間周波増幅器の図であり、
図5bは、シミュレーションのため回路構成部品に特定の値が割当てられた図
2の第1の実施例の変形バージョンの図であり、
図5cは、シミュレーションのため回路構成部品に特定の値が割当てられた図
3の第2の実施例の図であり、
図5d及び5eは、図5a乃至5cの回路のシミュレーションの
間に使用された入力源回路図であり、
図6は、図5の回路の直流伝達(Vinに対するVout、勾配は回路の利得を表
わす)関数のグラフであり、
図7は、X軸上の小さい方のスケールに関する図5の回路の直流伝達関数のグ
ラフであり、
図8aは、シミュレーションのため回路素子に異なる特定の値が割当てられた
図5cに示された回路の変形された実施例の図であり、
図8b及び8cは、図8aの回路のシミュレーションの間に使用された入力源
回路図であり、
図9は、図8aの回路の直流伝達関数のグラフであり、
図10aは、シミュレーションのため回路構成部品に特定の値が割当てられた
本発明の局部的な正帰還を備えた中間周波増幅器/リミッタの第3の実施例の図
であり、
図10b及び10cは、図10aの回路のシミュレーションの間に使用された
入力源回路図であり、
図11は、図10aの回路の直流伝達関数のグラフである。
図1aの図面の詳細を参照するに、先行技術の中間周波制限増幅器の標準的な
回路実装が示される。回路の帰還ループは、回路を安定化させ、かつ、小さい入
力信号に対する大きい利得及び大きい方の入力信号に対する制御された制限を与
える。低周波の帰還ループに起因して、回路の全ノードは、(Vcc−0.5Ita il
Rc)でバイアスされる。非常に高い周波数で、直流ループは開き、全ての差
動増幅器段の全体利得が乗算される。このモードにおいて、各段の利得は、近似
的に以下の式:
により与えられ、式中、
である。
信号が増幅すると共に、最後の増幅器段は、その総テール電流が片側に迂回さ
せられたときに最初の制限を行い、これにより、その出力における最大差動振幅
を(RcItail)に一致させる。図1bには、図1aに示された先行技術の制限
増幅器の1段だけが示される。各段は、第1の差動トランジスタのペアQ1及び
Q2を含む。Q1のエミッタはQ2のエミッタに接続され、双方は電流源Itailに
接続される。Q1のコレクタは抵抗Rc1を介して電圧源(Vcc)に接続される。
Q2のコレクタは、抵抗Rc2を介して電圧源(Vcc)に接続される。トランジス
タQ1及びQ2の夫々のベースは、入力信号の正又は負の部分を受ける。
図2には、本発明による新規の制限中間周波増幅器回路が示される。新規の回
路は、第2の差動トランジスタのペアQ3及びQ4と、夫々にQ3及びQ4のエミッ
タに接続された抵抗RE1及びRE2とを含む局部的な正帰還を利用する。図示され
るように、Q3及びQ4は、局部的な正帰還を実現するため、それらのコレクタが
相互接続される。Q3のベース及びQ4のコレクタは、Q1のコレクタに接続され
る。Q4のベース及びQ3のコレクタは、Q2のコレクタに接続される。抵抗RE1
は、一方の端でQ3のエミッタ出力に接続され他方の端で電流源It2に接続され
る。抵抗RE2は、一方の端でQ4のエミッタ出力に接続され、他方の端で抵抗RE 1
と電流源It2とに接続される。
先行技術の中間周波増幅器/リミッタへの正帰還の採り入れにより、電流消費
の増加を要求することなく、小さい信号の利得が標準的な差動ペアの小さい信号
の利得よりも増加される。小さい信号の利得は、以下の式:
のように定められる。局所的な正帰還により、図2の回路実装は図1の回路実装
よりも少ない段数で同一の回路全体の利得を実現することができる。所望の信号
を得るため必要とされる段数の減少により、回路全体の電流(電力)消費は著し
く削減される。場合によっては、電力消費は最大で50%まで削減される。
第1の差動ペアの利得ブロックに採り入れられた局部的な帰還の量は、抵抗Rc1
及びRc2により制御される。
図3には、局部的な正帰還を備えた中間周波増幅器/リミッタの第2の実施例
が示される。この実装は、第1の差動ペアの利得ブロックに採り入れられた局部
的な帰還の量を制御する別の方法として、夫々にトランジスタQ3及びQ4のベー
スと接続された抵抗RP1及びRP2を使用する。この構造の場合、抵抗RC1及びRP1
は互いに直列接続され、RP1の反対側の端はQ1のコレクタに接続され、RC1
の反対側の端はVccに接続される。抵抗RC2及びRP2は互いに直列接続され、RP2
の反対側の端はQ2のコレクタに接続され、RC2の反対側の端はVccに接続さ
れる。トランジスタQ3及びQ4は図2に示された構造と同じ構造で接続される。
抵抗RP1及びRP2は、第1の差動ペアに採り入れられた正帰還の量を調整する
ため使用される。抵抗RP1及びRP2に対する値の比を調整することにより、利得
を増加させ、その極性を変えることさえ可能である。かくして、上記回路に関し
て、非常に小さい信号の範囲に対し、理論的に無限大の小さい信号の利得を得る
ことが可能である。
小さい信号の直線性の範囲を更に増加させるため、正帰還回路への信号入力を
小さくさせる付加的な抵抗がQ1及びQ2のコレクタに付加される(図4を参照の
こと)。図4の回路は、局部的な正帰還を備えた汎用的な中間周波増幅器/リミ
ッタ構築ブロックを示し
ている。図示されているように、抵抗RE1、RE2、RP1及びRP2は、図2及び3
に示された抵抗と同じである。付加的な抵抗RG1及びRG2がこの回路に付加され
ている。抵抗RG1は、一方の端でQ1のコレクタに接続され、他方の端で抵抗RP 1
とQ3のベースとに接続される。抵抗RG2は、一方の端でQ2のコレクタに接続
され、他方の端で抵抗RP2とQ4のベースとに接続される。
この構造の場合、抵抗RG1、RG2、RE1及びRE2の値が余分な小さい信号の利
得の直線性の範囲を調整するため使用され、一方、抵抗Rc1、Rc2、RP1及びRP2
の値は、第1の差動ペアの利得ブロックに採り入れられた正帰還の量を調整す
るため使用され、これにより、小さい信号の利得に影響を与える。標準的なリミ
ッタ(図1b)と、同一の電流消費を有すると同時に、同一の大きい信号の利得
(制限)を得るため、以下の条件:
It1+It2=Itail (2)
It1(RC1+RP1+RG1)+It2RG1=ItailRL (3)
が適用されるべきである。
図5a乃至5eの回路は、先行技術の中間周波増幅器/リミッタと比較して、
本発明の中間周波増幅器/リミッタの性能を示すためSpice(登録商標)回
路シミュレーションソフトウェアを用いて発生させられた。
図5aは先行技術の標準的な中間周波制限増幅器を表わし、図5bは図2に示
された本発明の第1の実施例の変形された回路を表わし、図5cは本発明の第2
の実施例の変形された回路を表わす。図5bの回路には、回路に採り入れられた
第2の差動ペアのトランジスタQ14及びQ15の別の構造が示されている。Q14の
ベースはQ15のコレクタとQ6のコレクタとに接続され、Q15のベースはQ14の
コレクタとQ7のコレクタとに接続される。
図5d及び5eは、シミュレーション中の図5a乃至5cの回路に対する入力
源を表わす。シミュレーションの目的のため、動作の
例を与えるべく特定の値が夫々の回路素子に割当てられる。
図6及び7には、図5a乃至5cに示された回路の直流伝達関数のグラフが表
わされる。図6は、信号の大きい方の範囲に対する直流伝達関数を示す。図示さ
れているように、図5aの先行技術の回路の直流伝達関数は、Vc(Q2)−Vc
(Q3)により表わされ、中空の矩形の記号によりグラフ的に示される。図5b
の回路の直流伝達関数は、Vc(Q6)−Vc(Q7)により表わされ、中実の矩形
の記号によりグラフ的に示される。図5cの回路の直流伝達関数は、Vc(Q12
)−Vc(Q13)により表わされ、中実の菱形の記号によりグラフ的に示される
。上記三つの回路は全て同一の総体的な制限利得と、厳密に同一の電流消費とを
有するが、図5bの回路の方が小さい信号の利得がより大きく、図5cの回路は
最大の小さい信号の利得を有する点に注意する必要がある。図7は、−50mV
乃至+50mVのX軸上の小さい方の範囲に関する直流伝達関数を示す。図5b
の回路の直流伝達関数は、信号利得上にエミッタ縮退の効果を示し、一方、図5
cの回路の直流伝達信号は、0mVの交差で実質的に垂直方向の勾配を示し、こ
れは、略無限大の小さい信号の利得を意味する。
図8aは、夫々の電気部品に異なる値が割当てられた図5cの回路の他の例を
示す。図8b及び8cは、シミュレーションの目的用の図8aの回路に対する入
力を表わす。
図9は、図8aの回路の直流伝達関数のグラフを表わす。直流伝達関数は、VC
(Q1)−Vc(Q2)により表わされる。このシミュレーションは、図8aの回
路の抵抗R1乃至R4の値を変えることにより、直流伝達関数の極性の変化が生
じる程度まで正帰還を増加させ得ることを示している。
図10aは、図5cの回路の変形されたバージョンの例を示す。特に、トラン
ジスタQ23及びQ24のエミッタに夫々接続された抵抗R26及びR30が付加さ
れている。図10b及び10cの回路は、
シミュレーションのため使用される入力信号を表わす。図11は、図10aの回
路の直流伝達関数のグラフを表わす。0mVの範囲の非常に急な勾配は、小さい
入力信号に対する非常に高い利得を意味する。
本発明の幾つかの実施例が図示、説明されているが、添付の請求の範囲に定義
されるように、本発明の精神及び範囲を逸脱することなく、それらの実施例に多
数の変更及び変形が行われることを理解する必要がある。
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フロントページの続き
(72)発明者 フォトワット−アーマディ,アリ フォト
ワット−アーマディ
アメリカ合衆国,カリフォルニア州
94089,サニーベール,ウエスト・オリー
ヴ 1014番,1号
Claims (1)
- 【特許請求の範囲】 1. 入力信号を受け、その出力に利得を有する出力信号を生成する第1の差動 増幅器ペアと、 上記第1の差動増幅器ペアに接続され、上記出力信号の利得の振幅を制御する 抵抗手段と、 上記第1の差動増幅器ペアの上記出力に接続された入力を有し、局部的な正帰 還を上記第1の差動増幅器ペアに採り入れる帰還手段とからなる中間周波増幅器 /リミッタ。 2. 上記第1の差動ペアは、 ベースに入力信号を受け、第1の電流源に接続されたエミッタを有する第1の トランジスタと、 ベースに入力信号を受け、上記第1のトランジスタの上記エミッタと上記第1 の電流源とに接続されたエミッタを有する第2のトランジスタとにより構成され る請求項1記載の中間周波増幅器/リミッタ。 3. 上記抵抗手段は、 一方の端で上記第1のトランジスタのコレクタに接続され、他方の端で電圧源 (Vcc)に接続された第1の抵抗と、 一方の端で上記第2のトランジスタのコレクタに接続され、他方の端で上記電 圧源(Vcc)に接続された第2の抵抗とにより構成され、 上記第1及び第2の抵抗は、上記第1の差動ペアに採り入れられた局部的な正 帰還の量を制御する、請求項2記載の中間周波増幅器/リミッタ。 4. 上記帰還手段は、 上記第1のトランジスタの上記ベースに接続されたベースと、上記第2のトラ ンジスタの上記コレクタに接続されたコレクタと、第2の電流源に接続されたエ ミッタとを有する第3のトランジスタと、 上記第2のトランジスタの上記コレクタに接続されたベースと、上記第1のト ランジスタの上記コレクタに接続されたコレクタと、上記第3のトランジスタの 上記エミッタ及び上記第2の電流源に接続されたエミッタとを有する第4のトラ ンジスタとにより構成され、 上記第3及び第4のトランジスタは第2の差動ペアを画成し、 上記帰還手段は、上記第1の差動ペアに採り入れられた局部的な正帰還の量を 制御し、上記出力信号の利得の直線性の範囲を更に調整する調整手段と更に有す る、請求項3記載の中間周波増幅器/リミッタ。 5. 上記調整手段は、 一方の端で上記第3のトランジスタの上記エミッタに接続され、他方の端で上 記第2の電流源に接続された第3の抵抗と、 一方の端で上記第4のトランジスタの上記エミッタに接続され、他方の端で上 記第2の電流源に接続された第4の抵抗とにより構成され、 上記第3及び第4の抵抗は、上記出力信号の利得の直線性の範囲を調整する、 請求項4記載の中間周波増幅器/リミッタ。 6. 上記調整手段は、 一方の端で上記第3のトランジスタの上記ベース及び上記第1のトランジスタ の上記コレクタに接続され、他方の端で上記第1の抵抗に接続された第3の抵抗 と、 一方の端で上記第4のトランジスタの上記ベース及び上記第2のトランジスタ の上記コレクタに接続され、他方の端で上記第2の抵抗に接続された第4の抵抗 とにより構成され、 上記第3及び第4の抵抗は、上記第1の差動ペアに採り入れられた局部的な正 帰還の量を制御する、請求項4記載の中間周波増幅器/リミッタ。 7. 上記調整手段は、 一方の端で上記第3のトランジスタの上記エミッタに接続され、他方の端で上 記第2の電流源に接続された第3の抵抗と、 一方の端で上記第4のトランジスタの上記エミッタに接続され、他方の端で上 記第2の電流源に接続された第4の抵抗とにより構成され、 上記第3及び第4の抵抗は、上記出力信号の利得の直線性の範囲を調整し、 上記調整手段は、 一方の端で上記第3のトランジスタの上記ベースに接続され、他方の端で上記 第1の抵抗に接続された第5の抵抗と、 一方の端で上記第4のトランジスタの上記ベースに接続され、他方の端で上記 第2の抵抗に接続された第6の抵抗とを更に有し、 上記第5及び第6の抵抗は、上記第1の差動ペアに採り入れられた局部的な正 帰還の量を制御し、 上記調整手段は、 一方の端で上記第1のトランジスタの上記コレクタに接続され、他方の端で上 記第5の抵抗及び上記第3のトランジスタの上記ベースに接続された第7の抵抗 と、 一方の端で上記第2のトランジスタの上記コレクタに接続され、他方の端で上 記第6の抵抗及び上記第4のトランジスタの上記ベースに接続された第8の抵抗 とを更に有し、 上記第7及び第8の抵抗は、上記出力信号の利得の直線性の範囲を調整する、 請求項4記載の中間周波増幅器/リミッタ。 8. 第1のトランジスタの差動ペアを有する中間周波増幅器/リミッタの感度 を増大させ、回路を動作させるため必要な電力の量を低下させる方法であって、 上記差動ペアの出力に正の局部的な帰還を採り入れる段階と、 所望の出力信号を得るため、上記差動ペアの上記出力に採り入れられた正の局 部的な帰還の量を調整する段階とからなる方法。 9. 上記正の局部的な帰還を採り入れる段階は、上記中間周波増幅器/リミッ タの出力に接続された第2のトランジスタの差動ペアを付加することにより行わ れる請求項8記載の方法。 10. 上記第1の差動ペアに採り入れられた正の局部的な帰還の量を調整する 段階は、上記第1及び第2の差動ペアの結合に抵抗を選択的に付加することによ り行われる請求項8記載の方法。
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