JPH1126651A - 電子回路のパッケージ構造 - Google Patents
電子回路のパッケージ構造Info
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Abstract
ールド中に封入する電子回路のパッケージ構造において
は、モールド枠やマスキング枠を設けたり、リード・フ
レームを用いたり、シールド・ケースを取り付けたりす
るために、小型、薄型化が妨げられ、製造コストを下げ
ることも難しかった。 【解決手段】 回路部品を実装した回路基板(1)に上
板(4)を、上板の下面(5)を回路部品中で最も高さ
が高いもの(3)に当接させて重ね、この間に樹脂
(6)を充填して回路部品を封入した構造とする。上板
(4)は絶縁材や金属板などのほか、絶縁材と金属層
(8)の積層材を用いてもよく、それらの場合金属層は
シールド作用を果たす。回路基板上にモールド枠等の場
所を必要とせず、上板が回路部品に当接しているから最
大限に小型、薄型化でき、しかも上板に積層した金属層
がシールド作用を行うとともに、遮光性、放熱性を向上
させる。
Description
チップを始めとする小型の電子回路部品を搭載し、樹脂
で封止して回路部品を埋設した電子回路モジュールのパ
ッケージ構造に関する。
して一定の機能を持つユニットとした回路モジュール
は、多様な種類のものが現れるとともに小型化が進み、
電子機器に表面実装するのに適したものが普及しつつあ
る。このような小型回路のパッケージ構造として、図3
(A)のものは発明者らが従来から製造しているもの
で、寸法の一例を上げれば縦横10mm以下、高さ5m
m以下程度である。そのB−B断面を図3(B)に示す
が、回路基板101にICチップ102やチップ抵抗、
チップ・コンデンサ等の回路部品103を実装し、基板
周辺の一部または全部にモールド枠104を接合し、そ
の内側にエポキシ等の樹脂105を注入して回路部品を
埋設し、金属のシールド・ケース106を取り付けたも
のである。シールド・ケース106に開けた窓107
は、回路中の光電素子のための光の通路である。
造で、そのD−D断面を図(D)に示すが、回路基板1
01の両側に樹脂を盛ってない箇所108があり、これ
は製造時にこの部分にマスキング材を土手状に仮接合し
ておき、マスキング材の間に樹脂を注入して固化した
後、マスキング材を除去したものである。このパッケー
ジにも金属のシールド・ケース106を取り付けてあ
る。
もので、そのF−F断面を図3(F)に示すが、回路に
リード109を接続し、トランスファ・モールドにより
回路を樹脂110中に封入したものである。
ジュールのパッケージ構造は、次のような問題を持って
いる。すなわち、図3(A)、(B)のものは、封止用
の樹脂105を一定の量と形状にするためにモールド枠
104を用いているが、このモールド枠104は完成モ
ジュールの構成部品の一部をなし、そしてモールド枠1
04の高さは回路部品の高さに対し若干余裕を持たせて
おくため、パッケージの小型、薄型化の支障となり、製
造コストの低減も難しい。図3(C)、(D)のもの
は、完成モジュールにはモールド枠を含まないものの、
樹脂の量と形状を一定にするために製造工程でこれに類
似したマスキング材を用い、樹脂の注入後に除去するの
であるから、やはり前記と同様の問題を持っている。図
3(E)、(F)のものは構成材料にリード・フレーム
が加わってコスト要因となり、完成形状も前記のものの
ようなチップ状でなくリードが張り出しているため、小
型、薄型化に不向きである。本発明はこれらの問題を解
決して、小型、薄型化に適するとともに廉価に製造で
き、信頼性も十分な電子回路のパッケージ構造を提供す
るものである。
ケージは、回路部品を実装した回路基板に上板を乗せ、
回路基板と上板の間に封止用の樹脂を充填した構造であ
る。言い替えれば、回路基板と上板が樹脂部分をサンド
イッチ状に挟持し、樹脂中に回路部品を埋設している。
上板の下面は抵抗やコンデンサ等の回路部品の中で高さ
の最も高いものに当接させる。従って樹脂層の厚さが回
路部品の厚さと同等になって、パッケージの厚さが最小
限に収まる。またパッケージの各側面が樹脂面となり、
回路基板にモールド枠やマスキング枠を配置するための
場所を設ける必要がない。上板には絶縁材を用いるな
り、あるいは回路部品の表面が十分に絶縁されていて短
絡の恐れがないならば、金属板を用いるなりする。さら
に絶縁材の上板に金属層を重ねてもよく、このように金
属層を設けることにより遮蔽機能が得られ、従来のよう
なシールド・ケースを用いなくとも信頼性が維持され
る。
施形態を説明する。図1は、本発明による電子回路のパ
ッケージ構造の第1の実施形態を示し、図1(A)は外
観図、図1(B)は図1(A)のB−B断面図である。
図1(B)にて、回路基板1にICチップ2およびチッ
プ状の抵抗、コンデンサその他の回路部品が実装してあ
り、その中で一番高さの高いものを回路部品3としてあ
る。上部に上板4を、高さが一番高くて回路基板から一
番出っ張っている回路部品3に下面5を当接させて配置
してある。そして回路基板1と上板4の間を樹脂6で充
填することにより、全体を接合するとともに樹脂中に回
路部品を埋設して機械的に保護し、外気からも保護して
いる。
装置への接続用の端子電極が設けてある。回路基板1の
側面の円弧状に窪んだ部分7は、窪みの内面に導電材を
被覆した導電部で、回路基板1の素材に設けてあったス
ルーホールの一部であり、この導電部7によって回路基
板1の上面の導電パターンと下面の端子電極を接続して
いる。
となく下面5を回路部品3に当接させることができる。
製品の薄型化のため、強度の許す範囲で極力薄手の材料
(例えば0.1mm前後)を用いる。モジュールの機能
によってはフォト・トランジスタ、フォト・ダイオー
ド、LED等の受光、発光の光電素子を含むから、その
場合は上板4は光を通すことが必要で、光の強度に応じ
て透明または半透明の樹脂材料等を用いる。しかし他方
に遮光を要する回路部品があるなら、その箇所は上板4
にマスク印刷などを施しておく。
である場合には、上板4を金属板にすることができる。
金属板の上板からはシールド作用が得られる。シールド
作用の安定のために金属の上板4を回路基板1の接地パ
ターンに接続するには、例えば接地パターン上に接地用
のばね片や導電エラストマ等を置き、上板4の下面に当
接させるなどの構造を取ることができる。金属板の上板
4はシールド作用以外にも、遮光性や放熱性に優れると
いう利点がある。
て絶縁膜を形成しておけば、回路部品3に当接させても
短絡の恐れがない。金属板の上板4を接地するには、下
面5の絶縁被覆を一部省き、ここに前記の接地用ばね片
等が当接するようにする。
(A)は外観図、図2(B)は図2(A)のB−B断面
図である。基本構造は図1と同様であるが、絶縁材の上
板4の上に金属層8を重ねてシールド機能を持たせたも
のである。一般に、上板4および金属層8として、印刷
回路基板材料のような絶縁材と金属箔を一体に積層した
ものを用いるのが便利である。金属層8の接地は、例え
ば上板4の下面5に小面積のランド部を設け、スルーホ
ールで上面の金属層8に接続し、前述のように回路基板
1の接地パターンに設けた接地用のばね片等がこのラン
ド部に当接するようにして行うことができる。この場合
スルーホールは、樹脂6がパッケージ表面に流れ出ない
程度に小径のものや、予め封止してあるもの、あるいは
穴が導電材でふさがっているものなどが望ましい。金属
層8を設けることにより、前述のように、シールド機能
のほか遮光性と放熱性が向上する。
窓9は、回路が光電素子を含む場合の光の通路で、フォ
ト・エッチングして形成する。その場合、光が通るよう
上板4には透明または半透明の材料を用いる。従来のよ
うに別体のシールド・ケースを用いたパッケージでは、
回路の種別などの表示のためにシールド・ケースに記号
を刻印することがあったが、本発明のごとくシールド・
ケースを用いずに金属層8を設ける場合には、刻印など
の工程によらなくとも、記号を窓9などと同時にパター
ニングすることができ、製造コストを下げる上で有利で
ある。
的にはICチップ2、回路部品3等を実装した回路基板
1の部品搭載面に樹脂6を塗布し、上板4を押しつけて
下面5を回路部品3に当接させ、周囲からはみ出した樹
脂を削り取って固化することにより得られる構造であ
る。しかし実際の製造に当たってはもっと便利な方法を
用いる。例えば、大面積の集合基板に個々の回路モジュ
ールとなる多くの領域を設け、それぞれの領域に回路部
品を実装し、その上にこれも大面積の集合上板をかぶせ
て、その下面を集合基板上に多数搭載された回路部品群
3の上面に当接させて保持し、集合基板の周囲に樹脂の
注入部を除いてモールド枠を設けておくなり、集合基板
の周囲を注入部を残して塞ぐ治具を用いるなりして樹脂
を注入、固化し、これをダイシングして回路モジュール
を多数個取りで得るのである。しかし、ここでは製造方
法について詳述することは省く。
ジュールは従来のようなモールド枠やリード・フレー
ム、あるいはシールド・ケースといった部品を用いない
から、部品数が減ってコストが下がる。回路基板にはモ
ールド枠の搭載場所が不要で面積を小さくでき、またモ
ジュールの厚さは回路基板の厚さと回路部品の高さと上
板の厚さの和にほぼ等しくて余分の厚さを必要とせず、
最大限の小型、薄型化が可能になる。回路部品は樹脂中
に封入されて機械的に保護され、外部の雰囲気からも保
護されてモジュールの信頼性が保たれる。そして上板に
金属板あるいは金属箔との積層板を用いるならば、シー
ルド・ケースを用いなくとも遮蔽作用が得られるととも
に、遮光性や放熱性が向上する。また、金属層のパター
ニングにより、種別などの記号の表示を従来より簡単に
行えるという利点もある。
であって、図(A)は外観図、図(B)は図(A)のB
−B断面図である。
形態であって、図(A)は外観図、図(B)は図(A)
のB−B断面図である。
(A)、図(C)および図(E)はそれぞれ外観図であ
り、図(B)、図(D)および図(F)はそれぞれ図
(A)、図(C)および図(E)のB−B断面図、D−
D断面図およびF−F断面図である。
Claims (5)
- 【請求項1】 回路部品を実装した回路基板の上に上板
を重ねて配置し、上板は下面を回路部品のうち最も高さ
の高いものに当接させ、回路基板と上板の間に充填した
樹脂中に回路部品を封入した電子回路のパッケージ構
造。 - 【請求項2】 請求項1に記載の電子回路のパッケージ
構造において、上板は下面に絶縁被覆を施した金属板で
ある電子回路のパッケージ構造。 - 【請求項3】 請求項1に記載の電子回路のパッケージ
構造において、絶縁材の上板にさらに金属層を重ねた電
子回路のパッケージ構造。 - 【請求項4】 請求項3に記載の電子回路のパッケージ
構造において、上板と金属層として絶縁材と金属箔の積
層材料を用いた電子回路のパッケージ構造。 - 【請求項5】 請求項3に記載の電子回路のパッケージ
構造において、上板を透光性の材料とし、金属層の一部
に窓を設けた電子回路のパッケージ構造。
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Application Number | Priority Date | Filing Date | Title |
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JP19335397A JP3824742B2 (ja) | 1997-07-04 | 1997-07-04 | 電子回路のパッケージ構造 |
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Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001237584A (ja) * | 2000-02-21 | 2001-08-31 | Murata Mfg Co Ltd | 電子装置及びその製造方法、及びそれを用いた通信装置 |
JP2007129304A (ja) * | 2005-11-01 | 2007-05-24 | Taiyo Yuden Co Ltd | 高周波無線モジュール |
KR100737098B1 (ko) | 2006-03-16 | 2007-07-06 | 엘지이노텍 주식회사 | 전자파 차폐장치 및 그 제조 공정 |
JP2011155213A (ja) * | 2010-01-28 | 2011-08-11 | Tdk Corp | 回路モジュールの製造方法 |
JP2012124407A (ja) * | 2010-12-10 | 2012-06-28 | Murata Mfg Co Ltd | 回路モジュール及びその製造方法 |
WO2012105394A1 (ja) * | 2011-02-01 | 2012-08-09 | 株式会社村田製作所 | 電子部品モジュール、及び該電子部品モジュールを備える多機能カード |
US9865518B2 (en) | 2014-11-07 | 2018-01-09 | Shin-Etsu Chemical Co., Ltd. | Electromagnetic wave shielding support base-attached encapsulant, encapsulated substrate having semicondutor devices mounted thereon, encapsulated wafer having semiconductor devices formed thereon, and semiconductor apparatus |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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1997
- 1997-07-04 JP JP19335397A patent/JP3824742B2/ja not_active Expired - Fee Related
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001237584A (ja) * | 2000-02-21 | 2001-08-31 | Murata Mfg Co Ltd | 電子装置及びその製造方法、及びそれを用いた通信装置 |
JP2007129304A (ja) * | 2005-11-01 | 2007-05-24 | Taiyo Yuden Co Ltd | 高周波無線モジュール |
KR100737098B1 (ko) | 2006-03-16 | 2007-07-06 | 엘지이노텍 주식회사 | 전자파 차폐장치 및 그 제조 공정 |
JP2011155213A (ja) * | 2010-01-28 | 2011-08-11 | Tdk Corp | 回路モジュールの製造方法 |
JP2012124407A (ja) * | 2010-12-10 | 2012-06-28 | Murata Mfg Co Ltd | 回路モジュール及びその製造方法 |
WO2012105394A1 (ja) * | 2011-02-01 | 2012-08-09 | 株式会社村田製作所 | 電子部品モジュール、及び該電子部品モジュールを備える多機能カード |
US9865518B2 (en) | 2014-11-07 | 2018-01-09 | Shin-Etsu Chemical Co., Ltd. | Electromagnetic wave shielding support base-attached encapsulant, encapsulated substrate having semicondutor devices mounted thereon, encapsulated wafer having semiconductor devices formed thereon, and semiconductor apparatus |
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