JPH10207437A - 消費電力制御装置と消費電力の制御方法 - Google Patents
消費電力制御装置と消費電力の制御方法Info
- Publication number
- JPH10207437A JPH10207437A JP9027301A JP2730197A JPH10207437A JP H10207437 A JPH10207437 A JP H10207437A JP 9027301 A JP9027301 A JP 9027301A JP 2730197 A JP2730197 A JP 2730197A JP H10207437 A JPH10207437 A JP H10207437A
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- JP
- Japan
- Prior art keywords
- synchronization signal
- signal
- polarity
- power consumption
- display device
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- Controls And Circuits For Display Device (AREA)
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Abstract
(57)【要約】
【課題】 ＬＣＤにおいてもＣＲＴと同等の省電力モー
ドを実現することができるようにした。 【解決手段】 ホストコンピュータからの表示データを
受けた信号生成回路５は、該表示データに基づいてＣＲ
Ｔ用の同期信号及び画像信号とＬＣＤ用の同期信号及び
画像データ信号とを生成し、この内ＣＲＴ用の同期信号
ｂとＬＣＤ用の同期信号ｃ及び画像データ信号ｅをＬＣ
Ｄ制御回路６に供給する。ＬＣＤ制御回路６ではＣＲＴ
用の同期信号ｂについて同期信号の種別（水平同期信号
又は垂直同期信号）を判別し、さらにこれら同期信号の
極性を統一し、該極性を監視しながら省電力モードの判
別を行う。これにより、ＬＣＤにおいても、ＣＲＴと同
様、ＶＥＳＡで規定された省電力モードを実現する。
ドを実現することができるようにした。 【解決手段】 ホストコンピュータからの表示データを
受けた信号生成回路５は、該表示データに基づいてＣＲ
Ｔ用の同期信号及び画像信号とＬＣＤ用の同期信号及び
画像データ信号とを生成し、この内ＣＲＴ用の同期信号
ｂとＬＣＤ用の同期信号ｃ及び画像データ信号ｅをＬＣ
Ｄ制御回路６に供給する。ＬＣＤ制御回路６ではＣＲＴ
用の同期信号ｂについて同期信号の種別（水平同期信号
又は垂直同期信号）を判別し、さらにこれら同期信号の
極性を統一し、該極性を監視しながら省電力モードの判
別を行う。これにより、ＬＣＤにおいても、ＣＲＴと同
様、ＶＥＳＡで規定された省電力モードを実現する。
Description
【０００１】
【発明の属する技術分野】本発明は消費電力制御装置と
消費電力の制御方法に関し、特に、液晶表示装置の消費
電力を制御する消費電力制御装置と消費電力の制御方法
に関する。
消費電力の制御方法に関し、特に、液晶表示装置の消費
電力を制御する消費電力制御装置と消費電力の制御方法
に関する。
【０００２】
【発明が解決しようとする課題】従来より、グラフィッ
ク環境の業界標準を推進しているＶＥＳＡ（Video Elec
tronics Standards Association)によってＤＰＭＳ（Di
splay Power ManagementSignaling) という消費電力の
管理手法が標準化されている。該ＤＰＭＳは、陰極線管
表示装置（以下「ＣＲＴ」という。）だけでなく、液晶
表示装置（以下「ＬＣＤ」という。）をも対象とし、表
示装置に入力される同期信号を組み合わせて該表示装置
の待機状態を検知するものである。
ク環境の業界標準を推進しているＶＥＳＡ（Video Elec
tronics Standards Association)によってＤＰＭＳ（Di
splay Power ManagementSignaling) という消費電力の
管理手法が標準化されている。該ＤＰＭＳは、陰極線管
表示装置（以下「ＣＲＴ」という。）だけでなく、液晶
表示装置（以下「ＬＣＤ」という。）をも対象とし、表
示装置に入力される同期信号を組み合わせて該表示装置
の待機状態を検知するものである。
【０００３】そして、前記同期信号は、通常はＰＣＩ
（Peripheral Component Interconnect)バス等のバスを
介してホストコンピュータから出力される表示データに
基づき生成される。すなわち、ホストコンピュータから
出力された表示データはバスを介して信号生成回路に入
力され、該信号生成回路で前記同期信号の生成がなされ
る。
（Peripheral Component Interconnect)バス等のバスを
介してホストコンピュータから出力される表示データに
基づき生成される。すなわち、ホストコンピュータから
出力された表示データはバスを介して信号生成回路に入
力され、該信号生成回路で前記同期信号の生成がなされ
る。
【０００４】ところで、一般にＣＲＴ用の同期信号とＬ
ＣＤ用の同期信号とは別々に生成されるが、ＣＲＴ用同
期信号にはＶＥＳＡで規定され標準化された省電力モー
ド制御信号が含まれる一方、ＬＣＤ用の同期信号には前
記省電力モード制御信号が含まれていない。また、この
場合、信号生成回路として高解像の表示装置に対応した
ＳＶＧＡ（Super Video Graphics Array) チップを使用
して該ＳＶＧＡチップによりＬＣＤ用に別途省電力モー
ド制御信号を生成したとしても、該省電力モード制御信
号はＳＶＧＡチップの性能の依存してしまうため、ＬＣ
Ｄにおいては必ずしもＣＲＴ用省電力モード制御信号と
同等の省電力モード制御信号が得られるとは限らない。
ＣＤ用の同期信号とは別々に生成されるが、ＣＲＴ用同
期信号にはＶＥＳＡで規定され標準化された省電力モー
ド制御信号が含まれる一方、ＬＣＤ用の同期信号には前
記省電力モード制御信号が含まれていない。また、この
場合、信号生成回路として高解像の表示装置に対応した
ＳＶＧＡ（Super Video Graphics Array) チップを使用
して該ＳＶＧＡチップによりＬＣＤ用に別途省電力モー
ド制御信号を生成したとしても、該省電力モード制御信
号はＳＶＧＡチップの性能の依存してしまうため、ＬＣ
Ｄにおいては必ずしもＣＲＴ用省電力モード制御信号と
同等の省電力モード制御信号が得られるとは限らない。
【０００５】本発明はこのような事情に鑑みなされたも
のであって、ＬＣＤにおいてもＣＲＴと同等の省電力モ
ードを実現することができる消費電力制御装置と消費電
力の制御方法を提供することを目的とする。
のであって、ＬＣＤにおいてもＣＲＴと同等の省電力モ
ードを実現することができる消費電力制御装置と消費電
力の制御方法を提供することを目的とする。
【０００６】
【課題を解決するための手段】上記目的を達成するため
に請求項１記載の発明は、情報処理装置と液晶表示装置
との間に介装された消費電力制御装置であって、少なく
とも陰極線管表示装置用の第１の同期信号と液晶表示装
置用の第２の同期信号を含む所定データ信号とを生成す
る信号生成手段と、前記第１の同期信号の内容を解析し
て所定の省電力情報を前記液晶表示装置に送出する同期
信号解析手段とを備えていることを特徴としている。
に請求項１記載の発明は、情報処理装置と液晶表示装置
との間に介装された消費電力制御装置であって、少なく
とも陰極線管表示装置用の第１の同期信号と液晶表示装
置用の第２の同期信号を含む所定データ信号とを生成す
る信号生成手段と、前記第１の同期信号の内容を解析し
て所定の省電力情報を前記液晶表示装置に送出する同期
信号解析手段とを備えていることを特徴としている。
【０００７】また、請求項５記載の発明は、情報処理装
置から出力される表示データを液晶表示装置に表示する
と共に、前記情報処理装置からの出力状態に応じて前記
液晶表示装置の消費電力を制御する消費電力の制御方法
であって、少なくとも陰極線管表示装置用の第１の同期
信号と液晶表示装置用の第２の同期信号を含む所定デー
タ信号とを生成する信号生成ステップと、前記第１の同
期信号の内容を解析して所定の省電力情報を前記液晶表
示装置に送出する同期信号解析ステップとを含んでいる
ことを特徴としている。
置から出力される表示データを液晶表示装置に表示する
と共に、前記情報処理装置からの出力状態に応じて前記
液晶表示装置の消費電力を制御する消費電力の制御方法
であって、少なくとも陰極線管表示装置用の第１の同期
信号と液晶表示装置用の第２の同期信号を含む所定デー
タ信号とを生成する信号生成ステップと、前記第１の同
期信号の内容を解析して所定の省電力情報を前記液晶表
示装置に送出する同期信号解析ステップとを含んでいる
ことを特徴としている。
【０００８】
【発明の実施の形態】図１は本発明に係る消費電力制御
装置としてのＬＣＤ用消費電力制御装置の一実施の形態
を示すブロック構成図であって、該ＬＣＤ用消費電力制
御装置１は、ＰＣＩバス２を介して接続されたホストコ
ンピュータ３と画像データを画面上に表示するＬＣＤ４
との間に介装されている。
装置としてのＬＣＤ用消費電力制御装置の一実施の形態
を示すブロック構成図であって、該ＬＣＤ用消費電力制
御装置１は、ＰＣＩバス２を介して接続されたホストコ
ンピュータ３と画像データを画面上に表示するＬＣＤ４
との間に介装されている。
【０００９】ＬＣＤ用消費電力制御装置１は、ＰＣＩバ
ス２からの表示データ信号ａが入力されてＣＲＴ用及び
ＬＣＤ用の夫々の各同期信号（水平同期信号（Ｈsync）
及び垂直同期信号（Ｖsync））ｂ、ｃとＣＲＴ用及びＬ
ＣＤ用のＲＧＢの画像データ信号ｄ、ｅとを生成する信
号生成回路５と、ＣＲＴ用及びＬＣＤ用の夫々の各同期
信号ｂ、ｃ及びＬＣＤ用の画像データ信号ｅとが入力さ
れるＬＣＤ制御回路６とを備えている。
ス２からの表示データ信号ａが入力されてＣＲＴ用及び
ＬＣＤ用の夫々の各同期信号（水平同期信号（Ｈsync）
及び垂直同期信号（Ｖsync））ｂ、ｃとＣＲＴ用及びＬ
ＣＤ用のＲＧＢの画像データ信号ｄ、ｅとを生成する信
号生成回路５と、ＣＲＴ用及びＬＣＤ用の夫々の各同期
信号ｂ、ｃ及びＬＣＤ用の画像データ信号ｅとが入力さ
れるＬＣＤ制御回路６とを備えている。
【００１０】しかして、ＬＣＤ制御回路６は、ＬＣＤ用
同期信号ｃ及びＬＣＤ用画像データ信号ｅに基づいて所
定の信号処理を行う一方、ＣＲＴ用の同期信号ｂに基づ
いて水平同期信号（Ｈsync）と垂直同期信号（Ｖsync）
とを判別し、極性検出や省電力モード検出を行ない、省
電力モード情報を含んだＬＣＤ表示信号ｆをＬＣＤ４に
出力する。
同期信号ｃ及びＬＣＤ用画像データ信号ｅに基づいて所
定の信号処理を行う一方、ＣＲＴ用の同期信号ｂに基づ
いて水平同期信号（Ｈsync）と垂直同期信号（Ｖsync）
とを判別し、極性検出や省電力モード検出を行ない、省
電力モード情報を含んだＬＣＤ表示信号ｆをＬＣＤ４に
出力する。
【００１１】ＬＣＤ制御回路６は、具体的には、図２
（ａ）に示す極性レジスタ及び図２（ｂ）に示すＤＰＭ
Ｓレジスタが内蔵されている。
（ａ）に示す極性レジスタ及び図２（ｂ）に示すＤＰＭ
Ｓレジスタが内蔵されている。
【００１２】すなわち、極性レジスタは、図２（ａ）に
示すように、水平同期信号（Ｈsync）の極性が書き込ま
れる第１の極性情報格納部７と、垂直同期信号（Ｖsyn
c）の極性が書き込まれる第２の極性情報格納部８とを
有している。そして、これら第１及び第２の極性情報格
納部７、８に格納される極性情報は、信号生成回路５及
び表示モードによって予め決定されており、第１及び第
２の極性情報格納部７、８に「０」が書き込まれたとき
は同期信号の入力極性をそのままにして極性検出を行
い、該第１及び第２の極性情報格納部７、８に「１」が
書き込まれたときは同期信号の入力極性を反転させて極
性検出を行う。
示すように、水平同期信号（Ｈsync）の極性が書き込ま
れる第１の極性情報格納部７と、垂直同期信号（Ｖsyn
c）の極性が書き込まれる第２の極性情報格納部８とを
有している。そして、これら第１及び第２の極性情報格
納部７、８に格納される極性情報は、信号生成回路５及
び表示モードによって予め決定されており、第１及び第
２の極性情報格納部７、８に「０」が書き込まれたとき
は同期信号の入力極性をそのままにして極性検出を行
い、該第１及び第２の極性情報格納部７、８に「１」が
書き込まれたときは同期信号の入力極性を反転させて極
性検出を行う。
【００１３】また、ＤＰＭＳレジスタは、図２（ｂ）に
示すように、水平同期信号（Ｈsync）の有無情報を格納
するＨsync情報格納部９と、垂直同期信号（Ｖsync）の
有無情報を格納するＶsync情報格納部１０とを有してお
り、該Ｈsync情報格納部９及びＶsync情報格納部１０に
夫々「１」が書き込まれたときにこれら水平同期信号及
び垂直同期信号の存在を検出する。
示すように、水平同期信号（Ｈsync）の有無情報を格納
するＨsync情報格納部９と、垂直同期信号（Ｖsync）の
有無情報を格納するＶsync情報格納部１０とを有してお
り、該Ｈsync情報格納部９及びＶsync情報格納部１０に
夫々「１」が書き込まれたときにこれら水平同期信号及
び垂直同期信号の存在を検出する。
【００１４】図３はＬＣＤ制御回路６に内蔵された極性
検出部の電気回路図であって、該極性検出部は、第１及
び第２のアンドゲート１１、１２とオアゲート１３を有
している。
検出部の電気回路図であって、該極性検出部は、第１及
び第２のアンドゲート１１、１２とオアゲート１３を有
している。
【００１５】以下、水平同期信号が入力された場合の極
性検出について説明するが、垂直同期信号についても同
様である。
性検出について説明するが、垂直同期信号についても同
様である。
【００１６】水平同期信号が負極性信号の場合は、極性
レジスタの第１の極性情報格納部７は「０」に設定さ
れ、したがって極性情報は「０」となる。これにより第
１のアンドゲート１１はマスクされ、出力は「０」とな
る。一方、第２のアンドゲート１２はオープンになり、
水平同期信号の極性は変わらない。よって、オアゲート
１３からは「０」が出力される。
レジスタの第１の極性情報格納部７は「０」に設定さ
れ、したがって極性情報は「０」となる。これにより第
１のアンドゲート１１はマスクされ、出力は「０」とな
る。一方、第２のアンドゲート１２はオープンになり、
水平同期信号の極性は変わらない。よって、オアゲート
１３からは「０」が出力される。
【００１７】一方、水平同期信号が正極性信号の場合
は、極性レジスタの第１の極性情報格納部７は「１」に
設定され、したがって極性情報は「１」となる。これに
より、第２のアンドゲート１２はマスクされ、出力は
「０」となる。一方、第１のアンドゲート１１はオープ
ンになると共に正極性信号を反転した水平同期信号が入
力され、その結果オアゲート１３からは「０」が出力さ
れる。
は、極性レジスタの第１の極性情報格納部７は「１」に
設定され、したがって極性情報は「１」となる。これに
より、第２のアンドゲート１２はマスクされ、出力は
「０」となる。一方、第１のアンドゲート１１はオープ
ンになると共に正極性信号を反転した水平同期信号が入
力され、その結果オアゲート１３からは「０」が出力さ
れる。
【００１８】そして、負極性に極性統一された同期信号
はＬＣＤ４のＣＰＵクロックにより出力信号「０」がラ
ッチされ、ＤＰＭＳレジスタのＨsync情報格納部９に
「１」が書き込まれる。これにより、水平同期信号の有
無を判別することができる。
はＬＣＤ４のＣＰＵクロックにより出力信号「０」がラ
ッチされ、ＤＰＭＳレジスタのＨsync情報格納部９に
「１」が書き込まれる。これにより、水平同期信号の有
無を判別することができる。
【００１９】図４はＶＥＳＡで規定されているＤＰＭＳ
における表示モードと同期信号との関係を示すマップで
あって、斯かるマップを検索することにより、スタンバ
イ状態及びサスペンド状態を判別し、省電力モード制御
を行なうことができる。
における表示モードと同期信号との関係を示すマップで
あって、斯かるマップを検索することにより、スタンバ
イ状態及びサスペンド状態を判別し、省電力モード制御
を行なうことができる。
【００２０】すなわち、ＤＰＭＳレジスタを監視して定
期的にＤＰＭＳレジスタの内容を読み出し、Ｈsync情報
格納部９の格納内容が「１」となって水平同期信号のパ
ルスのみが発生しているときはサスペンドモードと判別
し、Ｖsync情報格納部１０に夫々「１」となって垂直同
期信号のパルスのみが発生しているときはスタンバイモ
ードと判別する。
期的にＤＰＭＳレジスタの内容を読み出し、Ｈsync情報
格納部９の格納内容が「１」となって水平同期信号のパ
ルスのみが発生しているときはサスペンドモードと判別
し、Ｖsync情報格納部１０に夫々「１」となって垂直同
期信号のパルスのみが発生しているときはスタンバイモ
ードと判別する。
【００２１】これにより、ＬＣＤの場合であってもＣＲ
Ｔと同様の省電力制御を行なうことができる。
Ｔと同様の省電力制御を行なうことができる。
【００２２】
【実施例】図５は本発明の実施例を示すブロック回路図
である。
である。
【００２３】本実施例では信号生成回路５としてのＳＶ
ＧＡチップ１４から出力される信号の内、ＬＣＤ用同期
信号（水平同期信号（Ｈsync）、垂直同期信号（Ｖsyn
c））ｃ、画像データ信号ｅの他にＣＲＴ用水平同期信
号ｂ′がＬＣＤ制御回路としてのＬＣＤ制御ＩＣ１５に
入力される場合を示している。すなわち、ＬＣＤ制御Ｉ
Ｃ１５に入力されたＣＲＴ用水平同期信号ｂ′は、負極
性に極性統一される。そして、負のパルスがラッチされ
るとＬＣＤ制御ＩＣ１５に内蔵されたＤＰＭＳレジスタ
のＨsync情報格納部９に「１」が書き込まれる。その
後、ＣＰＵ１６はＬＣＤ制御ＩＣ１５のＤＰＭＳレジス
タを監視して定期的に該ＤＰＭＳレジスタの格納内容を
読み出し、斯かる読み出しがなされた後、ＤＰＭＳレジ
スタのＨsync情報格納部９を「０」にリセットする。す
なわち、この場合はＨsync情報格納部９に格納されてい
る「１」を読み出して水平同期信号を検出し、その後Ｈ
sync情報格納部９を「０」に書き換える。そして、所定
時間後、ＤＰＭＳレジスタの内容を再度読み出したとき
にＨsync情報格納部９が「０」に設定されている場合で
あって且つ垂直同期信号が検出されている場合はＣＰＵ
１６はスタンバイ状態にさせるための指令をＬＣＤ制御
ＩＣ１５に送る。
ＧＡチップ１４から出力される信号の内、ＬＣＤ用同期
信号（水平同期信号（Ｈsync）、垂直同期信号（Ｖsyn
c））ｃ、画像データ信号ｅの他にＣＲＴ用水平同期信
号ｂ′がＬＣＤ制御回路としてのＬＣＤ制御ＩＣ１５に
入力される場合を示している。すなわち、ＬＣＤ制御Ｉ
Ｃ１５に入力されたＣＲＴ用水平同期信号ｂ′は、負極
性に極性統一される。そして、負のパルスがラッチされ
るとＬＣＤ制御ＩＣ１５に内蔵されたＤＰＭＳレジスタ
のＨsync情報格納部９に「１」が書き込まれる。その
後、ＣＰＵ１６はＬＣＤ制御ＩＣ１５のＤＰＭＳレジス
タを監視して定期的に該ＤＰＭＳレジスタの格納内容を
読み出し、斯かる読み出しがなされた後、ＤＰＭＳレジ
スタのＨsync情報格納部９を「０」にリセットする。す
なわち、この場合はＨsync情報格納部９に格納されてい
る「１」を読み出して水平同期信号を検出し、その後Ｈ
sync情報格納部９を「０」に書き換える。そして、所定
時間後、ＤＰＭＳレジスタの内容を再度読み出したとき
にＨsync情報格納部９が「０」に設定されている場合で
あって且つ垂直同期信号が検出されている場合はＣＰＵ
１６はスタンバイ状態にさせるための指令をＬＣＤ制御
ＩＣ１５に送る。
【００２４】これにより、ＬＣＤにおいてもＣＲＴと同
様にして省電力制御を行なうことが可能となる。
様にして省電力制御を行なうことが可能となる。
【００２５】
【発明の効果】以上詳述したように本発明に係る消費電
力制御装置及び消費電力の制御方法によれば、ＣＲＴに
接続することを想定した情報処理装置をＬＣＤに接続す
る場合においても、ＣＲＴと同等の省電力モードでもっ
て消費電力を節約することができる。
力制御装置及び消費電力の制御方法によれば、ＣＲＴに
接続することを想定した情報処理装置をＬＣＤに接続す
る場合においても、ＣＲＴと同等の省電力モードでもっ
て消費電力を節約することができる。
【図１】本発明に係る消費電力制御装置としてのＬＣＤ
消費電力制御装置の一実施の形態を示すブロック構成図
である。
消費電力制御装置の一実施の形態を示すブロック構成図
である。
【図２】ＬＣＤ制御回路に内蔵される極性レジスタ及び
ＤＰＭＳレジスタのフォーマット図である。
ＤＰＭＳレジスタのフォーマット図である。
【図３】極性検出部の電気回路図である。
【図４】表示モードと同期信号との関係を示すマップで
ある。
ある。
【図５】ＬＣＤ消費電力制御装置の実施例を示すブロッ
ク構成図である。
ク構成図である。
３ ホストコンピュータ（情報処理装置） ４ ＬＣＤ（液晶表示装置） ５ 信号生成回路（信号生成手段） ６ ＬＣＤ制御回路（同期信号解析手段、同期信号判別
手段、極性統一手段、省電力モード判別手段）
手段、極性統一手段、省電力モード判別手段）
Claims (8)
- 【請求項１】 情報処理装置と液晶表示装置との間に介
装された消費電力制御装置であって、 少なくとも陰極線管表示装置用の第１の同期信号と液晶
表示装置用の第２の同期信号を含む所定データ信号とを
生成する信号生成手段と、前記第１の同期信号の内容を
解析して所定の省電力情報を前記液晶表示装置に送出す
る同期信号解析手段とを備えていることを特徴とする消
費電力制御装置。 - 【請求項２】 前記第１の同期信号が、水平同期信号と
垂直同期信号とからなり、前記同期信号解析手段は、前
記第１の同期信号が前記水平同期信号か前記垂直同期信
号かを判別する同期信号判別手段と、該同期信号判別手
段により判別された第１の同期信号の極性を統一する極
性統一手段と、該極性統一手段により統一された極性を
監視して省電力モードを判別する省電力モード判別手段
とを有していることを特徴とする請求項１記載の消費電
力制御装置。 - 【請求項３】 前記極性統一手段は、前記第１の同期信
号の極性を反転又は非反転して極性を統一することを特
徴とする請求項２記載の消費電力制御装置。 - 【請求項４】 前記消電力モードは、少なくともスタン
バイモードとサスペンドモードとを含んでいることを特
徴とする請求項２又は請求項３記載の消費電力制御装
置。 - 【請求項５】 情報処理装置から出力される表示データ
を液晶表示装置に表示すると共に、前記情報処理装置か
らの出力状態に応じて前記液晶表示装置の消費電力を制
御する消費電力の制御方法であって、 少なくとも陰極線管表示装置用の第１の同期信号と液晶
表示装置用の第２の同期信号を含む所定データ信号とを
生成する信号生成ステップと、前記第１の同期信号の内
容を解析して所定の省電力情報を前記液晶表示装置に送
出する同期信号解析ステップとを含んでいることを特徴
とする消費電力の制御方法。 - 【請求項６】 前記第１の同期信号が、水平同期信号と
垂直同期信号とからなり、前記同期信号解析ステップ
は、さらに前記第１の同期信号が水平同期信号か垂直同
期信号かを判別する同期信号判別ステップと、該同期信
号判別ステップにより判別された第１の同期信号の極性
を統一する極性統一ステップと、該極性統一ステップに
より統一された極性を監視して省電力モードを判別する
省電力モード判別ステップとを含んでいることを特徴と
する請求項５記載の消費電力の制御方法。 - 【請求項７】 前記極性統一ステップは、前記第１の同
期信号の極性を反転又は非反転して極性を統一すること
を特徴とする請求項６記載の消費電力の制御方法。 - 【請求項８】 前記消電力モードは、少なくともスタン
バイモードとサスペンドモードとを含んでいることを特
徴とする請求項６又は請求項７記載の消費電力の制御方
法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9027301A JPH10207437A (ja) | 1997-01-28 | 1997-01-28 | 消費電力制御装置と消費電力の制御方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9027301A JPH10207437A (ja) | 1997-01-28 | 1997-01-28 | 消費電力制御装置と消費電力の制御方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10207437A true JPH10207437A (ja) | 1998-08-07 |
Family
ID=12217277
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9027301A Pending JPH10207437A (ja) | 1997-01-28 | 1997-01-28 | 消費電力制御装置と消費電力の制御方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH10207437A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002244636A (ja) * | 2001-02-19 | 2002-08-30 | Sharp Corp | 表示装置 |
-
1997
- 1997-01-28 JP JP9027301A patent/JPH10207437A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002244636A (ja) * | 2001-02-19 | 2002-08-30 | Sharp Corp | 表示装置 |
| JP4601186B2 (ja) * | 2001-02-19 | 2010-12-22 | シャープ株式会社 | 表示装置 |
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