JPH10150601A - 撮像装置 - Google Patents
撮像装置Info
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- JPH10150601A JPH10150601A JP8308208A JP30820896A JPH10150601A JP H10150601 A JPH10150601 A JP H10150601A JP 8308208 A JP8308208 A JP 8308208A JP 30820896 A JP30820896 A JP 30820896A JP H10150601 A JPH10150601 A JP H10150601A
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- Transforming Light Signals Into Electric Signals (AREA)
Abstract
撮影でも余分な時間を要することなくノイズのない極め
て良好な画像を得る。 【解決手段】 撮像素子12を、撮影時における被写体
の明るさに応じて、1回の撮影動作にて1組の画素P1
〜P4のうち所望数の画素の電荷を適宜加算して画像信
号を出力できるように構成する。そして、被写体からの
光量の大小に応じて、撮像素子12から出力された画同
信号の信号レベルがある所定のしきい値以上のときには
電子シャッタにより露光制御を行い、前記しきい値以下
のときには同期制御回路18が駆動回路13を制御し、
撮像素子12において1回の撮影動作にて1組の画素P
1〜P4のうち所望数の画素の電荷を適宜加算して画像
信号を出力する。
Description
能を持ったインターライン構造を有するCCD(Charge
Coupled Device :電荷結合素子)などの撮像素子を具
備する撮像装置に関する。
等に用いて好適な高画素数の撮像素子としては、インタ
ーライン型のCCDイメージセンサがある。このCCD
イメージセンサは、図11に示すように、マトリクス状
に配列されて入射した光を電荷に変換する光電変換要素
(画素)101と、この画素101のそれぞれに蓄えら
れた電荷を読み出して垂直方向に転送する垂直電荷転送
部(VCCD)102と、このVCCD102から転送
されてきた信号電荷を水平方向に転送する水平電荷転送
部(HCCD)103と、転送された信号電荷を画像信
号として出力端子105から出力する出力部104とを
備えて構成されている。
ンサは、以下に示すように機能する。先ず、画素101
で光電変換された信号電荷がVCCD102に転送さ
れ、図示の如く4相駆動型の場合には各駆動パルスφV
1,φV2,φV3及びφV4により順次HCCD10
3に転送される。続いて、HCCD103において、図
示の如く2相駆動型の場合にはVCCD102から転送
されてきた水平1列分の信号電荷が各駆動パルスφH1
及びφH2により順次出力部104に転送され、この出
力部104において信号電荷が画像信号(電圧)に変換
されて出力端子105から出力される。
能を備えた撮像装置に適用した場合のブロック図を図1
2に示す。この撮像装置は、レンズ111及びその絞り
112と、上述のインターライン型のCCDイメージセ
ンサである撮像素子113と、絞り112及び撮像素子
113の駆動回路114,115と、撮像素子113か
らの画像信号レベルを検出するためのレベル検出回路1
16と、画像信号のレベルを制御する利得制御回路11
7と、画像信号に必要な処理を加える信号処理回路11
8と、撮像素子113の1回の撮影動作で出力した全画
素の画像信号を一時的に記憶する画像メモリ119と、
画像信号から画像を構成して表示する電子ビューファイ
ンダや液晶ディスプレイのような画像表示部120と、
撮像装置全体を制御する同期制御回路121とから構成
されている。
動作について説明する。先ず、絞り112により適切な
入射光量とされたレンズ111から光が撮像素子113
に入射し、同期制御回路121の制御により駆動回路1
15が駆動してこの光が撮像素子113において光電変
換されて画像信号となって出力される。続いて、この画
像信号の信号レベルがレベル検出回路116にて検出さ
れ、それに応じた同期制御回路121の制御によって利
得制御回路117において画像信号のレベルが制御さ
れ、或いは駆動回路114により絞り112が調節され
る。続いて、この画像信号が信号処理回路118におい
て必要な処理を受け、画像メモリ119に記憶される。
そして、画像表示部120において画像信号に基づいて
画像が構成されて表示される。
113の1回の撮影動作で出力可能な画素数より垂直方
向の画素数が少ないものである場合には、撮像素子11
3が1回の撮影動作で出力した画像信号を画像メモリ1
19に記憶させ、垂直方向の画素列を間引いて画像表示
部120と同じ垂直画素数として画像表示部120に出
力したり、撮像素子113が1回の撮影動作で出力した
画像信号から信号処理回路118により画像表示部12
0と同じ垂直画素数に間引いて画像メモリ119に記憶
させ、画像表示部120に出力したりすればよい。
成の撮像装置を用いる際に、操作者が画像表示部120
を見ながら、例えば屋外から屋内へ撮影する被写体を変
更したとき等のように、被写体の明るさが低下した場合
には、以下のように対処していた。即ち、撮像素子11
3が出力する画像信号の信号レベルをレベル検出回路1
16で検出し、同期制御回路121において、この信号
レベルがあるしきい値以下であると判断された場合に
は、同期制御回路121が、利得制御回路117を制御
して信号増幅率を増大させたり、駆動回路114を制御
して絞り112を開いたりすることにより、画像表示部
120に画像を表示していた。
置において、例えばストロボ等の補助光が必要な暗時撮
影では、被写体を撮影表示するための十分な明るさが確
保できないことがある。このような場合、利得制御回路
117を制御して信号増幅率を増大させる方法では、撮
像素子113の出力部104で発生するノイズも共に増
大させてしまうために良好な画像が得られない。また、
駆動回路114を制御して絞り112を開く方法では、
シャッタを押してからストロボが発行するまでに適切な
露光条件に合わせた絞りに変更するため、時間がかかる
という問題がある。
おける撮影のみならず、暗時撮影でも余分な時間を要す
ることなくノイズのない極めて良好な画像を得ることの
できる撮像装置を提供することにある。
平及び垂直方向に配設された光電変換要素である複数の
画素と、垂直方向の前記画素列毎に設けられ前記画素か
らの電荷を垂直方向に転送する複数の垂直電荷転送部
と、前記垂直電荷転送部の一方に接続され当該垂直電荷
転送部から転送される電荷を水平方向に転送する水平電
荷転送部と、Nを3以上の自然数として、垂直方向にN
画素おきに共通に前記画素に接続され、前記画素から垂
直電荷転送部への信号電荷の読み出しを制御するととも
に前記垂直電荷転送部から前記水平電荷転送部への信号
電荷の転送を制御する電極と、前記水平電荷転送部から
転送された信号電荷を画像信号に変換して出力する出力
部とを具備する撮像素子を有し、垂直方向に繰り返し配
設されてなるN画素の組について、2画素からN画素ま
でのうち適切な画素数分の信号電荷を前記電極から読み
出し、前記垂直電荷転送部或いは前記水平電荷転送部に
おいてこれらの信号電荷を加算して、前記出力部から画
像信号として出力することができるように構成されてい
る。
素子から出力される画像信号の信号レベルを検出するレ
ベル検出手段と、前記レベル検出手段からの画像信号に
応じて、1つの画素の信号電荷を読み出すためのパルス
或いは2画素からN画素までの所定画素数を指定してそ
れらの信号電荷を加算して読み出すためのパルスを発生
させる同期制御手段とを更に有し、前記同期制御手段に
おいて、前記レベル検出手段から入力された画像信号に
応じて、加算する画素数が適宜切り換えられるように構
成されている。
前記同期制御手段が、前記レベル検出手段から入力され
た画像信号の信号レベルが所定のしきい値以上である場
合には、1画素の信号電荷のみを読み出すように前記撮
像素子を制御し、前記画像信号の信号レベルが前記しき
い値より小さい場合には、当該信号レベルに応じた画素
数の信号電荷を読みだして加算するように前記撮像素子
を制御する。
素子からの画像信号を撮影画像として表示する画像表示
装置であって、前記撮像素子の1回の撮影動作で出力可
能な画素数より垂直方向の画素数が少ない画像表示装置
を更に有する。
素子において、所定の期間に前記画素の信号電荷を一斉
に排出させることができるように構成されている。
前記撮像素子の前記画素に垂直方向に同一色とされた色
フィルタが設けられ、前記色フィルタが、水平方向に2
色、3色或いは4色毎に同色となるように繰り返し配設
されている。
素子から出力される画像信号の信号レベルを検出するレ
ベル検出手段と、前記レベル検出手段からの画像信号に
応じて、1つの画素の信号電荷を読み出すためのパルス
或いは2画素からN画素までの所定画素数を指定してそ
れらの信号電荷を加算して読み出すためのパルスを発生
させる同期制御手段と、前記同期制御手段により制御さ
れ、前記撮像素子から出力される画像信号の振幅を変化
させることができる利得制御手段とを更に有し、前記同
期制御手段が2画素からN画素までの所定画素数の信号
電荷の加算を指定した際に、前記利得制御手段が画像信
号の振幅が前記所定画素数に相当する振幅となるまで複
数の撮像期間にわたって画像信号の振幅を各撮像期間毎
に漸次増大させてゆく。
前記同期制御手段が、前記レベル検出手段から入力され
た画像信号の信号レベルが所定のしきい値以上である場
合には、1画素の信号電荷のみを読み出すように前記撮
像素子を制御し、前記画像信号の信号レベルが前記しき
い値より小さい場合には、当該信号レベルに応じた画素
数の信号電荷を読みだして加算するように前記撮像素子
を制御する。
記利得制御手段が、画像信号の振幅を各撮像期間毎に漸
次増大させてゆくための複数の制御モードを有し、前記
制御モードを適宜切り換えることができるように構成さ
れている。
素子からの画像信号を撮影画像として表示する画像表示
装置であって、前記撮像素子の1回の撮影動作で出力可
能な画素数より垂直方向の画素数が少ない画像表示装置
を更に有する。
素子において、所定の期間に前記画素の信号電荷を一斉
に排出させることができるように構成されている。
前記撮像素子の前記画素に垂直方向に同一色とされた色
フィルタが設けられ、前記色フィルタが、水平方向に2
色、3色或いは4色毎に同色となるように繰り返し配設
されている。
くつかの具体的な実施の形態について図面を参照しなが
ら詳細に説明する。
形態について説明する。この第1の実施の形態に係る撮
像装置は、図1に示すように、レンズ11と、インター
ライン型のCCDイメージセンサである撮像素子12
と、撮像素子12の駆動回路13と、撮像素子12から
の画像信号レベルを検出するためのレベル検出回路14
と、画像信号に必要な処理を加える信号処理回路15
と、撮像素子12の1回の撮影動作で出力した全画素の
画像信号を一時的に記憶する画像メモリ16と、画像信
号から画像を構成して表示するいわゆる電子ビューファ
インダや液晶ディスプレイのような画像表示部17と、
撮像装置全体を制御する同期制御回路18とから構成さ
れている。ここで、画像表示部17は、撮像素子12の
1回の撮影動作で出力可能な画素数より垂直方向の画素
数が少なく構成されている。
に、マトリクス状に配列されて入射した光を電荷に変換
する光電変換要素(画素)1と、この画素1のそれぞれ
に蓄えられた電荷を読み出して垂直方向に転送する垂直
電荷転送部(VCCD)2と、このVCCD2から転送
されてきた信号電荷を水平方向に転送する水平電荷転送
部(HCCD)3と、転送された信号電荷を画像信号と
して出力端子5から出力する出力部4とを備えて構成さ
れている。
のものであり、VCCD2には転送電極として機能する
各電極D1,D2,D3,D4,D5,D6,D7及び
D8がそれぞれ設けられ、1つの画素1に2つの前記電
極が接続されている。即ち、ある画素1(P1)に電極
D1,D2が接続され、画素P1に隣接する画素P2に
電極D3,D4、画素P2に隣接する画素P3に電極D
5,D6、画素P3に隣接する画素P4に電極D7,D
8が接続されており、これら画素P1〜P4が1組とさ
れて各VCCD2に沿った垂直方向に繰り返し配列され
ている。
D3,D5及びD7が読み出し電極としても機能する。
即ち、繰り返し配列された各組の画素P1〜P4に対し
て、電極D1,D3,D5及びD7がそれぞれ共通に接
続されており、4画素毎に電極D1,D3,D5及びD
7がそれぞれ共通に接続されていることになる。従って
この場合、画像表示部17の垂直方向の画素数は、撮像
素子12の垂直方向の画素数の4分の1以上あればよ
い。
5及びD7にφV1,φV3,φV5及びφV7が印加
されて、各画素1で光電変換された信号電荷がVCCD
2に読み出される。また、電荷転送時には、これら電極
P1〜P8に駆動パルスφV1,φV2,φV3,φV
4,φV5,φV6,φV7及びφV8が印加されて、
画素1で光電変換された信号電荷がVCCD2からHC
CD3へ順次転送される。このようにして読み出され、
HCCD3に転送された水平1列分の画像信号は、HC
CD3において、図示の如く2相駆動型の場合には各駆
動パルスφH1及びφH2により順次出力部4に転送さ
れ、この出力部4において信号電荷が画像信号(電圧)
に変換されて出力端子5から出力される。
動作について説明する。本第1の実施の形態において
は、撮像素子12が、撮影時における被写体の明るさに
応じて、当該撮像素子12による1回の撮影動作にて1
組の画素P1〜P4のうち所望数の画素の電荷を適宜加
算して画像信号を出力することができる。
像素子12に入射し、同期制御回路21の制御により駆
動回路13が駆動してこの光が撮像素子12において光
電変換されて画像信号となって出力される。続いて、こ
の画像信号の信号レベルがレベル検出回路14にて検出
され、被写体からの光量の大小に応じて、この信号レベ
ルがある所定のしきい値以上のときには電子シャッタに
より露光制御を行い、信号レベルが前記しきい値以下の
ときには同期制御回路18が駆動回路13を制御し、撮
像素子12において1回の撮影動作にて1組の画素P1
〜P4のうち所望数の画素の電荷を適宜加算して画像信
号を出力する。続いて、この画像信号が信号処理回路1
5において必要な処理を受け、画像メモリ16に記憶さ
れる。そして、画像表示部17において画像信号に基づ
いて画像が構成されて表示されることになる。
き、信号レベルが前記しきい値以上の場合(ここでは1
画素の電荷を読み出して転送する場合)と暗時撮影であ
って信号レベルが前記しきい値以下の場合(ここでは3
画素の電荷を加算する場合)の各々について順次説明す
る。
(画素P1)の電荷を読み出して転送する場合について
述べる。図3に、撮像素子12において、垂直方向に繰
り返す4画素おきの画素の信号電荷のみを読み出す場合
のタイミングチャートを示す。ここで、VDが、垂直ブ
ランキング期間をロー電位(低電位)で表す垂直同期信
号であり、HDが、水平ブランキング期間をロー電位
(低電位)で表す水平同期信号である。φV1,φV
3,φV5及びφV7は、VCCD2の8相駆動パルス
の代表として示された駆動パルスであり、φH1は、H
CCD3の2相駆動パルスの代表として示された駆動パ
ルスである。VSUB は、画素1に蓄積される電荷を基板
に掃き出すことのできる期間を指定する電荷掃き出し信
号であり、パルス25により電荷の掃き出しが指示され
る。また、駆動パルスφV1に示されたパルス21は、
垂直方向に連続する4画素からなる組によって水平方向
に構成される水平画素列のうち、第1の水平画素列の信
号電荷をVCCD2に読み出す第1の読み出しパルスを
示している。
間の繰り返し周期を概略示しており、期間T1Aは電荷掃
き出し信号VSUB の連続する掃き出しパルス25が印加
され終わってから読み出しパルス21が印加されるまで
の期間を示している。また、時刻t1は読み出しパルス
21が印加されるタイミングを、時刻t2は次の撮像期
間において掃き出しパルス25の印加が開始されるタイ
ミングをそれぞれ示す。
ら蓄積期間T1Aの開始時刻までの間においては、電荷掃
き出し信号VSUB の連続する掃き出しパルス25が印加
され続けているので、各画素1の電荷は常に掃き出され
ている。そして、掃き出しパルス25の印加が終了した
後、蓄積期間T1Aの間に発生した電荷のみが、信号電荷
として画素1に蓄積される。そして、蓄積期間T1Aが終
了した時刻t1のタイミングにおいて読み出しパルス2
1が印加され、第1の画素P1の信号電荷がVCCD2
の電極D1に読み出される。
より、信号電荷がHCCD3の方向へ転送される。この
ときの様子を図4の模式図に示す。ここで、P1〜P4
が垂直方向に連続する4画素の組を示す。また、状態2
7はVCCD2の電極が蓄積状態にあることを示し、状
態26はVCCD2の電極がバリア状態にあり信号電荷
が存在しないことを示しており、時刻t1が図3の時刻
t1に対応し、第1の画素P1が読み出された状態を示
す。このように、時刻t1のタイミングにおいて読み出
された各々の画素P1の信号電荷が8相駆動パルスによ
って次に繰り返される画素P1の位置まで転送され、画
像信号に変換されて出力される。更に、時刻t2のタイ
ミングにおいて掃き出し信号25の印加が開始されるた
め、VCCD2に読み出されなかった第2の画素P2,
第3の画素P3及び第4の画素P4の信号電荷はこのと
きに掃き出される。
像メモリ16に記憶され、同期制御回路18からの制御
信号によって2次元の画像となるように画像表示部17
に表示される。
力された画像信号の信号レベルがある所定のしきい値以
上のときには、露光時間に相当する蓄積期間T1Aを短く
することにより露光制御を行ってもよい。
素(P1〜P3)の電荷を読み出して転送する場合につ
いて述べる。図5に、撮像素子12において、垂直方向
に繰り返す4画素のうちの3画素の信号電荷を加算して
読み出す場合のタイミングチャートを示す。ここで、V
Dが、垂直ブランキング期間をロー電位(低電位)で表
す垂直同期信号であり、HDが、水平ブランキング期間
をロー電位(低電位)で表す水平同期信号である。φV
1,φV3,φV5及びφV7は、VCCD2の8相駆
動パルスの代表として示された駆動パルスであり、φH
1は、HCCD3の2相駆動パルスの代表として示され
た駆動パルスである。VSUB は、画素1に蓄積される電
荷を基板に掃き出すことのできる期間を指定する電荷掃
き出し信号であり、パルス25により電荷の掃き出しが
指示される。また、駆動パルスφV1に示されたパルス
21は、垂直方向に連続する4画素からなる組によって
水平方向に構成される水平画素列のうち、第1の水平画
素列の信号電荷をVCCD2に読み出す第1の読み出し
パルスを示し、パルス21は第2の水平画素列の信号電
荷をVCCD2に読み出す第2の読み出しパルス、パル
ス23は第3の水平画素列の信号電荷をVCCD2に読
み出す第3の読み出しパルスをそれぞれ示している。
間の繰り返し周期を概略示しており、期間T2Aは電荷掃
き出し信号VSUB の連続する掃き出しパルス25が印加
され終わってから読み出しパルス21,22,23が印
加されるまでの期間を示している。また、時刻t3は読
み出しパルス21,22,23が印加されるタイミング
を、時刻t4は次の撮像期間において掃き出しパルス2
5の印加が開始されるタイミングをそれぞれ示す。
刻から蓄積期間T2Aの開始時刻までの間においては、電
荷掃き出し信号VSUB の連続する掃き出しパルス25が
印加され続けているので、各画素1の電荷は常に掃き出
されている。そして、掃き出しパルス25の印加が終了
した後、蓄積期間T2Aの間に発生した電荷のみが、信号
電荷として画素1に蓄積される。そして、蓄積期間T2A
が終了した時刻t3のタイミングにおいて読み出しパル
ス21,22,23がそれぞれ印加され、第1の画素P
1、第2の画素P2及び第3の画素P3の信号電荷がそ
れぞれVCCD2の電極D1,D3及びD5に読み出さ
れる。
より、信号電荷がHCCD3の方向へ転送される。この
ときの様子を図6の模式図に示す。ここで、P1〜P4
が垂直方向に連続する4画素の組を示す。また、状態2
7はVCCD2の電極が蓄積状態にあることを示し、状
態26はVCCD2の電極がバリア状態にあり信号電荷
が存在しないことを示しており、時刻t3が図5の時刻
t3に対応し、第1〜第3の画素P1〜P3がそれぞれ
読み出された状態を示す。このように、時刻t3のタイ
ミングにおいて読み出された各々の画素P1〜P3の信
号電荷が加算され、8相駆動パルスによって次に繰り返
される画素P1の位置まで転送されることが分かる。ま
た、図6の電荷蓄積状態を見れば明らかなように、信号
電荷が加算された後も必ず3電極以上が蓄積状態にある
ので、VCCD2内で加算された信号電荷が溢れること
なく転送されることになる。続いて、この加算された信
号電荷が画像信号に変換されて出力される。
像メモリ16に記憶され、同期制御回路18からの制御
信号によって2次元の画像となるように画像表示部17
に表示される。
垂直方向に繰り返す4画素のうちの3画素を加算して読
み出す場合について説明したが、本発明はこれに限定さ
れることなく、2画素或いは4画素を加算することによ
り適切な画像信号を得ることも可能である。また、この
第1の実施の形態においては、画素1の信号電荷の加算
をVCCD2内で行う場合について説明したが、このV
CCD2の代わりにHCCD3内で加算を行うこともで
きる。
撮像素子12に図7(a)或いは図7(b)に示すよう
な色フィルタ29を設けてもよい。この色フィルタ29
は、垂直方向に配列された画素28を覆うようにストラ
イプ状とされている。図7(a)には、水平方向に赤
(R)、緑(G)、青(B)の3色の色フィルタ29が
繰り返し配設された状態が、図7(b)には、水平方向
にシアン(Cy)、緑(G)、黄(Ye)の3色の色フ
ィルタ29が繰り返し配設された状態がそれぞれ示され
ている。このように、垂直方向にストライプ状の各色フ
ィルタ29を用いることにより、垂直方向の画素28の
信号電荷を加算しても、信号処理回路15の処理によっ
て色分離が可能な撮像装置を構成することが可能とな
る。
置によれば、通常撮影時及び撮像素子12から出力され
た画像信号の信号レベルがある所定のしきい値以上のと
きには、電子シャッタの動作で露光制御を行い、前記画
像信号の信号レベルがある所定のしきい値以下のときに
は、同期制御回路18からの制御信号によって通常撮影
時に間引いていた画素1(例えば第2,第3の画素P
2,P3)の信号電荷と読み出していた画素1(第1の
画素P1)の信号電荷とを加算して、画像信号の信号レ
ベルを増大させて良好な画像表示を実現することができ
る。
ば、従来の如く利得制御回路を駆使して信号増幅率を増
大させる手法とは異なり、複数の画素の信号電荷を加算
することで画像信号の信号レベルを増大させるため、利
得制御回路による信号増幅率の増大と共に撮像素子の出
力部で発生するノイズを増大させてしまうという問題が
生じることはない。また、露光制御を絞りを用いずに露
光制御を行うことができるので、例えば操作者がシャッ
タを押してからストロボが発行するまでの時間を短縮さ
せることも可能である。
ば、絞りを用いずに電子シャッタのみで露光制御を行う
ことや画像メモリの搭載を省略すること等が可能である
ので、装置全体の小型化やコストの低減化を実現するこ
ともできる。
の形態について説明する。なお、第1の実施の形態に係
る撮像装置と同様の構成要素等については同符号を記し
て説明を省略する。
図8に示すように、図1に示した第1の実施の形態に係
る撮像装置とほぼ同様の構成を有するが、撮像素子12
とレベル検出回路14との間に、撮像素子12から出力
された画像信号の信号レベルを制御するための利得制御
回路31が付加されている点で第1の実施の形態の場合
と相違する。
子12から出力された画像信号の信号レベルがある所定
のしきい値以下である場合には、第1の実施の形態で既
述したように、同期制御回路18からの制御信号によっ
て通常撮影時に間引いていた画素1(例えば第2,第3
の画素P2,P3)の信号電荷と読み出していた画素1
(第1の画素P1)の信号電荷とを加算して、画像信号
の信号レベルを増大させて撮像素子12から出力する。
とする垂直方向の画素列のうち、第1の画素P1のみの
信号電荷のみを読み出していた状態(図4に相当する)
から、この第1の画素P1の信号電荷に例えば第2,第
3の画素P2,P3の信号電荷を加算し、信号レベルが
増大、この場合では3倍に増大された状態に瞬時に移行
することになる。従って、画像表示部17の画面の輝度
が突然3倍に増大し、操作者にとっては画面が非常に見
づらいものとなる懸念がある。
利得制御回路31が、撮像素子12から出力された画像
信号の信号レベルを制御し、画素P1の信号電荷のみの
信号レベルから各信号出力期間毎に諸々の割合で信号増
幅率を漸次増大させ、所定の信号出力期間の経過時に利
得を1、この場合では画像信号の信号レベルを画素P1
の信号電荷のみの信号レベルの3倍となるように調節す
る。
号の信号レベルの制御状態を図9に示す。この図9は、
撮像素子12からの出力信号Sig1と、利得制御回路31
からの出力信号Sig2、及び利得制御回路31の信号増幅
率Aの関係を表している。各信号において、期間T'1
は、図3の撮像期間T1で撮像した画像の信号出力期
間、即ち撮像素子12から4画素おきの信号電荷のみを
出力する場合の信号出力期間を、期間T'2は、図5の撮
像期間T2で撮像した画像の信号出力期間、即ち撮像素
子12から4画素のうちの3画素の信号電荷を加算して
出力する場合の信号出力期間をそれぞれ示す。
信号出力期間がT'1からT'2に切り換えられたことに合
わせて、利得制御回路31が信号増幅率Aを4つの信号
出力期間T'2にわたって3/6、4/6、5/6、6/
6(=1)と変化させる。すると、それに伴って利得制
御回路31からの出力信号Sig2の信号レベルが、信号出
力期間がT'1における信号レベルを基準として1.5
倍、2倍、2.5倍、そして3倍と変化する。このよう
に、画像信号の信号レベルを漸次変化させることによ
り、画像表示部17上の輝度変化を緩和して、画面を見
易いものとすることができる。
の変化率を上述のように一定とするのみならず、例えば
当初の信号出力期間T'2には画像信号の増加率を大きく
し、次の信号出力期間T'2からは画像信号の増加率が当
初の信号出力期間T'2に比して小さくなるように、利得
制御回路31の制御モードを変えてもよい。具体的に
は、図10に示すように、信号出力期間がT'1からT'2
に切り換えられたことに合わせて、利得制御回路31が
信号増幅率Aを3つの信号出力期間T'2にわたって6/
9、8/9、9/9(=1)と変化させる。すると、そ
れに伴って利得制御回路31からの出力信号Sig2の信号
レベルが、信号出力期間がT'1における信号レベルを基
準として2倍、8/3倍、そして3倍と変化する。この
ように、画像信号の信号レベルを漸次変化させることに
より、画像表示部17上の輝度変化を緩和して、画面を
見易いものとすることができるとともに、輝度が変化し
終わるまでの時間を短縮することが可能となる。
垂直方向に繰り返す4画素のうちの3画素を加算して読
み出す場合について説明したが、本発明はこれに限定さ
れることなく、2画素或いは4画素を加算することによ
り適切な画像信号を得ることも可能である。また、この
第2の実施の形態においては、4つの信号出力期間にわ
たって信号増幅率Aの制御を行ったが、さらに多くの信
号出力期間を用いることにより、輝度の変化をゆっくり
行うこともできるし、少ない信号出力期間を用いること
により、輝度が変化し終わるまでの時間を短縮すること
もできる。また、加算する画素数に合わせて、信号増幅
率Aの制御を行う信号出力期間の数を変えることによ
り、最適な画像表示を選択することもできる。更に、こ
の第2の実施の形態においては、画素1の信号電荷の加
算をVCCD2内で行う場合について説明したが、この
VCCD2の代わりにHCCD3内で加算を行うことも
できる。
置によれば、通常撮影時及び撮像素子12から出力され
た画像信号の信号レベルがある所定のしきい値以上のと
きには、電子シャッタの動作で露光制御を行い、前記画
像信号の信号レベルがある所定のしきい値以下のときに
は、同期制御回路18からの制御信号によって通常撮影
時に間引いていた画素1(例えば第2,第3の画素P
2,P3)の信号電荷と読み出していた画素1(第1の
画素P1)の信号電荷とを加算して、画像信号の信号レ
ベルを増大させて良好な画像表示を実現することができ
る。
ば、従来の如く利得制御回路を駆使して信号増幅率を増
大させる手法とは異なり、複数の画素の信号電荷を加算
することで画像信号の信号レベルを増大させるため、利
得制御回路による信号増幅率の増大と共に撮像素子の出
力部で発生するノイズを増大させてしまうという問題が
生じることはない。また、露光制御を絞りを用いずに露
光制御を行うことができるので、例えば操作者がシャッ
タを押してからストロボが発行するまでの時間を短縮さ
せることも可能である。
14との間に利得制御回路31を設け、各信号出力期間
T'2毎に画像信号レベルを漸次増大させて信号電荷の加
算数に応じた画像信号レベルとすることにより、画像表
示部17上の輝度変化を緩和して、画面を見易いものと
することができる。更にこの場合、信号増幅率Aの変化
率の異なる種々の制御モードを用意することにより、そ
れらを適宜切り換えるて暗時撮影における画素加算によ
る輝度変化を操作者にとって違和感のない設定とするこ
とができる。
ば、絞りを用いずに電子シャッタのみで露光制御を行う
ことや画像メモリの搭載を省略すること等が可能である
ので、装置全体の小型化やコストの低減化を実現するこ
ともできる。
ら出力された画像信号の信号レベルがあるしきい値以上
のときには、電子シャッタにより露光時間に相当する蓄
積時間を短くすることで露光を制御し、前記信号レベル
がしきい値以下のときには、複数の画素の信号電荷を加
算して画像信号とする。従って、被写体の明るさに応じ
てノイズのない良好な画像表示が実現できる。
この利得制御回路により撮像素子から出力された画像信
号の信号増幅率を所定数の信号出力期間にわたって変化
させることにより、画像表示部における急激な輝度変化
を防止して操作者にとって違和感のない画像表示が実現
できる。
すブロック図である。
成要素である撮像素子を示す模式図である。
いた通常撮影時のタイミングチャートを示す特性図であ
る。
成要素である撮像素子において、通常撮影時の垂直方向
への振動電荷の転送状態を示す模式図である。
いた暗時撮影におけるタイミングチャートを示す特性図
である。
成要素である撮像素子において、暗時撮影における垂直
方向への振動電荷の転送状態を示す模式図である。
成要素である撮像素子に色フィルタが装着された様子を
示す模式図である。
すブロック図である。
成要素である利得制御回路による利得制御の一例を示す
特性図である。
構成要素である利得制御回路による利得制御の他の例を
示す特性図である。
示す模式図である。
Claims (12)
- 【請求項1】 水平及び垂直方向に配設された光電変換
要素である複数の画素と、 垂直方向の前記画素列毎に設けられ前記画素からの電荷
を垂直方向に転送する複数の垂直電荷転送部と、 前記垂直電荷転送部の一方に接続され当該垂直電荷転送
部から転送される電荷を水平方向に転送する水平電荷転
送部と、 Nを3以上の自然数として、垂直方向にN画素おきに共
通に前記画素に接続され、前記画素から垂直電荷転送部
への信号電荷の読み出しを制御するとともに前記垂直電
荷転送部から前記水平電荷転送部への信号電荷の転送を
制御する電極と、 前記水平電荷転送部から転送された信号電荷を画像信号
に変換して出力する出力部とを具備する撮像素子を有
し、 垂直方向に繰り返し配設されてなるN画素の組につい
て、2画素からN画素までのうち適切な画素数分の信号
電荷を前記電極から読み出し、前記垂直電荷転送部或い
は前記水平電荷転送部においてこれらの信号電荷を加算
して、前記出力部から画像信号として出力することがで
きるように構成されていることを特徴とする撮像装置。 - 【請求項2】 前記撮像素子から出力される画像信号の
信号レベルを検出するレベル検出手段と、 前記レベル検出手段からの画像信号に応じて、1つの画
素の信号電荷を読み出すためのパルス或いは2画素から
N画素までの所定画素数を指定してそれらの信号電荷を
加算して読み出すためのパルスを発生させる同期制御手
段とを更に有し、 前記同期制御手段において、前記レベル検出手段から入
力された画像信号に応じて、加算する画素数が適宜切り
換えられるように構成されていることを特徴とする請求
項1に記載の撮像装置。 - 【請求項3】 前記同期制御手段は、前記レベル検出手
段から入力された画像信号の信号レベルが所定のしきい
値以上である場合には、1画素の信号電荷のみを読み出
すように前記撮像素子を制御し、前記画像信号の信号レ
ベルが前記しきい値より小さい場合には、当該信号レベ
ルに応じた画素数の信号電荷を読みだして加算するよう
に前記撮像素子を制御することを特徴とする請求項2に
記載の撮像装置。 - 【請求項4】 前記撮像素子からの画像信号を撮影画像
として表示する画像表示装置であって、前記撮像素子の
1回の撮影動作で出力可能な画素数より垂直方向の画素
数が少ない画像表示装置を更に有することを特徴とする
請求項1〜3のいずれか1項に記載の撮像装置。 - 【請求項5】 前記撮像素子において、所定の期間に前
記画素の信号電荷を一斉に排出させることができるよう
に構成されていることを特徴とする請求項1〜4のいず
れか1項に記載の撮像装置。 - 【請求項6】 前記撮像素子の前記画素に垂直方向に同
一色とされた色フィルタが設けられ、 前記色フィルタが、水平方向に2色、3色或いは4色毎
に同色となるように繰り返し配設されていることを特徴
とする請求項1〜5のいずれか1項に記載の撮像装置。 - 【請求項7】 前記撮像素子から出力される画像信号の
信号レベルを検出するレベル検出手段と、 前記レベル検出手段からの画像信号に応じて、1つの画
素の信号電荷を読み出すためのパルス或いは2画素から
N画素までの所定画素数を指定してそれらの信号電荷を
加算して読み出すためのパルスを発生させる同期制御手
段と、 前記同期制御手段により制御され、前記撮像素子から出
力される画像信号の振幅を変化させることができる利得
制御手段とを更に有し、 前記同期制御手段が2画素からN画素までの所定画素数
の信号電荷の加算を指定した際に、前記利得制御手段が
画像信号の振幅が前記所定画素数に相当する振幅となる
まで複数の撮像期間にわたって画像信号の振幅を各撮像
期間毎に漸次増大させてゆくことを特徴とする請求項1
に記載の撮像装置。 - 【請求項8】 前記同期制御手段は、前記レベル検出手
段から入力された画像信号の信号レベルが所定のしきい
値以上である場合には、1画素の信号電荷のみを読み出
すように前記撮像素子を制御し、前記画像信号の信号レ
ベルが前記しきい値より小さい場合には、当該信号レベ
ルに応じた画素数の信号電荷を読みだして加算するよう
に前記撮像素子を制御することを特徴とする請求項7に
記載の撮像装置。 - 【請求項9】 前記利得制御手段は、画像信号の振幅を
各撮像期間毎に漸次増大させてゆくための複数の制御モ
ードを有し、前記制御モードを適宜切り換えることがで
きることを特徴とする請求項7又は8に記載の撮像装
置。 - 【請求項10】 前記撮像素子からの画像信号を撮影画
像として表示する画像表示装置であって、前記撮像素子
の1回の撮影動作で出力可能な画素数より垂直方向の画
素数が少ない画像表示装置を更に有することを特徴とす
る請求項7〜9のいずれか1項に記載の撮像装置。 - 【請求項11】 前記撮像素子において、所定の期間に
前記画素の信号電荷を一斉に排出させることができるよ
うに構成されていることを特徴とする請求項7〜10の
いずれか1項に記載の撮像装置。 - 【請求項12】 前記撮像素子の前記画素に垂直方向に
同一色とされた色フィルタが設けられ、 前記色フィルタが、水平方向に2色、3色或いは4色毎
に同色となるように繰り返し配設されていることを特徴
とする請求項7〜11のいずれか1項に記載の撮像装
置。
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JP30820896A JP4227203B2 (ja) | 1996-11-19 | 1996-11-19 | 撮像装置 |
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JPH10150601A true JPH10150601A (ja) | 1998-06-02 |
JP4227203B2 JP4227203B2 (ja) | 2009-02-18 |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003060994A (ja) * | 2001-08-10 | 2003-02-28 | Canon Inc | 撮像装置及びカメラシステム |
US7176911B1 (en) * | 1999-02-02 | 2007-02-13 | Olympus Corporation | Solid-state imaging apparatus |
JP2012129884A (ja) * | 2010-12-16 | 2012-07-05 | Fujifilm Corp | 撮像装置及びその画素加算方法 |
-
1996
- 1996-11-19 JP JP30820896A patent/JP4227203B2/ja not_active Expired - Fee Related
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Publication number | Priority date | Publication date | Assignee | Title |
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JP4738667B2 (ja) * | 2001-08-10 | 2011-08-03 | キヤノン株式会社 | 撮像装置 |
JP2012129884A (ja) * | 2010-12-16 | 2012-07-05 | Fujifilm Corp | 撮像装置及びその画素加算方法 |
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