JPH0955517A - Multilayered metal schottky electrode - Google Patents

Multilayered metal schottky electrode

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JPH0955517A
JPH0955517A JP22453895A JP22453895A JPH0955517A JP H0955517 A JPH0955517 A JP H0955517A JP 22453895 A JP22453895 A JP 22453895A JP 22453895 A JP22453895 A JP 22453895A JP H0955517 A JPH0955517 A JP H0955517A
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恭子 堀
Masaaki Kuzuhara
正明 葛原
Kazuhiko Onda
和彦 恩田
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Abstract

PROBLEM TO BE SOLVED: To realize electrode structure wherein long term reliability of a semiconductor device is ensured and high frequency characteristics are not deteriorated, by forming one or a plurality of lamination films composed of molybdenum laves as the lower layers and titanium layers as the upper layers, arm a semiconductor layer, and forming a conductive metal layer on the lamination films. SOLUTION: Photoresist is spread on a GaAs Schottky contact layer 11. An aperture is formed in a photoresist film by using a reduction projection method and an electron beam exposure method. A molybdenum layer 12, a titanium layer 13 and an aluminum layer 14 are continuosly stuck in order on the whole surface by using a film forming method like an electron beam sputtering method. An electrode having a desired shape is formed in the aperture part, by eliminating the photoresist and lifting off unnecessary metal films on the photoresist. Thereby molybdenum is introduced into a semiconductor interface, and mutual reaction between metal and semiconductor is restrained, so that a device of high reliability can be obtained.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】本発明は電界効果トランジス
タ(以下、FETと記す)のゲート電極に用いられる多
層金属ショットキー性電極に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a multi-layer metal Schottky electrode used as a gate electrode of a field effect transistor (hereinafter referred to as FET).

【0002】[0002]

【従来の技術】化合物半導体を用いたFETでは、通常
半導体層とショットキーコンタクトを形成する金属層が
ゲート電極として用いられる。図10に従来のFETの
代表的な電極構造を示す。この電極構造は、同図に示す
ように、GaAsショットキーコンタクト層101上
に、これとショットキーコンタクトを形成するチタン
(Ti)層102を形成し、その上にバリアメタル層と
なる白金(Pt)層103と低抵抗金属層としての金
(Au)層104を順次積層したものである。この電極
構造において、白金層は、上層のゲートの抵抗を下げる
ための金層104と下層のチタン層102が直接に反応
することを防ぐと共に半導体ショットキーコンタクト層
の表面からガリウム(Ga)が外部へ向かって拡散する
のを抑制する働きを持っている。
2. Description of the Related Art In an FET using a compound semiconductor, a metal layer that forms a Schottky contact with a semiconductor layer is usually used as a gate electrode. FIG. 10 shows a typical electrode structure of a conventional FET. In this electrode structure, as shown in the figure, a titanium (Ti) layer 102 that forms a Schottky contact with the GaAs Schottky contact layer 101 is formed, and a platinum (Pt) layer serving as a barrier metal layer is formed thereon. ) Layer 103 and a gold (Au) layer 104 as a low resistance metal layer are sequentially laminated. In this electrode structure, the platinum layer prevents the gold layer 104 for lowering the resistance of the upper gate from directly reacting with the lower titanium layer 102, and gallium (Ga) from the surface of the semiconductor Schottky contact layer is external. It has the function of suppressing the diffusion toward

【0003】また、加工性の良さから図11に示すチタ
ン・アルミニウム(Ti、Al)系の電極構造も多く用
いられている。すなわち、GaAsショットキーコンタ
クト層111上に、チタン層112と低抵抗金属層とし
てのアルミニウム(Al)層113を積層した構造であ
る。
Also, a titanium / aluminum (Ti, Al) -based electrode structure shown in FIG. 11 is often used because of its good workability. That is, it has a structure in which a titanium layer 112 and an aluminum (Al) layer 113 as a low resistance metal layer are stacked on a GaAs Schottky contact layer 111.

【0004】また、トランジスタ特性を向上させるため
に、ゲート電極の断面形状をT字状とすることがよく行
われている。その断面構造を図12に示す。この構造の
電極は次のように作製される。GaAsショットキーコ
ンタクト層121上に、T字状の開口を有するフォトレ
ジスト膜(図示なし)を形成する。チタン、白金、金を
順次蒸着して、チタン層122、125、白金層12
3、126および金層124、127を形成する。フォ
トレジスト膜をその上に形成された金属層とともに除去
すれば、図12に示す構造の電極が得られる。
Further, in order to improve the transistor characteristics, it is often practiced to make the gate electrode have a T-shaped cross section. Its sectional structure is shown in FIG. The electrode having this structure is manufactured as follows. A photoresist film (not shown) having a T-shaped opening is formed on the GaAs Schottky contact layer 121. Titanium, platinum, and gold are sequentially deposited to form titanium layers 122, 125 and platinum layer 12.
3, 126 and gold layers 124, 127 are formed. By removing the photoresist film together with the metal layer formed thereon, the electrode having the structure shown in FIG. 12 is obtained.

【0005】[0005]

【発明が解決しようとする課題】上述した従来の電極構
造では、半導体との界面にチタンが接する構造であった
ため、FETを活性状態で長時間使用するとチタンと半
導体との間で相互反応が生じてFETの特性に変動が生
じたり信頼性の点で問題が生じるなどの欠点があった。
In the above-mentioned conventional electrode structure, since titanium is in contact with the interface with the semiconductor, when the FET is used in the active state for a long time, a mutual reaction occurs between the titanium and the semiconductor. As a result, there are drawbacks such as fluctuations in the characteristics of the FET and problems in terms of reliability.

【0006】また、従来の電極構造では、白金をバリア
メタルとして用いていたが、白金の蒸着には他の金属の
場合より高温度の加熱あるいは高エネルギーの電子ビー
ムが必要となるため、安定した成膜が困難で、再現性よ
く歩留り高く形成することが困難であった。
Further, in the conventional electrode structure, platinum is used as a barrier metal. However, the vapor deposition of platinum requires heating at a higher temperature or an electron beam of high energy as compared with other metals, so that it is stable. It was difficult to form a film, and it was difficult to form it with good reproducibility and high yield.

【0007】さらに、多層構造を構成する層に白金が含
まれると、積層された白金層の幅が下層電極の幅より細
くなる傾向がありその上に幅の狭い金層が成長すること
になるため、T字状の電極を形成した場合に、図12に
示すように、上層金属と下層金属が密着して形成されな
いという問題が起こる。そのため、電極の機械的強度が
不足する外、ゲート抵抗が高くなり所望の高周波特性が
得られないなどの問題が生じていた。
Further, when platinum is contained in the layer forming the multilayer structure, the width of the stacked platinum layers tends to be narrower than the width of the lower layer electrode, and a narrow gold layer grows on it. Therefore, when the T-shaped electrode is formed, as shown in FIG. 12, there is a problem that the upper layer metal and the lower layer metal are not formed in close contact with each other. Therefore, the mechanical strength of the electrode is insufficient, and the gate resistance becomes high, so that a desired high frequency characteristic cannot be obtained.

【0008】したがって、本発明の目的は、半導体装置
の長期信頼性を確保することができるとともに、高周波
特性を劣化させることのない電極構造を、安定して歩留
り高く形成しうるようにすることである。
Therefore, an object of the present invention is to ensure long-term reliability of a semiconductor device and to stably form an electrode structure which does not deteriorate high frequency characteristics with high yield. is there.

【0009】[0009]

【課題を解決するための手段】上記の目的を達成するた
めの本発明による電界効果トランジスタの多層金属ショ
ットキー性電極は、III −V族化合物半導体上に、モリ
ブデン(Mo)膜を下層としチタン(Ti)膜を上層と
する積層膜が1乃至複数層が形成され、その上に良導電
性金属層が形成されていることを特徴とするものであ
る。
A multi-layer metal Schottky electrode of a field effect transistor according to the present invention for achieving the above object is a titanium compound having a molybdenum (Mo) film as a lower layer on a III-V compound semiconductor. One or a plurality of laminated films having a (Ti) film as an upper layer are formed, and a good conductive metal layer is formed thereon.

【0010】[0010]

【発明の実施の形態】次に、本発明の実施の形態につい
て図面を参照して説明する。ここでは、例としてガリウ
ム・砒素(GaAs)上のゲート電極構造について説明
するが、これに限るものではなく、III-V族化合物半導
体素子に用いる電極であれば半導体材料を問わず、また
格子整合系、歪系のいずれの場合であっても適用するこ
とができる。
Next, embodiments of the present invention will be described with reference to the drawings. Here, a gate electrode structure on gallium arsenide (GaAs) will be described as an example, but the present invention is not limited to this, and any semiconductor material may be used as long as it is an electrode used for a III-V group compound semiconductor element, and lattice matching is possible. It can be applied to both cases of system and strain system.

【0011】図1は、本発明の実施の形態を説明するた
めのショットキー性電極の断面図である。この構造の電
極を形成するには、まず、GaAsショットキーコンタ
クト層11上にフォトレジストを塗布する。次に、縮小
投影法や電子線露光法を用いてフォトレジスト膜に開口
部を形成する。その後、電子ビーム蒸着法等の成膜法を
用いて、モリブデン層12、チタン層13、アルミニウ
ム層14を順次連続的に全面的に被着する。次に、フォ
トレジストを除去するとともにその上の不要の金属膜を
リフトオフすれば、開口部に所望の形状の電極が形成さ
れる。
FIG. 1 is a sectional view of a Schottky electrode for explaining an embodiment of the present invention. To form an electrode having this structure, first, a photoresist is applied on the GaAs Schottky contact layer 11. Next, an opening is formed in the photoresist film by using a reduction projection method or an electron beam exposure method. After that, a molybdenum layer 12, a titanium layer 13, and an aluminum layer 14 are sequentially and continuously deposited on the entire surface by a film forming method such as an electron beam evaporation method. Next, by removing the photoresist and lifting off the unnecessary metal film thereon, an electrode having a desired shape is formed in the opening.

【0012】本発明によるショットキー性電極の特徴的
な点は次の2点である。 半導体層と接触しこれとショットキーコンタクトを
形成する金属がモリブデンであること。 白金を用いていないこと。
The characteristic points of the Schottky electrode according to the present invention are the following two points. The metal that contacts the semiconductor layer and forms a Schottky contact therewith is molybdenum. Do not use platinum.

【0013】本発明による電界効果トランジスタのショ
ットキー性電極は、さらに次のような実施の形態を採り
うる。 良導電性金属膜としてアルミニウム層に代え、金層
を用いる。 良導電性金属膜の上に上層に形成される金属層との
密着性を向上させるためのチタン層を形成する。 モリブデン層とチタン層との積層膜を2層乃至それ
以上に積層する。 良導電性金属とその下層のチタン膜との間にモリブ
デン層のようなバリアメタル層を介在させる。 T字状開口を有するフォトレジスト膜を用い、リフ
トオフ法により電極を形成する。
The Schottky electrode of the field effect transistor according to the present invention can take the following embodiments. A gold layer is used instead of the aluminum layer as the good conductive metal film. A titanium layer is formed on the good-conductivity metal film to improve the adhesion with the upper metal layer. A laminated film of a molybdenum layer and a titanium layer is laminated in two or more layers. A barrier metal layer such as a molybdenum layer is interposed between the good conductive metal and the underlying titanium film. An electrode is formed by a lift-off method using a photoresist film having a T-shaped opening.

【0014】上記のようにして形成された多層電極で
は、GaAsショットキーコンタクト層11とモリブデ
ン層12とが活性状態でも相互反応を起こさないため、
長期に安定したショットキーコンタクトが確保される。
その上、多層構造中に白金が含まれていないため、製造
が容易で再現性よく歩留まり高く形成することが可能に
なる。さらに、白金を用いていないことにより、T字状
の電極を形成した際に、電極細りが発生しないため、上
層と下層の密着性が悪化することがなくなり、デバイス
の高周波特性を劣化させることがなくなる。
In the multilayer electrode formed as described above, since the GaAs Schottky contact layer 11 and the molybdenum layer 12 do not react with each other even in the active state,
A stable Schottky contact is secured for a long period of time.
Moreover, since platinum is not contained in the multilayer structure, it is possible to form the layer easily with good reproducibility and with high yield. Furthermore, since platinum is not used, when the T-shaped electrode is formed, electrode thinning does not occur, so that the adhesiveness between the upper layer and the lower layer does not deteriorate, and the high frequency characteristics of the device may deteriorate. Disappear.

【0015】[0015]

【実施例】以下、本発明の実施例について図面を参照し
て説明する。 [第1の実施例]図1は、第1の実施例の断面構造を示
す。図1に示すように、GaAsショットキーコンタク
ト層11上に、電子ビーム蒸着法により、膜厚10nm
のモリブデン層12、膜厚20nmのチタン層13、さ
らに膜厚420nmのアルミニウム層14を順次形成し
た。この積層膜はフォトレジストを用いたリフトオフ法
によりパターニングした。
Embodiments of the present invention will be described below with reference to the drawings. [First Embodiment] FIG. 1 shows a sectional structure of the first embodiment. As shown in FIG. 1, a film thickness of 10 nm is formed on the GaAs Schottky contact layer 11 by an electron beam evaporation method.
A molybdenum layer 12, a titanium layer 13 having a film thickness of 20 nm, and an aluminum layer 14 having a film thickness of 420 nm were sequentially formed. This laminated film was patterned by a lift-off method using a photoresist.

【0016】[第2の実施例]図2は、本発明の第2の
実施例を示す断面図である。同図に示すように、GaA
sショットキーコンタクト層21上に、電子ビーム蒸着
法を用いて、膜厚10nmのモリブデン層22、膜厚2
0nmのチタン層23、膜厚400nmのアルミニウム
層24および膜厚20nmのチタン層25を順次連続的
に成膜し、リフトオフ法を用いてパターニングした。
[Second Embodiment] FIG. 2 is a sectional view showing a second embodiment of the present invention. As shown in the figure, GaA
On the s-Schottky contact layer 21, a molybdenum layer 22 having a thickness of 10 nm and a thickness of 2 are formed by using an electron beam evaporation method.
A 0 nm titanium layer 23, a 400 nm thick aluminum layer 24, and a 20 nm thick titanium layer 25 were successively and successively formed, and patterned by a lift-off method.

【0017】[第3の実施例]図3は、本発明の第3の
実施例を示す断面図である。同図に示すように、GaA
sショットキーコンタクト層31上に、電子ビーム蒸着
法を用いて、モリブデン層32を10nmの膜厚に、チ
タン層33を20nmの膜厚に、バリアメタル層として
のモリブデン層34を10nmの膜厚に、良導電性金属
層としての金層35を410nmの膜厚に順次連続的に
成膜し、リフトオフ法によりパターニングした。
[Third Embodiment] FIG. 3 is a sectional view showing a third embodiment of the present invention. As shown in the figure, GaA
On the s-Schottky contact layer 31, a molybdenum layer 32 with a thickness of 10 nm, a titanium layer 33 with a thickness of 20 nm, and a molybdenum layer 34 as a barrier metal layer with a thickness of 10 nm are formed by electron beam evaporation. Then, a gold layer 35 as a good conductive metal layer was sequentially and continuously formed to a thickness of 410 nm and patterned by a lift-off method.

【0018】[第4の実施例]図4は、本発明の第4の
実施例を示す断面図である。同図に示すように、GaA
sショットキーコンタクト層41上に、電子ビーム蒸着
法を用いて、モリブデン層42を10nmの膜厚に、チ
タン層43を20nmの膜厚に、バリアメタル層として
のモリブデン層44を20nmの膜厚に、良導電性金属
層としての金層45を380nmの膜厚に、密着層とし
てのチタン層46を20nmの膜厚に順次連続的に成膜
し、リフトオフ法によりパターニングした。
[Fourth Embodiment] FIG. 4 is a sectional view showing a fourth embodiment of the present invention. As shown in the figure, GaA
On the s-Schottky contact layer 41, a molybdenum layer 42 having a thickness of 10 nm, a titanium layer 43 having a thickness of 20 nm, and a molybdenum layer 44 serving as a barrier metal layer having a thickness of 20 nm are formed by electron beam evaporation. Then, a gold layer 45 as a good conductive metal layer having a film thickness of 380 nm and a titanium layer 46 as an adhesion layer having a film thickness of 20 nm were successively formed successively and patterned by a lift-off method.

【0019】[第5の実施例]図5は、本発明の第5の
実施例を示す断面図である。同図に示すように、GaA
sショットキーコンタクト層51上に、電子ビーム蒸着
法を用いて、膜厚10nmのモリブデン層52、膜厚1
0nmのチタン層53、膜厚10nmのモリブデン層5
4、膜厚10nmのチタン層55および膜厚410nm
のアルミニウム層56を順次連続的に成膜し、リフトオ
フ法を用いてパターニングした。
[Fifth Embodiment] FIG. 5 is a sectional view showing a fifth embodiment of the present invention. As shown in the figure, GaA
On the s Schottky contact layer 51, a molybdenum layer 52 having a film thickness of 10 nm and a film thickness of 1 were formed by using an electron beam evaporation method.
0 nm titanium layer 53, 10 nm thick molybdenum layer 5
4. Titanium layer 55 with 10 nm thickness and 410 nm thickness
The aluminum layer 56 was sequentially formed and patterned by the lift-off method.

【0020】この構造の電極では、一回の蒸着に必要な
モリブデンの厚さを薄くすることができるため、成膜が
より容易になりプロセスの安定化を図ることができる。
この実施例においては(モリブデン、チタン)を2単位
としたが、これに限るものではなく、所望の単位だけく
りかえすことが可能である。
In the electrode having this structure, the thickness of molybdenum required for one vapor deposition can be reduced, so that the film formation becomes easier and the process can be stabilized.
In this embodiment, (molybdenum, titanium) is set to 2 units, but the unit is not limited to this, and it is possible to repeat only desired units.

【0021】[第6の実施例]図6は、本発明の第6の
実施例を示す断面図である。同図に示すように、GaA
sショットキーコンタクト層61上に、電子ビーム蒸着
法を用いて、膜厚10nmのモリブデン層62、膜厚1
0nmのチタン層63、膜厚10nmのモリブデン層6
4、膜厚10nmのチタン層65、膜厚390nmのア
ルミニウム層66および膜厚20nmのチタン層67を
順次連続的に成膜し、リフトオフ法を用いてパターニン
グした。
[Sixth Embodiment] FIG. 6 is a sectional view showing a sixth embodiment of the present invention. As shown in the figure, GaA
On the s-Schottky contact layer 61, a molybdenum layer 62 having a thickness of 10 nm and a thickness of 1 are formed by using an electron beam evaporation method.
0 nm titanium layer 63, 10 nm thick molybdenum layer 6
4. A titanium layer 65 having a film thickness of 10 nm, an aluminum layer 66 having a film thickness of 390 nm, and a titanium layer 67 having a film thickness of 20 nm were successively and successively formed, and patterned by a lift-off method.

【0022】[第7の実施例]図7は、本発明の第7の
実施例を示す断面図である。同図に示すように、GaA
sショットキーコンタクト層71上に、電子ビーム蒸着
法を用いて、膜厚10nmのモリブデン層72、膜厚1
0nmのチタン層73、膜厚10nmのモリブデン層7
4、膜厚10nmのチタン層75を積層した後、続いて
バリアメタル層としてのモリブデン層76を10nmの
膜厚に、良導電性金属層としての金層77を400nm
の膜厚に順次連続的に成膜し、リフトオフ法によりパタ
ーニングした。
[Seventh Embodiment] FIG. 7 is a sectional view showing a seventh embodiment of the present invention. As shown in the figure, GaA
On the s-Schottky contact layer 71, a molybdenum layer 72 having a thickness of 10 nm and a thickness of 1 are formed by an electron beam evaporation method.
0 nm titanium layer 73 and 10 nm thick molybdenum layer 7
4. After stacking a titanium layer 75 having a film thickness of 10 nm, a molybdenum layer 76 as a barrier metal layer having a film thickness of 10 nm and a gold layer 77 as a good conductive metal layer having a film thickness of 400 nm are successively formed.
The film thickness was sequentially and continuously formed and patterned by the lift-off method.

【0023】[第8の実施例]図8は、本発明の第8の
実施例を示す断面図である。同図に示すように、GaA
sショットキーコンタクト層81上に、電子ビーム蒸着
法を用いて、膜厚10nmのモリブデン層82、膜厚1
0nmのチタン層83、膜厚10nmのモリブデン層8
4、膜厚10nmのチタン層85を積層した後、続いて
バリアメタル層としてのモリブデン層86を10nmの
膜厚に、良導電性金属層としての金層87を380nm
の膜厚に、密着層としてのチタン層88を20nmの膜
厚に順次連続的に成膜し、リフトオフ法によりパターニ
ングした。
[Eighth Embodiment] FIG. 8 is a sectional view showing an eighth embodiment of the present invention. As shown in the figure, GaA
On the s-Schottky contact layer 81, a molybdenum layer 82 having a thickness of 10 nm and a thickness of 1 are formed by using an electron beam evaporation method.
0 nm titanium layer 83 and 10 nm thick molybdenum layer 8
4. After laminating a titanium layer 85 having a film thickness of 10 nm, a molybdenum layer 86 as a barrier metal layer having a film thickness of 10 nm and a gold layer 87 as a good conductive metal layer having a film thickness of 380 nm are successively formed.
Then, a titanium layer 88 as an adhesion layer having a thickness of 20 nm was successively and continuously formed to a thickness of 20 nm and patterned by a lift-off method.

【0024】[第9の実施例]図9は、本発明の第9の
実施例を示す断面図である。GaAsショットキーコン
タクト層91上に、フォトリソグラフィ法により、T字
状の開口を有するフォトレジスト膜(図示なし)を形成
した後、電子ビーム蒸着法を用いて、モリブデン、チタ
ン、モリブデン、金をそれぞれ10nm、20nm、1
0nm、410nmの膜厚に堆積した。次に、フォトレ
ジストとともに不要の金属膜を除去して、モリブデン層
92、96、チタン層93、97、モリブデン層94、
98、金層95、99からなるショットキー性電極を形
成した。上記のように形成した電極では、上層と下層の
金属層の密着性はよく、低抵抗のゲート電極を形成する
ことができた。
[Ninth Embodiment] FIG. 9 is a sectional view showing a ninth embodiment of the present invention. After forming a photoresist film (not shown) having a T-shaped opening on the GaAs Schottky contact layer 91 by photolithography, molybdenum, titanium, molybdenum, and gold are respectively formed by electron beam evaporation. 10nm, 20nm, 1
It was deposited to a film thickness of 0 nm and 410 nm. Next, the unnecessary metal film is removed together with the photoresist to remove the molybdenum layers 92 and 96, the titanium layers 93 and 97, the molybdenum layer 94,
A Schottky electrode composed of 98 and gold layers 95 and 99 was formed. In the electrode formed as described above, the adhesion between the upper and lower metal layers was good, and a low resistance gate electrode could be formed.

【0025】[0025]

【発明の効果】以上説明したように、本発明によれば、
III −V族化合物半導体の電極構造として、半導体界面
にモリブデンが導入されているために、金属−半導体間
の相互反応が抑制されるため信頼性の高いデバイスが得
られる。また、蒸着温度が高い白金をバリヤ層として含
まないために、プロセスが容易で再現性および歩留まり
の向上を図ることができる。さらに、白金を含まないた
め、白金を含んだ電極構造においてみられた電極幅の減
少がなく、T字型の電極の場合に上層と下層の金属層の
密着性を確保することが可能となる。したがって、低抵
抗な微細電極構造の作製が可能となり、FETの高周波
特性の劣化を防ぐことができる。
As described above, according to the present invention,
As an electrode structure of a III-V group compound semiconductor, since molybdenum is introduced into the semiconductor interface, a metal-semiconductor interaction is suppressed, so that a highly reliable device can be obtained. Further, since platinum having a high vapor deposition temperature is not included as a barrier layer, the process is easy and the reproducibility and the yield can be improved. Furthermore, since platinum is not included, there is no reduction in the electrode width seen in the electrode structure containing platinum, and in the case of a T-shaped electrode, it is possible to secure the adhesion between the upper and lower metal layers. . Therefore, a low resistance fine electrode structure can be manufactured, and deterioration of the high frequency characteristics of the FET can be prevented.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の実施の形態および第1の実施例を説明
するための断面図。
FIG. 1 is a cross-sectional view for explaining an embodiment mode and a first embodiment example of the present invention.

【図2】本発明の第2の実施例を説明するための断面
図。
FIG. 2 is a sectional view for explaining a second embodiment of the present invention.

【図3】本発明の第3の実施例を説明するための断面
図。
FIG. 3 is a sectional view for explaining a third embodiment of the present invention.

【図4】本発明の第4の実施例を説明するための断面
図。
FIG. 4 is a sectional view for explaining a fourth embodiment of the present invention.

【図5】本発明の第5の実施例を説明するための断面
図。
FIG. 5 is a sectional view for explaining a fifth embodiment of the present invention.

【図6】本発明の第6の実施例を説明するための断面
図。
FIG. 6 is a sectional view for explaining a sixth embodiment of the present invention.

【図7】本発明の第7の実施例を説明するための断面
図。
FIG. 7 is a sectional view for explaining a seventh embodiment of the present invention.

【図8】本発明の第8の実施例を説明するための断面
図。
FIG. 8 is a sectional view for explaining an eighth embodiment of the present invention.

【図9】本発明の第9の実施例を説明するための断面
図。
FIG. 9 is a sectional view for explaining a ninth embodiment of the present invention.

【図10】第1の従来例を示す断面図。FIG. 10 is a cross-sectional view showing a first conventional example.

【図11】第2の従来例を示す断面図。FIG. 11 is a sectional view showing a second conventional example.

【図12】第3の従来例を示す断面図。FIG. 12 is a sectional view showing a third conventional example.

【符号の説明】[Explanation of symbols]

11、21、31、41、51、61、71、81、9
1、101、111、121 GaAsショットキーコ
ンタクト層 12、22、32、34、42、44、52、54、6
2、64、72、74、76、82、84、86、9
2、94、96、98 モリブデン層 13、23、25、33、43、46、53、55、6
3、65、67、73、75、83、85、88、9
3、97、102、112、122、125 チタン層 14、24、56、66、113 アルミニウム層 35、45、77、87、95、99、104、12
4、127 金層 103、123、126 白金層
11, 21, 31, 41, 51, 61, 71, 81, 9
1, 101, 111, 121 GaAs Schottky contact layer 12, 22, 32, 34, 42, 44, 52, 54, 6
2, 64, 72, 74, 76, 82, 84, 86, 9
2, 94, 96, 98 Molybdenum layer 13, 23, 25, 33, 43, 46, 53, 55, 6
3, 65, 67, 73, 75, 83, 85, 88, 9
3, 97, 102, 112, 122, 125 Titanium layer 14, 24, 56, 66, 113 Aluminum layer 35, 45, 77, 87, 95, 99, 104, 12
4,127 Gold layer 103,123,126 Platinum layer

Claims (5)

【特許請求の範囲】[Claims] 【請求項1】 III −V族化合物半導体を用いた電界効
果トランジスタの多層金属ショットキー性電極であっ
て、半導体層上に、モリブデン(Mo)層を下層としチ
タン(Ti)層を上層とする積層膜が1乃至複数層が形
成され、その上に良導電性金属層が形成されていること
を特徴とする多層金属ショットキー性電極。
1. A multi-layer metal Schottky electrode for a field effect transistor using a III-V compound semiconductor, wherein a molybdenum (Mo) layer is a lower layer and a titanium (Ti) layer is an upper layer on a semiconductor layer. A multi-layer metal Schottky electrode, wherein one or more laminated films are formed, and a good conductive metal layer is formed thereon.
【請求項2】 前記良導電性金属層がアルミニウム(A
l)または金(Au)により形成されていることを特徴
とする請求項1記載の多層金属ショットキー性電極。
2. The good conductive metal layer is made of aluminum (A
The multi-layer metal Schottky electrode according to claim 1, which is formed of 1) or gold (Au).
【請求項3】 前記良導電性金属層上に密着層となるチ
タン層が形成されていることを特徴とする請求項1記載
の多層金属ショットキー性電極。
3. The multilayer metal Schottky electrode according to claim 1, wherein a titanium layer serving as an adhesion layer is formed on the good conductive metal layer.
【請求項4】 前記積層膜と前記良導電性金属層との間
にバリアメタル層が形成されていることを特徴とする請
求項1記載の多層金属ショットキー性電極。
4. The multi-layer metal Schottky electrode according to claim 1, wherein a barrier metal layer is formed between the laminated film and the good conductive metal layer.
【請求項5】 前記バリアメタル層がモリブデン層であ
ることを特徴とする請求項4記載の多層金属ショットキ
ー性電極。
5. The multi-layer metal Schottky electrode according to claim 4, wherein the barrier metal layer is a molybdenum layer.
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