JPH09245137A - メモリカード - Google Patents
メモリカードInfo
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- JPH09245137A JPH09245137A JP7808396A JP7808396A JPH09245137A JP H09245137 A JPH09245137 A JP H09245137A JP 7808396 A JP7808396 A JP 7808396A JP 7808396 A JP7808396 A JP 7808396A JP H09245137 A JPH09245137 A JP H09245137A
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- 230000010365 information processing Effects 0.000 description 2
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- Management, Administration, Business Operations System, And Electronic Commerce (AREA)
Abstract
(57)【要約】
【課題】不正なアクセスによる残度数カウンタの再充填
を行う等の不正を防止し、しかも、特別な乱数発生回路
の領域をメモリカード内に設けることなく、端末認証の
実行のために必要となる乱数を出力するメモリカードを
提供する。 【解決手段】端末認証を実行する際に用いる乱数（第３
の乱数）を、端末装置がカード認証を実行する際に入力
した乱数（第２の乱数）と、メモリ内に格納されている
乱数値（第１の乱数）から演算することにより、複雑な
乱数発生回路を搭載することなく、端末認証を実行する
度に異なる乱数（第３の乱数）を簡易に生成する。
を行う等の不正を防止し、しかも、特別な乱数発生回路
の領域をメモリカード内に設けることなく、端末認証の
実行のために必要となる乱数を出力するメモリカードを
提供する。 【解決手段】端末認証を実行する際に用いる乱数（第３
の乱数）を、端末装置がカード認証を実行する際に入力
した乱数（第２の乱数）と、メモリ内に格納されている
乱数値（第１の乱数）から演算することにより、複雑な
乱数発生回路を搭載することなく、端末認証を実行する
度に異なる乱数（第３の乱数）を簡易に生成する。
Description
【０００１】
【発明の属する技術分野】本発明はＩＣメモリを利用し
たプリペイドカードシステムに係る技術分野に属する。
特に、複数のメモリビットからなる残度数カウンタと相
互認証機能を有し、再充填して再使用することができ、
しかも相互認証に必要とされる乱数の発生回路を省略し
たメモリカードに関するものである。
たプリペイドカードシステムに係る技術分野に属する。
特に、複数のメモリビットからなる残度数カウンタと相
互認証機能を有し、再充填して再使用することができ、
しかも相互認証に必要とされる乱数の発生回路を省略し
たメモリカードに関するものである。
【０００２】
【従来の技術】電話カード等に用いられているＩＣメモ
リプリペイドカードにおいては、残度数を記憶するカウ
ンタは常に減算のみ可能であり増加させることができな
いようになっている。このため、プリペイドカードはカ
ウンタの全数値の減算が終了し購入したカードの金額を
使い切ってしまうと捨てなければならない。すなわち、
“使い捨て”の状態であった。
リプリペイドカードにおいては、残度数を記憶するカウ
ンタは常に減算のみ可能であり増加させることができな
いようになっている。このため、プリペイドカードはカ
ウンタの全数値の減算が終了し購入したカードの金額を
使い切ってしまうと捨てなければならない。すなわち、
“使い捨て”の状態であった。
【０００３】
【発明が解決しようとする課題】特開平３−８０９０
「再使用可能なプリペイドメモリカード」には、メモリ
カードの再充填機がカードの正当性を確認するという記
載がある。しかし、その記載の方法では、不正なカード
充填機を用いてカウンタの残度数を増加させ再使用する
ことを防止することができない。
「再使用可能なプリペイドメモリカード」には、メモリ
カードの再充填機がカードの正当性を確認するという記
載がある。しかし、その記載の方法では、不正なカード
充填機を用いてカウンタの残度数を増加させ再使用する
ことを防止することができない。
【０００４】これに対し、カードと端末の間で相互認証
を行い互いに正当であることが確認された場合に、カウ
ンタの再充填を行う方法が提案されている。しかし、連
続した不正なアクセスにより、再充填キーが盗まれてし
まう恐れがある。また、端末認証の実行のために必要と
なる乱数をカードが出力するために、特別な乱数発生回
路の領域をプリペイドカード内に設ける必要があった。
を行い互いに正当であることが確認された場合に、カウ
ンタの再充填を行う方法が提案されている。しかし、連
続した不正なアクセスにより、再充填キーが盗まれてし
まう恐れがある。また、端末認証の実行のために必要と
なる乱数をカードが出力するために、特別な乱数発生回
路の領域をプリペイドカード内に設ける必要があった。
【０００５】
【課題を解決するための手段】これらの問題を解決する
ために、本発明によるメモリカードは端末認証を実行す
る際に用いる乱数（第３の乱数）を、端末装置がカード
認証を実行する際に入力した乱数（第２の乱数）と、メ
モリ内に格納されている乱数（第１の乱数）から演算す
ることにより、複雑な乱数発生回路を搭載することな
く、端末認証を実行する度に異なる乱数（第３の乱数）
を簡易に生成することができる。
ために、本発明によるメモリカードは端末認証を実行す
る際に用いる乱数（第３の乱数）を、端末装置がカード
認証を実行する際に入力した乱数（第２の乱数）と、メ
モリ内に格納されている乱数（第１の乱数）から演算す
ることにより、複雑な乱数発生回路を搭載することな
く、端末認証を実行する度に異なる乱数（第３の乱数）
を簡易に生成することができる。
【０００６】
【発明の実施の形態】以下、本発明について実施の形態
により説明する。図１は本発明のメモリカードにおける
情報処理機構の構成を示す図である。図１において、１
は本発明のメモリカード、２はＩＣメモリ等からなる記
憶手段、３は論理回路またはＣＰＵ（central processi
ng unit ）等からなる演算手段、４は端末装置とデータ
の送受信を行うためのインタフェースである。
により説明する。図１は本発明のメモリカードにおける
情報処理機構の構成を示す図である。図１において、１
は本発明のメモリカード、２はＩＣメモリ等からなる記
憶手段、３は論理回路またはＣＰＵ（central processi
ng unit ）等からなる演算手段、４は端末装置とデータ
の送受信を行うためのインタフェースである。
【０００７】記憶手段２はさらに細部により構成され、
５はカードＩＤ等のＩＣメモリカードを識別するための
データを記憶するＩＣ識別領域、６はユーザＩＤ等のユ
ーザを識別するためのデータを記憶するユーザ領域、７
は再充填回数やその上限値等の発行者側で設定するデー
タを記憶する発行者領域、８はプリペイドカードの残度
数を記憶するカウンタ領域である。ここに、残度数はプ
リペイドカードの残りを示す数値であり、実際の金額、
電話等の度数、乗り物等の利用回数のような数値であ
る。また、９は元々記憶している第１の乱数、１０は端
末装置（図示せず）から入力した第２の乱数、１１は第
１の乱数９と第２の乱数１０から演算した第３の乱数で
ある。
５はカードＩＤ等のＩＣメモリカードを識別するための
データを記憶するＩＣ識別領域、６はユーザＩＤ等のユ
ーザを識別するためのデータを記憶するユーザ領域、７
は再充填回数やその上限値等の発行者側で設定するデー
タを記憶する発行者領域、８はプリペイドカードの残度
数を記憶するカウンタ領域である。ここに、残度数はプ
リペイドカードの残りを示す数値であり、実際の金額、
電話等の度数、乗り物等の利用回数のような数値であ
る。また、９は元々記憶している第１の乱数、１０は端
末装置（図示せず）から入力した第２の乱数、１１は第
１の乱数９と第２の乱数１０から演算した第３の乱数で
ある。
【０００８】また演算手段３はさらに細部により構成さ
れ、１２はメモリカード１によって端末装置が正規であ
るか否かの認証を行う場合にメモリカード側の処理を行
う端末認証手段、１３は端末装置によってメモリカード
１が正規であるか否かの認証を行う場合にメモリカード
側の処理を行うカード認証手段、１４は端末装置がカー
ド認証を行う際に出力する第２の乱数をメモリカード１
に入力するための乱数入力手段、１５は第１の乱数９と
第２の乱数１０から第３の乱数１１を演算する乱数演算
手段である。
れ、１２はメモリカード１によって端末装置が正規であ
るか否かの認証を行う場合にメモリカード側の処理を行
う端末認証手段、１３は端末装置によってメモリカード
１が正規であるか否かの認証を行う場合にメモリカード
側の処理を行うカード認証手段、１４は端末装置がカー
ド認証を行う際に出力する第２の乱数をメモリカード１
に入力するための乱数入力手段、１５は第１の乱数９と
第２の乱数１０から第３の乱数１１を演算する乱数演算
手段である。
【０００９】以上の構成において、メモリカード１の動
作を説明する。通常の利用あるいは再充填処理を行う等
のために、メモリカード１を端末装置にセットすると、
メモリカード１はその端末認証手段１２によって端末装
置が正規であるか否かの認証処理を行う。その際に、記
憶手段２に記憶されている第３の乱数１１を使用する。
第３の乱数１１は、第１の乱数９と第２の乱数１０に基
づいて乱数演算手段１５が演算した乱数である。ここに
第１の乱数９は、あらかじめ記憶手段２が記憶する乱数
である。また第２の乱数１０は、前回、端末装置がカー
ド認証処理を行った際に生成した乱数であって、乱数入
力手段１４が入力し記憶手段２に記憶した乱数である。
作を説明する。通常の利用あるいは再充填処理を行う等
のために、メモリカード１を端末装置にセットすると、
メモリカード１はその端末認証手段１２によって端末装
置が正規であるか否かの認証処理を行う。その際に、記
憶手段２に記憶されている第３の乱数１１を使用する。
第３の乱数１１は、第１の乱数９と第２の乱数１０に基
づいて乱数演算手段１５が演算した乱数である。ここに
第１の乱数９は、あらかじめ記憶手段２が記憶する乱数
である。また第２の乱数１０は、前回、端末装置がカー
ド認証処理を行った際に生成した乱数であって、乱数入
力手段１４が入力し記憶手段２に記憶した乱数である。
【００１０】乱数演算手段１５の行う演算は、第１の
乱数９と第２の乱数１０から特定の桁は特定の乱数のそ
の桁から抽出して第３の乱数１１を組み立てる、第１
の乱数９と第２の乱数１０の各桁の並び順序を入れ換え
第３の乱数１１を組み立てる、第１の乱数９と第２の
乱数１０の桁をシフトして第３の乱数１１を組み立て
る、第１の乱数９と第２の乱数１０の間で数値演算ま
たは論理演算を行い第３の乱数１１を組み立てる、第
１の乱数９と第２の乱数１０と、所定の数値との間で数
値演算または論理演算を行い第３の乱数１１を組み立て
る、のような演算処理が含まれる。実際の演算は、これ
らの内の１つ、または、複数を組み合わせて行われる。
上述の乱数発生方法のいずれか、または、組合せによ
り、実行の都度、異なる乱数を生成することができ、不
正端末を使用して再充填処理を行う等のメモリカードの
不正使用を防止することができる。
乱数９と第２の乱数１０から特定の桁は特定の乱数のそ
の桁から抽出して第３の乱数１１を組み立てる、第１
の乱数９と第２の乱数１０の各桁の並び順序を入れ換え
第３の乱数１１を組み立てる、第１の乱数９と第２の
乱数１０の桁をシフトして第３の乱数１１を組み立て
る、第１の乱数９と第２の乱数１０の間で数値演算ま
たは論理演算を行い第３の乱数１１を組み立てる、第
１の乱数９と第２の乱数１０と、所定の数値との間で数
値演算または論理演算を行い第３の乱数１１を組み立て
る、のような演算処理が含まれる。実際の演算は、これ
らの内の１つ、または、複数を組み合わせて行われる。
上述の乱数発生方法のいずれか、または、組合せによ
り、実行の都度、異なる乱数を生成することができ、不
正端末を使用して再充填処理を行う等のメモリカードの
不正使用を防止することができる。
【００１１】このように、本発明のメモリカードにおい
ては端末装置が生成した乱数に基づいて演算された乱数
（第３の乱数１１）を用いて端末認証処理が行われるた
め、複雑な構成でチップ面積を必要とする乱数発生回路
をメモリカードのＩＣのチップ上に設ける必要がなく、
メモリカードは安価となる。
ては端末装置が生成した乱数に基づいて演算された乱数
（第３の乱数１１）を用いて端末認証処理が行われるた
め、複雑な構成でチップ面積を必要とする乱数発生回路
をメモリカードのＩＣのチップ上に設ける必要がなく、
メモリカードは安価となる。
【００１２】本発明においてはメモリカード１の記憶手
段２の特定の領域を、内部からは読み取り可能である
が、外部からは読み取り不可能に構成する。たとえば、
ＩＣ識別領域５、カウンタ領域８および第３の乱数１１
を除く、ユーザ領域６、発行者領域７、第１の乱数９お
よび第２の乱数１０を内部からは読み取り可能である
が、外部からは読み取り不可能に構成する。このような
構成は、各領域ごとに独立して読取モードの設定を行え
るようにし、内部からは読取モードへの設定を行えるが
外部からは読取モードへの設定を行えないようにするこ
とにより実現できる。また、相互認証処理は、メモリカ
ードによる端末装置が正規であるか否かを判定する端末
認証処理を先に行い、正規と判定した場合にのみ、端末
装置によるメモリカードが正規であるか否かを判定する
カード認証処理を行う。これらによりむやみにメモリカ
ードの記憶データが読み取られることがないから、再充
填処理等が不正に行われることに対するセキュリティが
向上する。
段２の特定の領域を、内部からは読み取り可能である
が、外部からは読み取り不可能に構成する。たとえば、
ＩＣ識別領域５、カウンタ領域８および第３の乱数１１
を除く、ユーザ領域６、発行者領域７、第１の乱数９お
よび第２の乱数１０を内部からは読み取り可能である
が、外部からは読み取り不可能に構成する。このような
構成は、各領域ごとに独立して読取モードの設定を行え
るようにし、内部からは読取モードへの設定を行えるが
外部からは読取モードへの設定を行えないようにするこ
とにより実現できる。また、相互認証処理は、メモリカ
ードによる端末装置が正規であるか否かを判定する端末
認証処理を先に行い、正規と判定した場合にのみ、端末
装置によるメモリカードが正規であるか否かを判定する
カード認証処理を行う。これらによりむやみにメモリカ
ードの記憶データが読み取られることがないから、再充
填処理等が不正に行われることに対するセキュリティが
向上する。
【００１３】
【実施例】次に、本発明について実施例により説明す
る。まず、再充填処理について説明する。図２は本発明
のメモリカードにおいて相互認証と再充填（カウンタリ
チャージ）を行う処理過程を示すフロー図である。図２
に示すように再充填処理は、まずメモリカードにより端
末認証が実行され（Ｓ１）、正規の端末装置でない場合
（Ｓ２）には再充填処理を中断する（Ｓ３）。また、正
規の端末装置の場合（Ｓ２）には、端末装置によりカー
ド認証が実行される。この際第２の乱数が端末装置によ
り生成されメモリカードが入力する（Ｓ４）。カード認
証の結果メモリカードが正規でない場合（Ｓ５）には再
充填処理を中断する（Ｓ３）。また、正規のメモリカー
ドの場合（Ｓ５）には、再充填命令を実行する（Ｓ
６）。実行後に再充填処理を終了する。
る。まず、再充填処理について説明する。図２は本発明
のメモリカードにおいて相互認証と再充填（カウンタリ
チャージ）を行う処理過程を示すフロー図である。図２
に示すように再充填処理は、まずメモリカードにより端
末認証が実行され（Ｓ１）、正規の端末装置でない場合
（Ｓ２）には再充填処理を中断する（Ｓ３）。また、正
規の端末装置の場合（Ｓ２）には、端末装置によりカー
ド認証が実行される。この際第２の乱数が端末装置によ
り生成されメモリカードが入力する（Ｓ４）。カード認
証の結果メモリカードが正規でない場合（Ｓ５）には再
充填処理を中断する（Ｓ３）。また、正規のメモリカー
ドの場合（Ｓ５）には、再充填命令を実行する（Ｓ
６）。実行後に再充填処理を終了する。
【００１４】次に相互認証の一方の認証処理である端末
認証処理について説明する。図３は端末認証の処理過程
を示すフロー図である。ステップＳ１０１〜Ｓ１０４に
おいて、端末装置はメモリカード１に“カードＩＤ送出
要求”を出力し、これを受けたメモリカード１は“カー
ドＩＤ”を端末装置に出力する。端末装置はメモリカー
ド１からその“カードＩＤ”を読取る。次に、端末装置
は記憶している“マスターキーＭ”と“カードＩＤ”か
ら関数ｆを使用して“端末認証キーｆ（ＩＤ，Ｍ）”を
生成する。
認証処理について説明する。図３は端末認証の処理過程
を示すフロー図である。ステップＳ１０１〜Ｓ１０４に
おいて、端末装置はメモリカード１に“カードＩＤ送出
要求”を出力し、これを受けたメモリカード１は“カー
ドＩＤ”を端末装置に出力する。端末装置はメモリカー
ド１からその“カードＩＤ”を読取る。次に、端末装置
は記憶している“マスターキーＭ”と“カードＩＤ”か
ら関数ｆを使用して“端末認証キーｆ（ＩＤ，Ｍ）”を
生成する。
【００１５】次に、ステップＳ１０５〜Ｓ１０６におい
て、メモリカード１は前記の“端末認証キーｆ（ＩＤ，
Ｍ）”をその発行時に記憶している。端末装置はメモリ
カード１に“乱数送出要求”を出力し、これを入力した
メモリカード１は記憶手段２に前回のカード認証（後述
する）において記憶した第３の乱数１１（ＲＮＡ’）を
端末装置に出力し、端末装置はその乱数“ＲＮＡ’”を
読取る。次に、ステップＳ１０７〜Ｓ１１０において、
メモリカード１と端末装置はともに認証のための関数ｇ
（）を有し、関数ｇ（ｆ（ＩＤ，Ｍ），ＲＮＡ’）を計
算する。
て、メモリカード１は前記の“端末認証キーｆ（ＩＤ，
Ｍ）”をその発行時に記憶している。端末装置はメモリ
カード１に“乱数送出要求”を出力し、これを入力した
メモリカード１は記憶手段２に前回のカード認証（後述
する）において記憶した第３の乱数１１（ＲＮＡ’）を
端末装置に出力し、端末装置はその乱数“ＲＮＡ’”を
読取る。次に、ステップＳ１０７〜Ｓ１１０において、
メモリカード１と端末装置はともに認証のための関数ｇ
（）を有し、関数ｇ（ｆ（ＩＤ，Ｍ），ＲＮＡ’）を計
算する。
【００１６】次に、ステップＳ１１１において、端末装
置は計算結果をメモリカード１に出力し、メモリカード
１はそれを読取り両者の計算結果が等しいことの確認を
する。計算結果が等しければその端末装置は正規の端末
装置であり、計算結果が等しく無ければその端末装置は
正規の端末装置ではない。
置は計算結果をメモリカード１に出力し、メモリカード
１はそれを読取り両者の計算結果が等しいことの確認を
する。計算結果が等しければその端末装置は正規の端末
装置であり、計算結果が等しく無ければその端末装置は
正規の端末装置ではない。
【００１７】次に相互認証の他方の認証処理であるカー
ド認証処理について説明する。図４はカード認証の処理
過程を示すフロー図である。ステップＳ２０１〜Ｓ２０
４において、端末装置はメモリカード１に“カードＩＤ
送出要求”を出力し、これを受けたメモリカード１は
“カードＩＤ”を端末装置に出力する。端末装置はメモ
リカード１からその“カードＩＤ”を読取る。次に、端
末装置は記憶している“マスターキーＭ”と“カードＩ
Ｄ”から関数ｈを使用して“カード認証キーｈ（ＩＤ，
Ｍ）”を生成する。
ド認証処理について説明する。図４はカード認証の処理
過程を示すフロー図である。ステップＳ２０１〜Ｓ２０
４において、端末装置はメモリカード１に“カードＩＤ
送出要求”を出力し、これを受けたメモリカード１は
“カードＩＤ”を端末装置に出力する。端末装置はメモ
リカード１からその“カードＩＤ”を読取る。次に、端
末装置は記憶している“マスターキーＭ”と“カードＩ
Ｄ”から関数ｈを使用して“カード認証キーｈ（ＩＤ，
Ｍ）”を生成する。
【００１８】次に、ステップＳ２０５〜Ｓ２０６におい
て、メモリカード１は前記の“カード認証キーｈ（Ｉ
Ｄ，Ｍ）”をその発行時に記憶している。端末装置は乱
数“ＲＮＢ”を生成する。端末装置はその乱数“ＲＮ
Ｂ”をメモリカード１に出力し、メモリカード１はその
乱数“ＲＮＢ”を読取り、記憶手段２に第２の乱数１０
として記憶する。次に、ステップＳ２０７〜Ｓ２１０に
おいて、メモリカード１と端末装置はともに認証のため
の関数ｇ（）を有し、関数ｇ（ｈ（ＩＤ，Ｍ），ＲＮ
Ｂ）を計算する。
て、メモリカード１は前記の“カード認証キーｈ（Ｉ
Ｄ，Ｍ）”をその発行時に記憶している。端末装置は乱
数“ＲＮＢ”を生成する。端末装置はその乱数“ＲＮ
Ｂ”をメモリカード１に出力し、メモリカード１はその
乱数“ＲＮＢ”を読取り、記憶手段２に第２の乱数１０
として記憶する。次に、ステップＳ２０７〜Ｓ２１０に
おいて、メモリカード１と端末装置はともに認証のため
の関数ｇ（）を有し、関数ｇ（ｈ（ＩＤ，Ｍ），ＲＮ
Ｂ）を計算する。
【００１９】次に、ステップＳ２１１において、メモリ
カード１は計算結果を端末装置に出力し、端末装置は両
者の計算結果が等しいことの確認をする。計算結果が等
しければそのメモリカード１は正規のメモリカードであ
り、計算結果が等しく無ければそのメモリカード１は正
規のメモリカードではない。一方、ステップＳ２１２に
おいて、メモリカード１は関数ｘ（）を有し、第２の乱
数１０（ＲＮＢ）とメモリカード１が記憶する第１の乱
数９（ＲＮＡ）とから、乱数演算手段１５によりｘ（Ｒ
ＮＡ，ＲＮＢ）を演算し、第３の乱数１１（ＲＮＡ’）
として記憶手段２に記憶する。
カード１は計算結果を端末装置に出力し、端末装置は両
者の計算結果が等しいことの確認をする。計算結果が等
しければそのメモリカード１は正規のメモリカードであ
り、計算結果が等しく無ければそのメモリカード１は正
規のメモリカードではない。一方、ステップＳ２１２に
おいて、メモリカード１は関数ｘ（）を有し、第２の乱
数１０（ＲＮＢ）とメモリカード１が記憶する第１の乱
数９（ＲＮＡ）とから、乱数演算手段１５によりｘ（Ｒ
ＮＡ，ＲＮＢ）を演算し、第３の乱数１１（ＲＮＡ’）
として記憶手段２に記憶する。
【００２０】不正使用を防止するため“ＲＮＡ’”と
“ＲＮＢ”は認証の都度、異なる値が送受信される必要
がある。乱数“ＲＮＢ”は端末が生成する値であり、マ
イクロコンピュータ等を使用して演算を行うため十分に
分散した値であると考えてよい。一方、乱数“ＲＮ
Ａ’”を、同様に十分に分散した値とするためには、従
来技術においてはメモリカード１が同様の乱数発生回路
を有することが不可欠であった。ところが上述のよう
に、本発明ではカード認証時に端末装置から送信される
乱数“ＲＮＢ”（メモリカード１の記憶手段２に記憶し
て第２の乱数１０となる）と、メモリカード１の記憶手
段２に記憶する第１の乱数９（ＲＮＡ）とから、演算を
行って、次回の相互認証を行う際に使用する新たな乱数
“ＲＮＡ’”を得るようにした。したがって、メモリカ
ード１は簡易な乱数演算手段１５を有するだけで十分に
分散した乱数を発生することができる。
“ＲＮＢ”は認証の都度、異なる値が送受信される必要
がある。乱数“ＲＮＢ”は端末が生成する値であり、マ
イクロコンピュータ等を使用して演算を行うため十分に
分散した値であると考えてよい。一方、乱数“ＲＮ
Ａ’”を、同様に十分に分散した値とするためには、従
来技術においてはメモリカード１が同様の乱数発生回路
を有することが不可欠であった。ところが上述のよう
に、本発明ではカード認証時に端末装置から送信される
乱数“ＲＮＢ”（メモリカード１の記憶手段２に記憶し
て第２の乱数１０となる）と、メモリカード１の記憶手
段２に記憶する第１の乱数９（ＲＮＡ）とから、演算を
行って、次回の相互認証を行う際に使用する新たな乱数
“ＲＮＡ’”を得るようにした。したがって、メモリカ
ード１は簡易な乱数演算手段１５を有するだけで十分に
分散した乱数を発生することができる。
【００２１】
【発明の効果】以上のとおりであるから本発明のメモリ
カードによれば、不正なアクセスによる残度数カウンタ
の再充填を行う等の不正使用を防止できる。また、特別
な乱数発生回路の領域をプリペイドカード内に設けるこ
となく、端末認証の実行のために必要とされる乱数をメ
モリカードが出力することができる。
カードによれば、不正なアクセスによる残度数カウンタ
の再充填を行う等の不正使用を防止できる。また、特別
な乱数発生回路の領域をプリペイドカード内に設けるこ
となく、端末認証の実行のために必要とされる乱数をメ
モリカードが出力することができる。
【図１】本発明のメモリカードにおける情報処理機構の
構成を示す図である。
構成を示す図である。
【図２】本発明のメモリカードにおいて相互認証と再充
填（カウンタリチャージ）を行う処理過程を示すフロー
図である。
填（カウンタリチャージ）を行う処理過程を示すフロー
図である。
【図３】端末認証の処理過程を示すフロー図である。
【図４】カード認証の処理過程を示すフロー図である。
１ メモリカード ２ 記憶手段 ３ 演算手段 ４ インタフェース ５ ＩＣ識別領域 ６ ユーザ領域 ７ 発行者領域 ８ カウンタ領域 ９ 第１の乱数 １０ 第２の乱数 １１ 第３の乱数 １２ 端末認証手段 １３ カード認証手段 １４ 乱数入力手段 １５ 乱数演算手段
Claims (5)
- 【請求項１】記憶手段と、乱数入力手段と、乱数演算手
段とを有し、 前記記憶手段は第１の乱数を記憶し、 前記乱数入力手段は端末装置がカード認証を実行する際
に端末装置から第２の乱数を入力し、 前記乱数演算手段は前記第１の乱数と前記第２の乱数か
ら端末認証を実行する上で用いられる第３の乱数を演算
する、 ことを特徴とするメモリカード。 - 【請求項２】前記記憶手段は外部から読み出し不可能な
記憶手段であることを特徴とする請求項１記載のメモリ
カード。 - 【請求項３】前記記憶手段は前記第２の乱数を記憶する
ことを特徴とする請求項１または２記載のメモリカー
ド。 - 【請求項４】前記記憶手段は前記第３の乱数を記憶する
ことを特徴とする請求項１〜３のいずれか記載のメモリ
カード。 - 【請求項５】メモリカードを使用する場合の相互認証に
おいて、端末認証はカード認証の前に実行することを特
徴とする請求項３または４記載のメモリカード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP07808396A JP3756241B2 (ja) | 1996-03-07 | 1996-03-07 | メモリカード |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP07808396A JP3756241B2 (ja) | 1996-03-07 | 1996-03-07 | メモリカード |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09245137A true JPH09245137A (ja) | 1997-09-19 |
| JP3756241B2 JP3756241B2 (ja) | 2006-03-15 |
Family
ID=13651962
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP07808396A Expired - Lifetime JP3756241B2 (ja) | 1996-03-07 | 1996-03-07 | メモリカード |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3756241B2 (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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-
1996
- 1996-03-07 JP JP07808396A patent/JP3756241B2/ja not_active Expired - Lifetime
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| JP4672056B2 (ja) * | 2008-12-01 | 2011-04-20 | 株式会社エフ・イー・シー | コンピュータシステムの利用補助装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3756241B2 (ja) | 2006-03-15 |
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