JPH09191276A - Transmitter-receiver for mobile communication system - Google Patents
Transmitter-receiver for mobile communication systemInfo
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- JPH09191276A JPH09191276A JP29841496A JP29841496A JPH09191276A JP H09191276 A JPH09191276 A JP H09191276A JP 29841496 A JP29841496 A JP 29841496A JP 29841496 A JP29841496 A JP 29841496A JP H09191276 A JPH09191276 A JP H09191276A
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Abstract
Description
【０００１】[0001]
【発明の属する技術分野】本発明は、符号分割多元接続
（ＣＤＭＡ：Code Division Multiple Access ）移動通
信システムに係り、特に、周波数分割全二重（Frequenc
y Division Duplex ：ＦＤＤ）と、時間分割全二重（Ti
me Division Duplex：ＴＤＤ）との双方を１台で実現し
た移動通信システム用送受信機に関するものである。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a code division multiple access (CDMA) mobile communication system, and more particularly to frequency division full duplex (Frequenc).
y Division Duplex: FDD) and time division full duplex (Ti
The present invention relates to a transmitter / receiver for a mobile communication system, which realizes both of a me Division Duplex (TDD).
【０００２】[0002]
【従来の技術】ほとんどの公衆移動通信では、双方向通
信をＦＤＤによって実現している。この場合、上りチャ
ネル（移動局→基地局）と下りチャネル（基地局→移動
局）とを分別するため、上りと下りとで異なるキャリア
周波数を用いている。例えば、８００ＭＨｚ帯を利用す
るＰＤＣ（Personal Digital Cellular ）では、キャリ
ア周波数を１３０ＭＨｚだけ離している（“デジタル方
式自動車電話システム”標準規格、ＲＣＲ ＳＴＤ−２
７、財団法人電波システム開発センタ 参照) 。2. Description of the Related Art In most public mobile communications, bidirectional communication is realized by FDD. In this case, different carrier frequencies are used for uplink and downlink in order to distinguish the uplink channel (mobile station → base station) and the downlink channel (base station → mobile station). For example, in a PDC (Personal Digital Cellular) using the 800 MHz band, the carrier frequencies are separated by 130 MHz ("Digital Car Telephone System" standard, RCR STD-2).
(See 7. Radio Wave System Development Center).
【０００３】一方、もうひとつの双方向通信方法にＴＤ
Ｄがある。これは、上りと下りで同一キャリア周波数を
用い、上り下りチャネルの分別を時間領域で行う。すな
わち、同一周波数を上りチャネルと下りチャネルで交互
に用いるのである。この例にＰＨＳ（Personal Handyph
one System）がある（“第２世代コードレス電話システ
ム”標準規格、ＲＣＲ ＳＴＤ−２８、財団法人電波シ
ステム開発センタ 参照)。On the other hand, TD is another bidirectional communication method.
There is D. This uses the same carrier frequency for uplink and downlink, and classifies uplink and downlink channels in the time domain. That is, the same frequency is used alternately for the upstream channel and the downstream channel. In this example, PHS (Personal Handyph
one system) (see "2nd Generation Cordless Telephone System" standard, RCR STD-28, Radio System Development Center, Japan).
【０００４】[0004]
【発明が解決しようとする課題】本発明の目的は、ＣＤ
ＭＡ移動通信において、周波数分割全二重（ＦＤＤ）と
時間分割全二重（ＴＤＤ）の双方を、１台で実現した移
動通信システム用送受信機を提供することにある。DISCLOSURE OF THE INVENTION The object of the present invention is to provide a CD
It is an object of the present invention to provide a transceiver for a mobile communication system that realizes both frequency division full duplex (FDD) and time division full duplex (TDD) in one MA mobile communication.
【０００５】[0005]
【課題を解決するための手段】上記目的を達成するため
に、本発明は、ＣＤＭＡ（Code Division Multiple Acc
ess ）移動通信システム用送受信機において、送信部
は、送信データをフレーム毎にインタリーブするインタ
リーバと、該インタリーバ内に設けられ、行および列単
位で書き込みおよび読み出し可能なインタリーブ・メモ
リと、インタリーブされた送信データを狭帯域変調信号
にデータ変調する変調手段と、該狭帯域変調信号を、拡
散系列を用いて、広帯域変調信号に拡散変調する拡散変
調手段とを具備し、前記インタリーバは、前記インタリ
ーブ・メモリに前記送信データを、行毎に書き込み、列
毎に読み出すことにより、前記インタリーブを実行し、
受信部は、前記広帯域変調信号を狭帯域変調信号へ変換
する逆拡散手段と、前記狭帯域信号を復調して復調デー
タを出力する復調手段と、前記復調データを前記フレー
ム毎にデインタリーブして、前記送信データを再生する
デインタリーバと、前記デインタリーバ内に設けられ、
行および列単位で書き込みおよび読み出し可能なデイン
タリーブ・メモリとを具備し、前記デインタリーバは、
前記デインタリーブ・メモリに前記復調データを列毎に
書き込み、行毎に読み出すことにより、前記デインタリ
ーブを実行し、前記送受信機は、前記インタリーブ・メ
モリからデータを読み出し、前記デインタリーブ・メモ
リへデータを書き込む場合に、列から列への移行速度
（列／秒）をあらかじめ決められた一定速度ＶT に制御
する一方、各列内のデータの読み出し速度ＶR および書
き込み速度ＶW （ビット／秒）を可変制御する制御手段
を具備することを特徴とする。In order to achieve the above object, the present invention provides a CDMA (Code Division Multiple Access).
ess) In a transceiver for a mobile communication system, a transmitter is interleaved with an interleaver that interleaves transmission data for each frame, and an interleave memory provided in the interleaver and capable of writing and reading in units of rows and columns. The interleaver comprises: a modulation means for data-modulating the transmission data into a narrowband modulation signal; and a spreading modulation means for spreading-modulating the narrowband modulation signal into a wideband modulation signal using a spreading sequence. The transmission data is written in the memory for each row and is read for each column to perform the interleaving,
The receiving unit includes a despreading unit that converts the wideband modulated signal into a narrowband modulated signal, a demodulation unit that demodulates the narrowband signal and outputs demodulated data, and deinterleaves the demodulated data for each frame. A deinterleaver for reproducing the transmission data, and provided in the deinterleaver,
A deinterleave memory capable of writing and reading in units of rows and columns, wherein the deinterleaver is
By writing the demodulated data in the deinterleave memory for each column and reading for each row, the deinterleave is performed, the transceiver reads the data from the interleave memory, and the data is written to the deinterleave memory. In the case of writing, the transfer speed from column to column (column / second) is controlled to a predetermined constant speed V T , while the reading speed V R and the writing speed V W (bit / second) of the data in each column are controlled. ) Is variably controlled.
【０００６】また、前記制御手段は、前記インタリーブ
・メモリの各列データの読み出し速度ＶR および前記デ
インタリーブ・メモリの各列データの書き込み速度ＶW
（ビット／秒）を、ＦＤＤモードのときには、ＶR ＝Ｖ
W ＝ＶT ・Ｍs 、ただし、Ｍs は各列のビット数とし、
ＴＤＤモードのときには、ＶR ＞２ＶT ・Ｍs およびＶ
W ＞２ＶT ・Ｍs とし、列の最後のビットを読み出した
後、次の列の読み出し開始時間までに、前記送受信機を
送信モードから受信モードに切り替えることができる。The control means may read the column data in the interleave memory at a read speed V R and write the column data in the deinterleave memory at a write speed V W.
(Bit / sec) is V R = V in the FDD mode
W = V T · M s , where M s is the number of bits in each column,
In the TDD mode, V R > 2V T · M s and V
With W > 2V T · M s , the transceiver can be switched from transmit mode to receive mode by the time the read start time of the next column is reached after reading the last bit of the column.
【０００７】その上、前記インタリーバは、前記インタ
リーバ・メモリの最初に、パイロット・シンボルを書き
込むこともできる。Moreover, the interleaver may write pilot symbols at the beginning of the interleaver memory.
【０００８】さらに、前記拡散変調手段の出力側に接続
され、前記送信データ中の重要データの送信電力を増加
する送信電力制御手段を具備してもよい。Further, a transmission power control means may be provided which is connected to the output side of the spread modulation means and which increases the transmission power of the important data in the transmission data.
【０００９】前記重要データは、前記パイロット・シン
ボルおよび制御データであってもよい。The important data may be the pilot symbols and control data.
【００１０】上記の構成で、行と列を入れ替えてもよ
い。With the above arrangement, the rows and columns may be interchanged.
【００１１】本発明によれば、簡単な構成で、ＣＤＭＡ
移動通信において、インタリーバおよびデインタリーバ
の読み出しおよび書き込み速度の単純な制御のみで、周
波数分割全二重（ＦＤＤ）と時間分割全二重（ＴＤＤ）
の双方を１台で実現できる。According to the present invention, the CDMA has a simple structure.
In mobile communications, frequency division full-duplex (FDD) and time division full-duplex (TDD) with only simple control of read and write speeds of interleaver and deinterleaver.
Both can be realized with one unit.
【００１２】また、インタリーバ・メモリの最初にパイ
ロット・シンボルを書き込むと、後でパイロット・シン
ボルを挿入する必要がない。Also, writing pilot symbols at the beginning of the interleaver memory eliminates the need for later insertion of pilot symbols.
【００１３】その上、重要なデータに対して送信電力を
増やしているので、重要なデータは確実に受信される。Moreover, since the transmission power is increased for the important data, the important data is surely received.
【００１４】[0014]
【発明の実施の形態】以下、図面を参照して、本発明の
実施形態を説明する。Embodiments of the present invention will be described below with reference to the drawings.
【００１５】まず、本発明において用いているＣＤＭＡ
移動通信システムの伝送方法を説明する。First, the CDMA used in the present invention.
A transmission method of the mobile communication system will be described.
【００１６】図１（Ａ）は、通常の移動通信におけるフ
レーム構成を示している。送信すべきユーザデータ系列
は、予め定めた時間長のフレームに分割される。次に、
各フレームの先頭部に制御データを付加するとともに、
各フレームの最後部に各フレーム毎のユーザデータの検
査符号（例えばＣＲＣ符号）を付加して、１フレーム分
のデータを作成する。図１（Ａ）において、フレームデ
ータに空きがあるのは、制御データ、ユーザデータおよ
び検査符号を合わせた合計伝送レートが、最大可能なレ
ートより低いときである。FIG. 1A shows a frame structure in ordinary mobile communication. The user data sequence to be transmitted is divided into frames having a predetermined time length. next,
While adding control data to the beginning of each frame,
A check code (for example, a CRC code) of user data for each frame is added to the end of each frame to create data for one frame. In FIG. 1A, the frame data is vacant when the total transmission rate of the control data, the user data, and the check code is lower than the maximum possible rate.
【００１７】１フレームデータを図３のようにインタリ
ーブし、図１（Ｂ）の無線チャネルフレームにマッピン
グする。フレームには、既知のパイロット・シンボルか
周期的に挿入されている。このパイロット・シンボルを
用いて、受信側で同期検波する。この方法は例えば、三
瓶、“陸上移動通信用１６ＱＡＭのフェージングひずみ
補償方式”、信学論（Ｂ−ＩＩ）、ｖｏｌ．Ｊ−７２−
Ｂ−ＩＩ、ｐｐ．７−１５、１９８９年１月に開示され
ている。または、その英語版である S. Sampei, "Fadin
g Compensation for 16QAM in Land Mobile Communicat
ions", The Transactions of the Institute of Electr
onics, Information and CommunicationEngineers of J
apan B-II, Vol. J72-B-II pp. 7-15, January 1989, a
nd S. Sampei, et al. "Rayleigh Fading Compensation
for QAM in Land Mobile RadioCommunications", IEEE
Transactions on Vehicular Technology, VOL. 42. N
o. 2, MAY 1993 を参照。One frame data is interleaved as shown in FIG. 3 and is mapped to the radio channel frame shown in FIG. 1 (B). Known pilot symbols are periodically inserted in the frame. Synchronous detection is performed on the receiving side using this pilot symbol. This method is described in, for example, Sanpei, “16QAM Fading Distortion Compensation Method for Land Mobile Communication”, Theoretical Theory (B-II), vol. J-72-
B-II, pp. 7-15, January 1989. Or its English version, S. Sampei, "Fadin
g Compensation for 16QAM in Land Mobile Communicat
ions ", The Transactions of the Institute of Electr
onics, Information and Communication Engineers of J
apan B-II, Vol. J72-B-II pp. 7-15, January 1989, a
nd S. Sampei, et al. "Rayleigh Fading Compensation
for QAM in Land Mobile Radio Communications ", IEEE
Transaction s on Vehicular Technology, VOL. 42. N
o. 2, see MAY 1993.
【００１８】図１（Ｂ）において、パイロット・シンボ
ルで囲まれた区間をスロットと呼ぶ。１フレームがＮs
個のスロットで構成され、１スロットがＭs ビットで構
成されているとすると、１フレームは、Ｎs ＊Ｍs ビッ
トで構成される。In FIG. 1B, a section surrounded by pilot symbols is called a slot. 1 frame is N s
If one slot is composed of M s bits and one slot is composed of M s bits, one frame is composed of N s * M s bits.
【００１９】このように構成されたシンボル系列を１次
変調し、変調シンボルレートの整数倍（数十から数百
倍）のチップレートの拡散符号系列で２次変調して、送
信している。The symbol sequence thus configured is first-order modulated, second-order modulated with a spreading code sequence having a chip rate that is an integer multiple (tens to hundreds times) of the modulation symbol rate, and then transmitted.
【００２０】既知のパイロット・シンボルを周期的に挿
入して送信した場合、受信側は、このパイロット・シン
ボルを用いて、スロット内の各データ位置における伝送
路の状態を推定し、同期検波用の参照信号として用いて
いる（上に示したS. Sampeiの論文等を参照）。When a known pilot symbol is periodically inserted and transmitted, the receiving side uses this pilot symbol to estimate the state of the transmission line at each data position in the slot, and to perform synchronous detection. It is used as a reference signal (see S. Sampei's paper etc.).
【００２１】一方、送信側は、送信データを組み替える
ためのインタリーバを備えている。On the other hand, the transmission side has an interleaver for rearranging the transmission data.
【００２２】図２は、このインタリーバが使用するイン
タリーブ・メモリ３Ａを示す概念図であり、１フレーム
分の構成を示している。このメモリの行のビット数（列
数）は、１フレームを構成するスロットの数Ｎs であ
り、列のビット数（行数）は、１スロットを構成する最
大ビット数Ｍs と等しい。このインタリーブ・メモリに
おいて、１フレーム分の送信データを書き込むときに
は、横方向に１ビットづつ書き込み、読み出すときは、
縦方向に読み出す。FIG. 2 is a conceptual diagram showing an interleave memory 3A used by this interleaver, and shows a structure for one frame. The number of bits (the number of columns) in a row of this memory is the number N s of slots that form one frame, and the number of bits (the number of rows) of a column is equal to the maximum number M s of bits that form one slot. In this interleaved memory, when writing one frame of transmission data, one bit is written in the horizontal direction, and when reading,
Read vertically.
【００２３】図３は、インタリーブ・メモリ３Ａにデー
タが書き込まれた様子を示す。図３に示すように、この
インタリーブ・メモリ３Ａには、誤り検出訂正のための
検査符号（ＣＲＣ）を含む、１フレーム分のデータが書
き込まれる。この様に書き込まれたインタリーブ・メモ
リ３Ａから、縦方向に（列毎に）読み出して、順番にス
ロットにマッピングする。すると、列番号（１〜Ｎs ）
が、図１（Ｂ）のスロット番号に対応することになる。
このように、インタリーブ・メモリから読み出すと、各
スロットは、図１（Ｃ）に示すようになる。図１（Ｃ）
の空きは、図１（Ａ）および図３において、１フレーム
のデータに空きがあることに対応している。FIG. 3 shows how data is written in the interleave memory 3A. As shown in FIG. 3, data for one frame including a check code (CRC) for error detection and correction is written in the interleave memory 3A. The interleave memory 3A thus written is read in the vertical direction (column by column) and sequentially mapped to the slots. Then the column number (1 to N s )
Corresponds to the slot number in FIG. 1 (B).
Thus, when read from the interleave memory, each slot becomes as shown in FIG. FIG. 1 (C)
1 corresponds to the fact that there is a vacancy in one frame of data in FIGS. 1A and 3.
【００２４】以上が、送信側のデータを作成するための
構成である。一方、受信側も、デインタリーバを用意し
て、インタリーブされて送られてきたデータを、元の配
置に再度組み立てている。デインタリーバも、図２と同
様の構成のデインタリーブ・メモリを備えており、その
動作は、インタリーバの場合と、書き込みと読み出しの
方向が逆である。すなわち、受信側では、列方向に書き
込み、横の行方向に読み出して、元のデータを得てい
る。The above is the configuration for creating the data on the transmitting side. On the other hand, the receiving side also prepares a deinterleaver to reassemble the interleaved and sent data into the original arrangement. The deinterleaver also includes a deinterleave memory having the same configuration as that in FIG. 2, and its operation is opposite to that of the interleaver in writing and reading directions. That is, on the receiving side, the original data is obtained by writing in the column direction and reading in the horizontal row direction.
【００２５】このようにして送信することにより、移動
局側の電力の節減が可能になる。図４は、この様子を示
している。重要なデータであるパイロット・シンボル
と、その付近の制御データは、大きいパワーで送信され
る。そして、空き部分は送信しない。この伝送方式は、
本出願人が先に出願した特願平７−３５７０２号（ＰＣ
Ｔ／ＪＰ９６／００４１９）「伝送方法およびそれに用
いる送信装置、受信装置」に開示されている。By transmitting in this way, it is possible to save power on the mobile station side. FIG. 4 shows this state. Pilot symbols, which are important data, and control data in the vicinity thereof are transmitted with large power. Then, the empty portion is not transmitted. This transmission method is
Japanese Patent Application No. 7-35702 filed by the applicant earlier (PC
T / JP96 / 00419) "Transmission method and transmitter and receiver used therefor".
【００２６】このような、伝送システムにおいて、周波
数分割全二重（ＦＤＤ）と時間分割全二重の双方を１台
で実現した、本発明による移動通信システム用送受信機
の実施形態を説明する。An embodiment of a transceiver for a mobile communication system according to the present invention, which realizes both frequency division full duplex (FDD) and time division full duplex in a single transmission system, will be described.
【００２７】まず、図５を参照して、周波数分割全二重
（ＦＤＤ）と時間分割全二重（ＴＤＤ）について説明す
る。図５は、ＦＤＤとＴＤＤの、１つの周波数に対する
送信の様子を示す概念図で、図５（Ａ）は、ＦＤＤモー
ドにおける送信データを示し、図５（Ｂ）は、ＴＤＤモ
ードにおける送信データを示している。First, frequency division full duplex (FDD) and time division full duplex (TDD) will be described with reference to FIG. 5A and 5B are conceptual diagrams showing how FDD and TDD are transmitted with respect to one frequency. FIG. 5A shows transmission data in the FDD mode and FIG. 5B shows transmission data in the TDD mode. Shows.
【００２８】まず、図５（Ａ）は、送受信機の送信部
が、割り当てられた周波数を占有して送信している様子
を示している。なお、この送受信機の受信部は、別の周
波数を用いてデータを受信している。First, FIG. 5 (A) shows a state in which the transmitter of the transceiver occupies and transmits the allocated frequency. The receiving unit of this transceiver receives data using another frequency.
【００２９】一方、図５（Ｂ）は、同じ周波数を用い
て、送信と受信とを時間によって切り換えている様子を
示している。この場合、パイロット・シンボルを付与す
ることから、１スロット毎に送信と受信とを切り換える
ことが望ましい。On the other hand, FIG. 5B shows a state in which transmission and reception are switched by time using the same frequency. In this case, it is desirable to switch between transmission and reception for each slot because pilot symbols are added.
【００３０】図６は、このようなＦＤＤとＴＤＤとを、
１台の無線機で実現した送受信機の構成を示す。図６に
おいて、フレーム化部１は、送信データを１フレームご
とにまとめる。誤り訂正符号器２は、１フレーム毎にま
とめられたデータを誤り訂正符号化する。インタリーバ
３は、図２に示したインタリーブ・メモリ３Ａを有して
おり、１フレームのデータを１スロット毎のデータに組
み立てる。このインタリーブ・メモリ３Ａの読み出しに
おいて、列から列への移行速度ＶT （列／秒）は一定で
あるが、各列内データ（Ｍs ビット／列）を読み出す読
み出し速度ＶR（ビット／秒）は、ＦＤＤとＴＤＤのモ
ードによって切り換えることができる。これについて
は、後でさらに詳しく説明する。FIG. 6 shows such FDD and TDD as
The structure of the transceiver realized by one wireless device is shown. In FIG. 6, the framing unit 1 collects the transmission data for each frame. The error correction encoder 2 performs error correction coding on the data collected for each frame. The interleaver 3 has the interleave memory 3A shown in FIG. 2, and assembles data of one frame into data for each slot. In the reading of the interleave memory 3A, the column-to-column transition speed V T (column / second) is constant, but the read speed V R (bit / second) for reading the data in each row (M s bits / column) ) Can be switched depending on the mode of FDD and TDD. This will be described in more detail later.
【００３１】データ変調器４は、インタリーブ・メモリ
３Ａから読み出したデータを１次変調する。拡散変調器
５は、データ変調器４の出力を、狭帯域変調信号から広
帯域信号へ２次変調し、拡散信号を出力する。周波数変
換器６は、この拡散信号をキャリア周波数に変換し、送
信信号を出力する。このキャリアは、キャリア周波数発
生器９から周波数変換器６に供給される。こうして作ら
れた送信信号は、送受信分波器７およびアンテナ１５を
介して、空中に無線送信される。The data modulator 4 primarily modulates the data read from the interleave memory 3A. The spread modulator 5 secondarily modulates the output of the data modulator 4 from a narrowband modulation signal to a wideband signal, and outputs a spread signal. The frequency converter 6 converts this spread signal into a carrier frequency and outputs a transmission signal. This carrier is supplied from the carrier frequency generator 9 to the frequency converter 6. The transmission signal thus created is wirelessly transmitted in the air via the transmission / reception duplexer 7 and the antenna 15.
【００３２】なお、図４に示すような送信電力を制御す
る必要がある場合は、周波数変換器６と送受信分波器７
との間に、送信電力制御回路１７を挿入して、送信電力
を制御する。この場合、図４に示すパイロットシンボ
ル、制御データ、および準重要ユーザデータの各データ
長は予め定められており、各データ長に応じて、送信電
力が制御される。When it is necessary to control the transmission power as shown in FIG. 4, the frequency converter 6 and the transmission / reception demultiplexer 7 are used.
A transmission power control circuit 17 is inserted between and to control the transmission power. In this case, the data lengths of the pilot symbols, control data, and semi-important user data shown in FIG. 4 are predetermined, and the transmission power is controlled according to each data length.
【００３３】次に、受信部の構成を説明する。アンテナ
１５および送受信分波器７を介して受信された受信信号
は、周波数変換器１４に供給される。この受信信号は、
周波数変換器１４において、キャリア周波数発生器９か
らの信号によって、周波数変換される。周波数変換され
た信号は、逆拡散復調器１３によって、拡散広帯域信号
から狭帯域変調信号へ変換された後、データ復調器１２
によって元のデータ信号に戻される。Next, the structure of the receiving section will be described. The reception signal received via the antenna 15 and the transmission / reception demultiplexer 7 is supplied to the frequency converter 14. This received signal is
In the frequency converter 14, the frequency is converted by the signal from the carrier frequency generator 9. The frequency-converted signal is converted from the spread wide band signal to the narrow band modulated signal by the despread demodulator 13, and then the data demodulator 12
To restore the original data signal.
【００３４】ビット・デインタリーバ１１は、デインタ
リーブ・メモリ１１Ａを用いて、元のデータフレームを
復元する。このデインタリーブ・メモリ１１Ａへの書き
込は、列から列への移行速度ＶT は一定とし、各列内デ
ータの書き込み速度ＶW （ビット／秒）は、ＦＤＤおよ
びＴＤＤの各モードによって切り換えて、実行される。
誤り訂正復号器１０は、デインタリーバ１１から出力さ
れた各フレームを、フレーム単位に誤り訂正して、受信
データとして出力する。The bit deinterleaver 11 restores the original data frame by using the deinterleave memory 11A. In the writing to the deinterleave memory 11A, the transfer speed V T from column to column is constant, and the writing speed V W (bit / sec) of data in each column is switched according to each mode of FDD and TDD. Is executed.
The error correction decoder 10 error-corrects each frame output from the deinterleaver 11 in frame units and outputs it as received data.
【００３５】これらの送信部および受信部は、主制御部
２０および副制御部２１によって制御される。The transmitter and the receiver are controlled by the main controller 20 and the sub controller 21.
【００３６】図７は、副制御部２１の構成を示すブロッ
ク図である。図において、リードクロック発生器２２
は、インタリーバ３のメモリ３Ａとデインタリーバ１１
のメモリ１１Ａの読み出しクロックを発生する。一方、
ライトクロック発生器２３は、メモリ３Ａおよび１１Ａ
の書き込みクロックを発生する。これらのクロックの周
波数は、ＴＤＤモードにおいて、メモリ３Ａの読み出し
速度ＶR とメモリ１１Ａの書き込み速度ＶW が、ともに
通常速度ＶN ＝Ｍs ＊ＶT （ビット／秒）の２倍より大
きくなるように、クロック制御部２４によって制御され
る。ここで、Ｍsはメモリ３Ａおよび１１Ａの１列のデ
ータビット数（ビット／列）であり、ＶTは列から列へ
の移行速度（列／秒：一定）である。このように、メモ
リ３Ａの読み出し速度ＶR と、メモリ１１Ａの書き込み
速度ＶW を、通常速度の２倍より大きくするのは、イン
タリーバ３の出力に、空き時間を発生させるためであ
る。例えば、ＶR ＝２．５ＶN のとき、１スロット内に
０．６スロット分の空き時間が発生する。この空き時間
に、送信と受信とを切り換えることができる。FIG. 7 is a block diagram showing the configuration of the sub control unit 21. In the figure, a read clock generator 22
Is the memory 3A of the interleaver 3 and the deinterleaver 11
The read clock of the memory 11A is generated. on the other hand,
The write clock generator 23 includes memories 3A and 11A.
To generate the write clock for. The frequencies of these clocks in the TDD mode are such that the read speed V R of the memory 3A and the write speed V W of the memory 11A are both higher than twice the normal speed V N = M s * V T (bits / second). As described above, the clock control unit 24 controls. Here, M s is the number of data bits in one column of the memories 3A and 11A (bit / column), and V T is the column-to-column transition speed (column / second: constant). As described above, the read speed V R of the memory 3A and the write speed V W of the memory 11A are set to be more than twice the normal speed in order to generate a vacant time in the output of the interleaver 3. For example, when V R = 2.5V N , a vacant time of 0.6 slot occurs in one slot. During this idle time, transmission and reception can be switched.
【００３７】さらに説明する。副制御部２１のクロック
制御部２４は、ＦＤＤモードにおいては、メモリ３Ａの
読み出し速度ＶR とメモリ１１Ａの書き込み速度ＶW と
が、ともに通常速度ＶN になるような周波数のクロック
を発生するように、クロック発生器２２および２３を制
御する。一方、ＴＤＤモードにおいては、メモリ３Ａの
読み出し期間には、読み出し速度ＶR が通常速度の２倍
より大きい値、例えば２．５ＶN となり、メモリ１１Ａ
の書き込み期間には、書き込み速度ＶW が通常速度の２
倍より大きい値、例えば２．５ＶN となるような周波数
のクロックを発生するように、クロック発生器２２およ
び２３を制御する。なお、メモリ３Ａへの書き込み速度
およびメモリ１１Ａからの読み出しは、ＦＤＤおよびＴ
ＤＤのいずれのモードにおいても通常速度ＶN で行われ
る。Further description will be made. In the FDD mode, the clock control unit 24 of the sub control unit 21 generates a clock having a frequency such that the read speed V R of the memory 3A and the write speed V W of the memory 11A are both the normal speed V N. To control the clock generators 22 and 23. On the other hand, in the TDD mode, the read speed V R becomes a value larger than twice the normal speed, for example, 2.5 V N in the read period of the memory 3A, and the memory 11A
In the writing period of, the writing speed V W is 2 which is the normal speed.
The clock generators 22 and 23 are controlled so as to generate a clock having a frequency that is greater than double, for example, 2.5 V N. It should be noted that the writing speed to the memory 3A and the reading from the memory 11A are FDD and T
In any of the DD modes, the normal speed V N is used.
【００３８】キャリア周波数制御部２５は、主制御部２
０の指示に応じて、キャリア周波数発生器９が発生する
キャリアの周波数を制御する。すなわち、ＦＤＤモード
においては、送信キャリア周波数ｆT と送信キャリア周
波数ｆR とが所定の異なる周波数となるように、キャリ
ア周波数発生器９を制御する一方、ＴＤＤにモードにお
いては、送信キャリア周波数ｆT と受信キャリア周波数
ｆR とが、同一周波数となるように、キャリア周波数発
生器９を制御する。The carrier frequency control unit 25 is the main control unit 2
According to the instruction of 0, the carrier frequency generated by the carrier frequency generator 9 is controlled. That is, in the FDD mode, the carrier frequency generator 9 is controlled so that the transmission carrier frequency f T and the transmission carrier frequency f R are different from each other by a predetermined value, while in the TDD mode, the transmission carrier frequency f T is set. The carrier frequency generator 9 is controlled so that the received carrier frequency f R and the received carrier frequency f R become the same frequency.
【００３９】このような構成において、ＦＤＤとＴＤＤ
とを１台の送受信機で実現するための、本実施例の動作
を説明する。In such a configuration, FDD and TDD
The operation of this embodiment for realizing the above and the above with one transceiver will be described.
【００４０】送信すべきデータ系列は、フレーム化部１
に供給される。フレーム化部１は、この送信データ系列
をあらかじめ定めた１フレーム時間（Ｔf ）毎のデータ
に分割し、フレームを構成する。誤り訂正符号器２は、
各フレーム毎に、そのフレーム内の送信データを誤り訂
正符号化し、インタリーバ３に供給する。インタリーバ
３は、送信データを、通常速度ＶN で、Ｍs 行×Ｎs 列
のインタリーブ・メモリ３Ａに、行毎（横方向）に書き
込む。このとき、最初の行にパイロット・シンボルを書
き込めば、後でパイロット・シンボルを付加する必要が
ない。インタリーバ３は、１フレーム分の送信データを
書き込んだ後、書き込まれた送信データを、今度は、列
（縦方向）毎に読み出す。以下、ＦＤＤモードとＴＤＤ
モードとに分けて、動作説明する。The data sequence to be transmitted is the framing unit 1.
Is supplied to. The framing unit 1 divides this transmission data sequence into data for each predetermined one frame time (T f ) to form a frame. The error correction encoder 2 is
For each frame, the transmission data in the frame is error correction coded and supplied to the interleaver 3. The interleaver 3 writes transmission data row by row (horizontal direction) in the interleave memory 3A of M s rows × N s columns at a normal speed V N. At this time, if pilot symbols are written in the first line, it is not necessary to add pilot symbols later. The interleaver 3 writes the transmission data for one frame, and then reads the written transmission data for each column (vertical direction). Below, FDD mode and TDD
The operation will be described separately for each mode.
【００４１】（１）ＦＤＤモードの動作 ＦＤＤモードの場合、送信部のインタリーバ３は、リー
ドクロック発生器２２から供給されたクロック信号によ
って、通常速度ＶN （＝Ｍs ・ＶT ）ビット／秒で、イ
ンタリーブ・メモリ３Ａ内の送信データを列毎に読み出
す。すなわち、ＦＤＤモードの場合、メモリ３Ａの読み
出し速度は、ＶR ＝ＶN である。メモリ３Ａの各列が１
スロットを構成するので、１スロットはＭs ビットで構
成される（パイロット・シンボルを含む）。(1) Operation in FDD mode In the FDD mode, the interleaver 3 of the transmission section uses the clock signal supplied from the read clock generator 22 to operate at the normal speed V N (= M s · V T ) bits / second. Then, the transmission data in the interleave memory 3A is read out for each column. That is, in the FDD mode, the read speed of the memory 3A is V R = V N. Each column of memory 3A is 1
Since a slot is configured, one slot is composed of M s bits (including pilot symbols).
【００４２】インタリーバ３で作成された送信データ系
列は、データ変調器４でデータ変調され、拡散変調器５
で拡散変調される。そして、周波数変調器６で指定され
た送信周波数ｆT に変換された後、送信される。この送
受信機は、送受信分波器７を備えており、ここで送信と
受信の周波数成分を分別する。The transmission data sequence created by the interleaver 3 is data-modulated by the data modulator 4 and spread by the spread modulator 5.
Is spread and modulated. Then, the signal is converted into the transmission frequency f T designated by the frequency modulator 6 and then transmitted. This transmitter / receiver includes a transmission / reception demultiplexer 7, which separates the frequency components of transmission and reception.
【００４３】一方、受信部の周波数変換器１４は、指定
された周波数ｆR で受信波を周波数変換する。周波数変
換された受信信号は、逆拡散復調器１３で逆拡散復調さ
れ、データ復調器１２でデータ復調される。復調された
データは、デインタリーバ１１に供給される。デインタ
リーバ１１は、ライトクロック発生器２３から供給され
たクロック信号によって、この復調データを、書き込み
速度ＶW ＝ＶN （通常速度）で、列（縦方向）毎にデイ
ンタリーブ・メモリ１１Ａに書き込む。書き込まれたデ
ータは、通常速度ＶN で、行（横方向）毎に読み出され
る。On the other hand, the frequency converter 14 of the receiving section frequency-converts the received wave at the designated frequency f R. The frequency-converted received signal is despread demodulated by the despread demodulator 13 and data demodulated by the data demodulator 12. The demodulated data is supplied to the deinterleaver 11. The deinterleaver 11 writes this demodulated data to the deinterleave memory 11A for each column (vertical direction) at the writing speed V W = V N (normal speed) by the clock signal supplied from the write clock generator 23. . The written data is read row by row (horizontal direction) at the normal speed V N.
【００４４】すなわち、ＦＤＤモードにおいては、イン
タリーブ・メモリ３Ａの読み出し速度とデインタリーブ
・メモリ１１Ａの書き込み速度とは、ともに通常速度Ｖ
N であるが、デインタリーブ・メモリ１１Ａの書き込み
方向と読み出し方向は、インタリーブ・メモリ３Ａの場
合と逆になっている。また、デインタリーブ・メモリ１
１Ａ内のパイロット・シンボルの部分は空きになってい
る。この２点が、デインタリーバ１１とインタリーバ３
とが違う点である。デインタリーバ１１から出力された
データは、誤り訂正復号器１０で誤り訂正復号され、元
のデータが得られる。That is, in the FDD mode, the read speed of the interleave memory 3A and the write speed of the deinterleave memory 11A are both the normal speed V.
Although N , the writing and reading directions of the deinterleave memory 11A are opposite to those of the interleave memory 3A. Also, deinterleave memory 1
The pilot symbol portion in 1A is empty. These two points are the deinterleaver 11 and the interleaver 3.
Is the difference. The data output from the deinterleaver 11 is subjected to error correction decoding by the error correction decoder 10 to obtain original data.
【００４５】（２）ＴＤＤモードの動作 ＴＤＤモードの場合、副制御回路２１のキャリア周波数
制御部２５は、送信周波数ｆT と受信周波数ｆR とを同
一（ｆT ＝ｆR ）に設定する。それとともに、インタリ
ーブ・メモリ３Ａの読み出し速度ＶR をＶR ＞２ＶN と
し、デインタリーブ・メモリ１１Ａの書き込み速度ＶW
は、ＶW ＞２ＶN とする。例えば、インタリーブメモリ
３ＡのＶR ＝ デインタリーブメモリ１１ＡのＶW ＝
２．５ＶN とし、１スロット内に０．６スロット分の空
き時間をつくる。この空き時間に、送信と受信とを切り
換えることができる。その他の動作は、ＦＤＤモードの
場合と同様である。(2) Operation in TDD mode In the TDD mode, the carrier frequency control unit 25 of the sub control circuit 21 sets the transmission frequency f T and the reception frequency f R to be the same (f T = f R ). At the same time, the read speed V R of the interleave memory 3A is set to V R > 2V N, and the write speed V W of the deinterleave memory 11A.
Is V W > 2V N. For example, V R of the interleave memory 3A = V W of the deinterleave memory 11A =
It is set to 2.5V N, and a vacant time for 0.6 slot is created in one slot. During this idle time, transmission and reception can be switched. Other operations are similar to those in the FDD mode.
【００４６】なお、拡散変調はデータ変調後の信号を、
送信データのビットレートより高速レートの拡散系列で
変調するが、ＴＤＤモードのときの拡散系列速度（チッ
プレート）を、ＦＤＤモードのときのそれと同じにして
もよいし、ＦＤＤモードの読み出し速度等とおなじ倍率
の速度としてもよい。In the spread modulation, the signal after data modulation is
The spreading sequence is modulated at a higher rate than the bit rate of the transmission data, but the spreading sequence speed (chip rate) in the TDD mode may be the same as that in the FDD mode, or may be the same as the reading speed in the FDD mode. The speed of the same magnification may be used.
【００４７】[0047]
【発明の効果】上記の説明のように、本発明によれば、
簡単な構成で、ＣＤＭＡ移動通信において、インタリー
バおよびデインタリーバの読み出しおよび書き込み速度
の単純な制御のみで、周波数分割全二重（ＦＤＤ）と時
間分割全二重（ＴＤＤ）の双方を１台で実現できる。As described above, according to the present invention,
With simple configuration, in CDMA mobile communication, both frequency division full duplex (FDD) and time division full duplex (TDD) can be realized by one unit by simply controlling the read and write speeds of the interleaver and deinterleaver. it can.
【００４８】また、インタリーバ・メモリの最初にパイ
ロット・シンボルを書き込むと、後でパイロット・シン
ボルを挿入する必要がない。Also, writing pilot symbols at the beginning of the interleaver memory eliminates the need for later insertion of pilot symbols.
【００４９】その上、重要なデータに対して送信電力を
増やしているので、重要なデータは確実に受信される。Moreover, since the transmission power is increased with respect to the important data, the important data is surely received.
【図１】本発明による移動通信システム用送受信機の実
施形態に使用する伝送方法を説明する概念図であり、
（Ａ）は、送信データフレームの構成を示し、（Ｂ）
は、パターン既知のパイロット・シンボルを、周期的に
挿入して得られた無線チャネルフレームの構成を示し、
（Ｃ）は、無線チャネルスロットの構成を示す。FIG. 1 is a conceptual diagram illustrating a transmission method used in an embodiment of a transceiver for a mobile communication system according to the present invention,
(A) shows the structure of a transmission data frame, (B)
Shows a structure of a radio channel frame obtained by periodically inserting pilot symbols of known patterns,
(C) shows the structure of a radio channel slot.
【図２】同実施形態のインタリーブ・メモリ３Ａの構成
を示す概念図である。FIG. 2 is a conceptual diagram showing a configuration of an interleave memory 3A of the same embodiment.
【図３】同メモリ３Ａにデータを格納した状態を示す概
念図である。FIG. 3 is a conceptual diagram showing a state in which data is stored in the memory 3A.
【図４】同実施形態における送信電力制御の一例を示す
概念図である。FIG. 4 is a conceptual diagram showing an example of transmission power control in the same embodiment.
【図５】ＦＤＤおよびＴＤＤを説明する概念図であり、
（Ａ）はＦＤＤモードを示し、（Ｂ）はＴＤＤモードを
示す。FIG. 5 is a conceptual diagram illustrating FDD and TDD,
(A) shows an FDD mode, (B) shows a TDD mode.
【図６】本発明による移動通信システム用送受信機の実
施形態を示すブロック図である。FIG. 6 is a block diagram showing an embodiment of a transceiver for a mobile communication system according to the present invention.
【図７】同実施形態の副制御回路の構成を示すブロック
図である。FIG. 7 is a block diagram showing a configuration of a sub control circuit of the same embodiment.
１ フレーム化部 ２ 誤り訂正符号器 ３ インタリーバ ３Ａ インタリーブ・メモリ ４ データ変調器 ５ 拡散変調器 ６ 周波数変換器 ７ 送受信分波器 １０ 誤り訂正復号器 １１ ビット・デインタリーバ １１Ａ デインタリーブ・メモリ １２ データ復調器 １３ 逆拡散復調器 １４ 周波数変換器 １５ アンテナ ２０ 主制御部 ２１ 副制御部 ２２ リードクロック発生器 ２３ ライトクロック発生器 ２４ クロック制御部 ２５ キャリア周波数制御部 1 framing unit 2 error correction encoder 3 interleaver 3A interleave memory 4 data modulator 5 spread modulator 6 frequency converter 7 transmission / reception demultiplexer 10 error correction decoder 11 bit deinterleaver 11A deinterleave memory 12 data demodulation Device 13 Despreading demodulator 14 Frequency converter 15 Antenna 20 Main control unit 21 Sub-control unit 22 Read clock generator 23 Write clock generator 24 Clock control unit 25 Carrier frequency control unit
Claims (10)
ess ）移動通信システム用送受信機において、 送信部は、 送信データをフレーム毎にインタリーブするインタリー
バと、 該インタリーバ内に設けられ、行および列単位で書き込
みおよび読み出し可能なインタリーブ・メモリと、 インタリーブされた送信データを狭帯域変調信号にデー
タ変調する変調手段と、 該狭帯域変調信号を、拡散系列を用いて、広帯域変調信
号に拡散変調する拡散変調手段とを具備し、 前記インタリーバは、前記インタリーブ・メモリに前記
送信データを、行毎に書き込み、列毎に読み出すことに
より、前記インタリーブを実行し、 受信部は、 前記広帯域変調信号を狭帯域変調信号へ変換する逆拡散
手段と、 前記狭帯域信号を復調して復調データを出力する復調手
段と、 前記復調データを前記フレーム毎にデインタリーブし
て、前記送信データを再生するデインタリーバと、 前記デインタリーバ内に設けられ、行および列単位で書
き込みおよび読み出し可能なデインタリーブ・メモリと
を具備し、 前記デインタリーバは、前記デインタリーブ・メモリに
前記復調データを列に書き込み、行毎に読み出すことに
より、前記デインタリーブを実行し、 前記送受信機は、 前記インタリーブ・メモリからデータを読み出し、前記
デインタリーブ・メモリへデータを書き込む場合に、列
から列への移行速度（列／秒）をあらかじめ決められた
一定速度ＶT に制御する一方、各列内のデータの読み出
し速度ＶR および書き込み速度ＶW （ビット／秒）を可
変制御する制御手段を具備することを特徴とする移動通
信システム用送受信機。1. A CDMA (Code Division Multiple Acc)
ess) In a transceiver for a mobile communication system, a transmitter is interleaved with an interleaver that interleaves transmission data for each frame, and an interleave memory that is provided in the interleaver and is writable and readable in row and column units. The interleaver comprises: a modulation means for performing data modulation of transmission data into a narrow band modulation signal; and a spreading modulation means for spreading modulation of the narrow band modulation signal into a wide band modulation signal by using a spreading sequence. The transmission data is written into the memory for each row and read for each column to perform the interleaving, and the receiving unit includes a despreading unit that converts the wideband modulated signal into a narrowband modulated signal, and the narrowband signal. Demodulating means for demodulating and outputting demodulated data; A deinterleaver for regenerating the transmitted data by releasing, and a deinterleave memory provided in the deinterleaver and capable of writing and reading in units of rows and columns, the deinterleaver comprising: By writing the demodulated data in a column in a memory and reading the data for each row, the deinterleaving is performed, the transceiver reads data from the interleave memory, and writes data in the deinterleave memory. The transfer speed (rows / second) from row to row is controlled to a predetermined constant rate V T , while the read rate V R and the write rate V W (bits / second) of data in each column are variably controlled. A transceiver for a mobile communication system comprising a control means.
受信機において、前記制御手段は、前記インタリーブ・
メモリの各列データの読み出し速度ＶR および前記デイ
ンタリーブ・メモリの各列データの書き込み速度Ｖ
W （ビット／秒）を、 ＦＤＤモードのときには、ＶR ＝ＶW ＝ＶT ・Ｍs 、た
だし、Ｍs は各列のビット数とし、 ＴＤＤモードのときには、ＶR ＞２ＶT ・Ｍs およびＶ
W ＞２ＶT ・Ｍs とし、列の最後のビットを読み出した
後、次の列の読み出し開始時間までに、前記送受信機を
送信モードから受信モードに切り替えることを特徴とす
る移動通信システム用送受信機。2. The transceiver for mobile communication system according to claim 1, wherein the control means includes the interleave
Read speed V R of each column data of the memory and write speed V R of each column data of the deinterleave memory
Let W (bits / second) be V R = V W = V T · M s in the FDD mode, where M s is the number of bits in each column, and in the TDD mode V R > 2V T · M s And V
Transmission / reception for a mobile communication system, characterized in that W > 2V T · M s , the transceiver is switched from a transmission mode to a reception mode by the time when the last bit of the column is read and before the reading start of the next column. Machine.
ム用送受信機において、前記インタリーバは、前記イン
タリーバ・メモリの最初に、パイロット・シンボルを書
き込むことを特徴とする移動通信システム用送受信機。3. The transceiver for mobile communication system according to claim 1, wherein the interleaver writes a pilot symbol at the beginning of the interleaver memory.
動通信システム用送受信機は、さらに、前記拡散変調手
段の出力側に接続され、前記送信データ中の重要データ
の送信電力を増加する送信電力制御手段を具備すること
を特徴とする移動通信システム用送受信機。4. The transceiver for mobile communication system according to any one of claims 1 to 3, further connected to an output side of the spread spectrum modulation means to increase transmission power of important data in the transmission data. A transceiver for a mobile communication system, comprising a transmission power control means.
受信機において、前記重要データは、前記パイロット・
シンボルおよび制御データであることを特徴とする移動
通信システム用送受信機。5. The transceiver for mobile communication system according to claim 4, wherein the important data is the pilot data.
A transceiver for a mobile communication system, which is a symbol and control data.
ess ）移動通信システム用送受信機において、 送信部は、 送信データをフレーム毎にインタリーブするインタリー
バと、 該インタリーバ内に設けられ、列および行単位で書き込
みおよび読み出し可能なインタリーブ・メモリと、 インタリーブされた送信データを狭帯域変調信号にデー
タ変調する変調手段と、 該狭帯域変調信号を、拡散系列を用いて、広帯域変調信
号に拡散変調する拡散変調手段とを具備し、 前記インタリーバは、前記インタリーブ・メモリに前記
送信データを、列毎に書き込み、行毎に読み出すことに
より、前記インタリーブを実行し、 受信部は、 前記広帯域変調信号を狭帯域変調信号へ変換する逆拡散
手段と、 前記狭帯域信号を復調して復調データを出力する復調手
段と、 前記復調データを前記フレーム毎にデインタリーブし
て、前記送信データを再生するデインタリーバと、 前記デインタリーバ内に設けられ、列および行単位で書
き込みおよび読み出し可能なデインタリーブ・メモリと
を具備し、 前記デインタリーバは、前記デインタリーブ・メモリに
前記復調データを行毎に書き込み、列毎に読み出すこと
により、前記デインタリーブを実行し、 前記送受信機は、 前記インタリーブ・メモリからデータを読み出し、前記
デインタリーブ・メモリへデータを書き込む場合に、行
から行への移行速度（行／秒）をあらかじめ決められた
一定速度ＶT に制御する一方、各行内のデータの読み出
し速度ＶR および書き込み速度ＶW （ビット／秒）を可
変制御する制御手段を具備することを特徴とする移動通
信システム用送受信機。6. A CDMA (Code Division Multiple Acc)
ess) In a transceiver for a mobile communication system, a transmitter is interleaved with an interleaver that interleaves transmission data for each frame, and an interleave memory provided in the interleaver and capable of writing and reading in column and row units. The interleaver comprises: a modulation means for performing data modulation of transmission data into a narrow band modulation signal; and a spreading modulation means for spreading modulation of the narrow band modulation signal into a wide band modulation signal by using a spreading sequence. The transmission data is written into the memory for each column and is read for each row to perform the interleaving, and the receiving unit includes a despreading unit that converts the wideband modulated signal into a narrowband modulated signal, and the narrowband signal. Demodulating means for demodulating and outputting demodulated data; A deinterleaver that releaves to reproduce the transmission data; and a deinterleave memory that is provided in the deinterleaver and is writable and readable on a column-by-row basis and a row-by-row basis. By executing the deinterleaving by writing the demodulated data in the memory row by row and reading the column by column, the transceiver may read the data from the interleave memory and write the data in the deinterleave memory. , The row-to-row transition speed (row / sec) is controlled to a predetermined constant speed V T , while the data read speed V R and write speed V W (bit / sec) of each row are variably controlled. A transceiver for a mobile communication system comprising a control means.
受信機において、前記制御手段は、前記インタリーブ・
メモリの各行データの読み出し速度ＶR および前記デイ
ンタリーブ・メモリの各行データの書き込み速度Ｖ
W （ビット／秒）を、 ＦＤＤモードのときには、ＶR ＝ＶW ＝ＶT ・Ｍs 、た
だし、Ｍs は各行のビット数とし、 ＴＤＤモードのときには、ＶR ＞２ＶT ・Ｍs およびＶ
W ＞２ＶT ・Ｍs とし、行の最後のビットを読み出した
後、次の行の読み出し開始時間までに、前記送受信機を
送信モードから受信モードに切り替えることを特徴とす
る移動通信システム用送受信機。7. The transceiver for mobile communication system according to claim 1, wherein the control means includes the interleave
Read speed V R of each row data of the memory and write speed V R of each row data of the deinterleaved memory
Let W (bits / second) be V R = V W = V T · M s in the FDD mode, where M s is the number of bits in each row, and in the TDD mode V R > 2V T · M s and V
Transmission / reception for a mobile communication system, characterized in that W > 2V T · M s, and after the last bit of a row is read, the transceiver is switched from the transmission mode to the reception mode by the read start time of the next row. Machine.
ム用送受信機において、前記インタリーバは、前記イン
タリーバ・メモリの最初に、パイロット・シンボルを書
き込むことを特徴とする移動通信システム用送受信機。8. The transceiver for mobile communication system according to claim 6 or 7, wherein the interleaver writes a pilot symbol at the beginning of the interleaver memory.
動通信システム用送受信機は、さらに、前記拡散変調手
段の出力側に接続され、前記送信データ中の重要データ
の送信電力を増加する送信電力制御手段を具備すること
を特徴とする移動通信システム用送受信機。9. The transceiver for mobile communication system according to any one of claims 6 to 8, which is further connected to an output side of the spread modulation means to increase transmission power of important data in the transmission data. A transceiver for a mobile communication system, comprising a transmission power control means.
送受信機において、前記重要データは、前記パイロット
・シンボルおよび制御データであることを特徴とする移
動通信システム用送受信機。10. The transceiver for mobile communication system according to claim 9, wherein the important data is the pilot symbol and control data.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29841496A JP2910990B2 (en) | 1995-11-09 | 1996-11-11 | Transceiver for mobile communication system |
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|---|---|---|---|
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| JP29147595 | 1995-11-09 | ||
| JP29841496A JP2910990B2 (en) | 1995-11-09 | 1996-11-11 | Transceiver for mobile communication system |
Publications (2)
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| Application Number | Title | Priority Date | Filing Date |
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