JPH0774315A - Switching device - Google Patents

Switching device

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JPH0774315A
JPH0774315A JP21839393A JP21839393A JPH0774315A JP H0774315 A JPH0774315 A JP H0774315A JP 21839393 A JP21839393 A JP 21839393A JP 21839393 A JP21839393 A JP 21839393A JP H0774315 A JPH0774315 A JP H0774315A
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JP
Japan
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circuit
mosfet
terminal
power supply
switching device
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JP21839393A
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Japanese (ja)
Inventor
Masuo Hanawaka
増生 花若
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Yokogawa Electric Corp
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Yokogawa Electric Corp
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Publication date
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Abstract

PURPOSE:To facilitate mounting on a heat-radiating member and a printed board, and also to miniaturize a switching power supply. CONSTITUTION:A MOSFET 2 of a multisource and a control circuit block, which is used for PWM driving of the MOSFET 2, are housed in the package 1 of an integrated circuit. The above-mentioned control circuit block is composed of a reference voltage circuit 3, a low voltage malfunction preventing circuit 4, a gate 5, an abnormal heat detection circuit 6, an oscillation circuit 7, a latch circuit 8, a comparator 9 and the like. A power supply input terminal IN, the drain terminal D of the MOSFET 2, and three terminals of a source terminal S are provided outside the package 1 as external terminals. As a result, a switching device is composed of three terminals in the same manner as the MOSFET, and the number of externally attached parts can be reduced.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明はスイッチングデバイス装
置に関し、詳しくは、スイッチング電源のスイッチ素子
として用いられるスイッチングデバイス装置に関するも
のである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a switching device device, and more particularly to a switching device device used as a switch element of a switching power supply.

【0002】[0002]

【従来の技術】近年、スイッチング電源の部品点数削
減,スペースファクタの向上,小形化,コストダウンな
どを実現するために、スイッチ素子として用いられるM
OSFETとその制御回路とを同一チップの半導体集積
回路として構成したスイッチングデバイス装置が実用化
されている。
2. Description of the Related Art In recent years, in order to reduce the number of parts of a switching power supply, improve the space factor, downsize, and reduce the cost, an M which is used as a switching element.
A switching device device in which an OSFET and its control circuit are configured as a semiconductor integrated circuit on the same chip has been put into practical use.

【0003】ところで一般に、スイッチング電源のスイ
ッチ素子として用いるMOSFETは、導通時の抵抗に
よる損失とスイッチングに伴う損失による発熱を放熱さ
せるためにヒートシンクなどの放熱部材に取付け、チッ
プの温度上昇を抑えて十分な信頼性を確保することが行
われている。従って、MOSFETとその制御回路とを
同一チップの半導体集積回路として構成したスイッチン
グデバイス装置においても、十分な信頼性を確保するた
めには、ヒートシンクなどの放熱部材に取付けることが
望ましい。
Generally, a MOSFET used as a switching element of a switching power supply is mounted on a heat radiation member such as a heat sink to radiate heat generated by resistance loss during conduction and heat generated by switching, and suppresses temperature rise of a chip sufficiently. To ensure high reliability. Therefore, even in a switching device device in which the MOSFET and its control circuit are configured as a semiconductor integrated circuit of the same chip, it is desirable to attach it to a heat dissipation member such as a heat sink in order to ensure sufficient reliability.

【0004】[0004]

【発明が解決しようとする課題】ところが、従来のこの
ようなスイッチングデバイス装置は外部端子として例え
ば20本以上の多ピンが設けられていて、その放熱部分
は特異な形状になっている。このために、放熱部材への
取付けもさることながらプリント配線板に実装するのも
なかなか困難であり、特に、部品実装の自動化は極めて
困難である。
However, such a conventional switching device device is provided with, for example, 20 or more multi-pins as external terminals, and its heat radiation portion has a peculiar shape. For this reason, it is very difficult to mount it on the printed wiring board as well as mounting it on the heat dissipation member, and in particular, it is extremely difficult to automate the component mounting.

【0005】また、外部端子として設けられているピン
の数に比例して外付け部品の数も増えることから、スイ
ッチング電源を構成した場合にそれら外付け部品を実装
するためのスペースを確保しなければならず、スペース
ファクタが低下して小形化の制約を受けるという問題点
もある。本発明はこのような問題点を解決するものであ
って、その目的は、放熱部材やプリント配線板への実装
が容易で、スペースファクタを大幅に向上させることに
よりスイッチング電源の小形化が図れるスイッチングデ
バイス装置を実現することにある。
Further, since the number of external parts increases in proportion to the number of pins provided as external terminals, it is necessary to secure a space for mounting these external parts when a switching power supply is constructed. However, there is also a problem that the space factor is reduced and the size is restricted. The present invention solves such a problem, and an object thereof is to facilitate mounting on a heat dissipation member or a printed wiring board, and to reduce the size of a switching power supply by greatly improving a space factor. It is to realize the device unit.

【0006】[0006]

【課題を解決するための手段】本発明は、このような問
題点を解決するために、スイッチ素子として用いるMO
SFETとその制御回路とが同一チップの半導体集積回
路として構成されるスイッチングデバイス装置におい
て、前記MOSFETのドレイン端子とソース端子およ
び制御回路の電源入力端子が外部端子として設けられた
ことを特徴とする。
According to the present invention, in order to solve such a problem, an MO used as a switch element is provided.
In a switching device device in which an SFET and its control circuit are configured as a semiconductor integrated circuit on the same chip, a drain terminal and a source terminal of the MOSFET and a power supply input terminal of the control circuit are provided as external terminals.

【0007】[0007]

【作用】本発明のスイッチングデバイス装置は従来のM
OSFETと同様な3端子素子として構成され、従来の
3端子のMOSFETと同様な3端子パッケージに収容
できる。このように構成されるスイッチングデバイス装
置は、スイッチング電源のスイッチ素子およびスイッチ
素子の制御回路として用いられる。そして、スイッチン
グ電源を構成した場合におけるスイッチングデバイス装
置の内部各部への電源供給は、制御回路の電源入力端子
を介して行われる。
The switching device apparatus of the present invention is the same as the conventional M
It is configured as a 3-terminal element similar to the OSFET, and can be housed in a 3-terminal package similar to the conventional 3-terminal MOSFET. The switching device device thus configured is used as a switch element of a switching power supply and a control circuit of the switch element. Then, when the switching power supply is configured, the power supply to the respective internal parts of the switching device device is performed via the power supply input terminal of the control circuit.

【0008】スイッチング電源の組立てにあたって、放
熱部材やプリント配線板への実装を従来の3端子のMO
SFETと同様の扱いで容易に行うことができる。ま
た、3端子構造になっていることから、外付け部品点数
を大幅に削減できてスペースファクタを大幅に向上させ
ることができ、スイッチング電源の小形化が図れる。
In assembling the switching power supply, mounting on a heat dissipation member or a printed wiring board requires a conventional 3-terminal MO.
It can be easily performed in the same manner as the SFET. Further, since it has a three-terminal structure, the number of external parts can be greatly reduced, the space factor can be greatly improved, and the switching power supply can be downsized.

【0009】[0009]

【実施例】以下、図面を用いて本発明の実施例を説明す
る。図1は本発明の一実施例の回路図である。図1にお
いて、1は3端子構造の集積回路のパッケージであり、
マルチソースのMOSFET2とこのMOSFET2を
PWM駆動するための制御回路ブロックとが同一チップ
の半導体集積回路として構成されて収納される。外部端
子としては、電源入力端子INとMOSFET2のドレ
インに接続されるドレイン端子DとMOSFET2のソ
ースに接続されるソース端子Sの3端子が設けられてい
る。このようなパッケージとしては例えばTO220を
用いる。
Embodiments of the present invention will be described below with reference to the drawings. FIG. 1 is a circuit diagram of an embodiment of the present invention. In FIG. 1, 1 is a package of an integrated circuit having a three-terminal structure,
A multi-source MOSFET 2 and a control circuit block for PWM driving the MOSFET 2 are configured and housed as a semiconductor integrated circuit on the same chip. As the external terminals, three terminals are provided: a power supply input terminal IN, a drain terminal D connected to the drain of the MOSFET 2, and a source terminal S connected to the source of the MOSFET 2. For example, TO220 is used as such a package.

【0010】3は基準電圧回路であり、電圧制御の目標
値を与えるとともに、内部回路のバイアス電流やバイア
ス電圧を発生する。4は低電圧誤動作防止回路であり、
電源入力電圧が低い時の誤動作を防止するために設けら
れている。この低電圧誤動作防止回路4の出力信号は、
入力電源電圧がある閾値よりも低い場合にはMOSFE
T2を駆動するためのPWM信号の出力を停止させるよ
うに、3つの入力端子を有するゲート5の入力端子の一
つに入力されている。また、通常この回路4には、動作
の安定化を図るためにヒステリシスが設けられている。
Reference numeral 3 is a reference voltage circuit that provides a target value for voltage control and generates a bias current and a bias voltage for the internal circuit. 4 is a low voltage malfunction prevention circuit,
It is provided to prevent malfunction when the power supply input voltage is low. The output signal of the low voltage malfunction prevention circuit 4 is
If the input power supply voltage is lower than a certain threshold, MOSFE
It is input to one of the input terminals of the gate 5 having three input terminals so as to stop the output of the PWM signal for driving T2. Further, normally, the circuit 4 is provided with hysteresis in order to stabilize the operation.

【0011】6は異常加熱検出回路であり、チップ保護
のためにチップの異常な温度上昇を検出する。この異常
加熱検出回路6の出力信号も、検出温度が設定値を越え
るとMOSFET2を駆動するPWM信号の出力を停止
させるように、3つの入力端子を有するゲート5の入力
端子の一つに入力されている。7は発振回路であり、P
WMの同期信号をラッチ回路8に出力するとともに、P
WM信号発生のための鋸歯状波または三角波をコンパレ
ータ9の非反転入力端子に入力する。
An abnormal heating detection circuit 6 detects an abnormal temperature rise of the chip for chip protection. The output signal of the abnormal heating detection circuit 6 is also input to one of the input terminals of the gate 5 having three input terminals so as to stop the output of the PWM signal for driving the MOSFET 2 when the detected temperature exceeds the set value. ing. 7 is an oscillator circuit, P
The WM synchronization signal is output to the latch circuit 8 and P
A sawtooth wave or a triangular wave for generating the WM signal is input to the non-inverting input terminal of the comparator 9.

【0012】ラッチ回路8の出力端子Qはゲート5の他
の入力端子に接続されている。ゲート5の出力端子はバ
ッファアンプ10を介してMOSFET2のゲート端子
に接続されている。11は誤差増幅器であり、電源入力
電圧と基準電圧との誤差を増幅してコンパレータ9の反
転入力端子の一つに入力する。この誤差増幅器11は電
源入力電圧と基準電圧との誤差が小さくなるようにコン
パレータ9の入力レベルを決めるものであり、系の周波
数特性を補償するために位相補償回路を内蔵している。
The output terminal Q of the latch circuit 8 is connected to the other input terminal of the gate 5. The output terminal of the gate 5 is connected to the gate terminal of the MOSFET 2 via the buffer amplifier 10. An error amplifier 11 amplifies an error between the power supply input voltage and the reference voltage and inputs it to one of the inverting input terminals of the comparator 9. The error amplifier 11 determines the input level of the comparator 9 so that the error between the power supply input voltage and the reference voltage becomes small, and has a built-in phase compensation circuit for compensating the frequency characteristic of the system.

【0013】12はPWM信号の最大パルス幅を設定す
る最大デューテイ設定回路であり、その出力信号はコン
パレータ9の他の反転入力端子に入力されている。コン
パレータ9の出力端子はゲート13の一方の入力端子に
接続されている。ゲート13の他方の入力端子にはコン
パレータ14の出力端子が接続され、ゲート13の出力
端子はラッチ回路8のリセット端子Rに接続されてい
る。
Reference numeral 12 is a maximum duty setting circuit for setting the maximum pulse width of the PWM signal, and its output signal is inputted to the other inverting input terminal of the comparator 9. The output terminal of the comparator 9 is connected to one input terminal of the gate 13. The output terminal of the comparator 14 is connected to the other input terminal of the gate 13, and the output terminal of the gate 13 is connected to the reset terminal R of the latch circuit 8.

【0014】コンパレータ14はMOSFET2のマル
チソースから検出するドレイン電流に比例した電流を検
出するものであって、非反転入力端子には検出電流が入
力され、反転入力端子には閾値電流Ithが入力されてい
る。このコンパレータ14により、検出電流が閾値電流
th以上の場合にはパルス毎に電流リミットがかけられ
ることになる。すなわち、図1の実施例では、ラッチ回
路8をリセットすることによりMOSFET2をオフに
する。
The comparator 14 detects a current proportional to the drain current detected from the multi-source of the MOSFET 2, and the detection current is input to the non-inverting input terminal and the threshold current I th is input to the inverting input terminal. Has been done. When the detected current is equal to or larger than the threshold current I th , the comparator 14 limits the current for each pulse. That is, in the embodiment shown in FIG. 1, the MOSFET 2 is turned off by resetting the latch circuit 8.

【0015】図2は図1のスイッチングデバイス装置を
用いたスイッチング電源の具体例図である。図2におい
て、トランスTには1次巻線W1と2次巻線W2とバイ
アス巻線WBが設けられている。1次巻線W1の一端に
は整流回路RECのプラス端子が接続され、1次巻線W
1の他端にはスイッチングデバイス装置のパッケージ1
のドレイン端子Dが接続されている。2次巻線W2の一
端にはダイオードD1のアノードが接続され、ダイオー
ドD1のカソードと2次巻線W2の他端にはコンデンサ
C1が接続されている。バイアス巻線WBには一端には
ダイオードD1のアノードが接続され、ダイオードD2
のカソードとバイアス巻線WBの他端にはコンデンサC
2が接続されている。これらダイオードD1とコンデン
サC1およびダイオードD2とコンデンサC2はそれぞ
れ整流平滑回路を構成している。
FIG. 2 is a specific example of a switching power supply using the switching device device of FIG. In FIG. 2, the transformer T is provided with a primary winding W1, a secondary winding W2, and a bias winding WB. The positive terminal of the rectifier circuit REC is connected to one end of the primary winding W1.
At the other end of 1 is a switching device device package 1
Drain terminal D of is connected. The anode of the diode D1 is connected to one end of the secondary winding W2, and the capacitor C1 is connected to the cathode of the diode D1 and the other end of the secondary winding W2. One end of the bias winding WB is connected to the anode of the diode D1 and the diode D2 is connected.
Of the capacitor C and the other end of the bias winding WB
2 is connected. The diode D1 and the capacitor C1 and the diode D2 and the capacitor C2 form a rectifying and smoothing circuit, respectively.

【0016】スイッチングデバイス装置のパッケージ1
のソース端子Sはバイアス巻線WBの他端および整流回
路RECのマイナス端子に接続されている。なお、整流
回路RECのプラス端子とマイナス端子間にはコンデン
サC3が接続されている。スイッチングデバイス装置の
パッケージ1の電源入力端子INはダイオードD2とコ
ンデンサC2の接続点に接続されるとともに、抵抗Rを
介して整流回路RECのプラス端子に接続されている。
Switching device package 1
Is connected to the other end of the bias winding WB and the negative terminal of the rectifier circuit REC. A capacitor C3 is connected between the positive terminal and the negative terminal of the rectifier circuit REC. The power supply input terminal IN of the package 1 of the switching device device is connected to the connection point of the diode D2 and the capacitor C2, and is also connected to the plus terminal of the rectifier circuit REC via the resistor R.

【0017】図2の構成において、スイッチングデバイ
ス装置の制御回路ブロックは、電源入力端子INに入力
電圧が印加されると、この入力電圧を一定に保つように
MOSFET2をPWM制御する。ここで、入力電圧は
通常バイアス巻線WBに発生する電圧とほぼ等しいの
で、2次巻線W2とバイアス巻線WBの巻数比を適切に
設定することにより、2次巻線W2の整流平滑回路から
所望の出力電圧が得られる。
In the configuration of FIG. 2, when the input voltage is applied to the power supply input terminal IN, the control circuit block of the switching device device PWM-controls the MOSFET 2 so as to keep this input voltage constant. Here, since the input voltage is almost equal to the voltage normally generated in the bias winding WB, the rectifying / smoothing circuit of the secondary winding W2 is set by appropriately setting the winding ratio of the secondary winding W2 and the bias winding WB. To obtain the desired output voltage.

【0018】なお、スイッチングデバイス装置の回路構
成は図1の実施例に限定されるものではなく、目的に応
じて回路要素の増減は可能であり、少なくとも外部端子
が3端子のパッケージに収容されていればよい。
The circuit configuration of the switching device apparatus is not limited to that of the embodiment shown in FIG. 1, and the number of circuit elements can be increased or decreased according to the purpose, and at least the external terminals are accommodated in a three-terminal package. Just do it.

【0019】[0019]

【発明の効果】以上詳細に説明したように、本発明によ
れば、出力制御が可能なスイッチングデバイス装置を従
来のMOSFETと同様な3端子素子として構成でき、
従来の3端子のMOSFETと同様な3端子パッケージ
に収容できる。このように構成されるスイッチングデバ
イス装置は、従来のスイッチング電源の個別の構成要素
であるスイッチ素子およびスイッチ素子の制御回路を、
スイッチ素子として用いられる従来のMOSFETと同
様な3端子形の1パッケージのデバイスとして置き換え
ることができる。
As described in detail above, according to the present invention, a switching device device capable of output control can be constructed as a three-terminal element similar to a conventional MOSFET.
It can be housed in a 3-terminal package similar to a conventional 3-terminal MOSFET. The switching device device configured in this manner includes a switch element and a control circuit for the switch element, which are individual constituent elements of a conventional switching power supply.
It can be replaced by a device of one package of three terminals type similar to the conventional MOSFET used as a switch element.

【0020】これにより、スイッチング電源の組立てに
あたっては、放熱部材やプリント配線板への実装を従来
の3端子形のパッケージに収容されたMOSFETと同
様の扱いで容易に行うことができる。また、パッケージ
が3端子構造になっていることから外付け部品点数を大
幅に削減できてスペースファクタを大幅に向上させるこ
とができ、スイッチング電源の小形化にも有効である。
As a result, when assembling the switching power supply, it can be easily mounted on the heat radiation member or the printed wiring board in the same manner as the MOSFET housed in the conventional three-terminal type package. In addition, since the package has a three-terminal structure, the number of external parts can be significantly reduced, the space factor can be greatly improved, and it is also effective for downsizing the switching power supply.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の一実施例の回路図である。FIG. 1 is a circuit diagram of an embodiment of the present invention.

【図2】図1のスイッチングデバイス装置を用いたスイ
ッチング電源の具体例図である。
FIG. 2 is a specific example diagram of a switching power supply using the switching device device of FIG.

【符号の説明】[Explanation of symbols]

1 パッケージ 2 MOSFET 3 基準電圧回路 4 低電圧誤動作防止回路 5 ゲート 6 異常加熱検出回路 7 発振回路 8 ラッチ回路 9 コンパレータ 10 バッファアンプ 11 誤差増幅器 12 最大デューテイ設定回路 13 ゲート 14 コンパレータ 1 package 2 MOSFET 3 reference voltage circuit 4 low voltage malfunction prevention circuit 5 gate 6 abnormal heating detection circuit 7 oscillation circuit 8 latch circuit 9 comparator 10 buffer amplifier 11 error amplifier 12 maximum duty setting circuit 13 gate 14 comparator

───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 FI 技術表示箇所 H03K 17/00 A 9184−5J ─────────────────────────────────────────────────── ─── Continuation of the front page (51) Int.Cl. 6 Identification code Office reference number FI technical display location H03K 17/00 A 9184-5J

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】スイッチ素子として用いるMOSFETと
その制御回路とが同一チップの半導体集積回路として構
成されるスイッチングデバイス装置において、 前記MOSFETのドレイン端子とソース端子および制
御回路の電源入力端子が外部端子として設けられたこと
を特徴とするスイッチングデバイス装置。
1. A switching device device in which a MOSFET used as a switch element and a control circuit thereof are configured as a semiconductor integrated circuit of the same chip, wherein a drain terminal and a source terminal of the MOSFET and a power input terminal of the control circuit are external terminals. A switching device device provided.
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