JPH0760354B2 - マイクロコンピュータ - Google Patents

マイクロコンピュータ

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JPH0760354B2
JPH0760354B2 JP3167524A JP16752491A JPH0760354B2 JP H0760354 B2 JPH0760354 B2 JP H0760354B2 JP 3167524 A JP3167524 A JP 3167524A JP 16752491 A JP16752491 A JP 16752491A JP H0760354 B2 JPH0760354 B2 JP H0760354B2
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Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明はパーソナル・コンピュー
タに関し、詳細にいえば、コンピュータの入出力回路に
対して発生する可能性のある電磁妨害雑音の影響を減衰
するためのシールドを設けることに関する。
【０００２】
【従来の技術】一般にパーソナル・コンピュータ・シス
テム、特にＩＢＭパーソナル・コンピュータは今日の現
代社会にコンピュータ能力を提供するために、広範な用
途を達成している。パーソナル・コンピュータ・システ
ムは通常、デスク・トップ、床置き、またはポータブル
・マイクロコンピュータとして定義でき、これらは単一
のシステム処理装置及び関連する揮発性または非揮発性
のメモリ、表示装置、キーボード、１台または複数台の
ディスケット駆動機構、固定ディスク記憶装置、ならび
にオプションのプリンタを有するシステム装置で構成さ
れている。これらのシステムの傑出した特徴の１つは、
これらの構成要素を電気的に接続するためにマザーボー
ドないしシステム・ボードを使用することである。これ
らのシステムは主として、シングル・ユーザに独立した
コンピューティング機能を与え、かつ個人または小企業
が購入できるような低い価格になるように設計されてい
る。このようなパーソナル・コンピュータ・システムの
例としては、ＩＢＭのパーソナル・コンピュータＸＴ及
びＡＴ、ならびにＩＢＭのパーソナル・システム／２モ
デル２５、３０、５０、６０、７０及び８０が挙げられ
る。
【０００３】これらのシステムは２つの一般的なファミ
リーに分類できる。第１のファミリーは通常ファミリー
Ｉモデルといわれるもので、ＩＢＭパーソナル・コンピ
ュータＡＴ及びその他の「ＩＢＭコンパチブル」機械で
具現化されているバス・アーキテクチャを使用してい
る。第２のファミリーはファミリーＩＩモデルと呼ばれ
るもので、ＩＢＭのパーソナル・システム／２モデル５
０ないし８０で具現化されているマイクロ・チャネル・
バス・アーキテクチャを使用している。多くのファミリ
ーＩモデルはシステム処理装置として、広く普及してい
るインテル８０８８または８０８６マイクロプロセッサ
を使用している。これらの処理装置は１メガバイトのメ
モリをアドレスする能力を有している。いくつかのファ
ミリーＩ及びほとんどのファミリーＩＩモデルは通常、
高速度のインテル８０２８６、８０３８６、及び８０４
８６マイクロプロセッサを使用しており、これらの処理
装置は低速なインテル８０８６マイクロプロセッサをエ
ミュレートするリアル・モードで、あるいは若干のモデ
ルに対してアドレス指定範囲を１メガバイトから、４ギ
ガバイトに拡張するプロテクト・モードで作動する。要
するに、８０２８６、８０３８６及び８０４８６プロセ
ッサのリアル・モード機能は８０８６及び８０８８マイ
クロプロセッサ用に作成されたソフトウェアとのハード
ウェア互換性を提供する。
【０００４】エンクロージャに収められ、かつシャーシ
によって支持されているか、あるいは回路板に接続され
ているパーソナル・コンピュータの構成要素が、さまざ
まな周波数で電磁放射線を放出すること、及びコンピュ
ータの使用環境に応じて、このようなエネルギーの放出
をさまざまな限度に制限する標準が確立されていること
は周知である。さらに、上記で詳述したような高速なプ
ロセッサ及びこのようなプロセッサに関連した回路が通
常、初期の設計で、低速なプロセッサとは異なる周波数
及び量の放射線を放出することは周知である。従来、金
属エンクロージャまたはコーティング、あるいはその両
方を設けたり、あるいは設けられているエンクロージャ
またはカバーにライニングを施すことを含め、各種の方
法のシールドが行われてきた。これらの方法でシールド
を行い、放射線を減衰する際に、このようなエンクロー
ジャ及びカバーに設けられた開口が、シールドを施すの
に特別困難な問題を招来することが知られている。さら
に、上記で簡単に述べた電磁妨害雑音で生じる可能性の
ある影響が、マイクロコンピュータの作動構成要素と必
然的に交換される入出力信号を中断したり、妨害したり
することがあることも知られている。
【０００５】パーソナル・コンピュータ・テクノロジの
開発が進歩するにともない、パーソナル・コンピュータ
はプロセッサ、データ記憶装置、及びメモリにますます
速いデータ処理速度を組み込むことを可能としてきてい
る。このような速い速度は電磁放射線のより多くの放出
をもたらし、このような放出、ならびに入出力信号を妨
害する可能性というリスクに関して課される要求が高ま
ってきている。このような要件を指す他の用語として
は、電磁互換性及び電磁妨害雑音の抑制とが挙げられ
る。速い速度を求めながら、電磁放射線の放出を要求さ
れている標準の範囲内に収めるために、設計はギャップ
や開口が最小限で完全に接地されたエンクロージャをめ
ざすようになってきている。
【０００６】
【発明が解決しようとする課題】本発明の目的は、上述
の環境における電磁妨害雑音による入出力信号に対する
悪影響を効果的に防止することである。本発明のこの目
的を実現するに当たり、このような入出力信号が多層回
路板の内部層に設けられた導電路との間で流れる領域
に、シールドが設けられる。
【０００７】本発明の他の目的は、パーソナル・コンピ
ュータのユーザ及び使用環境が、過度の電磁放出から保
護されるようにすることである。本発明のこの目的を実
現するに当たり、回路板の一部に対し、また入出力信号
が通過するコネクタに対し、シールド手段を設ける。
【０００８】
【課題を解決するための手段】本発明のこれらの目的
は、マイクロコンピュータを次のような構成にすること
によって達成される。即ち、回路板を取り付けるための
シャーシ（１９）であって、基板（２２）、パネル（２
４、２５）及び前記シャーシの少なくとも一部が電磁妨
害雑音を散逸させるためにグランドに接続されているシ
ャーシ（１９）と、マイクロコンピュータの作動構成要
素を相互に接続するために前記シャーシ（１９）に取り
付けられ、前記パネルに隣接して延びている側縁部と、
マイクロコンピュータの作動構成要素との間で流れる入
出力信号のための導電路を前記側縁部に隣接して画定す
る前記回路板の複数の内部層とを有する多層プリント回
路板（２０）と、前記導電路との間で入出力信号を通す
ために前記回路板に取り付けられた少なくとも１個のコ
ネクタ（１１０）と、前記導電路との間での入出力信号
の通過によって生じる可能性のある悪影響に対するシー
ルドを行い、かつ前記回路板の側縁部を構造的に強化す
るためのシールド構造体であって、グランドに接続され
た前記シャーシの一部分に作動可能に接続され、前記導
電路と前記パネルとの間で信号が通過する領域を実質的
に包囲しているシールド構造体（１０１、１０２、１１
１）と、を備えたマイクロコンピュータである。また、
低速なシステム・プロセッサで実行されるように設計さ
れた適用業務プログラム及びオペレーティング・システ
ム・ソフトウェアと互換性を有する高速なシステム・プ
ロセッサを有しているマイクロコンピュータにおいて、
回路板を取り付けるためのシャーシ（１９）であって、
基板（２２）、前部パネル（２４）及び後部パネル（２
５）、ならびに前記シャーシの少なくとも一部が電磁妨
害雑音を散逸させるためにグランドに維持されているシ
ャーシ（１９）と、マイクロコンピュータの作動構成要
素を相互に接続するために前記シャーシ（１９）に取り
付けられ、前記前部パネル（２４）及び後部パネル（２
５）の一方に隣接して延びている側縁部と、マイクロコ
ンピュータの作動構成要素との間で流れる入出力信号の
ための導電路を前記側縁部に隣接して画定する前記回路
板の複数の内部層とを有する多層プリント回路板（２
０）と、前記回路板と電気的に接続され、高速データ・
バスに結合されている、リアル・モード及びプロテクト
・モードの作動を有する高速マイクロプロセッサと、前
記回路板に電気的に接続され、低速データ・バスに結合
されている非揮発性メモリと、高速データ・バスと低速
データ・バスの間の通信をもたらすための、前記回路板
に電気的に接続されたバス・コントローラと、高速デー
タ・バスに電気的に応答する揮発性メモリと、前記揮発
性メモリ及び前記非揮発性メモリに電気的に結合され、
該揮発性メモリと前記高速マイクロプロセッサの間の通
信を調整するメモリ・コントローラと、前記シャーシ
（１９）に係合し、かつマイクロコンピュータの前記マ
イクロプロセッサ、メモリ及びコントローラ構成要素を
収めるための、シールドされ、包囲された容積を前記シ
ャーシとともに形成するカバー（１６）と、前記導電路
との間で入出力信号を通すために前記回路板に取り付け
られた少なくとも１個のコネクタ（１１０）と、前記導
電路との間での入出力信号の通過によって生じる可能性
のある悪影響に対するシールドを行い、かつ前記回路板
の側縁部を構造的に強化するためのシールド構造体（１
０１、１０２、１１１）であって、グランドに接続され
た前記シャーシの一部分に作動可能に接続され、前記導
電路と前記コネクタに隣接した前記前部及び後部パネル
の一方との間で信号が通過する領域を実質的に包囲して
いるシールド構造体（１０１、１０２、１１１）と、を
備えたマイクロコンピュータである。
【０００９】
【実施例】本発明を本発明の好ましい実施例を示す添付
図面を参照して、以下詳細に説明するが、以下の説明を
始める前に、当分野の技術者が本発明の望ましい結果を
達成しながら、本明細書で説明する本発明を改変できる
ことを理解されたい。したがって、以下の説明は当分野
の技術者を対象とした、広範囲の教示的な開示であっ
て、本発明を限定するものではないことを理解すべきで
ある。
【００１０】添付図面を詳細に参照すると、本発明を実
施するマイクロコンピュータが、総括的に１０で示され
ている（図１）。上述のように、コンピュータ１０は関
連する表示装置１１、キーボード１２、及びプリンタま
たはプロッタ１４を含んでいてもかまわない。コンピュ
ータ１０は装飾用の外部部材１６（図２）及び内部シー
ルド部材１８によって形成されたカバー１５を有してお
り、内部シールド部材１８はシャーシ１９と協働して、
ディジタル・データを処理し、記憶するための電気的に
駆動されるデータ処理及び記憶構成要素を受け入れるた
めに包囲され、シールドされた容積を画定している。こ
れらの構成要素の少なくともいくつかは、多層回路板２
０ないしマザーボードに取り付けられており、この多層
回路板はシャーシ１９に取り付けられ、コンピュータ１
０の上述の構成要素、ならびにフロッピィ・ディスク駆
動機構、各種の形態の直接アクセス記憶装置、アクセサ
リ・カードないしボードなどの関連要素を電気的に相互
接続するための手段を提供している。以下で詳細に説明
するように、回路板２０には、マイクロコンピュータの
作動構成要素との間の入出力信号の通路が設けられてい
る。
【００１１】シャーシ１９は２２で示す基板、２４で示
す前部パネル、及び２５で示す後部パネルを有している
（図２）。前部パネル２４は磁気ディスクまたは光ディ
スクのディスク駆動機構、テープ・バックアップ駆動機
構などのデータ記憶装置を受け入れるための少なくとも
１個のオープン・ベイ（図示の形態では、４個）を画定
している。図示の形態には、一対の上部ベイ２６、２８
及び一対の下部ベイ２９、３０が設けられている。上部
ベイの一方２６は第１のサイズの周辺駆動機構（３．５
インチ駆動機構といわれるものなど）を受け入れるよう
になされており、もう一方２８は２つのサイズ（３．５
インチと５．２５インチなど）のうち選択されたものの
駆動機構を受け入れるようになされており、また下部ベ
イは１種類のサイズ（３．５インチ）だけの装置を受け
入れるようになされている。
【００１２】上記の構造を本発明と関連付ける前に、パ
ーソナル・コンピュータ・システム１０の一般的な作動
の要約を検討するのが賢明であろう。図３には、回路板
２０に取り付けられた構成要素、ならびにパーソナル・
コンピュータ・システムの入出力スロット及びその他の
ハードウェアに対する回路板の接続を含む、本発明によ
るシステム１０などのようなコンピュータの各種の構成
要素を説明するパーソナル・コンピュータ・システムの
ブロック図が示されている。回路板には、高速ＣＰＵロ
ーカル・バス３４によって、バス制御タイミング装置３
５を介してメモリ制御装置３６に接続されたマイクロプ
ロセッサからなるシステム・プロセッサ３２が接続され
ており、メモリ制御装置３６はさらに揮発性ランダム・
アクセス・メモリ（ＲＡＭ）３８に接続されている。任
意適切なマイクロプロセッサを使用できるが、適切なマ
イクロプロセッサの１つはインテルが販売している８０
３８６である。
【００１３】図３のシステム・ブロック図を詳細に参照
して本発明を以下で説明するが、以下の説明を開始する
に当たり、本発明による装置及び方法を他のハードウェ
ア構成の回路板とともに使用できることを意図している
ことを理解すべきである。たとえば、システム・プロセ
ッサはインテル８０２８６または８０４８６であっても
よい。
【００１４】図３において、ＣＰＵローカル・バス３４
（データ、アドレス及び制御構成要素からなる）はマイ
クロプロセッサ３２、数値演算コプロセッサ３９、キャ
ッシュ・コントローラ４０、及びキャッシュ・メモリ４
１の接続をもたらす。ＣＰＵローカル・バス３４にはバ
ッファ４２も結合されている。バッファ４２自体は、こ
れもアドレス、データ及び制御構成要素で構成されてい
る、低速な（ＣＰＵローカル・バスに比較して）システ
ム・バス４４に接続されている。システム・バス４４は
バッファ４２と他のバッファ６８の間を延びている。シ
ステム・バス４４はさらにバス制御及びタイミング装置
３５及びＤＭＡ装置４８に接続されている。ＤＭＡ装置
４８は中央アービトレーション装置４９及びＤＭＡコン
トローラ５０で構成されている。バッファ５１はシステ
ム・バス４４と、マイクロ・チャネル・バス５２などの
オプション機能バスとの間のインタフェースを提供す
る。バス５２には、マイクロ・チャネル・アダプタ・カ
ードを受け入れるための複数個の入出力スロット５４が
接続されており、これらのスロットはさらに入出力装置
またはメモリに接続されている。
【００１５】アービトレーション制御バス５５はＤＭＡ
コントローラ５０及び中央アービトレーション装置４９
を、入出力スロット５４及びディスケット・アダプタ５
６に結合している。システム・バス４４には、メモリ・
コントローラ５９、アドレス・マルチプレクサ６０、及
びデータ・バッファ６１で構成されたメモリ制御装置３
６も接続されている。メモリ制御装置３６はさらに、Ｒ
ＡＭモジュール３８で表されるランダム・アクセス・メ
モリに接続されている。メモリ・コントローラ３６はＲ
ＡＭ３８の特定の領域に対してマイクロプロセッサ３２
との間でアドレスをマッピングするための論理回路を含
んでいる。この論理回路を使用して、それまでＢＩＯＳ
によって占有されていたＲＡＭを再利用する。メモリ・
コントローラ３６はさらに、ＲＯＭ６４を使用可能また
は使用不能とするＲＯＭ選択信号（ＲＯＭＳＥＬ）を発
生する。
【００１６】基本の１メガバイトのＲＡＭモジュールを
有するマイクロコンピュータ・システム１０が示されて
いるが、図３においてオプションのメモリ・モジュール
６５ないし６７によって表されているように、追加のメ
モリを接続することができる。説明のみを目的として、
本発明を基本の１メガバイトのメモリ・モジュール３８
を参照して説明する。
【００１７】ラッチ・バッファ６８がシステム・バス４
４と回路板入出力バス６９の間に接続されている。回路
板入出力バス６９はアドレス、データ、ならびに制御そ
れぞれの構成要素を含んでいる。回路板入出力バス６９
に沿って、各種の入出力アダプタ、ならびにディスプレ
イ・アダプタ７０（表示装置１１を駆動するのに使用さ
れる）、ＣＭＯＳクロック７２、以下においてＮＶＲＡ
Ｍと呼ぶ不揮発性ＣＭＯＳ ＲＡＭ７４、ＲＳ２３２ア
ダプタ７６、パラレル・アダプタ７８、複数個のタイマ
８０、ディスケット・アダプタ５６、割込みコントロー
ラ８４、及び読取り専用メモリ６４などの他の構成要素
が結合されている。読取り専用メモリ６４は入出力装置
と、マイクロプロセッサ３２のオペレーティング・シス
テムの間のインタフェースに使用されるＢＩＯＳを含ん
でいる。ＲＯＭ６４に記憶されているＢＩＯＳをＲＡＭ
３８にコピーして、ＢＩＯＳの実行時間を短縮すること
ができる。ＲＯＭ６４はさらにメモリ・コントローラ３
６に応答する（ＲＯＭＳＥＬ信号によって）。ＲＯＭ６
４をメモリ・コントローラ３６によって使用可能とする
と、ＢＩＯＳはＲＯＭ外で実行される。ＲＯＭ６４をメ
モリ・コントローラ３６によって使用不能とすると、Ｒ
ＯＭはマイクロプロセッサ３２からのアドレス照会に応
答しなくなる（すなわち、ＢＩＯＳはＲＡＭ外で実行さ
れる）。
【００１８】回路板入出力バス６９は以下で説明するよ
うに、多層回路板２０の内部層に形成された導電性経路
によって画定される部分を含んでおり、詳細にいえばシ
ャーシの前面パネルと後面パネルの一方に隣接して延び
るように配置された回路板２０の縁部に隣接して延びて
いる多数のこのような経路を含んでいる。回路板のこの
ような設計は、表示装置、キーボード及びプリンタなど
の装置との信号の交換のための、このような側縁に沿っ
た多数の入出力コネクタの配置を可能とする。
【００１９】クロック７２は時刻の計算に使用され、Ｎ
ＶＲＡＭはシステム構成データを記憶するのに使用され
る。すなわち、ＮＶＲＡＭはシステムの現行の構成を記
述する値を含むこととなる。たとえば、ＮＶＲＡＭは固
定ディスクまたはディスケットの容量、表示装置の型
式、メモリの量、時間、日付などを記述する情報を含ん
でいる。特に重要なのは、ＮＶＲＡＭがデータを含んで
おり（１ビットでよい）、このデータをメモリ・コント
ローラ３６が使用して、ＢＩＯＳがＲＯＭ外で実行され
るのか、ＲＡＭ外で実行されるのか、またＢＩＯＳ Ｒ
ＡＭが使用することを意図しているＲＡＭを再利用する
かどうかを決定することである。さらに、これらのデー
タはＳＥＴコンフィギュレーションなどの特別な構成プ
ログラムが実行された場合に、ＮＶＲＡＭに記憶され
る。ＳＥＴコンフィギュレーション・プログラムの目的
は、ＮＶＲＡＭに対してシステムの構成を特徴付ける数
値を記憶することである。
【００２０】上述のように、コンピュータは総括的に１
５で示されるカバーを有しており、このカバーはシャー
シ１９と協働して、マイクロコンピュータの上述の構成
要素を収めるための閉鎖され、シールドされた空間を形
成する。カバーは成形可能な合成材料製の一体成形構成
要素である外部装飾カバー部材１６、及び装飾カバー部
材の構成に適合するように形成された金属薄板ライナー
によって形成されるのが好ましい。ただし、カバーは他
の周知の方法でも作成できるものであって、本発明の有
用性は上述の型式のエンクロージャに限定されるもので
はない。
【００２１】上述のコンピュータ構成要素の正常な作動
を妨げることのある電磁放射線の影響を減衰し、回路板
２０の側縁を構造的に補強するために、本発明は多層回
路板の内部導電路との間の入出力信号の通路から生じる
可能性のある悪影響をシールドし、このような信号が通
過する側縁部を構造的に補強するためのシールド構造を
含んでいる。シールド構造はグランドに維持されている
シャーシの部分に作動的に接続されており、入出力信号
が回路板の導電路とコネクタに隣接したシャーシのパネ
ルの間で通過する領域を実質的に包囲している。これに
より、電気的な電磁妨害雑音をシールド構造を介してグ
ランドに落とし、回路の動作に悪影響を与えないように
することができる。なお、本発明のシールド構造は２つ
の構成部品を有しており、その一方は回路板の外層に形
成されており、他方は薄い金属ストリップとして形成さ
れている。
【００２２】シールド構造の構成部品の第１のものをよ
り明確に理解するために、図４ないし図６を参照する
が、これらの図面には、多層プリント回路板の分解立面
図と、回路板のいくつかの外層の平面図が示されてい
る。図面において、回路板２０は導電路と、絶縁及び分
離のみを目的とする２枚の間挿層を有する上面及び下面
の両方で向き合っている３つの層で形成された６層の回
路板として示されている。このような多層回路板は本明
細書で説明する発明性を有する特徴を別とすれば、従来
からあり、周知のものである。このような多層プリント
回路板の設計及び組立に関する一般的な概念は、当分野
の技術者には周知のものであり、各種の技術文献に記載
されている。これらの理由から、本明細書の説明は主と
して回路板２０を他のものと区別する点を対象とし、公
知の原理の技術的開示を繰り返すものではない。
【００２３】回路板２０は上述のように、１００Ａ、１
００Ｂ、１００Ｃ、１００Ｄ、及び１００Ｅという５つ
の層を含んでいる。２つのこのような層、１００Ｂおよ
び１００Ｄは絶縁及び分離の目的に役立つものである。
他の層、１００Ａ、１００Ｃおよび１００Ｅはパーソナ
ル・コンピュータ１０の作動構成要素を接続するのに役
立つ導電路を担持している。内面の１つ（たとえば、最
上層１００Ａの下面、または内部層１００Ｃのいずれか
の面）はコンピュータ１０のエンクロージャ内に収めら
れている構成要素と、エンクロージャの外部構成要素の
間の信号が通過する導電路を担持している。
【００２４】図示の実施例において、入出力信号はシャ
ーシの後部パネル２５に隣接した回路板２０の一部（図
２において、コンピュータ１０の電源で隠されている位
置にある）を通過する。それ故、以下で説明する特性を
示す回路板の側縁部はシャーシのこのパネルに隣接して
延びている。
【００２５】回路板２０の関連する側縁部は入出力導電
路を担持している層から多層回路板の外部に向かってい
る層において、上部及び下部グリッド部分１０１及び１
０２（それぞれ、図５及び図６）によって画定された接
地面領域ないし接地グリッドを担持している。各グリッ
ド部分は多層回路板２０の最外面に配置できるものであ
って、回路板２０全体にわたる導電路を画定するために
使用される銅箔などの導体の線の配列によって画定され
た部分を有している。線は０．１５２４ｍｍ（６ミル）
程度の幅を有しているのが好ましく、また０．１５２４
ないし０．２５４ｍｍ（６ないし１０ミル）の間隔で互
いに離隔されている。線の幅及び間隔を計算して、１０
０ないし３００メガヘルツの周波数範囲などの、問題を
生じると考えられる特定の周波数における電磁エネルギ
ーを抑制するようにする。線のパターンは互いに直角に
延び、間に空間を残すものを含んでいる。
【００２６】これまで、銅などの導体の中実な領域を使
用して、シールドを行うことが提案されてきたが、この
ような大きな領域の影響の１つに、このような連続した
大きな領域を有するプリント回路板の領域の歪があるこ
とが発見された。このような歪が生じる理由は明確では
ないが、回路板の製造、取扱い、及び使用の際の熱膨張
効果の変動によって生じるものと考えられている。本明
細書記載の線のグリッドはこのような歪を回避するもの
と判断されている。したがって、本明細書記載の接地グ
リッドはプリント回路板の側縁を補強し、側縁部を平面
ないし平坦に維持し、回路板を歪ませる作用をする力に
対して回路板を強化する。これらの機能は上述の電気シ
ールド機能とは別なものである。
【００２７】このような歪を生じさせる可能性のある力
は、製造時の回路板の側縁部に対する、図６及び図７に
示しコネクタ１１０などのコネクタの接続によって、ま
たその後のコネクタに対するケーブルなどの接続によっ
て生じることがある。また、外部装置と回路板２０の導
電路との間の接続を確立するコネクタ１１０は、電磁妨
害雑音の放出や、コンピュータ１０のこの領域を通過す
る入出力回路に対するこのような妨害雑音の侵入の場所
となる可能性がある。
【００２８】本発明によれば、図７および図８に示され
ているように、シールド構造の第２の構成部品は成形さ
れた薄金属ストリップ１１１であって、コネクタ１１０
及び同様に配置されたその他の部品をほぼ完全に包囲し
ている。ストリップ１１１はほぼ「Ｕ」形の構成となっ
ており、一方側面が下方におかれ、Ｕの基部が接地面１
０１及び１０２の配置されている回路板２０の側縁部に
固定されている。シールド・ストリップ１１１はネジ付
きスタッドなどの適切な機械的固定具によって固定する
ことも、あるいはその他の任意の態様で固定することも
できる。図示の形態において、ストリップ１１１はコネ
クタ１１０などのコネクタの導電性シェルに固定されて
いる。ストリップ１１１及び接地グリッド部１０１、１
０２は互いに、またグランドとして機能するシャーシの
部分に電気的に接続されていることが好ましい。図示の
形態において、ストリップ１１１はシャーシの後部パネ
ル２５との係合によって、このような接続をもたらして
いる。ストリップ１１１はさらに、回路板２０の側縁部
を構造的に補強し、回路板を歪その他に対して強化して
いる。この機能は入出力回路がコンピュータの内部及び
外部の間で通過している重要な部分において、このよう
な回路を電磁妨害雑音からシールドする効果とは別なも
のである。
【００２９】
【発明の効果】本発明により、コンピュータにおける電
磁妨害雑音による入出力信号に対する悪影響を効果的に
防止することができる。
【図面の簡単な説明】
【図１】本発明を実施するパーソナル・コンピュータの
斜視図である。
【図２】シャーシ、カバー、電気機械的直接アクセス記
憶装置及び多層回路板を含んでおり、図１のパーソナル
・コンピュータのいくつかの要素の間のいくつかの関係
を説明する分解斜視図である。
【図３】図１及び図２のパーソナル・コンピュータのい
くつかの構成部品の略図である。
【図４】図２のコンピュータに含まれている多層回路板
の分解立面図である。
【図５】図４の回路板の外部層の平面図である。
【図６】図４の回路板の外部層の平面図である。
【図７】図２に示したいくつかの入出力接続及びシール
ド構成部品の分解拡大斜視図である。
【図８】図２のコンピュータのシャーシ後部パネル部分
の垂直断面図である。
【符号の説明】
１０ コンピュータ １１ 表示装置 １２ キーボード １４ プリンタまたはプロッタ １５ カバー １８ 内部シールド部材 １９ シャーシ ２０ 多層回路板 ２２ ベース ２４ 前面パネル ２５ 後部パネル ３２ システム・プロセッサ １０１ 上部グリッド部分 １０２ 下部グリッド部分 １１０ コネクタ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ジェフリー・ウィリアム・ベンク アメリカ合衆国33496、フロリダ州ボカ・ ラトン、ノース・ミリタリー・トレイル ナンバー2708、6503 (72)発明者 トーマス・アルバート・ボッキーノ アメリカ合衆国33436、フロリダ州ボイン トン・ビーチ、アラディン・アベニュー、 3620番地 (72)発明者 ジェームズ・ウィリアム・デイソ アメリカ合衆国33496、フロリダ州ボカ・ ラトン、クラウドレーク、サークル、 18970番地 (72)発明者 ホセ・エドムンド・リチャーズ アメリカ合衆国33441、フロリダ州ディア フィールド・ビーチ、サウス・ウエスト32 番アベニュー、327番地 (72)発明者 マーク・リン・シプレイ アメリカ合衆国33463、フロリダ州レー ク・ウォース、ボニータ・アイル・ドライ ブ、8437番地 (72)発明者 ロバート・デイ・ウィソング アメリカ合衆国33434、フロリダ州ボカ・ ラトン、ノース・ウエスト26番アベニュ ー、4250番地

Claims (9)

    【特許請求の範囲】
  1. 【請求項１】回路板を取り付けるためのシャーシ（１
    ９）であって、基板（２２）、パネル（２４、２５）及
    び前記シャーシの少なくとも一部が電磁妨害雑音を散逸
    させるためにグランドに接続されているシャーシ（１
    ９）と、マイクロコンピュータの作動構成要素を相互に
    接続するために前記シャーシ（１９）に取り付けられ、
    前記パネルに隣接して延びている側縁部と、マイクロコ
    ンピュータの作動構成要素との間で流れる入出力信号の
    ための導電路を前記側縁部に隣接して画定する前記回路
    板の複数の内部層とを有する多層プリント回路板（２
    ０）と、前記導電路との間で入出力信号を通すために前
    記回路板に取り付けられた少なくとも１個のコネクタ
    （１１０）と、前記導電路との間での入出力信号の通過
    によって生じる可能性のある悪影響に対するシールドを
    行い、かつ前記回路板の側縁部を構造的に強化するため
    のシールド構造体であって、グランドに接続された前記
    シャーシの一部分に作動可能に接続され、前記導電路と
    前記パネルとの間で信号が通過する領域を実質的に包囲
    しているシールド構造体（１０１、１０２、１１１）
    と、を備えたマイクロコンピュータ。
  2. 【請求項２】前記シールド構造体が入出力信号に対する
    前記導電路の外部への、前記回路板の層の内部の接地面
    領域を含んでおり、該接地面領域が前記側縁部に隣接し
    て延びている、請求項１記載のマイクロコンピュータ。
  3. 【請求項３】前記シールド構造体が前記回路板と前記パ
    ネルをブリッジする成形薄金属ストリップをさらに含ん
    でいる、請求項２記載のマイクロコンピュータ。
  4. 【請求項４】前記シールド構造体が前記回路板と前記パ
    ネルをブリッジする成形薄金属ストリップをさらに含ん
    でいる、請求項１記載のマイクロコンピュータ。
  5. 【請求項５】前記成形薄金属ストリップが機械的に固定
    されており、かつ前記コネクタに電気的に接続されてい
    る、請求項４記載のマイクロコンピュータ。
  6. 【請求項６】前記シールド構造体が入出力信号に対する
    前記導電路の外部への、前記回路板の層の内部の接地面
    領域を含んでおり、該接地面領域が前記側縁部に隣接し
    て延びている導体の線の配列によって画定されている、
    請求項１記載のマイクロコンピュータ。
  7. 【請求項７】線の前記配列が互いに平行で、互いにほぼ
    その幅に等しい距離離隔している、第１の方向に延びて
    いる複数本の第１の線と、第２の方向に、かつ互いに平
    行に延びている複数本の第２の線とからなり、前記の第
    ２の方向が前記の第２の線が前記の第１の線と交差し、
    前記の線が一緒になってグリッド・パターンを画定する
    ようなものである、請求項６記載のマイクロコンピュー
    タ。
  8. 【請求項８】前記の第２の方向が前記の第１の方向に直
    角である、請求項７記載のマイクロコンピュータ。
  9. 【請求項９】低速なシステム・プロセッサで実行される
    ように設計された適用業務プログラム及びオペレーティ
    ング・システム・ソフトウェアと互換性を有する高速な
    システム・プロセッサを有しているマイクロコンピュー
    タにおいて、回路板を取り付けるためのシャーシ（１
    ９）であって、基板（２２）、前部パネル（２４）及び
    後部パネル（２５）、ならびに前記シャーシの少なくと
    も一部が電磁妨害雑音を散逸させるためにグランドに維
    持されているシャーシ（１９）と、マイクロコンピュー
    タの作動構成要素を相互に接続するために前記シャーシ
    （１９）に取り付けられ、前記前部パネル（２４）及び
    後部パネル（２５）の一方に隣接して延びている側縁部
    と、マイクロコンピュータの作動構成要素との間で流れ
    る入出力信号のための導電路を前記側縁部に隣接して画
    定する前記回路板の複数の内部層とを有する多層プリン
    ト回路板（２０）と、前記回路板と電気的に接続され、
    高速データ・バスに結合されている、リアル・モード及
    びプロテクト・モードの作動を有する高速マイクロプロ
    セッサと、前記回路板に電気的に接続され、低速データ
    ・バスに結合されている非揮発性メモリと、高速データ
    ・バスと低速データ・バスの間の通信をもたらすため
    の、前記回路板に電気的に接続されたバス・コントロー
    ラと、高速データ・バスに電気的に応答する揮発性メモ
    リと、前記揮発性メモリ及び前記非揮発性メモリに電気
    的に結合され、該揮発性メモリと前記高速マイクロプロ
    セッサの間の通信を調整するメモリ・コントローラと、
    前記シャーシ（１９）に係合し、かつマイクロコンピュ
    ータの前記マイクロプロセッサ、メモリ及びコントロー
    ラ構成要素を収めるための、シールドされ、包囲された
    容積を前記シャーシとともに形成するカバー（１６）
    と、前記導電路との間で入出力信号を通すために前記回
    路板に取り付けられた少なくとも１個のコネクタ（１１
    ０）と、前記導電路との間での入出力信号の通過によっ
    て生じる可能性のある悪影響に対するシールドを行い、
    かつ前記回路板の側縁部を構造的に強化するためのシー
    ルド構造体（１０１、１０２、１１１）であって、グラ
    ンドに接続された前記シャーシの一部分に作動可能に接
    続され、前記導電路と前記コネクタに隣接した前記前部
    及び後部パネルの一方との間で信号が通過する領域を実
    質的に包囲しているシールド構造体（１０１、１０２、
    １１１）と、を備えたマイクロコンピュータ。
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