JPH0759091A - 符号変換装置 - Google Patents
符号変換装置Info
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- JPH0759091A JPH0759091A JP5203888A JP20388893A JPH0759091A JP H0759091 A JPH0759091 A JP H0759091A JP 5203888 A JP5203888 A JP 5203888A JP 20388893 A JP20388893 A JP 20388893A JP H0759091 A JPH0759091 A JP H0759091A
- Authority
- JP
- Japan
- Prior art keywords
- code
- circuit
- coefficient
- output
- pixels
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- Pending
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Landscapes
- Compression Of Band Width Or Redundancy In Fax (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
- Image Processing (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
Abstract
(57)【要約】
【目的】符号レートの異なる符号化装置と復号化装置を
簡易に接続する。 【構成】入力符号４１と出力パラメータ４３から符号化
装置と復号化装置の符号レートを判定し、出力制御信号
４４，係数制御信号４５を出力する制御回路３２を設
け、入力符号４１を直交変換係数まで復号する復号回路
２２，逆量子回路２３を設ける。直交変換係数を係数処
理回路３３によって、ブロック毎に制御回路３２からの
制御信号４５に応じて制御する。係数は量子回路５によ
り量子化した後、符号回路６によって符号化され、出力
バッファ３４を経てスイッチ回路３５に供給される。ス
イッチ回路３５は制御回路３２からの制御信号４４によ
り出力符号４２を選択し出力する。
簡易に接続する。 【構成】入力符号４１と出力パラメータ４３から符号化
装置と復号化装置の符号レートを判定し、出力制御信号
４４，係数制御信号４５を出力する制御回路３２を設
け、入力符号４１を直交変換係数まで復号する復号回路
２２，逆量子回路２３を設ける。直交変換係数を係数処
理回路３３によって、ブロック毎に制御回路３２からの
制御信号４５に応じて制御する。係数は量子回路５によ
り量子化した後、符号回路６によって符号化され、出力
バッファ３４を経てスイッチ回路３５に供給される。ス
イッチ回路３５は制御回路３２からの制御信号４４によ
り出力符号４２を選択し出力する。
Description
【０００１】
【産業上の利用分野】本発明は画像信号のディジタル信
号処理を行う記録・伝送機器、その他の表示装置などの
各種機器において、画像信号をより少ない符号量で効率
的に符号化する高能率符号化装置及び復号化装置のう
ち、符号変換装置に関する。
号処理を行う記録・伝送機器、その他の表示装置などの
各種機器において、画像信号をより少ない符号量で効率
的に符号化する高能率符号化装置及び復号化装置のう
ち、符号変換装置に関する。
【０００２】
【従来の技術】図１は画像符号化装置の代表的な従来構
成を示すブロック図である。同図において連続して入力
される画像信号はフレームメモリ１に蓄えられる。動き
ベクトル検出回路２は、フレームメモリ１に蓄えられた
画像信号を用いて動きベクトルを検出し、検出した動き
ベクトルを動き補償回路１３に供給する。動き補償回路
１３では符号化の後、フレームメモリ１２に蓄えられた
復号画像に対して動き補償を行い予測画像１４を生成す
る。減算回路３においてフレームメモリ１に蓄えられた
入力画像から予測画像１４を減算する。その差分である
予測誤差信号を８×８画素のブロック単位で離散コサイ
ン変換(Discrete Cosine Transform：以下ＤＣＴ）回路
４に供給して直交変換を行う。このとき変換係数は低周
波成分、特に直流成分に集中して現われる。得られた８
×８画素の各係数は量子回路５において、各係数毎に量
子化が行われる。
成を示すブロック図である。同図において連続して入力
される画像信号はフレームメモリ１に蓄えられる。動き
ベクトル検出回路２は、フレームメモリ１に蓄えられた
画像信号を用いて動きベクトルを検出し、検出した動き
ベクトルを動き補償回路１３に供給する。動き補償回路
１３では符号化の後、フレームメモリ１２に蓄えられた
復号画像に対して動き補償を行い予測画像１４を生成す
る。減算回路３においてフレームメモリ１に蓄えられた
入力画像から予測画像１４を減算する。その差分である
予測誤差信号を８×８画素のブロック単位で離散コサイ
ン変換(Discrete Cosine Transform：以下ＤＣＴ）回路
４に供給して直交変換を行う。このとき変換係数は低周
波成分、特に直流成分に集中して現われる。得られた８
×８画素の各係数は量子回路５において、各係数毎に量
子化が行われる。
【０００３】符号回路６において、量子化係数は、図２
に示すジグザグスキャンを用いて一次元への並び替えが
行われる。この方法は係数データの集中する低周波領域
から高周波領域に向かってスキャンが行われる。次に一
次元に並び替えられた各係数の値がゼロであるか否かの
判定が行われ、連続するゼロの係数はその長さがランレ
ングスとしてカウントされる。ゼロ以外の係数のとき、
その係数とそれまでのゼロ係数のランレングスを組み合
わせて符号が割り当てられる。
に示すジグザグスキャンを用いて一次元への並び替えが
行われる。この方法は係数データの集中する低周波領域
から高周波領域に向かってスキャンが行われる。次に一
次元に並び替えられた各係数の値がゼロであるか否かの
判定が行われ、連続するゼロの係数はその長さがランレ
ングスとしてカウントされる。ゼロ以外の係数のとき、
その係数とそれまでのゼロ係数のランレングスを組み合
わせて符号が割り当てられる。
【０００４】符号は出力バッファ７に蓄えられた後、伝
送路に送り出される。また、出力バッファ７の蓄積量に
応じて量子化制御回路８は量子回路５に対して量子化パ
ラメータを供給する。量子化制御回路８は出力バッファ
７に蓄えられる符号量が多くなると量子化パラメータを
大きくし、符号量が少なくなると量子化パラメータを小
さくすることで出力符号レートを一定に保つ。
送路に送り出される。また、出力バッファ７の蓄積量に
応じて量子化制御回路８は量子回路５に対して量子化パ
ラメータを供給する。量子化制御回路８は出力バッファ
７に蓄えられる符号量が多くなると量子化パラメータを
大きくし、符号量が少なくなると量子化パラメータを小
さくすることで出力符号レートを一定に保つ。
【０００５】逆量子回路９，ＩＤＣＴ回路１０，加算回
路１１，フレームメモリ１２によりローカルデコーダを
形成し、動き補償に用いる復号画像を生成する。量子回
路５により量子化された量子化係数は、逆量子回路９に
よって量子回路５で用いたものと同じ量子化パラメータ
によって逆量子化が行われる。この逆量子化係数をＩＤ
ＣＴ回路１０により逆ＤＣＴを行い、入力画像と予測画
像の差分値である予測誤差信号に変換する。加算回路１
１では予測誤差信号と動き補償回路１３より出力される
予測画像１４を加算し復号画像を得る。この復号画像は
フレームメモリ１２に蓄えられ、次の予測画像作成のた
めに用いられる。
路１１，フレームメモリ１２によりローカルデコーダを
形成し、動き補償に用いる復号画像を生成する。量子回
路５により量子化された量子化係数は、逆量子回路９に
よって量子回路５で用いたものと同じ量子化パラメータ
によって逆量子化が行われる。この逆量子化係数をＩＤ
ＣＴ回路１０により逆ＤＣＴを行い、入力画像と予測画
像の差分値である予測誤差信号に変換する。加算回路１
１では予測誤差信号と動き補償回路１３より出力される
予測画像１４を加算し復号画像を得る。この復号画像は
フレームメモリ１２に蓄えられ、次の予測画像作成のた
めに用いられる。
【０００６】復号化装置の構成を図３に示す。復号化装
置の構成はローカルデコーダに入力バッファ２１，復号
回路２２が付属する。入力符号は入力バッファ２１に蓄
えられた後、復号回路２２により復号化が行われる。復
号化後の係数信号から、ローカルデコーダと同様に逆量
子回路２３，ＩＤＣＴ回路２４により予測誤差信号を求
める。この予測誤差信号とフレームメモリ２６に蓄えら
れた前フレームの復号画像を加算回路２５により加算す
ることによって復号画像を得る。この復号画像は次フレ
ームの画像復号のためにフレームメモリ２６に蓄えられ
る。
置の構成はローカルデコーダに入力バッファ２１，復号
回路２２が付属する。入力符号は入力バッファ２１に蓄
えられた後、復号回路２２により復号化が行われる。復
号化後の係数信号から、ローカルデコーダと同様に逆量
子回路２３，ＩＤＣＴ回路２４により予測誤差信号を求
める。この予測誤差信号とフレームメモリ２６に蓄えら
れた前フレームの復号画像を加算回路２５により加算す
ることによって復号画像を得る。この復号画像は次フレ
ームの画像復号のためにフレームメモリ２６に蓄えられ
る。
【０００７】
【発明が解決しようとする課題】符号化装置，復号化装
置は通常は同じ帯域の符号レートを持つ一対の装置を用
いることが多い。しかし、一般的には送信側と受信側は
別の装置であるため符号レートが異なることも多い。符
号化装置と復号化装置の帯域が異なる場合、低帯域の符
号レートで符号化された信号を高帯域の復号化装置で復
号化できるが、高帯域の符号レートで符号化された信号
を低帯域の復号化装置で復号化することはできない。高
帯域の符号化装置により記録・伝送された符号レートの
高い信号を帯域の低い復号化装置によって復号化を行う
と、復号化装置の入力バッファにおいてオーバーフロー
が発生する。このため、バッファ内では信号の上書きや
廃棄等の誤動作を生じ、復号画像は正しく再現されな
い。
置は通常は同じ帯域の符号レートを持つ一対の装置を用
いることが多い。しかし、一般的には送信側と受信側は
別の装置であるため符号レートが異なることも多い。符
号化装置と復号化装置の帯域が異なる場合、低帯域の符
号レートで符号化された信号を高帯域の復号化装置で復
号化できるが、高帯域の符号レートで符号化された信号
を低帯域の復号化装置で復号化することはできない。高
帯域の符号化装置により記録・伝送された符号レートの
高い信号を帯域の低い復号化装置によって復号化を行う
と、復号化装置の入力バッファにおいてオーバーフロー
が発生する。このため、バッファ内では信号の上書きや
廃棄等の誤動作を生じ、復号画像は正しく再現されな
い。
【０００８】一つの解決策は、図４のように伝送路の途
中に符号化装置と同じ帯域の復号化装置５２、ならびに
復号化装置と同じ帯域の符号化装置５１を設け、画像信
号を共通の中間フォーマットまで復号化した後、再符号
化することによって伝送が可能になる。しかしこの方法
では、高帯域の復号化装置と低帯域の符号化装置を必要
とするので実用的ではない。
中に符号化装置と同じ帯域の復号化装置５２、ならびに
復号化装置と同じ帯域の符号化装置５１を設け、画像信
号を共通の中間フォーマットまで復号化した後、再符号
化することによって伝送が可能になる。しかしこの方法
では、高帯域の復号化装置と低帯域の符号化装置を必要
とするので実用的ではない。
【０００９】本発明の目的は、高帯域の符号化装置によ
り符号化した符号レートの高い信号を記録・伝送し、低
帯域の復号化装置により復号化するとき、特別に復号化
装置と符号化装置を設けることなく、記録・伝送を可能
にする符号レート装置を提供することにある。
り符号化した符号レートの高い信号を記録・伝送し、低
帯域の復号化装置により復号化するとき、特別に復号化
装置と符号化装置を設けることなく、記録・伝送を可能
にする符号レート装置を提供することにある。
【００１０】
【課題を解決するための手段】本発明は上記の目的を達
成するために、符号化装置により記録・伝送された符号
を直交変換係数まで復号化を行い、各画像ブロック毎に
係数制御を行った後、量子化，符号割り当てを行い復号
化装置に符号を伝送する。
成するために、符号化装置により記録・伝送された符号
を直交変換係数まで復号化を行い、各画像ブロック毎に
係数制御を行った後、量子化，符号割り当てを行い復号
化装置に符号を伝送する。
【００１１】
【作用】本発明によれば、符号化された画像信号を直交
変換係数まで復号化を行い、画像ブロック毎に係数制御
を行うことにより、符号量を削減した新たな符号を伝送
路に供給できる。それにより、符号レートの帯域が異な
る符号化装置と復号化装置間での符号伝送が可能にな
る。
変換係数まで復号化を行い、画像ブロック毎に係数制御
を行うことにより、符号量を削減した新たな符号を伝送
路に供給できる。それにより、符号レートの帯域が異な
る符号化装置と復号化装置間での符号伝送が可能にな
る。
【００１２】
【実施例】図５は本発明の実施例の符号レート変換装置
の構成を示すブロック図である。入力符号４１は入力バ
ッファ３１に蓄えられる。入力バッファ３１に蓄えられ
た符号は、制御回路３２，復号回路２２，スイッチ回路
３５に供給される。制御回路３２では、入力バッファよ
り供給される符号と出力パラメータ４３を用いて出力制
御信号４４、及び係数制御信号４５を生成し、それぞれ
の信号をスイッチ回路３５，係数処理回路３３に供給す
る。復号回路２２によって、入力バッファから供給され
る符号を復号化し、逆量子回路２３において直交変換係
数に復号化する。直交変換係数は、係数処理回路３３で
係数制御信号４５に従った係数処理を行った後、量子回
路５に供給され、量子化制御回路８から送られてくる量
子化パラメータを用いて量子化が行われる。
の構成を示すブロック図である。入力符号４１は入力バ
ッファ３１に蓄えられる。入力バッファ３１に蓄えられ
た符号は、制御回路３２，復号回路２２，スイッチ回路
３５に供給される。制御回路３２では、入力バッファよ
り供給される符号と出力パラメータ４３を用いて出力制
御信号４４、及び係数制御信号４５を生成し、それぞれ
の信号をスイッチ回路３５，係数処理回路３３に供給す
る。復号回路２２によって、入力バッファから供給され
る符号を復号化し、逆量子回路２３において直交変換係
数に復号化する。直交変換係数は、係数処理回路３３で
係数制御信号４５に従った係数処理を行った後、量子回
路５に供給され、量子化制御回路８から送られてくる量
子化パラメータを用いて量子化が行われる。
【００１３】量子化された信号は符号回路６によって符
号が割り付けられた後、出力バッファ３４に蓄積され
る。量子化制御回路８は出力符号レートを一定に保つた
めに、出力バッファ３４の蓄積量が多いときは、量子回
路５に供給する量子化パラメータを大きくし、蓄積量が
少ないときは量子化パラメータを小さくする。スイッチ
回路３５は出力制御信号４４に従い、入力バッファ３１
か出力バッファ３４のいずれかの符号を選択し、出力符
号４２を復号化装置または記録メディアに伝送する。
号が割り付けられた後、出力バッファ３４に蓄積され
る。量子化制御回路８は出力符号レートを一定に保つた
めに、出力バッファ３４の蓄積量が多いときは、量子回
路５に供給する量子化パラメータを大きくし、蓄積量が
少ないときは量子化パラメータを小さくする。スイッチ
回路３５は出力制御信号４４に従い、入力バッファ３１
か出力バッファ３４のいずれかの符号を選択し、出力符
号４２を復号化装置または記録メディアに伝送する。
【００１４】制御回路３２において入力バッファ３１の
符号と出力パラメータ４３の判定を行った結果、入出力
符号レートが同じ、または入力符号レートが出力符号レ
ートより低いとき、制御回路３２はスイッチ回路３５に
対して、入力バッファ３１の符号を出力とする出力制御
信号４４を供給する。スイッチ回路３５はそれに従っ
て、スイッチを切り替え、入力バッファ３１の符号を出
力符号４２として伝送する。
符号と出力パラメータ４３の判定を行った結果、入出力
符号レートが同じ、または入力符号レートが出力符号レ
ートより低いとき、制御回路３２はスイッチ回路３５に
対して、入力バッファ３１の符号を出力とする出力制御
信号４４を供給する。スイッチ回路３５はそれに従っ
て、スイッチを切り替え、入力バッファ３１の符号を出
力符号４２として伝送する。
【００１５】また、入力符号レートの帯域が出力符号レ
ートの帯域よりも高いとき、制御回路３２はスイッチ回
路３５に対して、出力バッファ３４の符号を出力とする
出力制御信号４４を供給し、スイッチ回路３５は出力バ
ッファ３４の符号が出力符号４２となるようにスイッチ
を切り替える。このとき入力と出力の符号レートの帯域
の違いがわずかであれば、制御回路３２は係数制御回路
３３に対して係数処理を禁止する係数制御信号４５を供
給する。従って、出力符号レートの制御は量子化制御回
路８からの量子化パラメータのみで行われる。入出力符
号レートの帯域が大きく異なるときは、以下に示す処理
を行い符号レートを制御する。
ートの帯域よりも高いとき、制御回路３２はスイッチ回
路３５に対して、出力バッファ３４の符号を出力とする
出力制御信号４４を供給し、スイッチ回路３５は出力バ
ッファ３４の符号が出力符号４２となるようにスイッチ
を切り替える。このとき入力と出力の符号レートの帯域
の違いがわずかであれば、制御回路３２は係数制御回路
３３に対して係数処理を禁止する係数制御信号４５を供
給する。従って、出力符号レートの制御は量子化制御回
路８からの量子化パラメータのみで行われる。入出力符
号レートの帯域が大きく異なるときは、以下に示す処理
を行い符号レートを制御する。
【００１６】図６は係数処理回路３３の構成を示すブロ
ック図である。係数処理回路３３に入力された直交変換
係数は乗算回路３８により、制御回路３２より与えられ
る係数制御信号４５と、画像ブロックのｎ×ｎ画素の各
画素毎に乗算が行われる。
ック図である。係数処理回路３３に入力された直交変換
係数は乗算回路３８により、制御回路３２より与えられ
る係数制御信号４５と、画像ブロックのｎ×ｎ画素の各
画素毎に乗算が行われる。
【００１７】係数制御信号４５の一例を図７，図８に示
す。図７は８×８画素のブロックサイズで入力された直
交変換係数の中から、低周波領域の４×４画素の係数だ
けを選択し、以後の符号化に用いるための係数制御信号
４５の例である。図において“１”の画素の係数は入力
係数が直接出力されるが、“０”の画素の係数は全てゼ
ロが出力される。このように高周波領域の係数を強制的
に削除することにより、発生符号量を削減する。図８は
８×８画素のブロックサイズで入力された直交変換係数
から、低周波成分を選択するときに図２で示したジグザ
グスキャンのスキャン方向に合わせて選択する例であ
る。図７と同様に“１”の部分の係数を選択し、“０”
の部分の係数は強制的にゼロにする。したがって、選択
範囲内の最後の非ゼロ係数以降の係数が全てスキャン方
向に合わせてゼロになるので、図７の例に比べて係数を
一次元にならび替えたときのゼロ係数の発生する割合が
少なくなり、符号の割り当てを容易に行うことができ
る。
す。図７は８×８画素のブロックサイズで入力された直
交変換係数の中から、低周波領域の４×４画素の係数だ
けを選択し、以後の符号化に用いるための係数制御信号
４５の例である。図において“１”の画素の係数は入力
係数が直接出力されるが、“０”の画素の係数は全てゼ
ロが出力される。このように高周波領域の係数を強制的
に削除することにより、発生符号量を削減する。図８は
８×８画素のブロックサイズで入力された直交変換係数
から、低周波成分を選択するときに図２で示したジグザ
グスキャンのスキャン方向に合わせて選択する例であ
る。図７と同様に“１”の部分の係数を選択し、“０”
の部分の係数は強制的にゼロにする。したがって、選択
範囲内の最後の非ゼロ係数以降の係数が全てスキャン方
向に合わせてゼロになるので、図７の例に比べて係数を
一次元にならび替えたときのゼロ係数の発生する割合が
少なくなり、符号の割り当てを容易に行うことができ
る。
【００１８】また、図６の構成における係数制御信号４
５は０〜１の値であればよい。例えば、低周波領域から
高周波領域に向かって係数制御信号の値を少しずつ小さ
くしていけば、画像ブロック内の各画素に対して重み付
けを行うことができる。これにより、高周波領域に重要
なデータが含まれている場合、重要データを削除するこ
となく符号変換が行える。
５は０〜１の値であればよい。例えば、低周波領域から
高周波領域に向かって係数制御信号の値を少しずつ小さ
くしていけば、画像ブロック内の各画素に対して重み付
けを行うことができる。これにより、高周波領域に重要
なデータが含まれている場合、重要データを削除するこ
となく符号変換が行える。
【００１９】図９は係数処理回路３３の構成を示すブロ
ック図の変形例である。係数処理回路３３に入力された
直交変換係数はメモリ３７に蓄えられる。スイッチ回路
３９は制御回路３２より与えられる係数制御信号４５に
従いスイッチの切り替えを行う。係数制御信号が“１”
のときスイッチ回路３９はメモリ回路３７の係数を出力
し、“０”のときはゼロを係数値として出力する。係数
制御信号４５に図７、および、図８で示す信号を用いる
と、図６の実施例と同様の出力を得ることができる。ま
た、この回路において係数制御信号４５の値が“０”の
ときのスイッチ回路３９の出力を禁止することにより、
符号化装置と復号化装置で画像ブロックのサイズが異な
るときのブロックサイズ変更が可能になる。例えば、図
７の制御パターンを用いたとき８×８画素で入力された
ブロックは４×４画素のブロックサイズで出力される。
ック図の変形例である。係数処理回路３３に入力された
直交変換係数はメモリ３７に蓄えられる。スイッチ回路
３９は制御回路３２より与えられる係数制御信号４５に
従いスイッチの切り替えを行う。係数制御信号が“１”
のときスイッチ回路３９はメモリ回路３７の係数を出力
し、“０”のときはゼロを係数値として出力する。係数
制御信号４５に図７、および、図８で示す信号を用いる
と、図６の実施例と同様の出力を得ることができる。ま
た、この回路において係数制御信号４５の値が“０”の
ときのスイッチ回路３９の出力を禁止することにより、
符号化装置と復号化装置で画像ブロックのサイズが異な
るときのブロックサイズ変更が可能になる。例えば、図
７の制御パターンを用いたとき８×８画素で入力された
ブロックは４×４画素のブロックサイズで出力される。
【００２０】
【発明の効果】本発明によれば、入力符号と復号化装置
の符号レートの相異を判定し、画像ブロック毎に直交変
換係数の制御を行うことによって、入力符号を復号化装
置に合わせた符号に変換して出力する。したがって、符
号レートの異なる符号化装置と復号化装置間での符号伝
送が可能になる。
の符号レートの相異を判定し、画像ブロック毎に直交変
換係数の制御を行うことによって、入力符号を復号化装
置に合わせた符号に変換して出力する。したがって、符
号レートの異なる符号化装置と復号化装置間での符号伝
送が可能になる。
【図１】従来の符号化装置の構成を示すブロック図。
【図２】ジグザグスキャンの方法を示す説明図。
【図３】従来の復号化装置の構成を示すブロック図。
【図４】従来の符号変換装置の構成を示すブロック図。
【図５】本発明の実施例を示すブロック図。
【図６】係数制御回路の構成を示すブロック図。
【図７】係数制御信号を示す説明図。
【図８】係数制御信号を示す説明図。
【図９】係数制御回路の構成を示すブロック図。
５…量子回路、６…符号回路、８…量子化制御回路、２
２…復号回路、２３…逆量子回路、３１…入力バッフ
ァ、３２…制御回路、３３…係数処理回路、３４…出力
バッファ、３５…スイッチ回路、４１…入力符号、４２
…出力符号、４３…出力パラメータ。
２…復号回路、２３…逆量子回路、３１…入力バッフ
ァ、３２…制御回路、３３…係数処理回路、３４…出力
バッファ、３５…スイッチ回路、４１…入力符号、４２
…出力符号、４３…出力パラメータ。
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｎ 1/41 Ｂ 9070−5Ｃ 1/415 9070−5Ｃ 7/30 Ｈ０４Ｎ 7/133 Ｚ
Claims (5)
- 【請求項１】入力された符号を復号化する手段と、復号
化された信号を逆量子化する手段と、入力符号と復号化
装置から得られるパラメータを用いて制御信号を発生す
る手段と、前記制御信号を用いて前記逆量子化された係
数信号を、ｎ×ｎ画素からなる画像ブロック毎に制御す
る手段と、前記制御された係数信号を量子化する手段
と、前記量子化された信号を符号化する手段と、前記符
号化された符号を蓄積する手段と、前記蓄積された符号
を用いて前記量子化を制御する手段と、前記蓄積された
符号と前記入力された符号とを、前記制御信号によって
切り替えて出力する手段とを備えたことを特徴とする符
号変換装置。 - 【請求項２】請求項１において、前記画像ブロック毎に
制御する手段は、ｎ×ｎ画素からなる画像ブロックの中
から、ｍ×ｍ画素（ｎ＞ｍ）の領域を抜き出して符号化
する符号変換装置。 - 【請求項３】請求項１において、前記画像ブロック毎に
制御する手段は、ｎ×ｎ画素からなる画像ブロックの中
から、画像ブロックのスキャン方向に応じたｍ画素を抜
き出して符号化する符号変換装置。 - 【請求項４】請求項１において、前記画像ブロック制御
手段は、ｎ×ｎ画素からなる画像ブロックのサイズをｍ
×ｍ画素からなる画像ブロックに変換した後、符号化す
る符号変換装置。 - 【請求項５】請求項１において、入力された信号を出力
符号として出力する符号変換装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5203888A JPH0759091A (ja) | 1993-08-18 | 1993-08-18 | 符号変換装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5203888A JPH0759091A (ja) | 1993-08-18 | 1993-08-18 | 符号変換装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0759091A true JPH0759091A (ja) | 1995-03-03 |
Family
ID=16481385
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5203888A Pending JPH0759091A (ja) | 1993-08-18 | 1993-08-18 | 符号変換装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0759091A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08265372A (ja) * | 1995-03-20 | 1996-10-11 | Nec Corp | テレビ会議システムおよびテレビ会議システム用ルータ装置 |
| US5754235A (en) * | 1994-03-25 | 1998-05-19 | Sanyo Electric Co., Ltd. | Bit-rate conversion circuit for a compressed motion video bitstream |
-
1993
- 1993-08-18 JP JP5203888A patent/JPH0759091A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5754235A (en) * | 1994-03-25 | 1998-05-19 | Sanyo Electric Co., Ltd. | Bit-rate conversion circuit for a compressed motion video bitstream |
| JPH08265372A (ja) * | 1995-03-20 | 1996-10-11 | Nec Corp | テレビ会議システムおよびテレビ会議システム用ルータ装置 |
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