JPH0748830B2 - 固体撮像装置 - Google Patents
固体撮像装置Info
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- JPH0748830B2 JPH0748830B2 JP1206146A JP20614689A JPH0748830B2 JP H0748830 B2 JPH0748830 B2 JP H0748830B2 JP 1206146 A JP1206146 A JP 1206146A JP 20614689 A JP20614689 A JP 20614689A JP H0748830 B2 JPH0748830 B2 JP H0748830B2
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- clock
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Description
【発明の詳細な説明】 （イ）産業上の利用分野 本発明は、映像信号の波形整形回路としてサンプルホー
ルド回路を備えた固体撮像装置に関する。
ルド回路を備えた固体撮像装置に関する。
（ロ）従来の技術 固体撮像装置に搭載されるCCD固体撮像素子に於いて
は、CCDの水平レジスタから一画素毎に転送出力される
情報電荷がコンデンサに蓄積されて電圧値に変換され、
映像情報を示すレベルと基準レベルとを交互に繰り返す
映像信号が出力される。即ち、情報電荷として負電荷が
蓄積される場合、水平レジスタの出力部に設けたコンデ
ンサを水平レジスタの駆動クロックに同期して予め所定
のレベルにまでプリチャージし、そのコンデンサを情報
電荷量に応じて放電させることによりコンデンサの両端
に情報電荷に応じた電圧が得られるように構成される。
は、CCDの水平レジスタから一画素毎に転送出力される
情報電荷がコンデンサに蓄積されて電圧値に変換され、
映像情報を示すレベルと基準レベルとを交互に繰り返す
映像信号が出力される。即ち、情報電荷として負電荷が
蓄積される場合、水平レジスタの出力部に設けたコンデ
ンサを水平レジスタの駆動クロックに同期して予め所定
のレベルにまでプリチャージし、そのコンデンサを情報
電荷量に応じて放電させることによりコンデンサの両端
に情報電荷に応じた電圧が得られるように構成される。
ところが、コンデンサをプリチャージする際、プリチャ
ージパルスに混入する雑音や、電源自体に含まれる雑音
等に依ってプリチャージレベルが変動して映像情報レベ
ルの変動を招く虞れがあり、それらの雑音を除去するこ
とが望まれる。
ージパルスに混入する雑音や、電源自体に含まれる雑音
等に依ってプリチャージレベルが変動して映像情報レベ
ルの変動を招く虞れがあり、それらの雑音を除去するこ
とが望まれる。
第３図は、上述の如きプリチャージ動作時の雑音の除去
回路を備えた固体撮像装置のブロック図であり、第４図
はその動作タイミング図である。CCD固体撮像素子
（１）は、光電変換に依って発生する光電荷を情報電荷
として受光部に定期間蓄積し、この情報電荷を転送クロ
ック発生回路（２）からの垂直転送クロックφＶに依り
垂直方向に転送して水平レジスタに移すと共に、水平転
送クロックφＨに依り水平方向に転送して水平レジスタ
から水平ライン毎に出力するもので、水平レジスタの出
力側には、情報電荷量を電圧値に変換するコンデンサ及
びこのコンデンサをプリチャージするためのスイッチン
グトランジスタからなる出力部が設けられている。この
出力部では、水平転送クロックφＨに同期してプリチャ
ージ期間TPにコンデンサが基準レベルE0までプリチャー
ジされ、ディスチャージ期間TDに情報電荷がコンデンサ
に入力されることでコンデンサが放電されて情報電荷量
に応じたレベルＥとなる。そして、以上の動作を繰り返
し、第４図の如き信号レベルＥと基準レベルE0とが交互
に連続する映像信号Ｘ（ｔ）を出力する。
回路を備えた固体撮像装置のブロック図であり、第４図
はその動作タイミング図である。CCD固体撮像素子
（１）は、光電変換に依って発生する光電荷を情報電荷
として受光部に定期間蓄積し、この情報電荷を転送クロ
ック発生回路（２）からの垂直転送クロックφＶに依り
垂直方向に転送して水平レジスタに移すと共に、水平転
送クロックφＨに依り水平方向に転送して水平レジスタ
から水平ライン毎に出力するもので、水平レジスタの出
力側には、情報電荷量を電圧値に変換するコンデンサ及
びこのコンデンサをプリチャージするためのスイッチン
グトランジスタからなる出力部が設けられている。この
出力部では、水平転送クロックφＨに同期してプリチャ
ージ期間TPにコンデンサが基準レベルE0までプリチャー
ジされ、ディスチャージ期間TDに情報電荷がコンデンサ
に入力されることでコンデンサが放電されて情報電荷量
に応じたレベルＥとなる。そして、以上の動作を繰り返
し、第４図の如き信号レベルＥと基準レベルE0とが交互
に連続する映像信号Ｘ（ｔ）を出力する。
CCD（１）から得られる映像信号Ｘ（ｔ）は、サンプル
ホールド回路（3a）に入力され、水平転送クロックφＨ
と同一周期、即ち映像信号Ｘ（ｔ）と同一の周期でディ
スチャージ期間TDに同期するサンプリングクロックSC1
に従って情報電荷レベルＥがサンプルホールドされる。
このサンプリングクロックSC1は、サンプリングクロッ
ク発生回路（５）で作成されるもので、そのサンプリン
グクロック発生回路（５）の動作が転送クロック発生回
路（２）に同期させられる。そして、ホールド出力Ｘ
（ｔ）は、差動アンプ（４）の反転入力に供給される。
ホールド回路（3a）に入力され、水平転送クロックφＨ
と同一周期、即ち映像信号Ｘ（ｔ）と同一の周期でディ
スチャージ期間TDに同期するサンプリングクロックSC1
に従って情報電荷レベルＥがサンプルホールドされる。
このサンプリングクロックSC1は、サンプリングクロッ
ク発生回路（５）で作成されるもので、そのサンプリン
グクロック発生回路（５）の動作が転送クロック発生回
路（２）に同期させられる。そして、ホールド出力Ｘ
（ｔ）は、差動アンプ（４）の反転入力に供給される。
また、映像信号Ｘ（ｔ）は、サンプルホールド回路（3
b）に入力され、サンプリングクロックSC1と同様にサン
プリングクロック発生回路（５）で作成され、サンプリ
ングクロックSC1と同一周期でプリチャージ期間TDに同
期するサンプリングクロックSC2に従って基準レベルE0
がサンプルホールドされる。そして、ホールド出力X
2（ｔ）はサンプルホールド回路（3c）に入力されてサ
ンプリングクロックSC1に従ってサンプルホールドさ
れ、そのホールド出力X2′（ｔ）が差動アンプ（４）の
非反転入力に供給される。
b）に入力され、サンプリングクロックSC1と同様にサン
プリングクロック発生回路（５）で作成され、サンプリ
ングクロックSC1と同一周期でプリチャージ期間TDに同
期するサンプリングクロックSC2に従って基準レベルE0
がサンプルホールドされる。そして、ホールド出力X
2（ｔ）はサンプルホールド回路（3c）に入力されてサ
ンプリングクロックSC1に従ってサンプルホールドさ
れ、そのホールド出力X2′（ｔ）が差動アンプ（４）の
非反転入力に供給される。
サンプルホールド回路（3a）のホールド出力X1（ｔ）
は、ディスチャージ期間TDのサンプルホールド値であ
り、本来の情報電荷成分と雑音成分との和を表し、一
方、サンプルホールド回路（3b）のホールド出力X
2（ｔ）はプリチャージ期間TPのサンプルホールド値で
あり、雑音成分のみを表す。そこで、サンプルホールド
回路（3c）でホールド値X2（ｔ）の位相をホールド値X1
（ｔ）に一致させ、両ホールド値X1（ｔ）,X2′（ｔ）
の差をとることで情報電荷成分のみの映像信号Ｘ（ｔ）
を得ている。
は、ディスチャージ期間TDのサンプルホールド値であ
り、本来の情報電荷成分と雑音成分との和を表し、一
方、サンプルホールド回路（3b）のホールド出力X
2（ｔ）はプリチャージ期間TPのサンプルホールド値で
あり、雑音成分のみを表す。そこで、サンプルホールド
回路（3c）でホールド値X2（ｔ）の位相をホールド値X1
（ｔ）に一致させ、両ホールド値X1（ｔ）,X2′（ｔ）
の差をとることで情報電荷成分のみの映像信号Ｘ（ｔ）
を得ている。
ところで、上述の如き固体撮像装置に於いて、電子シャ
ッタ動作を行う場合、蓄積期間の途中でそれまで蓄積し
た光電荷を排出し、残余の蓄積期間に得られる光電荷を
情報電荷として用いるように構成される。例えば本出願
人に依る特開昭63−24764号公報に於いては、垂直走査
期間の途中で光電荷を読出方向とは反対の方向に転送し
て排出し、残りの垂直走査期間に光電荷を蓄積してい
る。このような光電荷の排出は、CCD（１）の出力部等
に雑音を発生させるため、映像信号Ｘ（ｔ）のブランキ
ング期間内に光電荷の排出を行い映像信号Ｘ（ｔ）への
雑音の重畳を防止している。
ッタ動作を行う場合、蓄積期間の途中でそれまで蓄積し
た光電荷を排出し、残余の蓄積期間に得られる光電荷を
情報電荷として用いるように構成される。例えば本出願
人に依る特開昭63−24764号公報に於いては、垂直走査
期間の途中で光電荷を読出方向とは反対の方向に転送し
て排出し、残りの垂直走査期間に光電荷を蓄積してい
る。このような光電荷の排出は、CCD（１）の出力部等
に雑音を発生させるため、映像信号Ｘ（ｔ）のブランキ
ング期間内に光電荷の排出を行い映像信号Ｘ（ｔ）への
雑音の重畳を防止している。
（ハ）発明が解決しようとする課題 しかしながら、映像信号Ｘ（ｔ）のブランキング期間に
は、各種信号処理のタイミングパルスが設定されている
ために、ブランキング期間に大きな雑音が重畳すると信
号処理動作が正常に働かなくなる。従って、ブランキン
グ期間内の雑音に対しても、誤動作を防止できる程度に
まで抑圧する必要が生じる。一般的には、信号処理の前
段階にクリップ回路を付加するか、或いはサンプルホー
ルド回路（3a）（3b）及び（3c）のサンプリングを停止
すること等に依ってブランキング期間中の雑音が抑圧さ
れるが、クロック回路の付加は回路規模が増大して部品
数の増加を招くため好ましくない。また、サンプリング
を停止するには、サンプルホールド回路の構成上困難で
ある。即ち、サンプルホールド回路のホールドトランジ
スタにFETを用いる必要が生じるため、信号処理回路を
構成するバイポーラ型の集積回路に組み込むことができ
ず、ワンチップで構成ができない。
は、各種信号処理のタイミングパルスが設定されている
ために、ブランキング期間に大きな雑音が重畳すると信
号処理動作が正常に働かなくなる。従って、ブランキン
グ期間内の雑音に対しても、誤動作を防止できる程度に
まで抑圧する必要が生じる。一般的には、信号処理の前
段階にクリップ回路を付加するか、或いはサンプルホー
ルド回路（3a）（3b）及び（3c）のサンプリングを停止
すること等に依ってブランキング期間中の雑音が抑圧さ
れるが、クロック回路の付加は回路規模が増大して部品
数の増加を招くため好ましくない。また、サンプリング
を停止するには、サンプルホールド回路の構成上困難で
ある。即ち、サンプルホールド回路のホールドトランジ
スタにFETを用いる必要が生じるため、信号処理回路を
構成するバイポーラ型の集積回路に組み込むことができ
ず、ワンチップで構成ができない。
そこで本発明は、光電荷の排出駆動に伴う雑音を有効に
抑圧し、信号処理回路の誤動作を防止することを目的と
する。
抑圧し、信号処理回路の誤動作を防止することを目的と
する。
（ニ）課題を解決するための手段 本発明は上述の課題を解決するためになされたもので、
平行に配列された複数の垂直レジスタの各出力が水平レ
ジスタの各段に対応付けられると共に、上記水平レジス
タの転送周波数と同一周波数のプリチャージパルスに従
って所定レベルまでプリチャージされて基準電圧を発生
し続いて上記水平レジスタの出力電荷量に基づいて充放
電されて信号電圧を発生する電圧変換手段が上記水平レ
ジスタの出力側に設けられた固体撮像素子、この固体撮
像素子の出力をサンプリングクロックに従ってサンプル
ホールドする第１及び第２のサンプルホールド回路、こ
の第２のサンプルホールド回路の出力をサンプリングク
ロックに従ってサンプルホールドする第３のサンプルホ
ールド回路、上記電圧変換手段の充放電期間毎に信号電
圧をサンプルホールドせしめる第１のサンプリングクロ
ックと上記電圧変換手段のプリチャージ期間毎に基準電
圧をサンプルホールドせしめる第２のサンプリングクロ
ックとを発生するクロック発生手段、上記第１のサンプ
リングクロックを上記第１及び第３のサンプルホールド
回路に供給すると共に、上記第１或いは第２のサンプリ
ングクロックを選択的に上記第２のサンプルホールド回
路に供給するクロック選択手段、上記第１及び第３のサ
ンプルホールド回路の出力が供給される差動増幅器、を
備え、上記垂直レジスタ中を電荷が高速に転送される期
間に上記第１のサンプリングクロックを上記第２のサン
プルホールド回路に供給し、残余の期間に上記第２のサ
ンプリングクロックを上記第２のサンプルホールド回路
に供給することを特徴とする。
平行に配列された複数の垂直レジスタの各出力が水平レ
ジスタの各段に対応付けられると共に、上記水平レジス
タの転送周波数と同一周波数のプリチャージパルスに従
って所定レベルまでプリチャージされて基準電圧を発生
し続いて上記水平レジスタの出力電荷量に基づいて充放
電されて信号電圧を発生する電圧変換手段が上記水平レ
ジスタの出力側に設けられた固体撮像素子、この固体撮
像素子の出力をサンプリングクロックに従ってサンプル
ホールドする第１及び第２のサンプルホールド回路、こ
の第２のサンプルホールド回路の出力をサンプリングク
ロックに従ってサンプルホールドする第３のサンプルホ
ールド回路、上記電圧変換手段の充放電期間毎に信号電
圧をサンプルホールドせしめる第１のサンプリングクロ
ックと上記電圧変換手段のプリチャージ期間毎に基準電
圧をサンプルホールドせしめる第２のサンプリングクロ
ックとを発生するクロック発生手段、上記第１のサンプ
リングクロックを上記第１及び第３のサンプルホールド
回路に供給すると共に、上記第１或いは第２のサンプリ
ングクロックを選択的に上記第２のサンプルホールド回
路に供給するクロック選択手段、上記第１及び第３のサ
ンプルホールド回路の出力が供給される差動増幅器、を
備え、上記垂直レジスタ中を電荷が高速に転送される期
間に上記第１のサンプリングクロックを上記第２のサン
プルホールド回路に供給し、残余の期間に上記第２のサ
ンプリングクロックを上記第２のサンプルホールド回路
に供給することを特徴とする。
そして、クロック選択手段を上記第１或いは第２のサン
プリングクロックを選択的に上記第１及び第３のサンプ
ルホールド回路に供給すると共に上記第２のサンプリン
グクロックを上記第２のサンプルホールド回路に供給す
るものとし、上記垂直レジスタ中を電荷が高速に転送さ
れている期間に上記第２のサンプリングクロックを上記
第１及び第３のサンプルホールド回路に供給し、残余の
期間に上記第１のサンプリングクロックを上記第１及び
第３のサンプルホールド回路に供給することを第２の特
徴とする。
プリングクロックを選択的に上記第１及び第３のサンプ
ルホールド回路に供給すると共に上記第２のサンプリン
グクロックを上記第２のサンプルホールド回路に供給す
るものとし、上記垂直レジスタ中を電荷が高速に転送さ
れている期間に上記第２のサンプリングクロックを上記
第１及び第３のサンプルホールド回路に供給し、残余の
期間に上記第１のサンプリングクロックを上記第１及び
第３のサンプルホールド回路に供給することを第２の特
徴とする。
（ホ）作 用 本発明に依れば、映像信号に雑音の重畳し易い期間、即
ち電荷を高速で垂直方向に転送する期間に、各サンプル
ホールド回路のサンプルホールドのタイミングを一致さ
せることで、第１及び第３のサンプルホールド回路の出
力が同一波形となり、差動増幅器に於いて両出力がキャ
ンセルされ、雑音が抑圧される。
ち電荷を高速で垂直方向に転送する期間に、各サンプル
ホールド回路のサンプルホールドのタイミングを一致さ
せることで、第１及び第３のサンプルホールド回路の出
力が同一波形となり、差動増幅器に於いて両出力がキャ
ンセルされ、雑音が抑圧される。
（ヘ）実施例 本発明の一実施例を図面に依って説明する。
第１図は本発明固体撮像装置のブロック図である。この
図に於いて、CCD（１）、転送クロック発生回路
（２）、サンプリングクロック発生回路（５）及びサン
プルホールド回路（3a）（3b）（3c）は第３図と同一で
あり、同一部分には同一符号が付してある。
図に於いて、CCD（１）、転送クロック発生回路
（２）、サンプリングクロック発生回路（５）及びサン
プルホールド回路（3a）（3b）（3c）は第３図と同一で
あり、同一部分には同一符号が付してある。
本発明の特徴とするところは、サンプルホールド回路
（3b）にサンプリングクロックSC1,SC2を選択的に供給
することにある。即ち、サンプルホールド回路（3b）に
は選択回路（10）で選択されたサンプリングクロックが
供給されるように構成されており、選択回路（10）の選
択動作が選択制御回路（11）の発生する選択パルスCPに
従って制御される。選択回路（10）は、例えば入力の一
方にサンプリングクロックSC1,SC2が夫々入力され、入
力の他方には選択パルスCPとその反転パルス▲▼と
が夫々入力される２つのANDゲート（12）（13）と、両
アンドゲート（12）（13）の出力が入力されるORゲート
（14）とからなり、選択パルスCPが“1"のときにはサン
プリングクロックSC2を出力し、“0"のときにはサンプ
リングクロックSC1を出力する。選択制御回路（11）
は、転送クロック発生回路（２）からのタイミングパル
スTPに従って動作し、転送クロック発生回路（２）のク
ロックパルスの発生する期間に選択パルスCPを“0"とす
る。
（3b）にサンプリングクロックSC1,SC2を選択的に供給
することにある。即ち、サンプルホールド回路（3b）に
は選択回路（10）で選択されたサンプリングクロックが
供給されるように構成されており、選択回路（10）の選
択動作が選択制御回路（11）の発生する選択パルスCPに
従って制御される。選択回路（10）は、例えば入力の一
方にサンプリングクロックSC1,SC2が夫々入力され、入
力の他方には選択パルスCPとその反転パルス▲▼と
が夫々入力される２つのANDゲート（12）（13）と、両
アンドゲート（12）（13）の出力が入力されるORゲート
（14）とからなり、選択パルスCPが“1"のときにはサン
プリングクロックSC2を出力し、“0"のときにはサンプ
リングクロックSC1を出力する。選択制御回路（11）
は、転送クロック発生回路（２）からのタイミングパル
スTPに従って動作し、転送クロック発生回路（２）のク
ロックパルスの発生する期間に選択パルスCPを“0"とす
る。
第２図は、第１図に示す固体撮像装置に電子シャッタ動
作をさせる場合のタイミング図であり、フレームトラン
スファ方式の場合を示す。この図に於いて、VD及びHDは
夫々CCD（１）の垂直走査信号及び水平走査信号であ
る。読出転送クロックφVFは、CCD（１）の撮像部の電
荷を垂直方向に転送して蓄積部に移すもので、垂直走査
信号VDのブランキング期間中にクロックパルスを発生す
る。そして、排出転送クロックφVBは、CCD（１）の撮
像部の電荷を読出方向とは反対の方向に転送して排出さ
せるもので、垂直走査信号VDの１周期の所定のタイミン
グで水平走査信号HDのブランキング期間にクロックパル
スを発生する。このクロックパルスの発生タイミング
は、垂直走査信号VDの１周期内で、水平走査信号HDの１
周期を１ステップとして可変設定され、排出転送クロッ
クφVBのクロックパルスの発生タイミングから読出転送
クロックφVFのクロックパルスの発生タイミングまでの
期間Ｌが光電荷の蓄積期間となる。即ち、排出転送クロ
ックφVBのクロックパルスの発生タイミングを遅らせれ
ばシャッタ速度は速くなり、逆に早めるとシャッタ速度
が遅くなる。
作をさせる場合のタイミング図であり、フレームトラン
スファ方式の場合を示す。この図に於いて、VD及びHDは
夫々CCD（１）の垂直走査信号及び水平走査信号であ
る。読出転送クロックφVFは、CCD（１）の撮像部の電
荷を垂直方向に転送して蓄積部に移すもので、垂直走査
信号VDのブランキング期間中にクロックパルスを発生す
る。そして、排出転送クロックφVBは、CCD（１）の撮
像部の電荷を読出方向とは反対の方向に転送して排出さ
せるもので、垂直走査信号VDの１周期の所定のタイミン
グで水平走査信号HDのブランキング期間にクロックパル
スを発生する。このクロックパルスの発生タイミング
は、垂直走査信号VDの１周期内で、水平走査信号HDの１
周期を１ステップとして可変設定され、排出転送クロッ
クφVBのクロックパルスの発生タイミングから読出転送
クロックφVFのクロックパルスの発生タイミングまでの
期間Ｌが光電荷の蓄積期間となる。即ち、排出転送クロ
ックφVBのクロックパルスの発生タイミングを遅らせれ
ばシャッタ速度は速くなり、逆に早めるとシャッタ速度
が遅くなる。
選択パルスCPは、各転送クロックφVF,φVBのクロック
パルスの発生に同期して“1"から“0"となり、サンプル
ホールド回路（3b）にサンプリングクロックSC1を供給
せしめる。この選択パルスCPが“0"となる期間は、垂直
走査信号VDのブランキング期間及び水平走査信号HDのブ
ランキング期間内に納められている。
パルスの発生に同期して“1"から“0"となり、サンプル
ホールド回路（3b）にサンプリングクロックSC1を供給
せしめる。この選択パルスCPが“0"となる期間は、垂直
走査信号VDのブランキング期間及び水平走査信号HDのブ
ランキング期間内に納められている。
従って、CCD（１）の撮像部の光電荷が蓄積部に転送さ
れる期間と排出される期間とにはCCD（１）の出力する
映像信号Ｘ（ｔ）が各サンプルホールド回路に同一タイ
ミングでサンプルホールドされ、差動アンプ（４）でキ
ャンセルされて出力Ｙ（ｔ）が消えるため、映像信号Ｘ
（ｔ）に重畳した転送雑音が抑圧される。
れる期間と排出される期間とにはCCD（１）の出力する
映像信号Ｘ（ｔ）が各サンプルホールド回路に同一タイ
ミングでサンプルホールドされ、差動アンプ（４）でキ
ャンセルされて出力Ｙ（ｔ）が消えるため、映像信号Ｘ
（ｔ）に重畳した転送雑音が抑圧される。
尚、本実施例に於いては、サンプルホールド回路（3b）
にサンプリングクロックSC1,SC2を選択的に供給する場
合を例示したが、サンプルホールド回路（3b）にはサン
プリングクロックSC2を供給し、サンプルホールド回路
（3a）（3c）にサンプリングクロックSC1,SC2を選択的
に供給するように構成することもできる。
にサンプリングクロックSC1,SC2を選択的に供給する場
合を例示したが、サンプルホールド回路（3b）にはサン
プリングクロックSC2を供給し、サンプルホールド回路
（3a）（3c）にサンプリングクロックSC1,SC2を選択的
に供給するように構成することもできる。
（ト）発明の効果 本発明に依れば、クロック回路等を付加することなく、
従来より備えているサンプルホールド回路を用い、電荷
を垂直転送する際に発生する雑音を有効に除去すること
ができ、固体撮像素子から得られる映像信号の処理回路
の誤動作を防止でき、安定した信号処理動作が望める。
従来より備えているサンプルホールド回路を用い、電荷
を垂直転送する際に発生する雑音を有効に除去すること
ができ、固体撮像素子から得られる映像信号の処理回路
の誤動作を防止でき、安定した信号処理動作が望める。
第１図は本発明固体撮像装置のブロック図、第２図は第
１図の固体撮像装置に電子シャッタ動作をさせる場合の
タイミング図、第３図は従来の固体撮像装置のブロック
図、第４図はその動作を示すタイミング図である。 （１）……CCD固体撮像素子、（２）……転送クロック
発生回路、（3a）（3b）（3c）……サンプルホールド回
路、（４）……差動アンプ、（５）……サンプリングク
ロック発生回路、（10）……選択回路、（11）……選択
制御回路。
１図の固体撮像装置に電子シャッタ動作をさせる場合の
タイミング図、第３図は従来の固体撮像装置のブロック
図、第４図はその動作を示すタイミング図である。 （１）……CCD固体撮像素子、（２）……転送クロック
発生回路、（3a）（3b）（3c）……サンプルホールド回
路、（４）……差動アンプ、（５）……サンプリングク
ロック発生回路、（10）……選択回路、（11）……選択
制御回路。
Claims (1)
- 【請求項１】平行に配列された複数の垂直レジスタの各
出力が水平レジスタの各段に対応付けられると共に、上
記水平レジスタの転送周波数と同一周波数のプリチャー
ジパルスに従って所定レベルまでプリチャージされて基
準電圧を発生し、続いて上記水平レジスタの出力電荷量
に基づいて充放電されて信号電圧を発生する電圧変換手
段が上記水平レジスタの出力側に設けられた固体撮像素
子、この固体撮像素子の出力をサンプリングクロックに
従ってサンプルホールドする第１及び第２のサンプルホ
ールド回路、この第２のサンプルホールド回路の出力を
サンプリングクロックに従ってサンプルホールドする第
３のサンプルホールド回路、上記電圧変換手段の充放電
期間毎に信号電圧をサンプルホールドせしめる第１のサ
ンプリングクロックと上記電圧変換手段のプリチャージ
期間毎に基準電圧をサンプルホールドせしめる第２のサ
ンプリングクロックとを発生するクロック発生手段、上
記第１のサンプリングクロックを上記第１及び第３のサ
ンプルホールド回路に供給すると共に、上記第１或いは
第２のサンプリングクロックを選択的に上記第２のサン
プルホールド回路に供給するクロック選択手段、上記第
１及び第３のサンプルホールド回路の出力が供給される
差動増幅器、を備え、 上記垂直レジスタ中を電荷が高速に転送される期間に上
記第１のサンプリングクロックを上記第２のサンプルホ
ールド回路に供給し、残余の期間に上記第２のサンプリ
ングクロックを上記第２のサンプルホールド回路に供給
することを特徴とする固体撮像装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1206146A JPH0748830B2 (ja) | 1989-08-09 | 1989-08-09 | 固体撮像装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1206146A JPH0748830B2 (ja) | 1989-08-09 | 1989-08-09 | 固体撮像装置 |
Publications (2)
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| JPH0370277A JPH0370277A (ja) | 1991-03-26 |
| JPH0748830B2 true JPH0748830B2 (ja) | 1995-05-24 |
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ID=16518554
Family Applications (1)
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1989
- 1989-08-09 JP JP1206146A patent/JPH0748830B2/ja not_active Expired - Fee Related
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| JPH0370277A (ja) | 1991-03-26 |
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