JPH07250266A - 映像信号処理装置 - Google Patents
映像信号処理装置Info
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- JPH07250266A JPH07250266A JP6039773A JP3977394A JPH07250266A JP H07250266 A JPH07250266 A JP H07250266A JP 6039773 A JP6039773 A JP 6039773A JP 3977394 A JP3977394 A JP 3977394A JP H07250266 A JPH07250266 A JP H07250266A
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- Japan
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- signal processing
- video
- circuit
- video data
- video signal
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Abstract
(57)【要約】
【目的】 映像信号の映像期間にノイズが混入しないよ
うにする。 【構成】 映像信号Ｙ2(t)がＡ／Ｄ変換回路１２で映像
データＹＤ1に変換されてラインメモリ１３に記憶され
る。ラインメモリ１３から読み出される映像データＹＤ
1は、クランプ回路１５に入力され、色信号処理回路１
６及び輝度信号処理回路１７で所定の処理が施された後
にエンコーダ回路１８に入力される。エンコーダ回路１
８から出力される映像データＹＤ2は、Ｄ／Ａ変換回路
１９で映像信号Ｙ3(t)に変換されて出力される。ライン
メモリ１３の映像データＹＤ1の読み出しのタイミング
は、書き込みのタイミングに対して水平走査期間よりク
ランプ回路１５からエンコーダ回路１８までの信号処理
で生じる遅延分だけ短い期間遅れて設定される。
うにする。 【構成】 映像信号Ｙ2(t)がＡ／Ｄ変換回路１２で映像
データＹＤ1に変換されてラインメモリ１３に記憶され
る。ラインメモリ１３から読み出される映像データＹＤ
1は、クランプ回路１５に入力され、色信号処理回路１
６及び輝度信号処理回路１７で所定の処理が施された後
にエンコーダ回路１８に入力される。エンコーダ回路１
８から出力される映像データＹＤ2は、Ｄ／Ａ変換回路
１９で映像信号Ｙ3(t)に変換されて出力される。ライン
メモリ１３の映像データＹＤ1の読み出しのタイミング
は、書き込みのタイミングに対して水平走査期間よりク
ランプ回路１５からエンコーダ回路１８までの信号処理
で生じる遅延分だけ短い期間遅れて設定される。
Description
【０００１】
【産業上の利用分野】本発明は、固体撮像素子から得ら
れる映像信号をデジタルデータに変換して各種の信号処
理を施す映像信号処理装置に関する。
れる映像信号をデジタルデータに変換して各種の信号処
理を施す映像信号処理装置に関する。
【０００２】
【従来の技術】ＣＣＤ固体撮像素子を用いたテレビカメ
ラ等の撮像装置では、撮像素子にクロックパルスを与え
て駆動する駆動回路と共に、撮像素子の出力に対して各
種の信号処理を施して所定のフォーマットに従う映像信
号を生成する映像信号処理回路が設けられる。このよう
な映像信号処理回路の場合、各種処理の条件設定を簡素
化するため、アナログ信号処理からデジタル信号処理へ
の移行が進められている。特に、カラー映像信号を取り
扱う際には、ホワイトバランスの調整や高輝度擬信号の
抑圧等信号処理条件の設定項目が多くなり、信号処理の
デジタル化によって条件設定を大幅に簡素化することが
できる。
ラ等の撮像装置では、撮像素子にクロックパルスを与え
て駆動する駆動回路と共に、撮像素子の出力に対して各
種の信号処理を施して所定のフォーマットに従う映像信
号を生成する映像信号処理回路が設けられる。このよう
な映像信号処理回路の場合、各種処理の条件設定を簡素
化するため、アナログ信号処理からデジタル信号処理へ
の移行が進められている。特に、カラー映像信号を取り
扱う際には、ホワイトバランスの調整や高輝度擬信号の
抑圧等信号処理条件の設定項目が多くなり、信号処理の
デジタル化によって条件設定を大幅に簡素化することが
できる。
【０００３】図４は、映像信号処理の一部をデジタル化
した撮像装置の構成を示すブロック図である。撮像素子
１は、行列配置された複数の受光画素を有し、各受光画
素に発生する情報電荷が駆動クロックφV、φHにより転
送出力されて各受光画素の情報電荷量に対応した映像信
号Ｙ1(t)を１画面単位で出力する。また、カラー映像を
得る際には、各受光画素がそれぞれ三原色（赤、緑、
青）またはその補色（黄、マゼンダ、シアン）のカラー
フィルタに対応付けられ、各受光画素に所定の色成分を
表す情報電荷が蓄積される。タイミングパルス生成回路
２は、基準クロックに基づいて水平走査周期及び垂直走
査周期のタイミングパルスＶＤ、ＨＤを発生し、ドライ
バ３に与える。ドライバ３は、タイミングパルス発生回
路２から供給されるタイミングパルスＶＤ、ＨＤに応答
して固体撮像素子１に垂直転送及び水平転送のための多
相の駆動クロックφV、φHを供給する。これにより、撮
像素子は、垂直走査の始まで１画面分の情報電荷の転送
出力を開始すると共に、水平走査の始まりで１水平ライ
ンの情報電荷の転送出力を開始することになる。
した撮像装置の構成を示すブロック図である。撮像素子
１は、行列配置された複数の受光画素を有し、各受光画
素に発生する情報電荷が駆動クロックφV、φHにより転
送出力されて各受光画素の情報電荷量に対応した映像信
号Ｙ1(t)を１画面単位で出力する。また、カラー映像を
得る際には、各受光画素がそれぞれ三原色（赤、緑、
青）またはその補色（黄、マゼンダ、シアン）のカラー
フィルタに対応付けられ、各受光画素に所定の色成分を
表す情報電荷が蓄積される。タイミングパルス生成回路
２は、基準クロックに基づいて水平走査周期及び垂直走
査周期のタイミングパルスＶＤ、ＨＤを発生し、ドライ
バ３に与える。ドライバ３は、タイミングパルス発生回
路２から供給されるタイミングパルスＶＤ、ＨＤに応答
して固体撮像素子１に垂直転送及び水平転送のための多
相の駆動クロックφV、φHを供給する。これにより、撮
像素子は、垂直走査の始まで１画面分の情報電荷の転送
出力を開始すると共に、水平走査の始まりで１水平ライ
ンの情報電荷の転送出力を開始することになる。
【０００４】アナログ信号処理部４は、主に、撮像素子
１から出力される映像信号Ｙ1(t)に対するサンプリング
処理、信号レベルの平均を一定に維持する利得制御処理
及び映像信号の再生側での信号レベルに対する発光輝度
の非線形性に対応させるためのガンマ補正処理を行い、
映像信号Ｙ2(t)を出力する。Ａ／Ｄ変換回路５は、アナ
ログ信号処理部４から出力される映像信号Ｙ2(t)をデジ
タルデータに変換し、各受光画素毎の映像情報に対応す
る映像データＹＤ1を出力する。デジタル信号処理部６
は、Ａ／Ｄ変換回路５から出力される映像データＹＤ1
に対し、色成分毎に分離する色分離処理、ホワイトバラ
ンス調整のための各色成分毎の増幅処理等を行い、映像
データＹＤ2を出力する。このデジタル信号処理部６に
おいては、各種同期信号に対応したデータの合成も行わ
れる。Ｄ／Ａ変換回路７は、デジタル信号処理部６から
出力される映像データＹＤ2をアナログ値に変換し、所
定のフォーマットに従う映像信号Ｙ3(t)を出力する。そ
して、制御マイコン８は、アナログ信号処理部４での利
得制御の基準レベル設定やデジタル信号処理部６でのホ
ワイトバランス制御の条件設定等を行う。同時に、制御
マイコン８は、各信号処理部４、６から得られる信号レ
ベル情報に基づいて、タイミングパルス生成回路２の動
作タイミングを制御することにより、撮像素子１のアイ
リス制御を行う。撮像素子１のアイリス制御は、撮像素
子１に１画面分の情報電荷が蓄積される時間を出力信号
の平均レベルに応答して伸縮することにより実現され
る。
１から出力される映像信号Ｙ1(t)に対するサンプリング
処理、信号レベルの平均を一定に維持する利得制御処理
及び映像信号の再生側での信号レベルに対する発光輝度
の非線形性に対応させるためのガンマ補正処理を行い、
映像信号Ｙ2(t)を出力する。Ａ／Ｄ変換回路５は、アナ
ログ信号処理部４から出力される映像信号Ｙ2(t)をデジ
タルデータに変換し、各受光画素毎の映像情報に対応す
る映像データＹＤ1を出力する。デジタル信号処理部６
は、Ａ／Ｄ変換回路５から出力される映像データＹＤ1
に対し、色成分毎に分離する色分離処理、ホワイトバラ
ンス調整のための各色成分毎の増幅処理等を行い、映像
データＹＤ2を出力する。このデジタル信号処理部６に
おいては、各種同期信号に対応したデータの合成も行わ
れる。Ｄ／Ａ変換回路７は、デジタル信号処理部６から
出力される映像データＹＤ2をアナログ値に変換し、所
定のフォーマットに従う映像信号Ｙ3(t)を出力する。そ
して、制御マイコン８は、アナログ信号処理部４での利
得制御の基準レベル設定やデジタル信号処理部６でのホ
ワイトバランス制御の条件設定等を行う。同時に、制御
マイコン８は、各信号処理部４、６から得られる信号レ
ベル情報に基づいて、タイミングパルス生成回路２の動
作タイミングを制御することにより、撮像素子１のアイ
リス制御を行う。撮像素子１のアイリス制御は、撮像素
子１に１画面分の情報電荷が蓄積される時間を出力信号
の平均レベルに応答して伸縮することにより実現され
る。
【０００５】Ｄ／Ａ変換回路７から出力される映像信号
Ｙ3(t)は、図５に示すように、１水平ライン単位で連続
しており、各水平ラインの信号の間には水平走査の帰線
消去期間となる水平ブランキング期間が設定される。再
生側において画面上に現れない水平ブランキング期間に
は、再生側の水平走査のタイミングを映像信号に同期さ
せる水平同期信号が重畳され、カラー映像信号の場合に
は、さらにカラーバーストと称される色同期信号が重畳
される。また、水平ラインの信号が水平走査線の数だけ
連続すると、映像信号Ｙ1(t)は次の画面に切り換わり、
その切り換わりを示す期間には垂直走査の帰線消去期間
となる垂直ブランキング期間が設定される。この垂直ブ
ランキング期間にも、水平ブランキング期間と同様に、
垂直同期信号や等価パルスが重畳されることになる。
Ｙ3(t)は、図５に示すように、１水平ライン単位で連続
しており、各水平ラインの信号の間には水平走査の帰線
消去期間となる水平ブランキング期間が設定される。再
生側において画面上に現れない水平ブランキング期間に
は、再生側の水平走査のタイミングを映像信号に同期さ
せる水平同期信号が重畳され、カラー映像信号の場合に
は、さらにカラーバーストと称される色同期信号が重畳
される。また、水平ラインの信号が水平走査線の数だけ
連続すると、映像信号Ｙ1(t)は次の画面に切り換わり、
その切り換わりを示す期間には垂直走査の帰線消去期間
となる垂直ブランキング期間が設定される。この垂直ブ
ランキング期間にも、水平ブランキング期間と同様に、
垂直同期信号や等価パルスが重畳されることになる。
【０００６】
【発明が解決しようとする課題】アナログ信号処理部４
及びデジタル信号処理部６からそれぞれ出力される映像
信号Ｙ2(t)及び映像データＹＤ2は、各信号処理の過程
において生じる遅延により、それぞれに入力される映像
信号Ｙ1(t)及び映像データＹＤ1に対して一定期間のず
れを有している。特に、映像信号処理のデジタル化が進
むと、デジタル信号処理部６での処理項目が多くなり、
映像データＹＤ1に対する映像データＹＤ2の遅延が大き
くなる。このため、アナログ信号処理部４から出力され
る映像信号Ｙ2(t)とＤ／Ａ変換回路７から出力される映
像信号Ｙ3(t)とで水平ブランキング期間が一致しなくな
る。測定によれば、１４．３２ＭＨｚの基準クロックを
用いたときで５μｓｅｃ程度の遅延を生じることが確認
されており、ＮＴＳＣ方式では、水平走査期間（６３．
５μｓｅｃ）の約１／１２の期間だけずれることにな
る。
及びデジタル信号処理部６からそれぞれ出力される映像
信号Ｙ2(t)及び映像データＹＤ2は、各信号処理の過程
において生じる遅延により、それぞれに入力される映像
信号Ｙ1(t)及び映像データＹＤ1に対して一定期間のず
れを有している。特に、映像信号処理のデジタル化が進
むと、デジタル信号処理部６での処理項目が多くなり、
映像データＹＤ1に対する映像データＹＤ2の遅延が大き
くなる。このため、アナログ信号処理部４から出力され
る映像信号Ｙ2(t)とＤ／Ａ変換回路７から出力される映
像信号Ｙ3(t)とで水平ブランキング期間が一致しなくな
る。測定によれば、１４．３２ＭＨｚの基準クロックを
用いたときで５μｓｅｃ程度の遅延を生じることが確認
されており、ＮＴＳＣ方式では、水平走査期間（６３．
５μｓｅｃ）の約１／１２の期間だけずれることにな
る。
【０００７】映像信号Ｙ2(t)と映像信号Ｙ3(t)とで水平
ブランキング期間が一致しなくなると、Ａ／Ｄ変換回路
５またはＤ／Ａ変換回路７で生じるスイッチングノイズ
が各映像信号Ｙ2(t)、Ｙ3(t)に混入し易くなる。即ち、
水平ブランキング期間内に重畳されている水平同期信号
や色同期信号は、同一のパターンを繰り返すため、Ａ／
Ｄ変換回路５及びＤ／Ａ変換回路７での変換動作の際の
スイッチングノイズがパターンノイズとなり、映像信号
Ｙ2(t)、Ｙ3(t)の映像成分に混入して再生画面の画質の
劣化を招くことになる。さらには、各信号処理部４、６
やタイミングパルス生成回路２において水平ブランキン
グ期間内に設定される水平走査周期のタイミングパルス
に起因して発生するノイズが映像信号の映像期間に混入
し易くなる。尚、映像成分については、各水平ライン毎
の規則性がないことから、Ａ／Ｄ変換回路５及びＤ／Ａ
変換回路７による変換動作で生じるスイッチングノイズ
がパターンノイズとはならず、映像成分に混入しても再
生画面の画質を大きく劣化させることはない。
ブランキング期間が一致しなくなると、Ａ／Ｄ変換回路
５またはＤ／Ａ変換回路７で生じるスイッチングノイズ
が各映像信号Ｙ2(t)、Ｙ3(t)に混入し易くなる。即ち、
水平ブランキング期間内に重畳されている水平同期信号
や色同期信号は、同一のパターンを繰り返すため、Ａ／
Ｄ変換回路５及びＤ／Ａ変換回路７での変換動作の際の
スイッチングノイズがパターンノイズとなり、映像信号
Ｙ2(t)、Ｙ3(t)の映像成分に混入して再生画面の画質の
劣化を招くことになる。さらには、各信号処理部４、６
やタイミングパルス生成回路２において水平ブランキン
グ期間内に設定される水平走査周期のタイミングパルス
に起因して発生するノイズが映像信号の映像期間に混入
し易くなる。尚、映像成分については、各水平ライン毎
の規則性がないことから、Ａ／Ｄ変換回路５及びＤ／Ａ
変換回路７による変換動作で生じるスイッチングノイズ
がパターンノイズとはならず、映像成分に混入しても再
生画面の画質を大きく劣化させることはない。
【０００８】そこで本発明は、水平ブランキング期間に
発生するノイズが映像信号の映像期間に混入するのを防
止した映像信号処理装置の提供を目的とする。
発生するノイズが映像信号の映像期間に混入するのを防
止した映像信号処理装置の提供を目的とする。
【０００９】
【課題を解決するための手段】本発明は、上述の課題を
解決するためのなされたもので、その特徴とするところ
は、水平走査及び垂直走査の各タイミングに対応して駆
動される固体撮像素子の出力を取り込み、所定のフォー
マットに従う映像信号を生成する映像信号処理装置にお
いて、水平ライン単位で連続する上記固体撮像素子の出
力に対して第１の信号処理を施して第１の映像信号を得
る第１の信号処理回路と、上記第１の映像信号をデジタ
ル情報に変換して第１の映像データを得るＡ／Ｄ変換回
路と、上記第１の映像データを少なくとも１水平ライン
単位で記憶し、所定の期間経過した後に読み出して出力
する記憶回路と、出力される上記第１の映像データに対
して第２の信号処理を施して第２の映像データを得る第
２の信号処理回路と、上記第２の映像データをアナログ
値に変換して第２の映像信号を得るＤ／Ａ変換回路と、
を備え、上記記憶回路が水平走査期間の整数倍の期間よ
り上記第２の信号処理の期間分短く上記第１の映像デー
タの出力を遅延することにある。
解決するためのなされたもので、その特徴とするところ
は、水平走査及び垂直走査の各タイミングに対応して駆
動される固体撮像素子の出力を取り込み、所定のフォー
マットに従う映像信号を生成する映像信号処理装置にお
いて、水平ライン単位で連続する上記固体撮像素子の出
力に対して第１の信号処理を施して第１の映像信号を得
る第１の信号処理回路と、上記第１の映像信号をデジタ
ル情報に変換して第１の映像データを得るＡ／Ｄ変換回
路と、上記第１の映像データを少なくとも１水平ライン
単位で記憶し、所定の期間経過した後に読み出して出力
する記憶回路と、出力される上記第１の映像データに対
して第２の信号処理を施して第２の映像データを得る第
２の信号処理回路と、上記第２の映像データをアナログ
値に変換して第２の映像信号を得るＤ／Ａ変換回路と、
を備え、上記記憶回路が水平走査期間の整数倍の期間よ
り上記第２の信号処理の期間分短く上記第１の映像デー
タの出力を遅延することにある。
【００１０】
【作用】本発明によれば、記憶回路が水平走査期間の整
数倍の期間より上記第２の信号処理の期間分短く第１の
映像データを遅延することで、第２の信号処理回路での
信号処理過程での遅延が加えられた第２の映像データ
は、記憶回路で遅延される前の第１の映像データに対し
て水平走査期間の整数倍の期間遅れることになる。この
ため、Ａ／Ｄ変換回路に入力される第１の映像信号の水
平ブランキング期間とＤ／Ａ変換回路から出力される第
２の映像信号の水平ブランキング期間とが互いに一致
し、各変換回路で生じるパターンノイズや、水平ブラン
キング期間に設定されるタイミング信号に起因するノイ
ズが映像期間に混入しなくなる。
数倍の期間より上記第２の信号処理の期間分短く第１の
映像データを遅延することで、第２の信号処理回路での
信号処理過程での遅延が加えられた第２の映像データ
は、記憶回路で遅延される前の第１の映像データに対し
て水平走査期間の整数倍の期間遅れることになる。この
ため、Ａ／Ｄ変換回路に入力される第１の映像信号の水
平ブランキング期間とＤ／Ａ変換回路から出力される第
２の映像信号の水平ブランキング期間とが互いに一致
し、各変換回路で生じるパターンノイズや、水平ブラン
キング期間に設定されるタイミング信号に起因するノイ
ズが映像期間に混入しなくなる。
【００１１】
【実施例】図１は、本発明の映像信号処理装置の構成を
示すブロック図である。この図において、撮像素子１、
タイミングパルス生成回路２及びドライバ３は図４と同
一であり、タイミングパルス生成回路２から出力される
垂直走査周期及び水平走査周期のタイミングパルスＶ
Ｄ、ＨＤに応答してドライバ３が駆動クロックφV、φH
を撮像素子１に与え、映像信号Ｙ1(t)を得るように構成
される。
示すブロック図である。この図において、撮像素子１、
タイミングパルス生成回路２及びドライバ３は図４と同
一であり、タイミングパルス生成回路２から出力される
垂直走査周期及び水平走査周期のタイミングパルスＶ
Ｄ、ＨＤに応答してドライバ３が駆動クロックφV、φH
を撮像素子１に与え、映像信号Ｙ1(t)を得るように構成
される。
【００１２】アナログ信号処理部１１は、撮像素子１か
ら出力される映像信号Ｙ1(t)を取り込んでサンプリング
した後、後述するアイリス／ゲイン制御回路１４からの
指示に基づいてゲインを調整し、映像信号Ｙ1(t)の平均
レベルを一定範囲内に維持する。さらに、再生側での信
号レベルに対する発光輝度の非線形性に対応させるよう
にガンマ補正を行い、所定のフォーマットに従う映像信
号Ｙ2(t)を出力する。Ａ／Ｄ変換回路１２は、映像信号
Ｙ2(t)を取り込んでデジタルデータに変換し、各データ
が撮像素子１の各受光画素の映像情報に対応する映像デ
ータＹＤ1を出力する。ラインメモリ１３は、アナログ
デジタル変換回路１２から出力される映像データＹＤ1
を１水平ライン単位で記憶し、一定の期間経過した後に
読み出して出力する。この読み出しのタイミングについ
ては、後に詳述する。アイリス／ゲイン制御回路１３
は、ラインメモリ１２から出力される映像データＹＤ1
を１画面単位で積分し、その積分値に基づいてタイミン
グパルス生成回路２にアイリスの制御指示を与えると共
に、アナログ信号処理部１１にゲインの制御指示を与え
る。タイミングパルス生成回路２に与えられる制御指示
によれば、映像データＹＤ1の１画面分の積分値の増減
に対応して撮像素子１の情報電荷の蓄積期間を伸縮制御
する自動露光制御が実現される。アナログ信号処理部１
１に与えられる制御指示によれば、映像データＹＤ1の
１画面分の積分値に対応して映像信号Ｙ1 (t)のゲインを
可変設定する自動利得制御が実現される。
ら出力される映像信号Ｙ1(t)を取り込んでサンプリング
した後、後述するアイリス／ゲイン制御回路１４からの
指示に基づいてゲインを調整し、映像信号Ｙ1(t)の平均
レベルを一定範囲内に維持する。さらに、再生側での信
号レベルに対する発光輝度の非線形性に対応させるよう
にガンマ補正を行い、所定のフォーマットに従う映像信
号Ｙ2(t)を出力する。Ａ／Ｄ変換回路１２は、映像信号
Ｙ2(t)を取り込んでデジタルデータに変換し、各データ
が撮像素子１の各受光画素の映像情報に対応する映像デ
ータＹＤ1を出力する。ラインメモリ１３は、アナログ
デジタル変換回路１２から出力される映像データＹＤ1
を１水平ライン単位で記憶し、一定の期間経過した後に
読み出して出力する。この読み出しのタイミングについ
ては、後に詳述する。アイリス／ゲイン制御回路１３
は、ラインメモリ１２から出力される映像データＹＤ1
を１画面単位で積分し、その積分値に基づいてタイミン
グパルス生成回路２にアイリスの制御指示を与えると共
に、アナログ信号処理部１１にゲインの制御指示を与え
る。タイミングパルス生成回路２に与えられる制御指示
によれば、映像データＹＤ1の１画面分の積分値の増減
に対応して撮像素子１の情報電荷の蓄積期間を伸縮制御
する自動露光制御が実現される。アナログ信号処理部１
１に与えられる制御指示によれば、映像データＹＤ1の
１画面分の積分値に対応して映像信号Ｙ1 (t)のゲインを
可変設定する自動利得制御が実現される。
【００１３】クランプ回路１５は、ラインメモリ１３か
ら出力される映像データＹＤ1の基準レベルをクランプ
し、その基準レベルと映像データＹＤ1との差を取り出
して出力する。色信号処理部１６は、まず映像データＹ
Ｄ1を色成分（赤、緑、青）毎に分離し、各成分の色デ
ータ（Ｒ、Ｇ、Ｂ）に対して固有のゲイン係数を乗じて
ホワイトバランスを調整する。その後、マトリクス処理
を経て色データ（Ｒ、Ｂ）から輝度データ（Ｙ）が差し
引かれた色差データ（Ｒ−Ｙ、Ｂ−Ｙ）を生成し、エン
コーダ回路１８に供給する。輝度信号処理部１７は、各
色データ（Ｒ、Ｇ、Ｂ）を所定の割合〔Ｒ：３０％、
Ｇ：５９％、Ｂ：１１％〕で合成して得られる輝度デー
タ（Ｙ）に対して、輪郭補正、ガンマ補正等の処理を施
し、エンコーダ回路１８に供給する。エンコーダ回路１
８は、各色差データ（Ｒ−Ｙ、Ｂ−Ｙ）に対して平衡変
調処理を施して搬送色データを生成し、この搬送色デー
タを輝度信号処理部１７から供給される輝度データ
（Ｙ）に加算することにより所定のテレビジョンフォー
マットに対応した映像データＹＤ2を出力する。また、
エンコーダ回路１８では、色同期信号に対応した色同期
データを加算することにより、映像データＹＤ2の水平
ブランキング期間に色同期信号を重畳させている。そし
て、Ｄ／Ａ変換回路１９は、エンコーダ回路１８から出
力される映像データＹＤ2をアナログ値に変換し、映像
信号Ｙ3(t)として出力する。このようにして得られる映
像信号Ｙ3(t)は、輝度信号に所定の色副搬送波により変
調された色差信号が重畳され、水平ブランキング期間に
色同期信号及び水平同期信号が重畳されている。尚、色
信号処理部１６及び輝度信号処理部１７の処理動作につ
いては、ＮＴＣＳ方式の場合を例示しており、その他の
テレビジョン方式では異なった処理動作となる。
ら出力される映像データＹＤ1の基準レベルをクランプ
し、その基準レベルと映像データＹＤ1との差を取り出
して出力する。色信号処理部１６は、まず映像データＹ
Ｄ1を色成分（赤、緑、青）毎に分離し、各成分の色デ
ータ（Ｒ、Ｇ、Ｂ）に対して固有のゲイン係数を乗じて
ホワイトバランスを調整する。その後、マトリクス処理
を経て色データ（Ｒ、Ｂ）から輝度データ（Ｙ）が差し
引かれた色差データ（Ｒ−Ｙ、Ｂ−Ｙ）を生成し、エン
コーダ回路１８に供給する。輝度信号処理部１７は、各
色データ（Ｒ、Ｇ、Ｂ）を所定の割合〔Ｒ：３０％、
Ｇ：５９％、Ｂ：１１％〕で合成して得られる輝度デー
タ（Ｙ）に対して、輪郭補正、ガンマ補正等の処理を施
し、エンコーダ回路１８に供給する。エンコーダ回路１
８は、各色差データ（Ｒ−Ｙ、Ｂ−Ｙ）に対して平衡変
調処理を施して搬送色データを生成し、この搬送色デー
タを輝度信号処理部１７から供給される輝度データ
（Ｙ）に加算することにより所定のテレビジョンフォー
マットに対応した映像データＹＤ2を出力する。また、
エンコーダ回路１８では、色同期信号に対応した色同期
データを加算することにより、映像データＹＤ2の水平
ブランキング期間に色同期信号を重畳させている。そし
て、Ｄ／Ａ変換回路１９は、エンコーダ回路１８から出
力される映像データＹＤ2をアナログ値に変換し、映像
信号Ｙ3(t)として出力する。このようにして得られる映
像信号Ｙ3(t)は、輝度信号に所定の色副搬送波により変
調された色差信号が重畳され、水平ブランキング期間に
色同期信号及び水平同期信号が重畳されている。尚、色
信号処理部１６及び輝度信号処理部１７の処理動作につ
いては、ＮＴＣＳ方式の場合を例示しており、その他の
テレビジョン方式では異なった処理動作となる。
【００１４】ここで、ラインメモリ１３からの映像デー
タＹＤ1の読み出しは、映像データＹＤ1が書き込まれる
タイミングに対し、１水平走査期間よりクランプ回路１
５の入力からエンコーダ回路１８の出力までに生じる遅
延分だけ短い期間遅れたタイミングに設定される。即
ち、クランプ回路１５に映像データＹＤ1が入力されて
からエンコーダ回路１８から映像データＹＤ2が出力さ
れるまでに生じる遅延と、ラインメモリ１３に映像デー
タＹＤ1が書き込まれてから読み出されるまでに生じる
遅延とを合わせて１水平走査期間となるようにしてい
る。従って、Ｄ／Ａ変換回路１９から出力される映像信
号Ｙ3(t)は、Ａ／Ｄ変換回路１２に入力される映像信号
Ｙ2(t)に対して１水平走査期間だけずれ、互いの水平ブ
ランキング期間が一致する。このため、Ａ／Ｄ変換回路
１２及びＤ／Ａ変換回路１９のスイッチングノイズや水
平ブランキング期間に設定される水平走査周期のタイミ
ングパルスに起因するノイズが各映像信号Ｙ2(t)、Ｙ
3(t)の映像期間に混入することがなくなる。
タＹＤ1の読み出しは、映像データＹＤ1が書き込まれる
タイミングに対し、１水平走査期間よりクランプ回路１
５の入力からエンコーダ回路１８の出力までに生じる遅
延分だけ短い期間遅れたタイミングに設定される。即
ち、クランプ回路１５に映像データＹＤ1が入力されて
からエンコーダ回路１８から映像データＹＤ2が出力さ
れるまでに生じる遅延と、ラインメモリ１３に映像デー
タＹＤ1が書き込まれてから読み出されるまでに生じる
遅延とを合わせて１水平走査期間となるようにしてい
る。従って、Ｄ／Ａ変換回路１９から出力される映像信
号Ｙ3(t)は、Ａ／Ｄ変換回路１２に入力される映像信号
Ｙ2(t)に対して１水平走査期間だけずれ、互いの水平ブ
ランキング期間が一致する。このため、Ａ／Ｄ変換回路
１２及びＤ／Ａ変換回路１９のスイッチングノイズや水
平ブランキング期間に設定される水平走査周期のタイミ
ングパルスに起因するノイズが各映像信号Ｙ2(t)、Ｙ
3(t)の映像期間に混入することがなくなる。
【００１５】以上のように映像信号の水平ブランキング
期間に発生するノイズが映像信号Ｙ 2(t)、Ｙ3(t)の映像
期間に混入しなくなれば、各部を同一基板上に集積回路
として構成することが可能になる。具体的には、アナロ
グ信号処理部１１、Ａ／Ｄ変換回路１２、ラインメモリ
１３、アイリス／ゲイン制御回路１４及びＤ／Ａ変換回
路１９をアナログ／デジタル混載の第１の集積回路Ａと
し、クランプ回路１５、色信号処理部１６、輝度信号処
理部１７及びエンコーダ回路１８をデジタル部のみとな
る第２の集積回路Ｂとして構成する。尚、第１の集積回
路Ａにタイミングパルス生成回路２を加えるようにして
もよい。従って、２つの集積回路Ａ、Ｂにより信号処理
装置を構成することができるようになる。
期間に発生するノイズが映像信号Ｙ 2(t)、Ｙ3(t)の映像
期間に混入しなくなれば、各部を同一基板上に集積回路
として構成することが可能になる。具体的には、アナロ
グ信号処理部１１、Ａ／Ｄ変換回路１２、ラインメモリ
１３、アイリス／ゲイン制御回路１４及びＤ／Ａ変換回
路１９をアナログ／デジタル混載の第１の集積回路Ａと
し、クランプ回路１５、色信号処理部１６、輝度信号処
理部１７及びエンコーダ回路１８をデジタル部のみとな
る第２の集積回路Ｂとして構成する。尚、第１の集積回
路Ａにタイミングパルス生成回路２を加えるようにして
もよい。従って、２つの集積回路Ａ、Ｂにより信号処理
装置を構成することができるようになる。
【００１６】図２は、本発明の映像信号処理装置の動作
を説明するタイミング図で、撮像素子１を連続的に動作
させる場合を示す。Ａ／Ｄ変換回路１２から出力される
映像データＹＤ1は、水平同期信号に同期して１水平ラ
イン分が連続しており、１水平ライン単位で順次ライン
メモリ１３に書き込まれる。ラインメモリ１３に書き込
まれた映像データＹＤ1は、書き込まれてから一定の期
間（１水平走査期間よりもクランプ回路１５からエンコ
ーダ回路１８までの信号処理で生じる遅延分だけ短い期
間）経過した後に読み出され、クランプ回路１５に供給
される。このラインメモリ１３の読み出しタイミング
は、水平走査周期を計測するカウンタにより設定され
る。例えば、１４．３２ＭＨｚの基準クロックを用いる
ＮＴＳＣ方式の場合、１水平走査期間が９１０クロック
期間で定義されることから、クランプ回路１５からエン
コーダ回路１８の間に生じる遅延を５μｓｅｃと仮定し
たときには、９１０クロックから５μｓｅｃに相当する
７２クロックを差し引いた８３８クロック期間経過した
時点でラインメモリ１３から映像データＹＤ1を読み出
すようにする。また、１水平ライン分の映像データＹＤ
1を読み出している途中で次の水平ラインの映像データ
ＹＤ1が入力されると、ラインメモリ１３は、映像デー
タＹＤ1の読み出しと書き込みとを並行して行うことに
なる。ラインメモリ１３で書き込みと読み出しとを並行
処理できるようにするには、映像データＹＤ1の書き込
み及び読み出しを２倍の周期で繰り返すことや、書き込
み回路と読み出し回路とを並列に設けるデュアルポート
型とすることが考えられる。
を説明するタイミング図で、撮像素子１を連続的に動作
させる場合を示す。Ａ／Ｄ変換回路１２から出力される
映像データＹＤ1は、水平同期信号に同期して１水平ラ
イン分が連続しており、１水平ライン単位で順次ライン
メモリ１３に書き込まれる。ラインメモリ１３に書き込
まれた映像データＹＤ1は、書き込まれてから一定の期
間（１水平走査期間よりもクランプ回路１５からエンコ
ーダ回路１８までの信号処理で生じる遅延分だけ短い期
間）経過した後に読み出され、クランプ回路１５に供給
される。このラインメモリ１３の読み出しタイミング
は、水平走査周期を計測するカウンタにより設定され
る。例えば、１４．３２ＭＨｚの基準クロックを用いる
ＮＴＳＣ方式の場合、１水平走査期間が９１０クロック
期間で定義されることから、クランプ回路１５からエン
コーダ回路１８の間に生じる遅延を５μｓｅｃと仮定し
たときには、９１０クロックから５μｓｅｃに相当する
７２クロックを差し引いた８３８クロック期間経過した
時点でラインメモリ１３から映像データＹＤ1を読み出
すようにする。また、１水平ライン分の映像データＹＤ
1を読み出している途中で次の水平ラインの映像データ
ＹＤ1が入力されると、ラインメモリ１３は、映像デー
タＹＤ1の読み出しと書き込みとを並行して行うことに
なる。ラインメモリ１３で書き込みと読み出しとを並行
処理できるようにするには、映像データＹＤ1の書き込
み及び読み出しを２倍の周期で繰り返すことや、書き込
み回路と読み出し回路とを並列に設けるデュアルポート
型とすることが考えられる。
【００１７】そして、映像データＹＤ1がクランプ回路
１５に入力されると、色信号処理部１６及び輝度信号処
理部１７で所定の処理が施された後にエンコーダ回路１
８から映像データＹＤ2として出力される。このときの
映像データＹＤ2は、クランプ回路１５に入力される映
像データＹＤ1に対してクランプ回路１５からエンコー
ダ回路１８までの信号処理により生じる遅延分だけ遅れ
ることになる。ところが、クランプ回路１５に入力され
る映像データＹＤ1が予め１水平走査期間よりもクラン
プ回路１５からエンコーダ回路１８までの信号処理で生
じる遅延分だけ短く遅延されていることから、映像デー
タＹＤ2は、ラインメモリ１３に書き込まれる映像デー
タＹＤ1に対してちょうど１水平走査期間遅れることに
なる。従って、Ａ／Ｄ変換回路１２に入力される映像信
号Ｙ2(t)とＤ／Ａ変換回路１９から出力される映像信号
Ｙ2(t)との水平ブランキング期間が一致し、水平ブラン
キング期間に重畳される水平同期信号や色同期信号に起
因するＡ／Ｄ変換回路１２やＤ／Ａ変換回路１９のスイ
ッチングノイズ及び水平走査周期のタイミングパルスに
起因するノイズが映像期間に混入しにくくなる。
１５に入力されると、色信号処理部１６及び輝度信号処
理部１７で所定の処理が施された後にエンコーダ回路１
８から映像データＹＤ2として出力される。このときの
映像データＹＤ2は、クランプ回路１５に入力される映
像データＹＤ1に対してクランプ回路１５からエンコー
ダ回路１８までの信号処理により生じる遅延分だけ遅れ
ることになる。ところが、クランプ回路１５に入力され
る映像データＹＤ1が予め１水平走査期間よりもクラン
プ回路１５からエンコーダ回路１８までの信号処理で生
じる遅延分だけ短く遅延されていることから、映像デー
タＹＤ2は、ラインメモリ１３に書き込まれる映像デー
タＹＤ1に対してちょうど１水平走査期間遅れることに
なる。従って、Ａ／Ｄ変換回路１２に入力される映像信
号Ｙ2(t)とＤ／Ａ変換回路１９から出力される映像信号
Ｙ2(t)との水平ブランキング期間が一致し、水平ブラン
キング期間に重畳される水平同期信号や色同期信号に起
因するＡ／Ｄ変換回路１２やＤ／Ａ変換回路１９のスイ
ッチングノイズ及び水平走査周期のタイミングパルスに
起因するノイズが映像期間に混入しにくくなる。
【００１８】図３は、本発明の映像信号処理装置の動作
を説明するタイミング図で、撮像素子１を１水平走査期
間おきに間欠的に動作させる場合を示す。Ａ／Ｄ変換回
路１２から出力される映像データＹＤ1は、１水平走査
期間おきに１水平ライン分が連続しており、１水平ライ
ン単位でそれぞれラインメモリ１３に書き込まれる。ラ
インメモリ１３に書き込まれた映像データＹＤ1は、書
き込まれてから一定の期間経過した後に読み出され、ク
ランプ回路１５に供給される。そして、クランプ回路１
５に入力された映像データＹＤ1は、色信号処理部１６
及び輝度信号処理部１７で所定の処理が施された後にエ
ンコーダ回路１８から映像データＹＤ2として出力され
る。ここで、ラインメモリ１３からの映像データＹＤ1
の読み出しのタイミング及びクランプ回路１５からエン
コーダ回路１８までの信号処理によって生じる遅延につ
いては、図２に示す連続動作の場合と同一となる。従っ
て、撮像素子１を間欠動作させる場合でも、Ａ／Ｄ変換
回路１２に入力される映像信号Ｙ1(t)とＤ／Ａ変換回路
１９から出力される映像信号Ｙ 3(t)との水平ブランキン
グ期間が一致することになる。
を説明するタイミング図で、撮像素子１を１水平走査期
間おきに間欠的に動作させる場合を示す。Ａ／Ｄ変換回
路１２から出力される映像データＹＤ1は、１水平走査
期間おきに１水平ライン分が連続しており、１水平ライ
ン単位でそれぞれラインメモリ１３に書き込まれる。ラ
インメモリ１３に書き込まれた映像データＹＤ1は、書
き込まれてから一定の期間経過した後に読み出され、ク
ランプ回路１５に供給される。そして、クランプ回路１
５に入力された映像データＹＤ1は、色信号処理部１６
及び輝度信号処理部１７で所定の処理が施された後にエ
ンコーダ回路１８から映像データＹＤ2として出力され
る。ここで、ラインメモリ１３からの映像データＹＤ1
の読み出しのタイミング及びクランプ回路１５からエン
コーダ回路１８までの信号処理によって生じる遅延につ
いては、図２に示す連続動作の場合と同一となる。従っ
て、撮像素子１を間欠動作させる場合でも、Ａ／Ｄ変換
回路１２に入力される映像信号Ｙ1(t)とＤ／Ａ変換回路
１９から出力される映像信号Ｙ 3(t)との水平ブランキン
グ期間が一致することになる。
【００１９】以上の実施例においては、映像データＹＤ
2を映像データＹＤ1に対して１水平走査期間遅らせる場
合を例示したが、遅延期間は、水平走査期間の整数倍で
あればよく、１水平走査期間に限られるものではない。
2を映像データＹＤ1に対して１水平走査期間遅らせる場
合を例示したが、遅延期間は、水平走査期間の整数倍で
あればよく、１水平走査期間に限られるものではない。
【００２０】
【発明の効果】本発明によれば、映像信号をデジタルデ
ータとして処理するようにした映像信号処理装置におい
て、映像信号をデジタルデータに変換するためのＡ／Ｄ
変換回路あるいはデジタルデータから映像信号を再生す
るＤ／Ａ変換回路で生じるスイッチングノイズが映像信
号の映像期間に混入しにくくなる。同時に、映像信号の
水平ブランキング期間に設定される各種のタイミングパ
ルスに起因するノイズが映像期間に混入しにくくなるこ
とから、ノイズ低減の効果は大きい。
ータとして処理するようにした映像信号処理装置におい
て、映像信号をデジタルデータに変換するためのＡ／Ｄ
変換回路あるいはデジタルデータから映像信号を再生す
るＤ／Ａ変換回路で生じるスイッチングノイズが映像信
号の映像期間に混入しにくくなる。同時に、映像信号の
水平ブランキング期間に設定される各種のタイミングパ
ルスに起因するノイズが映像期間に混入しにくくなるこ
とから、ノイズ低減の効果は大きい。
【００２１】そして、映像信号の映像期間にノイズが混
入しにくくなることから、信号処理回路をＡ／Ｄ変換回
路あるいはＤ／Ａ変換回路と共に集積回路として構成す
ることが可能になり、映像信号処理装置を僅かな構成部
品によって実現することができる。
入しにくくなることから、信号処理回路をＡ／Ｄ変換回
路あるいはＤ／Ａ変換回路と共に集積回路として構成す
ることが可能になり、映像信号処理装置を僅かな構成部
品によって実現することができる。
【図１】本発明の映像信号処理装置の構成を示すブロッ
クである。
クである。
【図２】本発明の映像信号処理装置の第１の動作を説明
するタイミング図である。
するタイミング図である。
【図３】本発明の映像信号処理装置の第２の動作を説明
するタイミング図である。
するタイミング図である。
【図４】映像信号処理の一部がデジタル化された撮像装
置の構成を示すブロック図である。
置の構成を示すブロック図である。
【図５】映像信号の水平走査期間の波形図である。
１ 撮像素子 ２ タイミングパルス生成回路 ３ ドライバ ４、１１ アナログ信号処理部 ５、１２ Ａ／Ｄ変換回路 ６ デジタル信号処理部 ７、１９ Ｄ／Ａ変換回路 ８ 制御マイコン １３ ラインメモリ １４ アイリス／ゲイン制御回路 １５ クランプ回路 １６ 色信号処理部 １７ 輝度信号処理部 １８ エンコーダ回路
Claims (1)
- 【請求項１】 水平走査及び垂直走査の各タイミングに
対応して駆動される固体撮像素子の出力を取り込み、所
定のフォーマットに従う映像信号を生成する映像信号処
理装置において、水平ライン単位で連続する上記固体撮
像素子の出力に対して第１の信号処理を施して第１の映
像信号を得る第１の信号処理回路と、上記第１の映像信
号をデジタル情報に変換して第１の映像データを得るＡ
／Ｄ変換回路と、上記第１の映像データを少なくとも１
水平ライン単位で記憶し、所定の期間経過した後に読み
出して出力する記憶回路と、出力される上記第１の映像
データに対して第２の信号処理を施して第２の映像デー
タを得る第２の信号処理回路と、上記第２の映像データ
をアナログ値に変換して第２の映像信号を得るＤ／Ａ変
換回路と、を備え、上記記憶回路が水平走査期間の整数
倍の期間より上記第２の信号処理の期間分短く上記第１
の映像データの出力を遅延することを特徴とする映像信
号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03977394A JP3667784B2 (ja) | 1994-03-10 | 1994-03-10 | 映像信号処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03977394A JP3667784B2 (ja) | 1994-03-10 | 1994-03-10 | 映像信号処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07250266A true JPH07250266A (ja) | 1995-09-26 |
| JP3667784B2 JP3667784B2 (ja) | 2005-07-06 |
Family
ID=12562261
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03977394A Expired - Lifetime JP3667784B2 (ja) | 1994-03-10 | 1994-03-10 | 映像信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3667784B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6803951B1 (en) | 1999-09-03 | 2004-10-12 | Victor Company Of Japan, Limited | Apparatus and method for video image information processing |
| US7595824B2 (en) | 2004-07-28 | 2009-09-29 | Kabushiki Kaisha Toshiba | Signal processor, data processor, and solid state image sensor |
-
1994
- 1994-03-10 JP JP03977394A patent/JP3667784B2/ja not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6803951B1 (en) | 1999-09-03 | 2004-10-12 | Victor Company Of Japan, Limited | Apparatus and method for video image information processing |
| US7595824B2 (en) | 2004-07-28 | 2009-09-29 | Kabushiki Kaisha Toshiba | Signal processor, data processor, and solid state image sensor |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3667784B2 (ja) | 2005-07-06 |
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Legal Events
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