JPH07236026A - 密着型イメージセンサ - Google Patents
密着型イメージセンサInfo
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- JPH07236026A JPH07236026A JP6051184A JP5118494A JPH07236026A JP H07236026 A JPH07236026 A JP H07236026A JP 6051184 A JP6051184 A JP 6051184A JP 5118494 A JP5118494 A JP 5118494A JP H07236026 A JPH07236026 A JP H07236026A
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- multiplexer
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- multiplexers
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Abstract
(57)【要約】
【目的】 Ｇ３対応ファクシミリ用の密着型イメージセ
ンサに用いられていたマルチプレクサと同程度の切り換
え速度を有するマルチプレクサを、Ｇ４対応ファクシミ
リ用に使用することができる密着型イメージセンサを提
供する。 【構成】 二つのマルチプレクサ１０及び１２を設け
る。Ｇ４対応ファクシミリでＡ３サイズの原稿を読み取
るため、４８６４個のセンサ素子５０を６４個ずつ７６
のブロックに分割し、６４個の出力回路Ｃ1 〜Ｃ64のう
ち奇数番目の出力回路からのパラレル信号はマルチプレ
クサ１０へ、偶数番目の出力回路からのパラレル信号は
マルチプレクサ１２へ供給される。各マルチプレクサか
らのシリアル信号はスイッチ１４によって交互にスイッ
チングされて出力されるので、マルチプレクサの切り換
え周期は、単一のマルチプレクサの場合の２倍となる。
ンサに用いられていたマルチプレクサと同程度の切り換
え速度を有するマルチプレクサを、Ｇ４対応ファクシミ
リ用に使用することができる密着型イメージセンサを提
供する。 【構成】 二つのマルチプレクサ１０及び１２を設け
る。Ｇ４対応ファクシミリでＡ３サイズの原稿を読み取
るため、４８６４個のセンサ素子５０を６４個ずつ７６
のブロックに分割し、６４個の出力回路Ｃ1 〜Ｃ64のう
ち奇数番目の出力回路からのパラレル信号はマルチプレ
クサ１０へ、偶数番目の出力回路からのパラレル信号は
マルチプレクサ１２へ供給される。各マルチプレクサか
らのシリアル信号はスイッチ１４によって交互にスイッ
チングされて出力されるので、マルチプレクサの切り換
え周期は、単一のマルチプレクサの場合の２倍となる。
Description
【０００１】
【産業上の利用分野】本発明は、小型ファクシミリやコ
ピー機等において原稿読み取り装置として使用される密
着型イメージセンサに関するものである。
ピー機等において原稿読み取り装置として使用される密
着型イメージセンサに関するものである。
【０００２】
【従来の技術】図４は従来のＡ４サイズ用（主走査方向
の長さが216 mm）の密着型イメージセンサの一例を示す
回路図である。この回路には、出力回路Ｃ1 〜Ｃ32のチ
ャンネル数に対応して３２本のラインＬ1 〜Ｌ32が設け
られている。画像読み取り手段であるセンサ素子５０は
８素子／mmの線密度で、全体として１７２８個含まれて
いる。これらのセンサ素子５０は、出力回路Ｃ1 〜Ｃ32
のチャンネル数と同じ数（３２個）ずつ５４個のブロッ
クに分割され、それぞれの出力回路Ｃ1 〜Ｃ32にマトリ
ックス状に接続されている。
の長さが216 mm）の密着型イメージセンサの一例を示す
回路図である。この回路には、出力回路Ｃ1 〜Ｃ32のチ
ャンネル数に対応して３２本のラインＬ1 〜Ｌ32が設け
られている。画像読み取り手段であるセンサ素子５０は
８素子／mmの線密度で、全体として１７２８個含まれて
いる。これらのセンサ素子５０は、出力回路Ｃ1 〜Ｃ32
のチャンネル数と同じ数（３２個）ずつ５４個のブロッ
クに分割され、それぞれの出力回路Ｃ1 〜Ｃ32にマトリ
ックス状に接続されている。
【０００３】同一のブロックに含まれるセンサ素子５０
は、入力回路Ａ1 〜Ａ54のうち対応するものから供給さ
れる入力パルスによって同時に駆動される。センサ素子
５０は、図５に示すように、原稿からの反射光を光電変
換するホトダイオード５０ａのカソードと、このホトダ
イオードに蓄積された電荷を取り出すスイッチング素子
としての役割を果たすブロッキングダイオード５０ｂの
カソードが、フロント・トゥ・フロントに接続されて構
成される。尚、印加するパルスの極性を逆にすれば、ア
ノード同士を接続した構成（バック・トゥ・バック）と
することもできる。
は、入力回路Ａ1 〜Ａ54のうち対応するものから供給さ
れる入力パルスによって同時に駆動される。センサ素子
５０は、図５に示すように、原稿からの反射光を光電変
換するホトダイオード５０ａのカソードと、このホトダ
イオードに蓄積された電荷を取り出すスイッチング素子
としての役割を果たすブロッキングダイオード５０ｂの
カソードが、フロント・トゥ・フロントに接続されて構
成される。尚、印加するパルスの極性を逆にすれば、ア
ノード同士を接続した構成（バック・トゥ・バック）と
することもできる。
【０００４】ホトダイオード５０ａとブロッキングダイ
オード５０ｂとしては、例えばアモルファスシリコンの
ｐｉｎダイオードを用いることができるが、本出願人が
以前提案したように、ブロッキングダイオード５０ｂの
代わりにＴＦＴ（薄膜トランジスタ）を用いることもで
きる（特願平５−９２３８１）。また、出力回路Ｃ1〜
Ｃ32は、それぞれアンプ、積分器、サンプルホールド回
路からなる（図示せず）。
オード５０ｂとしては、例えばアモルファスシリコンの
ｐｉｎダイオードを用いることができるが、本出願人が
以前提案したように、ブロッキングダイオード５０ｂの
代わりにＴＦＴ（薄膜トランジスタ）を用いることもで
きる（特願平５−９２３８１）。また、出力回路Ｃ1〜
Ｃ32は、それぞれアンプ、積分器、サンプルホールド回
路からなる（図示せず）。
【０００５】いま例えばｎ（１≦ｎ≦３５）番目の入力
回路Ａn からブロックＢn に入力パルスが供給される
と、そのブロックの３２個のセンサ素子５０からは同時
に画像信号が出力される。この画像信号はアンプで増幅
され、増幅された信号は入力パルスが供給されている期
間中、積分器によって積分され、その積分された電圧値
は入力パルスの終了直前にサンプルホールド回路によっ
てサンプルホールドされ、一定期間保持される。
回路Ａn からブロックＢn に入力パルスが供給される
と、そのブロックの３２個のセンサ素子５０からは同時
に画像信号が出力される。この画像信号はアンプで増幅
され、増幅された信号は入力パルスが供給されている期
間中、積分器によって積分され、その積分された電圧値
は入力パルスの終了直前にサンプルホールド回路によっ
てサンプルホールドされ、一定期間保持される。
【０００６】各サンプルホールド回路によって保持され
たｎ番目のブロックの３２チャンネル分のパラレル画像
信号は、ｎ＋１番目のブロックＢn+1 に入力パルスが供
給されている期間中にマルチプレクサ５２によってシリ
アル信号に変換され、出力ライン５４へと出力される。
このような動作をすべてのブロックについて順次行うこ
とにより、主走査方向の１ライン分の画像情報が読み取
られ、更に１ライン分の読み取りが終了したら、次のラ
インにおいても同様の動作が繰り返される。
たｎ番目のブロックの３２チャンネル分のパラレル画像
信号は、ｎ＋１番目のブロックＢn+1 に入力パルスが供
給されている期間中にマルチプレクサ５２によってシリ
アル信号に変換され、出力ライン５４へと出力される。
このような動作をすべてのブロックについて順次行うこ
とにより、主走査方向の１ライン分の画像情報が読み取
られ、更に１ライン分の読み取りが終了したら、次のラ
インにおいても同様の動作が繰り返される。
【０００７】ところで、Ｇ３対応ファクシミリにおいて
Ａ４サイズの原稿を読み取る場合、１ライン当たりの読
み取り時間を５msecとするのが普通である。その場合、
ブロック数を上記のように５４とすると、１ブロック当
たりの読み取り時間は、 ５msec ÷ ５４ ≒ ９３μsec となる。したがって、この時間内に１ブロック分の画像
読み取りを行うために、例えば６４μsec 程度のパルス
幅を持った入力パルスを使用する。
Ａ４サイズの原稿を読み取る場合、１ライン当たりの読
み取り時間を５msecとするのが普通である。その場合、
ブロック数を上記のように５４とすると、１ブロック当
たりの読み取り時間は、 ５msec ÷ ５４ ≒ ９３μsec となる。したがって、この時間内に１ブロック分の画像
読み取りを行うために、例えば６４μsec 程度のパルス
幅を持った入力パルスを使用する。
【０００８】
【発明が解決しようとする課題】これに対し、Ｇ４対応
ファクシミリではセンサ素子の線密度は１６素子／mm
で、Ａ３サイズ（主走査方向の長さが304 mm）の原稿を
１ライン当たり１msec程度で読み取ることが必要とな
る。その場合、全体のセンサ素子の数は、 ３０４ × １６ ＝ ４８６４個 となる。このとき、チャンネル数を３２から６４に増や
してマトリックス接続すると、ブロック数は７６に抑え
られ、その場合の１ブロック当たりの読み取り時間は、 １msec ÷ ７６ ≒ １３．２μsec となる。スイッチング素子としてアモルファスシリコン
からなるｐｉｎダイオードを用いた場合でも、またＴＦ
Ｔを用いた場合であっても、１０μsec が一つの限界と
考えられるので、この程度の時間的余裕があれば、セン
サ素子は問題なく動作する。
ファクシミリではセンサ素子の線密度は１６素子／mm
で、Ａ３サイズ（主走査方向の長さが304 mm）の原稿を
１ライン当たり１msec程度で読み取ることが必要とな
る。その場合、全体のセンサ素子の数は、 ３０４ × １６ ＝ ４８６４個 となる。このとき、チャンネル数を３２から６４に増や
してマトリックス接続すると、ブロック数は７６に抑え
られ、その場合の１ブロック当たりの読み取り時間は、 １msec ÷ ７６ ≒ １３．２μsec となる。スイッチング素子としてアモルファスシリコン
からなるｐｉｎダイオードを用いた場合でも、またＴＦ
Ｔを用いた場合であっても、１０μsec が一つの限界と
考えられるので、この程度の時間的余裕があれば、セン
サ素子は問題なく動作する。
【０００９】しかしながら、マルチプレクサはこの期間
内に６４チャンネル分をパラレル信号からシリアル信号
へ切り換えなければならず、その場合の切り換え周期
は、 １３．２μsec ÷ ６４ ≒ ０．２１μsec となり、非常に高速に切り換え動作を行うことが要求さ
れる。そして、更に今後１ライン当たりの読み取り時間
が０．５msec程度になった場合、マルチプレクサの信号
切り換え時間はこの半分程度になる可能性がある。この
ように高速な応答が要求されると、通常のマルチプレク
サの性能では対応できず、高速動作が可能な高価なマル
チプレクサが必要になる。
内に６４チャンネル分をパラレル信号からシリアル信号
へ切り換えなければならず、その場合の切り換え周期
は、 １３．２μsec ÷ ６４ ≒ ０．２１μsec となり、非常に高速に切り換え動作を行うことが要求さ
れる。そして、更に今後１ライン当たりの読み取り時間
が０．５msec程度になった場合、マルチプレクサの信号
切り換え時間はこの半分程度になる可能性がある。この
ように高速な応答が要求されると、通常のマルチプレク
サの性能では対応できず、高速動作が可能な高価なマル
チプレクサが必要になる。
【００１０】本発明は上記事情に基づいてなされたもの
であり、現在入手しうる通常のマルチプレクサを使っ
て、高速にパラレル信号からシリアル信号へ切り換え動
作を行うことができる密着型イメージセンサを提供する
ことを目的とするものである。
であり、現在入手しうる通常のマルチプレクサを使っ
て、高速にパラレル信号からシリアル信号へ切り換え動
作を行うことができる密着型イメージセンサを提供する
ことを目的とするものである。
【００１１】
【課題を解決するための手段】上記の課題を解決するた
めに、請求項１記載の発明は、複数の画像読み取り手段
を出力回路のチャンネル数と同じ数ずつ複数のブロック
に分け、各ブロックに含まれる対応する画像読み取り手
段からの信号が同一の出力回路に供給されるよう前記複
数の画像読み取り手段をマトリックス接続し、前記ブロ
ック単位で同時に前記画像読み取り手段を駆動したとき
の前記出力回路からのパラレル信号をマルチプレクサに
よりシリアル信号に変換して出力するという動作をすべ
てのブロックについて順次行なう密着型イメージセンサ
において、前記マルチプレクサを複数設け、同一ブロッ
ク内の前記画像読み取り手段のうち隣合うものからの出
力信号が異なるマルチプレクサより出力されるよう前記
各出力回路を前記複数のマルチプレクサに接続するとと
もに、前記複数のマルチプレクサからの信号を所定の順
序でスイッチングするスイッチ手段を設けたことを特徴
とするものである。
めに、請求項１記載の発明は、複数の画像読み取り手段
を出力回路のチャンネル数と同じ数ずつ複数のブロック
に分け、各ブロックに含まれる対応する画像読み取り手
段からの信号が同一の出力回路に供給されるよう前記複
数の画像読み取り手段をマトリックス接続し、前記ブロ
ック単位で同時に前記画像読み取り手段を駆動したとき
の前記出力回路からのパラレル信号をマルチプレクサに
よりシリアル信号に変換して出力するという動作をすべ
てのブロックについて順次行なう密着型イメージセンサ
において、前記マルチプレクサを複数設け、同一ブロッ
ク内の前記画像読み取り手段のうち隣合うものからの出
力信号が異なるマルチプレクサより出力されるよう前記
各出力回路を前記複数のマルチプレクサに接続するとと
もに、前記複数のマルチプレクサからの信号を所定の順
序でスイッチングするスイッチ手段を設けたことを特徴
とするものである。
【００１２】上記の課題を解決するために、請求項２記
載の発明は、請求項１記載の発明において、前記マルチ
プレクサの数は二つとし、同一ブロックの偶数番目の画
像読み取り手段からの出力信号と奇数番目の画像読み取
り手段からの出力信号がそれぞれ異なるマルチプレクサ
より出力されるように前記出力回路を接続したことを特
徴とするものである。
載の発明は、請求項１記載の発明において、前記マルチ
プレクサの数は二つとし、同一ブロックの偶数番目の画
像読み取り手段からの出力信号と奇数番目の画像読み取
り手段からの出力信号がそれぞれ異なるマルチプレクサ
より出力されるように前記出力回路を接続したことを特
徴とするものである。
【００１３】
【作用】請求項１記載の発明は前記の構成により、一つ
のマルチプレクサについて見た場合、スイッチ手段によ
って別のマルチプレクサにスイッチングされている間
は、そのマルチプレクサは、信号を切り換える時間に余
裕が与えられる。したがって、それぞれのマルチプレク
サについてみると、等価的に切り換え動作速度を遅くで
きる。例えば、マルチプレクサをｍ個設けた場合には、
従来の構成で必要とされるマルチプレクサの動作速度の
ｍ分の１の動作速度まで遅いマルチプレクサを使用する
ことができる。尚、スイッチ手段としては、最終的なシ
リアルな画像信号の信号間隔程度の周期に対応する速度
でスイッチング可能なものが要求されるが、スイッチ手
段については、例えば半導体スイッチ回路を用いること
により、十分に高速なスイッチ手段を容易に入手でき
る。
のマルチプレクサについて見た場合、スイッチ手段によ
って別のマルチプレクサにスイッチングされている間
は、そのマルチプレクサは、信号を切り換える時間に余
裕が与えられる。したがって、それぞれのマルチプレク
サについてみると、等価的に切り換え動作速度を遅くで
きる。例えば、マルチプレクサをｍ個設けた場合には、
従来の構成で必要とされるマルチプレクサの動作速度の
ｍ分の１の動作速度まで遅いマルチプレクサを使用する
ことができる。尚、スイッチ手段としては、最終的なシ
リアルな画像信号の信号間隔程度の周期に対応する速度
でスイッチング可能なものが要求されるが、スイッチ手
段については、例えば半導体スイッチ回路を用いること
により、十分に高速なスイッチ手段を容易に入手でき
る。
【００１４】請求項２記載の発明は前記の構成により、
マルチプレクサを二つ設け、同一ブロックの偶数番目の
画像読み取り手段からの出力信号と奇数番目の画像読み
取り手段からの出力信号がそれぞれ異なるマルチプレク
サより出力されるようにすることにより、マルチプレク
サに要求される動作速度は、従来の回路構成で必要とさ
れる動作速度に比べて２分の１となる。また、回路構成
も従来のものを僅かに変更するだけで実現できる。
マルチプレクサを二つ設け、同一ブロックの偶数番目の
画像読み取り手段からの出力信号と奇数番目の画像読み
取り手段からの出力信号がそれぞれ異なるマルチプレク
サより出力されるようにすることにより、マルチプレク
サに要求される動作速度は、従来の回路構成で必要とさ
れる動作速度に比べて２分の１となる。また、回路構成
も従来のものを僅かに変更するだけで実現できる。
【００１５】
【実施例】以下に、図面を参照して一実施例について説
明する。図１は本発明の一実施例である密着型イメージ
センサの回路図、図２はマルチプレクサを一つだけ設け
たときの最終的なシリアル信号の一例を示す波形図、図
３はマルチプレクサを二つ設けたときのそれぞれのマル
チプレクサから出力されるシリアル信号の一例を示す波
形図である。尚、図１において図４と同一の部分につい
ては同一符号を付して、その詳細な説明を省略する。
明する。図１は本発明の一実施例である密着型イメージ
センサの回路図、図２はマルチプレクサを一つだけ設け
たときの最終的なシリアル信号の一例を示す波形図、図
３はマルチプレクサを二つ設けたときのそれぞれのマル
チプレクサから出力されるシリアル信号の一例を示す波
形図である。尚、図１において図４と同一の部分につい
ては同一符号を付して、その詳細な説明を省略する。
【００１６】図１に示す回路の密着型イメージセンサ
は、Ｇ４対応ファクシミリに用いられるもので、センサ
素子５０の線密度は１６素子／mmであり、Ａ３サイズ
（主走査方向の長さが304 mm）の原稿に対応するため、
全体で４８６４個のセンサ素子５０が含まれている。こ
れらのセンサ素子５０は、６４個ずつ７６ブロックに分
割されている。この６４という数は、出力回路Ｃ1 〜Ｃ
64の数に対応する。
は、Ｇ４対応ファクシミリに用いられるもので、センサ
素子５０の線密度は１６素子／mmであり、Ａ３サイズ
（主走査方向の長さが304 mm）の原稿に対応するため、
全体で４８６４個のセンサ素子５０が含まれている。こ
れらのセンサ素子５０は、６４個ずつ７６ブロックに分
割されている。この６４という数は、出力回路Ｃ1 〜Ｃ
64の数に対応する。
【００１７】入力回路Ａ1 〜Ａ76は、センサ素子５０の
ホトダイオードに蓄積された電荷を読み出すための入力
パルスを供給する回路で、対応するブロックＢ1 〜Ｂ76
に対して順次入力パルスが供給される。したがって、一
つのブロックに含まれる６４個のセンサ素子からは画像
信号が一斉に出力されて対応する出力回路Ｃ1 〜Ｃ64に
入る。
ホトダイオードに蓄積された電荷を読み出すための入力
パルスを供給する回路で、対応するブロックＢ1 〜Ｂ76
に対して順次入力パルスが供給される。したがって、一
つのブロックに含まれる６４個のセンサ素子からは画像
信号が一斉に出力されて対応する出力回路Ｃ1 〜Ｃ64に
入る。
【００１８】各出力回路Ｃ1 〜Ｃ64はアンプ、積分器、
サンプルホールド回路（図示せず）から構成され、それ
ぞれのブロックのセンサ素子５０からの画像信号をアン
プで増幅し、これを入力パルスのパルス幅の期間にわた
って積分器で積分し、この積分された電圧値を入力パル
スの終了直前にサンプルホールド回路によってサンプル
ホールドし、一定期間これを保持する。
サンプルホールド回路（図示せず）から構成され、それ
ぞれのブロックのセンサ素子５０からの画像信号をアン
プで増幅し、これを入力パルスのパルス幅の期間にわた
って積分器で積分し、この積分された電圧値を入力パル
スの終了直前にサンプルホールド回路によってサンプル
ホールドし、一定期間これを保持する。
【００１９】出力回路Ｃ1 〜Ｃ64の出力線ｒ1 〜ｒ64の
うち、奇数番目の出力線ｒ1 、ｒ3、・・・ｒ63は左側
のマルチプレクサ１０に接続され、偶数番目の出力線ｒ
2 、ｒ4 、・・・ｒ64は右側のマルチプレクサ１２に接
続されている。これにより、各ブロックのセンサ素子５
０のうち、ラインＬ1 、Ｌ3 、・・・Ｌ63に接続されて
いるものの信号はマルチプレクサ１０を経て出力され、
ラインＬ2 、Ｌ4 、・・・Ｌ64に接続されているものの
信号はマルチプレクサ１２を経て出力される。
うち、奇数番目の出力線ｒ1 、ｒ3、・・・ｒ63は左側
のマルチプレクサ１０に接続され、偶数番目の出力線ｒ
2 、ｒ4 、・・・ｒ64は右側のマルチプレクサ１２に接
続されている。これにより、各ブロックのセンサ素子５
０のうち、ラインＬ1 、Ｌ3 、・・・Ｌ63に接続されて
いるものの信号はマルチプレクサ１０を経て出力され、
ラインＬ2 、Ｌ4 、・・・Ｌ64に接続されているものの
信号はマルチプレクサ１２を経て出力される。
【００２０】図２及び図３は、マルチプレクサから出力
されるシリアル信号のレベル変化を比較して示した波形
図であり、このうち図２はマルチプレクサを一つだけ設
けた場合、図３（ａ）（ｂ）は二つのマルチプレクサ１
０、１２を設けた図１に示す本実施例の回路の場合であ
る。これらの図において、レベルを示す記号ｒ1 〜ｒ 64
は、図１の出力回路Ｃ1 〜Ｃ64の出力線ｒ1 〜ｒ64に対
応させて同じ記号とした。尚、ここではＧ４対応ファク
シミリの密着型イメージセンサを考え、１ブロックの読
み出し時間を１３．２μsec とする。
されるシリアル信号のレベル変化を比較して示した波形
図であり、このうち図２はマルチプレクサを一つだけ設
けた場合、図３（ａ）（ｂ）は二つのマルチプレクサ１
０、１２を設けた図１に示す本実施例の回路の場合であ
る。これらの図において、レベルを示す記号ｒ1 〜ｒ 64
は、図１の出力回路Ｃ1 〜Ｃ64の出力線ｒ1 〜ｒ64に対
応させて同じ記号とした。尚、ここではＧ４対応ファク
シミリの密着型イメージセンサを考え、１ブロックの読
み出し時間を１３．２μsec とする。
【００２１】任意のブロックに含まれる６４個のセンサ
素子５０から画像信号が読み出され、出力回路Ｃ1 〜Ｃ
64を経て図１の出力線ｒ1 〜ｒ64上に、図２に対応する
記号で示したレベルの画像信号がパラレルに出力された
とする。従来のように、マルチプレクサが一つしかない
場合には、そのマルチプレクサは図２に示すように６４
個のパラレル信号を約０．２０６μsec 周期で切り換え
動作を行って各信号をシリアルにして送出しなければな
らない。しかしながら、通常のマルチプレクサの性能で
は、０．２０６μsec 周期で切り換え動作を行うのは困
難である。
素子５０から画像信号が読み出され、出力回路Ｃ1 〜Ｃ
64を経て図１の出力線ｒ1 〜ｒ64上に、図２に対応する
記号で示したレベルの画像信号がパラレルに出力された
とする。従来のように、マルチプレクサが一つしかない
場合には、そのマルチプレクサは図２に示すように６４
個のパラレル信号を約０．２０６μsec 周期で切り換え
動作を行って各信号をシリアルにして送出しなければな
らない。しかしながら、通常のマルチプレクサの性能で
は、０．２０６μsec 周期で切り換え動作を行うのは困
難である。
【００２２】これに対して、図１に示すように二つのマ
ルチプレクサ１０及び１２を設けて同図のように配線す
ると、奇数番目の出力線ｒ1 、ｒ3 、・・・ｒ63上の信
号は左側のマルチプレクサ１０へ供給され、出力線
ｒ2 、ｒ4 、・・・ｒ64上の信号は右側のマルチプレク
サ１２へ供給される。マルチプレクサ１０及び１２から
の出力は、それぞれ図３（ａ）（ｂ）に示すようなシリ
アル信号となる。この場合の各マルチプレクサの切り換
え動作の周期は約０．４１２μsec となり、図２の場合
と比較して２倍の時間的余裕が生じる。そして、マルチ
プレクサ１０又は１２から出力されるシリアル信号は、
スイッチ１４によってスイッチングされ、交互に最終出
力ライン１６に送出される。したがって、最終出力ライ
ン１６上の信号の波形図は、図２に示したものと同様の
０．２０６μsec 間隔のシリアル信号となる。
ルチプレクサ１０及び１２を設けて同図のように配線す
ると、奇数番目の出力線ｒ1 、ｒ3 、・・・ｒ63上の信
号は左側のマルチプレクサ１０へ供給され、出力線
ｒ2 、ｒ4 、・・・ｒ64上の信号は右側のマルチプレク
サ１２へ供給される。マルチプレクサ１０及び１２から
の出力は、それぞれ図３（ａ）（ｂ）に示すようなシリ
アル信号となる。この場合の各マルチプレクサの切り換
え動作の周期は約０．４１２μsec となり、図２の場合
と比較して２倍の時間的余裕が生じる。そして、マルチ
プレクサ１０又は１２から出力されるシリアル信号は、
スイッチ１４によってスイッチングされ、交互に最終出
力ライン１６に送出される。したがって、最終出力ライ
ン１６上の信号の波形図は、図２に示したものと同様の
０．２０６μsec 間隔のシリアル信号となる。
【００２３】このように二つのマルチプレクサ１０及び
１２を設けると、各マルチプレクサの切り換え動作の周
期は、マルチプレクサを一つしか設けないときに比べて
２倍となり、その分マルチプレクサの性能上の許容範囲
が広がる。実際、０．４１２μsec 周期での切り換え動
作は、通常のマルチプレクサにおいて十分可能であり、
したがって、Ｇ４対応のファクシミリについても通常の
マルチプレクサをそのまま使用することができる。尚、
二つのマルチプレクサを設けると、これらを切り換える
ためのスイッチ１４が必要となり、これを０．２０６μ
sec 周期で切り換えなければならないが、市販されてい
る半導体スイッチを用いれば、かかる切り換え動作は問
題なく行うことができる。
１２を設けると、各マルチプレクサの切り換え動作の周
期は、マルチプレクサを一つしか設けないときに比べて
２倍となり、その分マルチプレクサの性能上の許容範囲
が広がる。実際、０．４１２μsec 周期での切り換え動
作は、通常のマルチプレクサにおいて十分可能であり、
したがって、Ｇ４対応のファクシミリについても通常の
マルチプレクサをそのまま使用することができる。尚、
二つのマルチプレクサを設けると、これらを切り換える
ためのスイッチ１４が必要となり、これを０．２０６μ
sec 周期で切り換えなければならないが、市販されてい
る半導体スイッチを用いれば、かかる切り換え動作は問
題なく行うことができる。
【００２４】本発明は上記実施例に限定されるものでは
なく、その要旨の範囲内で種々の変更が可能である。例
えば、上記実施例はマルチプレクサを二つ設けた場合で
あるが、本発明はこれに限定されるものではなく、マル
チプレクサを三つ以上設けてスイッチを多接点のものと
することも可能である。マルチプレクサの数が増えれ
ば、それだけマルチプレクサの切り換え動作の周期が長
くなるので、マルチプレクサの負担がより軽減されると
いう利点がある。ただし、その場合には、同一ブロック
内に含まれるセンサ素子のうち、隣合うセンサ素子から
の出力信号が常に異なるマルチプレクサより出力される
ように配線する必要がある。
なく、その要旨の範囲内で種々の変更が可能である。例
えば、上記実施例はマルチプレクサを二つ設けた場合で
あるが、本発明はこれに限定されるものではなく、マル
チプレクサを三つ以上設けてスイッチを多接点のものと
することも可能である。マルチプレクサの数が増えれ
ば、それだけマルチプレクサの切り換え動作の周期が長
くなるので、マルチプレクサの負担がより軽減されると
いう利点がある。ただし、その場合には、同一ブロック
内に含まれるセンサ素子のうち、隣合うセンサ素子から
の出力信号が常に異なるマルチプレクサより出力される
ように配線する必要がある。
【００２５】
【発明の効果】以上説明したように、本発明によれば、
画像読み取り手段の数が増加してシリアルに送出される
各画像信号の時間間隔が短くなっても、複数のマルチプ
レクサを設けることによって、パラレル信号からシリア
ル信号へ変換するマルチプレクサの切り換え周期をマル
チプレクサの数に比例して長くでき、したがって、例え
ば従来のＧ３対応ファクシミリ用の密着型イメージセン
サに用いられていた通常の動作速度を有するマルチプレ
クサをそのまま用いて、Ｇ４対応ファクシミリの画像信
号間隔に対応できる密着型イメージセンサを提供するこ
とができる。
画像読み取り手段の数が増加してシリアルに送出される
各画像信号の時間間隔が短くなっても、複数のマルチプ
レクサを設けることによって、パラレル信号からシリア
ル信号へ変換するマルチプレクサの切り換え周期をマル
チプレクサの数に比例して長くでき、したがって、例え
ば従来のＧ３対応ファクシミリ用の密着型イメージセン
サに用いられていた通常の動作速度を有するマルチプレ
クサをそのまま用いて、Ｇ４対応ファクシミリの画像信
号間隔に対応できる密着型イメージセンサを提供するこ
とができる。
【図１】本発明の一実施例の密着型イメージセンサの回
路図である。
路図である。
【図２】マルチプレクサを一つだけ設けたときのマルチ
プレクサからのシリアル出力信号の一例を示す波形図で
ある。
プレクサからのシリアル出力信号の一例を示す波形図で
ある。
【図３】マルチプレクサを二つ設けたときの、各マルチ
プレクサから出力されるシリアル信号の一例を示す波形
図である。
プレクサから出力されるシリアル信号の一例を示す波形
図である。
【図４】従来の密着型イメージセンサの一例の回路図で
ある。
ある。
【図５】ホトダイオードとブロッキングダイオードがフ
ロント・トゥ・フロントに接続されてなるセンサ素子の
回路図である。
ロント・トゥ・フロントに接続されてなるセンサ素子の
回路図である。
１０、１２、５２ マルチプレクサ １４ スイッチ １６ 最終出力ライン ５０ センサ素子 ５０ａ ホトダイオード ５０ｂ ブロッキングダイオード Ａ1 〜Ａ76 入力回路 Ｂ1 〜Ｂ54 各ブロック Ｃ1 〜Ｃ64 出力回路 Ｌ1 〜Ｌ64 ライン ｒ1 〜ｒ64 出力線
───────────────────────────────────────────────────── フロントページの続き (72)発明者 長竹 洋一 東京都千代田区大手町２丁目６番３号 新 日本製鐵株式会社内
Claims (2)
- 【請求項１】 複数の画像読み取り手段を出力回路のチ
ャンネル数と同じ数ずつ複数のブロックに分け、各ブロ
ックに含まれる対応する画像読み取り手段からの信号が
同一の出力回路に供給されるよう前記複数の画像読み取
り手段をマトリックス接続し、前記ブロック単位で同時
に前記画像読み取り手段を駆動したときの前記出力回路
からのパラレル信号をマルチプレクサによりシリアル信
号に変換して出力するという動作をすべてのブロックに
ついて順次行なう密着型イメージセンサにおいて、 前記マルチプレクサを複数設け、同一ブロック内の前記
画像読み取り手段のうち隣合うものからの出力信号が異
なるマルチプレクサより出力されるよう前記各出力回路
を前記複数のマルチプレクサに接続するとともに、前記
複数のマルチプレクサからの信号を所定の順序でスイッ
チングするスイッチ手段を設けたことを特徴とする密着
型イメージセンサ。 - 【請求項２】 前記複数のマルチプレクサの数は二つと
し、同一ブロックの偶数番目の画像読み取り手段からの
出力信号と奇数番目の画像読み取り手段からの出力信号
がそれぞれ異なるマルチプレクサより出力されるように
前記出力回路を接続したことを特徴とする請求項１記載
の密着型イメージセンサ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6051184A JPH07236026A (ja) | 1994-02-24 | 1994-02-24 | 密着型イメージセンサ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6051184A JPH07236026A (ja) | 1994-02-24 | 1994-02-24 | 密着型イメージセンサ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07236026A true JPH07236026A (ja) | 1995-09-05 |
Family
ID=12879775
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6051184A Withdrawn JPH07236026A (ja) | 1994-02-24 | 1994-02-24 | 密着型イメージセンサ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07236026A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8693063B2 (en) | 2005-06-30 | 2014-04-08 | Brother Kogyo Kabushiki Kaisha | Image-reading device |
-
1994
- 1994-02-24 JP JP6051184A patent/JPH07236026A/ja not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8693063B2 (en) | 2005-06-30 | 2014-04-08 | Brother Kogyo Kabushiki Kaisha | Image-reading device |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20010508 |