JPH0716192B2 - 画像記録装置のシリアル通信制御装置 - Google Patents
画像記録装置のシリアル通信制御装置Info
- Publication number
- JPH0716192B2 JPH0716192B2 JP59142138A JP14213884A JPH0716192B2 JP H0716192 B2 JPH0716192 B2 JP H0716192B2 JP 59142138 A JP59142138 A JP 59142138A JP 14213884 A JP14213884 A JP 14213884A JP H0716192 B2 JPH0716192 B2 JP H0716192B2
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- Japan
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- block
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Description
【発明の詳細な説明】 産業上の利用分野 本発明は数種類の付加装置のうち、何種類かを選択的に
接続して使用する複写機、ファクシミリ等の画像記録装
置における通信制御方式に関するものである。
接続して使用する複写機、ファクシミリ等の画像記録装
置における通信制御方式に関するものである。
従来技術 画像記録装置のうちで例えば複写機において、その付加
装置とは自動原稿搬送装置（SADH）、コピー用紙丁合装
置（ソータ）、文字表示装置（α／ディスプレイ）、コ
ピア制御用不揮発性メモリデータ出力装置（ミニプリン
タ）等といったものがある。
装置とは自動原稿搬送装置（SADH）、コピー用紙丁合装
置（ソータ）、文字表示装置（α／ディスプレイ）、コ
ピア制御用不揮発性メモリデータ出力装置（ミニプリン
タ）等といったものがある。
これら付加装置は選択的に使用可能なものであって、使
用者側の要望によって接続される付加装置は異なるもの
である。
用者側の要望によって接続される付加装置は異なるもの
である。
従来は接続可能な付加装置すべてについてその接続用イ
ンタフェースを複写機本体側に用意していた。
ンタフェースを複写機本体側に用意していた。
発明が解決しようとする問題点 したがって使用者が不要とする付加装置についてまでそ
の接続用インタフェースを用意しておくことはコストが
嵩み、不経済であった。
の接続用インタフェースを用意しておくことはコストが
嵩み、不経済であった。
そこで、画像記録装置本体と各付加装置とをシリアルラ
インで接続して制御データを時分割で送信することも考
えられるが、画像記録装置はコロトロンや静電気による
ノイズが発生する場合が多く、これらのノイズが原因し
て誤動作や故障が生じ易い。
インで接続して制御データを時分割で送信することも考
えられるが、画像記録装置はコロトロンや静電気による
ノイズが発生する場合が多く、これらのノイズが原因し
て誤動作や故障が生じ易い。
また各付加装置が自らの制御データ以外のデータも全て
受信しなければデータの種類が識別できる受信効率が良
くない。
受信しなければデータの種類が識別できる受信効率が良
くない。
問題点を解決するための手段および作用 そこで本発明はこのような問題点を解決するために、図
１に示すように、本体Ａと、シリアルラインＣにより前
記本体Ａに接続される複数の付加装置B1,B2,……Bnとか
らなり、本体Ａ側に送信手段ａが設けられ、付加装置
B1,B2,……Bn側にそれぞれ受信手段b1,b2,……bnが設け
られた画像記録装置のシリアル通信制御装置である。
１に示すように、本体Ａと、シリアルラインＣにより前
記本体Ａに接続される複数の付加装置B1,B2,……Bnとか
らなり、本体Ａ側に送信手段ａが設けられ、付加装置
B1,B2,……Bn側にそれぞれ受信手段b1,b2,……bnが設け
られた画像記録装置のシリアル通信制御装置である。
そして前記送信手段ａは、使用している付加装置にそれ
ぞれ対応するブロックデータを使用している全ての付加
装置を一巡する周期で各付加装置に対して順次送信する
ことを繰り返し行うものであり、前記ブロックデータ
は、一定のビット数からなる１バイトのコントロールア
ドレスデータと、それに続く１バイト以上のインタフェ
ースデータと、それに続く１バイトのブロックチェック
キャラクタからなり、前記コントロールアドレスデータ
は、データの種類を識別するための符号と、前記付加装
置を選択するための選択用データと、前記インタフェー
スデータのバイト数を示すブロック長データと、バイト
毎の垂直パリティチェックとを各々所定ビットで構成
し、前記インタフェースデータは、データの種類を識別
するための符号と、付加装置を制御するための制御内容
を示す制御データと、バイト毎の垂直パリティチェック
とを各々所定ビットで構成し、前記ブロックチェックキ
ャラクタは、前記コントロールアドレスデータ並びに前
記インタフェースデータの水平パリティチェックを備え
る。
ぞれ対応するブロックデータを使用している全ての付加
装置を一巡する周期で各付加装置に対して順次送信する
ことを繰り返し行うものであり、前記ブロックデータ
は、一定のビット数からなる１バイトのコントロールア
ドレスデータと、それに続く１バイト以上のインタフェ
ースデータと、それに続く１バイトのブロックチェック
キャラクタからなり、前記コントロールアドレスデータ
は、データの種類を識別するための符号と、前記付加装
置を選択するための選択用データと、前記インタフェー
スデータのバイト数を示すブロック長データと、バイト
毎の垂直パリティチェックとを各々所定ビットで構成
し、前記インタフェースデータは、データの種類を識別
するための符号と、付加装置を制御するための制御内容
を示す制御データと、バイト毎の垂直パリティチェック
とを各々所定ビットで構成し、前記ブロックチェックキ
ャラクタは、前記コントロールアドレスデータ並びに前
記インタフェースデータの水平パリティチェックを備え
る。
また前記受信手段b1,b2,…bnは、前記送信手段ａにより
送信される各ブロックデータの前記符号を入力し、入力
した符号が前記選択用データを含む前記コントロールア
ドレスデータである場合は前記選択用データを入力し、
入力した選択用データが自らの付加装置を選択するもの
であると判断した場合に該ブロックデータが有する前記
ブロック長データが示すバイト数の前記インタフェース
データを受信する。
送信される各ブロックデータの前記符号を入力し、入力
した符号が前記選択用データを含む前記コントロールア
ドレスデータである場合は前記選択用データを入力し、
入力した選択用データが自らの付加装置を選択するもの
であると判断した場合に該ブロックデータが有する前記
ブロック長データが示すバイト数の前記インタフェース
データを受信する。
本発明は、以上のような構成からなり、送信手段ａが送
信するブロックデータには、バイト毎のパリティチェッ
クを行う垂直パリティチェックと、前記コントロールア
ドレスデータ並びに前記インタフェースデータの各バイ
トのパリティチェックを行う水平パリティチェックとを
含み、２重のエラーチェックを行い厳格なノイズ対策を
行っている。
信するブロックデータには、バイト毎のパリティチェッ
クを行う垂直パリティチェックと、前記コントロールア
ドレスデータ並びに前記インタフェースデータの各バイ
トのパリティチェックを行う水平パリティチェックとを
含み、２重のエラーチェックを行い厳格なノイズ対策を
行っている。
また送信されるブロックデータの各バイトはデータの種
類を識別するための符号を有しているので、各受信手段
b1,b2,…bnは入力した前記符号が選択用データを含むコ
ントロールアドレスデータである場合は選択用データを
入力し、入力した選択用データが自らの付加装置を選択
するものであると判断した場合に該ブロックデータが有
する前記ブロック長データが示すバイト数の前記インタ
フェースデータを受信する。
類を識別するための符号を有しているので、各受信手段
b1,b2,…bnは入力した前記符号が選択用データを含むコ
ントロールアドレスデータである場合は選択用データを
入力し、入力した選択用データが自らの付加装置を選択
するものであると判断した場合に該ブロックデータが有
する前記ブロック長データが示すバイト数の前記インタ
フェースデータを受信する。
したがって受信手段b1,b2…bnは入力した選択用データ
が自らを選択するものでないと判断したときは次に続く
インタフェースデータはデータの種類を識別する符号の
みを入力し全てを受信する必要がなく、効率的に必要な
データのみを受信することができる。
が自らを選択するものでないと判断したときは次に続く
インタフェースデータはデータの種類を識別する符号の
みを入力し全てを受信する必要がなく、効率的に必要な
データのみを受信することができる。
実施例 以下第２図ないし第４図に図示する本発明の実施例にし
たがってさらに詳しく説明する。
たがってさらに詳しく説明する。
本実施例は複写機に自動原稿搬送装置（SADH）、コピー
用紙丁合装置（ソータ）および文字表示装置（α/Nディ
スプレイ）等を接続したものである。
用紙丁合装置（ソータ）および文字表示装置（α/Nディ
スプレイ）等を接続したものである。
共通シリアルライン上にのせられるデータは第２図
（ａ）に示すように順次ブロック毎に各付加装置が対応
し、その１ブロックの内容は第２図（ｂ）に示すように
初めのコントロールアドレスデータ２につづいて単数ま
たは複数のインタフェースデータ３および最後のブロッ
クチェックキャラクタ４からなりたっている。
（ａ）に示すように順次ブロック毎に各付加装置が対応
し、その１ブロックの内容は第２図（ｂ）に示すように
初めのコントロールアドレスデータ２につづいて単数ま
たは複数のインタフェースデータ３および最後のブロッ
クチェックキャラクタ４からなりたっている。
コントロールアドレスデータ２は付加装置の選択および
データ数を示し、インタフェースデータ３は制御内容を
示し、ブロックチェックキャラクタ４はブロック毎のパ
リティチェック（水平パリティチェック）を行うもので
それぞれ、11ビットによりなり、１バイトを構成してい
る。
データ数を示し、インタフェースデータ３は制御内容を
示し、ブロックチェックキャラクタ４はブロック毎のパ
リティチェック（水平パリティチェック）を行うもので
それぞれ、11ビットによりなり、１バイトを構成してい
る。
コントロールアドレスデータ２とインタフェースデータ
３の内容を第２図（ｃ）によりさらに詳しくみてみる
と、各バイトの先頭ビット５はスタートビットとされ常
に“0"が送信され、後尾ビット10はストップビットとし
て常に“1"が送信される。
３の内容を第２図（ｃ）によりさらに詳しくみてみる
と、各バイトの先頭ビット５はスタートビットとされ常
に“0"が送信され、後尾ビット10はストップビットとし
て常に“1"が送信される。
２番目のビット６はコントロールビットであり、当該バ
イトが示す内容はコントロールアドレスデータであるの
かその他インタフェースデータまたはブロックチェック
キャラキタであるかを示すもので“1"ならばコントロー
ルアドレスデータを、“0"ならばその他のものを示す。
イトが示す内容はコントロールアドレスデータであるの
かその他インタフェースデータまたはブロックチェック
キャラキタであるかを示すもので“1"ならばコントロー
ルアドレスデータを、“0"ならばその他のものを示す。
コントロールアドレスデータ２に関して、コントロール
ビット６に続く３ビット７は付加装置のアドレスを示
し、例えばSADHならば“000"ソータならば“001"という
ように各付加装置に対応して付されるアドレスが送信さ
れる。
ビット６に続く３ビット７は付加装置のアドレスを示
し、例えばSADHならば“000"ソータならば“001"という
ように各付加装置に対応して付されるアドレスが送信さ
れる。
またそのあとに続く４ビット８は１ブロックにおける転
送データ数を２進で示しており、例えば“0100"ならば
４バイトのデータが１ブロックに含まれていることを示
している。
送データ数を２進で示しており、例えば“0100"ならば
４バイトのデータが１ブロックに含まれていることを示
している。
さらにそのあとに続く１ビット９はバイト毎のパリティ
チェック（垂直パリティチェック）を行うものである。
チェック（垂直パリティチェック）を行うものである。
インタフェースデータ３についてはスタートビット５、
コントロールビット６、垂直パリティチェック９および
ストップビット10以外の７ビット11はアドレスビット７
で示された付加装置の制御内容が書き込まれていて、付
加装置の必要に応じて複数のインタフェースデータを備
える。
コントロールビット６、垂直パリティチェック９および
ストップビット10以外の７ビット11はアドレスビット７
で示された付加装置の制御内容が書き込まれていて、付
加装置の必要に応じて複数のインタフェースデータを備
える。
ブロックチェックキャラキタ４についても、スタートビ
ット５、コントロールビット６、垂直パリティチェック
９およびストップビット10以外の７ビットが水平パリテ
ィチェック用のビットである。
ット５、コントロールビット６、垂直パリティチェック
９およびストップビット10以外の７ビットが水平パリテ
ィチェック用のビットである。
したがって第２図（ｃ）に示されたコントロールアドレ
スデータ２の場合は、スタートビット５の“0"で１バイ
トの開始を示し２番目のコントロールビット６の“1"で
当該バイトがコントロールアドレスデータであることを
示し、次の３ビット７の“000"で当該ブロックがSADHの
ためのデータであることを示し、次の４ビット８の“01
00"で当該ブロックが４バイトで構成されていて、以下
の２バイトがインタフェースデータ、１バイトがブロッ
クチェックキャラクタであることを示し、次の１ビット
９の“0"は１バイト中のビットの内容が“1"であるビッ
ト数が自分自身を含めて、奇数となるように“0"として
該バイトのパリティチェックを行い、次のストップビッ
ト10の“1"で１バイトの終了を示している。
スデータ２の場合は、スタートビット５の“0"で１バイ
トの開始を示し２番目のコントロールビット６の“1"で
当該バイトがコントロールアドレスデータであることを
示し、次の３ビット７の“000"で当該ブロックがSADHの
ためのデータであることを示し、次の４ビット８の“01
00"で当該ブロックが４バイトで構成されていて、以下
の２バイトがインタフェースデータ、１バイトがブロッ
クチェックキャラクタであることを示し、次の１ビット
９の“0"は１バイト中のビットの内容が“1"であるビッ
ト数が自分自身を含めて、奇数となるように“0"として
該バイトのパリティチェックを行い、次のストップビッ
ト10の“1"で１バイトの終了を示している。
なおブロックチェックキャラクタ４は１ブロック中のコ
ントロールアドレスデータおよびインタフェースデータ
の同一桁のビットの内容を水平パリティチェックするも
ので前記垂直パリティチェックとともに転送中に生じる
内容の誤りを二重に監視している。
ントロールアドレスデータおよびインタフェースデータ
の同一桁のビットの内容を水平パリティチェックするも
ので前記垂直パリティチェックとともに転送中に生じる
内容の誤りを二重に監視している。
以上のデータを4800BPSの転送速度で送信しているので
１バイトは約2.3msec程度の時間となる。
１バイトは約2.3msec程度の時間となる。
第３図は複写機本体からSADHへの送受信回路を示してお
り、本体側ではインバータ20および平衡出力ゲート21よ
りなるラインドライバー22により20mAカレントループで
データが平衡線29にのせられて出力され、SADHの受信側
では平衡線29は各々について２個の抵抗23,24（抵抗24
は一端をアース）を介してフォトカプラ25の発光ダイオ
ード26の両端に接続され、フォトトランジスタ27の出力
はバッファ28を介してSADHのCPUに入力される。
り、本体側ではインバータ20および平衡出力ゲート21よ
りなるラインドライバー22により20mAカレントループで
データが平衡線29にのせられて出力され、SADHの受信側
では平衡線29は各々について２個の抵抗23,24（抵抗24
は一端をアース）を介してフォトカプラ25の発光ダイオ
ード26の両端に接続され、フォトトランジスタ27の出力
はバッファ28を介してSADHのCPUに入力される。
以上のように、ノイズによる誤信号をできるだけ排除し
て送信を確実にしているのはコントロールアドレスデー
タの内容のうちアドレス用ビット７の内容が誤った場
合、別の付加装置が指定されて、全く関係のない制御内
容が該付加装置に入力され、誤動作を起こし、最悪の場
合は故障を起こすことになるからである。
て送信を確実にしているのはコントロールアドレスデー
タの内容のうちアドレス用ビット７の内容が誤った場
合、別の付加装置が指定されて、全く関係のない制御内
容が該付加装置に入力され、誤動作を起こし、最悪の場
合は故障を起こすことになるからである。
なお複写機本体側から引き出される平衡線29に他の複数
の付加装置がSADHと同様の方式で接続される。
の付加装置がSADHと同様の方式で接続される。
ここで受信側のデータ入力方式について第４図にしたが
って説明する。
って説明する。
受信側では入力データラインのビットの中央値をサンプ
リングできる内部クロックを有していて第４図において
上段の入力データラインにのせられるデータを下段の内
部クロックが図のように対応して入力する。
リングできる内部クロックを有していて第４図において
上段の入力データラインにのせられるデータを下段の内
部クロックが図のように対応して入力する。
いま、クロック１と２の論理和が“0"でスタートビット
を検出すると、クロック４で読み込んだ内容が“1"なら
ばコントロールアドレスデータと判断し、“0"ならばイ
ンタフェースデータまたはブロックチェックキャラクタ
と判断する。
を検出すると、クロック４で読み込んだ内容が“1"なら
ばコントロールアドレスデータと判断し、“0"ならばイ
ンタフェースデータまたはブロックチェックキャラクタ
と判断する。
コントロールアドレスデータと判断したときは、さらに
次のクロック6,8,10で読み込んだ内容の論理和をとり、
その和が“0"のときは、SADHに送信されたデータである
と判断し、またはその他“1"のときはソータへの送信デ
ータというように判断する。
次のクロック6,8,10で読み込んだ内容の論理和をとり、
その和が“0"のときは、SADHに送信されたデータである
と判断し、またはその他“1"のときはソータへの送信デ
ータというように判断する。
このようにして受信側では入力データを読み込んで判断
していくことができる。
していくことができる。
以上のように本実施例では複数の付加装置が接続される
場合でも複写機本体側の出力インタフェースは１つでよ
く、その出力ラインに各付加装置を並列に接続すればよ
いので、経済的であるとともに信頼性も高い。
場合でも複写機本体側の出力インタフェースは１つでよ
く、その出力ラインに各付加装置を並列に接続すればよ
いので、経済的であるとともに信頼性も高い。
また新たに別の付加装置を接続する場合でもハードウェ
アにおいて共通データラインに接続するだけでよく、あ
とはその付加装置用のブロックを転送データに追加する
だけで済む。
アにおいて共通データラインに接続するだけでよく、あ
とはその付加装置用のブロックを転送データに追加する
だけで済む。
なお本実施例では転送速度を4800BPSとしたがこれは限
定されたものではなく、さらに速いものでも適用であ
る。
定されたものではなく、さらに速いものでも適用であ
る。
また１バイトを11ビットとしているが制御対象が多数あ
る付加装置の場合などのため、ビット数増やすこと、場
合によっては減らすことも可能である。
る付加装置の場合などのため、ビット数増やすこと、場
合によっては減らすことも可能である。
さらに新しい付加装置が開発された場合でも接続して、
利用することが簡単にできる。
利用することが簡単にできる。
発明の効果 このように本発明は画像記録装置本体側の出力本数が１
本でよく、コントローラー用のボード及びインタフェー
スのコストが安価で済み、かつ付加装置との接続が簡略
され便利であるとともに、信頼性の向上も図れ、さらに
接続できる付加装置類を単純に増やすことができるのは
便利である。
本でよく、コントローラー用のボード及びインタフェー
スのコストが安価で済み、かつ付加装置との接続が簡略
され便利であるとともに、信頼性の向上も図れ、さらに
接続できる付加装置類を単純に増やすことができるのは
便利である。
送信するブロックデータ中に、垂直パリティチェックと
水平パリティチェックとの２重のパリティチェックを有
し厳格なノイズ対策を施しているので、画像記録装置に
生じ安い誤動作や故障の発生を可及的に防止している。
水平パリティチェックとの２重のパリティチェックを有
し厳格なノイズ対策を施しているので、画像記録装置に
生じ安い誤動作や故障の発生を可及的に防止している。
また送信データ中には、バイト毎にデータの種類を識別
するための符号を備え、ブロックデータ中最先のコント
ロールアドレスデータに選択用データを含んでいるの
で、受信側で必要のないインタフェースデータを全部受
信する必要がなく効率的である。
するための符号を備え、ブロックデータ中最先のコント
ロールアドレスデータに選択用データを含んでいるの
で、受信側で必要のないインタフェースデータを全部受
信する必要がなく効率的である。
第１図は本発明のクレーム対応図、第２図は本発明に係
る実施例における送信されるデータ内容を示した図、第
３図は本実施例の送受信回路を示した図、第４図は本実
施例における入力データの入力方式を説明する図であ
る。 １……ブロック、２……コントロールアドレスデータ、
３……インタフェースデータ、４……ブロックチェック
キャラクタ、５……スタートビット、６……コントロー
ルビット、７……アドレスビット、８……データ数ビッ
ト、９……垂直パリティチェックビット、10……ストッ
プビット、11……インタフェースデータビット、20……
インバータ、21……平衡出力ゲート、22……ラインドラ
イバー、23,24……抵抗、25……フォトカプラ、26……
発光ダイオード、27……フォトトランジスタ、28……バ
ッファ、29……平衡線。
る実施例における送信されるデータ内容を示した図、第
３図は本実施例の送受信回路を示した図、第４図は本実
施例における入力データの入力方式を説明する図であ
る。 １……ブロック、２……コントロールアドレスデータ、
３……インタフェースデータ、４……ブロックチェック
キャラクタ、５……スタートビット、６……コントロー
ルビット、７……アドレスビット、８……データ数ビッ
ト、９……垂直パリティチェックビット、10……ストッ
プビット、11……インタフェースデータビット、20……
インバータ、21……平衡出力ゲート、22……ラインドラ
イバー、23,24……抵抗、25……フォトカプラ、26……
発光ダイオード、27……フォトトランジスタ、28……バ
ッファ、29……平衡線。
Claims (1)
- 【請求項１】本体と、シリアルラインにより前記本体に
接続される複数の付加装置と、前記本体側に設けられた
送信手段と、前記付加装置側に設けられた受信手段とを
具備した画像記録装置のシリアル通信制御装置におい
て、 前記送信手段は、 使用している付加装置にそれぞれ対応するブロックデー
タを使用している全ての付加装置を一巡する周期で各付
加装置に対して順次送信することを繰り返し行うもので
あり、 前記ブロックデータは、一定のビット数からなる１バイ
トのコントロールアドレスデータと、それに続く１バイ
ト以上のインタフェースデータと、それに続く１バイト
のブロックチェックキャラクタからなり、 前記コントロールアドレスデータは、データの種類を識
別するための符号と、前記付加装置を選択するための選
択用データと、前記インタフェースデータのバイト数を
示すブロック長データと、バイト毎の垂直パリティチェ
ックとを各々所定ビットで構成し、 前記インタフェースデータは、データの種類を識別する
ための符号と、付加装置を制御するための制御内容を示
す制御データと、バイト毎の垂直パリティチェックとを
各々所定ビットで構成し、 前記ブロックチェックキャラクタは、前記コントロール
アドレスデータ並びに前記インタフェースデータの水平
パリティチェックを備え、 前記受信手段は、 前記送信手段により送信される各ブロックデータの前記
符号を入力し、 入力した符号が前記選択用データを含む前記コントロー
ルアドレスデータである場合は前記選択用データを入力
し、 入力した選択用データが自らの付加装置を選択するもの
であると判断した場合に該ブロックデータが有する前記
ブロック長データが示すバイト数の前記インタフェース
データを受信することを特徴とする画像記録装置のシリ
アル通信制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59142138A JPH0716192B2 (ja) | 1984-07-11 | 1984-07-11 | 画像記録装置のシリアル通信制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59142138A JPH0716192B2 (ja) | 1984-07-11 | 1984-07-11 | 画像記録装置のシリアル通信制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6123443A JPS6123443A (ja) | 1986-01-31 |
| JPH0716192B2 true JPH0716192B2 (ja) | 1995-02-22 |
Family
ID=15308246
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59142138A Expired - Fee Related JPH0716192B2 (ja) | 1984-07-11 | 1984-07-11 | 画像記録装置のシリアル通信制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0716192B2 (ja) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52127579A (en) * | 1976-04-16 | 1977-10-26 | Hitachi Ltd | Remote monitor control sytem |
| JPS58148595A (ja) * | 1982-02-27 | 1983-09-03 | Matsushita Electric Works Ltd | 多重伝送制御システム |
-
1984
- 1984-07-11 JP JP59142138A patent/JPH0716192B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6123443A (ja) | 1986-01-31 |
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