JPH0696560A - データ記憶装置のインデクスパルス発生装置及びディスクドライブ - Google Patents
データ記憶装置のインデクスパルス発生装置及びディスクドライブInfo
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- JPH0696560A JPH0696560A JP3014415A JP1441591A JPH0696560A JP H0696560 A JPH0696560 A JP H0696560A JP 3014415 A JP3014415 A JP 3014415A JP 1441591 A JP1441591 A JP 1441591A JP H0696560 A JPH0696560 A JP H0696560A
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-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel
- G11B27/19—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier
- G11B27/28—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording
- G11B27/30—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording
- G11B27/3027—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording used signal is digitally coded
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B5/48—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed
- G11B5/58—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed with provision for moving the head for the purpose of maintaining alignment of the head relative to the record carrier during transducing operation, e.g. to compensate for surface irregularities of the latter or for track following
- G11B5/596—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed with provision for moving the head for the purpose of maintaining alignment of the head relative to the record carrier during transducing operation, e.g. to compensate for surface irregularities of the latter or for track following for track following on disks
- G11B5/59633—Servo formatting
Abstract
(57)【要約】 （修正有）
【目的】磁気ディスクパックのサーボ面から読み戻され
るインデクスマーク情報にエラートレランスを提供す
る。 【構成】リードバック回路３６はサーボ面３４上の磁気
ヘッド２６からの生データ信号をデジタルパルスへ変換
する。リードバック回路３６の出力によりインデクスマ
ーク検出回路３８が駆動され、インデクスマーク検出回
路３８はエラートレラントインデクス発生法を使用して
インデクスパルス出力を与える。特定のサーボインデク
スフレームを含み、そこまでの、すぐ先行する一連の連
続サーボデータフレーム内に冗長度を有する非ゼロコー
ドの増分シーケンスが書き込まれる。エラートレラント
回路がサーボフレームデータを読み取って復号し遭遇す
る非ゼロコードのカウントを維持し、非ゼロコードの所
望カウントに達し且つ非ゼロフレームカウンタと実際の
フレームデコード間の最少マッチ数が満されるとインデ
クスパルスを発生する。
るインデクスマーク情報にエラートレランスを提供す
る。 【構成】リードバック回路３６はサーボ面３４上の磁気
ヘッド２６からの生データ信号をデジタルパルスへ変換
する。リードバック回路３６の出力によりインデクスマ
ーク検出回路３８が駆動され、インデクスマーク検出回
路３８はエラートレラントインデクス発生法を使用して
インデクスパルス出力を与える。特定のサーボインデク
スフレームを含み、そこまでの、すぐ先行する一連の連
続サーボデータフレーム内に冗長度を有する非ゼロコー
ドの増分シーケンスが書き込まれる。エラートレラント
回路がサーボフレームデータを読み取って復号し遭遇す
る非ゼロコードのカウントを維持し、非ゼロコードの所
望カウントに達し且つ非ゼロフレームカウンタと実際の
フレームデコード間の最少マッチ数が満されるとインデ
クスパルスを発生する。
Description
【０００１】
【産業上の利用分野】本発明は磁気ディスク記憶装置内
のインデクスマークを捜し出すことに関する。
のインデクスマークを捜し出すことに関する。
【０００２】
【従来の技術】コンピュータディスクドライブ等の磁気
記憶装置では、磁気記憶ディスク等の磁気媒体の表面上
にデジタル情報が磁気的に記憶される。デジタル情報は
磁気ディスク表面上の連続領域の磁界を選択的に分極さ
せて表示される。この情報を記憶ディスクから読み戻す
時には、媒体の磁気分極を感知して電気的出力信号へ変
換する。リード及びライト動作は回転ディスク表面上を
“飛び回って”出力信号を与える磁気リード／ライトヘ
ッドにより行われる。
記憶装置では、磁気記憶ディスク等の磁気媒体の表面上
にデジタル情報が磁気的に記憶される。デジタル情報は
磁気ディスク表面上の連続領域の磁界を選択的に分極さ
せて表示される。この情報を記憶ディスクから読み戻す
時には、媒体の磁気分極を感知して電気的出力信号へ変
換する。リード及びライト動作は回転ディスク表面上を
“飛び回って”出力信号を与える磁気リード／ライトヘ
ッドにより行われる。
【０００３】代表的に、ディスクドライブの記憶ディス
クは“ディスクパック”内に積み重ねられている。パッ
ク内の各ディスクの両面が情報を記憶するのに使用され
る。パック内の各ディスクの各面にその特定面に対して
情報を読み書きするための少くとも１個の磁気ヘッドが
ある。代表的に、全ての磁気ヘッドは同じ時間に同じデ
ィスク半径にあるように、ディスク表面上を半径方向に
タンデム移動する。“シリンダ”が同じ半径にあって、
一般的に、集合ヘッドにより同時にアクセスされるディ
スクパック内のディスク表面上の１組の特定トラックを
識別する。シリンダ内の各トラックはフレームすなわち
データを保持するセクターへ分割される。サーボ面がパ
ック内の１枚のディスクの一面を占有してコントローラ
が使用する情報を保持し、とりわけ、サーボ面上の特定
フレーム（“インデクスフレーム”）が検出される時に
インデクスパルスを発生する。サーボ面上に記憶される
情報はパック内の他のディスク面上の磁気ヘッド位置を
捜し出すのに使用される。サーボ面上のデータはデータ
保持面上のセクターを捜し出すのに使用される。セクタ
ーはサーボ面上のインデクスマーク位置に関して捜し出
される。
クは“ディスクパック”内に積み重ねられている。パッ
ク内の各ディスクの両面が情報を記憶するのに使用され
る。パック内の各ディスクの各面にその特定面に対して
情報を読み書きするための少くとも１個の磁気ヘッドが
ある。代表的に、全ての磁気ヘッドは同じ時間に同じデ
ィスク半径にあるように、ディスク表面上を半径方向に
タンデム移動する。“シリンダ”が同じ半径にあって、
一般的に、集合ヘッドにより同時にアクセスされるディ
スクパック内のディスク表面上の１組の特定トラックを
識別する。シリンダ内の各トラックはフレームすなわち
データを保持するセクターへ分割される。サーボ面がパ
ック内の１枚のディスクの一面を占有してコントローラ
が使用する情報を保持し、とりわけ、サーボ面上の特定
フレーム（“インデクスフレーム”）が検出される時に
インデクスパルスを発生する。サーボ面上に記憶される
情報はパック内の他のディスク面上の磁気ヘッド位置を
捜し出すのに使用される。サーボ面上のデータはデータ
保持面上のセクターを捜し出すのに使用される。セクタ
ーはサーボ面上のインデクスマーク位置に関して捜し出
される。
【０００４】代表的に、従来技術のインデクス発生法は
インデクスフレームのみに書き込まれた特定非ゼロイン
デクスマークを認識し、他の全てのサーボフレームには
ゼロパターンが書き込まれる。
インデクスフレームのみに書き込まれた特定非ゼロイン
デクスマークを認識し、他の全てのサーボフレームには
ゼロパターンが書き込まれる。
【０００５】従来技術のインデクス発生回路は非常にリ
ードバックエラーをこうむり易い。一つのフレームから
のエラーにより所望フレーム内でインデクスを検出でき
なくなったり、所望しないフレーム内にインデクスが誤
発生することがある。これらの方法は非ゼロインデクス
マーク内の（“１”の替りに“０”を読み取る）ビット
のドロップアウトにより所望インデクスを見落したり、
特定の非ゼロインデクスマークと同じパターン内の
（“０”の替りに“１”を読み取る）ビットのドロップ
インにより所望しないフレームのインデクスを誤って識
別し易い。サーボ面から読み戻されるインデクス情報内
に高いエラートレランスレベルを有するインデクスパル
スを発生する方法及び装置が非常に望ましい。
ードバックエラーをこうむり易い。一つのフレームから
のエラーにより所望フレーム内でインデクスを検出でき
なくなったり、所望しないフレーム内にインデクスが誤
発生することがある。これらの方法は非ゼロインデクス
マーク内の（“１”の替りに“０”を読み取る）ビット
のドロップアウトにより所望インデクスを見落したり、
特定の非ゼロインデクスマークと同じパターン内の
（“０”の替りに“１”を読み取る）ビットのドロップ
インにより所望しないフレームのインデクスを誤って識
別し易い。サーボ面から読み戻されるインデクス情報内
に高いエラートレランスレベルを有するインデクスパル
スを発生する方法及び装置が非常に望ましい。
【０００６】
【発明が解決しようとする課題】本発明は磁気ディスク
パックのサーボ面から読み戻されるインデクスマーク情
報にエラートレランスを提供するものである。本発明に
より、たとえサーボ面から多数のインデクス情報ビット
が不適切に読み取られても、正しいインデクスパルスを
発生することができる。
パックのサーボ面から読み戻されるインデクスマーク情
報にエラートレランスを提供するものである。本発明に
より、たとえサーボ面から多数のインデクス情報ビット
が不適切に読み取られても、正しいインデクスパルスを
発生することができる。
【０００７】本発明は、インデクスフレームと呼ばれ
る、所与のシリンダ上の一つの特定サーボフレームを非
常に高精度で識別する。本発明により、所望のインデク
スフレームが認識される確率が高くなり、所望しないフ
レームがインデクスフレームとして誤って識別される確
率が低くなる。本発明は、所望のインデクスフレームを
含めた所望のインデクスフレームまでのすぐ先行するい
くつかのフレーム内に書き込まれた、冗長度を有する、
非ゼロコードの増分シーケンスを使用する。シリンダ上
の他の全てのフレームにはゼロコードが書き込まれる。
正確な非ゼロフレーム数及びフレーム当りの専用サーボ
情報ビット数は、特定応用及び所要のエラートレランス
レベルに基いて変動することができる。フレームカウン
タ値と実際にデコードされたフレーム値間の所要最少数
の“マッチ”すなわち正確な対応がなされるかもしくは
それを越えると、インデクス発生デコード論理回路はあ
る非ゼロフレームカウントを維持し所望カウントにおい
てインデクスマークを発生する。エラートレラント論理
はさまざまなフレームデコードのメモリを使用してカウ
ンタを非ゼロフレームシーケンス内の最も可能性の高い
位置へ適応更新すなわちリセットする。
る、所与のシリンダ上の一つの特定サーボフレームを非
常に高精度で識別する。本発明により、所望のインデク
スフレームが認識される確率が高くなり、所望しないフ
レームがインデクスフレームとして誤って識別される確
率が低くなる。本発明は、所望のインデクスフレームを
含めた所望のインデクスフレームまでのすぐ先行するい
くつかのフレーム内に書き込まれた、冗長度を有する、
非ゼロコードの増分シーケンスを使用する。シリンダ上
の他の全てのフレームにはゼロコードが書き込まれる。
正確な非ゼロフレーム数及びフレーム当りの専用サーボ
情報ビット数は、特定応用及び所要のエラートレランス
レベルに基いて変動することができる。フレームカウン
タ値と実際にデコードされたフレーム値間の所要最少数
の“マッチ”すなわち正確な対応がなされるかもしくは
それを越えると、インデクス発生デコード論理回路はあ
る非ゼロフレームカウントを維持し所望カウントにおい
てインデクスマークを発生する。エラートレラント論理
はさまざまなフレームデコードのメモリを使用してカウ
ンタを非ゼロフレームシーケンス内の最も可能性の高い
位置へ適応更新すなわちリセットする。
【０００８】
【課題を解決するための手段】本発明の実施例におい
て、サーボ面上に記録される非ゼロデータは最下位２ビ
ットの付加繰返し冗長度を有する１〜７の３ビット２進
表示で与えられる５ビットパターンである。ビットの順
序は繰返しビットの最大分離を与えるように再配列され
る。
て、サーボ面上に記録される非ゼロデータは最下位２ビ
ットの付加繰返し冗長度を有する１〜７の３ビット２進
表示で与えられる５ビットパターンである。ビットの順
序は繰返しビットの最大分離を与えるように再配列され
る。
【０００９】
【実施例】ディスクパック１２及びＥブロックアセンブ
リ１４を具備するディスクアセンブリ１０を第１図に示
す。ディスクパック１２は駆動スピンドル１８上に積み
重ねられたディスク１６を有している。Ｅブロックアセ
ンブリ１４はサーボスピンドル２０及び複数の支持アー
ム２２を具備している。各支持アームは１本もしくは２
本の彎曲アーム２４を支持している。各彎曲アーム２４
は磁気ヘッドアセンブリ２６を支持している。各彎曲ア
ーム２４はマウント２８によりその対応する支持アーム
２２に載置される。スピンドルモータ３０が駆動スピン
ドル１８に連結されている。アクチュエータ３２がサー
ボスピンドル２０に連結されている。サーボ面３４はデ
ィスクパック１２内の一つのディスク１６の一表面から
なっている。リードパック回路３６がサーボ面３４上に
情報を読み書きする磁気ヘッド２６に接続されている。
リードバック回路３６はインデクスマーク検出回路３８
に接続されている。スピンドルモータ制御回路３３がス
ピンドルモータ３０を制御する。サーボアクチュエータ
コントロール３５が位置命令を受信してアクチュエータ
３２に接続する。インデクスマーク検出回路３８がスピ
ンドルモータコントロール３３及びリード／ライト回路
３７へインデクスパルス出力を与える。他の各磁気ヘッ
ド２６にはリード／ライト回路３７が付随しており、そ
れはリード及びライト動作中に情報を運ぶデータバスに
接続されている。
リ１４を具備するディスクアセンブリ１０を第１図に示
す。ディスクパック１２は駆動スピンドル１８上に積み
重ねられたディスク１６を有している。Ｅブロックアセ
ンブリ１４はサーボスピンドル２０及び複数の支持アー
ム２２を具備している。各支持アームは１本もしくは２
本の彎曲アーム２４を支持している。各彎曲アーム２４
は磁気ヘッドアセンブリ２６を支持している。各彎曲ア
ーム２４はマウント２８によりその対応する支持アーム
２２に載置される。スピンドルモータ３０が駆動スピン
ドル１８に連結されている。アクチュエータ３２がサー
ボスピンドル２０に連結されている。サーボ面３４はデ
ィスクパック１２内の一つのディスク１６の一表面から
なっている。リードパック回路３６がサーボ面３４上に
情報を読み書きする磁気ヘッド２６に接続されている。
リードバック回路３６はインデクスマーク検出回路３８
に接続されている。スピンドルモータ制御回路３３がス
ピンドルモータ３０を制御する。サーボアクチュエータ
コントロール３５が位置命令を受信してアクチュエータ
３２に接続する。インデクスマーク検出回路３８がスピ
ンドルモータコントロール３３及びリード／ライト回路
３７へインデクスパルス出力を与える。他の各磁気ヘッ
ド２６にはリード／ライト回路３７が付随しており、そ
れはリード及びライト動作中に情報を運ぶデータバスに
接続されている。
【００１０】動作上、モータ３０が駆動スピンドル１８
を回転させ、それによりディスク１６は調和して回転す
る。アクチュエータ３２はサーボスピンドル２０を移動
させて磁気ヘッド２６がディスク１６上のトラック間を
移動するようにする。リードバック回路３６はサーボ面
３４上の磁気ヘッド２６からの生データ信号をデジタル
パルスへ変換する。リードバック回路３６の出力により
インデクスマーク検出回路３８が駆動される。インデク
スマーク検出回路３８は本発明に従ったエラートレラン
トインデクス発生法を使用してインデクスパルス出力を
与える。サーボアクチュエータコントロール３５は位置
命令を受信する。サーボアクチュエータコントロール３
５はこの情報を使用してアクチュエータ３２を制御す
る。スピンドルモータ制御回路３３はインデクスマーク
検出回路３８からインデクスパルス情報を受信してスピ
ンドルモータ３０を制御する。リード／ライト回路３７
はデータバスから情報を受信し、磁気ヘッド２６を介し
てディスク１６の表面上へ書き込む。リード／ライト回
路３７はまたディスク１６表面から情報を読み取ってデ
ータバス上へ与えるのにも使用される。リード／ライト
回路３７はリード／ライトコマンド及びインデクスパル
ス情報の関数としてデータを書き込む。
を回転させ、それによりディスク１６は調和して回転す
る。アクチュエータ３２はサーボスピンドル２０を移動
させて磁気ヘッド２６がディスク１６上のトラック間を
移動するようにする。リードバック回路３６はサーボ面
３４上の磁気ヘッド２６からの生データ信号をデジタル
パルスへ変換する。リードバック回路３６の出力により
インデクスマーク検出回路３８が駆動される。インデク
スマーク検出回路３８は本発明に従ったエラートレラン
トインデクス発生法を使用してインデクスパルス出力を
与える。サーボアクチュエータコントロール３５は位置
命令を受信する。サーボアクチュエータコントロール３
５はこの情報を使用してアクチュエータ３２を制御す
る。スピンドルモータ制御回路３３はインデクスマーク
検出回路３８からインデクスパルス情報を受信してスピ
ンドルモータ３０を制御する。リード／ライト回路３７
はデータバスから情報を受信し、磁気ヘッド２６を介し
てディスク１６の表面上へ書き込む。リード／ライト回
路３７はまたディスク１６表面から情報を読み取ってデ
ータバス上へ与えるのにも使用される。リード／ライト
回路３７はリード／ライトコマンド及びインデクスパル
ス情報の関数としてデータを書き込む。
【００１１】本発明はサーボ面３４上のインデクスフレ
ームを含むインデクスフレームまでのすぐ先行するいく
つかのデータフレームに書き込まれた、冗長度を有す
る、非ゼロコードの増分シーケンスを使用する。表面３
４上の他の全てのフレームにはゼロコードが書き込まれ
る。非ゼロフレーム及びフレーム当り専用サーボ情報の
正確な数は特定応用及び所要のエラートレラントレベル
に基いて変えることができる。さらに、エラートレラン
スの組合せ及び誤インデクスパルス発生に対する抵抗が
異なるように、デコーディングアルゴリズム内のさまざ
まなパラメータを設定することができる。本発明の実施
例において、サーボ面３４上の各データフレームにはイ
ンデクス情報の５ビットが書き込まれる。インデクスフ
レーム自体及びインデクスフレームまでの６フレームを
除く、全てのフレームについて５つのビット位置の全て
に対して論理ゼロが書き込まれる（０００００）。イン
デクスフレームの前の第６フレームから開始して、１か
ら７までをカウントするシーケンスのそのフレームの位
置に対応する非ゼロパターンが書き込まれ、１はインデ
クスフレームの前の第６フレームに対応し７はインデク
スフレーム自体に対応する。非ゼロパターンの５ビット
は１０進１から７の３ビット２進表示として書き込ま
れ、最下位２ビットには繰返し冗長度が付加される。ビ
ット順は各繰返ビットの最大分離を与えるように再配列
される。
ームを含むインデクスフレームまでのすぐ先行するいく
つかのデータフレームに書き込まれた、冗長度を有す
る、非ゼロコードの増分シーケンスを使用する。表面３
４上の他の全てのフレームにはゼロコードが書き込まれ
る。非ゼロフレーム及びフレーム当り専用サーボ情報の
正確な数は特定応用及び所要のエラートレラントレベル
に基いて変えることができる。さらに、エラートレラン
スの組合せ及び誤インデクスパルス発生に対する抵抗が
異なるように、デコーディングアルゴリズム内のさまざ
まなパラメータを設定することができる。本発明の実施
例において、サーボ面３４上の各データフレームにはイ
ンデクス情報の５ビットが書き込まれる。インデクスフ
レーム自体及びインデクスフレームまでの６フレームを
除く、全てのフレームについて５つのビット位置の全て
に対して論理ゼロが書き込まれる（０００００）。イン
デクスフレームの前の第６フレームから開始して、１か
ら７までをカウントするシーケンスのそのフレームの位
置に対応する非ゼロパターンが書き込まれ、１はインデ
クスフレームの前の第６フレームに対応し７はインデク
スフレーム自体に対応する。非ゼロパターンの５ビット
は１０進１から７の３ビット２進表示として書き込ま
れ、最下位２ビットには繰返し冗長度が付加される。ビ
ット順は各繰返ビットの最大分離を与えるように再配列
される。
【００１２】例えば、３ビット２進表示が最上位ビット
から最下位ビットまで“ＣＢＡ”の順序で与えられる場
合、最下位２ビットに冗長度を付加すると“ＣＢＢＡ
Ａ”となる。これらのビットは再配列して“ＡＢＣＡ
Ｂ”を形成する。このようにして、次のパターンが書き
込まれる。
から最下位ビットまで“ＣＢＡ”の順序で与えられる場
合、最下位２ビットに冗長度を付加すると“ＣＢＢＡ
Ａ”となる。これらのビットは再配列して“ＡＢＣＡ
Ｂ”を形成する。このようにして、次のパターンが書き
込まれる。
【００１３】
【表１】 位 置 １０進 ３ビット２進 ５ビットパターン インデクスの６つ前 １ ００１ １００１０ インデクスの５つ前 ２ ０１０ ０１００１ インデクスの４つ前 ３ ０１１ １１０１１ インデクスの３つ前 ４ １００ ００１００ インデクスの２つ前 ５ １０１ １０１１０ インデクスの１つ前 ６ １１０ ０１１０１ インデクス ７ １１１ １１１１１ 他の位置 ０ ０００ ０００００
【００１４】このデータコーディング法によりサーボ面
から読み戻される復号化データの信頼度が向上する。第
２図は本発明に従ったインデクス発生アルゴリズムのフ
ロー図である。アルゴリズムは第２図のブロック４０で
開始され、新しいデータフレームの５−３デコードがサ
ーボ面３４から読み取られる。フロー図のブロック４２
において、前のサーボフレームからの復号化データはＰ
ＲＥＶと呼ばれる変数内に記憶され、新しく復号化され
たデータは変数ＰＲＥＳ内に記憶される。ブロック４４
において、ＰＲＥＳ及びＰＲＥＶはゼロと比較される。
両変数共ゼロに等しければ、コントロールは第２図のフ
ロー図のブロック４６へ移る。ＰＲＥＳもしくはＰＲＥ
Ｖが非ゼロであれば、ブロック４４においてコントロー
ルはブロック４８へ渡される。ブロック４８において、
ＰＲＥＳの値はＰＲＥＶ＋１の値と比較される。ＰＲＥ
ＳがＰＲＥＶ＋１に等しければ、ブロック４４において
コントロールはブロック５０へ渡される。ＰＲＥＳがＰ
ＲＥＶ＋１に等しくなければ、ブロック４８においてコ
ントロールはブロック５２へ渡される。ブロック５０に
おいて、変数ＣＯＵＮＴはＰＲＥＳに等しく設定され、
コントロールはブロック５４へ渡される。
から読み戻される復号化データの信頼度が向上する。第
２図は本発明に従ったインデクス発生アルゴリズムのフ
ロー図である。アルゴリズムは第２図のブロック４０で
開始され、新しいデータフレームの５−３デコードがサ
ーボ面３４から読み取られる。フロー図のブロック４２
において、前のサーボフレームからの復号化データはＰ
ＲＥＶと呼ばれる変数内に記憶され、新しく復号化され
たデータは変数ＰＲＥＳ内に記憶される。ブロック４４
において、ＰＲＥＳ及びＰＲＥＶはゼロと比較される。
両変数共ゼロに等しければ、コントロールは第２図のフ
ロー図のブロック４６へ移る。ＰＲＥＳもしくはＰＲＥ
Ｖが非ゼロであれば、ブロック４４においてコントロー
ルはブロック４８へ渡される。ブロック４８において、
ＰＲＥＳの値はＰＲＥＶ＋１の値と比較される。ＰＲＥ
ＳがＰＲＥＶ＋１に等しければ、ブロック４４において
コントロールはブロック５０へ渡される。ＰＲＥＳがＰ
ＲＥＶ＋１に等しくなければ、ブロック４８においてコ
ントロールはブロック５２へ渡される。ブロック５０に
おいて、変数ＣＯＵＮＴはＰＲＥＳに等しく設定され、
コントロールはブロック５４へ渡される。
【００１５】コントロールがブロック５２へ渡される
と、ＣＯＵＮＴはＣＯＵＮＴ＋１に等しく設定され、コ
ントロールはブロック５４へ渡される。ブロック５４に
おいて、ＣＯＵＮＴの値はＰＲＥＳの値と比較される。
ＣＯＵＮＴがＰＲＥＳに等しければ、コントロールはブ
ロック５６へ渡される。ＣＯＵＮＴがＰＲＥＳＳに等し
くなければ、コントロールは直接ブロック５８へ渡され
ブロック５６はバイパスされる。ブロック５６におい
て、変数ＭＡＴＣＨはＭＡＴＣＨ＋１に等しく設定され
る。ブロック４６を介してブロック５８へコントロール
が渡されると、変数ＭＡＴＣＨはゼロに等しく設定され
変数ＣＯＵＮＴはゼロに等しく設定される。ブロック５
８において、ＣＯＵＮＴが７に等しく且つＭＡＴＣＨが
４よりも大きければ、コントロールはブロック６０へ渡
される。ブロック６０はインデクスパルスを発生する。
さもなくば、ブロック５８において、次フレームの受信
を待機するブロック４０内のアルゴリズムの始めにコン
トロールが戻される。
と、ＣＯＵＮＴはＣＯＵＮＴ＋１に等しく設定され、コ
ントロールはブロック５４へ渡される。ブロック５４に
おいて、ＣＯＵＮＴの値はＰＲＥＳの値と比較される。
ＣＯＵＮＴがＰＲＥＳに等しければ、コントロールはブ
ロック５６へ渡される。ＣＯＵＮＴがＰＲＥＳＳに等し
くなければ、コントロールは直接ブロック５８へ渡され
ブロック５６はバイパスされる。ブロック５６におい
て、変数ＭＡＴＣＨはＭＡＴＣＨ＋１に等しく設定され
る。ブロック４６を介してブロック５８へコントロール
が渡されると、変数ＭＡＴＣＨはゼロに等しく設定され
変数ＣＯＵＮＴはゼロに等しく設定される。ブロック５
８において、ＣＯＵＮＴが７に等しく且つＭＡＴＣＨが
４よりも大きければ、コントロールはブロック６０へ渡
される。ブロック６０はインデクスパルスを発生する。
さもなくば、ブロック５８において、次フレームの受信
を待機するブロック４０内のアルゴリズムの始めにコン
トロールが戻される。
【００１６】アルゴリズムは第３Ａ図及び第３Ｂ図に示
すようなハードウェアで実施することができる。第３Ａ
図において、５ビットデジタルコードがデータ線ＩＮ
２、ＩＮ１Ａ、ＩＮ１Ｂ、ＩＮ０Ａ、ＩＮ０Ｂを介して
インデクスマーク発生回路６２へ入力される。データ線
ＩＮ２、ＩＮ１Ａ、ＩＮ１Ｂ、ＩＮ０Ａ、ＩＮ０Ｂは５
−３デコーダ６４に接続されている。５−３デコーダ６
４は線ＤＥＣ２、ＤＥＣ１、ＤＥＣ０を介してプレゼン
トデコーダレジスタ（ＰＲＥＳ）６６へ出力を与える。
プレゼントデコーダレジスタ６６はクロックデータ線Ｃ
１に接続されたクロック入力ＣＬＫを含んでいる。プレ
ゼントデコードレジスタ６６はデータ線ＰＲＥＳ２、Ｐ
ＲＥＳ１、ＰＲＥＳ０を介してプレビアスデコードレジ
スタ（ＰＲＥＶ）６８へ出力を与える。プレビアスデコ
ードレジスタ６８はデータ線ＰＲＥＶ２、ＰＲＥＶ１、
ＰＲＥＶ０を介してプラス１加算器７０へ出力を与え
る。プラス１加算器７０は線ＰＬＵＳ２、ＰＬＵＳ１、
ＰＬＵＳ０上へ出力を与える。
すようなハードウェアで実施することができる。第３Ａ
図において、５ビットデジタルコードがデータ線ＩＮ
２、ＩＮ１Ａ、ＩＮ１Ｂ、ＩＮ０Ａ、ＩＮ０Ｂを介して
インデクスマーク発生回路６２へ入力される。データ線
ＩＮ２、ＩＮ１Ａ、ＩＮ１Ｂ、ＩＮ０Ａ、ＩＮ０Ｂは５
−３デコーダ６４に接続されている。５−３デコーダ６
４は線ＤＥＣ２、ＤＥＣ１、ＤＥＣ０を介してプレゼン
トデコーダレジスタ（ＰＲＥＳ）６６へ出力を与える。
プレゼントデコーダレジスタ６６はクロックデータ線Ｃ
１に接続されたクロック入力ＣＬＫを含んでいる。プレ
ゼントデコードレジスタ６６はデータ線ＰＲＥＳ２、Ｐ
ＲＥＳ１、ＰＲＥＳ０を介してプレビアスデコードレジ
スタ（ＰＲＥＶ）６８へ出力を与える。プレビアスデコ
ードレジスタ６８はデータ線ＰＲＥＶ２、ＰＲＥＶ１、
ＰＲＥＶ０を介してプラス１加算器７０へ出力を与え
る。プラス１加算器７０は線ＰＬＵＳ２、ＰＬＵＳ１、
ＰＬＵＳ０上へ出力を与える。
【００１７】第３Ｂ図において、ＯＲゲート７２はＰＲ
ＥＳ２、ＰＲＥＳ１、ＰＲＥＳ０、ＰＲＥＶ２、ＰＲＥ
Ｖ１、ＰＲＥＶ０データ線から入力を受信する。ＯＲゲ
ート７２は１個の検出器を具備し、データ線ＰＰＸＯ上
に出力を与える。コンパレタ７４がＰＲＥＳをＰＲＥＶ
＋１と比較する。コンパレタ７４はＸＮＯＲゲート７
６、７８、８０及びＮＡＮＤゲート８２を具備してい
る。ＸＮＯＲゲート７６はデータ線ＰＲＥＳ２及びＰＬ
ＵＳ２から入力を受信してＮＡＮＤゲート８２へ出力を
与える。ＸＮＯＲゲートはＰＲＥＳ１及びＰＬＵＳ１デ
ータ線から入力を受信してＮＡＮＤゲート８２へ出力を
与える。ＸＮＯＲゲート８０はデータ線ＰＲＥＳ０、Ｐ
ＬＵＳ０に接続され、ＮＡＮＤゲート８２へ出力を与え
る。カウンタクリア論理回路８４はインバータ８６、Ａ
ＮＤゲート８８及びＮＯＲゲート９０を具備している。
インバータ８６はＯＲゲート７２からのＰＰＸＯに接続
され、ＡＮＤゲート８８に出力を与える。ＡＮＤゲート
８８はクロック入力Ｃ２をも受信する。ＡＮＤゲート８
８はＮＯＲゲート９０に出力を与える。ＮＯＲゲート９
０はまた、データ線ＩＮＤＥＸを介して入力を受信しデ
ータ線ＣＬＲＮＣＮＴへ出力を与える。
ＥＳ２、ＰＲＥＳ１、ＰＲＥＳ０、ＰＲＥＶ２、ＰＲＥ
Ｖ１、ＰＲＥＶ０データ線から入力を受信する。ＯＲゲ
ート７２は１個の検出器を具備し、データ線ＰＰＸＯ上
に出力を与える。コンパレタ７４がＰＲＥＳをＰＲＥＶ
＋１と比較する。コンパレタ７４はＸＮＯＲゲート７
６、７８、８０及びＮＡＮＤゲート８２を具備してい
る。ＸＮＯＲゲート７６はデータ線ＰＲＥＳ２及びＰＬ
ＵＳ２から入力を受信してＮＡＮＤゲート８２へ出力を
与える。ＸＮＯＲゲートはＰＲＥＳ１及びＰＬＵＳ１デ
ータ線から入力を受信してＮＡＮＤゲート８２へ出力を
与える。ＸＮＯＲゲート８０はデータ線ＰＲＥＳ０、Ｐ
ＬＵＳ０に接続され、ＮＡＮＤゲート８２へ出力を与え
る。カウンタクリア論理回路８４はインバータ８６、Ａ
ＮＤゲート８８及びＮＯＲゲート９０を具備している。
インバータ８６はＯＲゲート７２からのＰＰＸＯに接続
され、ＡＮＤゲート８８に出力を与える。ＡＮＤゲート
８８はクロック入力Ｃ２をも受信する。ＡＮＤゲート８
８はＮＯＲゲート９０に出力を与える。ＮＯＲゲート９
０はまた、データ線ＩＮＤＥＸを介して入力を受信しデ
ータ線ＣＬＲＮＣＮＴへ出力を与える。
【００１８】更新フレームカウンタ論理回路９２はＰＰ
ＸＯデータ線及びＣ２クロックデータ線に接続された入
力を有するＡＮＤゲート９４を具備している。ＡＮＤゲ
ート９４はＣＣＬＫデータ線上にクロック出力を与え
る。フレームカウンタ９６は同期ロード及び非同期クリ
アを有する３ビット２進アップカウンタを具備してい
る。フレームカウンタ９６はＬＯＡＤＮ、ＰＬＵＳ０、
ＰＬＵＳ１、ＰＬＵＳ２、ＣＬＲＮＣＮＴ、ＣＣＬＫデ
ータ線から入力を受信する。フレームカウンタ９６から
のデータ出力はデータ線ＣＮＴ０、ＣＮＴ１、ＣＮＴ２
により運ばれる。
ＸＯデータ線及びＣ２クロックデータ線に接続された入
力を有するＡＮＤゲート９４を具備している。ＡＮＤゲ
ート９４はＣＣＬＫデータ線上にクロック出力を与え
る。フレームカウンタ９６は同期ロード及び非同期クリ
アを有する３ビット２進アップカウンタを具備してい
る。フレームカウンタ９６はＬＯＡＤＮ、ＰＬＵＳ０、
ＰＬＵＳ１、ＰＬＵＳ２、ＣＬＲＮＣＮＴ、ＣＣＬＫデ
ータ線から入力を受信する。フレームカウンタ９６から
のデータ出力はデータ線ＣＮＴ０、ＣＮＴ１、ＣＮＴ２
により運ばれる。
【００１９】コンパレタ９８は現在の変数（ＰＲＥＳ）
とＣＯＵＮＴの比較を行う。コンパレタ９８はＸＮＯＲ
ゲート１００、１０２、１０４、及びゲート１０６を具
備している。ＸＮＯＲゲート１００〜１０４はデータ線
ＣＮＴ０、ＰＲＥＳ２、ＣＮＴ１、ＰＲＥＳ１、ＣＮＴ
２、ＰＲＥＳ０から入力を受信する。コンパレタ９８は
ＡＮＤゲート１０６から出力ＰＥＣを与える。ＡＮＤゲ
ート１０８はＰＥＣ及びＰＰＸＯデータ線及び第３のク
ロックデータ線Ｃ３に接続され、データ線ＭＡＴＣＨ上
に出力を与える。マッチカウンタ１１０にはＭＡＴＣＨ
データ線及びＣＬＲＮＣＮＴデータ線が接続され、デー
タ線Ｍ２、Ｍ１、Ｍ０を介してデコーダ１１２に数字出
力を与える。デコーダ１１２はＭＡＴＣＨ−ｇｒｅａｔ
ｅｒ−ｔｈａｎ−ｆｏｕｒデコーダを提供し、ＯＲゲー
ト１１４及びＡＮＤゲート１１６を具備している。ＯＲ
ゲート１１４はデータ線Ｍ０、Ｍ１から入力を受信す
る。ＡＮＤゲート１１６はＯＲゲート１１４及びデータ
線Ｍ２から入力を受信し、データ線ＭＧ４上へ出力を与
える。
とＣＯＵＮＴの比較を行う。コンパレタ９８はＸＮＯＲ
ゲート１００、１０２、１０４、及びゲート１０６を具
備している。ＸＮＯＲゲート１００〜１０４はデータ線
ＣＮＴ０、ＰＲＥＳ２、ＣＮＴ１、ＰＲＥＳ１、ＣＮＴ
２、ＰＲＥＳ０から入力を受信する。コンパレタ９８は
ＡＮＤゲート１０６から出力ＰＥＣを与える。ＡＮＤゲ
ート１０８はＰＥＣ及びＰＰＸＯデータ線及び第３のク
ロックデータ線Ｃ３に接続され、データ線ＭＡＴＣＨ上
に出力を与える。マッチカウンタ１１０にはＭＡＴＣＨ
データ線及びＣＬＲＮＣＮＴデータ線が接続され、デー
タ線Ｍ２、Ｍ１、Ｍ０を介してデコーダ１１２に数字出
力を与える。デコーダ１１２はＭＡＴＣＨ−ｇｒｅａｔ
ｅｒ−ｔｈａｎ−ｆｏｕｒデコーダを提供し、ＯＲゲー
ト１１４及びＡＮＤゲート１１６を具備している。ＯＲ
ゲート１１４はデータ線Ｍ０、Ｍ１から入力を受信す
る。ＡＮＤゲート１１６はＯＲゲート１１４及びデータ
線Ｍ２から入力を受信し、データ線ＭＧ４上へ出力を与
える。
【００２０】ＡＮＤゲート１１８は７に等しいカウント
及びＭＡＴＣＨ−ｇｒｅａｔｅｒ−ｔｈａｎ−ｆｏｕｒ
検出器を有している。ＡＮＤゲート１１８はデータ線Ｍ
Ｇ４、ＣＮＴ０、ＣＮＴ１、ＣＮＴ２に接続され、イン
デクス発生レジスタ１２０に出力を与える。インデクス
発生レジスタ１２０は第４のクロックデータ線Ｃ４から
クロックパルスを受信しデータ線ＩＮＤＥＸ上に出力を
与えるフリップフロップである。第４図は５−３デコー
ダ６４の論理図である。デコーダ６４はＮＡＮＤゲート
１２２、１２４、ＡＮＤゲート１２６、１２８、１３
０、１３２、１３４及びＯＲゲート１３６、１３８を具
備している。５−３デコーダ６４はデータ線ＩＮ２、Ｉ
Ｎ１Ａ、ＩＮ１Ｂ、ＩＮ０Ａ、ＩＮ０Ｂを介して２進入
力を受信し、データ線ＯＵＴ２、ＯＵＴ１、ＯＵＴ０上
に出力を与える。５−３デコーダ６４は２進表示から３
ビット２進表示へ変換を行う。
及びＭＡＴＣＨ−ｇｒｅａｔｅｒ−ｔｈａｎ−ｆｏｕｒ
検出器を有している。ＡＮＤゲート１１８はデータ線Ｍ
Ｇ４、ＣＮＴ０、ＣＮＴ１、ＣＮＴ２に接続され、イン
デクス発生レジスタ１２０に出力を与える。インデクス
発生レジスタ１２０は第４のクロックデータ線Ｃ４から
クロックパルスを受信しデータ線ＩＮＤＥＸ上に出力を
与えるフリップフロップである。第４図は５−３デコー
ダ６４の論理図である。デコーダ６４はＮＡＮＤゲート
１２２、１２４、ＡＮＤゲート１２６、１２８、１３
０、１３２、１３４及びＯＲゲート１３６、１３８を具
備している。５−３デコーダ６４はデータ線ＩＮ２、Ｉ
Ｎ１Ａ、ＩＮ１Ｂ、ＩＮ０Ａ、ＩＮ０Ｂを介して２進入
力を受信し、データ線ＯＵＴ２、ＯＵＴ１、ＯＵＴ０上
に出力を与える。５−３デコーダ６４は２進表示から３
ビット２進表示へ変換を行う。
【００２１】第５図はプレゼントデコーダレジスタ６６
の論理図である。デコーダレジスタ６８も類似である。
デコーダレジスタ６６はＤ型フリップフロップ１４０、
１４２、１４４を具備している。レジスタ６６はＤＥＣ
２、ＤＥＣ１、ＤＥＣ０データ線上の入力を出力データ
線ＰＲＥＳ２、ＰＲＥＳ１、ＰＲＥＳ０上へラッチす
る。ＰＬＵＳ１加算器７０を第６図に示す。加算器７０
はＡＮＤゲート１４６、ＸＯＲゲート１４８、１５０及
びインバータ１５２を具備している。加算器７０はデー
タ線ＰＲＥＶ2 、ＰＲＥＶ１、ＰＲＥＶ０から入力を受
信し、データ線ＰＬＵＳ２、ＰＬＵＳ１、ＰＬＵＳ０上
に出力を与える。
の論理図である。デコーダレジスタ６８も類似である。
デコーダレジスタ６６はＤ型フリップフロップ１４０、
１４２、１４４を具備している。レジスタ６６はＤＥＣ
２、ＤＥＣ１、ＤＥＣ０データ線上の入力を出力データ
線ＰＲＥＳ２、ＰＲＥＳ１、ＰＲＥＳ０上へラッチす
る。ＰＬＵＳ１加算器７０を第６図に示す。加算器７０
はＡＮＤゲート１４６、ＸＯＲゲート１４８、１５０及
びインバータ１５２を具備している。加算器７０はデー
タ線ＰＲＥＶ2 、ＰＲＥＶ１、ＰＲＥＶ０から入力を受
信し、データ線ＰＬＵＳ２、ＰＬＵＳ１、ＰＬＵＳ０上
に出力を与える。
【００２２】第７図はマッチカウンタ１１０の論理図で
ある。マッチカウンタ１１０はＪＫフリップフロップ１
５４、１５６、１５８及びインバータ１６０、１６２を
具備している。マッチカウンタ１１０はＭＡＴＣＨ入力
データ線上のデジタルパルス数の２進表示をデータ線Ｍ
２、Ｍ１、Ｍ０上に与える。ＣＬＲＮＣＮＴはマッチカ
ウンタ１１０をリセットする。
ある。マッチカウンタ１１０はＪＫフリップフロップ１
５４、１５６、１５８及びインバータ１６０、１６２を
具備している。マッチカウンタ１１０はＭＡＴＣＨ入力
データ線上のデジタルパルス数の２進表示をデータ線Ｍ
２、Ｍ１、Ｍ０上に与える。ＣＬＲＮＣＮＴはマッチカ
ウンタ１１０をリセットする。
【００２３】第３Ａ図及び第３Ｂ図の回路は第２図に示
すフロー図をハードウェアで実施したものである。本回
路はアルゴリズムを実施するための４つの順次クロック
縁Ｃ１、Ｃ２、Ｃ３、Ｃ４を必要とする。伝播遅延を許
容するのに充分な時間分離がなされている限り、縁のタ
イミングは重要ではない。論理は次のように作動する。
すフロー図をハードウェアで実施したものである。本回
路はアルゴリズムを実施するための４つの順次クロック
縁Ｃ１、Ｃ２、Ｃ３、Ｃ４を必要とする。伝播遅延を許
容するのに充分な時間分離がなされている限り、縁のタ
イミングは重要ではない。論理は次のように作動する。
【００２４】(1) クロックパルスＣ１が発生する前
に、５つのサーボインデクス情報ビットＩＮ２、ＩＮ１
Ａ、ＩＮ１Ｂ、ＩＮ０Ａ、ＩＮ０Ｂがディスクのサーボ
面から読み出される。 (2) ５−３デコーダ６４の論理を使用して、５ビット
パターンが３ビットへデコードされる。この５−３デコ
ードのルールは次のようである。５ビットパターン（Ａ
ＢＣＤＥ）に対しては： (a) （Ａ＝Ｄ）且つ（Ｂ＝Ｅ）であれば、３ビットを
（ＣＢＡ）として出力する。 (b) （Ａ＜＞Ｄ）もしくは（Ｂ＜＞Ｅ）であれば、３ビ
ットを（０００）として出力する。 (3) Ｃ１において、前の３ビットデコードの値がプレ
ビアスデコードレジスタ６８へ移され、プレゼントデコ
ードがプレゼントデコードレジスタ６６に記憶される。 (4) 現在及び前のデコード値は１個の検出器を形成す
るＯＲゲート７２により、いずれかのデコードが非ゼロ
であるかどうかを調べられる。現在もしくは前の値が非
ゼロであれば、ＰＰＸＯビット（現在もしくは前のデコ
ードがゼロでない）が設定される。 (5) プラス１加算器ブロック７０により前のデコード
プラス１の値が計算される。 (6) コンパレタ７４により現在のデコード値が前のデ
コードプラス１の値と比較される。 (7) クロックＣ２において、ＰＰＸＯデータ線が設定
されていなければ、フレームカウンタ９６及びマッチカ
ウンタ１１０がクリアされる。 (8) またクロックＣ２において、ＰＰＸＯビットが設
定されて現在のデコード値が前のデコード値プラス１に
等しければ、この現在のデコード値がフレームカウンタ
９６にロードされる。値が等しくなれけば、フレームカ
ウンタ９６は１だけ増分される。 (9) コンパレタ９８により現在のデコード値がフレー
ムカウンタ値と比較される。２つの値が等しければ、Ｐ
ＥＣ（プレゼントイコールズカンウト）データ線が設定
される。 (10) クロックＣ３において、ＰＥＣ及びＰＰＯＸデー
タ線が設定されると、マッチカウンタ１１２が１だけ増
分される。 (11) マッチカウンタ１１２の値が４よりも大きけれ
ば、データ線ＭＧ４が設定される。 (12) フレームカウンタ９６の値が７であってＭＧ４デ
ータ線が設定されると、ＡＮＤゲート１１８はフリップ
フロップ１２０への入力を設定する。 (13) クロックＣ４において、フリップフロップ１２０
への入力が設定されると、インデクスパルスが出力とし
てインデクスデータ線上へ出される。 (14) インデクスパルスが発生すると、カウンタクリア
論理８４によりフレームカウンタ９６及びマッチカウン
タ１１０がクリアされる。
に、５つのサーボインデクス情報ビットＩＮ２、ＩＮ１
Ａ、ＩＮ１Ｂ、ＩＮ０Ａ、ＩＮ０Ｂがディスクのサーボ
面から読み出される。 (2) ５−３デコーダ６４の論理を使用して、５ビット
パターンが３ビットへデコードされる。この５−３デコ
ードのルールは次のようである。５ビットパターン（Ａ
ＢＣＤＥ）に対しては： (a) （Ａ＝Ｄ）且つ（Ｂ＝Ｅ）であれば、３ビットを
（ＣＢＡ）として出力する。 (b) （Ａ＜＞Ｄ）もしくは（Ｂ＜＞Ｅ）であれば、３ビ
ットを（０００）として出力する。 (3) Ｃ１において、前の３ビットデコードの値がプレ
ビアスデコードレジスタ６８へ移され、プレゼントデコ
ードがプレゼントデコードレジスタ６６に記憶される。 (4) 現在及び前のデコード値は１個の検出器を形成す
るＯＲゲート７２により、いずれかのデコードが非ゼロ
であるかどうかを調べられる。現在もしくは前の値が非
ゼロであれば、ＰＰＸＯビット（現在もしくは前のデコ
ードがゼロでない）が設定される。 (5) プラス１加算器ブロック７０により前のデコード
プラス１の値が計算される。 (6) コンパレタ７４により現在のデコード値が前のデ
コードプラス１の値と比較される。 (7) クロックＣ２において、ＰＰＸＯデータ線が設定
されていなければ、フレームカウンタ９６及びマッチカ
ウンタ１１０がクリアされる。 (8) またクロックＣ２において、ＰＰＸＯビットが設
定されて現在のデコード値が前のデコード値プラス１に
等しければ、この現在のデコード値がフレームカウンタ
９６にロードされる。値が等しくなれけば、フレームカ
ウンタ９６は１だけ増分される。 (9) コンパレタ９８により現在のデコード値がフレー
ムカウンタ値と比較される。２つの値が等しければ、Ｐ
ＥＣ（プレゼントイコールズカンウト）データ線が設定
される。 (10) クロックＣ３において、ＰＥＣ及びＰＰＯＸデー
タ線が設定されると、マッチカウンタ１１２が１だけ増
分される。 (11) マッチカウンタ１１２の値が４よりも大きけれ
ば、データ線ＭＧ４が設定される。 (12) フレームカウンタ９６の値が７であってＭＧ４デ
ータ線が設定されると、ＡＮＤゲート１１８はフリップ
フロップ１２０への入力を設定する。 (13) クロックＣ４において、フリップフロップ１２０
への入力が設定されると、インデクスパルスが出力とし
てインデクスデータ線上へ出される。 (14) インデクスパルスが発生すると、カウンタクリア
論理８４によりフレームカウンタ９６及びマッチカウン
タ１１０がクリアされる。
【００２５】本発明により、磁気記憶装置内でインデク
スマークを捜し出してインデクスパルスを発生するエラ
ートレラント法及び装置が提供される。本発明は、所望
のインデクスフレームを含む所望のインデクスフレーム
までのすぐ先行するインデクスフレームに書き込まれた
非ゼロコードの増分シーケンスを使用する。論理回路が
磁気記憶装置内のサーボ面から読み出された非ゼロコー
ドのカウントを維持してインデクスパルスを発生する。
本発明はコード化法を使用してさらにエラートレランス
を改善する。前記実施例において、５ビットが使用され
る。最初の３ビットは１０進１〜７の２進表示である。
さらに２ビットが最下位２ビットの繰返し冗長度のため
に使用される。繰返ビットの最大分離を行うようにビッ
ト順が再配列される。
スマークを捜し出してインデクスパルスを発生するエラ
ートレラント法及び装置が提供される。本発明は、所望
のインデクスフレームを含む所望のインデクスフレーム
までのすぐ先行するインデクスフレームに書き込まれた
非ゼロコードの増分シーケンスを使用する。論理回路が
磁気記憶装置内のサーボ面から読み出された非ゼロコー
ドのカウントを維持してインデクスパルスを発生する。
本発明はコード化法を使用してさらにエラートレランス
を改善する。前記実施例において、５ビットが使用され
る。最初の３ビットは１０進１〜７の２進表示である。
さらに２ビットが最下位２ビットの繰返し冗長度のため
に使用される。繰返ビットの最大分離を行うようにビッ
ト順が再配列される。
【００２６】本発明を実施例について説明してきたが、
同業者であれば発明の精神及び範囲を逸脱することなく
形式及び詳細の変更が可能と思われる。例えば、本発明
はサーボデータフレームが標準、非サーボデータフレー
ムとディスク面を共有する（すなわち、埋込サーボ応
用）データ記憶装置内のエラートレラントインデクスパ
ルス発生を含んでいる。別の実施例では、エラートレラ
ント回路は遭遇する非ゼロコードのカウントを維持しカ
ウントと実際の現在のデコード間の最大許容不一致数を
越えない場合にはインデクスパルスを発生する。
同業者であれば発明の精神及び範囲を逸脱することなく
形式及び詳細の変更が可能と思われる。例えば、本発明
はサーボデータフレームが標準、非サーボデータフレー
ムとディスク面を共有する（すなわち、埋込サーボ応
用）データ記憶装置内のエラートレラントインデクスパ
ルス発生を含んでいる。別の実施例では、エラートレラ
ント回路は遭遇する非ゼロコードのカウントを維持しカ
ウントと実際の現在のデコード間の最大許容不一致数を
越えない場合にはインデクスパルスを発生する。
【図１】第１図は磁気ディスク記憶装置。
【図２】第２図は本発明に従ったエラートレラントイン
デクス発生装置のフロー図。
デクス発生装置のフロー図。
【図３】第３Ａ図は本発明に従って作られたエラートレ
ラントインデクスパルス発生回路の論理図。
ラントインデクスパルス発生回路の論理図。
【図４】第３Ｂ図は本発明に従って作られたエラートレ
ラントインデクスパルス発生回路の論理図。
ラントインデクスパルス発生回路の論理図。
【図５】第４図は５−３デコーダの論理図。
【図６】第５図は３ビットデコード値レジスタの論理
図。
図。
【図７】第６図は３ビットプラス１加算器の論理図。
【図８】第７図は３ビットマッチカウンタの論理図。
１０ ディスクアセンブリ １２ ディスクパック １４ Ｅブロックアセンブリ １６ ディスク １８ 駆動スピンドル ２０ サーボスピンドル ２２ 支持アーム ２４ 彎曲アーム ２６ 磁気ヘッドアセンブリ ２８ マウント ３０ スピンドルモータ ３２ アクチュエータ ３３ スピンドルモータ制御回路 ３４ サーボ面 ３５ サーボアクチュエータコントロール ３６ リードバック回路 ３７ リード／ライト回路 ３８ インデクスマーク検出回路 ６２ インデクスマーク発生回路 ６４ ５−３デコーダ ６６ プレゼントデコーダレジスタ ６８ プレビアスデコードレジスタ ７０ プラス１加算器 ７２ ＯＲゲート ７４ コンパレタ ７６ ＸＮＯＲゲート ７８ 〃 ８０ 〃 ８２ ＮＡＮＤゲート ８４ カウンタクリア論理回路 ８６ インバータ ８８ ＡＮＤゲート ９０ ＮＯＲゲート ９２ 更新フレームカウンタ論理回路 ９４ ＡＮＤゲート ９６ フレームカウンタ ９８ コンパレタ １００ ＸＮＯＲゲート １０２ 〃 １０４ 〃 １０６ ＡＮＤゲート １０８ 〃 １１０ ＭＡＴＣＨカウンタ １１２ デコーダ １１４ ＯＲゲート １１６ ＡＮＤゲート １１８ 〃 １２０ インデクス発生レジスタ １２２ ＮＡＮＤゲート １２４ 〃 １２６ ＡＮＤゲート １２８ 〃 １３０ 〃 １３２ ＡＮＤゲート １３４ 〃 １３６ ＯＲゲート １３８ 〃 １４０ Ｄ型フリップフロップ １４２ 〃 １４４ 〃 １４６ ＡＮＤゲート １４８ ＸＯＲゲート １５０ 〃 １５２ インバータ １５４ ＪＫフリップフロップ １５６ 〃 １５８ 〃 １６０ インバータ １６２ 〃
Claims (28)
- 【請求項１】 インデクスマークを保持する記憶面を有
するデータ記憶装置内でインデクスパルスを発生する装
置において、該装置は、記憶面からデータを読み取る手
段と、記憶面からデータを読み取る手段に接続されて記
憶面上の非ゼロコードの増分シーケンスを検出する手段
と、記憶面からデータを読み取る手段と接続され記憶面
上の増分シーケンスに基いてインデクスマークの位置を
識別しインデクスマークを表わす出力を与える手段と、
非ゼロコードの増分シーケンス検出手段及びインデクス
パルス出力発生手段に接続されたエラートレラント手
段、を具備するインデクスパルス発生装置。 - 【請求項２】 請求項１記載の装置において、エラート
レラント手段は、非ゼロコードをカウントして非ゼロコ
ード総数を表わすカウント出力を与えるカウンタと、カ
ウンタ及びインデクスマーク位置識別手段に接続されて
カウンタ出力をインデクスマーク位置識別手段の出力と
比較し非ゼロコードとカウント出力との総マッチ数を表
わすマッチ出力を与えるコンパレタ、を具備するインデ
クスパルス発生装置。 - 【請求項３】 請求項２記載の装置において、エラート
レラント手段はカウント出力を所定のカウント値と比較
し且つマッチ出力を所定のマッチ閾値と比較する手段を
含む、インデクスパルス発生装置。 - 【請求項４】 請求項３記載の装置において、比較手段
はカウント出力が所定のカウントに等しく且つマッチ出
力が所定のマッチ閾値よりも大きいかもしくは等しい場
合にインデクスパルス出力を発生する手段を含む、イン
デクスパルス発生装置。 - 【請求項５】 請求項４記載の装置において、インデク
スパルス発生手段に接続されたリセット回路を含む、イ
ンデクスパルス発生装置。 - 【請求項６】 磁気記憶装置内でインデクスパルスを発
生する装置において、該装置はデータ信号出力を与える
リードバックセンサと、リードバックセンサに接続され
非ゼロコードを保持するデータ信号出力内のデータフレ
ームをカウントしてデータ信号出力内の非ゼロデータフ
レームカウントを表わす非ゼロフレームカウントを発生
する非ゼロフレームカウンタと、リードバックセンサ及
び非ゼロフレームカウンタに接続され非ゼロフレームカ
ウントをデータフレーム内に保持された非ゼロコード値
と比較して非ゼロフレームカウントと非ゼロコード値間
のマッチの発生を表わすマッチコンパレタ出力を発生す
るマッチコンパレタと、マッチコンパレタに接続され非
ゼロフレームカウントと非ゼロコード値間のマッチをカ
ウントして非ゼロフレームカウントと非ゼロコード値間
のマッチ数を表わすマッチカウンタ出力を与えるマッチ
カウンタと、マッチカウンタに接続されマッチカウンタ
出力を所定の最小マッチ値と比較し最小マッチ値を越え
るマッチ数の発生を表わすマッチカウンタコンパレタ出
力を与えるマッチカウンタコンパレタと、非ゼロフレー
ムカウンタに接続され非ゼロフレームカウントを所定の
非ゼロフレーム出力値と比較して所定の非ゼロフレーム
カウント値に等しい非ゼロフレームカウントの発生を表
わす非ゼロフレームカウンタコンパレタ出力を与える非
ゼロフレームカウンタコンパレタと、マッチカウンタ及
び非ゼロフレームカウンタコンパレタに接続されインデ
クスパルスを保持するインデクスパルス発生器出力を与
えるインデクスパルス発生器、を具備するインデクスパ
ルス発生装置。 - 【請求項７】 請求項６記載の装置において、リードバ
ックセンサ及び非ゼロカウンタに接続された５−３デコ
ーダを含む、インデクスパルス発生装置。 - 【請求項８】 請求項６記載の装置において、リードバ
ックセンサに接続されて非ゼロデータフレームを識別し
非ゼロデータフレームを表わす一つの検出器出力を与え
る１個の検出器を含む、インデクスパルス発生装置。 - 【請求項９】 請求項６記載の装置において、インデク
スパルス発生器、非ゼロフレームカウンタ及びマッチカ
ウンタに接続されたリセット回路を含む、インデクスパ
ルス発生装置。 - 【請求項１０】 請求項６記載の装置において、非ゼロ
フレームカウンタコンパレタは、リードバックセンサに
接続されて現在のデータフレーム値を記憶するプレゼン
トデータフレーム記憶レジスタと、プレゼントデータフ
レーム記憶レジスタに接続されて前のデータフレーム値
を記憶するプレビアスデータフレームレジスタと、プレ
ゼントデータフレーム記憶レジスタ及びプレビアスデー
タフレーム記憶レジスタに接続されて現在のデータフレ
ーム値を１プラス前のデータフレーム値と比較するコン
パレタを具備するインデクスパルス発生装置。 - 【請求項１１】 請求項６記載の装置において、非ゼロ
フレームカウンタコンパレタに接続されて非ゼロフレー
ムカウンタを更新する更新手段を含む、インデクスパル
ス発生装置。 - 【請求項１２】 請求項１１記載の装置において、更新
手段はプラス１加算器及び現在のデータフレーム値を前
のデータフレーム値プラス１と比較して非ゼロフレーム
カウンタに更新値をロードする手段を具備する、インデ
クスパルス発生装置。 - 【請求項１３】 サーボトラックが記録されるサーボ面
を含み、サーボトラックはインデクスマーク位置を表わ
すコードに到る所定のシーケンスで記録された複数の非
ゼロコードを含んでいる複数のデータ記憶ディスクと、
サーボトラックを読み取ってサーボ読取信号を発生する
手段と、サーボ読取信号に応答して所定のシーケンスを
検出しインデクスマーク位置を表わすコードを読み取っ
た時にインデクスパルス出力を発生する手段、を具備す
るディスクドライブ。 - 【請求項１４】 請求項１３記載のディスクドライブに
おいて、さらに、複数のディスクに対してデータを読み
取り且つ書き込むための複数個のリード／ライトヘッド
と、複数個のリード／ライトヘッドをサーボ読取信号の
関数として位置決めする手段と、リード／ライトヘッド
の動作をインデクスパルス出力の関数として制御する手
段、を具備するディスクドライブ。 - 【請求項１５】 請求項１４記載のディスクドライブに
おいて、複数個のリード／ライトヘッドを位置決めする
手段はアクチュエータからなる、ディスクドライブ。 - 【請求項１６】 請求項１３記載のディスクドライブに
おいて、所定のシーケンスを検出してインデクスパルス
出力を発生する手段は、サーボトラック読取手段に接続
されて非ゼロコードの増分シーケンスを検出する手段
と、読取手段に接続されてインデクスマーク位置を表わ
すコードを検出しインデクスマーク出力を発生する手段
と、非ゼロコードの増分シーケンス検出手段及びインデ
クスマーク位置を表わすコード検出手段に接続されてイ
ンデクスパルス出力を発生する手段、を具備するディス
クドライブ。 - 【請求項１７】 請求項１６記載のディスクドライブに
おいて、さらに、非ゼロコードをカウントして非ゼロコ
ード総数を表わすカウント出力を与えるカウンタと、カ
ウンタ及びインデクスマーク位置を表わすコード検出手
段に接続されカウンタ出力をインデクスマーク位置を表
わすコード検出手段の出力と比較して非ゼロコードとカ
ウント出力のマッチを表わすマッチ出力を発生するコン
パレタと、コンパレタに接続されていくつかのマッチ出
力をカウントするマッチカウンタ、を含むディスクドラ
イブ。 - 【請求項１８】 請求項１７記載のディスクドライブに
おいて、さらにカウント出力を所定のカウント値と比較
してマッチ出力を所定の最小マッチ値と比較するカウン
ト比較手段を含む、ディスクドライブ。 - 【請求項１９】 請求項１８記載のディスクドライブに
おいて、カウント比較手段はカウント出力が所定のカウ
ント値に等しく且つマッチ出力が所定の最小マッチ値よ
りも大きいかもしくは等しい場合にインデクスパルス出
力を発生する手段を含む、ディスクドライブ。 - 【請求項２０】 請求項１３記載のディスクドライブに
おいて、所定コード検出手段をリセットする手段を含
む、ディスクドライブ。 - 【請求項２１】 記憶情報及びサーボデータが記録され
るデータトラックを含み、サーボデータはインデクスマ
ークを表わすコードを含めてインデクスマークコードに
到る所定のシーケンスで記録された複数の非ゼロコード
を含んでいるデータ記憶ディスクと、サーボデータを読
み取ってサーボ読取信号を発生する手段と、サーボ読取
信号に応答して所定シーケンスを検出しインデクスパル
ス出力を発生する手段、を具備するディスクドライブ。 - 【請求項２２】 請求項２１記載のディスクドライブに
おいて、さらに、サーボ読取信号の関数として読取手段
に対してディスクを位置決めする手段、を具備するディ
スクドライブ。 - 【請求項２３】 請求項２２記載のディスクドライブに
おいて、位置決め手段はアクチュエータからなる、ディ
スクドライブ。 - 【請求項２４】 請求項２１記載のディスクドライブに
おいて、所定シーケンスを検出してインデクスパルス出
力を発生する手段は、サーボデータ読取手段に接続され
て非ゼロコードの増分シーケンスを検出する手段と、読
取手段に接続されてインデクスマーク位置を表わすコー
ドを検出しインデクスマーク出力を発生する手段と、非
ゼロコードの増分シーケンス検出手段及びインデクスマ
ーク位置を表わすコード検出手段に接続されてインデク
スパルス出力を発生する手段、を具備するディスクドラ
イブ。 - 【請求項２５】 請求項２４記載のディスクドライブに
おいて、比較手段は、非ゼロコードをカウントして非ゼ
ロコード総数を表わすカウント出力を与えるカウンタ
と、カウンタ及びインデクスマーク位置を表わすコード
検出手段に接続されカウンタ出力をインデクスマーク位
置を表わすコード検出手段の出力と比較して非ゼロコー
ドとカウント出力の総マッチ数を表わすマッチ出力を発
生するコンパレタ、を具備するディスクドライブ。 - 【請求項２６】 請求項２５記載のディスクドライブに
おいて、比較手段はカウント出力を所定のカウント値と
比較し且つマッチ出力を所定の最小マッチ値と比較する
カウント比較手段、を具備するディスクドライブ。 - 【請求項２７】 請求項２６記載のディスクドライブに
おいて、カウント比較手段はカウント出力が所定のカウ
ントに等しく且つマッチ出力が所定の最小マッチ値より
も大きいかもしくは等しい場合にインデクスパルス出力
を発生する手段を含む、ディスクドライブ。 - 【請求項２８】 請求項２１記載のディスクドライブに
おいて、所定コード検出手段をリセットする手段を含
む、ディスクドライブ。
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| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US07/560,438 US5162954A (en) | 1990-07-31 | 1990-07-31 | Apparatus for generating an index pulse in a data storage system |
| US560438 | 1990-07-31 |
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