JPH0640264B2 - Envelope generator - Google Patents

Envelope generator

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JPH0640264B2
JPH0640264B2 JP60080918A JP8091885A JPH0640264B2 JP H0640264 B2 JPH0640264 B2 JP H0640264B2 JP 60080918 A JP60080918 A JP 60080918A JP 8091885 A JP8091885 A JP 8091885A JP H0640264 B2 JPH0640264 B2 JP H0640264B2
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JP
Japan
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sample
output
envelope
hold circuit
voltage
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JP60080918A
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Inventor
雅夫 山崎
Original Assignee
日本コロムビア株式会社
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Publication date
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Description

【発明の詳細な説明】 産業上の利用分野 本発明は電子楽器の楽音エンベロープを発生するエンベ
ロープジエネレータに関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an envelope generator for generating a musical tone envelope of an electronic musical instrument.

従来技術 従来エンベロープジエネレータを実現する手段として、
時定数回路の放電特性を利用したものがある。これは時
定数回路を定電圧で充電する際の電圧変化を楽音のアタ
ツクエンベロープとして、また放電する際の電圧変化を
楽音のデイケイエンベロープとして利用するものであ
る。
Conventional Technology As a means to realize a conventional envelope generator,
There is one utilizing the discharge characteristic of the time constant circuit. This utilizes a voltage change when the time constant circuit is charged with a constant voltage as an attack envelope of a musical tone and a voltage change when discharging the time constant circuit as a decay envelope of a musical tone.

発明が解決しようとする問題点 しかし、上記のようなエンベロープジエネレータでは、
時定数回路を形成する抵抗やコンデンサの精度がそのま
まエンベロープ曲線に反映されてしまう。すなわち、周
囲の温度変化や定数のバラツキにより異なるエンベロー
プ曲線が発生されてしまう。また、複雑なエンベロープ
曲線を得るためには、複数の時定数回路を用意し遂時切
換えるというような手段をとる必要があり、複雑な回路
構成となつてしまう。さらに、エンベロープ曲線をデイ
ジタル値に変換してメモリへ格納しておきこれを随時読
み出してはアナログ電圧に変換してエンベロープ曲線を
得る方法,あるいは楽音形成もデイジタル信号である場
合は、前記メモリから読み出したエンベロープのデイジ
タル信号と楽音のデイジタル信号とをデイジタル乗算す
る方法等もある。いずれの場合もエンベロープのデイジ
タル信号を格納するための大容量なメモリが必要である
し、特に後者ではデイジタル乗算器が必要となり、高価
なものとなつてしまう。
Problems to be Solved by the Invention However, in the envelope generator as described above,
The accuracy of the resistors and capacitors that form the time constant circuit is directly reflected in the envelope curve. That is, different envelope curves are generated due to changes in ambient temperature and variations in constants. Further, in order to obtain a complicated envelope curve, it is necessary to prepare a plurality of time constant circuits and switch them at the same time, resulting in a complicated circuit configuration. Further, a method of converting the envelope curve into a digital value and storing it in a memory and then reading it out at any time to convert it into an analog voltage to obtain an envelope curve, or when the tone formation is also a digital signal, read out from the memory. There is also a method of digitally multiplying the envelope digital signal and the musical tone digital signal. In either case, a large-capacity memory is required to store the digital signal of the envelope, and in particular, the latter requires a digital multiplier, which is expensive.

本発明は抵抗やコンデンサより成る時定数回路の不安定
性や、デイジタル方式の大規模かつ高価であるという欠
点を改善し、簡易な回路構成によるエンベロープジエネ
レータの提供を目的とするものである。
It is an object of the present invention to provide an envelope generator having a simple circuit configuration, by improving the instability of a time constant circuit composed of a resistor and a capacitor and the disadvantages of the digital method that are large-scale and expensive.

問題点を解決するための手段 本発明は、上記の目的を達成するために、アナログ処理
とデイジタル処理のそれぞれのメリツトを効果的に利用
したものである。すなわち、時間軸方向のみ離散化し、
振幅方向は乗算形D/Aコンバータのリフアレンス電圧
としてアナログ信号に変換された信号をサンプルアンド
ホールド回路を介し遅延して入力する回路構成により、
デイジタル乗算器を用いずにアナログ処理で振幅の制御
が可能となり、また信号の巡回処理手段により回路を小
規模にまとめることができるものである。
Means for Solving the Problems The present invention effectively utilizes respective merits of analog processing and digital processing in order to achieve the above object. That is, only the time axis direction is discretized,
The amplitude direction has a circuit configuration in which a signal converted into an analog signal as a reference voltage of the multiplying D / A converter is delayed and input through a sample and hold circuit.
The amplitude can be controlled by analog processing without using a digital multiplier, and the circuit can be integrated into a small scale by means of the signal cyclic processing means.

実施例 本発明の一実施例を説明する。第1図は本発明のエンベ
ロープジエネレータの一実施例の要部を示す回路図であ
る。また第2図はこの実施例の回路動作を示すタイミン
グチヤートである。ピアノ,ギター等の減衰音系楽器の
エンベロープを発生するように成した実施例を示したも
ので、第1図におけるクロツクコントローラ1は、マス
タークロツク1aと、発音のONあるいはOFFを指示するス
イツチ1bよりのON/▲▼信号とを入力とし、S
H1,SH2,▲▼の各信号を出力するもので、これ
らの信号間のタイミングは第2図に示す。このようなタ
イミングを制御する具体的な回路としては第1図(b)の
ようなものが考えられる。この回路の構成は一般的なも
のであり、容易に理解できるものなので説明は省略す
る。次にセレクタ4はセレクト信号Sが“H"の時に入力
端子Aに入力される値を、セレクト信号Sが“L"の時に
入力端子Bに入力される値を出力端子Yに出力するもの
である。この出力端子Yに表われる信号をNビツトのデ
イジタル値Kとする。Kは乗算形D/Aコンバータ5の入
力となる。2のレジスタAにはNビツトのデイジタル値
K1が、3のレジスタBには同じくNビツトのデイジタル
値K2が格納されている。乗算形D/Aコンバータ5の出力
電圧は、スイツチSW1,コンデンサCおよびバツフア
よりなる第1のサンプル アンド ホールド回路に
入力される。この第1のサンプル アンド ホールド回
路の出力Voutと定電圧源6の出力電圧Vrは、オルタネー
テイブに動作する2つのスイツチSW3およびSW4によつて
選択されスイツチSW2、コンデンサC2およびバツフアA2
よりなる第2のサンプル アンド ホールド回路に入力
される。この第2のサンプル アンド ホールド回路の
出力は乗算形D/Aコンバータ5のリフアレンス電圧Vref
となる。さて、いま全くの初期状態にあるものとする。
すなわち、Vout=0〔V〕であり、発音のONあるいはOF
Fを指示するON/▲▼信号も“L"である。そのた
め、K=K2となつている。また、▲▼信号は“H"
であるためスイツチSW3は開放、スイツチSW4は導通とな
り第2のサンプル アンド ホールド回路にはVoutすな
わち0〔V〕がサンプルされホールドされている。つま
りVref=0〔V〕である。乗算形D/Aコンバータ5の出
力電圧は、リフアレンス電圧入力VrefとNビツトのデイ
ジタル入力Kとにより と表わされるのでVref=0〔V〕である現時点では0
〔V〕である。次に第2図に示したように、時刻t1にお
いてON/▲▼信号が“H"となり発音が指示された
ものとする。するとセレクタ4のセレクト信号Sが“H"
となるのであるからK=K1となる。また、時刻t2からt6
までの間▲▼信号が発生し、スイツチSW3が導
通、スイツチSW4が解放となるので定電圧源6の出力電
圧Vr〔V〕が第2のサンプル アンド ホールド回路で
時刻t2からt3の間サンプルされ、時刻t3からt6の間ホー
ルされる。したがつてこの時、乗算形D/Aコンバータ5
の出力電圧は となる。そして第1のサンプル アンド ホールド回路
で時刻t4からt5の間サンプルされ、時刻t5からt8の間ホ
ールドされる。この時の出力をVout(1)とすると である。さて時刻t6で▲▼信号は再び“H"に戻る
ので、スイツチSW3が解放、スイツチSW4が導通となり、
Vout(1)が第2のサンプル アンド ホールド回路で
時刻t6からt7の間サンプルれ、時刻t7からt10の間ホー
ルドされる。したがつてこの時、乗算形D/Aコンバータ
5の出力電圧は となる。これは第1のサンプル アンド ホールド回路
で時刻t8からt9の間サンプルされ時刻t9からt12の間ホ
ールドされる。この時の出力をVout(2)とすると である。このように、ON/▲▼信号が“H"になつ
て以後SHZ信号毎に出力電圧Voutは更新されてゆき、i
番目のSHZ信号が発生した時点での出力電圧Vout(i)
となる。ここで2N−1>K1>0の範囲でデイジタル値K1
が設定されていれば であるから Vr>Vout(1)>Vout(2)>…>Vout(i-1)>Vout(i)… となる。すなわち、出力電圧Voutは単調減少をしている
ことになる。しかも であるから、出力電圧Voutを時系列に並べると時間軸方
向に離散化した指数関数と一致し自然な減衰特性が得ら
れることがわかる。
Example An example of the present invention will be described. FIG. 1 is a circuit diagram showing a main part of an embodiment of the envelope generator of the present invention. FIG. 2 is a timing chart showing the circuit operation of this embodiment. This shows an embodiment configured to generate an envelope of a decaying tone type musical instrument such as a piano or a guitar. The clock controller 1 in FIG. 1 instructs the master clock 1a and ON or OFF of the sound generation. The ON / ▲ ▼ signal from switch 1b is input and S
The signals of H 1 , SH 2 , and ▲ ▼ are output, and the timing between these signals is shown in FIG. A concrete circuit for controlling such timing is shown in FIG. 1 (b). Since the structure of this circuit is general and can be easily understood, description thereof will be omitted. Next, the selector 4 outputs the value input to the input terminal A when the select signal S is "H" and the value input to the input terminal B to the output terminal Y when the select signal S is "L". is there. The signal appearing at the output terminal Y is the digital value K of N bits. K becomes an input of the multiplication type D / A converter 5. Register A of 2 has a digital value of N bits
Register B having K 1 and 3 also stores an N-bit digital value K 2 . The output voltage of the multiplying D / A converter 5 is input to a first sample-and-hold circuit including a switch SW 1 , a capacitor C 1 and a buffer A 1 . The output Vout of the first sample-and-hold circuit and the output voltage Vr of the constant voltage source 6 are selected by two switches SW 3 and SW 4 which operate alternately, and a switch SW 2 , a capacitor C 2 and a buffer A 2 are selected.
Is input to the second sample and hold circuit. The output of this second sample-and-hold circuit is the reference voltage Vref of the multiplying D / A converter 5.
Becomes Now, let us assume that it is in a completely initial state.
That is, Vout = 0 [V], and ON or OF of pronunciation
The ON / ▲ ▼ signal that indicates F is also “L”. Therefore, K = K 2 . Also, the ▲ ▼ signal is "H".
Therefore, the switch SW 3 is open, the switch SW 4 is conductive, and Vout, that is, 0 [V] is sampled and held in the second sample-and-hold circuit. That is, Vref = 0 [V]. The output voltage of the multiplying D / A converter 5 depends on the reference voltage input Vref and the N-bit digital input K. Since Vref is 0 [V], it is 0 at this time.
[V]. Next, as shown in FIG. 2, it is assumed that the ON / ▲ ▼ signal becomes “H” at time t 1 and the sounding is instructed. Then, the select signal S of the selector 4 is "H".
Therefore, K = K 1 . Also, from time t 2 to t 6
Until ▲ ▼ signal is generated, the switch SW 3 becomes conductive and the switch SW 4 is released, so that the output voltage Vr [V] of the constant voltage source 6 is from the time t 2 to the time t 3 in the second sample and hold circuit. It is sampled for a period of time and is held for a period of time t 3 to t 6 . Therefore, at this time, the multiplying D / A converter 5
The output voltage of Becomes Then, the first sample and hold circuit samples from time t 4 to t 5 and holds it from time t 5 to t 8 . If the output at this time is Vout (1) Is. At time t 6 , the ▲ ▼ signal returns to "H" again, so switch SW 3 is released and switch SW 4 becomes conductive.
Vout (1) is a sample between the second sample and hold circuit t 7 from the time t 6, the is held between t 10 from the time t 7. Therefore, at this time, the output voltage of the multiplying D / A converter 5 is Becomes It is held between t 12 from between the sampled time t 9 of t 9 from the time t 8 in the first sample-and-hold circuit. If the output at this time is V out (2) Is. In this way, the output voltage Vout is updated for each SHZ signal after the ON / ▲ ▼ signal becomes “H”.
Output voltage Vout (i) at the time of the second SHZ signal
Is Becomes Here, in the range of 2 N −1> K 1 > 0, the digital value K 1
If is set Therefore, Vr> Vout (1)> Vout (2)>...> Vout (i-1)> Vout (i). That is, the output voltage Vout is monotonically decreasing. Moreover, Therefore, it can be seen that when the output voltages Vout are arranged in time series, they match the exponential function discretized in the time axis direction, and a natural attenuation characteristic is obtained.

ここで、デイジタル値Kは減衰の速さを決定する定数で
あることもわかる。したがつてK2としてK1と異なるデイ
ジタル値をレジスタB3に格納しておけば、ON/▲
▼信号が“L"になつた時、すなわちリリース時のエン
ベロープを形成することができる。
Here, it can also be seen that the digital value K is a constant that determines the speed of attenuation. Therefore, if a digital value different from K 1 is stored in register B3 as K 2 , ON / ▲
▼ An envelope can be formed when the signal reaches “L”, that is, when released.

以上が本発明の基本的な動作例である。自然楽器のエン
ベロープは必ずしも指数曲線と一致するとは限らない
が、減衰率の異なる複数の曲線を時間的に切り換えるこ
とで近似することができる。そのためにはデイジタル値
Kを格納するレジスタを複数設けておき、デイケイ中任
意の時点でこれを切り換えればよい。また、第2のサン
プル アンド ホールド回路の出力電圧を適当に増幅し
てやれば となり、任意の増加率を持つ増加特性を得ることもでき
る。
The above is a basic operation example of the present invention. The envelope of a natural musical instrument does not always match the exponential curve, but it can be approximated by switching a plurality of curves with different attenuation rates in time. For that purpose, a plurality of registers for storing the digital value K may be provided, and these may be switched at any time during the decay. Moreover, if the output voltage of the second sample and hold circuit is appropriately amplified, Therefore, it is possible to obtain an increasing characteristic with an arbitrary increasing rate.

発明の効果 上記のようにリフアレンス電圧が出力電圧に応じて変化
するので、あたかも圧縮あるいは伸張のような効果も得
られ、ビツト数の少ない構成でも充分な分解能が得られ
る。
EFFECTS OF THE INVENTION Since the reference voltage changes depending on the output voltage as described above, an effect such as compression or expansion can be obtained, and sufficient resolution can be obtained even with a configuration having a small number of bits.

【図面の簡単な説明】[Brief description of drawings]

第1図(a)は本発明の一実施例を示すブロツク図、第1
図(b)はクロツクコントローラ1の回路例で、第2図は
タイミングチヤートを示す図である。 1……クロツクコントローラ、2……レジスタA、3…
…レジスタB、4……セレクタ、5……乗算形D/Aコン
バータ、6……定電圧源、SW1,C1,A1……第1のサン
プル アンド ホールド回路、SW1……アナログスイツ
チ、C1……コンデンサ、A2……バツフア、SW2,C2,A2
……第2のサンプル アンド ホールド回路、SW2……
アナログスイツチ、C2……コンデンサ、A2……バツフ
ア、SW3,SW4……アナログスイツチ、7……シフトレジ
スタ、8,9……D-FlipFlopである。
FIG. 1 (a) is a block diagram showing an embodiment of the present invention.
FIG. 2B is a circuit example of the clock controller 1, and FIG. 2 is a diagram showing a timing chart. 1 ... Clock controller, 2 ... Register A, 3 ...
… Register B, 4 …… Selector, 5 …… Multiplying D / A converter, 6 …… Constant voltage source, SW 1 , C 1 , A 1 … First sample and hold circuit, SW 1 … Analog switch , C 1 …… Capacitor, A 2 …… Buffer, SW 2 , C 2 , A 2
…… Second sample and hold circuit, SW 2 ……
Analog switch, C 2 ... capacitor, A 2 ... buffer, SW 3 , SW 4 ... analog switch, 7 ... shift register, 8, 9 ... D-FlipFlop.

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】連続的な音源波形の振幅をエンベロープ信
号で制御することにより楽音を形成する電子楽器の音源
回路に於いて、所定のデイジタル値を格納しておく記憶
装置と、格納されたデイジタル値を読み出しリフアレン
ス電圧と比較してアナログ電圧に変換する乗算形D/A
コンバータと、アナログ電圧に変換された上記D/Aコ
ンバータの出力電圧を一定周期毎にサンプルアンドホー
ルドし出力する第1のサンプルアンドホールド回路と、
ある一定電圧を出力する定電圧源と、上記第1のサンプ
ルアンドホールド回路の出力と上記定電圧源の出力とを
所定のタイミングで切り換えてこれをサンプルアンドホ
ールドする第2のサンプルアンドホールド回路を具備
し、上記第2のサンプルアンドホールド回路の出力を上
記リフアレンス電圧とすることを特徴とするエンベロー
プジエネレータ。
1. A storage device for storing a predetermined digital value in a sound source circuit of an electronic musical instrument for forming a musical tone by controlling the amplitude of a continuous sound source waveform with an envelope signal, and the stored digital signal. Multiplying D / A that converts the value into an analog voltage by comparing with the read reference voltage
A converter, and a first sample-and-hold circuit that samples and holds the output voltage of the D / A converter converted into an analog voltage at regular intervals, and outputs the sample-and-hold circuit.
A constant voltage source that outputs a certain constant voltage, and a second sample and hold circuit that switches the output of the first sample and hold circuit and the output of the constant voltage source at a predetermined timing to sample and hold this. An envelope generator comprising the output of the second sample-and-hold circuit as the reference voltage.
【請求項2】記憶装置に格納した複数のデイジタル値を
所定のタイミングで切り換えて乗算形D/Aコンバータ
に読み出し、出力されるエンベロープを変形させること
を特徴とする特許請求の範囲第(1)項記載のエンベロ
ープジエネレータ。
2. A plurality of digital values stored in a storage device are switched at a predetermined timing to be read by a multiplying D / A converter, and an output envelope is deformed. An envelope generator according to the paragraph.
【請求項3】第2のサンプルアンドホールド回路の出力
を増幅しエンベロープが増加特性となる値にリフアレン
ス電圧をしてなることを特徴とする特許請求の範囲第
(1)項記載のエンベロープジエネレータ。
3. An envelope generator according to claim 1, wherein the reference voltage is amplified to a value at which the output of the second sample-and-hold circuit is amplified and the envelope has an increasing characteristic. .
JP60080918A 1985-04-16 1985-04-16 Envelope generator Expired - Lifetime JPH0640264B2 (en)

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Publication Number Publication Date
JPS61239297A JPS61239297A (en) 1986-10-24
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