JPH0630074A - モデム装置 - Google Patents
モデム装置Info
- Publication number
- JPH0630074A JPH0630074A JP3222708A JP22270891A JPH0630074A JP H0630074 A JPH0630074 A JP H0630074A JP 3222708 A JP3222708 A JP 3222708A JP 22270891 A JP22270891 A JP 22270891A JP H0630074 A JPH0630074 A JP H0630074A
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- cpu
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Abstract
(57)【要約】
【目的】 モデム装置の実際上の動作に必要な回路のみ
に電力を供給することにより、消費電力の低減を計る。 【構成】 モデム装置１が、ＤＴＥ（利用者の端末）か
らのコマンドを受け付けるコマンドモード時に、モデム
装置１の内部の変復調回路４，インタフェース回路７へ
の電力供給を停止するリレースイッチ８を設ける。 【効果】 携帯用コンピュータに内蔵されるモデム装置
など、電源容量の制約が大きいモデム装置として有利で
ある。
に電力を供給することにより、消費電力の低減を計る。 【構成】 モデム装置１が、ＤＴＥ（利用者の端末）か
らのコマンドを受け付けるコマンドモード時に、モデム
装置１の内部の変復調回路４，インタフェース回路７へ
の電力供給を停止するリレースイッチ８を設ける。 【効果】 携帯用コンピュータに内蔵されるモデム装置
など、電源容量の制約が大きいモデム装置として有利で
ある。
Description
【０００１】
【産業上の利用分野】この発明は、モデム装置に関し、
さらに詳しくは、電力消費を低減可能としたモデム装置
に関する。
さらに詳しくは、電力消費を低減可能としたモデム装置
に関する。
【０００２】
【従来の技術】図６は、従来のモデム装置５１の一例を
示したブロック図である。このモデム装置５１は、モデ
ム装置内部の処理を行う内部処理モードと，ＤＴＥ（モ
デム装置の利用者の端末）からのコマンドを受け付ける
コマンドモードと，通信回線を介して実際にデータ通信
を行う通信モードの３通りの動作モードを有している。
示したブロック図である。このモデム装置５１は、モデ
ム装置内部の処理を行う内部処理モードと，ＤＴＥ（モ
デム装置の利用者の端末）からのコマンドを受け付ける
コマンドモードと，通信回線を介して実際にデータ通信
を行う通信モードの３通りの動作モードを有している。
【０００３】ＣＰＵ５２の第１データ入出力ポートＤ
１，ＥＲ信号入力端子ＩＮＰは、それぞれに対応するＤ
ＴＥの端子と接続されている。ＣＰＵ５２の第２データ
入出力ポートＤ２は、変復調回路４，ＲＯＭ５，ＲＡＭ
６の各ポートと接続されている。ＣＰＵ５２のリセット
端子ＲＳＴは、パワーオンリセット用コンデンサＣを介
してモデム装置用電源ＶCCと，リセット回路Ｓを介して
ＤＴＥのＥＲ信号出力端子に接続されている。リセット
回路Ｓは、ＤＴＥのＥＲ信号出力端子から出力されるＥ
Ｒ（データ端末レディ）信号の立上がり時にリセット信
号を発生する機能を有する。ＣＰＵ５２の選択出力端子
ＣＳは、インバータＢを介して、ＲＯＭ５の選択入力端
子NOTＣＥと接続されている。変復調回路４には、イン
タフェース回路７を介して通信回線が接続されている。
１，ＥＲ信号入力端子ＩＮＰは、それぞれに対応するＤ
ＴＥの端子と接続されている。ＣＰＵ５２の第２データ
入出力ポートＤ２は、変復調回路４，ＲＯＭ５，ＲＡＭ
６の各ポートと接続されている。ＣＰＵ５２のリセット
端子ＲＳＴは、パワーオンリセット用コンデンサＣを介
してモデム装置用電源ＶCCと，リセット回路Ｓを介して
ＤＴＥのＥＲ信号出力端子に接続されている。リセット
回路Ｓは、ＤＴＥのＥＲ信号出力端子から出力されるＥ
Ｒ（データ端末レディ）信号の立上がり時にリセット信
号を発生する機能を有する。ＣＰＵ５２の選択出力端子
ＣＳは、インバータＢを介して、ＲＯＭ５の選択入力端
子NOTＣＥと接続されている。変復調回路４には、イン
タフェース回路７を介して通信回線が接続されている。
【０００４】次に、このモデム装置５１の動作について
説明する。ＣＰＵ５２が、モデム装置用電源ＶCCのパワ
ーオンまたはＤＴＥからのＥＲ信号の立上がり時にリセ
ットされると、モデム装置５１は、必要な内部処理を行
い、ＤＴＥからのコマンドを受け付けるコマンドモード
に入る。次に、モデム装置５１は、受け付けたコマンド
に対応した処理を行った後、データ通信を行う。
説明する。ＣＰＵ５２が、モデム装置用電源ＶCCのパワ
ーオンまたはＤＴＥからのＥＲ信号の立上がり時にリセ
ットされると、モデム装置５１は、必要な内部処理を行
い、ＤＴＥからのコマンドを受け付けるコマンドモード
に入る。次に、モデム装置５１は、受け付けたコマンド
に対応した処理を行った後、データ通信を行う。
【０００５】
【発明が解決しようとする課題】上記従来のモデム装置
５１では、モデム装置内部のあらゆる回路に、常に電力
を供給する構成になっていたので、モデム装置５１の利
用者からのコマンドを受け付けるコマンドモード時や，
モデム装置５１を使用しない時には、不必要な回路で消
費される電力が無駄になる問題点がある。
５１では、モデム装置内部のあらゆる回路に、常に電力
を供給する構成になっていたので、モデム装置５１の利
用者からのコマンドを受け付けるコマンドモード時や，
モデム装置５１を使用しない時には、不必要な回路で消
費される電力が無駄になる問題点がある。
【０００６】そこで、この発明の目的は、モデム装置の
実際上の動作に必要な回路のみに電力を供給することに
より、消費電力の低減を計ったモデム装置を提供するこ
とにある。
実際上の動作に必要な回路のみに電力を供給することに
より、消費電力の低減を計ったモデム装置を提供するこ
とにある。
【０００７】
【課題を解決するための手段】第１の観点では、この発
明は、モデム装置の利用者の端末からのコマンドを受け
付けるコマンドモードと，通信回線を介して通信を行う
通信モードとを少なくとも有するモデム装置において、
前記コマンドモード時にモデム装置の通信関連部分への
電力供給を停止または減少させるスイッチ手段を具備し
たことを特徴とするモデム装置を提供する。
明は、モデム装置の利用者の端末からのコマンドを受け
付けるコマンドモードと，通信回線を介して通信を行う
通信モードとを少なくとも有するモデム装置において、
前記コマンドモード時にモデム装置の通信関連部分への
電力供給を停止または減少させるスイッチ手段を具備し
たことを特徴とするモデム装置を提供する。
【０００８】第２の観点では、この発明は、モデム装置
を制御するＣＰＵをモデム装置の利用者の端末からの所
定の信号に応じてパワーダウンモードにするＣＰＵ制御
手段を具備したことを特徴とするモデム装置を提供す
る。
を制御するＣＰＵをモデム装置の利用者の端末からの所
定の信号に応じてパワーダウンモードにするＣＰＵ制御
手段を具備したことを特徴とするモデム装置を提供す
る。
【０００９】
【作用】第１の観点のモデム装置では、コマンドモード
時には、動作させる必要のない通信関連部分への電力供
給を停止または減少させる。このため、通信関連部分で
消費される分の電力を節約することが出来る。
時には、動作させる必要のない通信関連部分への電力供
給を停止または減少させる。このため、通信関連部分で
消費される分の電力を節約することが出来る。
【００１０】第２の観点のモデム装置では、モデム装置
を使用しないときに、利用者の端末側からの所定の信号
により、ＣＰＵをパワーダウンモードにすることが出来
る。このため、ＣＰＵで消費される電力を低減すること
が出来る。
を使用しないときに、利用者の端末側からの所定の信号
により、ＣＰＵをパワーダウンモードにすることが出来
る。このため、ＣＰＵで消費される電力を低減すること
が出来る。
【００１１】
【実施例】以下、図に示す実施例によりこの発明をさら
に詳細に説明する。なお、これによりこの発明が限定さ
れるものではない。図１は、この発明の一実施例による
モデム装置のブロック図である。このモデム装置１は、
モデム装置内部の処理を行う内部処理モードと，ＤＴＥ
からのコマンドを受け付けるコマンドモードと，通信回
線を介して実際にデータ通信を行う通信モードの３通り
の動作モードを有している。
に詳細に説明する。なお、これによりこの発明が限定さ
れるものではない。図１は、この発明の一実施例による
モデム装置のブロック図である。このモデム装置１は、
モデム装置内部の処理を行う内部処理モードと，ＤＴＥ
からのコマンドを受け付けるコマンドモードと，通信回
線を介して実際にデータ通信を行う通信モードの３通り
の動作モードを有している。
【００１２】ＣＰＵ２のリレー制御出力端子Ｇ１は、リ
レースイッチ８のリレー制御端子ＲＧと接続されてい
る。ＣＰＵ２のバッファゲート出力端子Ｇ２は、バッフ
ァ３のゲート端子ＧＴと接続されている。ＣＰＵ２の第
１データ入出力ポートＤ１，ＥＲ信号入力端子ＩＮＰ
は、それぞれに対応するＤＴＥの端子と接続されてい
る。ＣＰＵ２の第２データ入出力ポートＤ２は、バッフ
ァ３を介して変復調回路４に接続されている。また、Ｒ
ＯＭ５と，ＲＡＭ６の各ポートに接続されている。ＣＰ
Ｕ２のリセット端子ＲＳＴは、パワーオンリセット用コ
ンデンサＣを介してモデム装置用電源ＶCCと，リセット
回路Ｓを介してＤＴＥのＥＲ信号出力端子と接続されて
いる。リセット回路Ｓは、ＤＴＥのＥＲ信号出力端子か
ら出力されるＥＲ信号の立上がり時にリセット信号を発
生する機能を有する。ＣＰＵ２の選択出力端子ＣＳは、
インバータＢと，ＲＣ積分回路Ｔを介して、ＲＯＭ５の
選択入力端子NOTＣＥと接続されている。変復調処理回
路４には、インタフェース回路７を介して通信回線が接
続されている。
レースイッチ８のリレー制御端子ＲＧと接続されてい
る。ＣＰＵ２のバッファゲート出力端子Ｇ２は、バッフ
ァ３のゲート端子ＧＴと接続されている。ＣＰＵ２の第
１データ入出力ポートＤ１，ＥＲ信号入力端子ＩＮＰ
は、それぞれに対応するＤＴＥの端子と接続されてい
る。ＣＰＵ２の第２データ入出力ポートＤ２は、バッフ
ァ３を介して変復調回路４に接続されている。また、Ｒ
ＯＭ５と，ＲＡＭ６の各ポートに接続されている。ＣＰ
Ｕ２のリセット端子ＲＳＴは、パワーオンリセット用コ
ンデンサＣを介してモデム装置用電源ＶCCと，リセット
回路Ｓを介してＤＴＥのＥＲ信号出力端子と接続されて
いる。リセット回路Ｓは、ＤＴＥのＥＲ信号出力端子か
ら出力されるＥＲ信号の立上がり時にリセット信号を発
生する機能を有する。ＣＰＵ２の選択出力端子ＣＳは、
インバータＢと，ＲＣ積分回路Ｔを介して、ＲＯＭ５の
選択入力端子NOTＣＥと接続されている。変復調処理回
路４には、インタフェース回路７を介して通信回線が接
続されている。
【００１３】図２は、モデム装置１のメインルーチンで
の処理手順を示したフローチャートである。ＣＰＵ２
は、モデム装置用電源ＶCCのパワーオンまたはＤＴＥか
らのＥＲ信号の立上がり時にリセットされる（ステップ
１）。モデム装置１は、内部処理モード（詳細後述）に
入り、規定の内部処理を行う（ステップＳ２）。モデム
装置１は、コマンドモード（詳細後述）に入り、ＤＴＥ
からのコマンドを受け付ける（ステップＳ３）。モデム
装置１は、通信モード（詳細後述）に入り、通信回線を
介してデータ通信を行う（ステップＳ４）。
の処理手順を示したフローチャートである。ＣＰＵ２
は、モデム装置用電源ＶCCのパワーオンまたはＤＴＥか
らのＥＲ信号の立上がり時にリセットされる（ステップ
１）。モデム装置１は、内部処理モード（詳細後述）に
入り、規定の内部処理を行う（ステップＳ２）。モデム
装置１は、コマンドモード（詳細後述）に入り、ＤＴＥ
からのコマンドを受け付ける（ステップＳ３）。モデム
装置１は、通信モード（詳細後述）に入り、通信回線を
介してデータ通信を行う（ステップＳ４）。
【００１４】図３は、内部処理モードに入ったステップ
Ｓ２（図２参照）内の処理手順を示したフローチャート
である。モデム装置１は、内部処理モード本来の処理を
行う（ステップＳ２１）。
Ｓ２（図２参照）内の処理手順を示したフローチャート
である。モデム装置１は、内部処理モード本来の処理を
行う（ステップＳ２１）。
【００１５】ＣＰＵ２は、バッファゲート出力端子Ｇ２
をＨｉとする。バッファ３は、ハイインピーダンスとな
る（ステップＳ２２）。ＣＰＵ２は、リレー制御出力端
子Ｇ１をＨｉにして、リレースイッチ８をオフにし（ス
テップＳ２３）、変復調回路４，インタフェース回路７
への電力供給を停止する。
をＨｉとする。バッファ３は、ハイインピーダンスとな
る（ステップＳ２２）。ＣＰＵ２は、リレー制御出力端
子Ｇ１をＨｉにして、リレースイッチ８をオフにし（ス
テップＳ２３）、変復調回路４，インタフェース回路７
への電力供給を停止する。
【００１６】ＣＰＵ２は、ＤＴＥからのＥＲ信号がＨｉ
であるか否か判定する。Ｈｉである場合、ステップＳ２
５に進む。Ｈｉでない場合、ステップＳ２６に進む。
であるか否か判定する。Ｈｉである場合、ステップＳ２
５に進む。Ｈｉでない場合、ステップＳ２６に進む。
【００１７】ステップＳ２５で、メインルーチンに復帰
する。
する。
【００１８】ステップＳ２６で、ＣＰＵ２は、ＲＯＭ５
を非選択にする命令をＲＯＭ５からフェッチした後、こ
の命令を実行し、選択出力端子ＣＳのレベルをＬｏにす
る。しかし、ＣＰＵ２の選択出力端子ＣＳとＲＯＭ５の
選択入力端子NOTＣＥの間には、ＲＣ積分回路Ｔがある
ため、ＲＯＭ５の選択入力端子NOTＣＥのレベルは、し
ばらくの間Ｌｏのままであり、ＲＯＭ５の選択状態が続
いている。この間にＣＰＵ２は、ＣＰＵ２がパワーダウ
ンモードに入る命令をＲＯＭ５からフェッチする。この
後に、ＣＰＵ２は、前記命令を実行し、パワーダウンモ
ードに入る。ＣＰＵ２がＲＯＭ５からパワーダウンモー
ドに入る命令をフェッチし終ったあと、ＲＯＭ５の選択
入力端子NOTＣＥのレベルがスレシュホールドレベルＴH
を超えてＨｉとなり、ＲＯＭ５は非選択状態（省電力モ
ード）に入る（ステップＳ２７）。ＣＰＵ２は、パワー
ダウンモードのまま停止する（ステップＳ２９）。な
お、パワーダウンモードに入るＤＴＥからの信号として
は、上記ＥＲ信号の他に、モデム装置の利用者が新たに
定義する信号を用いることも可能である。
を非選択にする命令をＲＯＭ５からフェッチした後、こ
の命令を実行し、選択出力端子ＣＳのレベルをＬｏにす
る。しかし、ＣＰＵ２の選択出力端子ＣＳとＲＯＭ５の
選択入力端子NOTＣＥの間には、ＲＣ積分回路Ｔがある
ため、ＲＯＭ５の選択入力端子NOTＣＥのレベルは、し
ばらくの間Ｌｏのままであり、ＲＯＭ５の選択状態が続
いている。この間にＣＰＵ２は、ＣＰＵ２がパワーダウ
ンモードに入る命令をＲＯＭ５からフェッチする。この
後に、ＣＰＵ２は、前記命令を実行し、パワーダウンモ
ードに入る。ＣＰＵ２がＲＯＭ５からパワーダウンモー
ドに入る命令をフェッチし終ったあと、ＲＯＭ５の選択
入力端子NOTＣＥのレベルがスレシュホールドレベルＴH
を超えてＨｉとなり、ＲＯＭ５は非選択状態（省電力モ
ード）に入る（ステップＳ２７）。ＣＰＵ２は、パワー
ダウンモードのまま停止する（ステップＳ２９）。な
お、パワーダウンモードに入るＤＴＥからの信号として
は、上記ＥＲ信号の他に、モデム装置の利用者が新たに
定義する信号を用いることも可能である。
【００１９】図４は、コマンドモードに入ったステップ
Ｓ３（図２参照）内の処理手順を示したフローチャート
である。モデム装置１は、コマンドモード本来の処理を
行う（ステップＳ３１）。
Ｓ３（図２参照）内の処理手順を示したフローチャート
である。モデム装置１は、コマンドモード本来の処理を
行う（ステップＳ３１）。
【００２０】ＣＰＵ２は、ＤＴＥから受け付けたコマン
ドが、ＡＴＤ（自動ダイヤル）コマンドであるか否か判
定する。ＡＴＤコマンドであった場合、ステップＳ３３
に進む。ＡＴＤコマンドでなかった場合、ステップＳ３
４に進む（ステップＳ３２）。
ドが、ＡＴＤ（自動ダイヤル）コマンドであるか否か判
定する。ＡＴＤコマンドであった場合、ステップＳ３３
に進む。ＡＴＤコマンドでなかった場合、ステップＳ３
４に進む（ステップＳ３２）。
【００２１】ステップＳ３３で、ＣＰＵ２は、リレー制
御出力端子Ｇ１をＬｏにして、リレースイッチ８をオン
とし（ステップＳ３３）、変復調回路４，インタフェー
ス回路７へ電力を供給する。
御出力端子Ｇ１をＬｏにして、リレースイッチ８をオン
とし（ステップＳ３３）、変復調回路４，インタフェー
ス回路７へ電力を供給する。
【００２２】ステップＳ３４で、モデム装置１は、ＣＰ
Ｕ２が受け付けたコマンドに対応したコマンド対応処理
を行う。
Ｕ２が受け付けたコマンドに対応したコマンド対応処理
を行う。
【００２３】ＣＰＵ２は、バッファゲート出力端子Ｇ２
をＬｏにして、バッファ３をスルーとする（ステップ３
５）。メインルーチンに復帰する（ステップＳ３６）。
をＬｏにして、バッファ３をスルーとする（ステップ３
５）。メインルーチンに復帰する（ステップＳ３６）。
【００２４】なお、ＡＴＤコマンドに加えて若しくは，
その代りに、利用者が定義したコマンドや，ループテス
トコマンドなどを用いてもよい。
その代りに、利用者が定義したコマンドや，ループテス
トコマンドなどを用いてもよい。
【００２５】図５は、通信モードに入ったステップＳ４
（図２参照）内の処理手順を示したフローチャートであ
る。モデム装置１は、ＤＴＥから受け付けたＡＴＤコマ
ンドに基づいてダイヤルするなど、通信モード本来の処
理を行う（ステップＳ４１）。
（図２参照）内の処理手順を示したフローチャートであ
る。モデム装置１は、ＤＴＥから受け付けたＡＴＤコマ
ンドに基づいてダイヤルするなど、通信モード本来の処
理を行う（ステップＳ４１）。
【００２６】ＣＰＵ２は、通信回線が切断状態であるか
否か判定する。通信回線が切断状態の場合、ステップＳ
４３に進む。通信回線が接続状態の場合、ステップＳ４
１に戻る（ステップ４２）。
否か判定する。通信回線が切断状態の場合、ステップＳ
４３に進む。通信回線が接続状態の場合、ステップＳ４
１に戻る（ステップ４２）。
【００２７】メインルーチンに復帰する（ステップＳ４
５）。
５）。
【００２８】
【発明の効果】この発明の第１の観点のモデム装置によ
れば、コマンドモード時には、不必要な通信関連部分の
電力を節約することが出来る。また、第２の観点のモデ
ム装置によれば、モデム装置を使用しないときに、ＣＰ
Ｕで消費される電力を低減することが出来る。そこで、
携帯用コンピュータに内蔵されるモデム装置など、電源
容量の制約が大きいモデム装置として有利である。
れば、コマンドモード時には、不必要な通信関連部分の
電力を節約することが出来る。また、第２の観点のモデ
ム装置によれば、モデム装置を使用しないときに、ＣＰ
Ｕで消費される電力を低減することが出来る。そこで、
携帯用コンピュータに内蔵されるモデム装置など、電源
容量の制約が大きいモデム装置として有利である。
【図１】この発明の一実施例のモデム装置のブロック図
である。
である。
【図２】図１のモデム装置のメインルーチンでの処理手
順を示したフローチャートである。
順を示したフローチャートである。
【図３】図２のメインルーチン内の処理手順を示したフ
ローチャートである。
ローチャートである。
【図４】図２のメインルーチン内の処理手順を示したフ
ローチャートである。
ローチャートである。
【図５】図２のメインルーチン内の処理手順を示したフ
ローチャートである。
ローチャートである。
【図６】従来のモデム装置の一例のブロック図である。
１ モデム装置 ２ ＣＰＵ ３ バッファ ４ 変復調回路 ５ ＲＯＭ ６ ＲＡＭ ７ インタフェース回路 ８ リレースイッチ ＶCC モデム装置用電源 Ｂ インバータ Ｃ パワーオンリセット用コンデンサ Ｓ リセット回路 Ｔ ＲＣ積分回路 ＤＴＥ 端末 ５１ モデム装置 ５２ ＣＰＵ
Claims (2)
- 【請求項１】 モデム装置の利用者の端末からのコマン
ドを受け付けるコマンドモードと，通信回線を介して通
信を行う通信モードとを少なくとも有するモデム装置に
おいて、前記コマンドモード時にモデム装置の通信関連
部分への電力供給を停止または減少させるスイッチ手段
を具備したことを特徴とするモデム装置。 - 【請求項２】 モデム装置を制御するＣＰＵをモデム装
置の利用者の端末からの所定の信号に応じてパワーダウ
ンモードにするＣＰＵ制御手段を具備したことを特徴と
するモデム装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3222708A JP2936823B2 (ja) | 1991-09-03 | 1991-09-03 | モデム装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3222708A JP2936823B2 (ja) | 1991-09-03 | 1991-09-03 | モデム装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0630074A true JPH0630074A (ja) | 1994-02-04 |
| JP2936823B2 JP2936823B2 (ja) | 1999-08-23 |
Family
ID=16786666
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3222708A Expired - Lifetime JP2936823B2 (ja) | 1991-09-03 | 1991-09-03 | モデム装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2936823B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6845406B2 (en) | 2000-12-27 | 2005-01-18 | Fujitsu Limited | Information processing equipment, signal transformation equipment, method of communications, and computer product |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6130151A (ja) * | 1984-07-20 | 1986-02-12 | Fujitsu Ltd | 端末電源制御方式 |
| JPS6384338A (ja) * | 1986-09-29 | 1988-04-14 | Toshiba Corp | 電源投入／遮断制御方式 |
| JPH02287716A (ja) * | 1989-04-28 | 1990-11-27 | Seiko Epson Corp | 内蔵モデム電源制御装置 |
-
1991
- 1991-09-03 JP JP3222708A patent/JP2936823B2/ja not_active Expired - Lifetime
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6130151A (ja) * | 1984-07-20 | 1986-02-12 | Fujitsu Ltd | 端末電源制御方式 |
| JPS6384338A (ja) * | 1986-09-29 | 1988-04-14 | Toshiba Corp | 電源投入／遮断制御方式 |
| JPH02287716A (ja) * | 1989-04-28 | 1990-11-27 | Seiko Epson Corp | 内蔵モデム電源制御装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6845406B2 (en) | 2000-12-27 | 2005-01-18 | Fujitsu Limited | Information processing equipment, signal transformation equipment, method of communications, and computer product |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2936823B2 (ja) | 1999-08-23 |
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