JPH06295341A - エッジ座標検出装置 - Google Patents
エッジ座標検出装置Info
- Publication number
- JPH06295341A JPH06295341A JP6048540A JP4854094A JPH06295341A JP H06295341 A JPH06295341 A JP H06295341A JP 6048540 A JP6048540 A JP 6048540A JP 4854094 A JP4854094 A JP 4854094A JP H06295341 A JPH06295341 A JP H06295341A
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- JP
- Japan
- Prior art keywords
- frame memory
- edge coordinate
- memory unit
- data
- unit
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- Pending
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Abstract
(57)【要約】
【目的】 エッジ座標検出装置に用いるプログラム命令
語の構成の単純化を図る。 【構成】 入力されたアナログ信号の映像信号をデジタ
ル信号に変換し、任意のスレッショルドレベルにて二値
化する映像入力変換部４と、二値化された情報を記憶す
るフレームメモリ部３と、プログラム命令語の順序を記
憶する記憶装置２と、前記記憶装置２に記憶されたプロ
グラム命令語に応動して前記フレームメモリ部３のデー
タを変換してエッジ座標の情報を出力する演算処理部１
とを有している。 【効果】 プログラム命令語の構成を単純化することが
でき、しかもフレームメモリ部のデータを減少させるこ
とができる。
語の構成の単純化を図る。 【構成】 入力されたアナログ信号の映像信号をデジタ
ル信号に変換し、任意のスレッショルドレベルにて二値
化する映像入力変換部４と、二値化された情報を記憶す
るフレームメモリ部３と、プログラム命令語の順序を記
憶する記憶装置２と、前記記憶装置２に記憶されたプロ
グラム命令語に応動して前記フレームメモリ部３のデー
タを変換してエッジ座標の情報を出力する演算処理部１
とを有している。 【効果】 プログラム命令語の構成を単純化することが
でき、しかもフレームメモリ部のデータを減少させるこ
とができる。
Description
【０００１】
【産業上の利用分野】本発明は二値画像の処理に関し、
特にソフトウェアによるエッジ座標検出装置に関する。
特にソフトウェアによるエッジ座標検出装置に関する。
【０００２】
【従来の技術】従来、この種のエッジ座標検出装置は、
二値画像のデータが０→１，１→０に変化する輪郭線を
抽出し、その後、抽出された輪郭線を検索することによ
って行っていた。
二値画像のデータが０→１，１→０に変化する輪郭線を
抽出し、その後、抽出された輪郭線を検索することによ
って行っていた。
【０００３】
【発明が解決しようとする課題】上述した従来のエッジ
座標検出装置は、演算対象となるデータ量が多く、又、
その演算方法により同一データを複数回使用し、更に演
算回数が多いため、処理時間が長くなり、又プログラム
命令語が複雑になるという欠点がある。
座標検出装置は、演算対象となるデータ量が多く、又、
その演算方法により同一データを複数回使用し、更に演
算回数が多いため、処理時間が長くなり、又プログラム
命令語が複雑になるという欠点がある。
【０００４】本発明の目的は前記課題を解決したエッジ
座標検出装置を提供することにある。
座標検出装置を提供することにある。
【０００５】
【課題を解決するための手段】前記目的を達成するた
め、本発明に係るエッジ座標検出装置は、映像入力変換
部と、フレームメモリ部と、記憶装置と、演算処理部と
を有するエッジ座標検出装置であって、映像入力変換部
は、入力されたアナログ信号の映像信号をデジタル信号
に変換し、これを二値化してフレームメモリ部に出力す
るものであり、フレームメモリ部は、映像入力変換部か
ら入力された二値化情報を記憶するものであり、記憶装
置は、プログラムの命令語の順序を記憶するものであ
り、演算処理部は、記憶装置に記憶されたプログラムの
命令語に応動して、フレームメモリ部のデータを変換し
てエッジ座標の情報を出力するものである。
め、本発明に係るエッジ座標検出装置は、映像入力変換
部と、フレームメモリ部と、記憶装置と、演算処理部と
を有するエッジ座標検出装置であって、映像入力変換部
は、入力されたアナログ信号の映像信号をデジタル信号
に変換し、これを二値化してフレームメモリ部に出力す
るものであり、フレームメモリ部は、映像入力変換部か
ら入力された二値化情報を記憶するものであり、記憶装
置は、プログラムの命令語の順序を記憶するものであ
り、演算処理部は、記憶装置に記憶されたプログラムの
命令語に応動して、フレームメモリ部のデータを変換し
てエッジ座標の情報を出力するものである。
【０００６】また、映像入力変換部は、デジタル信号を
任意のスレッショルドレベルにて二値化するものであ
る。
任意のスレッショルドレベルにて二値化するものであ
る。
【０００７】また、フレームメモリ部は、映像入力変換
部からの情報を規則に従って配列記憶するものである。
部からの情報を規則に従って配列記憶するものである。
【０００８】また、演算処理部は、フレームメモリ部に
含まれるｎ×ｍマトリックス内の映像二値化データにお
ける相加平均Ｏ1を抽出し、次にフレームメモリ部に含
まれるｎ×Ｏ1マトリックス内の映像二値化データにお
ける相加平均Ｏ2を抽出し、これをＯL≒ＯL+1又はＯL＜
ＯL+1となる第Ｌ回に抽出された相加平均ＯL1を映像二
値化データのエッジ座標として出力するものである。
含まれるｎ×ｍマトリックス内の映像二値化データにお
ける相加平均Ｏ1を抽出し、次にフレームメモリ部に含
まれるｎ×Ｏ1マトリックス内の映像二値化データにお
ける相加平均Ｏ2を抽出し、これをＯL≒ＯL+1又はＯL＜
ＯL+1となる第Ｌ回に抽出された相加平均ＯL1を映像二
値化データのエッジ座標として出力するものである。
【０００９】
【作用】演算処理部１は、記憶装置２に記憶された順序
あるプログラム命令語に応動してフレームメモリ部３の
データを制御する。すなわち、演算処理部１は、図２に
示すようなフレームメモリ部３に含まれるｎ×ｍマトリ
ックスａ内の映像二値化データｂにおける相加平均Ｏ1
（図３のｃの位置）を抽出し、次にフレームメモリ部に
含まれるｎ×Ｏ1マトリックスｄ内の映像二値化データ
ｂにおける相加平均Ｏ2（図４のｅの位置）を抽出し、
これをＯL≒ＯL+1又はＯL＜ＯL+1となる第Ｌ回に抽出さ
れた相加平均ＯL1を映像二値化データｂのエッジ座標の
情報として出力する。
あるプログラム命令語に応動してフレームメモリ部３の
データを制御する。すなわち、演算処理部１は、図２に
示すようなフレームメモリ部３に含まれるｎ×ｍマトリ
ックスａ内の映像二値化データｂにおける相加平均Ｏ1
（図３のｃの位置）を抽出し、次にフレームメモリ部に
含まれるｎ×Ｏ1マトリックスｄ内の映像二値化データ
ｂにおける相加平均Ｏ2（図４のｅの位置）を抽出し、
これをＯL≒ＯL+1又はＯL＜ＯL+1となる第Ｌ回に抽出さ
れた相加平均ＯL1を映像二値化データｂのエッジ座標の
情報として出力する。
【００１０】
【実施例】以下、本発明の一実施例に図により説明す
る。
る。
【００１１】図１において、本発明に係るエッジ座標検
出装置は、映像入力変換部４と、フレームメモリ部３
と、記憶装置２と、演算処理部１とを有している。
出装置は、映像入力変換部４と、フレームメモリ部３
と、記憶装置２と、演算処理部１とを有している。
【００１２】映像入力変換部４は、入力されたアナログ
信号の映像信号をデジタル信号に変換し、これを二値化
してフレームメモリ部３に出力するものである。映像入
力変換部４は、デジタル信号を任意のスレッショルドレ
ベルにて二値化している。
信号の映像信号をデジタル信号に変換し、これを二値化
してフレームメモリ部３に出力するものである。映像入
力変換部４は、デジタル信号を任意のスレッショルドレ
ベルにて二値化している。
【００１３】フレームメモリ３部は、映像入力変換部４
から入力された二値化情報を記憶するものである。フレ
ームメモリ部３は、映像入力変換部４からの情報を規則
に従って配列記憶している。
から入力された二値化情報を記憶するものである。フレ
ームメモリ部３は、映像入力変換部４からの情報を規則
に従って配列記憶している。
【００１４】記憶装置２は、プログラムの命令語の順序
を記憶するものであり、演算処理部１は、記憶装置２に
記憶されたプログラムの命令語に応動して、フレームメ
モリ３部のデータを変換してエッジ座標の情報を出力す
るものである。
を記憶するものであり、演算処理部１は、記憶装置２に
記憶されたプログラムの命令語に応動して、フレームメ
モリ３部のデータを変換してエッジ座標の情報を出力す
るものである。
【００１５】演算処理部１は、記憶装置２に記憶された
順序あるプログラム命令語に応動してフレームメモリ部
３のデータを制御し、演算処理部１は、図２に示すよう
なフレームメモリ部３に含まれるｎ×ｍマトリックスａ
内の映像二値化データｂにおける相加平均Ｏ1（図３の
ｃの位置）を抽出し、次にフレームメモリ部に含まれる
ｎ×Ｏ1マトリックスｄ内の映像二値化データｂにおけ
る相加平均Ｏ2（図４のｅの位置）を抽出し、これをＯL
≒ＯL+1又はＯL＜ＯL+1となる第Ｌ回に抽出された相加
平均ＯL1を映像二値化データｂのエッジ座標の情報とし
て出力する。
順序あるプログラム命令語に応動してフレームメモリ部
３のデータを制御し、演算処理部１は、図２に示すよう
なフレームメモリ部３に含まれるｎ×ｍマトリックスａ
内の映像二値化データｂにおける相加平均Ｏ1（図３の
ｃの位置）を抽出し、次にフレームメモリ部に含まれる
ｎ×Ｏ1マトリックスｄ内の映像二値化データｂにおけ
る相加平均Ｏ2（図４のｅの位置）を抽出し、これをＯL
≒ＯL+1又はＯL＜ＯL+1となる第Ｌ回に抽出された相加
平均ＯL1を映像二値化データｂのエッジ座標の情報とし
て出力する。
【００１６】実施例において、映像入力変換部４は、映
像信号を入力として、入力されたアナログ信号をデジタ
ル信号に変換し、任意のスレッショルドレベルにて二値
化し、フレームメモリ部３へデータを転送する。
像信号を入力として、入力されたアナログ信号をデジタ
ル信号に変換し、任意のスレッショルドレベルにて二値
化し、フレームメモリ部３へデータを転送する。
【００１７】フレームメモリ部３は、転送されたデータ
を規則に従ってデータを配列記憶する。
を規則に従ってデータを配列記憶する。
【００１８】記憶装置２に含まれる順序あるプログラム
命令語に応動してフレームメモリ部３のデータを制御す
る演算処理部１は、図２に示すようなフレームメモリ部
３に含まれるｎ×ｍマトリックスａ内の映像二値化デー
タｂにおける相加平均Ｏ1（図３のｃの位置）を抽出
し、次にフレームメモリ部３に含まれるｎ×Ｏ1マトリ
ックスｄ内の映像二値化データｂにおける相加平均Ｏ2
（図４のｅの位置）を抽出し、これをＯL≒ＯL+1又はＯ
L＜ＯL+1となる第Ｌ回に抽出された相加平均ＯL1を映像
二値化データｂのエッジ座標の情報として出力する。図
５はｎ×Ｏ2マトリックスｆを示し、ｇは第３回目の相
加平均の位置（Ｏ3）を示す。図６はｎ×ＯL-1マトリッ
クスｈを示し、ｉは第ｌ回目の相加平均の位置（ＯL）
を示す。
命令語に応動してフレームメモリ部３のデータを制御す
る演算処理部１は、図２に示すようなフレームメモリ部
３に含まれるｎ×ｍマトリックスａ内の映像二値化デー
タｂにおける相加平均Ｏ1（図３のｃの位置）を抽出
し、次にフレームメモリ部３に含まれるｎ×Ｏ1マトリ
ックスｄ内の映像二値化データｂにおける相加平均Ｏ2
（図４のｅの位置）を抽出し、これをＯL≒ＯL+1又はＯ
L＜ＯL+1となる第Ｌ回に抽出された相加平均ＯL1を映像
二値化データｂのエッジ座標の情報として出力する。図
５はｎ×Ｏ2マトリックスｆを示し、ｇは第３回目の相
加平均の位置（Ｏ3）を示す。図６はｎ×ＯL-1マトリッ
クスｈを示し、ｉは第ｌ回目の相加平均の位置（ＯL）
を示す。
【００１９】すなわち、本発明の方式において、演算処
理部１は、フレームメモリ部３に記憶されたｎ×ｍマト
リックスの映像二値化データのＹ軸相加平均を得るため
に制御され、得られた数値Ｏ1を使用して演算処理部１
は再度フレームメモリ部３に記憶されたｎ×Ｏ1マトリ
ックスの映像二値化データのＹ軸相加平均を得るべく制
御され、数値Ｏ2を得て、ＯL≒ＯL+1又はＯL＜ＯL+1と
なるＬ＋１回繰返し制御されて得られた数値ＯLをｎ×
ｍマトリックスの映像二値化データのＹ軸方向のエッジ
座標の情報として出力するものであり、演算処理部１
は、単純，明解，高速に制御される。
理部１は、フレームメモリ部３に記憶されたｎ×ｍマト
リックスの映像二値化データのＹ軸相加平均を得るため
に制御され、得られた数値Ｏ1を使用して演算処理部１
は再度フレームメモリ部３に記憶されたｎ×Ｏ1マトリ
ックスの映像二値化データのＹ軸相加平均を得るべく制
御され、数値Ｏ2を得て、ＯL≒ＯL+1又はＯL＜ＯL+1と
なるＬ＋１回繰返し制御されて得られた数値ＯLをｎ×
ｍマトリックスの映像二値化データのＹ軸方向のエッジ
座標の情報として出力するものであり、演算処理部１
は、単純，明解，高速に制御される。
【００２０】
【発明の効果】以上説明したように本発明によれば、プ
ログラム命令語の構成が単純化されることにより、演算
処理部の制御手順が簡略化され、さらに制御・処理対象
となるフレームメモリ部のデータを減少することができ
る。
ログラム命令語の構成が単純化されることにより、演算
処理部の制御手順が簡略化され、さらに制御・処理対象
となるフレームメモリ部のデータを減少することができ
る。
【００２１】また映像入力変換部は、デジタル信号を任
意のスレッショルドレベルにて二値化するため、フレー
ムメモリ部内に規則に従って記憶させるのに最適な情報
を出力することができる。
意のスレッショルドレベルにて二値化するため、フレー
ムメモリ部内に規則に従って記憶させるのに最適な情報
を出力することができる。
【００２２】またフレームメモリ部は、情報を規則に従
って配列記憶するため、演算処理部によるフレームメモ
リ部内のデータ変換を迅速，円滑に行うことができる。
って配列記憶するため、演算処理部によるフレームメモ
リ部内のデータ変換を迅速，円滑に行うことができる。
【図１】本発明の一実施例を示す構成図である。
【図２】フレームメモリ部内の映像二値化データの構成
図である。
図である。
【図３】フレームメモリ部内における抽出された数値の
位置を表わす図である。
位置を表わす図である。
【図４】フレームメモリ部内における抽出された数値の
位置を表わす図である。
位置を表わす図である。
【図５】フレームメモリ部内における抽出された数値の
位置を表わす図である。
位置を表わす図である。
【図６】フレームメモリ部内における抽出された数値の
位置を表わす図である。
位置を表わす図である。
１ 演算処理部 ２ 記憶装置 ３ フレームメモリ部 ４ 映像入力変換部 ａ ｎ×ｍマトリックス ｂ 映像二値化データ ｃ 第１回目の相加平均の位置（Ｏ1） ｄ ｎ×Ｏ1マトリックス ｅ 第２回目の相加平均の位置（Ｏ2） ｆ ｎ×Ｏ2マトリックス ｇ 第３回目の相加平均の位置（Ｏ3） ｈ ｎ×ＯL-1マトリックス ｉ 第Ｌ回目の相加平均の位置（ＯL）
Claims (4)
- 【請求項１】 映像入力変換部と、フレームメモリ部
と、記憶装置と、演算処理部とを有するエッジ座標検出
装置であって、 映像入力変換部は、入力されたアナログ信号の映像信号
をデジタル信号に変換し、これを二値化してフレームメ
モリ部に出力するものであり、 フレームメモリ部は、映像入力変換部から入力された二
値化情報を記憶するものであり、 記憶装置は、プログラムの命令語の順序を記憶するもの
であり、 演算処理部は、記憶装置に記憶されたプログラムの命令
語に応動して、フレームメモリ部のデータを変換してエ
ッジ座標の情報を出力するものであることを特徴とする
エッジ座標検出装置。 - 【請求項２】 映像入力変換部は、デジタル信号を任意
のスレッショルドレベルにて二値化するものであること
を特徴とする請求項１に記載のエッジ座標検出装置。 - 【請求項３】 フレームメモリ部は、映像入力変換部か
らの情報を規則に従って配列記憶するものであることを
特徴とする請求項１に記載のエッジ座標検出装置。 - 【請求項４】 演算処理部は、フレームメモリ部に含ま
れるｎ×ｍマトリックス内の映像二値化データにおける
相加平均Ｏ1を抽出し、次にフレームメモリ部に含まれ
るｎ×Ｏ1マトリックス内の映像二値化データにおける
相加平均Ｏ2を抽出し、これをＯL≒ＯL+1又はＯL＜Ｏ
L+1となる第Ｌ回に抽出された相加平均ＯL1を映像二値
化データのエッジ座標として出力するものであることを
特徴とする請求項１に記載のエッジ座標検出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6048540A JPH06295341A (ja) | 1994-03-18 | 1994-03-18 | エッジ座標検出装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6048540A JPH06295341A (ja) | 1994-03-18 | 1994-03-18 | エッジ座標検出装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06295341A true JPH06295341A (ja) | 1994-10-21 |
Family
ID=12806208
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6048540A Pending JPH06295341A (ja) | 1994-03-18 | 1994-03-18 | エッジ座標検出装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06295341A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20030053386A (ko) * | 2001-12-22 | 2003-06-28 | 재단법인 포항산업과학연구원 | 시시디 카메라를 이용한 치수측정 방법 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5512431A (en) * | 1978-07-11 | 1980-01-29 | Mitsubishi Electric Corp | Pattern meter |
| JPS6136881A (ja) * | 1984-07-30 | 1986-02-21 | Fuji Electric Co Ltd | パタ−ン判別装置 |
-
1994
- 1994-03-18 JP JP6048540A patent/JPH06295341A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5512431A (en) * | 1978-07-11 | 1980-01-29 | Mitsubishi Electric Corp | Pattern meter |
| JPS6136881A (ja) * | 1984-07-30 | 1986-02-21 | Fuji Electric Co Ltd | パタ−ン判別装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20030053386A (ko) * | 2001-12-22 | 2003-06-28 | 재단법인 포항산업과학연구원 | 시시디 카메라를 이용한 치수측정 방법 |
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