JPH06268544A - 改善された合成器を利用する通信システム及び高速高分解能同調方法 - Google Patents
改善された合成器を利用する通信システム及び高速高分解能同調方法Info
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- JPH06268544A JPH06268544A JP5116315A JP11631593A JPH06268544A JP H06268544 A JPH06268544 A JP H06268544A JP 5116315 A JP5116315 A JP 5116315A JP 11631593 A JP11631593 A JP 11631593A JP H06268544 A JPH06268544 A JP H06268544A
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/16—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop
- H03L7/22—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using more than one loop
- H03L7/23—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using more than one loop with pulse counters or frequency dividers
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Superheterodyne Receivers (AREA)
- Noise Elimination (AREA)
- Circuits Of Receivers In General (AREA)
Abstract
(57)【要約】
【目的】 ディジタル信号プロセッサユニットによる周
波数修正を伴う低コストの近似周波数合成器を使用して
送信又は受信に際し高速高分解能周波数同調できる通信
システム及び同調方法を提供する。 【構成】 使用者は、情報の送信又は受信の際に周波数
を選択する。近似周波数合成器３２は、無線注入周波数
を提供するために使用される。制御器３８は、使用者選
択周波数を中継しかつこの周波数に対する近似周波数合
成器３２の最近接有効周波数を判定し、合成器３２をこ
の判定有効周波数にセットするように命令し、この判定
有効周波数と使用者選択周波数との差を計算し、この差
をディジタル信号プロセッサユニット３６に送り、後者
３６はこの差を因数分解アルゴリズムを使用して周波数
混合中に単一又は多重ステッププロセスで修正する。
波数修正を伴う低コストの近似周波数合成器を使用して
送信又は受信に際し高速高分解能周波数同調できる通信
システム及び同調方法を提供する。 【構成】 使用者は、情報の送信又は受信の際に周波数
を選択する。近似周波数合成器３２は、無線注入周波数
を提供するために使用される。制御器３８は、使用者選
択周波数を中継しかつこの周波数に対する近似周波数合
成器３２の最近接有効周波数を判定し、合成器３２をこ
の判定有効周波数にセットするように命令し、この判定
有効周波数と使用者選択周波数との差を計算し、この差
をディジタル信号プロセッサユニット３６に送り、後者
３６はこの差を因数分解アルゴリズムを使用して周波数
混合中に単一又は多重ステッププロセスで修正する。
Description
【０００１】
【産業上の利用分野】本発明は、通信システム、特に、
送信機及び受信機用高分解能周波数同調に関する。
送信機及び受信機用高分解能周波数同調に関する。
【０００２】
【問題を解決するための手段】本発明は、通信システ
ム、及び、無線送信機又は無線受信機に高速高分解能能
力を提供するために、ディジタル信号プロセッサユニッ
ト（以下、ＤＳＰと稱する）による周波数修正を伴う近
似周波数合成器を使用する方法を含む。
ム、及び、無線送信機又は無線受信機に高速高分解能能
力を提供するために、ディジタル信号プロセッサユニッ
ト（以下、ＤＳＰと稱する）による周波数修正を伴う近
似周波数合成器を使用する方法を含む。
【０００３】使用者は、情報を送信又は交信をしたい際
に周波数を選択する。近似周波数合成器は、無線注入周
波数を提供するために使用される。この型式の合成器
は、高安定性、低雑音かつ低寄性信号を示すことが、関
連技術における習熟者に知られている。本発明の近似周
波数合成器は、所与の１つ又は複数の帯域にわたり不等
増分周波数の範囲を含むことができる。
に周波数を選択する。近似周波数合成器は、無線注入周
波数を提供するために使用される。この型式の合成器
は、高安定性、低雑音かつ低寄性信号を示すことが、関
連技術における習熟者に知られている。本発明の近似周
波数合成器は、所与の１つ又は複数の帯域にわたり不等
増分周波数の範囲を含むことができる。
【０００４】音声制御器は、使用者選択周波数を中継し
かつその近似周波数合成器の（これに）最近接有効周波
数を判定する。この制御器は、この近似周波数合成器を
この所定有効周波数にセットするように命令し、この所
定有効周波数とこの使用者選択周波数との差を計算す
る。計算周波数（又は誤差）は、このＤＳＰに送られ
て、周波数混合中に修正される。
かつその近似周波数合成器の（これに）最近接有効周波
数を判定する。この制御器は、この近似周波数合成器を
この所定有効周波数にセットするように命令し、この所
定有効周波数とこの使用者選択周波数との差を計算す
る。計算周波数（又は誤差）は、このＤＳＰに送られ
て、周波数混合中に修正される。
【０００５】このＤＳＰは、中間周波数（ＩＦ）信号を
受信して、この信号をゼロヘルツ（Ｈｚ）中間信号又は
基本帯域と混合する。この制御器によって計算されたこ
の周波数誤差は、次いで、標準ＤＳＰ混合アルゴリズム
を利用して、混合除去される。この周波数混合は、単一
又は多重ステッププロセスで達成される。
受信して、この信号をゼロヘルツ（Ｈｚ）中間信号又は
基本帯域と混合する。この制御器によって計算されたこ
の周波数誤差は、次いで、標準ＤＳＰ混合アルゴリズム
を利用して、混合除去される。この周波数混合は、単一
又は多重ステッププロセスで達成される。
【０００６】本発明の目的は、改善された同調能力を有
する通信システムを提供することにある。本発明の特徴
は、ディジタル処理技術の使用を通して周波数混合を達
成することにある。
する通信システムを提供することにある。本発明の特徴
は、ディジタル処理技術の使用を通して周波数混合を達
成することにある。
【０００７】本発明の追加の特徴は、可変注入周波数同
調を達成するために近似周波数合成器を利用することに
ある。
調を達成するために近似周波数合成器を利用することに
ある。
【０００８】本発明の利点は、比較的低コスト合成器で
以て高速かつ効率的な周波数同調を実施する通信システ
ムを提供することにある。
以て高速かつ効率的な周波数同調を実施する通信システ
ムを提供することにある。
【０００９】これらの及び他の目的、特徴及び利点は、
本願の明細書、付図、及び特許請求の範囲に開示及び主
張されている。
本願の明細書、付図、及び特許請求の範囲に開示及び主
張されている。
【００１０】
【実施例】いま、付図を参照すると、これらの付図は同
様の事項を種々の角度から扱っており、図１は、先行技
術において周知のかつ本発明に組み込まれた近似周波数
合成器１０のブロック線図を示す。矢印１１は、図示さ
れていない制御器からの入力を表し、この制御器は近似
周波数合成器１０に周波数選択情報を供給する。近似周
波数合成器１０は、２つの位相ロックループ（以下、Ｐ
ＬＬと稱する）に及び１４を含む。近似周波数合成器１
０は２つのＰＬＬのみを含むように示されているが、云
うまでもなく、本発明の技術の教示を利用すれば、いく
つのＰＬＬを１つの合成器に採用してもかまわない。Ｐ
ＬＬ１２及び１４は類似した構成を有し、簡単のため
に、ＰＬＬ１２の詳細な構成のみについて説明する。
様の事項を種々の角度から扱っており、図１は、先行技
術において周知のかつ本発明に組み込まれた近似周波数
合成器１０のブロック線図を示す。矢印１１は、図示さ
れていない制御器からの入力を表し、この制御器は近似
周波数合成器１０に周波数選択情報を供給する。近似周
波数合成器１０は、２つの位相ロックループ（以下、Ｐ
ＬＬと稱する）に及び１４を含む。近似周波数合成器１
０は２つのＰＬＬのみを含むように示されているが、云
うまでもなく、本発明の技術の教示を利用すれば、いく
つのＰＬＬを１つの合成器に採用してもかまわない。Ｐ
ＬＬ１２及び１４は類似した構成を有し、簡単のため
に、ＰＬＬ１２の詳細な構成のみについて説明する。
【００１１】ＰＬＬ１２は、分周器１６、位相検出器１
８、分周器２０、積分器２２、低域通過フィルタ２４、
及び電圧制御発振器（以下、ＶＣＯと稱する）２６を含
む。基準周波数ｆｒは分周器１６に入力され、分周器１
６はさらに位相検出器１８に結合される。位相検出器１
８は、分周器２０から追加入力を受け、かつその出力を
積分器２２に結合する。積分器２２は低域通過フィルタ
２４に結合され、フィルタ２４はさらにＶＣＯ２６に結
合される。ＶＣＯ２６は、矢印２８、３０で、それぞ
れ、示されるように２つの出力信号を発生する。矢印３
０で示される信号は分周器２０に結合され、他方、矢印
２８で示される他のＶＣＯ信号は、ＰＬＬ１４の場合に
おけるような、追加のＰＬＬの分周器構成要素に結合さ
れることがある。
８、分周器２０、積分器２２、低域通過フィルタ２４、
及び電圧制御発振器（以下、ＶＣＯと稱する）２６を含
む。基準周波数ｆｒは分周器１６に入力され、分周器１
６はさらに位相検出器１８に結合される。位相検出器１
８は、分周器２０から追加入力を受け、かつその出力を
積分器２２に結合する。積分器２２は低域通過フィルタ
２４に結合され、フィルタ２４はさらにＶＣＯ２６に結
合される。ＶＣＯ２６は、矢印２８、３０で、それぞ
れ、示されるように２つの出力信号を発生する。矢印３
０で示される信号は分周器２０に結合され、他方、矢印
２８で示される他のＶＣＯ信号は、ＰＬＬ１４の場合に
おけるような、追加のＰＬＬの分周器構成要素に結合さ
れることがある。
【００１２】位相ロックループ１２がロック状態にある
とき、位相検出器１８の入力上の周波数は、Ｋ分周器１
６内の値によって基準周波数ｆｒを除いたものに等し
い。基準周波数が正確かつ安定した周波数源から到来す
るとき、周波数安定性は、この出力ＶＣＯ１６へ転送さ
れる。ＶＣＯ１６は、Ｋ分周器１６からとＬ分周器２０
からの位相検出器１８への入力どうしを周波数と位相に
おいて等しいように維持するに必要な周波数で強制的に
発振させられる。
とき、位相検出器１８の入力上の周波数は、Ｋ分周器１
６内の値によって基準周波数ｆｒを除いたものに等し
い。基準周波数が正確かつ安定した周波数源から到来す
るとき、周波数安定性は、この出力ＶＣＯ１６へ転送さ
れる。ＶＣＯ１６は、Ｋ分周器１６からとＬ分周器２０
からの位相検出器１８への入力どうしを周波数と位相に
おいて等しいように維持するに必要な周波数で強制的に
発振させられる。
【００１３】このＰＬＬは、多数の離散周波数を発生す
ることができる。これらの周波数は全て、Ｋによって分
周された基準周波数（ｆｒ／Ｋ）の倍数であり、かつＬ
分周器２０に対する値を選択すことによって選択され
る。もしＫ分周器１６がプログラマ可能ならば、周波数
の多数の集合がＰＬＬ１２から得られる。図１の基本同
調ループの場合は、周波数同調増分はｆｒ／Ｋであり、
その倍数はＬであって、したがってその出力周波数は式
１に記載のように数学的に表現される。
ることができる。これらの周波数は全て、Ｋによって分
周された基準周波数（ｆｒ／Ｋ）の倍数であり、かつＬ
分周器２０に対する値を選択すことによって選択され
る。もしＫ分周器１６がプログラマ可能ならば、周波数
の多数の集合がＰＬＬ１２から得られる。図１の基本同
調ループの場合は、周波数同調増分はｆｒ／Ｋであり、
その倍数はＬであって、したがってその出力周波数は式
１に記載のように数学的に表現される。
【数１】ｆｏ＝Ｌ／Ｋ＊ｆｒ ここに、ｆｏ＝出力周波数 Ｋ ＝Ｋ分周器の値 Ｌ ＝Ｌ分周器の値 ｆｒ＝基準周波数
【００１４】周波数チャンネルの狭い間隔は小さい増分
同調ステップを必要とし、これが、さらに、ｆｒ／Ｋの
低い値を必要とする。このことは、低位相検出周波数を
意味する。しかしながら、高位相検出周波数は、ＶＣＯ
出力に対する高速整定時間を可能にする。なおまた、Ｌ
は基準周波数に対する乗数として作用するので、Ｌはま
た基準周波数の位相雑音に乗算し、したがって、Ｌの値
を低く維持したいと云う誘因がある。小周波数増分で以
って高スペクトル純度を得るための従来の解決は、１未
満のループを採用すると共に、乗数Ｌを設計値より低く
維持することである。
同調ステップを必要とし、これが、さらに、ｆｒ／Ｋの
低い値を必要とする。このことは、低位相検出周波数を
意味する。しかしながら、高位相検出周波数は、ＶＣＯ
出力に対する高速整定時間を可能にする。なおまた、Ｌ
は基準周波数に対する乗数として作用するので、Ｌはま
た基準周波数の位相雑音に乗算し、したがって、Ｌの値
を低く維持したいと云う誘因がある。小周波数増分で以
って高スペクトル純度を得るための従来の解決は、１未
満のループを採用すると共に、乗数Ｌを設計値より低く
維持することである。
【００１５】図１において、２つのＰＬＬは、縦続式に
リンクされている。近似周波数合成器１０の出力周波数
ｆｏより上へ式１に展開された関係を拡張すると、式２
に示されるようになる。
リンクされている。近似周波数合成器１０の出力周波数
ｆｏより上へ式１に展開された関係を拡張すると、式２
に示されるようになる。
【数２】ｆｏ＝Ｌ／Ｋ＊Ｘ／Ｙ＊ｆｒ ここに、ｆｏ＝出力周波数 Ｌ ＝Ｌ分周器の値 Ｋ ＝Ｋ分周器の値 Ｘ ＝Ｘ分周器の値 Ｙ ＝Ｙ分周器の値 ｆｒ＝基準周波数
【００１６】Ｋ、Ｙ、Ｌ、及びＸ分周器に対するプログ
ラム可能値を有するＰＬＬを利用することによって、比
較的広い周波数範囲を有する近似周波数合成器を構成す
ることができる。本出願人は、容易に入手可能の材料を
使用して２つの位相ロックループ近似周波数合成器を設
計し、この合成器は２〜８８ＭＨｚ帯域にわたり１ＫＨ
ｚ未満の間隔の周波数の集合を発生する能力がある。し
たがって、この帯域内のどの周波数でも１ＫＨｚ未満の
誤差で発生することができる。これに関連する技術の習
熟者に周知の技術に基づく、因数分解アルゴリズムは、
この帯域内の全ての整数周波数に対するＬ、Ｘ、及びＹ
の値を計算する。この因数分解アルゴリズムは、帯域内
位相雑音を設計値より下に維持するために、２０より下
のＸ値、及び２，７００より下のＬ値のみを選択する。
ラム可能値を有するＰＬＬを利用することによって、比
較的広い周波数範囲を有する近似周波数合成器を構成す
ることができる。本出願人は、容易に入手可能の材料を
使用して２つの位相ロックループ近似周波数合成器を設
計し、この合成器は２〜８８ＭＨｚ帯域にわたり１ＫＨ
ｚ未満の間隔の周波数の集合を発生する能力がある。し
たがって、この帯域内のどの周波数でも１ＫＨｚ未満の
誤差で発生することができる。これに関連する技術の習
熟者に周知の技術に基づく、因数分解アルゴリズムは、
この帯域内の全ての整数周波数に対するＬ、Ｘ、及びＹ
の値を計算する。この因数分解アルゴリズムは、帯域内
位相雑音を設計値より下に維持するために、２０より下
のＸ値、及び２，７００より下のＬ値のみを選択する。
【００１７】図２は、本発明を組み込んだ通信システム
のブロック線図を示す。アンテナ３０は、中継器２９に
結合される。中継器２９は、近似周波数合成器３２との
第１接続、アナログ−ディジタル変換器３４及びディジ
タル−アナログ変換器３５との第２接続を有する。変換
器３４及び３５は、ディジタル信号プロセッサユニット
（以下、ＤＳＰと稱する）３６に結合される。制御器３
８は、近似周波数合成器３２及びＤＳＰ３６に結合され
る。制御器３８は、システム使用者が所望の同調周波数
を選択することを可能にする。周波数標準４０が、な
お、正確目的のために、近似周波数合成器３２に結合さ
れることもある。
のブロック線図を示す。アンテナ３０は、中継器２９に
結合される。中継器２９は、近似周波数合成器３２との
第１接続、アナログ−ディジタル変換器３４及びディジ
タル−アナログ変換器３５との第２接続を有する。変換
器３４及び３５は、ディジタル信号プロセッサユニット
（以下、ＤＳＰと稱する）３６に結合される。制御器３
８は、近似周波数合成器３２及びＤＳＰ３６に結合され
る。制御器３８は、システム使用者が所望の同調周波数
を選択することを可能にする。周波数標準４０が、な
お、正確目的のために、近似周波数合成器３２に結合さ
れることもある。
【００１８】図３は、図２に示されたシステムの機能を
流れ図に示す。第１ステップ６０は、使用者に送信又は
受信する際の周波数を選択することを要求する。次のス
テップ６２は、この近似周波数合成器上で有効なかつ使
用者選択周波数に最近接周波数を判定するようにそのシ
ステム制御器に要求する。ステップ６４において、この
制御器は、使用者選択周波数とこの近似周波数合成器の
有効最近接周波数との差を計算し、この情報をそのＤＳ
Ｐに送る。ステップ６６において、この制御器は、この
近似周波数合成器をステップ６２において選択された周
波数にセットし、ステップ６８において、計算された周
波数差をこのＤＳＰに送る。このＤＳＰは、ステップ７
０において、ステップ６６の計算された差と受信又は送
信すべき信号からの中間周波数とを混合する。
流れ図に示す。第１ステップ６０は、使用者に送信又は
受信する際の周波数を選択することを要求する。次のス
テップ６２は、この近似周波数合成器上で有効なかつ使
用者選択周波数に最近接周波数を判定するようにそのシ
ステム制御器に要求する。ステップ６４において、この
制御器は、使用者選択周波数とこの近似周波数合成器の
有効最近接周波数との差を計算し、この情報をそのＤＳ
Ｐに送る。ステップ６６において、この制御器は、この
近似周波数合成器をステップ６２において選択された周
波数にセットし、ステップ６８において、計算された周
波数差をこのＤＳＰに送る。このＤＳＰは、ステップ７
０において、ステップ６６の計算された差と受信又は送
信すべき信号からの中間周波数とを混合する。
【００１９】図４は、送信機に組み込まれた本発明の代
替実施例を示す。注意すべきことは、図４に示された実
施例は、本願の基礎的技術を実現するために必要でない
回路複雑性を含んでいると云うことである。粗同調素子
と微同調素子へ分かれる信号は、図３の流れ図に概括さ
れたプロセスを実現するためには必要ない。
替実施例を示す。注意すべきことは、図４に示された実
施例は、本願の基礎的技術を実現するために必要でない
回路複雑性を含んでいると云うことである。粗同調素子
と微同調素子へ分かれる信号は、図３の流れ図に概括さ
れたプロセスを実現するためには必要ない。
【００２０】図４において、音声入力７１は、アナログ
−ディジタルに変換器７２内でディジタル信号に変換さ
れる。アナログ−ディジタル変換器７２の出力は、複素
ベースバンド通過フィルタ７４に結合される。中間周波
数信号Ｉ及び複素ベースバンド信号Ｑは、ベースバンド
通過フィルタ７４の結果の出力であり、全複素周波数中
継器７６に結合される。中継器７６の出力は、複素補間
フィルタ７８に結合され、このフィルタは、さらに半複
素中継器８０に結合される。
−ディジタルに変換器７２内でディジタル信号に変換さ
れる。アナログ−ディジタル変換器７２の出力は、複素
ベースバンド通過フィルタ７４に結合される。中間周波
数信号Ｉ及び複素ベースバンド信号Ｑは、ベースバンド
通過フィルタ７４の結果の出力であり、全複素周波数中
継器７６に結合される。中継器７６の出力は、複素補間
フィルタ７８に結合され、このフィルタは、さらに半複
素中継器８０に結合される。
【００２１】図４において上述の信号処理とは独立に、
ダイヤル周波数８２が使用者によって選択されかつ制御
器８４によって確認される。制御器８４は、近似周波数
合成器８６の有効最近接周波数を判定し、選択し、かつ
使用者選択周波数とこの合成器選択周波数との差を計算
する。この計算周波数誤差は、そのＤＳＰに送られ、こ
のＤＳＰは粗及び微周波数因数分解を遂行する。この結
果の微周波数因数分解は、全複素周波数中継器７６に結
合される。全複素周波数中継器７６は２つの出力を有
し、これらは複素補間フィルタ７８のロック信号入力で
ある。複素補間フィルタ７８は、信号を半複素周波数中
継器８０に出力する。さらに、粗周波数因数分解出力
が、半複素周波数中継器８０に結合される。半複素周波
数中継器８０の出力はディジタル−アナログ変換器９８
に結合され、後者の出力はＤＳＰ送信信号周波数として
働く。
ダイヤル周波数８２が使用者によって選択されかつ制御
器８４によって確認される。制御器８４は、近似周波数
合成器８６の有効最近接周波数を判定し、選択し、かつ
使用者選択周波数とこの合成器選択周波数との差を計算
する。この計算周波数誤差は、そのＤＳＰに送られ、こ
のＤＳＰは粗及び微周波数因数分解を遂行する。この結
果の微周波数因数分解は、全複素周波数中継器７６に結
合される。全複素周波数中継器７６は２つの出力を有
し、これらは複素補間フィルタ７８のロック信号入力で
ある。複素補間フィルタ７８は、信号を半複素周波数中
継器８０に出力する。さらに、粗周波数因数分解出力
が、半複素周波数中継器８０に結合される。半複素周波
数中継器８０の出力はディジタル−アナログ変換器９８
に結合され、後者の出力はＤＳＰ送信信号周波数として
働く。
【００２２】本発明の装置及び方法、並びにこれらの達
成する多くの利点はこれまでの説明から理解されると考
えられ、また、本発明の精神と範囲に反することなく、
又は全てのこれらの材料上の利点を犠牲にすることな
く、その部品の形式、構成、配置、そのステップに種々
な変更を加えることは可能であり、ここに記載された形
態は、単に、その好適実施例であることは、明かであ
る。
成する多くの利点はこれまでの説明から理解されると考
えられ、また、本発明の精神と範囲に反することなく、
又は全てのこれらの材料上の利点を犠牲にすることな
く、その部品の形式、構成、配置、そのステップに種々
な変更を加えることは可能であり、ここに記載された形
態は、単に、その好適実施例であることは、明かであ
る。
【図１】先行技術に周知の、近似周波数合成器のブロッ
ク線図。
ク線図。
【図２】本発明の教示による実施例の同調技術を含む無
線通信受信機システムのブロック線図。
線通信受信機システムのブロック線図。
【図３】図２に示されたシステムの機能流れ図。
【図４】本発明の教示による代替実施例の同調技術を含
む、粗同調及び微同調に対するステップを示す送信機シ
ステムのブロック線図。
む、粗同調及び微同調に対するステップを示す送信機シ
ステムのブロック線図。
【手続補正書】
【提出日】平成５年７月７日
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】全文
【補正方法】変更
【補正内容】
【書類名】 明細書
【発明の名称】 改善された合成器を利用する通信シス
テム及び高速高分解能同調方法
テム及び高速高分解能同調方法
【特許請求の範囲】
【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、通信システム、特に、
送信機及び受信機用高分解能周波数同調に関する。
送信機及び受信機用高分解能周波数同調に関する。
【０００２】
【従来の技術】どの通信システムについてもその原理的
要素の１つは、信号送信又は受信に対して所望の周波数
に正確に同調する能力である。周波数同調に対するあら
ゆる技術的調査研究は、システム複雑性と能力との間の
トレードオフを抱える。
要素の１つは、信号送信又は受信に対して所望の周波数
に正確に同調する能力である。周波数同調に対するあら
ゆる技術的調査研究は、システム複雑性と能力との間の
トレードオフを抱える。
【０００３】現今の通信応用に使用される無線周波数同
調器を設計するに当たり、技術者は、周波数同調構成要
素に対して直接ディジタル合成（以下、ＤＤＳと称す
る）の使用にしばしば依存してきた。不幸にして、ＤＤ
Ｓ型式のシステムは、正規動作中に発生する大量の寄生
周波数信号に典型的に関連している。これらの自発寄生
周波数信号を抑制するために、特別位相ロックループの
ような追加回路構成がこのシステムに追加される。これ
らの追加位相ロックループは、広帯域寄生信号成分を抑
制する低域通過フィルタとして働くが、しかしこのため
に設計複雑性、特別な構成要素の追加及び消費電力の増
大と云う犠牲を払う。
調器を設計するに当たり、技術者は、周波数同調構成要
素に対して直接ディジタル合成（以下、ＤＤＳと称す
る）の使用にしばしば依存してきた。不幸にして、ＤＤ
Ｓ型式のシステムは、正規動作中に発生する大量の寄生
周波数信号に典型的に関連している。これらの自発寄生
周波数信号を抑制するために、特別位相ロックループの
ような追加回路構成がこのシステムに追加される。これ
らの追加位相ロックループは、広帯域寄生信号成分を抑
制する低域通過フィルタとして働くが、しかしこのため
に設計複雑性、特別な構成要素の追加及び消費電力の増
大と云う犠牲を払う。
【０００４】代替的に、バーニヤ位相ロック方式を使用
することも考えられる。しかしながら、このバーニヤ位
相ロックループは、その補助的性質によって、除去すべ
き寄生周波数信号を発生する。これらの寄生信号は、バ
ーニヤ合成器内のループのような、２つ以上のループの
混合によって発生される。ＤＤＳに基づく無線通信シス
テムの場合、この自発寄生周波数信号の好ましくない影
響を最少化するために可なりの特別設計努力及び材料を
費やさなければならない。
することも考えられる。しかしながら、このバーニヤ位
相ロックループは、その補助的性質によって、除去すべ
き寄生周波数信号を発生する。これらの寄生信号は、バ
ーニヤ合成器内のループのような、２つ以上のループの
混合によって発生される。ＤＤＳに基づく無線通信シス
テムの場合、この自発寄生周波数信号の好ましくない影
響を最少化するために可なりの特別設計努力及び材料を
費やさなければならない。
【０００５】上述の型式の通信システムに関連して回路
複雑性及びコストの追加を回避するために、近似周波数
合成器構成要素を利用して所望する同調を達成すること
が、この種の無線設計技術の分野の習熟者に周知であ
る。近似周波数合成器は、送信又は受信に対する複数の
所定周波数を有し、これらの周波数は設計パラメータに
依存する。近似周波数合成器は、主として１つ以上のリ
ンク位相ロックループを含む装置であると考えてよい。
第１位相ロックループの出力周波数は、第２位相ロック
ループの基準周波数として働く。同様に、第２位相ロッ
クループの出力周波数は、第３位相ロックループの基準
周波数として働く。逐次位相ロックループの間のこの関
係は、ｎにわたって続き、ここにｎはこの近似周波数合
成器内の位相ロックループの数である。各位相ロックル
ープは、基準枝及び帰還枝の各々内に分周器構成要素を
有する。各位相ロックループの出力周波数は、これらの
分周器内へプログラムされる値の関数である。１つのル
ープの基準又は入力周波数が上昇すると、同調整定時間
が短縮する。したがって、１つの近似周波数合成器内の
位相ロックループの数が増大するに従い、プログラム可
能整数乗／除選択の数もまた増大し、それゆえ、周波数
選択の数も増大する。
複雑性及びコストの追加を回避するために、近似周波数
合成器構成要素を利用して所望する同調を達成すること
が、この種の無線設計技術の分野の習熟者に周知であ
る。近似周波数合成器は、送信又は受信に対する複数の
所定周波数を有し、これらの周波数は設計パラメータに
依存する。近似周波数合成器は、主として１つ以上のリ
ンク位相ロックループを含む装置であると考えてよい。
第１位相ロックループの出力周波数は、第２位相ロック
ループの基準周波数として働く。同様に、第２位相ロッ
クループの出力周波数は、第３位相ロックループの基準
周波数として働く。逐次位相ロックループの間のこの関
係は、ｎにわたって続き、ここにｎはこの近似周波数合
成器内の位相ロックループの数である。各位相ロックル
ープは、基準枝及び帰還枝の各々内に分周器構成要素を
有する。各位相ロックループの出力周波数は、これらの
分周器内へプログラムされる値の関数である。１つのル
ープの基準又は入力周波数が上昇すると、同調整定時間
が短縮する。したがって、１つの近似周波数合成器内の
位相ロックループの数が増大するに従い、プログラム可
能整数乗／除選択の数もまた増大し、それゆえ、周波数
選択の数も増大する。
【０００６】
【発明が解決しようとする課題】不幸にして、高分解能
同調を要する応用における近似周波数合成器に基づく無
線通信システムの使用は、調節可能の周波数無線通信シ
ステムに要求されるような小形かつ正規同調ステップ
に、合理的な回路パラメータを提供することができない
ので、禁止されている。高分解能応用において近似周波
数合成器の利点を活かすことのできる比較的簡単な周波
数同調器に対する要望が存在する。
同調を要する応用における近似周波数合成器に基づく無
線通信システムの使用は、調節可能の周波数無線通信シ
ステムに要求されるような小形かつ正規同調ステップ
に、合理的な回路パラメータを提供することができない
ので、禁止されている。高分解能応用において近似周波
数合成器の利点を活かすことのできる比較的簡単な周波
数同調器に対する要望が存在する。
【０００７】
【問題を解決するための手段】本発明は、通信システ
ム、及び、無線送信機又は無線受信機に高速高分解能能
力を提供するために、ディジタル信号プロセッサユニッ
ト（以下、ＤＳＰと稱する）による周波数修正を伴う近
似周波数合成器を使用する方法を含む。
ム、及び、無線送信機又は無線受信機に高速高分解能能
力を提供するために、ディジタル信号プロセッサユニッ
ト（以下、ＤＳＰと稱する）による周波数修正を伴う近
似周波数合成器を使用する方法を含む。
【０００８】使用者は、情報を送信又は交信をしたい際
に周波数を選択する。近似周波数合成器は、無線注入周
波数を提供するために使用される。この型式の合成器
は、高安定性、低雑音かつ低寄性信号を示すことが、関
連技術における習熟者に知られている。本発明の近似周
波数合成器は、所与の１つ又は複数の帯域にわたり不等
増分周波数の範囲を含むことができる。
に周波数を選択する。近似周波数合成器は、無線注入周
波数を提供するために使用される。この型式の合成器
は、高安定性、低雑音かつ低寄性信号を示すことが、関
連技術における習熟者に知られている。本発明の近似周
波数合成器は、所与の１つ又は複数の帯域にわたり不等
増分周波数の範囲を含むことができる。
【０００９】無線制御器は、使用者選択周波数を中継し
かつその近似周波数合成器の（これに）最近接有効周波
数を判定する。この制御器は、この近似周波数合成器を
この判定有効周波数にセットするように命令し、この判
定有効周波数とこの使用者選択周波数との差を計算す
る。計算周波数（又は誤差）は、このＤＳＰに送られ
て、周波数混合中に修正される。
かつその近似周波数合成器の（これに）最近接有効周波
数を判定する。この制御器は、この近似周波数合成器を
この判定有効周波数にセットするように命令し、この判
定有効周波数とこの使用者選択周波数との差を計算す
る。計算周波数（又は誤差）は、このＤＳＰに送られ
て、周波数混合中に修正される。
【００１０】このＤＳＰは、中間周波数（ＩＦ）信号を
受信して、この信号をゼロヘルツ（Ｈｚ）中間信号又は
基本帯域と混合する。この制御器によって計算されたこ
の周波数誤差は、次いで、標準ＤＳＰ混合アルゴリズム
を利用して、混合除去される。この周波数混合は、単一
又は多重ステッププロセスで達成される。
受信して、この信号をゼロヘルツ（Ｈｚ）中間信号又は
基本帯域と混合する。この制御器によって計算されたこ
の周波数誤差は、次いで、標準ＤＳＰ混合アルゴリズム
を利用して、混合除去される。この周波数混合は、単一
又は多重ステッププロセスで達成される。
【００１１】本発明の目的は、改善された同調能力を有
する通信システムを提供することにある。本発明の特徴
は、ディジタル処理技術の使用を通して周波数混合を達
成することにある。
する通信システムを提供することにある。本発明の特徴
は、ディジタル処理技術の使用を通して周波数混合を達
成することにある。
【００１２】本発明の追加の特徴は、可変注入周波数同
調を達成するために近似周波数合成器を利用することに
ある。
調を達成するために近似周波数合成器を利用することに
ある。
【００１３】本発明の利点は、比較的低コスト合成器で
以て高速かつ効率的な周波数同調を実施する通信システ
ムを提供することにある。
以て高速かつ効率的な周波数同調を実施する通信システ
ムを提供することにある。
【００１４】これらの及び他の目的、特徴及び利点は、
本願の明細書、付図、及び特許請求の範囲に開示及び主
張されている。
本願の明細書、付図、及び特許請求の範囲に開示及び主
張されている。
【００１５】
【実施例】いま、付図を参照すると、これらの付図は同
様の事項を種々の角度から扱っており、図１は、先行技
術において周知のかつ本発明に組み込まれた近似周波数
合成器１０のブロック線図を示す。矢印１１は、図示さ
れていない制御器からの入力を表し、この制御器は近似
周波数合成器１０に周波数選択情報を供給する。近似周
波数合成器１０は、２つの位相ロックループ（以下、Ｐ
ＬＬと稱する）１２及び１４を含む。近似周波数合成器
１０は２つのＰＬＬのみを含むように示されているが、
云うまでもなく、本発明の技術の教示を利用すれば、い
くつのＰＬＬを１つの合成器に採用してもかまわない。
ＰＬＬ１２及び１４は類似した構成を有し、簡単のため
に、ＰＬＬ１２の詳細な構成のみについて説明する。
様の事項を種々の角度から扱っており、図１は、先行技
術において周知のかつ本発明に組み込まれた近似周波数
合成器１０のブロック線図を示す。矢印１１は、図示さ
れていない制御器からの入力を表し、この制御器は近似
周波数合成器１０に周波数選択情報を供給する。近似周
波数合成器１０は、２つの位相ロックループ（以下、Ｐ
ＬＬと稱する）１２及び１４を含む。近似周波数合成器
１０は２つのＰＬＬのみを含むように示されているが、
云うまでもなく、本発明の技術の教示を利用すれば、い
くつのＰＬＬを１つの合成器に採用してもかまわない。
ＰＬＬ１２及び１４は類似した構成を有し、簡単のため
に、ＰＬＬ１２の詳細な構成のみについて説明する。
【００１６】ＰＬＬ１２は、分周器１６、位相検出器１
８、分周器２０、積分器２２、低域通過フィルタ２４、
及び電圧制御発振器（以下、ＶＣＯと稱する）２６を含
む。基準周波数ｆｒは分周器１６に入力され、分周器１
６はさらに位相検出器１８に結合される。位相検出器１
８は、分周器２０から追加入力を受け、かつその出力を
積分器２２に結合する。積分器２２は低域通過フィルタ
２４に結合され、フィルタ２４はさらにＶＣＯ２６に結
合される。ＶＣＯ２６は、矢印２８、３０で、それぞ
れ、示されるように２つの出力信号を発生する。矢印３
０で示される信号は分周器２０に結合され、他方、矢印
２８で示される他のＶＣＯ信号は、ＰＬＬ１４の場合に
おけるような、追加のＰＬＬの分周器構成要素に結合さ
れることがある。
８、分周器２０、積分器２２、低域通過フィルタ２４、
及び電圧制御発振器（以下、ＶＣＯと稱する）２６を含
む。基準周波数ｆｒは分周器１６に入力され、分周器１
６はさらに位相検出器１８に結合される。位相検出器１
８は、分周器２０から追加入力を受け、かつその出力を
積分器２２に結合する。積分器２２は低域通過フィルタ
２４に結合され、フィルタ２４はさらにＶＣＯ２６に結
合される。ＶＣＯ２６は、矢印２８、３０で、それぞ
れ、示されるように２つの出力信号を発生する。矢印３
０で示される信号は分周器２０に結合され、他方、矢印
２８で示される他のＶＣＯ信号は、ＰＬＬ１４の場合に
おけるような、追加のＰＬＬの分周器構成要素に結合さ
れることがある。
【００１７】位相ロックループ１２がロック状態にある
とき、位相検出器１８の入力上の周波数は、Ｋ分周器１
６内の値によって基準周波数ｆｒを除したものに等し
い。基準周波数が正確かつ安定した周波数源から到来す
るとき、周波数安定性は、この出力ＶＣＯ１６へ転送さ
れる。ＶＣＯ１６は、Ｋ分周器１６からとＬ分周器２０
からの位相検出器１８への入力どうしを周波数と位相に
おいて等しいように維持するに必要な周波数で強制的に
発振させられる。
とき、位相検出器１８の入力上の周波数は、Ｋ分周器１
６内の値によって基準周波数ｆｒを除したものに等し
い。基準周波数が正確かつ安定した周波数源から到来す
るとき、周波数安定性は、この出力ＶＣＯ１６へ転送さ
れる。ＶＣＯ１６は、Ｋ分周器１６からとＬ分周器２０
からの位相検出器１８への入力どうしを周波数と位相に
おいて等しいように維持するに必要な周波数で強制的に
発振させられる。
【００１８】このＰＬＬは、多数の離散周波数を発生す
ることができる。これらの周波数は全て、Ｋによって分
周された基準周波数（ｆｒ／Ｋ）の倍数であり、かつＬ
分周器２０に対する値を選択すことによって選択され
る。もしＫ分周器１６がプログラム可能ならば、周波数
の多数の集合がＰＬＬ１２から得られる。図１の基本同
調ループの場合は、周波数同調増分はｆｒ／Ｋであり、
その倍数はＬであって、したがってその出力周波数は式
１に記載のように数学的に表現される。
ることができる。これらの周波数は全て、Ｋによって分
周された基準周波数（ｆｒ／Ｋ）の倍数であり、かつＬ
分周器２０に対する値を選択すことによって選択され
る。もしＫ分周器１６がプログラム可能ならば、周波数
の多数の集合がＰＬＬ１２から得られる。図１の基本同
調ループの場合は、周波数同調増分はｆｒ／Ｋであり、
その倍数はＬであって、したがってその出力周波数は式
１に記載のように数学的に表現される。
【数１】ｆｏ＝Ｌ／Ｋ＊ｆｒ ここに、ｆｏ＝出力周波数 Ｋ ＝Ｋ分周器の値 Ｌ ＝Ｌ分周器の値 ｆｒ＝基準周波数
【００１９】周波数チャンネルの狭い間隔は小さい増分
同調ステップを必要とし、これが、さらに、ｆｒ／Ｋの
低い値を必要とする。このことは、低位相検出周波数を
意味する。しかしながら、高位相検出周波数は、ＶＣＯ
出力に対する高速整定時間を可能にする。なおまた、Ｌ
は基準周波数に対する乗数として作用するので、Ｌはま
た基準周波数の位相雑音に乗算し、したがって、Ｌの値
を低く維持したいと云う誘因がある。小周波数増分で以
って高スペクトル純度を得るための従来の解決は、１未
満のループを採用すると共に、乗数Ｌを設計値より低く
維持することである。
同調ステップを必要とし、これが、さらに、ｆｒ／Ｋの
低い値を必要とする。このことは、低位相検出周波数を
意味する。しかしながら、高位相検出周波数は、ＶＣＯ
出力に対する高速整定時間を可能にする。なおまた、Ｌ
は基準周波数に対する乗数として作用するので、Ｌはま
た基準周波数の位相雑音に乗算し、したがって、Ｌの値
を低く維持したいと云う誘因がある。小周波数増分で以
って高スペクトル純度を得るための従来の解決は、１未
満のループを採用すると共に、乗数Ｌを設計値より低く
維持することである。
【００２０】図１において、２つのＰＬＬは、縦続式に
リンクされている。近似周波数合成器１０の出力周波数
ｆｏより上へ式１に展開された関係を拡張すると、式２
に示されるようになる。
リンクされている。近似周波数合成器１０の出力周波数
ｆｏより上へ式１に展開された関係を拡張すると、式２
に示されるようになる。
【数２】ｆｏ＝Ｌ／Ｋ＊Ｘ／Ｙ＊ｆｒ ここに、ｆｏ＝出力周波数 Ｌ ＝Ｌ分周器の値 Ｋ ＝Ｋ分周器の値 Ｘ ＝Ｘ分周器の値 Ｙ ＝Ｙ分周器の値 ｆｒ＝基準周波数
【００２１】Ｋ、Ｙ、Ｌ、及びＸ分周器に対するプログ
ラム可能値を有するＰＬＬを利用することによって、比
較的広い周波数範囲を有する近似周波数合成器を構成す
ることができる。本出願人は、容易に入手可能の材料を
使用して２つの位相ロックループ近似周波数合成器を設
計し、この合成器は２〜８８ＭＨｚ帯域にわたり１ＫＨ
ｚ以下の間隔の周波数の集合を発生する能力がある。し
たがって、この帯域内のどの周波数でも１ＫＨｚ以下の
誤差で発生することができる。これに関連する技術の習
熟者に周知の技術に基づく、因数分解アルゴリズムは、
この帯域内の全ての整数周波数に対するＬ、Ｘ、及びＹ
の値を計算する。この因数分解アルゴリズムは、帯域内
位相雑音を設計値より下に維持するために、２０より下
のＸ値、及び２，７００より下のＬ値のみを選択する。
ラム可能値を有するＰＬＬを利用することによって、比
較的広い周波数範囲を有する近似周波数合成器を構成す
ることができる。本出願人は、容易に入手可能の材料を
使用して２つの位相ロックループ近似周波数合成器を設
計し、この合成器は２〜８８ＭＨｚ帯域にわたり１ＫＨ
ｚ以下の間隔の周波数の集合を発生する能力がある。し
たがって、この帯域内のどの周波数でも１ＫＨｚ以下の
誤差で発生することができる。これに関連する技術の習
熟者に周知の技術に基づく、因数分解アルゴリズムは、
この帯域内の全ての整数周波数に対するＬ、Ｘ、及びＹ
の値を計算する。この因数分解アルゴリズムは、帯域内
位相雑音を設計値より下に維持するために、２０より下
のＸ値、及び２，７００より下のＬ値のみを選択する。
【００２２】図２は、本発明を組み込んだ通信システム
のブロック線図を示す。アンテナ３０は、中継器２９に
結合される。中継器２９は、近似周波数合成器３２との
第１接続、アナログ−ディジタル変換器３４及びディジ
タル−アナログ変換器３５との第２接続を有する。変換
器３４及び３５は、ディジタル信号プロセッサユニット
（以下、ＤＳＰと稱する）３６に結合される。制御器３
８は、近似周波数合成器３２及びＤＳＰ３６に結合され
る。制御器３８は、システム使用者が所望の同調周波数
を選択することを可能にする。周波数標準４０が、な
お、正確目的のために、近似周波数合成器３２に結合さ
れることもある。
のブロック線図を示す。アンテナ３０は、中継器２９に
結合される。中継器２９は、近似周波数合成器３２との
第１接続、アナログ−ディジタル変換器３４及びディジ
タル−アナログ変換器３５との第２接続を有する。変換
器３４及び３５は、ディジタル信号プロセッサユニット
（以下、ＤＳＰと稱する）３６に結合される。制御器３
８は、近似周波数合成器３２及びＤＳＰ３６に結合され
る。制御器３８は、システム使用者が所望の同調周波数
を選択することを可能にする。周波数標準４０が、な
お、正確目的のために、近似周波数合成器３２に結合さ
れることもある。
【００２３】図３は、図２に示されたシステムの機能を
流れ図に示す。第１ステップ６０は、使用者に送信又は
受信する際の周波数を選択することを要求する。次のス
テップ６２は、この近似周波数合成器上で有効なかつ使
用者選択周波数に最近接周波数を判定するようにそのシ
ステム制御器に要求する。ステップ６４において、この
制御器は、使用者選択周波数とこの近似周波数合成器の
有効最近接周波数との差を計算し、この情報をそのＤＳ
Ｐに送る。ステップ６６において、この制御器は、この
近似周波数合成器をステップ６２において選択された周
波数にセットし、ステップ６８において、計算された周
波数差をこのＤＳＰに送る。このＤＳＰは、ステップ７
０において、ステップ６６の計算された差と受信又は送
信すべき信号からの中間周波数とを混合する。
流れ図に示す。第１ステップ６０は、使用者に送信又は
受信する際の周波数を選択することを要求する。次のス
テップ６２は、この近似周波数合成器上で有効なかつ使
用者選択周波数に最近接周波数を判定するようにそのシ
ステム制御器に要求する。ステップ６４において、この
制御器は、使用者選択周波数とこの近似周波数合成器の
有効最近接周波数との差を計算し、この情報をそのＤＳ
Ｐに送る。ステップ６６において、この制御器は、この
近似周波数合成器をステップ６２において選択された周
波数にセットし、ステップ６８において、計算された周
波数差をこのＤＳＰに送る。このＤＳＰは、ステップ７
０において、ステップ６６の計算された差と受信又は送
信すべき信号からの中間周波数とを混合する。
【００２４】図４は、送信機に組み込まれた本発明の代
替実施例を示す。注意すべきことは、図４に示された実
施例は、本願の基礎的技術を実現するために必要でない
回路複雑性を含んでいると云うことである。粗同調素子
と微同調素子へ分かれる信号は、図３の流れ図に概括さ
れたプロセスを実現するためには必要ない。
替実施例を示す。注意すべきことは、図４に示された実
施例は、本願の基礎的技術を実現するために必要でない
回路複雑性を含んでいると云うことである。粗同調素子
と微同調素子へ分かれる信号は、図３の流れ図に概括さ
れたプロセスを実現するためには必要ない。
【００２５】図４において、音声入力７１は、アナログ
−ディジタルに変換器７２内でディジタル信号に変換さ
れる。アナログ−ディジタル変換器７２の出力は、複素
ベースバンド通過フィルタ７４に結合される。中間周波
数信号Ｉ及び複素ベースバンド信号Ｑは、ベースバンド
通過フィルタ７４の結果の出力であり、全複素周波数中
継器７６に結合される。中継器７６の出力は、複素補間
フィルタ７８に結合され、このフィルタは、さらに半複
素中継器８０に結合される。
−ディジタルに変換器７２内でディジタル信号に変換さ
れる。アナログ−ディジタル変換器７２の出力は、複素
ベースバンド通過フィルタ７４に結合される。中間周波
数信号Ｉ及び複素ベースバンド信号Ｑは、ベースバンド
通過フィルタ７４の結果の出力であり、全複素周波数中
継器７６に結合される。中継器７６の出力は、複素補間
フィルタ７８に結合され、このフィルタは、さらに半複
素中継器８０に結合される。
【００２６】図４において上述の信号処理とは独立に、
ダイヤル周波数８２が使用者によって選択されかつ制御
器８４によって確認される。制御器８４は、近似周波数
合成器８６の有効最近接周波数を判定し、選択し、かつ
使用者選択周波数とこの合成器選択周波数との差を計算
する。この計算周波数誤差は、そのＤＳＰに送られ、こ
のＤＳＰは粗及び微周波数因数分解を遂行する。この結
果の微周波数因数分解は、全複素周波数中継器７６に結
合される。全複素周波数中継器７６は２つの出力を有
し、これらは複素補間フィルタ７８のロック信号入力で
ある。複素補間フィルタ７８は、信号を半複素周波数中
継器８０に出力する。さらに、粗周波数因数分解出力
が、半複素周波数中継器８０に結合される。半複素周波
数中継器８０の出力はディジタル−アナログ変換器９８
に結合され、後者の出力はＤＳＰ送信信号周波数として
働く。
ダイヤル周波数８２が使用者によって選択されかつ制御
器８４によって確認される。制御器８４は、近似周波数
合成器８６の有効最近接周波数を判定し、選択し、かつ
使用者選択周波数とこの合成器選択周波数との差を計算
する。この計算周波数誤差は、そのＤＳＰに送られ、こ
のＤＳＰは粗及び微周波数因数分解を遂行する。この結
果の微周波数因数分解は、全複素周波数中継器７６に結
合される。全複素周波数中継器７６は２つの出力を有
し、これらは複素補間フィルタ７８のロック信号入力で
ある。複素補間フィルタ７８は、信号を半複素周波数中
継器８０に出力する。さらに、粗周波数因数分解出力
が、半複素周波数中継器８０に結合される。半複素周波
数中継器８０の出力はディジタル−アナログ変換器９８
に結合され、後者の出力はＤＳＰ送信信号周波数として
働く。
【００２７】本発明の装置及び方法、並びにこれらの達
成する多くの利点はこれまでの説明から理解されると考
えられ、また、本発明の精神と範囲に反することなく、
又は全てのこれらの材料上の利点を犠牲にすることな
く、その部品の形式、構成、配置、そのステップに種々
な変更を加えることは可能であり、ここに記載された形
態は、単に、その好適実施例であることは、明かであ
る。
成する多くの利点はこれまでの説明から理解されると考
えられ、また、本発明の精神と範囲に反することなく、
又は全てのこれらの材料上の利点を犠牲にすることな
く、その部品の形式、構成、配置、そのステップに種々
な変更を加えることは可能であり、ここに記載された形
態は、単に、その好適実施例であることは、明かであ
る。
【図面の簡単な説明】
【図１】先行技術に周知の、近似周波数合成器のブロッ
ク線図。
ク線図。
【図２】本発明の教示による実施例の同調技術を含む無
線通信受信機システムのブロック線図。
線通信受信機システムのブロック線図。
【図３】図２に示されたシステムの機能流れ図。
【図４】本発明の教示による代替実施例の同調技術を含
む、粗同調及び微同調に対するステップを示す送信機シ
ステムのブロック線図。
む、粗同調及び微同調に対するステップを示す送信機シ
ステムのブロック線図。
【符号の説明】 １０ 近似周波数合成器 １２、１４ 位相ロックループ １６、２０ 分周器 ３２ 近似周波数合成器 ３４ アナログ−ディジタル変換器 ３５ ディジタル−アナログ変換器 ３６ ディジタル信号プロセッサユニット（ＤＳＰ） ３８ 制御器 ４０ 周波数標準 ７２ アナログ−ディジタル変換器 ８４ 制御器 ８６ 近似周波数合成器 ９８ ディジタル−アナログ変換器
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ロバート エー．ニューガード アメリカ合衆国アイオワ州マリオン，サー ド ストリート 1050
Claims (1)
- 【請求項１】 使用者に、信号を送信し又は受信する際
に所望周波数を選択可能とする手段と、 近似周波数合成器と、 ディジタル処理手段と、 制御器とを含み、使用者選択周波数と近似周波数合成器
の最近接有効周波数との差が前記制御器によって計算さ
れ、かつ信号混合中に除去されるために前記ディジタル
信号処理手段へ通過させられる、搬送信号送信又は受信
用通信システム装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US864988 | 1992-04-07 | ||
| US07/864,988 US5301366A (en) | 1992-04-07 | 1992-04-07 | High performance frequency tuning with low cost synthesizer |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06268544A true JPH06268544A (ja) | 1994-09-22 |
Family
ID=25344475
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5116315A Pending JPH06268544A (ja) | 1992-04-07 | 1993-04-07 | 改善された合成器を利用する通信システム及び高速高分解能同調方法 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5301366A (ja) |
| EP (1) | EP0565362B1 (ja) |
| JP (1) | JPH06268544A (ja) |
| DE (1) | DE69314373T2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007221689A (ja) * | 2006-02-20 | 2007-08-30 | Yagi Antenna Co Ltd | 広帯域高周波発振回路 |
| JP2009016973A (ja) * | 2007-07-02 | 2009-01-22 | Japan Radio Co Ltd | シンセサイザ |
| JP2009130544A (ja) * | 2007-11-21 | 2009-06-11 | Panasonic Corp | クロック信号発生回路 |
Families Citing this family (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5570066A (en) * | 1994-08-30 | 1996-10-29 | Motorola, Inc. | Method of programming a frequency synthesizer |
| US6417703B1 (en) * | 1996-09-25 | 2002-07-09 | Anritsu Company | Frequency synthesizer using a ratio sum topology |
| US5940747A (en) * | 1997-03-27 | 1999-08-17 | Lucent Technologies, Inc. | Apparatus and method of acquiring a carrier signal in a wireless receiver |
| US6873608B1 (en) * | 1997-08-06 | 2005-03-29 | Comsys Communication & Signal Processing Ltd | Communication system utilizing host signal processing |
| US20050083890A1 (en) * | 2000-02-03 | 2005-04-21 | Eli Plotnik | Communication system utilizing host signal processing |
| US20030058973A1 (en) * | 2001-06-01 | 2003-03-27 | Tsecouras Michael J. | Adaptive pulse frame rate frequency control for digital amplifier systems |
| EP1578691B8 (en) * | 2002-07-03 | 2018-10-17 | Nano-C, Inc. | Separation and purification of fullerenes |
| US7272365B2 (en) * | 2003-12-18 | 2007-09-18 | Andrew Corporation | Frequency offset correction in transmitters having non-ideal synthesizer channel spacing |
| CN109067395A (zh) * | 2018-08-17 | 2018-12-21 | 中国电子科技集团公司第三十八研究所 | 一种相位同步低相噪锁相频率合成装置 |
Family Cites Families (5)
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|---|---|---|---|---|
| US4602225A (en) * | 1984-06-24 | 1986-07-22 | Hewlett Packard Company | Apparatus for frequency correction in a frequency synthesizer |
| US4785260A (en) * | 1986-03-18 | 1988-11-15 | International Mobile Machines Corporation | Frequency synthesizer for broadcast telephone system having multiple assignable frequency channels |
| JPH02100409A (ja) * | 1988-10-06 | 1990-04-12 | Pioneer Electron Corp | 選局装置 |
| US5152005A (en) * | 1990-01-22 | 1992-09-29 | Motorola, Inc. | High resolution frequency synthesis |
| EP0454917B1 (en) * | 1990-05-02 | 1994-08-17 | Hewlett-Packard Limited | Frequency synthesiser |
-
1992
- 1992-04-07 US US07/864,988 patent/US5301366A/en not_active Expired - Fee Related
-
1993
- 1993-04-07 EP EP93302735A patent/EP0565362B1/en not_active Expired - Lifetime
- 1993-04-07 DE DE69314373T patent/DE69314373T2/de not_active Expired - Fee Related
- 1993-04-07 JP JP5116315A patent/JPH06268544A/ja active Pending
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| JP2009130544A (ja) * | 2007-11-21 | 2009-06-11 | Panasonic Corp | クロック信号発生回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| US5301366A (en) | 1994-04-05 |
| EP0565362A1 (en) | 1993-10-13 |
| EP0565362B1 (en) | 1997-10-08 |
| DE69314373D1 (de) | 1997-11-13 |
| DE69314373T2 (de) | 1998-05-14 |
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