JPH06102537A - Active matrix type liquid crystal display element - Google Patents

Active matrix type liquid crystal display element

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JPH06102537A
JPH06102537A JP25253192A JP25253192A JPH06102537A JP H06102537 A JPH06102537 A JP H06102537A JP 25253192 A JP25253192 A JP 25253192A JP 25253192 A JP25253192 A JP 25253192A JP H06102537 A JPH06102537 A JP H06102537A
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electrode
liquid crystal
capacitance
thin film
film transistor
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JP25253192A
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Japanese (ja)
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Yoshihiro Asai
義裕 浅井
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Toshiba Corp
Original Assignee
Toshiba Corp
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Publication date
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    • G02OPTICS
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    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
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    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/136Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit
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Abstract

PURPOSE:To obtain excellent visual angle characteristics by providing a control capacitance which can be formed in a simple manufacture process by using a low-cost dielectric film while avoiding decreases in the operation characteristics and reliability of a TFT. CONSTITUTION:This active matrix type liquid crystal display element is improved in the visual angle characteristics by being equipped with a pixel electrode halved into a 1st subordinate pixel electrode 1 which is connected to the TFT 5 and a 2nd subordinate pixel electrode 13 which is arranged adjacently to the 1st subordinate pixel electrode while avoiding contacting and overlapping with the 1st subordinate pixel electrode 1 in plane and is connected to the TFT 5 through the same material with the gate insulating film of the TFT 5 and electric capacitance 19 formed of a dielectric 17 made of the electrode 15 for the capacitance.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、薄膜トランジスタを画
素アレイのスイッチング素子として用いたアクティブマ
トリクス型液晶表示素子に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an active matrix type liquid crystal display element using a thin film transistor as a switching element of a pixel array.

【0002】[0002]

【従来の技術】電子機器の小型化や軽量化および低消費
電力化が近年進められているが、ディスプレイデバイス
の分野においてもCRT(Cathode Ray Tube)に代替す
る小型、軽量、低消費電力のディスプレイデバイスとし
て、フラットパネルディスプレイの研究・開発が盛んに
行なわれている。このなかでも、特に液晶表示素子は、
大面積表示が可能であることや、フルカラー化が可能で
あること、および低電流・低電圧動作のディスプレイデ
バイスであること等の特長を有している。
2. Description of the Related Art In recent years, electronic devices have been reduced in size and weight and reduced in power consumption. In the field of display devices, a small, lightweight, low power consumption display that replaces a CRT (Cathode Ray Tube). As a device, flat panel displays have been actively researched and developed. Among them, especially the liquid crystal display element,
It has features such as large-area display, full-color display, and low-current / low-voltage display device.

【0003】そのような液晶表示素子としては、目的に
応じて様々な動作方式のものが用いられるが、なかでも
アクティブマトリックス型液晶表示素子はフルカラーの
動画表示を高解像度で行なうことが可能である等の特長
を有しており、注目を集めている。
As such a liquid crystal display device, various operation systems are used according to the purpose. Among them, the active matrix liquid crystal display device is capable of displaying full-color moving images with high resolution. It has features such as, and is attracting attention.

【0004】アクティブマトリックス型液晶表示素子
は、マトリックス状に配置した電極の交差部分ごとに一
画素を配置し、その一画素ごとにスイッチング素子を配
設して、このスイッチング素子で接続された画素を個別
に駆動制御するものである。
In the active matrix type liquid crystal display element, one pixel is arranged at each intersection of electrodes arranged in a matrix, a switching element is arranged for each pixel, and the pixels connected by this switching element are arranged. The drive is controlled individually.

【0005】このようなアクティブマトリックス方式の
液晶表示素子は、スイッチング素子として用いられる素
子によってダイオードのような非線形素子を用いた非線
形素子型と薄膜トランジスタ(Thin Film Transistor:
TFT、以下TFTと略称)型とに分類できるが、この
うち特にTFT型の研究・開発が盛んに行なわれて既に
実用に供されているものもある。
Such an active matrix type liquid crystal display device includes a non-linear element type and a thin film transistor (Thin Film Transistor) using a non-linear element such as a diode depending on an element used as a switching element.
The TFT can be categorized into a TFT and hereinafter referred to as a TFT) type. Among them, there is a TFT type which has been actively researched and developed and has already been put to practical use.

【0006】しかしながら、液晶表示装置は一般的にC
RTなどに比べて視野角が狭いという欠点を有してい
る。そこでこのような視角特性を改善するために種々の
技術が考案されている。
However, liquid crystal display devices generally use C
It has a drawback that the viewing angle is narrower than that of RT. Therefore, various techniques have been devised to improve such viewing angle characteristics.

【0007】視角特性の改善を企図した従来の技術に係
る液晶表示装置としては、例えば特開平2−12号公報
に開示された液晶表示装置がある。図7はその構成を簡
略化して等価回路で示したものである。
As a conventional liquid crystal display device intended to improve the viewing angle characteristics, there is a liquid crystal display device disclosed in, for example, Japanese Patent Application Laid-Open No. 2-12. FIG. 7 shows an equivalent circuit in which the configuration is simplified.

【0008】図7において、一画素は第1の画素領域7
01と第2の画素領域703の 2つの画素領域から構成
されている。両画素領域は共通のTFT705に接続さ
れている。このTFT705は、交差して配置された走
査線707と信号線709との各交差部ごとに設けられ
ている。TFT705のゲートは行ごとに走査線707
に接続され、TFT705のドレインは列ごとに信号線
709に接続され、TFT705のソースは画素電極7
11に接続されている。
In FIG. 7, one pixel is the first pixel area 7
01 and the second pixel area 703. Both pixel regions are connected to a common TFT 705. The TFT 705 is provided at each intersection of the scanning line 707 and the signal line 709 which are arranged to intersect. The gate of the TFT 705 has a scanning line 707 for each row.
, The drain of the TFT 705 is connected to the signal line 709 for each column, and the source of the TFT 705 is connected to the pixel electrode 7.
11 is connected.

【0009】そして第1の画素領域701では、画素電
極711と対向電極713との間に液晶層715が挟持
され、第1の液晶容量717が形成される。また第2の
画素領域703では、画素電極711と対向電極713
との間に誘電体膜719および液晶層715が挟持され
て、第2の液晶容量721と、画素電極711および誘
電体膜719から形成される電気容量、すなわち第2の
液晶容量721に印加される電圧を分圧して制御する制
御容量723とが、直列に接続されるように形成されて
いる。
In the first pixel region 701, the liquid crystal layer 715 is sandwiched between the pixel electrode 711 and the counter electrode 713, and the first liquid crystal capacitor 717 is formed. Further, in the second pixel region 703, the pixel electrode 711 and the counter electrode 713.
And the dielectric film 719 and the liquid crystal layer 715 are sandwiched between the second liquid crystal capacitor 721 and the pixel electrode 711 and the dielectric film 719, that is, the second liquid crystal capacitor 721. A control capacitor 723 that divides the voltage to control the voltage is formed so as to be connected in series.

【0010】このような液晶表示素子においては、TF
T705のゲートに走査線選択電圧(Vg.on)が印加さ
れている期間(スイッチング期間)に、画素電極711
の電位が映像信号電極と同電位に設定され、TFT70
5のゲートに走査線非選択電圧(Vg.off )が印加され
ている期間(保持期間)には、画素電極711がこの電
位を保持する。そして第1の画素領域701では画素電
極711と対向電極713との電位差が第1の液晶容量
717に印加される。一方、第2の画素領域703では
画素電極711と対向電極713との間の電位差を第2
の液晶容量721と制御容量723とによって容量分割
された電圧が第2の液晶容量721に印加される。
In such a liquid crystal display device, the TF
During the period (switching period) in which the scanning line selection voltage (Vg.on) is applied to the gate of T705, the pixel electrode 711
Potential of the TFT 70 is set to the same potential as the video signal electrode.
During the period (holding period) in which the scanning line non-selection voltage (Vg.off) is applied to the gate of the pixel 5, the pixel electrode 711 holds this potential. Then, in the first pixel region 701, the potential difference between the pixel electrode 711 and the counter electrode 713 is applied to the first liquid crystal capacitor 717. On the other hand, in the second pixel region 703, the potential difference between the pixel electrode 711 and the counter electrode 713 is set to the second value.
The voltage divided by the liquid crystal capacitance 721 and the control capacitance 723 is applied to the second liquid crystal capacitance 721.

【0011】このように、特開平 2−12号公報に開示さ
れた液晶表示装置は、一画素を透過率の異なる 2つの画
素領域701、703から構成し、その 2つの画素領域
どうしが互いの視野角を補い合うようにすることで、視
角特性の向上を図ろうとするものである。
As described above, in the liquid crystal display device disclosed in Japanese Patent Application Laid-Open No. 2-12, one pixel is composed of two pixel regions 701 and 703 having different transmittances, and the two pixel regions are mutually arranged. By compensating for the viewing angles, the viewing angle characteristics are improved.

【0012】図8はそのような液晶表示装置のアレイ基
板上における一画素の平面的構成を示す図である。また
図9は図8におけるA−A´断面を示す図である。
FIG. 8 is a diagram showing a planar structure of one pixel on an array substrate of such a liquid crystal display device. 9 is a diagram showing a cross section taken along the line AA ′ in FIG.

【0013】図8、図9に示すように、ガラス基板70
0上には交差する走査線707と信号線709の各交差
部分ごとにTFT705が設けられている。
As shown in FIGS. 8 and 9, a glass substrate 70 is provided.
A TFT 705 is provided at each intersection of the scanning line 707 and the signal line 709 which intersect with each other.

【0014】TFT705の半導体層725にはゲー
ト、ソース、ドレインが形成されている。そのゲートは
走査線707と一体形成されたゲート電極727に、ド
レインは信号線709と一体形成されたドレイン電極7
29に、ソースは画素電極711と一体形成されたソー
ス電極731に各々接続されている。
A gate, a source and a drain are formed on the semiconductor layer 725 of the TFT 705. The gate is a gate electrode 727 formed integrally with the scanning line 707, and the drain is a drain electrode 7 formed integrally with the signal line 709.
29, the source is connected to the source electrode 731 integrally formed with the pixel electrode 711.

【0015】このようなアクティブマトリックス型液晶
表示素子においては、第2の画素領域703は図8に斜
線を付して示すように画素電極711上に誘電体膜71
9を形成した領域であり、第1の画素領域701はその
外側の画素電極711上の誘電体膜719が形成されて
いない領域である。またアレイ基板の主面側には液晶層
715に接するように配向膜733が形成されている。
In such an active matrix type liquid crystal display device, the second pixel region 703 has a dielectric film 71 on the pixel electrode 711 as shown by hatching in FIG.
9 is formed, and the first pixel area 701 is an area where the dielectric film 719 on the pixel electrode 711 outside thereof is not formed. An alignment film 733 is formed on the main surface side of the array substrate so as to be in contact with the liquid crystal layer 715.

【0016】一方、対向基板側は、ガラス基板737上
に対向電極739とその上を覆うように配向膜741と
が配設されている。
On the other hand, on the counter substrate side, a counter electrode 739 and an alignment film 741 are arranged on the glass substrate 737 so as to cover the counter electrode 739.

【0017】[0017]

【発明が解決しようとする課題】しかしながら、このよ
うな従来の液晶表示素子においては、TFT705を形
成した後に別の工程で別の材質の誘電体膜719を形成
していたので、この誘電体膜719を形成する工程中に
加熱されてTFT3の動作特性及び信頼性が著しく低下
するという問題があった。また、このような誘電体膜7
19を形成する工程や誘電体膜を用いることに起因し
て、製造工程が煩雑で材料コストも高価なものとなって
しまうという問題があった。
However, in such a conventional liquid crystal display element, since the dielectric film 719 made of another material is formed in another step after the TFT 705 is formed, this dielectric film is not formed. There is a problem that the operating characteristics and reliability of the TFT 3 are significantly deteriorated by being heated during the process of forming the 719. In addition, such a dielectric film 7
There is a problem in that the manufacturing process is complicated and the material cost is high due to the process of forming 19 and the use of the dielectric film.

【0018】一方、前記のようなTFT705の動作特
性及び信頼性の低下を避けるためには、そのTFT70
5のゲート絶縁膜743や半導体層725を形成した場
合よりも低い温度で誘電体膜719を形成しなければな
らない。このため誘電体膜719には例えばピンホール
欠陥のような膜の絶縁不良が発生して、良好な絶縁性が
得られず制御容量723の層間ショートが多発し、この
ような層間ショートにより他の正常画素とは異なった電
圧印加が行なわれて、その画素だけが他の正常画素とは
異なった表示状態に視認されて、画素欠陥となって観測
されるという問題があった。
On the other hand, in order to avoid the above-mentioned deterioration of the operating characteristics and reliability of the TFT 705, the TFT 70 is
5, the dielectric film 719 must be formed at a lower temperature than when the gate insulating film 743 and the semiconductor layer 725 of FIG. Therefore, the dielectric film 719 suffers from a film insulation defect such as a pinhole defect, a good insulation property cannot be obtained, and an interlayer short circuit of the control capacitor 723 frequently occurs. There is a problem in that a voltage different from that of a normal pixel is applied and only that pixel is visually recognized in a display state different from that of other normal pixels, resulting in a pixel defect.

【0019】また、上記のような技術の他にも、例えば
誘電体膜719の膜厚や材質を種々変更することによっ
て、それを用いた制御容量723の容量値を種々に設定
する技術や、容量制御用の電気容量を対向基板側に配置
する技術も考案されたが、このような誘電体膜719の
膜厚の制御や材質の変更は実際の製造に当たっては容易
ではなく、また対向基板側に新たに容量制御用の電気容
量を配置してこれを超微細なTFTアレイに正確にアラ
イメントすることは非常に困難なものであり、その結
果、製造工程が煩雑で材料コストも高価なものとなって
しまうという問題があった。
In addition to the above technique, for example, a technique of changing the film thickness and material of the dielectric film 719 to set various capacitance values of the control capacitor 723 using the same, A technique for arranging a capacitance for capacitance control on the counter substrate side was also devised, but such control of the film thickness of the dielectric film 719 and change of the material are not easy in actual manufacturing, and the counter substrate side is also difficult. It is very difficult to newly arrange a capacitance for capacitance control and accurately align it with an ultra-fine TFT array. As a result, the manufacturing process is complicated and the material cost is expensive. There was a problem of becoming.

【0020】本発明はこのような問題を解決するために
成されたものである。その目的は、簡易な製造工程によ
り形成でき、かつTFTの動作特性及び信頼性の低下を
避けることができ材料コストも低廉な誘電体膜を用いた
制御容量を具備して良好な視野角特性を実現したアクテ
ィブマトリックス型液晶表示素子を提供することにあ
る。
The present invention has been made to solve such a problem. The purpose is to provide a good viewing angle characteristic by providing a control capacitor using a dielectric film that can be formed by a simple manufacturing process, can avoid deterioration of the operating characteristics and reliability of the TFT, and is low in material cost. It is to provide an realized active matrix type liquid crystal display device.

【0021】[0021]

【課題を解決するための手段】第1の発明のアクティブ
マトリクス型液晶表示素子は、列設された走査線とこれ
にマトリックス状に交差するように列設された信号線と
前記走査線および前記信号線に接続された薄膜トランジ
スタ素子とこれに接続された画素電極とこれに対向する
対向電極と前記画素電極および前記対向電極の間に挟持
された液晶層とを有する液晶表示素子において、前記薄
膜トランジスタ素子に接続された第1の副画素電極と、
前記第1の副画素電極との平面的な接触および重複を避
けて前記第1の副画素電極と隣り合うように配設され前
記薄膜トランジスタ素子のゲート絶縁膜と同一の材質か
らなる誘電体と容量用電極とで電気容量を形成し該電気
容量を介して前記薄膜トランジスタ素子に接続された第
2の副画素電極とに 2分割された画素電極を具備するこ
とを特徴としている。
In the active matrix type liquid crystal display element of the first invention, there are arranged scanning lines and signal lines arranged so as to intersect with the scanning lines in a matrix, the scanning lines and the above. A thin film transistor element, comprising: a thin film transistor element connected to a signal line; a pixel electrode connected to the thin film transistor; a counter electrode facing the pixel electrode; and a liquid crystal layer sandwiched between the pixel electrode and the counter electrode. A first subpixel electrode connected to
A dielectric and a capacitor made of the same material as the gate insulating film of the thin film transistor element and disposed adjacent to the first subpixel electrode while avoiding planar contact and overlap with the first subpixel electrode. And a second sub-pixel electrode connected to the thin film transistor element via the capacitance, and the pixel electrode divided into two.

【0022】また、第2の発明のアクティブマトリクス
型液晶表示素子は、列設された走査線とこれにマトリッ
クス状に交差するように列設された信号線と前記走査線
および前記信号線に接続された薄膜トランジスタ素子と
これに接続された画素電極とこれに対向する対向電極と
前記画素電極および前記対向電極の間に挟持された液晶
層とを有する液晶表示素子において、前記薄膜トランジ
スタ素子のゲート絶縁膜と同一の材質からなる誘電体と
容量用電極とで第1の電気容量を形成し該電気容量を介
して前記薄膜トランジスタ素子に接続された第1の副画
素電極と、前記第1の副画素電極との平面的な接触およ
び重複を避けて前記第1の副画素電極と隣り合うように
配設され前記薄膜トランジスタ素子のゲート絶縁膜と同
一の材質からなる誘電体と容量用電極とで前記第1の電
気容量とは異なった容量値の第2の電気容量を形成し該
電気容量を介して前記薄膜トランジスタ素子に接続され
た第2の副画素電極とに 2分割された画素電極を具備す
ることを特徴としている。なお、上記の第1および第2
の発明のアクティブマトリックス型液晶表示素子は、絶
縁性基板上に前記容量用電極を形成し、該容量用電極上
に前記誘電体の層を形成し、該誘電体層上に前記第1の
副画素電極および前記第2の副画素電極を形成し、前記
誘電体層の一部にコンタクトホールを穿設し、該コンタ
クトホールを通して前記容量用電極と前記薄膜トランジ
スタ素子とを接続する構造としてもよい。
Further, the active matrix type liquid crystal display element of the second invention is connected to the scanning lines which are arranged in a row and the signal lines which are arranged in a row so as to intersect with the scanning lines in a matrix and the scanning lines and the signal lines. A thin film transistor element, a pixel electrode connected to the thin film transistor element, a counter electrode facing the pixel electrode, and a liquid crystal layer sandwiched between the pixel electrode and the counter electrode. A first sub-pixel electrode connected to the thin film transistor element via a first dielectric capacitance formed of a dielectric material and a capacitance electrode made of the same material, and the first sub-pixel electrode And is made of the same material as the gate insulating film of the thin film transistor element so as to be adjacent to the first subpixel electrode while avoiding a planar contact with and overlapping with the first subpixel electrode. An electric body and a capacitance electrode form a second electric capacitance having a capacitance value different from the first electric capacitance, and a second subpixel electrode connected to the thin film transistor element via the electric capacitance is formed. It is characterized by having a pixel electrode divided into two. In addition, the above-mentioned first and second
In the active matrix type liquid crystal display element of the invention, the capacitance electrode is formed on an insulating substrate, the dielectric layer is formed on the capacitance electrode, and the first sub-layer is formed on the dielectric layer. The pixel electrode and the second subpixel electrode may be formed, a contact hole may be formed in a part of the dielectric layer, and the capacitor electrode and the thin film transistor element may be connected through the contact hole.

【0023】[0023]

【作用】第1の発明のアクティブマトリクス型液晶表示
素子は、画素電極が第1の副画素電極とこの第1の副画
素電極との平面的な接触および重複を避けて配設された
第2の副画素電極とに、平面的に 2分割されており、第
2の副画素電極は電気容量を介して前記薄膜トランジス
タ素子に接続されているので、第2の副画素電極に印加
される電圧は、第1の副画素電極に印加される電圧に比
べて前記の電気容量による分圧だけ低下した電圧とな
り、第1の副画素と第2の副画素との光透過率および視
角特性が異なるようになる。また第2の発明のアクティ
ブマトリクス型液晶表示素子においても、これと同様に
第1の副画素電極に印加される電圧と第2の副画素電極
に印加される電圧とが第1の電気容量および第2の電気
容量の分圧の違いにより異なった電圧となって、第1の
副画素と第2の副画素との光透過率および視角特性が異
なるようになる。その結果、第1の副画素および第2の
副画素の視野角が互いに補完し合って、一画素全体での
視角特性が向上する。
In the active matrix type liquid crystal display element of the first invention, the pixel electrode is arranged so as to avoid the planar contact and overlap between the first subpixel electrode and the first subpixel electrode. The second subpixel electrode is connected to the thin film transistor element through an electric capacitance, and thus the voltage applied to the second subpixel electrode is , A voltage that is lower than the voltage applied to the first sub-pixel electrode by the partial voltage due to the electric capacitance, and the light transmittance and the viewing angle characteristics of the first sub-pixel and the second sub-pixel are different. become. Also in the active matrix type liquid crystal display element of the second invention, similarly, the voltage applied to the first subpixel electrode and the voltage applied to the second subpixel electrode are the same as the first capacitance and Due to the difference in the partial voltage of the second capacitance, different voltages result, and the light transmittance and the viewing angle characteristics of the first subpixel and the second subpixel differ. As a result, the viewing angles of the first sub-pixel and the second sub-pixel complement each other, and the viewing angle characteristics of one pixel as a whole are improved.

【0024】しかも、電気容量用の誘電体膜を薄膜トラ
ンジスタの構成材料以外の材質から特別に形成する必要
がないため、前記の電気容量を設けることによる製造工
程の煩雑化を避けることができ、またその製造コストも
低廉なものとすることができる。
Moreover, since it is not necessary to specially form the dielectric film for the electric capacity from a material other than the constituent material of the thin film transistor, it is possible to avoid the manufacturing process from being complicated by providing the electric capacity. The manufacturing cost can be low.

【0025】また、上記の第1および第2のアクティブ
マトリックス型液晶表示素子のさらに好適な具体的構成
としては、絶縁性基板上に前記容量用電極を形成し、該
容量用電極上に前記誘電体を形成し、該誘電体上に前記
第1の副画素電極および前記第2の副画素電極を形成
し、前記誘電体の一部にコンタクトホールを穿設し、該
コンタクトホールを通って前記容量用電極と前記薄膜ト
ランジスタ素子とを接続する接続配線を形成するように
すれば、ゲート絶縁膜および容量用電極を形成する際に
用いるマスクパターンを変更すること以外には従来のT
FT基板の製造工程を殆ど踏襲して前記の電気容量の誘
電体が形成できるので、さらに製造工程を効果的に簡易
化することができ、その製造コストも低廉なものとする
ことができる。
Further, as a more preferable concrete structure of the first and second active matrix type liquid crystal display elements, the capacitance electrode is formed on an insulating substrate, and the dielectric electrode is formed on the capacitance electrode. Forming a body, forming the first subpixel electrode and the second subpixel electrode on the dielectric, forming a contact hole in a part of the dielectric, and passing through the contact hole to form the contact hole. By forming a connection wiring that connects the capacitor electrode and the thin film transistor element, the conventional T wiring is used except for changing the mask pattern used when forming the gate insulating film and the capacitor electrode.
Since the dielectric having the above-mentioned capacitance can be formed almost following the manufacturing process of the FT substrate, the manufacturing process can be further effectively simplified and the manufacturing cost can be reduced.

【0026】[0026]

【実施例】以下、本発明に係るアクティブマトリックス
型液晶表示素子の実施例を図面に基づいて詳細に説明す
る。
Embodiments of the active matrix type liquid crystal display device according to the present invention will be described below in detail with reference to the drawings.

【0027】(実施例1)図1は第1の実施例のアクテ
ィブマトリックス型液晶表示素子の構成を簡略化して等
価回路で示す図、図2はそのTFTアレイ基板上の1画
素の平面的な構成を示す平面図であり、図3はそのB−
B´断面に相当する断面図である。
(Embodiment 1) FIG. 1 is a diagram showing a simplified structure of an active matrix type liquid crystal display element of the first embodiment by an equivalent circuit, and FIG. 2 is a plan view of one pixel on the TFT array substrate. FIG. 3 is a plan view showing the structure, and FIG.
It is a sectional view corresponding to a B'section.

【0028】これらの図に基づいて、第1の実施例のア
クティブマトリックス型液晶表示素子の構成と動作を説
明する。
The structure and operation of the active matrix type liquid crystal display device of the first embodiment will be described with reference to these figures.

【0029】一つの画素電極は平面的に 2分割されて第
1の副画素電極1および第2の副画素電極3の 2つの副
画素電極から構成され、TFT5はその両副画素電極
1、3に共通に接続されている。
One pixel electrode is divided into two in a plane and is composed of two sub-pixel electrodes, that is, a first sub-pixel electrode 1 and a second sub-pixel electrode 3. Are commonly connected to.

【0030】この第1の副画素電極1と液晶層7と対向
電極9とで第1の副画素11が構成されている。また第
2の副画素電極3と液晶層7と対向電極9とで第2の副
画素13が構成されている。そしてこの第2の副画素1
3とTFT5との間には、容量用電極15とTFT5の
ゲート絶縁膜として用いた膜を用いた誘電体17と第2
の副画素電極3とで構成される容量制御用の電気容量1
9が直列に接続されている。この電気容量19によっ
て、TFT5から送出された電圧が容量分割されて第1
の副画素電極1に印加される電圧よりも低電圧となって
第2の副画素電極3に印加される。
The first subpixel electrode 1, the liquid crystal layer 7, and the counter electrode 9 form a first subpixel 11. Further, the second subpixel electrode 3, the liquid crystal layer 7, and the counter electrode 9 form a second subpixel 13. And this second sub-pixel 1
Between the TFT 3 and the TFT 5, a dielectric 17 using the film used as the capacitor electrode 15 and the gate insulating film of the TFT 5 and the second
And the sub-pixel electrode 3 for controlling the capacitance 1
9 are connected in series. The voltage sent from the TFT 5 is capacity-divided by the electric capacity 19 and
The voltage becomes lower than the voltage applied to the sub-pixel electrode 1 and is applied to the second sub-pixel electrode 3.

【0031】その結果、第1の副画素11の印加電圧と
第2の副画素13の印加電圧は異なった値の電圧となっ
て第1の副画素11と第2の副画素13との光透過率お
よび視角特性が異なったものとなり、第1の副画素11
および第2の副画素13の視野角が互いに補完し合っ
て、一画素全体での視角特性が向上する。
As a result, the voltage applied to the first sub-pixel 11 and the voltage applied to the second sub-pixel 13 have different values, and the light applied to the first sub-pixel 11 and the light applied to the second sub-pixel 13 are different. Since the transmittance and the viewing angle characteristics are different, the first sub-pixel 11
And the viewing angles of the second sub-pixels 13 complement each other, and the viewing angle characteristics of one pixel as a whole are improved.

【0032】しかも、電気容量19に用いた誘電体17
は、TFT5のゲート絶縁膜に用いた膜を用いているの
で、TFT5を構成する材料以外の材質から特別に形成
する必要がないため、前記の電気容量19を設けること
による製造工程の煩雑化を避けることができ、またその
製造コストも低廉なものとすることができる。
Moreover, the dielectric 17 used for the electric capacity 19
Since the film used for the gate insulating film of the TFT 5 is used, it is not necessary to specially form it from a material other than the material forming the TFT 5, so that the manufacturing process is complicated by providing the electric capacitance 19. It can be avoided and its manufacturing cost can be low.

【0033】次に、本発明の第1の実施例のアクティブ
マトリックス型液晶表示素子の構成を、その製造工程に
従って詳細に説明する。
Next, the structure of the active matrix type liquid crystal display device of the first embodiment of the present invention will be described in detail in accordance with its manufacturing process.

【0034】まず、例えばガラス基板21の主面上に、
遮光性材料であるTa膜をスパッタ法で成膜した後、所
定の形状にフォトエッチングすることにより走査線23
及びゲート電極25が形成され、ITOのような透明導
電膜をスパッタ法により成膜後フォトエッチングにより
パターンニングして容量用電極15が形成されている。
次にこれらを覆うように例えばSiOx からなるゲー
ト絶縁膜27がプラズマCVD法により形成されてい
る。
First, for example, on the main surface of the glass substrate 21,
After forming a Ta film, which is a light-shielding material, by a sputtering method, the scanning line 23 is formed by photoetching into a predetermined shape.
Further, a gate electrode 25 is formed, a transparent conductive film such as ITO is formed by a sputtering method, and then patterned by photoetching to form a capacitor electrode 15.
Next, a gate insulating film 27 made of, for example, SiO x is formed by plasma CVD so as to cover them.

【0035】このゲート絶縁膜27は、TFT5の領域
においてはTFTのいわゆるゲート絶縁膜として用いら
れており、また容量用電極15上の領域においては、誘
電体17として用いられ、これを第2の副画素電極3と
容量用電極15で挟持して容量制御用の電気容量19が
形成されている。
This gate insulating film 27 is used as a so-called gate insulating film of the TFT in the area of the TFT 5, and is used as the dielectric 17 in the area on the capacitor electrode 15, which is used as the second insulating film. An electric capacitance 19 for capacitance control is formed by being sandwiched between the subpixel electrode 3 and the capacitance electrode 15.

【0036】すなわち、TFT5の領域においては、ゲ
ート絶縁膜27上のゲート電極25を覆う領域には、例
えばi型の水素アモルファスシリコン(以下、a−S
i:Hと略称)からなる半導体層29がプラズマCVD
法を用いて形成されている。その半導体層29上には互
いに電気的に分離されたn型a−Si:Hからなるオー
ミック層31、32が、同じくプラズマCVD法を用い
て配設されている。そしてオーミック層31には信号線
33と一体形成されたドレイン電極35が接続され、オ
ーミック層32にはソース電極37が接続されている。
ドレイン電極35及び信号線33、ソース電極37は、
例えばMo膜とAl膜をスパッタ法で順次成膜した後、
所定の形状にフォトエッチングして形成する。
That is, in the area of the TFT 5, in the area covering the gate electrode 25 on the gate insulating film 27, for example, i-type hydrogen amorphous silicon (hereinafter referred to as aS
The semiconductor layer 29 made of i: H) is plasma CVD
It is formed using the method. On the semiconductor layer 29, ohmic layers 31 and 32 made of n-type a-Si: H, which are electrically isolated from each other, are arranged similarly by using the plasma CVD method. A drain electrode 35 formed integrally with the signal line 33 is connected to the ohmic layer 31, and a source electrode 37 is connected to the ohmic layer 32.
The drain electrode 35, the signal line 33, and the source electrode 37 are
For example, after sequentially forming a Mo film and an Al film by a sputtering method,
It is formed by photoetching into a predetermined shape.

【0037】一方、容量用電極15上の領域において
は、ゲート絶縁膜27が誘電体17として用いられてお
り、このゲート絶縁膜27の上に例えばITOのような
透明導電膜をスパッタ法で成膜した後、フォトエッチン
グにより所定の形状に形成された第1の副画素電極1、
第2の副画素電極3が平面的に直接の接触や重複を避け
て、 2分割された 2つの副画素として配設されている。
そしてこのゲート絶縁膜27の一部にはコンタクトホー
ル57が穿設されており、このコンタクトホール57に
よって第1の副画素電極1の一部を介してソース電極3
7と容量用電極15とが接続されている。そしてこれら
の上全面を覆うように、例えばSiNx からなる保護膜
39がプラズマCVD法により形成され、さらにその上
の全面に例えば低温キュア型のポリイミドからなる配向
膜41が形成されている。
On the other hand, in the region on the capacitance electrode 15, the gate insulating film 27 is used as the dielectric 17, and a transparent conductive film such as ITO is formed on the gate insulating film 27 by the sputtering method. After forming the film, the first sub-pixel electrode 1 formed into a predetermined shape by photoetching,
The second sub-pixel electrode 3 is arranged as two sub-pixels divided in two, avoiding direct contact and overlap in the plane.
A contact hole 57 is formed in a part of the gate insulating film 27, and the source electrode 3 is formed by the contact hole 57 via a part of the first subpixel electrode 1.
7 and the capacitor electrode 15 are connected. Then, a protective film 39 made of, for example, SiN x is formed by plasma CVD so as to cover the entire upper surface thereof, and an alignment film 41 made of, for example, low temperature cure type polyimide is further formed on the entire surface thereof.

【0038】このようにTFTアレイ基板43は形成さ
れている。
In this way, the TFT array substrate 43 is formed.

【0039】一方、ガラス基板45の主面上には例えば
ITOのような透明導電膜からなる対向電極9が形成さ
れ、その全面を覆うように低温キュア型のポリイミドか
らなる配向膜49が形成されて対向基板51が形成され
ている。そしてTFTアレイ基板43および対向基板5
1の主面上の配向膜41、49をそれぞれ所定の方向に
布等で擦ることによりラビング配向処理が各々施されて
いる。
On the other hand, a counter electrode 9 made of a transparent conductive film such as ITO is formed on the main surface of the glass substrate 45, and an alignment film 49 made of low temperature cure type polyimide is formed so as to cover the entire surface thereof. Thus, the counter substrate 51 is formed. Then, the TFT array substrate 43 and the counter substrate 5
The rubbing alignment treatment is performed by rubbing the alignment films 41 and 49 on the first main surface in a predetermined direction with a cloth or the like.

【0040】そしてTFTアレイ基板43と対向基板5
1は、互いの主面側が対向しかつ互いの配向軸が90度の
角度を成すように組み合わされ、これらの基板の間隙に
は液晶層7が挟持される。アレイ基板43と対向基板5
1の主面とは反対側の外向面には、それぞれ偏光板5
3、55が貼設されている。そして、図示は省略する
が、アレイ基板43と対向基板51のいずれか一方の外
向面側に背面照明、いわゆるバックライトが配設され
る。
Then, the TFT array substrate 43 and the counter substrate 5
Nos. 1 and 2 are combined so that their principal surface sides face each other and their orientation axes form an angle of 90 degrees, and a liquid crystal layer 7 is sandwiched between the substrates. Array substrate 43 and counter substrate 5
Polarizing plate 5 is provided on each of the outward surfaces opposite to the main surface of 1.
3, 55 are attached. Although illustration is omitted, back lighting, that is, a backlight is provided on the outward surface side of either the array substrate 43 or the counter substrate 51.

【0041】以上のように、第1の実施例のアクティブ
マトリックス型液晶表示素子は、容量制御用の電気容量
19が、ゲート絶縁膜27を誘電体17として用いて、
これと容量用電極15と第2の副画素電極3とによって
形成されており、ゲート絶縁膜27は、例えば 300〜 4
00℃程度の高温で形成することが可能であるため、ピン
ホール欠陥などが発生することなく十分な絶縁性を得る
ことができる。これにより、従来絶縁不良に起因して発
生していた制御容量の層間ショートによる画素の表示欠
陥を減少させることができ、製造歩留まりを上げること
ができる。
As described above, in the active matrix type liquid crystal display element of the first embodiment, the capacitance control electric capacitance 19 uses the gate insulating film 27 as the dielectric 17,
The gate insulating film 27 is formed by this, the capacitor electrode 15 and the second subpixel electrode 3, and the gate insulating film 27 is, for example, 300 to 4
Since it can be formed at a high temperature of about 00 ° C., sufficient insulation can be obtained without causing pinhole defects and the like. As a result, it is possible to reduce display defects of the pixel due to interlayer short-circuiting of the control capacitor, which has been conventionally caused by defective insulation, and it is possible to increase the manufacturing yield.

【0042】しかも、電気容量19用の誘電体17はT
FT5の構成材料であるゲート絶縁膜27以外の材質か
ら特別に形成する必要がないため、この電気容量19を
設けることによる製造工程の煩雑化を避けることがで
き、またその製造コストも低廉なものとすることができ
る。
Moreover, the dielectric 17 for the capacitance 19 is T
Since it is not necessary to specially form a material other than the gate insulating film 27 which is a constituent material of the FT 5, it is possible to avoid complication of the manufacturing process due to the provision of the electric capacitance 19, and the manufacturing cost thereof is low. Can be

【0043】(実施例2)図4は第2の実施例のアクテ
ィブマトリックス型液晶表示素子の構成を簡略化して等
価回路で示す図、図5はその構成を示す平面図、図6は
その層構造を示す断面図である。
(Embodiment 2) FIG. 4 is a view showing a simplified structure of an active matrix type liquid crystal display element of a second embodiment by an equivalent circuit, FIG. 5 is a plan view showing the structure, and FIG. 6 is its layer. It is sectional drawing which shows a structure.

【0044】一つの画素電極は平面的に 2分割されて第
1の副画素電極401および第2の副画素電極403の
2つの副画素電極から構成され、TFT405はその両
副画素電極401、403に共通に接続されている。
One pixel electrode is divided into two in a plane and is divided into a first subpixel electrode 401 and a second subpixel electrode 403.
It is composed of two subpixel electrodes, and the TFT 405 is commonly connected to both subpixel electrodes 401 and 403.

【0045】この第1の副画素電極401と液晶層40
7と対向電極409とで第1の副画素411が構成され
ている。また第2の副画素電極403と液晶層407と
対向電極409とで第2の副画素413が構成されてい
る。そして第1の副画素411とTFT405との間に
は、容量用電極415とTFT405のゲート絶縁膜4
23と同じ膜を用いた誘電体417と第1の副画素電極
401とで構成される容量制御用の第1の電気容量41
9が直列に接続されている。
The first subpixel electrode 401 and the liquid crystal layer 40
7 and the counter electrode 409 form a first subpixel 411. Further, the second subpixel electrode 403, the liquid crystal layer 407, and the counter electrode 409 form a second subpixel 413. The capacitor electrode 415 and the gate insulating film 4 of the TFT 405 are provided between the first subpixel 411 and the TFT 405.
The first capacitance 41 for capacitance control, which is composed of the dielectric 417 and the first subpixel electrode 401 using the same film as that of No. 23.
9 are connected in series.

【0046】また第2の副画素413とTFT405と
の間には、容量用電極415とTFT405のゲート絶
縁膜423と同じ膜を用いた誘電体417と第2の副画
素電極403とで構成される容量制御用の第2の電気容
量421が直列に接続されている。
Further, between the second subpixel 413 and the TFT 405, there is formed a capacitor electrode 415, a dielectric 417 using the same film as the gate insulating film 423 of the TFT 405, and a second subpixel electrode 403. A second capacitance 421 for capacitance control is connected in series.

【0047】すなわち、この第2の実施例のアクティブ
マトリックス型液晶表示素子は、第1の実施例のアクテ
ィブマトリックス型液晶表示素子における第1の副画素
11に、第2の副画素13に接続した容量制御用の電気
容量19とは異なった容量値を有する第2の電気容量4
21を直列に接続したものと言うことができる。
That is, the active matrix liquid crystal display element of the second embodiment is connected to the first subpixel 11 and the second subpixel 13 of the active matrix liquid crystal display element of the first embodiment. The second capacitance 4 having a capacitance value different from that of the capacitance control capacitance 19.
It can be said that 21 is connected in series.

【0048】TFT405および各副画素411、41
3の層構造は、第1の実施例とほぼ同様であるが、図5
に明らかなように、その平面的構成は、第1の副画素4
11が有する第1の電気容量419の面積と第2の副画
素413が有する第2の電気容量421の面積とが異な
っている。例えばこの実施例では第1の副画素411が
有する第1の電気容量419の面積の方が、第2の副画
素413が有する第2の電気容量421の面積よりも大
きくなるように配設されている。これは第1の電気容量
419を構成する容量用電極415の面積と、第2の電
気容量421を構成する容量用電極415の面積とを異
なった面積とすることによって実現している。
The TFT 405 and the sub-pixels 411 and 41
The layer structure of No. 3 is almost the same as that of the first embodiment, except that FIG.
As can be seen in FIG.
The area of the first electric capacity 419 included in 11 and the area of the second electric capacity 421 included in the second subpixel 413 are different. For example, in this embodiment, the area of the first electric capacitance 419 of the first subpixel 411 is larger than the area of the second electric capacitance 421 of the second subpixel 413. ing. This is realized by making the area of the capacity electrode 415 forming the first electric capacity 419 different from the area of the capacity electrode 415 forming the second electric capacity 421.

【0049】このように、面積を異なったものとするこ
とで第1の電気容量419と第2の電気容量421は異
なった容量値に設定されている。
As described above, by making the areas different, the first electric capacitance 419 and the second electric capacitance 421 are set to different capacitance values.

【0050】これらの第1の電気容量419および第2
の電気容量421を各々第1の副画素411および第2
の副画素413にそれぞれ直列に接続することによっ
て、TFT405から送出された電圧が各々の電気容量
419、421によってそれぞれ容量分割されて、第1
の副画素電極401に印加される電圧の値と第2の副画
素電極403に印加される電圧の値とが異なったものと
なる。その結果、第1の副画素411の印加電圧と第2
の副画素413の印加電圧は異なった値の電圧となって
第1の副画素411と第2の副画素413との光透過率
および視角特性が異なったものとなり、第1の副画素4
11および第2の副画素413の視野角が互いに補完し
合って、一画素全体での視角特性が向上する。
These first capacitance 419 and second capacitance
Of the electric capacitance 421 of the first subpixel 411 and the second subpixel
By connecting the sub-pixels 413 in series with each other, the voltage sent from the TFT 405 is capacity-divided by the electric capacities 419 and 421, respectively.
The value of the voltage applied to the sub-pixel electrode 401 is different from the value of the voltage applied to the second sub-pixel electrode 403. As a result, the applied voltage of the first sub-pixel 411 and the second
The applied voltages of the sub-pixels 413 have different values, and the light transmittance and the viewing angle characteristics of the first sub-pixel 411 and the second sub-pixel 413 are different from each other.
The viewing angles of the eleventh and second sub-pixels 413 complement each other and the viewing angle characteristics of one pixel as a whole are improved.

【0051】しかも、電気容量419、421に用いた
誘電体417は、TFT405のゲート絶縁膜423に
用いた膜を用いているので、TFT405を構成する材
料以外の材質から特別に形成する必要がないため、前記
の電気容量419、421を設けることによる製造工程
の煩雑化を避けることができ、またその製造コストも低
廉なものとすることができる。
Moreover, since the dielectric 417 used for the electric capacitors 419 and 421 uses the film used for the gate insulating film 423 of the TFT 405, it is not necessary to specially form it from a material other than the material forming the TFT 405. Therefore, it is possible to avoid complication of the manufacturing process due to the provision of the electric capacitors 419 and 421, and it is possible to reduce the manufacturing cost.

【0052】さらに、第1の電気容量419と第2の電
気容量421の容量値は、その各々が有する誘電体41
7の面積を異なるようにすることで異なった値に設定さ
れており、誘電体417にコンタクトホール425を穿
設し、このコンタクトホール425を通って延伸された
ソース電極427と容量用電極415とが接続されてい
る。
Furthermore, the capacitance values of the first electric capacitance 419 and the second electric capacitance 421 are the dielectrics 41 of each of them.
7 are set to different values by making the areas thereof different, and a contact hole 425 is formed in the dielectric 417, and a source electrode 427 and a capacitor electrode 415 extended through the contact hole 425. Are connected.

【0053】従って、誘電体417を形成するに際して
は、ゲート絶縁膜423と同じ膜を用いて、この膜をフ
ォトエッチングなどを用いてパターンニングするときに
第1の電気容量419と第2の電気容量421とで異な
った面積となるようにマスクパターンを変更するだけ
で、第1の電気容量419および第2の電気容量421
の容量値を異なったものとすることができる。
Therefore, when forming the dielectric 417, the same film as the gate insulating film 423 is used, and when this film is patterned by photoetching or the like, the first capacitance 419 and the second capacitance 419 are formed. Only by changing the mask pattern so that the area of the capacitor 421 is different from that of the capacitor 421, the first capacitor 419 and the second capacitor 421 can be formed.
Can have different capacitance values.

【0054】これにより、従来のような誘電体417の
層厚を調節して容量値を制御する、あるいは誘電体41
7の材質を変えて第1の電気容量419と第2の電気容
量421の容量値を異なったものとする、といった煩雑
な工程の付加を避けることができる。
Thus, the capacitance value is controlled by adjusting the layer thickness of the dielectric 417 as in the conventional case, or the dielectric 41 is controlled.
It is possible to avoid adding a complicated process such as changing the material of No. 7 and making the capacitance values of the first electric capacitance 419 and the second electric capacitance 421 different.

【0055】なお、このTFT405のゲート絶縁膜4
23の材質および膜厚は、一般的なTFTに用いられる
膜の仕様を踏襲しているが、このような仕様のゲート絶
縁膜423は誘電体417として好適な誘電率を有して
いる。
The gate insulating film 4 of the TFT 405
The material and the film thickness of 23 follow the specifications of a film used for a general TFT, but the gate insulating film 423 having such a specification has a dielectric constant suitable as the dielectric 417.

【0056】また、このゲート絶縁膜423は、TFT
405のゲート絶縁膜423としても誘電体417とし
てもさらに好適な膜厚および材質に変更することもでき
ることは言うまでもない。
The gate insulating film 423 is a TFT
It goes without saying that the gate insulating film 423 and the dielectric 417 of 405 can be changed to further suitable film thicknesses and materials.

【0057】[0057]

【発明の効果】以上、詳細な説明により明示したよう
に、本発明によれば、簡易な製造工程により形成でき、
かつTFTの動作特性及び信頼性の低下を避けることが
でき材料コストも低廉な誘電体膜を用いた制御容量を具
備して、良好な視野角特性を実現するアクティブマトリ
ックス型液晶表示素子を提供することができる。
As described above in detail, according to the present invention, it is possible to form by a simple manufacturing process,
Provided is an active matrix type liquid crystal display device which realizes a good viewing angle characteristic by providing a control capacitor using a dielectric film which can avoid deterioration of the operating characteristics and reliability of the TFT and has a low material cost. be able to.

【図面の簡単な説明】[Brief description of drawings]

【図1】第1の発明のアクティブマトリックス型液晶表
示素子の構成を示す等価回路図。
FIG. 1 is an equivalent circuit diagram showing a configuration of an active matrix type liquid crystal display element of a first invention.

【図2】第1の発明のアクティブマトリックス型液晶表
示素子の一画素部分の構成を示す平面図。
FIG. 2 is a plan view showing the configuration of one pixel portion of the active matrix liquid crystal display element of the first invention.

【図3】第1の発明のアクティブマトリックス型液晶表
示素子の一画素部分の層構造を示す断面図。第4図に示
した実施例における一画素部分の断面図。
FIG. 3 is a cross-sectional view showing the layer structure of one pixel portion of the active matrix liquid crystal display element of the first invention. Sectional drawing of one pixel part in the Example shown in FIG.

【図4】第2の発明のアクティブマトリックス型液晶表
示素子の構成を示す等価回路図。
FIG. 4 is an equivalent circuit diagram showing a configuration of an active matrix type liquid crystal display element of a second invention.

【図5】第2の発明のアクティブマトリックス型液晶表
示素子の一画素部分の構成を示す平面図。
FIG. 5 is a plan view showing the configuration of one pixel portion of an active matrix type liquid crystal display element of the second invention.

【図6】第2の発明のアクティブマトリックス型液晶表
示素子の一画素部分の層構造を示す断面図。
FIG. 6 is a cross-sectional view showing the layer structure of one pixel portion of an active matrix type liquid crystal display element of the second invention.

【図7】従来のアクティブマトリックス型液晶表示素子
の構成を示す等価回路図。
FIG. 7 is an equivalent circuit diagram showing a configuration of a conventional active matrix type liquid crystal display element.

【図8】従来のアクティブマトリクス型液晶表示素子の
一画素部分の構成を示す平面図。
FIG. 8 is a plan view showing the configuration of one pixel portion of a conventional active matrix liquid crystal display element.

【図9】従来のアクティブマトリクス型液晶表示素子の
一画素部分の層構造を示す断面図。
FIG. 9 is a cross-sectional view showing a layer structure of one pixel portion of a conventional active matrix type liquid crystal display element.

【符号の説明】[Explanation of symbols]

1…第1の副画素電極、3…第2の副画素電極、5…T
FT、7…液晶層、9…対向電極、11…第1の副画
素、13…第2の副画素、15…容量用電極、17…誘
電体、19…電気容量、21…ガラス基板、23…走査
線、25…ゲート電極、27…ゲート絶縁膜、29…半
導体層、31、32…オーミック層、33…信号線、3
5…ドレイン電極、37…ソース電極、39…保護膜、
41…配向膜、57…コンタクトホール
1 ... 1st subpixel electrode, 3 ... 2nd subpixel electrode, 5 ... T
FT, 7 ... Liquid crystal layer, 9 ... Counter electrode, 11 ... First subpixel, 13 ... Second subpixel, 15 ... Capacitance electrode, 17 ... Dielectric material, 19 ... Electric capacitance, 21 ... Glass substrate, 23 ... Scan line, 25 ... Gate electrode, 27 ... Gate insulating film, 29 ... Semiconductor layer, 31, 32 ... Ohmic layer, 33 ... Signal line, 3
5 ... Drain electrode, 37 ... Source electrode, 39 ... Protective film,
41 ... Alignment film, 57 ... Contact hole

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】 列設された走査線とこれにマトリックス
状に交差するように列設された信号線と前記走査線およ
び前記信号線に接続された薄膜トランジスタ素子とこれ
に接続された画素電極とこれに対向する対向電極と前記
画素電極および前記対向電極の間に挟持された液晶層と
を有する液晶表示素子において、 前記薄膜トランジスタ素子に接続された第1の副画素電
極と、前記第1の副画素電極との平面的な接触および重
複を避けて前記第1の副画素電極と隣り合うように配設
され前記薄膜トランジスタ素子のゲート絶縁膜と同一の
材質からなる誘電体と容量用電極とで電気容量を形成し
該電気容量を介して前記薄膜トランジスタ素子に接続さ
れた第2の副画素電極とに 2分割された画素電極を具備
することを特徴とするアクティブマトリクス型液晶表示
素子。
1. A scanning line arranged in a row, a signal line arranged so as to intersect the scanning line in a matrix, a thin film transistor element connected to the scanning line and the signal line, and a pixel electrode connected to the thin film transistor element. In a liquid crystal display element having a counter electrode facing the pixel electrode and a liquid crystal layer sandwiched between the pixel electrode and the counter electrode, a first subpixel electrode connected to the thin film transistor element and a first subpixel electrode connected to the thin film transistor element. Electricity is provided by a dielectric and a capacitor electrode which are arranged adjacent to the first subpixel electrode while avoiding planar contact and overlap with the pixel electrode and made of the same material as the gate insulating film of the thin film transistor element. An active matrix comprising: a pixel electrode which is divided into two and a second subpixel electrode which forms a capacitance and is connected to the thin film transistor element through the electric capacitance. Liquid crystal display element.
【請求項2】 列設された走査線とこれにマトリックス
状に交差するように列設された信号線と前記走査線およ
び前記信号線に接続された薄膜トランジスタ素子とこれ
に接続された画素電極とこれに対向する対向電極と前記
画素電極および前記対向電極の間に挟持された液晶層と
を有する液晶表示素子において、 前記薄膜トランジスタ素子のゲート絶縁膜と同一の材質
からなる誘電体と容量用電極とで第1の電気容量を形成
し該電気容量を介して前記薄膜トランジスタ素子に接続
された第1の副画素電極と、前記第1の副画素電極との
平面的な接触および重複を避けて前記第1の副画素電極
と隣り合うように配設され前記薄膜トランジスタ素子の
ゲート絶縁膜と同一の材質からなる誘電体と容量用電極
とで前記第1の電気容量とは異なった容量値の第2の電
気容量を形成し該電気容量を介して前記薄膜トランジス
タ素子に接続された第2の副画素電極とに 2分割された
画素電極を具備することを特徴とするアクティブマトリ
クス型液晶表示素子。
2. A scanning line arranged in a row, a signal line arranged so as to intersect with the scanning line in a matrix, a thin film transistor element connected to the scanning line and the signal line, and a pixel electrode connected to the thin film transistor element. In a liquid crystal display device having a counter electrode facing this and a liquid crystal layer sandwiched between the pixel electrode and the counter electrode, a dielectric and a capacitor electrode made of the same material as the gate insulating film of the thin film transistor element, To form a first capacitance and to avoid planar contact and overlap between the first subpixel electrode connected to the thin film transistor element via the capacitance and the first subpixel electrode, and avoiding the first capacitance. A dielectric and a capacitor electrode, which are arranged adjacent to one subpixel electrode and are made of the same material as the gate insulating film of the thin film transistor element, have a capacitance different from the first capacitance. An active matrix type liquid crystal display comprising: a second sub-pixel electrode connected to the thin film transistor element through the second electric capacitance having a value and a pixel electrode divided into two. element.
【請求項3】 絶縁性基板上に前記容量用電極が形成さ
れ、該容量用電極上に前記誘電体の層が形成され、該誘
電体層上に前記第1の副画素電極および前記第2の副画
素電極が形成され、前記誘電体層の一部にコンタクトホ
ールが穿設され、該コンタクトホールを通して前記容量
用電極と前記薄膜トランジスタ素子とが接続されている
ことを特徴とする請求項1又は請求項2記載のアクティ
ブマトリクス型液晶表示素子。
3. The capacitor electrode is formed on an insulating substrate, the dielectric layer is formed on the capacitor electrode, and the first subpixel electrode and the second layer are formed on the dielectric layer. 2. The subpixel electrode is formed, a contact hole is formed in a part of the dielectric layer, and the capacitor electrode and the thin film transistor element are connected through the contact hole. The active matrix liquid crystal display element according to claim 2.
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