JPH0593921A - Active matrix type liquid crystal display element - Google Patents
Active matrix type liquid crystal display elementInfo
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- JPH0593921A JPH0593921A JP25660191A JP25660191A JPH0593921A JP H0593921 A JPH0593921 A JP H0593921A JP 25660191 A JP25660191 A JP 25660191A JP 25660191 A JP25660191 A JP 25660191A JP H0593921 A JPH0593921 A JP H0593921A
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Abstract
Description
【0001】[0001]
【産業上の利用分野】本発明は、薄膜トランジスタ(Th
in Film Transistor,TFT)をスイッチ素子として、
表示画素電極アレイを構成したアクティブマトリクス型
液晶表示素子に関する。The present invention relates to a thin film transistor (Th
in Film Transistor, TFT) as a switching element,
The present invention relates to an active matrix type liquid crystal display element which constitutes a display pixel electrode array.
【0002】[0002]
【従来の技術】近年、液晶を用いた表示素子として、テ
レビ表示やグラフィックディスプレイ等を指向した大容
量で高密度のアクティブマトリクス型液晶表示素子の開
発や実用化が盛んに行われている。このような表示素子
では、クロストークのない高コントラストの表示が行え
るように、各画素の駆動制御手段として半導体スイッチ
が用いられている。2. Description of the Related Art In recent years, as a display element using a liquid crystal, a large-capacity and high-density active matrix type liquid crystal display element directed to a television display or a graphic display has been actively developed and put into practical use. In such a display element, a semiconductor switch is used as a drive control unit of each pixel so that high-contrast display without crosstalk can be performed.
【0003】この半導体スイッチとしては、透過型の表
示が可能であり、大面積化も容易である等の理由から、
薄膜トランジスタが用いられ、絶縁基板上に形成され
る。As this semiconductor switch, a transmissive display is possible, and it is easy to increase the area.
A thin film transistor is used and is formed on an insulating substrate.
【0004】図3は、上述のような液晶表示素子の一例
として、特開昭56−162793号公報に示されてい
る概略断面構造を示している。図3において、11,12は
ガラス等による透明な絶縁基板で、一方の絶縁基板11の
一主面上には、薄膜トランジスタ13と透明電極膜による
表示画素電極14とが、複数個マトリクス状に配置構成さ
れている。また、他方の絶縁基板12の一主面上には、透
明導電膜による対向電極15が全面に形成されている。こ
れら両絶縁基板11,12は、両絶縁基板11,12の各一主面
が互いに対向するように間隙を保って配置される。そし
て、この間隙の周囲は封着剤16により封止され、内部に
は液晶17が封入されている。FIG. 3 shows a schematic sectional structure disclosed in Japanese Patent Application Laid-Open No. 56-162793 as an example of the above-mentioned liquid crystal display element. In FIG. 3, reference numerals 11 and 12 denote transparent insulating substrates made of glass or the like, and a plurality of thin film transistors 13 and display pixel electrodes 14 made of a transparent electrode film are arranged in a matrix on one main surface of one insulating substrate 11. It is configured. A counter electrode 15 made of a transparent conductive film is formed on the entire main surface of the other insulating substrate 12. The two insulating substrates 11 and 12 are arranged with a gap so that the main surfaces of the insulating substrates 11 and 12 face each other. The periphery of this gap is sealed with a sealing agent 16, and a liquid crystal 17 is sealed inside.
【0005】次に、図4によって薄膜トランジスタを備
えた表示画素電極アレイの一画素分の電気回路を説明す
る。図4において、21は信号線、22は走査線で、これら
信号線21および走査線22は絶縁基板11の一主面上にそれ
ぞれ複数本ずつ交差状態で、かつ、相互に絶縁された状
態で配設されている。これら信号線21および走査線22の
各交点位置にはそれぞれ薄膜トランジスタ13が設けられ
ている。各薄膜トランジスタ13のゲートは行ごとに走査
線22に接続され、また、ドレインは列ごとに信号線21に
接続されている。さらに、ソースは表示画素電極14に接
続されている。この表示画素電極14は、前述のように液
晶17を介して対向電極15と対向しており、さらに対向電
極15は直流電源24の正極側と接続している。Next, an electric circuit for one pixel of a display pixel electrode array including a thin film transistor will be described with reference to FIG. In FIG. 4, 21 is a signal line, 22 is a scanning line, and a plurality of these signal lines 21 and scanning lines 22 are crossed on one main surface of the insulating substrate 11 and are insulated from each other. It is arranged. A thin film transistor 13 is provided at each intersection of the signal line 21 and the scanning line 22. The gate of each thin film transistor 13 is connected to the scanning line 22 in each row, and the drain is connected to the signal line 21 in each column. Further, the source is connected to the display pixel electrode 14. The display pixel electrode 14 faces the counter electrode 15 via the liquid crystal 17 as described above, and the counter electrode 15 is connected to the positive electrode side of the DC power supply 24.
【0006】次に、回路構成による一画素分の駆動方法
を説明する。Next, a method of driving one pixel by the circuit configuration will be described.
【0007】薄膜トランジスタ13のゲートに走査線22か
ら走査線選択電圧が印加されている期間、すなわちスイ
ッチング期間に、信号線21からドレインに映像信号が加
わると、ソースに接続されている表示画素電極14の電位
は映像信号電位と同電位に設定される。また、ゲートに
走査線非選択電圧が印加されている期間は、表示画素電
極14はこの電位を保持する。これらの結果、表示画素電
極14に対して所定の電位に設定されている対向電極15と
の間に挟持された液晶17には、映像信号電圧に応じた電
位差がかかる。そして、この電位差に応じて液晶17の配
列状態が変化することにより、この電位差の生じた液晶
の部分の光透過率が変化し、画像表示が行われる。When a video signal is applied from the signal line 21 to the drain during a period in which the scanning line selection voltage is applied to the gate of the thin film transistor 13 from the scanning line 22, that is, a switching period, the display pixel electrode 14 connected to the source is connected. Is set to the same potential as the video signal potential. Further, the display pixel electrode 14 holds this potential while the scanning line non-selection voltage is applied to the gate. As a result, a potential difference according to the video signal voltage is applied to the liquid crystal 17 sandwiched between the display pixel electrode 14 and the counter electrode 15 set to a predetermined potential. Then, the arrangement state of the liquid crystal 17 changes in accordance with the potential difference, so that the light transmittance of the portion of the liquid crystal in which the potential difference occurs changes, and an image is displayed.
【0008】ここで、液晶17を直流駆動すると、液晶は
分子の電気分解により劣化し、寿命が短くなるため交流
駆動が行なわれる。一般的には、対向電極15の電位を直
流電位に設定し、この対向電極電位に対して映像信号電
圧を偶奇フレームで正負対称に設定することにより、交
流駆動を行う。つまり、映像信号電圧は、所定の直流電
圧と映像信号に対応した正負対称な交流電圧とが加算さ
れたものである。Here, when the liquid crystal 17 is driven by direct current, the liquid crystal is deteriorated by the electrolysis of molecules and the life is shortened, so that the liquid crystal is driven by alternating current. Generally, AC drive is performed by setting the potential of the counter electrode 15 to a DC potential and setting the video signal voltage symmetrically with respect to this counter electrode potential in even and odd frames. That is, the video signal voltage is a sum of a predetermined DC voltage and a positive / negative symmetrical AC voltage corresponding to the video signal.
【0009】図5および図6は薄膜トランジスタを備え
た表示画素電極アレイの一画素分の断面図で、図5は薄
膜トランジスタ13部分、図6は信号線21の部分である。5 and 6 are cross-sectional views of one pixel of a display pixel electrode array provided with a thin film transistor. FIG. 5 shows a thin film transistor 13 portion and FIG. 6 shows a signal line 21 portion.
【0010】始めに薄膜トランジスタ13部分を図5によ
り説明する。図5において、13G はゲート電極で、この
ゲート電極13G はアレイ基板27となる一方の絶縁基板11
上に形成され、図示しない走査線と導電接続している。
このゲート電極13G の表面およびこれを含む絶縁基板11
の表面はゲート絶縁膜28により覆われている。このゲー
ト絶縁膜28を介してゲート電極13G の上面と対向する部
分には、半導体層29が形成され、さらに、この半導体層
29の上部中央には絶縁体層30が形成されている。First, the thin film transistor 13 portion will be described with reference to FIG. In FIG. 5, reference numeral 13G is a gate electrode, and this gate electrode 13G is one of the insulating substrates 11 to be the array substrate 27.
It is formed above and electrically connected to a scan line (not shown).
Surface of this gate electrode 13G and insulating substrate 11 including it
The surface of is covered with a gate insulating film 28. A semiconductor layer 29 is formed in a portion facing the upper surface of the gate electrode 13G with the gate insulating film 28 interposed therebetween.
An insulator layer 30 is formed in the center of the upper portion of 29.
【0011】また、13S はソース電極で、このソース電
極13S は半導体層29および絶縁体層30の図示左半分上に
オーミック層31a を介して形成する。13D はドレイン電
極で、このドレイン電極13D は、半導体層29および絶縁
体層30の図示右半分上にオーミック層31b を介して形成
される。そして、表示画素電極14は、ドレイン電極13D
の一端に重なるようにして導電接続され、かつ、ゲート
絶縁膜28上に形成されている。そして、これら全体は配
向膜32により覆われている。Further, 13S is a source electrode, and this source electrode 13S is formed on the left half of the semiconductor layer 29 and the insulator layer 30 in the figure with an ohmic layer 31a interposed therebetween. 13D is a drain electrode, and this drain electrode 13D is formed on the right half of the semiconductor layer 29 and the insulator layer 30 in the drawing with an ohmic layer 31b interposed therebetween. The display pixel electrode 14 is the drain electrode 13D.
Is formed on the gate insulating film 28 so as to be conductively connected so as to overlap one end of the. The whole of these is covered with the alignment film 32.
【0012】アレイ基板27に対する対向基板34は、前述
のように絶縁基板12の一主面の全体に渡って対向電極15
が形成されており、さらに、対向基板34の上面には配向
膜35が全面に渡って形成されている。そして、これらア
レイ基板27と対向基板34との間隙には、液晶17が挟持さ
れている。The counter substrate 34 for the array substrate 27 is, as described above, the counter electrode 15 over the entire one main surface of the insulating substrate 12.
Further, an alignment film 35 is formed on the entire upper surface of the counter substrate 34. The liquid crystal 17 is held in the gap between the array substrate 27 and the counter substrate 34.
【0013】次に、信号線21部分を図6により説明す
る。絶縁基板11上には、前述のようにゲート絶縁膜28が
形成されており、信号線21は、各画素ごとの表示画素電
極14を避けた位置に形成されている。そして、この信号
線21も前述のように配向膜32により覆われている。Next, the signal line 21 portion will be described with reference to FIG. As described above, the gate insulating film 28 is formed on the insulating substrate 11, and the signal line 21 is formed at a position avoiding the display pixel electrode 14 of each pixel. The signal line 21 is also covered with the alignment film 32 as described above.
【0014】ところで、このような構成の液晶表示素子
では、図示のように、薄膜トランジスタ13のドレイン電
極13D 、ソース電極13S および信号線21が、表示画素電
極14に対して凸形状である。液晶表示素子の製造工程に
は、配向膜32全体をローラにより液晶配向処理する工
程、いわゆるラビング工程がある。この場合、前述のよ
うにドレイン電極13D 、ソース電極13S および信号線21
は、表示画素電極14に対して凸形状であるため、これら
の部分の配向膜32は、表示画素電極14部分の配向膜32よ
り強くこすられる。このため、これらドレイン電極13D
、ソース電極13Sおよび信号線21部分の配向膜32はラビ
ング時にはがれが生じ易く、はがれが生じた場合は、配
向膜32の厚さが数μm程度であっても、これらの電極お
よび配線部分は直接液晶17と接触することとなる。By the way, in the liquid crystal display device having such a structure, as shown in the drawing, the drain electrode 13D, the source electrode 13S and the signal line 21 of the thin film transistor 13 are convex with respect to the display pixel electrode 14. In the manufacturing process of the liquid crystal display element, there is a so-called rubbing process in which the entire alignment film 32 is subjected to liquid crystal alignment processing by a roller. In this case, as described above, the drain electrode 13D, the source electrode 13S and the signal line 21
Has a convex shape with respect to the display pixel electrode 14, the alignment film 32 in these portions is rubbed more strongly than the alignment film 32 in the display pixel electrode 14 portion. Therefore, these drain electrodes 13D
, The source electrode 13S and the alignment film 32 in the signal line 21 portion are liable to peel off during rubbing, and if peeling occurs, even if the thickness of the alignment film 32 is about several μm, these electrodes and wiring portions Will be in direct contact with the liquid crystal 17.
【0015】ここで、信号線21の材料にはアルミニウム
等の化学的に活性な低抵抗金属が用いられることが多い
が、これらの金属が液晶17と直接に接触すると金属成分
が液晶17中に混入し、この付近の液晶の比抵抗が下がっ
てしまう。このため、走査線22に走査線非選択電圧が印
加されている期間において、表示画素電極14が保持する
べき電荷が液晶17を介してリークするので、コントラス
トの低下や階調表示能力の低下等、画質不良を生じる。Here, a chemically active low resistance metal such as aluminum is often used as the material of the signal line 21, but when these metals come into direct contact with the liquid crystal 17, a metal component is contained in the liquid crystal 17. When mixed, the specific resistance of the liquid crystal in the vicinity decreases. Therefore, during the period when the scanning line non-selection voltage is applied to the scanning line 22, the charge to be held by the display pixel electrode 14 leaks through the liquid crystal 17, so that the contrast is lowered and the gradation display capability is lowered. , Causing poor image quality.
【0016】[0016]
【発明が解決しようとする課題】このように、半導体ス
イッチとして薄膜トランジスタ13を用いたアクティブマ
トリクス型液晶表示素子では、ラビング時に電極や配線
部分の配向膜にはがれが生じやすく、このはがれにより
画質不良が発生する問題が生じる。As described above, in the active matrix type liquid crystal display element using the thin film transistor 13 as the semiconductor switch, the alignment film of the electrodes and the wiring portion is liable to peel off during rubbing, and this peeling may cause a defective image quality. The problem arises.
【0017】本発明の目的は、ラビングにより配向膜の
一部にはがれが生じても、その付近に比抵抗の低下が生
じることがなく、比抵抗の低下に起因する画質不良が生
じることのないアクティブマトリクス型液晶表示素子を
提供することにある。The object of the present invention is that even if a part of the alignment film is peeled off by rubbing, the specific resistance is not lowered in the vicinity thereof, and the image quality is not deteriorated due to the decrease in the specific resistance. An object is to provide an active matrix type liquid crystal display device.
【0018】[0018]
【課題を解決するための手段】本発明によるアクティブ
マトリクス型液晶表示素子は、絶縁基板の一主面上に複
数本の走査線および信号線を互いに交差させ、これらの
各交点近くに薄膜トランジスタおよびこれに接続される
表示画素電極からなる一画素を配置しかつこの一画素を
前記走査線および信号線に接続してなるアレイ基板と、
他の絶縁基板の一主面に対向電極を配置してなる対向基
板と、前記アレイ基板と対向基板とをそれらの一主面側
が互いに対向するように組み合わせて得られる間隙に挟
持された液晶とを備えたもので、前記各信号線および前
記薄膜トランジスタの前記液晶側の電極面を、前記表示
画素電極と同じ材料により覆ったものである。In the active matrix type liquid crystal display device according to the present invention, a plurality of scanning lines and signal lines are intersected with each other on one main surface of an insulating substrate, and a thin film transistor and a thin film transistor are provided near each intersection. An array substrate formed by arranging one pixel composed of a display pixel electrode connected to and connecting the one pixel to the scanning line and the signal line,
A counter substrate in which a counter electrode is disposed on one main surface of another insulating substrate; and a liquid crystal sandwiched in a gap obtained by combining the array substrate and the counter substrate so that their one main surface sides face each other. The signal lines and the electrode surfaces of the thin film transistors on the liquid crystal side are covered with the same material as the display pixel electrodes.
【0019】[0019]
【作用】本発明では、ラビングにより配向膜の一部には
がれが生じても、信号線や電極面が液晶に直接触れるこ
とはなく、それらの液晶側の面に形成された表示画素電
極と同じ材料が液晶と接することとなる。ここで、一般
に表示画素電極の材料にはITO(Indium Tin Oxide)
が用いられている。このITOは酸化物であり、化学的
には非常に安定であり、液晶と直接接触してもITO成
分が液晶中に混入することはなく、したがって、配向膜
のはがれが生じた付近の比抵抗が低下することもなく、
この比抵抗の低下を原因とする画質低下が生じることも
ない。In the present invention, even if a part of the alignment film is peeled off by rubbing, the signal lines and electrode surfaces do not come into direct contact with the liquid crystal, and are the same as the display pixel electrodes formed on the liquid crystal side surface. The material comes into contact with the liquid crystal. In general, the material of the display pixel electrode is ITO (Indium Tin Oxide).
Is used. Since this ITO is an oxide and is chemically very stable, the ITO component does not mix into the liquid crystal even when it comes into direct contact with the liquid crystal, and therefore the specific resistance in the vicinity where the peeling of the alignment film occurs. Does not decrease,
Image quality deterioration due to the decrease in the specific resistance does not occur.
【0020】[0020]
【実施例】以下、本発明の一実施例を図面を参照して説
明する。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of the present invention will be described below with reference to the drawings.
【0021】図1および図2は薄膜トランジスタを備え
た表示画素電極アレイの一画素分の断面図で、図1は薄
膜トランジスタ13部分、図2は信号線21の部分である。
なお、これらの構成は、図5および図6で示した従来の
構成と共通する部分が多いので、共通部分には、同一符
号を付して説明を行う。1 and 2 are cross-sectional views of one pixel of a display pixel electrode array provided with a thin film transistor. FIG. 1 shows a thin film transistor 13 portion and FIG. 2 shows a signal line 21 portion.
Since these configurations have many parts in common with the conventional configuration shown in FIGS. 5 and 6, common parts will be described with the same reference numerals.
【0022】先ず、薄膜トランジスタ13部分を図1によ
り説明する。First, the thin film transistor 13 portion will be described with reference to FIG.
【0023】ゲート電極13G は、アレイ基板27となる一
方の絶縁基板11上に形成され、図示しない走査線と導電
接続している。このゲート電極13G の表面およびゲート
電極13G を含む絶縁基板11の表面はゲート絶縁膜28によ
り覆われている。このゲート絶縁膜28を介してゲート電
極13G の上面と対向する部分には、半導体層29が形成さ
れ、さらにこの半導体層29の上部中央には絶縁体層30が
形成されている。The gate electrode 13G is formed on one insulating substrate 11 which will be the array substrate 27, and is electrically connected to a scanning line (not shown). The surface of the gate electrode 13G and the surface of the insulating substrate 11 including the gate electrode 13G are covered with a gate insulating film 28. A semiconductor layer 29 is formed in a portion facing the upper surface of the gate electrode 13G via the gate insulating film 28, and an insulator layer 30 is formed in the upper center of the semiconductor layer 29.
【0024】また、ソース電極13S は、半導体層29およ
び絶縁体層30上の一部にオーミック層31a を介して形成
され、ドレイン電極13D は、上記半導体層29および絶縁
体層30上の他の一部に、オーミック層31b を介して形成
される。表示画素電極14は、ドレイン電極13D の一端に
重なるようにして導電接続され、かつ、ゲート絶縁膜28
上に形成されている。The source electrode 13S is formed on a part of the semiconductor layer 29 and the insulator layer 30 via the ohmic layer 31a, and the drain electrode 13D is formed on the semiconductor layer 29 and the insulator layer 30. It is partially formed via the ohmic layer 31b. The display pixel electrode 14 is conductively connected so as to overlap with one end of the drain electrode 13D, and has a gate insulating film 28.
Formed on.
【0025】さらに、ソース電極13S およびドレイン電
極13D の表面側、すなわち、対向基板34との間に挟持さ
れる液晶17側の面は、表示画素電極14と同一の材料、例
えばITO(Indium Tin Oxide)によって覆われる。さ
らに、これら全体は配向膜32により覆われる。Furthermore, the surface of the source electrode 13S and the drain electrode 13D, that is, the surface on the liquid crystal 17 side sandwiched between the counter electrode 34 and the counter electrode 34, is made of the same material as that of the display pixel electrode 14, for example, ITO (Indium Tin Oxide). ) Is covered by. Further, the whole of them is covered with the alignment film 32.
【0026】また、アレイ基板27および対向基板34の絶
縁基板11,12の両外側には、偏向板36,37が形成されて
いる。Deflection plates 36 and 37 are formed on both outer sides of the insulating substrates 11 and 12 of the array substrate 27 and the counter substrate 34.
【0027】なお、アレイ基板27に対する対向基板34
は、図5および図6で示したものと同じであり、絶縁基
板12の一主面の全体に渡って対向電極15が形成されてお
り、さらに絶縁基板12の上面には配向膜35が全面に渡っ
て形成されている。The counter substrate 34 with respect to the array substrate 27
5 is the same as that shown in FIG. 5 and FIG. 6, the counter electrode 15 is formed over the entire one main surface of the insulating substrate 12, and the alignment film 35 is entirely formed on the upper surface of the insulating substrate 12. It is formed across.
【0028】信号線21は、図2で示すように、絶縁基板
11上のゲート絶縁膜28上に、各画素ごとの表示画素電極
14を避けた状態で形成されている。そして、この信号線
21も、表示画素電極14と同一の材料、例えばITOによ
って覆われたのち、前述したように配向膜32により覆わ
れている。The signal line 21 is an insulating substrate as shown in FIG.
Display pixel electrode for each pixel on the gate insulating film 28 on
It is formed in a state of avoiding 14. And this signal line
21 is also covered with the same material as the display pixel electrode 14, for example, ITO, and then covered with the alignment film 32 as described above.
【0029】上記構成において、薄膜トランジスタ13の
ドレイン電極13D 、ソース電極13Sおよび信号線21に
は、一般に同一材料が用いられており、また、従来と同
じく、表示画素電極14に対して凸形状である。このた
め、ラビング時に、これらドレイン電極13D 、ソース電
極13S および信号線21部分の配向膜32は、表示画素電極
14部分の配向膜より強くこすられ、これらの部分の配向
膜にはがれが生じることがある。In the above structure, the drain electrode 13D, the source electrode 13S and the signal line 21 of the thin film transistor 13 are generally made of the same material and, like the conventional one, have a convex shape with respect to the display pixel electrode 14. .. Therefore, during rubbing, the drain electrode 13D, the source electrode 13S, and the alignment film 32 in the signal line 21 are
It may be rubbed more strongly than the alignment film in the 14th part, and peeling may occur in the alignment film in these parts.
【0030】ここで、配向膜32の一部、例えば信号線21
部分の配向膜にはがれが生じた場合、信号線21は前述の
ように液晶17に対して、信号線材料である例えばアルミ
ニウムと表示画素電極14と同じ材料であるITOとの二
層構造であるため、アルミニウムが液晶と直接接触する
ことはない。したがって、従来のようにアルミニウム等
の金属成分が液晶17中に混入し、この付近の液晶の比抵
抗が下がり、コントラストの低下や階調表示能力の低下
等の画質不良を生じることもない。Here, a part of the alignment film 32, for example, the signal line 21.
When peeling occurs in a part of the alignment film, the signal line 21 has a two-layer structure with respect to the liquid crystal 17, as described above, of a signal line material such as aluminum and ITO which is the same material as the display pixel electrode 14. Therefore, aluminum does not come into direct contact with the liquid crystal. Therefore, unlike the conventional case, a metal component such as aluminum is mixed into the liquid crystal 17, the specific resistance of the liquid crystal in the vicinity thereof is lowered, and the image quality failure such as the reduction of the contrast and the gray scale display ability is not caused.
【0031】また、信号線21は前述のように、アルミニ
ウムとITOとの二層構造であるため、アルミニウムに
よる配線部分に断線が生じても、この断線部分にはIT
O配線が存在するため断線にはならず、信号線の断線に
起因する歩留まりの低下を抑えることができ、液晶表示
素子自体の信頼性も向上する。さらに、製造工程自体は
従来と変わりないので、歩留まり低下の新たな要因とな
る製造工程の複雑化を伴うことがなく、前述の効果を期
待することができる。Further, since the signal line 21 has a two-layer structure of aluminum and ITO as described above, even if a disconnection occurs in the wiring part made of aluminum, the disconnection part is not affected by the IT.
The presence of the O wiring does not cause the disconnection, and it is possible to suppress a decrease in yield due to the disconnection of the signal line and improve the reliability of the liquid crystal display element itself. Furthermore, since the manufacturing process itself is the same as the conventional one, the above-mentioned effects can be expected without causing the manufacturing process to be complicated, which is a new factor of decreasing the yield.
【0032】本実施例によれば、信号線をアルミニウム
とITOとの二層構造としたが、ITOに代えてSnO
2 (酸化錫)、In2 O3 (酸化インジウム)を用いる
こともできる。According to the present embodiment, the signal line has a two-layer structure of aluminum and ITO, but SnO is used instead of ITO.
2 (tin oxide) and In 2 O 3 (indium oxide) can also be used.
【0033】[0033]
【発明の効果】以上のように本発明によれば、信号線お
よびこの信号線と同一の材料からなる電極の液晶側の面
を、表示画素電極と同一の材料で覆ったので、配向膜に
部分的なはがれが生じても、従来のように、信号線材料
が液晶と直接接触し、金属成分が液晶に混入してその付
近の比抵抗を低下させ、コントラストや階調表示能力低
下のような、画質不良を生じさせることはなく、良好な
画質を常に維持することができる。As described above, according to the present invention, the liquid crystal side surface of the signal line and the electrode made of the same material as the signal line is covered with the same material as the display pixel electrode. Even if partial peeling occurs, the signal line material is in direct contact with the liquid crystal as in the past, and the metal component mixes in the liquid crystal to lower the specific resistance in the vicinity, resulting in a decrease in contrast and gradation display capability. Good image quality can always be maintained without causing image quality failure.
【図1】本発明のアクティブマトリクス型液晶表示素子
の一実施例を示す薄膜トランジスタ部分を示す断面図で
ある。FIG. 1 is a cross-sectional view showing a thin film transistor portion showing an embodiment of an active matrix type liquid crystal display element of the present invention.
【図2】同上信号線の部分を示す断面図である。FIG. 2 is a sectional view showing a signal line portion of the above.
【図3】従来の一般的なアクティブマトリクス型液晶表
示素子の内部構造を示す断面図である。FIG. 3 is a cross-sectional view showing an internal structure of a conventional general active matrix type liquid crystal display device.
【図4】図3で示したアクティブマトリクス型液晶表示
素子における表示画素電極アレイの一画素分の電気回路
を示す等価回路図である。4 is an equivalent circuit diagram showing an electric circuit for one pixel of a display pixel electrode array in the active matrix type liquid crystal display element shown in FIG.
【図5】従来のアクティブマトリクス型液晶表示素子の
薄膜トランジスタ部分を示す断面図である。FIG. 5 is a cross-sectional view showing a thin film transistor portion of a conventional active matrix type liquid crystal display element.
【図6】同上信号線の部分を示す断面図である。FIG. 6 is a cross-sectional view showing a signal line portion of the above.
11,12 絶縁基板 13 薄膜トランジスタ 14 表示画素電極 15 対向電極 17 液晶 21 信号線 27 アレイ基板 34 対向基板 11, 12 Insulating substrate 13 Thin film transistor 14 Display pixel electrode 15 Counter electrode 17 Liquid crystal 21 Signal line 27 Array substrate 34 Counter substrate
Claims (1)
よび信号線を互いに交差させ、これらの各交点近くに薄
膜トランジスタおよびこれに接続される表示画素電極か
らなる一画素を配置し、かつ、この一画素を前記走査線
および信号線に接続してなるアレイ基板と、他の絶縁基
板の一主面に対向電極を配置してなる対向基板と、前記
アレイ基板と対向基板とをそれらの一主面側が互いに対
向するように組み合わせて得られる間隙に挟持された液
晶とを備えたアクティブマトリクス型液晶表示素子にお
いて、 前記各信号線および前記薄膜トランジスタの前記液晶層
側の電極面を、前記表示画素電極と同じ材料により覆っ
たことを特徴とするアクティブマトリクス型液晶表示素
子。1. A plurality of scanning lines and signal lines intersect with each other on one main surface of an insulating substrate, and one pixel composed of a thin film transistor and a display pixel electrode connected to the thin film transistor is arranged near each intersection. The array substrate having the one pixel connected to the scanning line and the signal line, the counter substrate having the counter electrode arranged on one main surface of the other insulating substrate, and the array substrate and the counter substrate. In an active matrix type liquid crystal display element comprising a liquid crystal sandwiched in a gap obtained by combining so that one main surface side faces each other, the signal lines and the electrode surface on the liquid crystal layer side of the thin film transistor, An active matrix type liquid crystal display element, characterized by being covered with the same material as a display pixel electrode.
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