JPH0556663A - Protector for thyristor converter - Google Patents

Protector for thyristor converter

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JPH0556663A
JPH0556663A JP3215767A JP21576791A JPH0556663A JP H0556663 A JPH0556663 A JP H0556663A JP 3215767 A JP3215767 A JP 3215767A JP 21576791 A JP21576791 A JP 21576791A JP H0556663 A JPH0556663 A JP H0556663A
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thyristor
arm
gate
protective
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Shigeru Tanabe
茂 田辺
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Abstract

PURPOSE:To protect a thyristor by sending protective gate pulses in the case that the reverse voltage period is insufficient after circulation of an accident current, and sending protective pulses further at the point of time when forward voltage applied subsequently is added in the case that these protective pulses are sent. CONSTITUTION:Protective gate pulses are sent by first protective pulse generating means 18-22 so as to surely prevent the occurrence of partial turn off, in the case that the reverse voltage period after circulation of an accident current is insufficient, when an accident of an overcurrent flowing to the a thyristor 1 occurs. And in the case that these protective pulses are sent, protective pulses are sent further by second protective pulse generating means 24-26 at the point of time when forward voltage applied subsequently is added. Hereby, the thyristor 1 can be protected from the deterioration by forward power.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、直流送電設備等に使用
するサイリスタ変換器の保護装置に係り、特に事故電流
通電時のサイリスタ変換器の保護装置に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a protection device for a thyristor converter used in DC power transmission equipment and the like, and more particularly to a protection device for a thyristor converter when a fault current is applied.

【0002】[0002]

【従来の技術】サイリスタ変換器においては、特にイン
バ―タ運転の際には通電終了後、僅かな逆電圧期間(余
裕角γと称する)の後、順電圧が印加されるため、余裕
角γとサイリスタのタ―ンオフタイム(Tqと称する)
の間には、以下の関係が常に維持されるようサイリスタ
変換器は運転される。 γ>Tq+T=γ0 ここで、Tはサイリスタ間のγのバラツキを考慮した時
2. Description of the Related Art In a thyristor converter, a forward voltage is applied after a short reverse voltage period (referred to as an allowance angle γ) after the end of energization, particularly during an inverter operation, so that the allowance angle γ And thyristor turn-off time (called Tq)
During the period, the thyristor converter is operated so that the following relationship is always maintained. γ> Tq + T = γ0 where T is the time considering the variation of γ between thyristors.

【0003】サイリスタ変換器の1ア―ムが多数の直列
サイリスタで構成される場合、個々のTqにバラツキが
あるため、クリティカルなγでの運転では特定のサイリ
スタのみタ―ンオフする現象が起こりそのサイリスタの
みに全回路電圧が加わり破壊するという不具合が生ず
る。これを避けるため、例えば特公昭54―31660
号に開示されている図2に示すようなゲ―ト制御回路が
用いられている。
When one arm of the thyristor converter is composed of a large number of series thyristors, there is a variation in each Tq, so that in a critical γ operation, only a specific thyristor turns off. The entire thyristor is applied with the entire circuit voltage, resulting in breakdown. In order to avoid this, for example, Japanese Patent Publication No. 54-31660
A gate control circuit as shown in FIG. 2 disclosed in the above publication is used.

【0004】サイリスタ変換器の1ア―ムは多数の直列
接続サイリスタとその付属回路より成るが、その内の1
部分を図2に示す。図2において1はサイリスタ、2,
3はサイリスタに並列接続された分圧用抵抗及びコンデ
ンサである。LED4a,4bは電流制限抵抗5を介し
てサイリスタ1と並列接続されており、各々順電圧信号
(FV)、逆電圧信号(RV)を発信し、ライトガイド
6a,6bを介してゲート制御装置内の光電変換回路7
に伝送され、電気信号に変換される。
One arm of the thyristor converter consists of a number of series-connected thyristors and their associated circuits, one of which is
The part is shown in FIG. In FIG. 2, 1 is a thyristor, 2,
Reference numeral 3 is a voltage dividing resistor and a capacitor connected in parallel with the thyristor. The LEDs 4a and 4b are connected in parallel with the thyristor 1 via the current limiting resistor 5, respectively, and emit forward voltage signals (FV) and reverse voltage signals (RV) respectively, and inside the gate control device via the light guides 6a and 6b. Photoelectric conversion circuit 7
Is transmitted to and converted into an electric signal.

【0005】通常のゲートパルスは以下のようにして発
生する。図示していない変換器制御装置から伝送される
導通期間オン信号ONでフリップフロップはセットされ
オフ信号OFFでリセットされる。フリップフロップ8
がセットされると、その出力は他のフリップフロップ9
をセットし、信号PHS0 が「1」になる。前述したF
V信号と信号PHS0 がアンドゲート10により論理積
がとられ、その出力がモノマルチバイブレータ11によ
り1パルス化され、増幅器12により増幅されたあと、
スイッチング用トランジスタ13のベースを駆動する。
A normal gate pulse is generated as follows. The flip-flop is set by the ON signal ON which is transmitted from the converter controller (not shown) and reset by the OFF signal OFF. Flip flop 8
When is set, its output is another flip-flop 9
Is set, and the signal PHS0 becomes "1". F mentioned above
The V signal and the signal PHS0 are logically ANDed by the AND gate 10, and the output is pulsed by the mono-multivibrator 11 and amplified by the amplifier 12,
It drives the base of the switching transistor 13.

【0006】直列サイリスタ1と同数のサイリスタ点弧
用LED141 〜14n が電源用コンデンサ15及び電
流調整インピーダンス16及び前記トランジスタ13と
直列に接続されている。従って、トランジスタ13が駆
動されるとLED141 〜14n に電流が流れ光ゲート
パルスとしてライトガイド17を介してサイリスタ1に
伝送される。ここでサイリスタ1は光直接点弧形を想定
しており、上記光ゲートパルスによりサイリスタ1は点
弧する。
The same number of thyristor firing LEDs 141 to 14n as the series thyristor 1 are connected in series with the power supply capacitor 15, the current adjusting impedance 16 and the transistor 13. Therefore, when the transistor 13 is driven, a current flows through the LEDs 141 to 14n and is transmitted to the thyristor 1 via the light guide 17 as an optical gate pulse. Here, the thyristor 1 is assumed to be a light direct ignition type, and the thyristor 1 is ignited by the optical gate pulse.

【0007】一方、逆電圧期間が所定値以下の場合の保
護ゲートパルスは以下のようにして発生される。図3は
インバータ運転時のサイリスタ電圧、FV信号、RV信
号、PHS0 信号及びゲ―トパルス指令を示す。導通期
間終了後の逆圧期間γが所定値γ0 以上の時はオンディ
レイによってフリップフロップ8がリセットされるた
め、破線で示したようにPHS0 信号が「0」となり保
護ゲ―トパルスは出力されない。ところが、γがγ0 よ
り小さい時、順電圧が加わると同時に保護ゲ―トパルス
が出力され全てのサイリスタは点弧される。
On the other hand, when the reverse voltage period is less than the predetermined value, the protection gate pulse is generated as follows. FIG. 3 shows the thyristor voltage, FV signal, RV signal, PHS0 signal and gate pulse command during inverter operation. When the back pressure period γ after the end of the conduction period is equal to or greater than the predetermined value γ0, the flip-flop 8 is reset by the on-delay, so that the PHS0 signal becomes "0" as shown by the broken line, and the protection gate pulse is not output. However, when γ is smaller than γ 0, a forward gate voltage is applied and at the same time a protection gate pulse is output and all thyristors are fired.

【0008】[0008]

【発明が解決しようとする課題】かかる従来のサイリス
タ変換器の保護装置には以下のような不具合がある。
The conventional protection device for a thyristor converter has the following drawbacks.

【0009】即ち、ア―ム短絡や直流短絡等のような、
サイリスタ変換器に過大な電流が流れるような事故が発
生した時、一般にゲ―トブロックによりサイリスタ変換
器を保護する方式がとられている。通常は故障電流が流
れた後1.5〜2msの時間逆電圧が印加された後、順
電圧が加わるので全てのサイリスタはタ―ンオフするこ
とかできゲ―トブロックが可能である。ところが、調相
設備の開閉が重畳する等の理由で系統電圧が歪んだ場合
には、逆電圧期間が通常より短かくなることがある。こ
うした場合、前述したように部分的にタ―オフするサイ
リスタがでることがあるので、これを防止するためγが
所定値より小さい時順電圧が印加された時点で保護ゲ―
トパルスを出力しサイリスタを保護する必要がある。
That is, such as an arm short circuit or a DC short circuit,
When an accident in which an excessive current flows through the thyristor converter occurs, a gate block is generally used to protect the thyristor converter. Normally, after a reverse voltage is applied for 1.5 to 2 ms after a fault current flows, a forward voltage is applied, so that all thyristors can be turned off and gate blocking is possible. However, when the system voltage is distorted due to overlapping of opening and closing of the phase adjusting equipment, the reverse voltage period may become shorter than usual. In such a case, a thyristor that partially turns off may occur as described above.To prevent this, when γ is smaller than a predetermined value, the protection gate is applied when the forward voltage is applied.
Pulse must be output to protect the thyristor.

【0010】サイリスタは故障電流を流すことにより、
その接合部温度が通常運転時より高くなる。タ―ンオフ
タイム(Tq)は温度依存性が顕著であり、温度が高く
なると大きくなる。このため通常運転時の逆電圧期間の
設定のままでは、部分的にタ―オフするサイリスタとタ
―ンオフしないサイリスタが存在するケ―スを完全に防
止できずに、十分な保護が行えなかった。
The thyristor causes a fault current to flow,
The junction temperature becomes higher than that during normal operation. The turn-off time (Tq) has a remarkable temperature dependency, and increases as the temperature rises. Therefore, with the setting of the reverse voltage period during normal operation, the case in which there is a thyristor that partially turns off and a thyristor that does not turn off cannot be completely prevented, and sufficient protection cannot be performed. ..

【0011】従って、本発明はかかる従来のサイリスタ
変換器の保護装置の不具合を解消するためになされたも
のであって、ア―ム短絡等の事故時にも確実に部分的な
タ―ンオフに対する保護ができるサイリスタ変換器の保
護装置を提供することを目的とする。
Therefore, the present invention has been made in order to solve the problem of the conventional protection device for a thyristor converter, and can reliably protect against partial turn-off even in the case of an accident such as an arm short circuit. It is an object of the present invention to provide a protection device for a thyristor converter that can achieve the above.

【0012】[0012]

【課題を解決するための手段】本発明は前記目的を達成
するために、サイリスタ変換器を構成するアームが少く
とも複数個の直列接続のサイリスタで構成され、該アー
ムの導通期間終了後の逆電圧印加期間が所定値以下の
時、導通期間終了後該アームに順電圧が印加さる毎に保
護ゲ―トパルスを発生する保護手段を備えたサイリスタ
変換器の保護装置において、前記サイリスタ変換器に過
大電流が流れる事故が発生した際に、該アームの導通期
間終了後の逆電圧印加期間が前記所定値より大きい所望
の値以下の時、導通期間終了後該アームに順電圧が印加
されたことで保護ゲ―トパルスを発生する第1の保護パ
ルス発生手段と、この第1の保護パルス発生手段が動作
した際には、前記サイリスタ変換器の交流側遮断器がト
リップするまで該アームに順電圧が印加される毎に保護
ゲ―トパルスを発生する第2の保護パルス発生手段を具
備したことを特徴とするものである。
In order to achieve the above-mentioned object, the present invention comprises at least a plurality of series-connected thyristors constituting an arm which constitutes a thyristor converter, and the reverse operation after the conduction period of the arm is completed. When the voltage application period is less than or equal to a predetermined value, in the protection device of the thyristor converter having protection means for generating a protection gate pulse each time a forward voltage is applied to the arm after the conduction period ends, the thyristor converter has an excessive voltage. When an accident occurs in which a current flows, when the reverse voltage application period after the conduction period of the arm is equal to or less than a desired value larger than the predetermined value, the forward voltage is applied to the arm after the conduction period is terminated. When the first protection pulse generating means for generating a protection gate pulse and the first protection pulse generating means operate, the first protection pulse generating means operates until the AC side breaker of the thyristor converter trips. It is characterized in that comprising a second protective pulse generating means for generating a Toparusu - forward voltage arm protection gate each time it is applied.

【0013】[0013]

【作用】本発明によれば、事故電流通流後、逆電圧期間
が不十分な場合、部分的なタ―ンオフの発生を確実に防
止するため第1の保護パルス発生手段によって保護ゲ―
トパルスを出し、この保護ゲ―トパルスが出た場合には
続いて印加される順電圧が加わった時点で更に第2の保
護パルス発生手段によって保護パルスを出すことにより
順電圧による劣化からサイリスタを保護する。
According to the present invention, when the reverse voltage period is insufficient after the fault current flows, the first protection pulse generating means is used to surely prevent the partial turn-off from occurring.
Pulse is generated, and when this protection gate pulse is generated, the protection pulse is further generated by the second protection pulse generating means when the forward voltage applied subsequently is applied to protect the thyristor from deterioration due to the forward voltage. To do.

【0014】[0014]

【実施例】以下、本発明の一実施例を図2と同一分に同
一符号を付して示す図1を参照して説明する。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of the present invention will be described below with reference to FIG. 1, which shows the same parts as those in FIG.

【0015】図1のものは、図2の従来のものに2つ保
護パルスを発生する第1の保護パルス発生手段及び第2
の保護パルス発生手段を付加したものである。第1の保
護パルス発生手段は、フリップフロップ18、反転ゲ―
ト19、オアゲ―ト20、アンドゲ―ト21及びモノマ
ルチバイブレ―タ22で構成されている。
The configuration of FIG. 1 is different from the conventional configuration of FIG. 2 in that it includes first protection pulse generating means for generating two protection pulses and a second protection pulse generating means.
The protection pulse generating means is added. The first protection pulse generating means is a flip-flop 18, an inversion gate.
It is composed of a gate 19, an oaget 20, an and gate 21, and a mono-multi vibrator 22.

【0016】そして、フリップフロップ18はフリップ
フロップ8がセットされると同時にセットされ、余裕角
γ1 及びア―ム短絡検出信号の反転ゲ―ト19からの出
力がオアゲ―ト20の入力となり、その出力によりリセ
ットされる。フリップフロップ18の出力はアンドゲ―
ト21によりFV信号と論理積をとられその出力はモノ
マルチバイブレ―タ22でワンショット化されて、オア
ゲ―ト23の入力となる。一方、第2の保護パルス発生
手段は、フリップフロップ24、アンドゲ―ト25、モ
ノマルチバイブレ―タ26で構成されている。
The flip-flop 18 is set at the same time as the flip-flop 8 is set, and the output from the margin angle γ1 and the inversion gate 19 of the arm short circuit detection signal becomes the input of the OR gate 20. Reset by output. The output of the flip-flop 18 is AND gate
The FV signal is logically ANDed by the gate 21 and its output is converted into a one-shot by the monomultivibrator 22 and becomes the input of the oaget 23. On the other hand, the second protection pulse generating means is composed of a flip-flop 24, an AND gate 25, and a mono-multivibrator 26.

【0017】そして、フリップフロップ24はアンドゲ
―ト21の出力によりセットされ、しゃ断器のトリップ
信号(CB TRIP)によりリセットされる。フリッ
プフロップ24の出力はアンドゲ―ト25によりFV信
号と論理積がとられ、その出力はモノマルチバイブレ―
タ26によりワンショット化されオアゲ―ト23の入力
となる。
The flip-flop 24 is set by the output of the AND gate 21, and reset by the trip signal (CB TRIP) of the circuit breaker. The output of the flip-flop 24 is logically ANDed with the FV signal by the AND gate 25, and the output is a mono-multi vibrator.
It is converted into a one-shot by the data 26 and becomes an input to the oaget 23.

【0018】前記のように構成することにより、ア―ム
短絡が発生した場合、ア―ム短絡検出信号が送信されて
くるので、反転ゲ―ト19の出力は「0」となる。この
時逆電圧期間がγ1 以上あればフリップフロップ18は
リセットされるので、保護パルスは出ないが逆電圧期間
がγ1 以下であるとフリップフロップ18がリセットさ
れず、その出力は「1」のままとなる。従って、再びサ
イリスタに順電圧が加わりFV信号がくるとアンドゲ―
ト21の入力は共に「1」となるので、その出力は
「1」となり、モノマルチバイブレ―タ22が動作して
保護パルスが出される。更にアンドゲ―ト21の出力は
フリップフロップ24のセット信号となる。フリップフ
ロップ24の出力はFV信号とのANDになっているの
で、ア―ム短絡後に1回保護ゲ―トパルスが出た後は、
FV信号がくれば必ず保護ゲ―トパルスが出るという状
況がサイリスタ変換器の交流側遮断器がトリップするま
で、即ち、CB TRIPによりフリップフロップ24
がリセットされるまで続く。
With the above construction, when an arm short circuit occurs, the arm short circuit detection signal is transmitted, and the output of the inverting gate 19 becomes "0". At this time, if the reverse voltage period is γ1 or more, the flip-flop 18 is reset. Therefore, if the reverse voltage period is γ1 or less, the flip-flop 18 is not reset and the output remains "1" because no protection pulse is output. Becomes Therefore, when forward voltage is applied to the thyristor again and FV signal comes,
Since both inputs of the switch 21 are "1", the output thereof is "1", and the mono-multivibrator 22 operates to output the protection pulse. Further, the output of the AND gate 21 becomes a set signal of the flip-flop 24. Since the output of the flip-flop 24 is ANDed with the FV signal, after the protection gate pulse is output once after the arm short circuit,
The situation in which the protection gate pulse is output whenever the FV signal comes in is until the AC side circuit breaker of the thyristor converter trips, that is, the flip-flop 24 by the CB TRIP.
Continues until is reset.

【0019】以上説明のように、ア―ム短絡が発生し、
1波の事故電流を流したあと逆電圧期間がγ1 より短い
場合、本発明によれば保護ゲ―トパルスが出る。γ1 の
値は事故電流を流した後のサイリスタの接合部温度が高
い状態に合せて選択されているので、通常運転時のγ0
より大きくなっており保護ゲ―トパルスが必要な状況で
は必ず保護することができる。
As described above, an arm short circuit occurs,
If the reverse voltage period is shorter than .gamma.1 after passing one wave of fault current, according to the invention, a protective gate pulse is issued. The value of γ1 is selected according to the condition that the junction temperature of the thyristor after the fault current is applied is high.
It can always be protected in larger situations where a protective gate pulse is needed.

【0020】更に、ア―ム短絡が発生し、かつ保護ゲ―
トパルスが発生した後はしゃ断器がトリップするまで順
電圧がかかれば必ずゲ―トパルスを出すため、順電圧に
よりサイリスタが劣化することはない。
Furthermore, an arm short circuit occurs and the protection gate
After the occurrence of the gate pulse, if the forward voltage is applied until the breaker trips, the gate pulse is always output, so the thyristor is not deteriorated by the forward voltage.

【0021】以上はア―ム短絡について説明したが直流
短絡でも同様である。又、図1ではサイリスタは代表と
して1個しか示していないが、複数個のサイリスタに対
して複数個のFV、RV信号が出された場合は、それら
をオア合成してその出力をここで説明したFV又はRV
信号として使用すればよい。尚、第1及び第2の保護パ
ルス発生手段は図1の論理回路に限定するものではな
く、種々設計変更して実施できるものである。
Although the arm short circuit has been described above, the same applies to a DC short circuit. Although only one thyristor is shown in FIG. 1 as a representative, when a plurality of FV and RV signals are output to a plurality of thyristors, they are OR-combined and their outputs are explained here. FV or RV
It may be used as a signal. The first and second protection pulse generating means are not limited to the logic circuit shown in FIG. 1 and can be implemented with various design changes.

【0022】[0022]

【発明の効果】以上説明のように本発明によれば、ア―
ム短絡等の発生時に、余裕角が不足した場合でも確実に
サイリスタを保護できるサイリスタ変換器の保護装置を
提供できる。
As described above, according to the present invention,
It is possible to provide a thyristor converter protection device that can reliably protect a thyristor even when the margin angle is insufficient when a system short circuit occurs.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の一実施例を示す構成図。FIG. 1 is a configuration diagram showing an embodiment of the present invention.

【図2】従来装置の構成図。FIG. 2 is a configuration diagram of a conventional device.

【図3】サイリスタ変換器の保護動作を説明するための
波形図。
FIG. 3 is a waveform diagram for explaining a protection operation of the thyristor converter.

【符号の説明】[Explanation of symbols]

1…サイリスタ 4…順電圧,逆
電圧用LED 6…ライトガイド 8,9,18,24 …フリップフ
ロップ 20,23 …オアゲ―ト 10,21,25…アンド
ゲ―ト
1 ... Thyristor 4 ... LED for forward voltage and reverse voltage 6 ... Light guide 8,9,18,24 ... Flip-flop 20,23 ... Ogate 10,21,25 ... And gate

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】 サイリスタ変換器を構成するアーム
が少くとも複数個の直列接続のサイリスタで構成され、
該アームの導通期間終了後の逆電圧印加期間が所定値以
下の時、導通期間終了後該アームに順電圧が印加さる毎
に保護ゲ―トパルスを発生する保護手段を備えたサイリ
スタ変換器の保護装置において、 前記サイリスタ変換器に過大電流が流れる事故が発生し
た際に、該アームの導通期間終了後の逆電圧印加期間が
前記所定値より大きい所望の値以下の時、導通期間終了
後該アームに順電圧が印加されたことで保護ゲ―トパル
スを発生する第1の保護パルス発生手段と、 この第1の保護パルス発生手段が動作した際には、前記
サイリスタ変換器の交流側遮断器がトリップするまで該
アームに順電圧が印加される毎に保護ゲ―トパルスを発
生する第2の保護パルス発生手段を具備したことを特徴
とするサイリスタ変換器の保護装置。
1. An arm constituting a thyristor converter is composed of at least a plurality of series-connected thyristors,
When the reverse voltage application period after the end of the conduction period of the arm is less than or equal to a predetermined value, protection of the thyristor converter provided with a protection means for generating a protection gate pulse each time a forward voltage is applied to the arm after the conduction period ends In the device, when an excessive current flows in the thyristor converter, when the reverse voltage application period after the end of the conduction period of the arm is equal to or less than a desired value larger than the predetermined value, the arm after the conduction period ends. A first protection pulse generating means for generating a protection gate pulse when a forward voltage is applied to the first protection pulse generating means, and the AC side circuit breaker of the thyristor converter when the first protection pulse generating means operates. A protection device for a thyristor converter, comprising a second protection pulse generating means for generating a protection gate pulse each time a forward voltage is applied to the arm until a trip occurs.
JP3215767A 1991-08-28 1991-08-28 Protection device for thyristor converter Expired - Lifetime JP2966152B2 (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006074888A (en) * 2004-09-01 2006-03-16 Toshiba Mitsubishi-Electric Industrial System Corp Gate control device of thyristor

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JP2006074888A (en) * 2004-09-01 2006-03-16 Toshiba Mitsubishi-Electric Industrial System Corp Gate control device of thyristor

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