JPH0554628B2 - - Google Patents

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JPH0554628B2
JPH0554628B2 JP59218496A JP21849684A JPH0554628B2 JP H0554628 B2 JPH0554628 B2 JP H0554628B2 JP 59218496 A JP59218496 A JP 59218496A JP 21849684 A JP21849684 A JP 21849684A JP H0554628 B2 JPH0554628 B2 JP H0554628B2
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Description

【発明の詳細な説明】 〔発明の利用分野〕 本発明は半導体集積回路中の電流路に流れる電
流値を検出する装置に関し、例えば電流制御型の
負荷駆動用集積回路における負荷電流を検出する
装置に関するものである。
[Detailed Description of the Invention] [Field of Application of the Invention] The present invention relates to a device for detecting the value of current flowing in a current path in a semiconductor integrated circuit, for example, a device for detecting a load current in a current-controlled load driving integrated circuit. It is related to.

〔従来技術〕[Prior art]

従来の電流測定回路としては、例えば「電気計
測便覧、昭和48年オーム社発行」の第1264頁に記
載のものがある。
As a conventional current measuring circuit, there is one described, for example, on page 1264 of "Electrical Measurement Handbook, published by Ohmsha, 1971."

第2図は従来の電流制御型負荷駆動用集積回路
の構成図である。
FIG. 2 is a configuration diagram of a conventional current-controlled load driving integrated circuit.

第2図において、1は負荷駆動用のパワートラ
ンジスタ、2は負荷、3は電流検出用抵抗、4は
制御回路、5は電源端子である。
In FIG. 2, 1 is a power transistor for driving a load, 2 is a load, 3 is a current detection resistor, 4 is a control circuit, and 5 is a power supply terminal.

上記の回路においては、負荷2を流れる電流を
電流検出用抵抗3で電圧に変換し、その値に基づ
いて制御回路4でパワートランジスタ1の制御電
圧又はデユーテイを調節することによつて、負荷
2を流れる電流を制御するような負帰還をかける
ように構成している。
In the above circuit, the current flowing through the load 2 is converted into a voltage by the current detection resistor 3, and the control circuit 4 adjusts the control voltage or duty of the power transistor 1 based on the value. It is configured to apply negative feedback to control the current flowing through the circuit.

そして一般に数アンペアクラスの電流検出用抵
抗を内蔵している電力制御用集積回路では、電流
検出用抵抗3の値として0.1Ω程度のエミツタ拡
散による抵抗を用いている。
Generally, in a power control integrated circuit that incorporates a current detection resistor of several ampere class, an emitter diffusion resistor of about 0.1Ω is used as the current detection resistor 3.

〔発明が解決しようとする問題点〕[Problem that the invention seeks to solve]

上記のごとき従来の装置においては、負荷を流
れる電流を検出するために、負荷に直列に抵抗が
挿入されるような構成となつているため、大電流
制御時にはその抵抗で電圧降下を生じ、負荷に掛
かる電圧が低下してしまうという問題がある。
In conventional devices such as those described above, a resistor is inserted in series with the load in order to detect the current flowing through the load. Therefore, when controlling a large current, the resistor causes a voltage drop, causing the load There is a problem in that the voltage applied to the device decreases.

その問題を解決するために、大容量で低抵抗値
の抵抗を実現しようとすると、大面積が必要とな
り、集積回路が大形で高価なものとなつてしま
う。
In order to solve this problem, attempting to realize a resistor with a large capacity and a low resistance value requires a large area, resulting in a large and expensive integrated circuit.

又、上記の電流検出用抵抗で発熱するため、放
熱設計が難かしくなるという問題もある。
Furthermore, since the current detection resistor generates heat, there is also the problem that heat dissipation design becomes difficult.

本発明は上記のごとき従来技術の問題点を解決
することを目的とするものである。
The present invention aims to solve the problems of the prior art as described above.

〔問題を解決するための手段〕[Means to solve the problem]

上記の目的を達成するため本発明においては、
半導体集積回路表面の絶縁膜上に電流路を形成
し、半導体集積回路内に磁気検出素子を形成し、
半導体集積回路チツプの上記磁気検出素子の近傍
に溝を設け、該溝の中に電流路を設けることによ
り、上記電流路を流れる電流によつて生じる磁界
の強さを上記磁気検出素子で検出することによつ
て電流値を検出し、かつ、磁気検出素子と電流路
との間隔を小さくして、検出感度を向上させるよ
うに構成している。
In order to achieve the above object, in the present invention,
Forming a current path on an insulating film on the surface of a semiconductor integrated circuit, forming a magnetic detection element within the semiconductor integrated circuit,
A groove is provided in the vicinity of the magnetic detection element of the semiconductor integrated circuit chip, and a current path is provided in the groove, so that the strength of the magnetic field generated by the current flowing through the current path is detected by the magnetic detection element. In this way, the current value is detected, and the distance between the magnetic detection element and the current path is reduced to improve the detection sensitivity.

第3図は本発明の概念図であり、第2図と同符
号は同一物を示す。
FIG. 3 is a conceptual diagram of the present invention, and the same reference numerals as in FIG. 2 indicate the same parts.

第3図において、6は磁気検出素子、7は磁界
発生用の電流路である。
In FIG. 3, 6 is a magnetic detection element, and 7 is a current path for generating a magnetic field.

上記の装置において、電流路7に負荷電流が流
れると、その電流値に対応した磁界が発生する。
In the above device, when a load current flows through the current path 7, a magnetic field corresponding to the current value is generated.

その磁界の強さを磁気検出素子6で検出するこ
とによつて、電流路7を流れる電流の値を検出す
ることが出来る。
By detecting the strength of the magnetic field with the magnetic detection element 6, the value of the current flowing through the current path 7 can be detected.

そして、本発明においては、上記の磁気検出素
子6と電流路7とを他の素子が形成されている半
導体集積回路チツプに形成するように構成してい
る。
In the present invention, the magnetic detection element 6 and the current path 7 are formed on a semiconductor integrated circuit chip on which other elements are formed.

〔発明の実施例〕[Embodiments of the invention]

第1図は本発明者が考案した本発明の前提とな
る電流検出装置の一例図であり、Aは平面図、B
はAのA−A′断面図を示す。
FIG. 1 is an example of a current detection device devised by the present inventor, which is the premise of the present invention, where A is a plan view and B is a plan view.
shows a sectional view taken along line A-A' of A.

第1図において、11は比抵抗が10Ω・cmのp
型(111)面のSi基板、12はn+埋込層、13は
p+の素子分離領域、14は比抵抗が10Ω・cmで
厚さが16μmのn-エピタキシヤル層、15はp型
のベース拡散領域、16はエミツタ用n+領域、
17,17′はホール電極用n+領域(A−A′断面
図では見えないはずであるが、説明のためBにも
表示している)、18はコレクタ用n+領域、19
はAl配線層、20はSiO2膜、21は厚さ30μmの
Agメツキ層で形成された電流路(21′,21″
は電流路の一部)であり、Al配線層19上にAg
蒸着膜を形成した後、その上にメツキ法によつて
形成されたものである。
In Figure 1, 11 is p with a specific resistance of 10Ω・cm.
(111) type Si substrate, 12 is n + buried layer, 13 is
p + element isolation region, 14 is an n - epitaxial layer with a resistivity of 10 Ω cm and a thickness of 16 μm, 15 is a p-type base diffusion region, 16 is an n + region for emitter,
17 and 17' are n + regions for hole electrodes (although they should not be visible in the A-A' cross-sectional view, they are also shown in B for explanation), 18 is n + region for collectors, and 19
is an Al wiring layer, 20 is a SiO 2 film, and 21 is a 30 μm thick
Current path (21′, 21″) formed with Ag plating layer
is a part of the current path), and Ag is on the Al wiring layer 19.
After forming a vapor-deposited film, it is formed thereon by a plating method.

なお第1図Aにおいて、破線内が磁気検出素子
の部分であり、破線外が素子分離領域13の部分
である。
In FIG. 1A, the part inside the broken line is the magnetic detection element, and the part outside the broken line is the part of the element isolation region 13.

又、上記の磁気検出素子は、n-エピタキシヤ
ル層14、ベース拡散領域15、エミツタ用n+
領域16、ホール電極用n+領域17,17′、コ
レクタ用n+領域18で構成されており、これは
バイポーラトランジスタのベース拡散領域15と
コレクタ用n+領域18との間にホール電極用n+
領域17,17′を設けたものである。
The above magnetic sensing element also includes an n - epitaxial layer 14, a base diffusion region 15, and an n + emitter layer.
It is composed of a region 16 , an n + region 17, 17' for a hole electrode, and an n + region 18 for a collector. +
Regions 17 and 17' are provided.

第1図の装置において、電流路21に負荷電流
が流れると、電流路21で取り囲まれた内側に形
成されている磁気検出素子上に磁界が生ずる。
In the device shown in FIG. 1, when a load current flows through the current path 21, a magnetic field is generated on the magnetic detection element formed inside the current path 21.

この磁界の強さを磁気検出素子で検出すること
によつて電流路21に流れる電流の値を検出する
ことが出来る。
By detecting the strength of this magnetic field with a magnetic detection element, the value of the current flowing through the current path 21 can be detected.

又、磁界を強くし、検出感度を上げるため、電
流路21を例えばAgメツキによつて厚く形成し、
かつその幅を狭くして、磁界の検出領域と電流路
との実効的な距離を小さく設定している。
In addition, in order to strengthen the magnetic field and increase detection sensitivity, the current path 21 is formed thickly by, for example, Ag plating.
Moreover, by narrowing the width, the effective distance between the magnetic field detection area and the current path is set small.

上記の構成において、2〜4Aの電流に対して
実効的な磁束密度50〜100ガウスが得られる。
In the above configuration, an effective magnetic flux density of 50 to 100 Gauss is obtained for a current of 2 to 4 A.

又、磁気検出素子はn-エピタキシヤル層14
の比抵抗を10Ω・cmと高くすることにより、ベー
ス・コレクタ結合の空乏層がホール電極用n+
域17,17′に達するようにする。
Moreover, the magnetic sensing element is made of an n - epitaxial layer 14.
By increasing the specific resistance to 10 Ω·cm, the depletion layer of the base-collector coupling is made to reach the hole electrode n + regions 17, 17'.

このときホール電極用n+領域17と17′との
間には、fVdnaxWBの電圧が生じる。
At this time, a voltage of fV dnax WB is generated between the hole electrode n + regions 17 and 17'.

ここで、fは形状効果を現わす係数、Vdnax
空乏層中の電子の飽和ドリフト速度、Wは17と
17′との間の距離、Bは実効的な磁束密度であ
る。
Here, f is a coefficient expressing the shape effect, V dnax is the saturation drift velocity of electrons in the depletion layer, W is the distance between 17 and 17', and B is the effective magnetic flux density.

例えばW=50μmの時、コレクタ用n+領域18
に8〜10Vの電圧を与え、ベース拡散領域15を
カレント・ミラーで駆動して、数mAのコレクタ
電流を流すと、負荷電流が2〜4Aのときに、数
十mVの出力が得られる。
For example, when W = 50 μm, collector n + region 18
If a voltage of 8 to 10 V is applied to the base diffusion region 15 with a current mirror and a collector current of several mA flows, an output of several tens of mV can be obtained when the load current is 2 to 4 A.

なお、n+埋込層12はコレクタ電流の通路と
ならないように、ベース拡散領域15の直下のみ
に形成する。
Note that the n + buried layer 12 is formed only directly under the base diffusion region 15 so as not to serve as a path for collector current.

上記のような構成おいては、電流路21のAg
メツキ以外の工程が通常のバイポーラプロセスに
よつて形成することが出来るので、電流検出機能
を有する負荷駆動用集積回路をコンパクトに形成
することが可能となる。
In the above configuration, Ag of the current path 21
Since the steps other than plating can be formed by a normal bipolar process, it is possible to form a load driving integrated circuit having a current detection function in a compact manner.

次に、前記第1図の装置の問題点について、説
明する。
Next, problems with the device shown in FIG. 1 will be explained.

第4図は、前記第1図のB−B′断面図であり、
22は磁界を示し、その他第1図と同符号は同一
物を示す。
FIG. 4 is a sectional view taken along line BB' in FIG.
Reference numeral 22 indicates a magnetic field, and the same reference numerals as in FIG. 1 indicate the same elements.

第4図の装置において、電流路21′,21″に
反対向きの電流が流れると、図示したような磁界
22が生ずる。
In the apparatus of FIG. 4, when currents in opposite directions flow through the current paths 21', 21'', a magnetic field 22 as shown is produced.

そして、n-エピタキシヤル層14に紙面に垂
直な方向に電流を流しておくと、ホール効果によ
つてn+拡散領域17,17間に電圧を生ずる。
When a current is passed through the n - epitaxial layer 14 in a direction perpendicular to the plane of the paper, a voltage is generated between the n + diffusion regions 17 and 17 due to the Hall effect.

ところが、第4図の構成のように、電流路2
1′,21″が半導体集積回路チツプの表面に形成
されている場合には、n-エピタキシヤル層14
の下部で電流路21′,22″に遠い領域では磁界
が弱くなり、n-エピタキシヤル層14に流して
いるバイアス電流との相互作用が小さくなるの
で、バイアス電流を十分に利用することが出来な
くなることがある。
However, as in the configuration shown in Fig. 4, the current path 2
1', 21'' are formed on the surface of the semiconductor integrated circuit chip, the n - epitaxial layer 14
The magnetic field is weaker in the region below the current paths 21' and 22'', and the interaction with the bias current flowing through the n - epitaxial layer 14 is reduced, so the bias current can be fully utilized. It may disappear.

例えば、n-エピタキシヤル層14の厚さを
12μmとした場合に、上端部に比べて下端部では
磁界が5%以上小さくなり、感度が低下するとと
もに、n-エピタキシヤル層内部ではバイアス電
流分布のばらつきの影響を受けやすくなり、感度
のばらつきが大きくなる。
For example, the thickness of the n -epitaxial layer 14 is
When the diameter is 12 μm, the magnetic field is 5% or more smaller at the bottom end than at the top end, resulting in lower sensitivity, and the inside of the n -epitaxial layer is more susceptible to variations in bias current distribution, resulting in sensitivity variations. becomes larger.

第5図は、上記のごとき問題を解決した本発明
の一実施例の断面図であ。
FIG. 5 is a sectional view of an embodiment of the present invention that solves the above problems.

第5図において、23,23′は電流路、24,
25は半導体集積回路チツプに設けた溝、26は
SiO2膜であり、その他第4図と同符号は同一物
を示す。
In FIG. 5, 23, 23' are current paths, 24,
25 is a groove provided in the semiconductor integrated circuit chip; 26 is a groove provided in the semiconductor integrated circuit chip;
It is a SiO 2 film, and the same symbols as in FIG. 4 indicate the same parts.

第5図の構成において、n-エピタキシヤル層
14の厚さを12μmとし、溝24,25をp型の
Si基板11に達する程度に形成すれば、電流路2
3,23′の中心からn-エピタキシヤル層14の
中心までの距離を50μmとして、n-エピタキシヤ
ル層の上端部及び下端部では中心に比べて磁界が
0.7%減少するだけである。
In the configuration shown in FIG. 5, the thickness of the n - epitaxial layer 14 is 12 μm, and the grooves 24 and 25 are formed of p-type
If it is formed to the extent that it reaches the Si substrate 11, the current path 2
Assuming that the distance from the center of 3, 23' to the center of the n -epitaxial layer 14 is 50 μm, the magnetic field is stronger at the upper and lower ends of the n -epitaxial layer than at the center.
It will only decrease by 0.7%.

このように第4図の構成に比べて磁界の変化が
非常に少なくなるので、感度が向上するばかりで
なく、n-エピタキシヤル層内部ではバイアス電
流分布のばらつきの影響も受けにくくなり、感度
のばらつきが小さくなる。
In this way, the changes in the magnetic field are much smaller than in the configuration shown in Figure 4, which not only improves the sensitivity, but also makes it less susceptible to variations in the bias current distribution inside the n -epitaxial layer, resulting in lower sensitivity. Variation becomes smaller.

次に第5図のごとき装置をバイポーラ集積回路
と一体化する場合の製造工程について説明する。
Next, a manufacturing process for integrating the device shown in FIG. 5 with a bipolar integrated circuit will be described.

まず、p型のSi基板11にn+埋込層を拡散し、
n-エピタキシヤル層14を成長させた後、p+
子分離領域を拡散で形成し、p型ベース拡散、
n+エミツタ拡散を行なうまでは、標準的なバイ
ポーラプロセスと同様に行なうことが出来る。
First, an n + buried layer is diffused into the p-type Si substrate 11,
After growing the n - epitaxial layer 14, a p + element isolation region is formed by diffusion, and a p type base diffusion,
Up to n + emitter diffusion, the process can be performed in the same way as a standard bipolar process.

次に、異方性エツチングもしくは反応性エツチ
ングによつて、n-エピタキシヤル層14を貫く
ような溝24,25を形成し、電流路23,2
3′、例えばAlワイヤをこの溝にはめ込む。
Next, grooves 24 and 25 penetrating the n - epitaxial layer 14 are formed by anisotropic etching or reactive etching to form current paths 23 and 2.
3', for example, an Al wire is fitted into this groove.

次に、700℃程度で、Alワイヤをリフローさ
せ、コンタクトエツチング、Al蒸着、パターニ
ング、PSGデポジシヨン、パツドのエツチング
を行なうことによつて第5図のごとき装置を形成
することが出来る。
Next, a device as shown in FIG. 5 can be formed by reflowing the Al wire at about 700° C. and performing contact etching, Al vapor deposition, patterning, PSG deposition, and pad etching.

なお、これまでの実施例では、バイポーラ集積
回路をベースとしたワンチツプ型の電流検出装置
について説明したが、MOS型の磁気検出素子と
CMOS回路とを一体化したような集積回路にも
適用出来ることは勿論である。
In the previous examples, a one-chip type current detection device based on a bipolar integrated circuit was explained, but a MOS type magnetic detection element and a one-chip type current detection device were explained.
Of course, it can also be applied to integrated circuits such as those integrated with CMOS circuits.

〔発明の効果〕〔Effect of the invention〕

以上説明したごとく本発明においては、電流路
と磁気検出素子とによつて電流を検出するように
構成しているので、従来の抵抗検出方式のように
負荷に流す電流値が制限されるとか、検出用抵抗
で内部発熱するといつたような問題を生ずること
がなく、かつ上記の電流路と磁気検出素子とを負
荷駆動用の集積回路と同一チツプ内に形成するよ
うに構成しているので、ワンチツプの集積回路で
負荷を制御することが出来るという優れた効果が
得られる。
As explained above, in the present invention, the current is detected by the current path and the magnetic detection element, so unlike the conventional resistance detection method, the current value flowing to the load is limited. There is no problem such as internal heat generated by the detection resistor, and the current path and magnetic detection element are formed on the same chip as the load driving integrated circuit. The excellent effect of being able to control the load with a single-chip integrated circuit is achieved.

又、電流路の形成以外は標準のバイポーラプロ
セスのみで構成することが出来るので、コンパク
トで安価な電流検出機能を有する負荷制御用の半
導体集積回路を容易に製造することが出来る。
In addition, since everything other than the formation of the current path can be constructed using only a standard bipolar process, it is possible to easily manufacture a compact and inexpensive semiconductor integrated circuit for load control having a current detection function.

さらに、半導体集積回路チツプに溝を設け、そ
の溝の中に電流路を形成するように構成している
ので、チツプ表面に電流路を形成するものに比べ
て、検出感度がよいだけでなく、バイアス電流の
不均一な分布に対しても感度のばらつきを減少出
来るという効果があり、さらに溝の中に電流路を
形成しているので、表面への突出部がなく、
PSGエツチングの際におけるマスク合わせが容
易になる等の効果もある。
Furthermore, since the semiconductor integrated circuit chip is configured to have a groove and a current path is formed in the groove, it not only has better detection sensitivity than a device that forms a current path on the chip surface. It has the effect of reducing variations in sensitivity even when the bias current is unevenly distributed, and since the current path is formed in the groove, there are no protrusions on the surface.
It also has the effect of facilitating mask alignment during PSG etching.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明者が考案した本発明の前提とな
る電流検出装置の一例図、第2図は従来装置の一
例図、第3図は本発明の概念図、第4図は第1図
のB−B′断面図、第5図は本発明の他の実施例
図である。 符号の説明 1……トランジスタ、2……負
荷、3……電流検出用抵抗、4……制御回路、5
……電源端子、6……磁気検出素子、7……電流
路、11……Si基板、12……n+埋込層、13…
…素子分離領域、14……n-エピタキシヤル層、
15……ベース拡散領域、16……エミツタ用
n+領域、17,17′……ホール電極用n+領域、
18……コレクタ用n+領域、19……Al配線層、
20……SiO2膜、21,21′,21″……電流
路、22……磁界、23,23′……電流路、2
4,25……溝、26……SiO2膜。
Fig. 1 is an example of a current detection device devised by the present inventor and is the premise of the present invention, Fig. 2 is an example of a conventional device, Fig. 3 is a conceptual diagram of the present invention, and Fig. 4 is the same as Fig. 1. FIG. 5 is a cross-sectional view taken along line B-B' of FIG. Explanation of symbols 1...Transistor, 2...Load, 3...Resistor for current detection, 4...Control circuit, 5
...Power terminal, 6...Magnetic detection element, 7...Current path, 11...Si substrate, 12...n + buried layer, 13...
...Element isolation region, 14...n - epitaxial layer,
15...Base diffusion area, 16...For emitter
n + region, 17, 17'... n + region for hole electrode,
18...N + region for collector, 19...Al wiring layer,
20... SiO 2 film, 21, 21', 21''... Current path, 22... Magnetic field, 23, 23'... Current path, 2
4, 25...groove, 26...SiO 2 film.

Claims (1)

【特許請求の範囲】[Claims] 1 半導体集積回路内に磁気検出素子を形成し、
又上記半導体集積回路チツプの上記磁気検出素子
の近傍に溝を設け、該溝の中に高導電率の電流路
を設け、該電流路を流れる電流によつて生じる磁
界の強さを上気磁気検出素子で検出することによ
つて上記電流路に流れる電流値を検出することを
特徴とする半導体電流検出装置。
1 Forming a magnetic detection element in a semiconductor integrated circuit,
Further, a groove is provided in the vicinity of the magnetic detection element of the semiconductor integrated circuit chip, and a high conductivity current path is provided in the groove, and the strength of the magnetic field generated by the current flowing through the current path is measured by the upper magnetic field. A semiconductor current detection device characterized in that a current value flowing in the current path is detected by detection with a detection element.
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