JPH0550178B2 - - Google Patents
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- JPH0550178B2 JPH0550178B2 JP5544083A JP5544083A JPH0550178B2 JP H0550178 B2 JPH0550178 B2 JP H0550178B2 JP 5544083 A JP5544083 A JP 5544083A JP 5544083 A JP5544083 A JP 5544083A JP H0550178 B2 JPH0550178 B2 JP H0550178B2
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- 230000005540 biological transmission Effects 0.000 claims description 66
- 238000000034 method Methods 0.000 claims description 5
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/42—Loop networks
- H04L12/427—Loop networks with decentralised control
- H04L12/433—Loop networks with decentralised control with asynchronous transmission, e.g. token ring, register insertion
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- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Small-Scale Networks (AREA)
Description
【発明の詳細な説明】
本発明は同期信号が供給されるループネツトワ
ークのループアクセス方式に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a loop access scheme for a loop network provided with synchronization signals.
同期信号が供給されるループネツトワークのア
クセス方式として、特許出願番号昭57−212364：
「ループ式通信システム」がある。かかるシステ
ムにおいては、クロツクステーシヨンは一定周期
で同期信号を送出するので、ノードステーシヨン
はこの一定周期の経過を検知すると、送信を終了
したり、送信権の獲得制御を停止し、次の周期ま
で待つ必要がある。しかし、次の周期において
は、クロツクステーシヨンが送出するトリガ信号
にもとずいて各ノードステーシヨンは送信権を獲
得するので、クロツクステーシヨンに近いノード
ステーシヨンほど送信権を獲得する機会が増え、
逆に遠いノードステーシヨンほど機会が減るとい
う問題点がある。 As an access method for a loop network to which a synchronization signal is supplied, patent application number 1983-212364:
There is a "loop communication system". In such a system, the clock station sends out a synchronization signal at a fixed cycle, so when the node station detects the passage of this fixed cycle, it ends the transmission or stops controlling the acquisition of transmission rights until the next cycle. need to wait. However, in the next cycle, each node station acquires the right to transmit based on the trigger signal sent by the clock station, so the closer the node station is to the clock station, the more opportunities it has to acquire the right to transmit.
On the other hand, the problem is that the farther away the node station is, the fewer opportunities there are.
本発明は、各ノードステーシヨンがその物理的
位置によらず公平に送信権を獲得できるループネ
ツトワークのアクセス方式を提供することにあ
る。 An object of the present invention is to provide a loop network access method in which each node station can fairly acquire transmission rights regardless of its physical location.
本発明によれば、１つのクロツクステーシヨン
と複数のノードステーシヨンより構成され、前記
クロツクステーシヨンがループ一巡の信号伝搬時
間より長い一定周期で同期信号をループに送出
し、前記ノードステーシヨンは、前記同期信号の
通過後前記ループのアイドル状態を検出すること
により送信権を獲得し信号ブロツクを送出するル
ープネツトワークにおけるループアクセス方式に
おいて、
前記ノードステーシヨンは、ある周期で送信を
中断して終了した場合あるいは送信権を獲得でき
なかつた場合、送信継続要求信号を送出し、前記
クロツクステーシヨンは前記送信継続要求信号を
受信した場合次の周期においては送信再開信号を
送出し、前記送信継続要求信号を送出したノード
ステーシヨンのみ前記送信再開信号にもとづき送
信権を獲得することを特徴とするループアクセス
方式が得られる。 According to the present invention, the clock station is composed of one clock station and a plurality of node stations, and the clock station sends a synchronization signal to the loop at a constant period longer than the signal propagation time for one round of the loop, and the node station In a loop access method in a loop network in which a transmission right is acquired by detecting an idle state of the loop after a synchronization signal has passed and a signal block is sent out, the node station interrupts transmission at a certain period and terminates transmission. Alternatively, if the transmission right cannot be acquired, a transmission continuation request signal is sent, and when the clock station receives the transmission continuation request signal, it transmits a transmission resume signal in the next cycle, and the transmission continuation request signal is transmitted. A loop access method is obtained in which only the sending node station acquires the transmission right based on the transmission resume signal.
次に図面を参照しながら本発明を詳細に説明す
る。第１図は本発明におけるループネツトワーク
の構成を示す。第１図のループネツトワークはノ
ードステーシヨン１，２，３，４，５，６及びク
ロツクステーシヨン７とから構成され、これらは
ループ８により接続されている。第２図はノード
ステーシヨン４の出力端子におけるループ８の信
号を示す図であり、第３図は本実施例に用いる信
号ブロツクの構成を示す。第３図ａはクロツクス
テーシヨン７が送出する信号ブロツクの構成及び
送信要求継続信号の構成を、同図ｂはノードステ
ーシヨン間通信のための信号ブロツクの構成を示
す。第３図において、PRはプリアンプル、SFは
開始フラグ、SYは同期ビツド、M0、M1は通信
モードを与える制御ビツト、EFは終了フラグ、
DAはあて先アドレス、SAは発信者アドレス、
INFOは情報フイールドを示す。 Next, the present invention will be explained in detail with reference to the drawings. FIG. 1 shows the configuration of a loop network in the present invention. The loop network of FIG. 1 consists of node stations 1, 2, 3, 4, 5, 6 and clock station 7, which are connected by a loop 8. FIG. 2 is a diagram showing the signal of the loop 8 at the output terminal of the node station 4, and FIG. 3 shows the configuration of the signal block used in this embodiment. FIG. 3a shows the structure of a signal block sent by the clock station 7 and the structure of a transmission request continuation signal, and FIG. 3b shows the structure of a signal block for communication between node stations. In Figure 3, PR is the preamble, SF is the start flag, SY is the synchronization bit, M0 and M1 are the control bits that specify the communication mode, EF is the end flag,
DA is the destination address, SA is the sender address,
INFO indicates an information field.
クロツクステーシヨン７は一定周期Toで同期
信号Ｆをループ８に送出する。同期信号Ｆは第３
図ａの構成を有し、ビツトSY＝１、ビツトM0＝
０、M1＝０となつている。各ノードステーシヨ
ンはビツトSY＝１を検出するとそれぞれのタイ
マをリセツトすると共にビツトM0＝M1＝０を検
出し、同期通信例えば音声通信の送信権を有して
いるノードステーシヨンは、それぞれの信号ブロ
ツクを送出する。ノードステーシヨン１，２がこ
の送信権を有しているとすると、第２図に示すよ
うに同期信号Ｆにひきつづいて信号ブロツクB1，
B2がループ８に供給される。この信号ブロツク
は第３図ｂの構成を有しビツト、SY＝０となり、
ビツトM0、M1は同期信号Ｆと同じで共に０であ
る。クロツクステーシヨン７は一巡してきた同期
信号Ｆをループ８より除去すると共に信号ブロツ
クB1，B2の通過後送信権を獲得し、非同期通信
を起動するトリガ信号Ｍを送出する。トリガ信号
Ｍは第３図ａの構成を有し、ビツトSY＝０、ビ
ツトM0＝０、M1＝１となつている。今、ノード
ステーシヨン３，４，５にこの通信フエーズの送
信要求が生じたとする。第２図に示すようにトリ
ガ信号Ｍにひきつづいてノードステーシヨン３は
信号ブロツクB3を送出しノードステーシヨン４
は信号ブロツクB4を信号ブロツクB3にひきつづ
き送出する。これらの信号ブロツクは第３図ｂの
構成を有しビツトSY、M0、M1はトリガ信号Ｍ
のそれと同じである。ノードステーシヨン４にお
いて、信号ブロツクB4の送出中にその周期にお
ける送信可能時間T1が経過したとする。ノード
ステーシヨン４はこの時間T1の経過を知ると送
信を終了すると共に送信継続要求信号Ｒを送出す
る。この要求信号Ｒは第３図ａの構成を有しビツ
トSY＝０、ビツトM0＝１、M1＝０となつてい
る。ノードステーシヨン５は、送信権を獲得する
前に時間T1が経過したので自分の信号ブロツク
を送出するための送信権獲得制御は停止するもの
の送信継続要求信号Ｒを送出するために送信権獲
得制御は続行する。しかし、ノードステーシヨン
４からの要求信号Ｒの通過を検出するとこの送信
権獲得制御も停止する。クロツクステーシヨン７
はノードステーシヨン４からの要求信号Ｒを受信
すると次の周期においては、同期信号Ｆにより起
動される通信の終了後トリガ信号Ｍの代わりに送
信再開信号Ｓを送出する。送信再開信号Ｓは第３
図ａの構成を有しビツトSY＝０、ビツトM0＝
M1＝１となつている。この送信再開信号Ｓは前
の周期で要求信号Ｒを送出したノードステーシヨ
ンのみ、この場合ノードステーシヨン４のみトリ
ガする。ノードステーシヨン４は送信再開信号Ｓ
の通過後信号ブロツクB4を送出する。この信号
ブロツクB4はビツトM0＝０、M1＝１なので、
ノードステーシヨン５はこの信号ブロツクの通過
後送信権獲得制御を開始し、そして送信権を獲得
する。 Clock station 7 sends a synchronizing signal F to loop 8 at a constant period To. The synchronization signal F is the third
It has the configuration shown in figure a, bit SY=1, bit M0=
0, M1=0. When each node station detects bit SY = 1, it resets its respective timer and also detects bit M0 = M1 = 0, and the node station that has the right to transmit synchronous communication, such as voice communication, transmits its respective signal block. Send. Assuming that the node stations 1 and 2 have this transmission right, the synchronization signal F is followed by the signal blocks B 1 , 2 as shown in FIG.
B 2 is fed into loop 8. This signal block has the configuration shown in FIG. 3b, and the bit, SY=0,
Bits M0 and M1 are the same as the synchronizing signal F and are both 0. The clock station 7 removes the synchronous signal F that has made one cycle from the loop 8, acquires the transmission right after passing through the signal blocks B 1 and B 2 , and sends out a trigger signal M for starting asynchronous communication. Trigger signal M has the configuration shown in FIG. 3a, with bit SY=0, bit M0=0, and M1=1. Now, assume that node stations 3, 4, and 5 receive a request to transmit this communication phase. As shown in FIG. 2, following the trigger signal M, the node station 3 sends out a signal block B3 to the node station 4.
sends out signal block B4 following signal block B3 . These signal blocks have the configuration shown in Figure 3b, and bits SY, M0, M1 are the trigger signal M.
It is the same as that of Assume that in the node station 4, the transmittable time T1 in the period has elapsed while the signal block B4 was being transmitted. When the node station 4 learns that this time T1 has elapsed, it ends the transmission and sends out a transmission continuation request signal R. This request signal R has the configuration shown in FIG. 3a, with bit SY=0, bit M0=1, and M1=0. Since the time T1 has elapsed before the node station 5 acquires the transmission right, the node station 5 stops the transmission right acquisition control for transmitting its own signal block, but continues the transmission right acquisition control for transmitting the transmission continuation request signal R. continues. However, when the passage of the request signal R from the node station 4 is detected, this transmission right acquisition control also stops. clock station 7
When receiving the request signal R from the node station 4, in the next cycle, after the communication initiated by the synchronization signal F ends, it sends out a transmission restart signal S instead of the trigger signal M. The transmission restart signal S is the third
It has the configuration shown in figure a, bit SY=0, bit M0=
M1=1. This transmission restart signal S triggers only the node station that sent the request signal R in the previous cycle, in this case only the node station 4. The node station 4 sends a transmission resume signal S
After passing through, the signal block B4 is sent out. This signal block B4 has bits M0=0 and M1=1, so
After passing this signal block, the node station 5 starts transmission right acquisition control and acquires the transmission right.
ノードステーシヨン４の送信終了後ノードステ
ーシヨン５が送信権を獲得する前に時間T1が経
過した場合は、ノードステーシヨン４は要求信号
Ｒを送出しないので、ノードステーシヨン５が送
信権を獲得した時要求信号Ｒを送出する。この場
合、次の周期の非同期通信は、送信再開信号Ｒに
もとずきノードステーシヨン５から開始される。 If time T1 has elapsed after node station 4 finishes transmitting and before node station 5 acquires the right to transmit, node station 4 will not send the request signal R, so when node station 5 acquires the right to transmit, it will not send the request signal. Send signal R. In this case, the next period of asynchronous communication is started from the node station 5 based on the transmission restart signal R.
次に各ノードステーシヨン及びクロツクステー
シヨン７のループインタフエイス部における動作
について第４図及び第５図を用いて説明する。第
４図に示す各ノードステーシヨンのループインタ
フエイス部はループ８に接続された入力端子１
０、出力端子１１を有しバツフア１２、制御回路
１３、信号検出回路１４、受信バツフア１５、タ
イマ１７、送信バツフア１８とから構成されてい
る。非送信状態においては、入力端子１０に供給
される信号ブロツクはバツフア１２、スイツチ３
０を経て出力端子１１に出力される。信号検出回
路１４は受信される信号ブロツクのプリアンプル
PR、開始フラグSF、ビツトSY、M0、M1、終
了フラグ、あて先アドレスDA及び発信者アドレ
スSAを検出し、ビツトSY＝１によりタイマ１７
をリセツトすると共にその他の検出結果を制御回
路１３に通知する。非同期通信の送信要求が生じ
た場合、制御回路１３は送出すべき信号ブロツク
を送信バツフア１８に格納し、信号検出回路１４
の検出結果にもとずき、ビツトM0＝０、M1＝１
の信号ブロツクの終了フラグEFが通過した時、
制御信号131によりスイツチ３０を送信バツフア
１８側にオンにし、プリアンプルPRを出力端子
１１に送出する。このプリアンプルPRの送出中
に信号検出回路１３がプリアンプルPRを検出し
た場合即ち上流のノードステーシヨンからの信号
ブロツクが入力端子１０に供給された場合は、制
御回路１３はただちに送信を停止しスイツチ３０
をループ８側にもどす。そして、次の終了フラグ
EFの通過を待つて上記の制御をくり返す。そし
て、プリアンプルPRの送出中に信号検出回路１
４がプリアンプルPRを検出しない場合は送信権
を獲得し送信バツフア内の信号ブロツクを送出す
る。この信号ブロツクの送出中にタイマ１７が時
間T1の経過を通知してきた場合は、制御回路１
３は、この送出を終了すると共に、要求信号Ｒを
送信バツフア１８に格納し送出する。そして、信
号検出回路１４が終了フラグEFを検出ときスイ
ツチ３０をループ８側にもどす。従つて、信号ブ
ロツクは発信ノードステーシヨンにおいてループ
８より除去される。上記の送信権の獲得制御中
に、タイマ１７が時間T1の経過を通知してきた
場合は、制御回路１３は信号検出回路１４が要求
信号Ｒの通過を即ちビツトＭ０＝１、M1＝０を
検出した時、送信権獲得制御を停止する。要求信
号Ｒを通過しない場合は送信権獲得制御を続行
し、送信権を獲得したとき要求信号Ｒを送出す
る。 Next, the operation of the loop interface section of each node station and clock station 7 will be explained with reference to FIGS. 4 and 5. The loop interface section of each node station shown in FIG. 4 has input terminal 1 connected to loop 8.
0, an output terminal 11, a buffer 12, a control circuit 13, a signal detection circuit 14, a reception buffer 15, a timer 17, and a transmission buffer 18. In the non-transmitting state, the signal block supplied to the input terminal 10 is connected to the buffer 12 and the switch 3.
0 and is output to the output terminal 11. The signal detection circuit 14 detects the preamble of the received signal block.
PR, start flag SF, bits SY, M0, M1, end flag, destination address DA and sender address SA are detected, and timer 17 is set by bit SY=1.
and notifies the control circuit 13 of other detection results. When a transmission request for asynchronous communication occurs, the control circuit 13 stores the signal block to be transmitted in the transmission buffer 18, and the signal detection circuit 14 stores the signal block to be transmitted in the transmission buffer 18.
Based on the detection result, bit M0=0, M1=1
When the end flag EF of the signal block passes,
The control signal 131 turns on the switch 30 to the transmission buffer 18 side, and sends out the preamble PR to the output terminal 11. If the signal detection circuit 13 detects the preamble PR while transmitting the preamble PR, that is, if a signal block from the upstream node station is supplied to the input terminal 10, the control circuit 13 immediately stops the transmission and switches on the switch. 30
Return to the loop 8 side. And the following exit flag
Wait for EF to pass and repeat the above control. Then, during the transmission of the preamble PR, the signal detection circuit 1
If 4 does not detect the preamble PR, it acquires the transmission right and sends out the signal block in the transmission buffer. If the timer 17 notifies the passage of time T1 while this signal block is being sent, the control circuit 1
3 finishes this transmission, stores the request signal R in the transmission buffer 18, and transmits it. Then, when the signal detection circuit 14 detects the end flag EF, the switch 30 is returned to the loop 8 side. The signal block is therefore removed from loop 8 at the originating node station. During the transmission right acquisition control described above, if the timer 17 notifies the passage of time T1 , the control circuit 13 causes the signal detection circuit 14 to detect the passing of the request signal R, that is, to set bits M0=1 and M1=0. When detected, transmission right acquisition control is stopped. If the request signal R is not passed, the transmission right acquisition control is continued, and when the transmission right is acquired, the request signal R is sent out.
なお、信号ブロツクの受信は、信号検出回路１
４より供給されるあて先アドレスが自己のアドレ
スと一致した時制御回路１３が受信バツフア１５
を起動することにより行なう。 Note that the reception of the signal block is performed by the signal detection circuit 1.
When the destination address supplied from 4 matches its own address, the control circuit 13 sends the reception buffer 15
This is done by starting .
第５図のクロツクステーシヨンはループ８に接
続された入力端子２０、出力端子２１を有すると
共に、バツフア２２、信号検出回路２４、制御回
路２３、タイマ２７、送信バツフア２８及びスイ
ツチ３１とから構成される。タイマ２７は周期
Toで送信バツフア２８内の信号ブロツクのビツ
トSYを１にすると共に、時間情報を制御回路２
３に供給する。制御回路２３はこの時間情報にも
とずき、送信バツフア２８内の信号ブロツクのビ
ツトM0、M1を共に０にし、同期信号Ｆとしてス
イツチ３１を介し出力端子２１に送出する。スイ
ツチ３１は制御信号231により送出に先立つて送
信バツフア２８にオンにされる。制御回路２３
は、ビツトM0＝M1＝０の信号ブロツクの終了フ
ラグEFを信号検出回路２４が検出したとき、ス
イツチ３１をループ８側にもどす。従つて、同期
信号Ｆはクロツクステーシヨンにおいてループ一
巡後除去される。信号検出回路２４がビツトM0
＝１、M1＝０の要求信号Ｒを検出した場合は、
制御回路２３は、同期信号Ｆがループ８を一巡し
た後送信権を獲得すると、ビツトM0＝０、M1＝
１のトリガ信号Ｍの代わりにビツトM0＝１、M1
＝１の送信再開信号Ｓを送出し、他のノードステ
ーシヨンに先立つて要求信号Ｒを送出したノード
ステーシヨンに対し送信権を与える。 The clock station shown in FIG. 5 has an input terminal 20 and an output terminal 21 connected to a loop 8, and also includes a buffer 22, a signal detection circuit 24, a control circuit 23, a timer 27, a transmission buffer 28, and a switch 31. Ru. Timer 27 has a period
At To, bit SY of the signal block in the transmission buffer 28 is set to 1, and the time information is transferred to the control circuit 2.
Supply to 3. Based on this time information, the control circuit 23 sets both bits M0 and M1 of the signal block in the transmission buffer 28 to 0, and sends it to the output terminal 21 via the switch 31 as a synchronizing signal F. Switch 31 is turned on by control signal 231 to transmit buffer 28 prior to transmission. Control circuit 23
When the signal detection circuit 24 detects the end flag EF of the signal block with bits M0=M1=0, the switch 31 is returned to the loop 8 side. Therefore, the synchronization signal F is removed after one loop at the clock station. The signal detection circuit 24 detects bit M0
If the request signal R with =1 and M1 = 0 is detected,
When the control circuit 23 acquires the transmission right after the synchronization signal F goes around the loop 8, the control circuit 23 sets bits M0=0 and M1=
Bit M0 = 1 instead of trigger signal M of 1, M1
=1, and the node station that sent the request signal R before other node stations is given the transmission right.
ある周期で要求信号Ｒを送出したノードステー
シヨンは、第４図において、信号検出回路１４が
送信再開信号Ｓの通過を検出するとスイツチ３０
を送信バツフア１８側にオンにしビツトM0＝０、
M1＝１にして信号ブロツクの送出を行なう。 In FIG. 4, the node station that has sent out the request signal R in a certain period switches on the switch 30 when the signal detection circuit 14 detects passage of the transmission restart signal S.
Turn on the transmit buffer 18 side and set bit M0=0,
Set M1=1 and transmit the signal block.
このように本発明によれば、周期T0でノード
ステーシヨン間通信が中断されても、次の周期に
おいては中断されたノードステーシヨンあるいは
送信権を獲得できなかつたノードステーシヨンが
優先して送信権を獲得することができ、各ノード
ステーシヨンはその物理的位置により不公平にな
ることはなく円滑な通信を提供するとこができ
る。 As described above, according to the present invention, even if inter-node station communication is interrupted in cycle T 0 , the interrupted node station or the node station that was unable to acquire the transmission right will receive the transmission right with priority in the next cycle. Each node station can provide smooth communication without being unfair due to its physical location.
第１図は本発明のループネツトワークの構成を
示すブロツク図、第２図はループ上の信号を示す
図、第３図は本発明の実施例に用いる信号ブロツ
クを示す図、第４図及び第５図は本実施例に用い
るノードステーシヨン及びクロツクステーシヨン
のループインタフエイス部を示すブロツク図であ
る。
図において、１，２，３，４，５，６はノード
ステーシヨン、７はクロツクステーシヨン、８は
ループ、１２，１５，１８，２２，２８はバツフ
ア、１３，２３は制御回路、１４，２４は信号検
出回路、１７，２７はタイマ、３０，３１はスイ
ツチを示す。
FIG. 1 is a block diagram showing the configuration of the loop network of the present invention, FIG. 2 is a diagram showing signals on the loop, FIG. 3 is a diagram showing signal blocks used in the embodiment of the present invention, and FIGS. FIG. 5 is a block diagram showing the loop interface section of the node station and clock station used in this embodiment. In the figure, 1, 2, 3, 4, 5, 6 are node stations, 7 is a clock station, 8 is a loop, 12, 15, 18, 22, 28 are buffers, 13, 23 are control circuits, 14, 24 1 is a signal detection circuit, 17 and 27 are timers, and 30 and 31 are switches.
Claims (1)
ステーシヨンより構成され、前記クロツクステー
シヨンがループ一巡の信号伝搬時間より長い一定
周期で同期信号をループに送出し、前記ノードス
テーシヨンは、前記同期信号の通過後前記ループ
のアイドル状態を検出することにより送信権を獲
得し信号ブロツクを送出するループネツトワーク
におけるループアクセス方式において、 前記ノードステーシヨンは、ある周期で送信を
中断して終了した場合あるいは送信権を獲得でき
なかつた場合、送信継続要求信号を送出し、前記
クロツクステーシヨンは前記送信継続要求信号を
受信した場合次の周期においては送信再開信号を
送出し、前記送信継続要求信号を送出したノード
ステーシヨンのみ前記送信再開信号にもとづき送
信権を獲得することを特徴とするループアクセス
方式。[Scope of Claims] 1. Consisting of one clock station and a plurality of node stations, the clock station sends a synchronization signal to the loop at a constant period longer than the signal propagation time for one round of the loop, and the node station: In a loop access method in a loop network, in which a transmission right is acquired by detecting an idle state of the loop after the synchronization signal has passed, and a signal block is sent out, the node station interrupts transmission at a certain period and terminates the transmission. If the clock station receives the transmission continuation request signal or if the transmission right cannot be acquired, it transmits a transmission continuation request signal, and when the clock station receives the transmission continuation request signal, it transmits a transmission resume signal in the next cycle, and the transmission continuation request signal is transmitted. A loop access system characterized in that only the node station that transmitted the transmission signal acquires the transmission right based on the transmission resume signal.
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5544083A JPS59181845A (en) | 1983-03-31 | 1983-03-31 | Loop access system |
| CA000442460A CA1201784A (en) | 1982-12-03 | 1983-12-02 | Loop network system controlled by a simple clock station |
| DE8383112151T DE3382313D1 (en) | 1982-12-03 | 1983-12-02 | RING NETWORK CONTROLLED BY A SIMPLE CLOCK STATION. |
| EP83112151A EP0111277B1 (en) | 1982-12-03 | 1983-12-02 | Loop network system controlled by a simple clock station |
| US06/824,035 US4627051A (en) | 1982-12-03 | 1986-01-30 | Loop network system controlled by a simple clock station |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5544083A JPS59181845A (en) | 1983-03-31 | 1983-03-31 | Loop access system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59181845A JPS59181845A (en) | 1984-10-16 |
| JPH0550178B2 true JPH0550178B2 (en) | 1993-07-28 |
Family
ID=12998650
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5544083A Granted JPS59181845A (en) | 1982-12-03 | 1983-03-31 | Loop access system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59181845A (en) |
-
1983
- 1983-03-31 JP JP5544083A patent/JPS59181845A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59181845A (en) | 1984-10-16 |
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