JPH053433A - Ｐｌｌシンセサイザ回路 - Google Patents
Ｐｌｌシンセサイザ回路Info
- Publication number
- JPH053433A JPH053433A JP3152793A JP15279391A JPH053433A JP H053433 A JPH053433 A JP H053433A JP 3152793 A JP3152793 A JP 3152793A JP 15279391 A JP15279391 A JP 15279391A JP H053433 A JPH053433 A JP H053433A
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- JP
- Japan
- Prior art keywords
- frequency
- section
- resonance
- output
- controlled oscillator
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
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- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Abstract
(57)【要約】
【目的】外来ノイズに強くすると共に、発振周波数範囲
の設定を不要とする。 【構成】基準周波発振器で基準周波数の基準信号を発生
する。入力電圧に応じて出力信号の周波数が可変する電
圧制御発振器の出力を分周器で分周する。基準信号の位
相と分周器の出力の位相とを位相比較器で比較する。位
相比較器の出力からローパスフィルタで低周波成分を抽
出して電圧制御発振器に入力する。バリキャップＤ1 と
表面弾性波共振子Ｆ1 とを用いて電圧制御発振器３の共
振部３１を構成する。
の設定を不要とする。 【構成】基準周波発振器で基準周波数の基準信号を発生
する。入力電圧に応じて出力信号の周波数が可変する電
圧制御発振器の出力を分周器で分周する。基準信号の位
相と分周器の出力の位相とを位相比較器で比較する。位
相比較器の出力からローパスフィルタで低周波成分を抽
出して電圧制御発振器に入力する。バリキャップＤ1 と
表面弾性波共振子Ｆ1 とを用いて電圧制御発振器３の共
振部３１を構成する。
Description
【０００１】
【産業上の利用分野】本発明は、ＰＬＬシンセサイザ回
路、特にその構成要素としての電圧制御発振回路の改良
に関するものである。
路、特にその構成要素としての電圧制御発振回路の改良
に関するものである。
【０００２】
【従来の技術】ＰＬＬシンセサイザ回路は、例えば無線
通信装置における送信器の搬送波発生回路や、受信器の
局部発振回路等に用いられている。この種のＰＬＬシン
セサイザ回路の一構成例を図３に示す。このＰＬＬシン
セサイザ回路は、位相比較器１と、ローパスフィルタ
（以下、ＬＰＦと略記する）２と、電圧制御発振器（以
下、ＶＣＯと略記する）３と、分周器４と、基準周波発
振器５とで構成してある。さらに分周器４は、プリスケ
ーラ４１と分周回路４２とで構成し、基準周波発振器５
は、水晶振動子Ｘを用いて構成した基準周波発振回路５
１と分周回路５２とで構成してある。
通信装置における送信器の搬送波発生回路や、受信器の
局部発振回路等に用いられている。この種のＰＬＬシン
セサイザ回路の一構成例を図３に示す。このＰＬＬシン
セサイザ回路は、位相比較器１と、ローパスフィルタ
（以下、ＬＰＦと略記する）２と、電圧制御発振器（以
下、ＶＣＯと略記する）３と、分周器４と、基準周波発
振器５とで構成してある。さらに分周器４は、プリスケ
ーラ４１と分周回路４２とで構成し、基準周波発振器５
は、水晶振動子Ｘを用いて構成した基準周波発振回路５
１と分周回路５２とで構成してある。
【０００３】このＰＬＬシンセサイザ回路では、基準周
波発振回路５１の出力を分周回路５２で分周して基準周
波数ｆS の信号を作成する。位相比較器１では、この基
準周波数ｆS の信号を基準として、この基準信号と分周
器４の出力との位相比較を行う。この位相比較器１の出
力はＬＰＦ２を通して低周波成分を抽出する。この低周
波成分が与えられるＶＣＯ３では、低周波成分に応じた
発振周波数ｆC の信号を出力する。この周波数ｆC の出
力信号をプリスケーラ４１でＮ1 分周し、さらに分周回
路４２でＮ2 分周した分周出力を位相比較器１に入力す
る。
波発振回路５１の出力を分周回路５２で分周して基準周
波数ｆS の信号を作成する。位相比較器１では、この基
準周波数ｆS の信号を基準として、この基準信号と分周
器４の出力との位相比較を行う。この位相比較器１の出
力はＬＰＦ２を通して低周波成分を抽出する。この低周
波成分が与えられるＶＣＯ３では、低周波成分に応じた
発振周波数ｆC の信号を出力する。この周波数ｆC の出
力信号をプリスケーラ４１でＮ1 分周し、さらに分周回
路４２でＮ2 分周した分周出力を位相比較器１に入力す
る。
【０００４】上記閉ループで、出力が入力に帰還され、
ＰＬＬシンセサイザ回路は基準信号の位相と分周出力と
の位相とを一致させるように動作し、位相が一致して出
力信号の周波数が固定された状態であるいわゆるロック
状態において、出力信号の周波数ｆC はｆS ×Ｎ1 ×Ｎ
2 となる。上記ＶＣＯ３の具体構成を図４に示す。この
ＶＣＯ３では、ＬＣ共振部３１’とトランジスタＱ1 を
用いたエミッタホロア構成の増幅部とからなる。ここ
で、ＬＣ共振部３１’は、コイルＬ1 ，コンデンサ
Ｃ1 、容量調節型のコンデンサＣ 2 及びバリキャップＤ
1 で構成してあり、ＬＰＦ２から与えられる低周波成分
でバリキャップＤ1 の容量成分が可変されることにより
共振周波数が変化し、ＶＣＯ３の出力の周波数ｆC が変
化する。
ＰＬＬシンセサイザ回路は基準信号の位相と分周出力と
の位相とを一致させるように動作し、位相が一致して出
力信号の周波数が固定された状態であるいわゆるロック
状態において、出力信号の周波数ｆC はｆS ×Ｎ1 ×Ｎ
2 となる。上記ＶＣＯ３の具体構成を図４に示す。この
ＶＣＯ３では、ＬＣ共振部３１’とトランジスタＱ1 を
用いたエミッタホロア構成の増幅部とからなる。ここ
で、ＬＣ共振部３１’は、コイルＬ1 ，コンデンサ
Ｃ1 、容量調節型のコンデンサＣ 2 及びバリキャップＤ
1 で構成してあり、ＬＰＦ２から与えられる低周波成分
でバリキャップＤ1 の容量成分が可変されることにより
共振周波数が変化し、ＶＣＯ３の出力の周波数ｆC が変
化する。
【０００５】
【発明が解決しようとする課題】ところで、ＬＣ共振回
路を用いたＶＣＯ３であると、外来ノイズに弱く、この
ため外来ノイズを遮蔽するために、シールドケースを用
いてシールドを施す必要があった。しかも、発振周波数
範囲を、容量調節型のコンデンサＣ2 の容量を調整して
設定する必要があった。
路を用いたＶＣＯ３であると、外来ノイズに弱く、この
ため外来ノイズを遮蔽するために、シールドケースを用
いてシールドを施す必要があった。しかも、発振周波数
範囲を、容量調節型のコンデンサＣ2 の容量を調整して
設定する必要があった。
【０００６】本発明は上述の点に鑑みて為されたもので
あり、その目的とするところは、外来ノイズに強く、且
つ発振周波数範囲を設定する必要がないＰＬＬシンセサ
イザ回路を提供することにある。
あり、その目的とするところは、外来ノイズに強く、且
つ発振周波数範囲を設定する必要がないＰＬＬシンセサ
イザ回路を提供することにある。
【０００７】
【課題を解決するための手段】本発明では、上記目的を
達成するために、可変リアクタス素子と表面弾性波共振
子とを用いて電圧制御発振器の共振部を構成してある。
達成するために、可変リアクタス素子と表面弾性波共振
子とを用いて電圧制御発振器の共振部を構成してある。
【０００８】
【作用】本発明は、上述のように表面弾性波共振子を用
いて電圧制御発振器の共振部を構成することにより、表
面弾性波共振子の持つ高いＱのために不要信帯の信号を
極度に減衰させることができるようにし、外来ノイズに
対して強くなるようにし、しかも予め表面弾性波共振子
を設計する段階で発振周波数範囲を限定しておけば、発
振周波数範囲の設定が不要となるようにしたものであ
る。
いて電圧制御発振器の共振部を構成することにより、表
面弾性波共振子の持つ高いＱのために不要信帯の信号を
極度に減衰させることができるようにし、外来ノイズに
対して強くなるようにし、しかも予め表面弾性波共振子
を設計する段階で発振周波数範囲を限定しておけば、発
振周波数範囲の設定が不要となるようにしたものであ
る。
【０００９】
【実施例】図１及び図２に本発明の一実施例を示す。本
実施例ではＰＬＬシンセサイザ回路のＶＣＯ３の構成に
特徴が有するものである。図１にそのＶＣＯ３の具体構
成を示す。本実施例ではＶＣＯ３の増幅部をデュアルゲ
ートのＭＯＳＦＥＴＱ2 を用いて構成してあり、共振部
３１を、可変リアクタス素子としてのバリキャップＤ1
と、表面弾性波共振子（以下、ＳＡＷフィルタと呼ぶ）
Ｆ1 と、コイルＬ2 ，Ｌ3 とで構成してある。なお、本
実施例の場合には２ポートのＳＡＷフィルタＦ1 を用い
てあるが、１ポートのものを用いて構成してもよい。
実施例ではＰＬＬシンセサイザ回路のＶＣＯ３の構成に
特徴が有するものである。図１にそのＶＣＯ３の具体構
成を示す。本実施例ではＶＣＯ３の増幅部をデュアルゲ
ートのＭＯＳＦＥＴＱ2 を用いて構成してあり、共振部
３１を、可変リアクタス素子としてのバリキャップＤ1
と、表面弾性波共振子（以下、ＳＡＷフィルタと呼ぶ）
Ｆ1 と、コイルＬ2 ，Ｌ3 とで構成してある。なお、本
実施例の場合には２ポートのＳＡＷフィルタＦ1 を用い
てあるが、１ポートのものを用いて構成してもよい。
【００１０】このＶＣＯ３では増幅部３２の出力を上記
共振部３１を介して増幅部３２の入力に正帰還すること
により発振動作し、この際の発振周波数が共振部３１の
共振周波数で決まる。そして、周波数の可変はバリキャ
ップＤ1 への印加電圧、つまりはＬＰＦ２の出力で行わ
れる。本実施例の場合には上記共振部３１をＱの高いＳ
ＡＷフィルタＦ1 を用いて構成してあるために、極めて
信号帯域を狭くすることができ（但し、極めて信号帯域
を狭いという意味は、必要帯域は確保し、不要信号帯域
を大幅に減衰できるという意味であり、ＬＣ共振回路の
ように不要に信号帯域が広くならないということを意味
する）、このため外来ノイズ等の影響を受けにくくで
き、従って従来のように外来ノイズの影響を防止するた
めに、シールドケースで共振部３１を覆うといったこと
を必要としない。しかも、ＳＡＷフィルタＦ1 を用いる
と、素子の設計段階で発振周波数を限定することがで
き、このため従来のＬＣ共振回路を用いた回路のように
発振周波数範囲の設定を行う必要はない。
共振部３１を介して増幅部３２の入力に正帰還すること
により発振動作し、この際の発振周波数が共振部３１の
共振周波数で決まる。そして、周波数の可変はバリキャ
ップＤ1 への印加電圧、つまりはＬＰＦ２の出力で行わ
れる。本実施例の場合には上記共振部３１をＱの高いＳ
ＡＷフィルタＦ1 を用いて構成してあるために、極めて
信号帯域を狭くすることができ（但し、極めて信号帯域
を狭いという意味は、必要帯域は確保し、不要信号帯域
を大幅に減衰できるという意味であり、ＬＣ共振回路の
ように不要に信号帯域が広くならないということを意味
する）、このため外来ノイズ等の影響を受けにくくで
き、従って従来のように外来ノイズの影響を防止するた
めに、シールドケースで共振部３１を覆うといったこと
を必要としない。しかも、ＳＡＷフィルタＦ1 を用いる
と、素子の設計段階で発振周波数を限定することがで
き、このため従来のＬＣ共振回路を用いた回路のように
発振周波数範囲の設定を行う必要はない。
【００１１】本実施例の具体的な使用例を図２に示す。
図２の場合には、ＦＳＫ変調をかけた搬送波を発生する
搬送波発生回路を構成した場合のＶＣＯ３の要部構成を
示すもので、図１におけるバリキャップＤ1 とコイルＬ
2との間に、さらにリアクタス素子Ｒｅを挿入すると共
に、このリアクタンス素子Ｒｅの両端に半導体からなる
スイッチ要素ＳＷ1 を接続し、スイッチ要素ＳＷ1 をオ
ン，オフさせることによりマークとスペースとの２種の
周波数の信号を発生させて、搬送周波数にＦＳＫ変調を
かけるようにしたものである。
図２の場合には、ＦＳＫ変調をかけた搬送波を発生する
搬送波発生回路を構成した場合のＶＣＯ３の要部構成を
示すもので、図１におけるバリキャップＤ1 とコイルＬ
2との間に、さらにリアクタス素子Ｒｅを挿入すると共
に、このリアクタンス素子Ｒｅの両端に半導体からなる
スイッチ要素ＳＷ1 を接続し、スイッチ要素ＳＷ1 をオ
ン，オフさせることによりマークとスペースとの２種の
周波数の信号を発生させて、搬送周波数にＦＳＫ変調を
かけるようにしたものである。
【００１２】なお、本発明を受信器の局部発振器に用い
た場合、発信局数が極めて多いような状況でも、特定の
局の信号を正確且つ良好に受信することができる局部発
振器を構成することもできる。
た場合、発信局数が極めて多いような状況でも、特定の
局の信号を正確且つ良好に受信することができる局部発
振器を構成することもできる。
【００１３】
【発明の効果】本発明は上述のように、表面弾性波共振
子を用いて電圧制御発振器の共振部を構成してあるの
で、表面弾性波共振子の持つ高いＱのために不要信帯の
信号を極度に減衰させることができ、このため外来ノイ
ズに対して強くなり、外来ノイズの影響を防止するため
にシールドケースで覆うという必要がなくなる。また、
予め表面弾性波共振子を設計する段階で発振周波数範囲
を限定しておけば、発振周波数範囲の設定が不要となる
利点がある。
子を用いて電圧制御発振器の共振部を構成してあるの
で、表面弾性波共振子の持つ高いＱのために不要信帯の
信号を極度に減衰させることができ、このため外来ノイ
ズに対して強くなり、外来ノイズの影響を防止するため
にシールドケースで覆うという必要がなくなる。また、
予め表面弾性波共振子を設計する段階で発振周波数範囲
を限定しておけば、発振周波数範囲の設定が不要となる
利点がある。
【図１】本発明の一実施例の電圧制御発振器の具体構成
図である。
図である。
【図２】同上を搬送波発生回路として用いる場合の要部
構成を示す回路図である。
構成を示す回路図である。
【図３】ＰＬＬシンセサイザ回路の構成を示すブロック
図である。
図である。
【図４】従来の電圧制御発振器の具体構成図である。
３ 電圧制御発振器 ３１ 共振部 Ｄ1 バリキャップ Ｆ1 表面弾性波共振子
Claims (1)
- 【特許請求の範囲】 【請求項１】 入力電圧に応じて出力信号の周波数が可
変する電圧制御発振器と、基準周波数の基準信号を発生
する基準周波発振器と、上記電圧制御発振器の出力を分
周する分周器と、基準信号の位相と分周器の出力の位相
とを比較する位相比較器と、位相比較器の出力から低周
波成分を抽出して上記電圧制御発振器に入力するローパ
スフィルタとで少なくとも構成されたＰＬＬシンセサイ
ザ回路において、可変リアクタス素子と表面弾性波共振
子とを用いて電圧制御発振器の共振部を構成して成るこ
とを特徴とするＰＬＬシンセサイザ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3152793A JPH053433A (ja) | 1991-06-25 | 1991-06-25 | Ｐｌｌシンセサイザ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3152793A JPH053433A (ja) | 1991-06-25 | 1991-06-25 | Ｐｌｌシンセサイザ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH053433A true JPH053433A (ja) | 1993-01-08 |
Family
ID=15548273
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3152793A Withdrawn JPH053433A (ja) | 1991-06-25 | 1991-06-25 | Ｐｌｌシンセサイザ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH053433A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20040044210A (ko) * | 2002-11-19 | 2004-05-28 | 주식회사 쏘닉스 | 표면탄성파 공진기를 이용한 고주파 주파수 합성기 |
-
1991
- 1991-06-25 JP JP3152793A patent/JPH053433A/ja not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20040044210A (ko) * | 2002-11-19 | 2004-05-28 | 주식회사 쏘닉스 | 표면탄성파 공진기를 이용한 고주파 주파수 합성기 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19980903 |