JPH05323054A - 微小時間計測装置 - Google Patents
微小時間計測装置Info
- Publication number
- JPH05323054A JPH05323054A JP3245196A JP24519691A JPH05323054A JP H05323054 A JPH05323054 A JP H05323054A JP 3245196 A JP3245196 A JP 3245196A JP 24519691 A JP24519691 A JP 24519691A JP H05323054 A JPH05323054 A JP H05323054A
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- JP
- Japan
- Prior art keywords
- pulse
- time
- input
- flip
- clock pulse
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Measurement Of Unknown Time Intervals (AREA)
Abstract
(57)【要約】
【目的】計測対象時間にクロックパルスの周期より短い
端数時間が発生した場合、非線形誤差を発生することな
く高精度に未知時間を計測すること。 【構成】一方の入力をクロックパルスとするＡＮＤ回路
１と、このＡＮＤ回路１の出力パルスを計数するカウン
タ２と、ＡＮＤ回路１の他方の入力としてそのＱ出力が
利用され且そのセット入力がクロックパルスに同期した
スタートパルスである第１のＲＳ・ＦＦ３と、当該第１
のＲＳ・ＦＦ３とリセット入力を共通としストップパル
スをそのセット入力とする第２のＲＳ・ＦＦ４と、この
第２のＲＳ・ＦＦ４のＱ出力を入力とし該Ｑ出力の入力
時間を計測する端数時間計測部５と、第２のＲＳ・ＦＦ
のＱ出力を入力後クロックパルスが２回入力された時点
でＲＳ・ＦＦ３，４にリセット信号を送出する２段シフ
トレジスタ６とを備えている。
端数時間が発生した場合、非線形誤差を発生することな
く高精度に未知時間を計測すること。 【構成】一方の入力をクロックパルスとするＡＮＤ回路
１と、このＡＮＤ回路１の出力パルスを計数するカウン
タ２と、ＡＮＤ回路１の他方の入力としてそのＱ出力が
利用され且そのセット入力がクロックパルスに同期した
スタートパルスである第１のＲＳ・ＦＦ３と、当該第１
のＲＳ・ＦＦ３とリセット入力を共通としストップパル
スをそのセット入力とする第２のＲＳ・ＦＦ４と、この
第２のＲＳ・ＦＦ４のＱ出力を入力とし該Ｑ出力の入力
時間を計測する端数時間計測部５と、第２のＲＳ・ＦＦ
のＱ出力を入力後クロックパルスが２回入力された時点
でＲＳ・ＦＦ３，４にリセット信号を送出する２段シフ
トレジスタ６とを備えている。
Description
【０００１】
【産業上の利用分野】本発明は、微小時間計測装置に係
り、更に詳しくは、超音波の伝播速度を精密に計測する
計測器，例えば，ボルト中を伝播する超音波の伝播速度
を計測する超音波ボルト軸力計等に使用して好適な微小
時間計測装置に関する。
り、更に詳しくは、超音波の伝播速度を精密に計測する
計測器，例えば，ボルト中を伝播する超音波の伝播速度
を計測する超音波ボルト軸力計等に使用して好適な微小
時間計測装置に関する。
【０００２】
【背景技術】従来、超音波ボルト軸力計等における超音
波伝播時間の計測部には、図３に示すような構成のもの
が使用されている。この場合、ＡＮＤ回路２１には、未
知時間パルス，即ち，超音波の発信から受信までの時間
幅のパルスと、パルス発生器２２から出力される既知周
波数のクロックパルスとが入力され、その出力パルスを
カウンタ２３で計測することにより、未知時間Ｔx をカ
ウント値Ｎに基づき算出しようとする方法が採用されて
いた。しかし、この場合には、図４に示すような両端の
クロックパルスの周期Δｔより短い端数時間ｔ1 ，ｔ2
については、カウンタ２３ではカウントされず、未知時
間Ｔx としては、Ｔx ＝Ｎ・Δｔが算出されることとな
るが、実際には、未知時間Ｔx ＝Ｎ・Δｔ＋ｔ1 ＋ｔ2
であることは明らかであり、このため、（ｔ1 ＋ｔ2 ）
の計測誤差が発生するという不都合があった。かかる計
測誤差を小さくするためにはパルス発生器２２の発振周
波数を上げなければならないが、従来においても計測精
度を上げるため市販の仕様に適するものの内で最大の発
振周波数のパルス発生器が使用されているのが実情であ
り、これ以上発振周波数を上げることは実現が困難であ
った。
波伝播時間の計測部には、図３に示すような構成のもの
が使用されている。この場合、ＡＮＤ回路２１には、未
知時間パルス，即ち，超音波の発信から受信までの時間
幅のパルスと、パルス発生器２２から出力される既知周
波数のクロックパルスとが入力され、その出力パルスを
カウンタ２３で計測することにより、未知時間Ｔx をカ
ウント値Ｎに基づき算出しようとする方法が採用されて
いた。しかし、この場合には、図４に示すような両端の
クロックパルスの周期Δｔより短い端数時間ｔ1 ，ｔ2
については、カウンタ２３ではカウントされず、未知時
間Ｔx としては、Ｔx ＝Ｎ・Δｔが算出されることとな
るが、実際には、未知時間Ｔx ＝Ｎ・Δｔ＋ｔ1 ＋ｔ2
であることは明らかであり、このため、（ｔ1 ＋ｔ2 ）
の計測誤差が発生するという不都合があった。かかる計
測誤差を小さくするためにはパルス発生器２２の発振周
波数を上げなければならないが、従来においても計測精
度を上げるため市販の仕様に適するものの内で最大の発
振周波数のパルス発生器が使用されているのが実情であ
り、これ以上発振周波数を上げることは実現が困難であ
った。
【０００３】最近になって、上記の問題を解決するた
め、図５のような端数時間計測部により上記端数時間を
計測しようとするものが考案されている。この端数時間
計測部は、定電流源３１と、差動電流スイッチ３２と、
コンデンサ３３とＡ／Ｄコンバータ３４とを含んで構成
され、端数時間ｔ1 またはｔ2 に相当する幅のパルスを
差動電流スイッチ３２に加え、図６に示すように端数パ
ルス幅に相当する時間だけコンデンサ３３を定電流源３
１で充電し、該コンデンサ３３の出力電圧をＡ／Ｄコン
バータ３４によりＡ／Ｄ変換することによって、端数時
間ｔ1 またはｔ2を計測し、これによって精度の高い時
間計測を行なおうとするものであった。
め、図５のような端数時間計測部により上記端数時間を
計測しようとするものが考案されている。この端数時間
計測部は、定電流源３１と、差動電流スイッチ３２と、
コンデンサ３３とＡ／Ｄコンバータ３４とを含んで構成
され、端数時間ｔ1 またはｔ2 に相当する幅のパルスを
差動電流スイッチ３２に加え、図６に示すように端数パ
ルス幅に相当する時間だけコンデンサ３３を定電流源３
１で充電し、該コンデンサ３３の出力電圧をＡ／Ｄコン
バータ３４によりＡ／Ｄ変換することによって、端数時
間ｔ1 またはｔ2を計測し、これによって精度の高い時
間計測を行なおうとするものであった。
【０００４】
【発明が解決しようとする課題】上記図５の従来例によ
れば、相当高精度な時間計測が可能になったが、端数時
間ｔ1 またはｔ2 が非常に小さくなることがあり、かか
る場合、図５の回路に非常にパルス幅の小さいパルスが
加えられ、このため、回路が正常に動作し得ず計測値に
非線形の誤差が発生するおそれがあるという不都合があ
った。
れば、相当高精度な時間計測が可能になったが、端数時
間ｔ1 またはｔ2 が非常に小さくなることがあり、かか
る場合、図５の回路に非常にパルス幅の小さいパルスが
加えられ、このため、回路が正常に動作し得ず計測値に
非線形の誤差が発生するおそれがあるという不都合があ
った。
【０００５】
【発明の目的】本発明の目的は、かかる従来技術の有す
る不都合を改善し、計測対象である未知時間にクロック
パルスの周期より短い端数時間が発生した場合であって
も、これに影響されて非線形誤差を発生することなく高
精度に未知時間を計測し得る微小時間計測装置を提供す
ることにある。
る不都合を改善し、計測対象である未知時間にクロック
パルスの周期より短い端数時間が発生した場合であって
も、これに影響されて非線形誤差を発生することなく高
精度に未知時間を計測し得る微小時間計測装置を提供す
ることにある。
【０００６】
【課題を解決するための手段】本発明の微小時間計測装
置は、一方の入力を既知周波数のクロックパルスとする
論理積回路と、この論理積回路の出力パルスを計数する
カウンタと、論理積回路の他方の入力としてそのＱ出力
が利用され且そのセット入力がクロックパルスに同期し
たスタートパルスである第１のＲＳフリップフロップ
（リセット・セット・フリップフロップ）と、当該第１
のＲＳフリップフロップとリセット入力を共通としスト
ップパルスをそのセット入力とする第２のＲＳフリップ
フロップと、この第２のＲＳフリップのＱ出力を入力と
し該Ｑ出力の入力時間を計測する端数時間計測部と、第
２のＲＳフリップフロップのＱ出力を入力後クロックパ
ルスが２以上の所定の回数入力された時点で第１，第２
のＲＳフリップフロップにリセット信号を送出する端数
時間設定回路とを備えている。このような構成によっ
て、前述した目的を達成しようとするものである。
置は、一方の入力を既知周波数のクロックパルスとする
論理積回路と、この論理積回路の出力パルスを計数する
カウンタと、論理積回路の他方の入力としてそのＱ出力
が利用され且そのセット入力がクロックパルスに同期し
たスタートパルスである第１のＲＳフリップフロップ
（リセット・セット・フリップフロップ）と、当該第１
のＲＳフリップフロップとリセット入力を共通としスト
ップパルスをそのセット入力とする第２のＲＳフリップ
フロップと、この第２のＲＳフリップのＱ出力を入力と
し該Ｑ出力の入力時間を計測する端数時間計測部と、第
２のＲＳフリップフロップのＱ出力を入力後クロックパ
ルスが２以上の所定の回数入力された時点で第１，第２
のＲＳフリップフロップにリセット信号を送出する端数
時間設定回路とを備えている。このような構成によっ
て、前述した目的を達成しようとするものである。
【０００７】
【作用】クロックパルスが論理積回路の一方の入力とし
て入力されている状態において、スタートパルスが第１
のＲＳフリップフロップに入力されると、当該第１のＲ
Ｓフリップフロップがセットされ、論理積回路が作動状
態となりクロックパルスがカウンタにより計数される。
ここで、スタートパルスはクロックパルスと同期してい
るのでスタートパルス側には端数時間は生じない。そし
て、ストップパルスが第２のＲＳフリップフロップに入
力されると、該第２のＲＳフリップフロップはリセット
され、そのＱ出力が端数時間計測部と端数時間設定回路
とに入力される。これにより、端数時間計測部では、端
数時間の計測を開始する。一方、端数時間設定回路で
は、第２のＲＳフリップフロップのＱ出力の入力から上
記２以上の所定の回数クロックパルスが入力されると、
第１，第２のＲＳフリップフロップにリセット信号を送
出する。これにより、第１，第２のＲＳフリップフロッ
プがリセットされ、論理積回路が非作動状態となってカ
ウンタがカウントを停止するとともに、端数時間計測部
も端数時間の計測を終了する。このようにして、得られ
たカウンタのカウント値と端数時間計測部の計測時間と
に基づき、スタートパルスからストップパルスまでの時
間が求められる。ここで、上記の端数時間は、端数時間
設定回路により必ずクロックパルスの周期より長く設定
されるようになっている。
て入力されている状態において、スタートパルスが第１
のＲＳフリップフロップに入力されると、当該第１のＲ
Ｓフリップフロップがセットされ、論理積回路が作動状
態となりクロックパルスがカウンタにより計数される。
ここで、スタートパルスはクロックパルスと同期してい
るのでスタートパルス側には端数時間は生じない。そし
て、ストップパルスが第２のＲＳフリップフロップに入
力されると、該第２のＲＳフリップフロップはリセット
され、そのＱ出力が端数時間計測部と端数時間設定回路
とに入力される。これにより、端数時間計測部では、端
数時間の計測を開始する。一方、端数時間設定回路で
は、第２のＲＳフリップフロップのＱ出力の入力から上
記２以上の所定の回数クロックパルスが入力されると、
第１，第２のＲＳフリップフロップにリセット信号を送
出する。これにより、第１，第２のＲＳフリップフロッ
プがリセットされ、論理積回路が非作動状態となってカ
ウンタがカウントを停止するとともに、端数時間計測部
も端数時間の計測を終了する。このようにして、得られ
たカウンタのカウント値と端数時間計測部の計測時間と
に基づき、スタートパルスからストップパルスまでの時
間が求められる。ここで、上記の端数時間は、端数時間
設定回路により必ずクロックパルスの周期より長く設定
されるようになっている。
【０００８】
【実施例】以下、本発明の好適な実施例を図１ないし図
２に基づいて説明する。図１には、本発明の一実施例の
構成が示されている。この実施例は、一方の入力を既知
周波数（１０〜５０ＭＨｚ範囲の一定周波数）のクロッ
クパルスａとする論理積回路としてのＡＮＤ回路１と、
このＡＮＤ回路１の出力段に設けられ当該ＡＮＤ回路１
から出力されるパルスｇを計数するカウンタ２と、ＡＮ
Ｄ回路１の他方の入力としてそのＱ出力ｃが利用され且
そのセット入力がクロックパルスに同期したスタートパ
ルスｄである第１のＲＳフリップフロップ３と、当該第
１のＲＳフリップフロップ３とリセット入力を共通とし
ストップパルスｄをそのセット入力とする第２のＲＳフ
リップフロップ４と、この第２のＲＳフリップ４のＱ出
力ｅを入力とし該Ｑ出力ｅの入力時間を計測する端数時
間計測部５とを備えている。そして、第１，第２のＲＳ
フリップフロップ３，４のリセット側の入力段には、第
２のＲＳフリップフロップ４のＱ出力ｅを入力後クロッ
クパルスａが２回入力された時点で第１，第２のＲＳフ
リップフロップ３，４にリセット信号ｆを送出する端数
時間設定回路としての２段シフトレジスタ６が設けられ
ている。ここで、端数時間計測部５は、前述した図５と
同様に構成されているものとする。
２に基づいて説明する。図１には、本発明の一実施例の
構成が示されている。この実施例は、一方の入力を既知
周波数（１０〜５０ＭＨｚ範囲の一定周波数）のクロッ
クパルスａとする論理積回路としてのＡＮＤ回路１と、
このＡＮＤ回路１の出力段に設けられ当該ＡＮＤ回路１
から出力されるパルスｇを計数するカウンタ２と、ＡＮ
Ｄ回路１の他方の入力としてそのＱ出力ｃが利用され且
そのセット入力がクロックパルスに同期したスタートパ
ルスｄである第１のＲＳフリップフロップ３と、当該第
１のＲＳフリップフロップ３とリセット入力を共通とし
ストップパルスｄをそのセット入力とする第２のＲＳフ
リップフロップ４と、この第２のＲＳフリップ４のＱ出
力ｅを入力とし該Ｑ出力ｅの入力時間を計測する端数時
間計測部５とを備えている。そして、第１，第２のＲＳ
フリップフロップ３，４のリセット側の入力段には、第
２のＲＳフリップフロップ４のＱ出力ｅを入力後クロッ
クパルスａが２回入力された時点で第１，第２のＲＳフ
リップフロップ３，４にリセット信号ｆを送出する端数
時間設定回路としての２段シフトレジスタ６が設けられ
ている。ここで、端数時間計測部５は、前述した図５と
同様に構成されているものとする。
【０００９】次に、上記実施例の全体的な動作を図２の
タイミングチャートを参照しつつ説明する。
タイミングチャートを参照しつつ説明する。
【００１０】ＡＮＤ回路１の一方の入力端に前述したク
ロックパルスａが入力されている状態において、これと
同期したスタートパルスｂが第１のＲＳフリップフロッ
プ３に入力される（例えば、実際の超音波ボルト軸力計
等における時間計測では、この時点で超音波パルスが送
信される。）と、当該第１のＲＳフリップフロップ３が
セットされ（オンになり）、ＡＮＤ回路１の他方の入力
端に第１のＲＳフリップフロップ３のＱ出力ｃ（ハイレ
ベル信号）が入力される。これにより、ＡＮＤ回路１が
作動状態となりカウンタ２によってクロックパルスａの
計数が開始される（図２参照）。ここで、スタートパル
スｂはクロックパルスａと同期しているのでスタートパ
ルス側には端数時間は生じない（図２参照）。そして、
一定時間後ストップパルスｄが第２のＲＳフリップフロ
ップ４に入力される（ボルト軸力計では、超音波を受信
した時に相当する）と、該第２のＲＳフリップフロップ
４はセットされ、そのＱ出力である端数パルスｅが端数
時間計測部５と２段シフトレジスタ６とに入力される。
これにより、端数時間計測部５では、端数時間の計測を
開始する。一方、２段シフトレジスタ６では、端数パル
スｅの入力開始から２回クロックパルスａが入力される
と、第１，第２のＲＳフリップフロップ３，４にハイレ
ベル信号であるリセット信号ｆを送出する。これによ
り、第１，第２のＲＳフリップフロップ３，４がリセッ
トされ、ＡＮＤ回路１が非作動状態となってカウンタ２
がカウントを停止するとともに、端数時間計測部５も端
数時間の計測を終了する（端数パルスｅがローとな
る）。そして、更に２回クロックパルスａが２段シフト
レジスタ６に入力されると、該２段シフトレジスタ６の
出力ｆはローになる（図２参照）。
ロックパルスａが入力されている状態において、これと
同期したスタートパルスｂが第１のＲＳフリップフロッ
プ３に入力される（例えば、実際の超音波ボルト軸力計
等における時間計測では、この時点で超音波パルスが送
信される。）と、当該第１のＲＳフリップフロップ３が
セットされ（オンになり）、ＡＮＤ回路１の他方の入力
端に第１のＲＳフリップフロップ３のＱ出力ｃ（ハイレ
ベル信号）が入力される。これにより、ＡＮＤ回路１が
作動状態となりカウンタ２によってクロックパルスａの
計数が開始される（図２参照）。ここで、スタートパル
スｂはクロックパルスａと同期しているのでスタートパ
ルス側には端数時間は生じない（図２参照）。そして、
一定時間後ストップパルスｄが第２のＲＳフリップフロ
ップ４に入力される（ボルト軸力計では、超音波を受信
した時に相当する）と、該第２のＲＳフリップフロップ
４はセットされ、そのＱ出力である端数パルスｅが端数
時間計測部５と２段シフトレジスタ６とに入力される。
これにより、端数時間計測部５では、端数時間の計測を
開始する。一方、２段シフトレジスタ６では、端数パル
スｅの入力開始から２回クロックパルスａが入力される
と、第１，第２のＲＳフリップフロップ３，４にハイレ
ベル信号であるリセット信号ｆを送出する。これによ
り、第１，第２のＲＳフリップフロップ３，４がリセッ
トされ、ＡＮＤ回路１が非作動状態となってカウンタ２
がカウントを停止するとともに、端数時間計測部５も端
数時間の計測を終了する（端数パルスｅがローとな
る）。そして、更に２回クロックパルスａが２段シフト
レジスタ６に入力されると、該２段シフトレジスタ６の
出力ｆはローになる（図２参照）。
【００１１】このようにして、得られたカウンタ２のカ
ウント値Ｎと端数時間計測部５の計測時間ｔとに基づ
き、測定対象であるスタートパルスからストップパルス
までの時間Ｔが求められる。即ち、クロックパルスａの
周期をΔｔとすると、 Ｔ＝Ｎ×Δｔ−ｔ より、Ｔが求められる。
ウント値Ｎと端数時間計測部５の計測時間ｔとに基づ
き、測定対象であるスタートパルスからストップパルス
までの時間Ｔが求められる。即ち、クロックパルスａの
周期をΔｔとすると、 Ｔ＝Ｎ×Δｔ−ｔ より、Ｔが求められる。
【００１２】以上説明したように、本実施例によると、
端数パルスｅは、ストップパルスｄの入力と同時にハイ
となり、その後２回クロックパルスａが２段シフトレジ
スタ６に入力された後にローとなるため、ストップパル
スｄの直後に、クロックパルスａの入力があったとして
も最低クロックパルスａの１周期分のパルス幅の端数パ
ルスが発生することとなり、端数パルスのパルス幅が小
さ過ぎて端数時間計測部５が正常に動作しないため計測
値に非線形の計測誤差が発生するという不都合を確実に
防止することができ、従って、測定対象であるスタート
パルスｂからストップパルスｄまでの時間Ｔにクロック
パルスａの周期より短い端数時間が発生した場合にあっ
ても高精度に時間Ｔを計測することができる。なお、上
記実施例では、端数時間設定回路を２段シフトレジスタ
で構成する場合を例示したが、これと同等の機能は２段
Ｄ形フリップフロップでも得ることができる。
端数パルスｅは、ストップパルスｄの入力と同時にハイ
となり、その後２回クロックパルスａが２段シフトレジ
スタ６に入力された後にローとなるため、ストップパル
スｄの直後に、クロックパルスａの入力があったとして
も最低クロックパルスａの１周期分のパルス幅の端数パ
ルスが発生することとなり、端数パルスのパルス幅が小
さ過ぎて端数時間計測部５が正常に動作しないため計測
値に非線形の計測誤差が発生するという不都合を確実に
防止することができ、従って、測定対象であるスタート
パルスｂからストップパルスｄまでの時間Ｔにクロック
パルスａの周期より短い端数時間が発生した場合にあっ
ても高精度に時間Ｔを計測することができる。なお、上
記実施例では、端数時間設定回路を２段シフトレジスタ
で構成する場合を例示したが、これと同等の機能は２段
Ｄ形フリップフロップでも得ることができる。
【００１３】
【発明の効果】以上説明したように、本発明によれば、
端数時間計測部が計測する端数時間は、端数時間設定回
路により必ずクロックパルスの周期より長く設定される
ようになっていることから、計測対象である未知時間に
クロックパルスの周期より短い端数時間が発生した場合
であっても、これに影響されて非線形誤差を発生するこ
となく高精度に未知時間を計測することができるという
従来にない優れた微小時間計測装置を提供することがで
きる。
端数時間計測部が計測する端数時間は、端数時間設定回
路により必ずクロックパルスの周期より長く設定される
ようになっていることから、計測対象である未知時間に
クロックパルスの周期より短い端数時間が発生した場合
であっても、これに影響されて非線形誤差を発生するこ
となく高精度に未知時間を計測することができるという
従来にない優れた微小時間計測装置を提供することがで
きる。
【図１】本発明の一実施例の構成を示すブロック図であ
る。
る。
【図２】図１の実施例の各部の動作を示すタイミングチ
ャートである。
ャートである。
【図３ないし図６】従来例を示す説明図である。
１ 論理積回路としてのＡＮＤ回路 ２ カウンタ ３ 第１のＲＳフリップフロップ ４ 第２のＲＳフリップフロップ ５ 端数時間計測部 ６ 端数時間設定回路としての２段シフトレジスタ
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成４年１１月５日
【手続補正１】
【補正対象書類名】図面
【補正対象項目名】図２
【補正方法】変更
【補正内容】
【図２】
Claims (1)
- 【請求項１】 一方の入力を既知周波数のクロックパル
スとする論理積回路と、この論理積回路の出力パルスを
計数するカウンタと、前記論理積回路の他方の入力とし
てそのＱ出力が利用され且そのセット入力が前記クロッ
クパルスに同期したスタートパルスである第１のＲＳフ
リップフロップと、当該第１のＲＳフリップフロップと
リセット入力を共通としストップパルスをそのセット入
力とする第２のＲＳフリップフロップと、この第２のＲ
ＳフリップフロップのＱ出力を入力とし該Ｑ出力の入力
時間を計測する端数時間計測部と、前記第２のＲＳフリ
ップフロップのＱ出力を入力後前記クロックパルスが２
以上の所定の回数入力された時点で前記第１，第２のＲ
Ｓフリップフロップにリセット信号を送出する端数時間
設定回路とを備えていることを特徴とする微小時間計測
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3245196A JPH05323054A (ja) | 1991-08-30 | 1991-08-30 | 微小時間計測装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3245196A JPH05323054A (ja) | 1991-08-30 | 1991-08-30 | 微小時間計測装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05323054A true JPH05323054A (ja) | 1993-12-07 |
Family
ID=17130055
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3245196A Pending JPH05323054A (ja) | 1991-08-30 | 1991-08-30 | 微小時間計測装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05323054A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005172722A (ja) * | 2003-12-15 | 2005-06-30 | Japan Radio Co Ltd | 時刻情報パルス発生装置 |
| JP2007040742A (ja) * | 2005-08-01 | 2007-02-15 | Yokogawa Electric Corp | ジッタ測定装置 |
-
1991
- 1991-08-30 JP JP3245196A patent/JPH05323054A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005172722A (ja) * | 2003-12-15 | 2005-06-30 | Japan Radio Co Ltd | 時刻情報パルス発生装置 |
| JP2007040742A (ja) * | 2005-08-01 | 2007-02-15 | Yokogawa Electric Corp | ジッタ測定装置 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20010206 |