JPH05268042A - Solid-state relay - Google Patents

Solid-state relay

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JPH05268042A
JPH05268042A JP6158692A JP6158692A JPH05268042A JP H05268042 A JPH05268042 A JP H05268042A JP 6158692 A JP6158692 A JP 6158692A JP 6158692 A JP6158692 A JP 6158692A JP H05268042 A JPH05268042 A JP H05268042A
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JP
Japan
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diode
thyristor
gate
electrode
state relay
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JP6158692A
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Inventor
Shinichi Tanisako
伸一 谷迫
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NEC Corp
Original Assignee
NEC Corp
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Abstract

PURPOSE:To attain high speed drive of the solid-state relay employing a high frequency use MOSFET with a low input capacitance and its miniaturization. CONSTITUTION:A 3rd diode 9 connects between an anode and a cathode of a photo electromotive force element 3. When a voltage impressed to an input terminal is decreased and a light from a light emitting diode 2 starts decreasing, if an input capacitance of the MOSFET7 is small, the MOSFET7 is gradually turned off while a discharge circuit consisted with a thyristor 6 and diodes 4, 5 is inactive and the operation remarkably slows down. Thus, the high frequency M0SFET7 with a low input capacitance is driven by providing the diode 9 to cause a leakage current thereby activating the discharge circuit.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は機械的な可動部を持たず
に電気機械的なリレーの作用と同じ機能を発揮する光結
合型のソリッドステートリレーに関し、特にRF信号や
ビデオ信号などの高周波の信号を制御するソリッドステ
ートリレーに関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an optical coupling type solid state relay having the same function as that of an electromechanical relay without having any mechanical moving parts, and particularly to a high frequency signal such as an RF signal or a video signal. Solid-state relay for controlling the signal of.

【0002】[0002]

【従来の技術】従来、かかるソリッドステートリレーは
発光ダイオードと光結合素子および出力段のMOSFE
T等を備えて構成されている。
2. Description of the Related Art Conventionally, such a solid-state relay has a light emitting diode, an optical coupling element, and an output stage MOSFE.
It is configured with T and the like.

【0003】図5は従来の一例を示すソリッドステート
リレーの回路図である。図5に示すように、従来のソリ
ッドステートリレーは入力端子1,1A間に印加した電
圧により発光ダイオード2を点灯し、この発光した光に
より複数個のフォトダイオード10を縦続接続してなる
光起電力素子3に起電力を発生させる。この光起電力素
子3の両端のアノード電極およびカソード電極間にはサ
イリスタ6の両端がそれぞれ第1のダイオード4及び第
2のダイオード5を介して接続されている。また、光起
電力素子3のアノード電極と第1のダイオード4のアノ
ード電極の接続点には、サイリスタ6のN極ゲートを接
続し、同様に光起電力素子3のカソード電極と第2のダ
イオード5のカソード電極との接続点には、サイリスタ
6のP極ゲートを接続している。そして、サイリスタ6
のアノード電極(以下、電極を省略する)とカソードと
はそれぞれ2つのエンハンスメント形DMOSFET7
のゲート7aとバックゲート7bとに接続されており、
これらMOSFET7がオンすることにより、ドレイン
電極7c−7cに接続された出力端子8,8A間の負荷
を閉じる。
FIG. 5 is a circuit diagram of a conventional solid state relay. As shown in FIG. 5, a conventional solid state relay is a photovoltaic device in which a light emitting diode 2 is turned on by a voltage applied between input terminals 1 and 1A, and a plurality of photodiodes 10 are cascade-connected by the emitted light. An electromotive force is generated in the power element 3. Both ends of the thyristor 6 are connected between the anode electrode and the cathode electrode at both ends of the photovoltaic element 3 via the first diode 4 and the second diode 5, respectively. The N-pole gate of the thyristor 6 is connected to the connection point between the anode electrode of the photovoltaic element 3 and the anode electrode of the first diode 4, and similarly the cathode electrode of the photovoltaic element 3 and the second diode are connected. The P-pole gate of the thyristor 6 is connected to the connection point of the cathode electrode 5 of FIG. And thyristor 6
There are two enhancement type DMOSFETs 7 each for the anode electrode (hereinafter, the electrode is omitted) and the cathode.
Connected to the gate 7a and back gate 7b of
When these MOSFETs 7 are turned on, the load between the output terminals 8 and 8A connected to the drain electrodes 7c-7c is closed.

【0004】かかるソリッドステートリレーは、発光ダ
イオード2を点灯した状態でサイリスタ6がオフ状態で
あり、抵抗値が極めて高い。従って、光起電力素子3で
発生した起電力による電荷は第1のダイオード4および
第2のダイオード5を介して出力用DMOSFET7の
ゲート7aに直ちに印加される。次に、入力端子1,1
Aに印加されていた電圧が無くなり、発光ダイオード2
が消灯した場合、光起電力3の発生電圧は無くなるが、
ダイオード4,5およびサイリスタ6により出力用エン
ハンスメント型DMOSFET7のゲート電圧はそのま
ま保たれている。この状態で光起電力素子3は自己放電
により電圧が低下して行くので、まずダイオード4,5
がオフ状態になる。このため、サイリスタ6のN極ゲー
トおよびP極ゲートのインピーダンスは極めて高くな
り、極く僅かな電流でサイリスタ6をオンするようにな
る。更に電圧が低下すると、サイリスタ6のN極ゲート
あるいはP極ゲートが順方向にバイアスされる。このサ
イリスタ6のゲートの感度は極めて高いため、光起電力
素子3のわずかの自己放電電流によりサイリスタ6はオ
ンしている。更に、サイリスタ6は自己保持特性を持つ
ため、一度オンするとアノード・カソード間の電圧が1
V程度に下がるまでオン状態を保つ。このため、出力用
エンハンスメントDMOSFET7のゲート7aに蓄積
された電荷はサイリスタ6を通って速やかに放電され、
DMOSFET7はオフする。
In such a solid state relay, the thyristor 6 is in the off state with the light emitting diode 2 turned on, and the resistance value is extremely high. Therefore, the electric charge generated by the electromotive force generated in the photovoltaic element 3 is immediately applied to the gate 7a of the output DMOSFET 7 via the first diode 4 and the second diode 5. Next, input terminals 1, 1
The voltage applied to A disappears and the light emitting diode 2
When is turned off, the voltage generated by the photovoltaic 3 disappears,
The gate voltage of the output enhancement type DMOSFET 7 is maintained as it is by the diodes 4, 5 and the thyristor 6. In this state, the voltage of the photovoltaic element 3 decreases due to self-discharge.
Turns off. Therefore, the impedance of the N-pole gate and the P-pole gate of the thyristor 6 becomes extremely high, and the thyristor 6 is turned on with an extremely small current. When the voltage further decreases, the N pole gate or P pole gate of the thyristor 6 is forward biased. Since the gate sensitivity of the thyristor 6 is extremely high, the thyristor 6 is turned on by a slight self-discharge current of the photovoltaic element 3. Furthermore, since the thyristor 6 has a self-holding characteristic, the voltage between the anode and the cathode becomes 1 when it is turned on once.
The ON state is maintained until the voltage drops to about V. Therefore, the charge accumulated in the gate 7a of the output enhancement DMOSFET 7 is quickly discharged through the thyristor 6,
The DMOSFET 7 is turned off.

【0005】[0005]

【発明が解決しようとする課題】上述した従来のソリッ
ドステートリレーは、RF信号やビデオ信号など高周波
の信号を制御する際に、アイソレーションロスが40d
B以上(1MHz)となる低入力容量の高周波用MOS
電界効果トランジスタを用いることが必要となる。
The conventional solid state relay described above has an isolation loss of 40d when controlling high frequency signals such as RF signals and video signals.
High frequency MOS with low input capacitance of B or more (1 MHz)
It is necessary to use field effect transistors.

【0006】しかるに、ソリッドステートリレーの放電
回路は光起電力素子3のアノード・カソード間電圧V1
とサイリスタ6のアノード・カソード間電圧V2がV
2〉V1の関係となった時に動作する。しかしながら、
発光ダイオード2が消灯して光起電力素子V1電圧が下
がり始めたとき、高周波用MOS電界効果トランジスタ
は入力容量が小さい(Ciss,10pF程度)ため、
V2〉V1の条件が成立せず、放電回路が動作しないま
ま徐々にMOS電界効果トランジスタがOFFする。従
って、電界効果トラジスタのスイッチング動作速度が大
幅に遅くなるという欠点がある。
However, the discharge circuit of the solid-state relay has a voltage V1 between the anode and the cathode of the photovoltaic element 3.
And the voltage V2 between the anode and cathode of the thyristor 6 is V
It operates when the relationship of 2> V1 is satisfied. However,
When the light emitting diode 2 is turned off and the voltage of the photovoltaic element V1 starts to drop, the high frequency MOS field effect transistor has a small input capacitance (Ciss, about 10 pF),
The condition of V2> V1 is not established, and the MOS field effect transistor is gradually turned off without operating the discharge circuit. Therefore, there is a drawback that the switching operation speed of the field effect transistor is significantly slowed down.

【0007】本発明の目的は、かかる低入力容量の電界
効果トランジスタを用いることができ、スイッチング速
度の早い小型のソリッドステートリレーを提供すること
にある。
An object of the present invention is to provide a small-sized solid state relay which can use such a field effect transistor having a low input capacitance and has a high switching speed.

【0008】[0008]

【課題を解決するための手段】本発明のソリッドステー
トリレーは、半導体発光素子と、前記半導体発光素子か
らの光により起電力を発生するフォトダイオードを複数
個縦続接続した光起電力素子と、前記光起電力素子から
発生する電圧をゲートに印加することにより導通状態に
なるMOS電界効果トランジスタと、前記MOS電界効
果トランジスタのゲート電極にアノード電極を接続し且
つバックゲート電極にカソード電極を接続するとともに
N極ゲートおよびP極ゲートをそれぞれ前記光起電力素
子のアノード電極およびカソード電極に接続したサイリ
スタと、前記サイリスタの前記N極ゲートにアノード電
極を接続し且つ前記サイリスタの前記アノード電極にカ
ソード電極を接続した第1のダイオードと、前記サイリ
スタの前記P極ゲートにカソード電極を接続し且つ前記
サイリスタの前記カソード電極にアノード電極を接続し
た第2のダイオードと、前記光起電力素子のアノード電
極およびカソード電極間に接続した第3のダイオードと
を有し、前記MOS電界効果トランジスタを負荷回路の
開閉を行うスイッチング素子として用いて構成される。
A solid state relay of the present invention comprises a semiconductor light emitting device, a photovoltaic device in which a plurality of photodiodes for generating electromotive force by light from the semiconductor light emitting device are cascade-connected, A MOS field effect transistor which becomes conductive when a voltage generated from a photovoltaic element is applied to its gate, an anode electrode is connected to a gate electrode of the MOS field effect transistor, and a cathode electrode is connected to a back gate electrode. A thyristor in which an N-pole gate and a P-pole gate are connected to an anode electrode and a cathode electrode of the photovoltaic element, respectively, and an anode electrode is connected to the N-pole gate of the thyristor and a cathode electrode is connected to the anode electrode of the thyristor. The connected first diode and the P-pole gate of the thyristor. A second diode connected to the cathode electrode of the thyristor and an anode electrode connected to the cathode electrode of the thyristor, and a third diode connected between the anode electrode and the cathode electrode of the photovoltaic element, The MOS field effect transistor is used as a switching element that opens and closes a load circuit.

【0009】[0009]

【実施例】次に、本発明の実施例について図面を参照し
て説明する。図1は本発明の一実施例を示すソリッドス
テートリレーの回路図である。図1に示すように、本実
施例は前述した図5の従来例において、第3のダイオー
ド9を複数個のフォトダイオード10を縦続接続した光
起電力素子3のアノード電極およびカソード電極間に接
続した構成になっている。その他の構成については図5
の回路と同様である。
Embodiments of the present invention will now be described with reference to the drawings. FIG. 1 is a circuit diagram of a solid state relay showing an embodiment of the present invention. As shown in FIG. 1, in the present embodiment, the third diode 9 is connected between the anode electrode and the cathode electrode of the photovoltaic element 3 in which a plurality of photodiodes 10 are cascaded in the conventional example of FIG. It has been configured. Other configurations are shown in FIG.
It is similar to the circuit of.

【0010】まず、入力端子1,1A間に入力電流が流
れ、発光ダイオード2が点灯すると、光起電力素子3の
両端に起電力が発生する。この電圧を高周波用エンハン
スメント型DMOSFET7のゲート7aおよびバック
ゲート7b間に印加し、高周波用エンハンスメント型D
MOSFET7のドレイン電極7c−7c間をオンさせ
る。
First, when an input current flows between the input terminals 1 and 1A to turn on the light emitting diode 2, electromotive force is generated at both ends of the photovoltaic element 3. This voltage is applied between the gate 7a and the back gate 7b of the high frequency enhancement type DMOSFET 7 to enhance the high frequency enhancement type DMOSFET 7.
The drain electrodes 7c-7c of the MOSFET 7 are turned on.

【0011】次に、入力端子1,1A間の入力電流を切
ると、発光ダイオード2の発光が止まり、光起電力素子
3の電圧が下がり始める。この電圧が下がり始めたと
き、光起電力素子3の両端電圧をすばやく低下させるた
め、光起電力素子3のアノード・カソード電極間に接続
されたダイオード9でリーク電流を生じさせることによ
り、低入力容量の高周波用エンハンスメント型DMOS
FET7のゲート・ソース間での低容量に充電された電
荷でダイオード4,5およびサイリスタ6からなる放電
回路を動作させることができ、前述した従来例のOFF
動作と同様に実現できる。また、かかるダイオード9は
逆バイアス時の逆方向飽和電流10-7A(アンペア)程
度に調整してある。
Next, when the input current between the input terminals 1 and 1A is cut off, the light emission of the light emitting diode 2 stops and the voltage of the photovoltaic element 3 starts to drop. When this voltage starts to drop, the voltage across the photovoltaic element 3 is quickly lowered, so that a leak current is generated in the diode 9 connected between the anode and cathode electrodes of the photovoltaic element 3 to reduce the input voltage. Enhancement type DMOS for high frequency of capacitance
The discharge circuit composed of the diodes 4 and 5 and the thyristor 6 can be operated by the electric charge charged to the low capacity between the gate and the source of the FET 7, and the above-mentioned conventional example is turned off.
It can be realized similarly to the operation. Further, the diode 9 is adjusted to have a reverse saturation current of 10 −7 A (ampere) at the time of reverse bias.

【0012】図2は図1に示すリレーのチップ平面図で
ある。図2に示すように、このチップは図1における点
線で囲まれた駆動回路部分を1チップ化した例である。
このチップには、光起電力素子3と、高周波用エンハン
スメント型DMOSFET7のゲート・バックゲート間
に接続される配線用パット12,13と、放電回路を構
成するサイリスタ6,ダイオード4および5と、ダイオ
ード9とから成る。
FIG. 2 is a plan view of a chip of the relay shown in FIG. As shown in FIG. 2, this chip is an example in which the drive circuit portion surrounded by the dotted line in FIG. 1 is integrated into one chip.
This chip includes a photovoltaic element 3, wiring pads 12 and 13 connected between the gate and back gate of a high-frequency enhancement type DMOSFET 7, a thyristor 6, diodes 4 and 5, which form a discharge circuit, and a diode. 9 and.

【0013】図3は図1に示すリレーをモールドパッケ
ージに組んだ状態の部分切り欠き斜視図である。図3に
示すように、チップをモールドパッケージ14でモール
ドしたソリッドステートリレーは、銅あるいは鉄ニッケ
ルのリードフレーム15のそれぞれ分離された内部リー
ド16に、LED2と、図2の駆動回路素子と、2つの
高周波用エンハンスメント型DMOSFET7とをAg
ペーストでマウントし、図1に示す回路の結線通りボン
ディングワイヤー18でそれぞれの素子を接続したもの
である。
FIG. 3 is a partially cutaway perspective view of the relay shown in FIG. 1 assembled in a mold package. As shown in FIG. 3, the solid-state relay in which the chip is molded in the mold package 14 has the LED 2, the drive circuit element of FIG. Two high-frequency enhancement type DMOSFETs 7 and Ag
It is mounted with a paste, and each element is connected by a bonding wire 18 according to the connection of the circuit shown in FIG.

【0014】図4は本発明の他の実施例を示すソリッド
ステートリレーの回路図である。図4に示すように、本
実施例は前述した図1の一実施例におけるダイオード9
をポリシリコンからなる高抵抗素子11で置き換えたも
のである。すなわち、この高抵抗素子11はダイオード
9と同様にリーク電流を生じさせるのに、数MΩの高抵
抗に設定している。従って、本実施例ではLED2が消
灯した際に光起電力素子3の両端電圧の低下を高抵抗素
子11で助け、前述した一実施例と同様に放電回路を動
作させることができる。
FIG. 4 is a circuit diagram of a solid state relay showing another embodiment of the present invention. As shown in FIG. 4, this embodiment uses the diode 9 in the embodiment of FIG. 1 described above.
Is replaced with a high resistance element 11 made of polysilicon. That is, the high resistance element 11 is set to have a high resistance of several MΩ in order to generate a leak current similarly to the diode 9. Therefore, in this embodiment, when the LED 2 is turned off, the high resistance element 11 helps the voltage drop across the photovoltaic element 3 and the discharge circuit can be operated in the same manner as in the above-described embodiment.

【0015】[0015]

【発明の効果】以上説明したように、本発明のソリッド
ステートリレーは、ダイオード又は高抵抗素子を光起電
力素子のアノード電極およびカソード電極間に接続する
ことにより、LEDが消灯した際に光起電力素子にリー
ク電流を生じさせることができるので、ゲート・ソース
間の低容量の高周波用MOSFETを駆動することがで
きるという効果がある。また、本発明はチップ占有面積
にほとんど影響せず容易に実現できるという効果もあ
る。
As described above, in the solid state relay of the present invention, the diode or the high resistance element is connected between the anode electrode and the cathode electrode of the photovoltaic element so that the photovoltaic element is turned on when the LED is turned off. Since a leak current can be generated in the power element, there is an effect that a high-capacity high-frequency MOSFET having a low capacitance between the gate and the source can be driven. Further, the present invention has an effect that it can be easily realized with almost no influence on the chip occupying area.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の一実施例を示すソリッドステートリレ
ーの回路図である。
FIG. 1 is a circuit diagram of a solid state relay showing an embodiment of the present invention.

【図2】図1に示すリレーのチップ平面図である。FIG. 2 is a plan view of a chip of the relay shown in FIG.

【図3】図1に示すリレーをモールドパッケージに組込
んだ状態の部分切り欠き斜視図である。
FIG. 3 is a partially cutaway perspective view of the relay shown in FIG. 1 assembled in a mold package.

【図4】本発明の他の実施例を示すソリッドステートリ
レーの回路図である。
FIG. 4 is a circuit diagram of a solid state relay showing another embodiment of the present invention.

【図5】従来の一例を示すソリッドステートリレーの回
路図である。
FIG. 5 is a circuit diagram of a conventional solid-state relay.

【符号の説明】[Explanation of symbols]

1,1A 入力端子 2 発光ダイオード 3 光起電力素子 4,5,9 ダイオード 6 サイリスタ 7 高周波用エンハンスメント型DMOSFET 8,8A 出力端子 10 フォトダイオード 11 高抵抗素子 12,13 配線用パッド 14 モールドパッケージ 15 リードフレーム 16 内部リード 18 ボンディングワイヤ 1,1A Input terminal 2 Light emitting diode 3 Photovoltaic element 4,5,9 Diode 6 Thyristor 7 High frequency enhancement type DMOSFET 8,8A Output terminal 10 Photodiode 11 High resistance element 12,13 Wiring pad 14 Mold package 15 Lead Frame 16 Internal lead 18 Bonding wire

Claims (2)

【特許請求の範囲】[Claims] 【請求項1】 半導体発光素子と、前記半導体発光素子
からの光により起電力を発生するフォトダイオードを複
数個縦続接続した光起電力素子と、前記光起電力素子か
ら発生する電圧をゲートに印加することにより導通状態
になるMOS電界効果トランジスタと、前記MOS電界
効果トランジスタのゲート電極にアノード電極を接続し
且つバックゲート電極にカソード電極を接続するととも
にN極ゲートおよびP極ゲートをそれぞれ前記光起電力
素子のアノード電極およびカソード電極に接続したサイ
リスタと、前記サイリスタの前記N極ゲートにアノード
電極を接続し且つ前記サイリスタの前記アノード電極に
カソード電極を接続した第1のダイオードと、前記サイ
リスタの前記P極ゲートにカソード電極を接続し且つ前
記サイリスタの前記カソード電極にアノード電極を接続
した第2のダイオードと、前記光起電力素子のアノード
電極およびカソード電極間に接続した第3のダイオード
とを有し、前記MOS電界効果トランジスタを負荷回路
の開閉を行うスイッチング素子として用いたことを特徴
とするソリッドステートリレー。
1. A semiconductor light emitting element, a photovoltaic element in which a plurality of photodiodes that generate electromotive force by light from the semiconductor light emitting element are cascade-connected, and a voltage generated from the photovoltaic element is applied to a gate. The MOS field effect transistor which becomes conductive by connecting the anode to the gate electrode of the MOS field effect transistor and the cathode electrode to the back gate electrode of the MOS field effect transistor, and the N pole gate and the P pole gate of the photovoltaic field effect transistor, respectively. A thyristor connected to an anode electrode and a cathode electrode of a power device; a first diode having an anode electrode connected to the N-pole gate of the thyristor and a cathode electrode connected to the anode electrode of the thyristor; The cathode electrode is connected to the P-pole gate and the thyristor is A second diode having an anode electrode connected to a cathode electrode and a third diode connected between the anode electrode and the cathode electrode of the photovoltaic element are provided, and the MOS field effect transistor opens and closes a load circuit. A solid-state relay characterized by being used as a switching element.
【請求項2】 前記第3のダイオードは、高抵抗素子で
置換した請求項1記載のソリッドステートリレー。
2. The solid state relay according to claim 1, wherein the third diode is replaced with a high resistance element.
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