JPH05145906A - 表示メモリ制御装置 - Google Patents
表示メモリ制御装置Info
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- JPH05145906A JPH05145906A JP3303222A JP30322291A JPH05145906A JP H05145906 A JPH05145906 A JP H05145906A JP 3303222 A JP3303222 A JP 3303222A JP 30322291 A JP30322291 A JP 30322291A JP H05145906 A JPH05145906 A JP H05145906A
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- Japan
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Abstract
(57)【要約】
【目的】１画面分の容量の表示メモリを使用してシリア
ルアトリビュートモードとパラレルアトリビュートモー
ドとを実現でき、ＷＳＴ方式テレテキストやキャプショ
ンシステム、そしてテレビジョンのオンスクリーン表示
としても使用可能な表示メモリ制御装置を提供すること
を目的とする。 【構成】１画面分の表示メモリ１３にシリアルアトリビ
ュートモードとパラレルアトリビュートモードとのデー
タが格納され、表示画面行カウンタ１０より出力される
カウント数によって行属性メモリ１１に格納されている
各種データにが読み出され、アドレス発生回路１２を介
して表示メモリ１３に供給される。そして表示メモリ１
３からデータが読み出され、ＣＧ１４においてＲＧＢ信
号に変更された後、表示画面に表示される。
ルアトリビュートモードとパラレルアトリビュートモー
ドとを実現でき、ＷＳＴ方式テレテキストやキャプショ
ンシステム、そしてテレビジョンのオンスクリーン表示
としても使用可能な表示メモリ制御装置を提供すること
を目的とする。 【構成】１画面分の表示メモリ１３にシリアルアトリビ
ュートモードとパラレルアトリビュートモードとのデー
タが格納され、表示画面行カウンタ１０より出力される
カウント数によって行属性メモリ１１に格納されている
各種データにが読み出され、アドレス発生回路１２を介
して表示メモリ１３に供給される。そして表示メモリ１
３からデータが読み出され、ＣＧ１４においてＲＧＢ信
号に変更された後、表示画面に表示される。
Description
【０００１】
【産業上の利用分野】本発明は、例えばテレテキスト
（文字放送）システムの受信装置等で使用される、文字
や図形等で構成された画像情報を符号形式で表示メモリ
に格納する表示メモリ制御装置に関する。
（文字放送）システムの受信装置等で使用される、文字
や図形等で構成された画像情報を符号形式で表示メモリ
に格納する表示メモリ制御装置に関する。
【０００２】
【従来の技術】世界のテレテキストシステムにおいて、
文字や図形等で構成された画像情報を表示メモリに格納
する方式としては、コードメモリ方式とビットマップメ
モリ方式とがある。このうちコードメモリ方式はイギリ
スで開発されたＷＳＴ（WorldSystem Teletext ）方式
のテレテキスト（ＵＫテレテキストとも呼ばれる）のレ
ベル１，２やアメリカで開発されたキャプション（字幕
放送）システム等に代表され、文字情報等の画像情報が
コード化されて表示メモリに格納される。またビットマ
ップメモリ方式は日本の文字放送（ハイブリット方式）
等に採用されており、テレテキストの画像情報が画素の
状態で表示メモリに格納される。
文字や図形等で構成された画像情報を表示メモリに格納
する方式としては、コードメモリ方式とビットマップメ
モリ方式とがある。このうちコードメモリ方式はイギリ
スで開発されたＷＳＴ（WorldSystem Teletext ）方式
のテレテキスト（ＵＫテレテキストとも呼ばれる）のレ
ベル１，２やアメリカで開発されたキャプション（字幕
放送）システム等に代表され、文字情報等の画像情報が
コード化されて表示メモリに格納される。またビットマ
ップメモリ方式は日本の文字放送（ハイブリット方式）
等に採用されており、テレテキストの画像情報が画素の
状態で表示メモリに格納される。
【０００３】コードメモリ方式で使用される表示メモリ
の制御方式にはシリアルアトリビュートモードとパラレ
ルアトリビュートモードとがある。以下、図面を参照し
てシリアルアトリビュートモードとパラレルアトリビュ
ートモードとを説明する。
の制御方式にはシリアルアトリビュートモードとパラレ
ルアトリビュートモードとがある。以下、図面を参照し
てシリアルアトリビュートモードとパラレルアトリビュ
ートモードとを説明する。
【０００４】図４はシリアルアトリビュートモードにお
ける表示メモリの使用方法の一例を説明する説明図であ
り、図５はパラレルアトリビュートモードにおける表示
メモリの使用方法の一例を説明する説明図である。
ける表示メモリの使用方法の一例を説明する説明図であ
り、図５はパラレルアトリビュートモードにおける表示
メモリの使用方法の一例を説明する説明図である。
【０００５】図４に示したようにシリアルアトリビュー
トモードは表示される文字の種類が指定されたキャラク
タコードと、表示される文字の色等の文字属性が指定さ
れたアトリビュートコードとがシリアルに混在してい
る。このため表示画面において文字属性変更の度にアト
リビュートコードが格納されている１文字分のスペース
が空くことになる。
トモードは表示される文字の種類が指定されたキャラク
タコードと、表示される文字の色等の文字属性が指定さ
れたアトリビュートコードとがシリアルに混在してい
る。このため表示画面において文字属性変更の度にアト
リビュートコードが格納されている１文字分のスペース
が空くことになる。
【０００６】これに対して図５に示したパラレルアトリ
ビュートモードは前述したキャラクタコードとアトリビ
ュートコードとがパラレルに格納される。つまり図５
（Ａ）に示したキャラクタコード用の表示メモリと図５
（Ｂ）に示したアトリビュートコード用の表示メモリと
が必要になる。この方式の場合、表示画面において文字
の種類と文字属性とを同時に変化させることができる。
ビュートモードは前述したキャラクタコードとアトリビ
ュートコードとがパラレルに格納される。つまり図５
（Ａ）に示したキャラクタコード用の表示メモリと図５
（Ｂ）に示したアトリビュートコード用の表示メモリと
が必要になる。この方式の場合、表示画面において文字
の種類と文字属性とを同時に変化させることができる。
【０００７】ところでＷＳＴ方式のテレテキストやキャ
プションシステム等の表示メモリの制御方法としては、
その伝送コード体系からシリアルアトリビュートモード
が表示メモリの使用効率上最適だが、この方式の表示メ
モリをテレビジョンのオンスクリーン表示用として兼用
する場合、文字の種類と文字属性とを同時に変化させる
ことができなかった。このため従来はシリアルアトリビ
ュートモード用とパラレルアトリビュートモード用とを
画面単位で選択できる表示メモリ制御装置を用いてい
た。
プションシステム等の表示メモリの制御方法としては、
その伝送コード体系からシリアルアトリビュートモード
が表示メモリの使用効率上最適だが、この方式の表示メ
モリをテレビジョンのオンスクリーン表示用として兼用
する場合、文字の種類と文字属性とを同時に変化させる
ことができなかった。このため従来はシリアルアトリビ
ュートモード用とパラレルアトリビュートモード用とを
画面単位で選択できる表示メモリ制御装置を用いてい
た。
【０００８】しかしながら従来の表示メモリ制御装置で
はシリアルアトリビュートモード用の１画面分のメモリ
に加えてパラレルアトリビュートモード用に１画面分の
メモリが必要になる。ここでテレビジョンのオンスクリ
ーン表示用として表示メモリが使用される場合、一般に
文字の種類と文字属性とを同時に変化させる表示行が数
行と少ないにもかかわらず２画面分のメモリが必要なた
め、非常に使用効率の悪い構成になっていた。
はシリアルアトリビュートモード用の１画面分のメモリ
に加えてパラレルアトリビュートモード用に１画面分の
メモリが必要になる。ここでテレビジョンのオンスクリ
ーン表示用として表示メモリが使用される場合、一般に
文字の種類と文字属性とを同時に変化させる表示行が数
行と少ないにもかかわらず２画面分のメモリが必要なた
め、非常に使用効率の悪い構成になっていた。
【０００９】
【発明が解決しようとする課題】従来の表示メモリ制御
装置ではシリアルアトリビュートモード用の１画面分の
メモリに加えてパラレルアトリビュートモード用に１画
面分、合計で２画面分のメモリが必要になる。ここでテ
レビジョンのオンスクリーン表示用として表示メモリが
使用される場合、一般に文字の種類と文字属性とを同時
に変化させる表示行が数行と少ないにもかかわらず２画
面分のメモリが必要なため、非常に使用効率の悪い構成
になっていた。
装置ではシリアルアトリビュートモード用の１画面分の
メモリに加えてパラレルアトリビュートモード用に１画
面分、合計で２画面分のメモリが必要になる。ここでテ
レビジョンのオンスクリーン表示用として表示メモリが
使用される場合、一般に文字の種類と文字属性とを同時
に変化させる表示行が数行と少ないにもかかわらず２画
面分のメモリが必要なため、非常に使用効率の悪い構成
になっていた。
【００１０】本発明は上記問題に鑑みてなされたもの
で、１画面分の容量の表示メモリを使用してシリアルア
トリビュートモードとパラレルアトリビュートモードと
を実現でき、ＷＳＴ方式テレテキストやキャプションシ
ステム、そしてテレビジョンのオンスクリーン表示とし
ても使用可能な表示メモリ制御装置を提供することを目
的とする。
で、１画面分の容量の表示メモリを使用してシリアルア
トリビュートモードとパラレルアトリビュートモードと
を実現でき、ＷＳＴ方式テレテキストやキャプションシ
ステム、そしてテレビジョンのオンスクリーン表示とし
ても使用可能な表示メモリ制御装置を提供することを目
的とする。
【００１１】
【課題を解決するための手段】本発明に係る手段は、表
示装置の行アドレスに相当する第１のアドレスを発生す
る手段と、前記第１のアドレスを基に第２のアドレス
と、文字の種類と文字属性とを示すコードを同一に格納
する第１のモードか、別々に格納する第２のモードかを
示すモード指示信号と、映像を表示するか否かを示す表
示可否信号とを発生する手段と、前記第２のアドレスと
モード指示信号と表示可否信号とを入力し、表示装置に
表示する表示データの格納された行アドレスである第３
のアドレスを発生する手段と、前記表示装置に表示する
表示データが多数格納されており、前記第３のアドレス
に格納されている表示データを出力する表示メモリ手段
と、前記メモリ手段より出力された表示データとモード
指示信号と表示可否信号とを入力し、表示データを前記
表示装置で表示する画像データに変換し、出力する手段
とを具備することで第１のモードと第２のモードとの表
示処理の選択が容易に実現される。
示装置の行アドレスに相当する第１のアドレスを発生す
る手段と、前記第１のアドレスを基に第２のアドレス
と、文字の種類と文字属性とを示すコードを同一に格納
する第１のモードか、別々に格納する第２のモードかを
示すモード指示信号と、映像を表示するか否かを示す表
示可否信号とを発生する手段と、前記第２のアドレスと
モード指示信号と表示可否信号とを入力し、表示装置に
表示する表示データの格納された行アドレスである第３
のアドレスを発生する手段と、前記表示装置に表示する
表示データが多数格納されており、前記第３のアドレス
に格納されている表示データを出力する表示メモリ手段
と、前記メモリ手段より出力された表示データとモード
指示信号と表示可否信号とを入力し、表示データを前記
表示装置で表示する画像データに変換し、出力する手段
とを具備することで第１のモードと第２のモードとの表
示処理の選択が容易に実現される。
【００１２】
【作用】本発明では任意の行単位で前記第１のモードと
前記第２のモードとを選択可能であるため、第１のモー
ドが最適な方式の表示と第２のモードが最適な方式の表
示とを、前記表示メモリ手段を兼用して使用することに
より前記表示メモリ手段の容量が１画面分で良いことに
なる。
前記第２のモードとを選択可能であるため、第１のモー
ドが最適な方式の表示と第２のモードが最適な方式の表
示とを、前記表示メモリ手段を兼用して使用することに
より前記表示メモリ手段の容量が１画面分で良いことに
なる。
【００１３】
【実施例】ＷＳＴ方式テレテキストやキャプションシス
テム等の受信装置では、テレビジョン信号の垂直帰線期
間に重畳されている文字信号が抜き取られ、復号後、文
字や図形等の表示データが表示メモリに格納される。
テム等の受信装置では、テレビジョン信号の垂直帰線期
間に重畳されている文字信号が抜き取られ、復号後、文
字や図形等の表示データが表示メモリに格納される。
【００１４】以下、図面を参照して本発明に係る一実施
例の構成及び動作を説明する。図１は本発明に係る一実
施例の構成を示す構成図であり、図２は図１における行
属性メモリ１１の構成を示す構成図であり、図３は図１
の動作を説明する説明図である。尚、本実施例では表示
メモリ１３は行アドレス０〜１５の計１６行で構成さ
れ、表示データがすでに格納されていると仮定する。ま
た表示画面行カウンタ１０は図示しないＣＲＴ等の表示
装置の表示走査に同期して０〜１５にカウントアップ
し、行属性メモリ１１は表示メモリ１３と同様に行アド
レス０〜１５の計１６行で構成されていると仮定する。
例の構成及び動作を説明する。図１は本発明に係る一実
施例の構成を示す構成図であり、図２は図１における行
属性メモリ１１の構成を示す構成図であり、図３は図１
の動作を説明する説明図である。尚、本実施例では表示
メモリ１３は行アドレス０〜１５の計１６行で構成さ
れ、表示データがすでに格納されていると仮定する。ま
た表示画面行カウンタ１０は図示しないＣＲＴ等の表示
装置の表示走査に同期して０〜１５にカウントアップ
し、行属性メモリ１１は表示メモリ１３と同様に行アド
レス０〜１５の計１６行で構成されていると仮定する。
【００１５】図１において表示画面行カウンタ１０から
出力されるカウントデータａは行属性メモリ１１に供給
される。行属性メモリ１１ではカウントデータａに相当
する行アドレスに格納されているモード選択データ、行
アドレスデータ、行表示データが読み出され、出力され
る。このうち行アドレスデータｂはアドレスデータ発生
回路１２に供給される。またモード選択データｄと行表
示データｅとはアドレス発生回路１２とキャラクタジェ
ネレータ（ＣＧ）１４とに供給される。
出力されるカウントデータａは行属性メモリ１１に供給
される。行属性メモリ１１ではカウントデータａに相当
する行アドレスに格納されているモード選択データ、行
アドレスデータ、行表示データが読み出され、出力され
る。このうち行アドレスデータｂはアドレスデータ発生
回路１２に供給される。またモード選択データｄと行表
示データｅとはアドレス発生回路１２とキャラクタジェ
ネレータ（ＣＧ）１４とに供給される。
【００１６】アドレス発生回路１２ではモード選択デー
タｄによりシリアルアトリビュートモードとパラレルア
トリビュートモードとのうち一方が選択される。ここで
選択されたモードと行アドレスデータｂとによりアドレ
スデータｃが生成され、表示メモリ１３に出力される。
表示メモリ１３ではアドレスデータｃを基に表示データ
ｆが読み出され、ＣＧ１４に出力される。ＣＧ１４では
供給された各データによってＲＧＢ（赤、緑、青）画像
データが生成され、図示しない表示装置に供給される。
タｄによりシリアルアトリビュートモードとパラレルア
トリビュートモードとのうち一方が選択される。ここで
選択されたモードと行アドレスデータｂとによりアドレ
スデータｃが生成され、表示メモリ１３に出力される。
表示メモリ１３ではアドレスデータｃを基に表示データ
ｆが読み出され、ＣＧ１４に出力される。ＣＧ１４では
供給された各データによってＲＧＢ（赤、緑、青）画像
データが生成され、図示しない表示装置に供給される。
【００１７】次に図２を参照して行属性メモリ１１の構
成を説明する。図２に示すように行属性メモリ１１の行
アドレスは０〜１５までの計１６行である。そしてｂ0
はモード選択データであり、ｂ1 〜ｂ4 とｂ5 〜ｂ8 と
は共に表示メモリ１３における行アドレスを示してい
る。但しシリアルアトリビュートモードの場合にはｂ1
〜ｂ4 のデータだけが必要なデータであり、パラレルア
トリビュートモードの場合にはｂ1 〜ｂ4 とｂ5 〜ｂ8
との両方のデータが必要である。ｂ9 は行表示データで
あり、表示を行うかどうかを示すデータである。ちなみ
に図３においては説明の関係上、ｂ1 〜ｂ4 とｂ5 〜ｂ
8 とのデータを１０進数で表示している。
成を説明する。図２に示すように行属性メモリ１１の行
アドレスは０〜１５までの計１６行である。そしてｂ0
はモード選択データであり、ｂ1 〜ｂ4 とｂ5 〜ｂ8 と
は共に表示メモリ１３における行アドレスを示してい
る。但しシリアルアトリビュートモードの場合にはｂ1
〜ｂ4 のデータだけが必要なデータであり、パラレルア
トリビュートモードの場合にはｂ1 〜ｂ4 とｂ5 〜ｂ8
との両方のデータが必要である。ｂ9 は行表示データで
あり、表示を行うかどうかを示すデータである。ちなみ
に図３においては説明の関係上、ｂ1 〜ｂ4 とｂ5 〜ｂ
8 とのデータを１０進数で表示している。
【００１８】図３において（Ａ）は行属性メモリ１１で
あり、（Ｂ）は表示メモリ１３であり、（Ｃ）は表示画
面である。これらの図面を参照して本実施例の動作を説
明する。ここで行属性メモリ１１においてｂ0 が“０”
の場合はシリアルアトリビュートモードを示しており、
“１”の場合にはパラレルアトリビュートモードを示し
ている。ｂ1 〜ｂ4 とｂ5 〜ｂ8とは前述したように表
示メモリ１３における行アドレスを示している。そして
ｂ9 は行表示データであり、表示を行う場合には“１”
であり、表示しない場合には“０”である。尚、“×”
はどんな値でも良いことを示している。
あり、（Ｂ）は表示メモリ１３であり、（Ｃ）は表示画
面である。これらの図面を参照して本実施例の動作を説
明する。ここで行属性メモリ１１においてｂ0 が“０”
の場合はシリアルアトリビュートモードを示しており、
“１”の場合にはパラレルアトリビュートモードを示し
ている。ｂ1 〜ｂ4 とｂ5 〜ｂ8とは前述したように表
示メモリ１３における行アドレスを示している。そして
ｂ9 は行表示データであり、表示を行う場合には“１”
であり、表示しない場合には“０”である。尚、“×”
はどんな値でも良いことを示している。
【００１９】まず行属性メモリ１１の行アドレスが
“０”の場合ｂ0 は“０”であり、ｂ1〜ｂ4 は“１”
であり、ｂ9 は“１”である。この場合はシリアルアト
リビュートモードであり、表示メモリ１３の行アドレス
“１”のデータが読み出される。ここで表示メモリ１３
の行アドレス“１”に格納されているデータ「白ＡＢＣ
青ＤＥ赤ＦＧＨＩ」は表示画面において行アドレス
“０”の２文字目から白色で［ＡＢＣ」と表示され、１
文字分あけて青色で［ＤＥ」と表示され、また１文字分
あけて赤色で「ＦＧＨＩ」と表示される。
“０”の場合ｂ0 は“０”であり、ｂ1〜ｂ4 は“１”
であり、ｂ9 は“１”である。この場合はシリアルアト
リビュートモードであり、表示メモリ１３の行アドレス
“１”のデータが読み出される。ここで表示メモリ１３
の行アドレス“１”に格納されているデータ「白ＡＢＣ
青ＤＥ赤ＦＧＨＩ」は表示画面において行アドレス
“０”の２文字目から白色で［ＡＢＣ」と表示され、１
文字分あけて青色で［ＤＥ」と表示され、また１文字分
あけて赤色で「ＦＧＨＩ」と表示される。
【００２０】次に行属性メモリ１１の行アドレスが
“１”の場合ｂ0 は“１”であり、ｂ1〜ｂ4 は“１
４”であり、ｂ5 〜ｂ8は“２”であり、ｂ9 は“１”
である。この場合はパラレルアトリビュートモードであ
り、表示メモリ１３の行アドレス“１４”のデータがキ
ャラクタコードデータとして、また行アドレス“２”の
データがアトリビュートコードデータとして読み出され
る。ここで表示メモリ１３の行アドレス“１４”に格納
されているデータ「ＡＢＣＤＥＦＧＨＩＪＫＬ」と行ア
ドレス“２”に格納されているデータ「白白白青青赤赤
赤赤白白白」とが組み合わされ、表示画面において行ア
ドレス“１”の行に白色で「ＡＢＣ」、青色で「Ｄ
Ｅ」、赤色で「ＦＧＨＩ」、そして白色で「ＪＫＬ」と
表示される。
“１”の場合ｂ0 は“１”であり、ｂ1〜ｂ4 は“１
４”であり、ｂ5 〜ｂ8は“２”であり、ｂ9 は“１”
である。この場合はパラレルアトリビュートモードであ
り、表示メモリ１３の行アドレス“１４”のデータがキ
ャラクタコードデータとして、また行アドレス“２”の
データがアトリビュートコードデータとして読み出され
る。ここで表示メモリ１３の行アドレス“１４”に格納
されているデータ「ＡＢＣＤＥＦＧＨＩＪＫＬ」と行ア
ドレス“２”に格納されているデータ「白白白青青赤赤
赤赤白白白」とが組み合わされ、表示画面において行ア
ドレス“１”の行に白色で「ＡＢＣ」、青色で「Ｄ
Ｅ」、赤色で「ＦＧＨＩ」、そして白色で「ＪＫＬ」と
表示される。
【００２１】そして行属性メモリ１１の行アドレスが
“２”の場合、ｂ9が“０”であることから表示画面の
行アドレス“２”には何も表示されない。以下、行属性
メモリ１１の行アドレスが“３”〜“１５”の場合も前
述した動作と同じ動作が繰り返される。
“２”の場合、ｂ9が“０”であることから表示画面の
行アドレス“２”には何も表示されない。以下、行属性
メモリ１１の行アドレスが“３”〜“１５”の場合も前
述した動作と同じ動作が繰り返される。
【００２２】以上、記述したように１画面分の表示メモ
リにシリアルアトリビュートモードとパラレルアトリビ
ュートモードとのデータが格納され、行属性メモリに格
納されている各種データにしたがって表示メモリからデ
ータが読み出され、ＣＧにおいて画像信号に変更された
後、表示画面に表示される。このような構成にすること
で任意の行単位によるパラレルアトリビュートモードと
シリアルアトリビュートモードとの表示処理の選択が容
易に実現できる。また、テレビジョンのオンスクリーン
表示用に表示メモリを兼用して使用する場合、従来は２
画面分の表示メモリが必要であったが１画面分の表示メ
モリだけで兼用することができる。
リにシリアルアトリビュートモードとパラレルアトリビ
ュートモードとのデータが格納され、行属性メモリに格
納されている各種データにしたがって表示メモリからデ
ータが読み出され、ＣＧにおいて画像信号に変更された
後、表示画面に表示される。このような構成にすること
で任意の行単位によるパラレルアトリビュートモードと
シリアルアトリビュートモードとの表示処理の選択が容
易に実現できる。また、テレビジョンのオンスクリーン
表示用に表示メモリを兼用して使用する場合、従来は２
画面分の表示メモリが必要であったが１画面分の表示メ
モリだけで兼用することができる。
【００２３】尚、表示メモリと行属性メモリとの行アド
レスは１６行に限定されるものではない。同様に表示画
面行カウンタのカウント数は０〜１５に限定されない。
また表示メモリと行属性メモリとを１つのメモリの中に
構成してもかまわない。そして行属性メモリのメモリ構
成やビット構成も本実施例に限定されない。
レスは１６行に限定されるものではない。同様に表示画
面行カウンタのカウント数は０〜１５に限定されない。
また表示メモリと行属性メモリとを１つのメモリの中に
構成してもかまわない。そして行属性メモリのメモリ構
成やビット構成も本実施例に限定されない。
【００２４】
【発明の効果】前述したように１画面分の表示メモリに
シリアルアトリビュートモードとパラレルアトリビュー
トモードとのデータが格納され、行属性メモリに格納さ
れている各種データにしたがって表示メモリからデータ
が読み出される。読み出されたデータがＣＧにおいてＲ
ＧＢ信号に変更された後、表示画面に表示される。この
ような構成にすることで任意の行単位によるパラレルア
トリビュートモードとシリアルアトリビュートモードと
の表示処理の選択が容易に実現できる。また、テレビジ
ョンのオンスクリーン表示用に表示メモリを兼用して使
用する場合、従来は２画面分の表示メモリが必要であっ
たが、本発明では１画面分の表示メモリだけで兼用する
ことができる。
シリアルアトリビュートモードとパラレルアトリビュー
トモードとのデータが格納され、行属性メモリに格納さ
れている各種データにしたがって表示メモリからデータ
が読み出される。読み出されたデータがＣＧにおいてＲ
ＧＢ信号に変更された後、表示画面に表示される。この
ような構成にすることで任意の行単位によるパラレルア
トリビュートモードとシリアルアトリビュートモードと
の表示処理の選択が容易に実現できる。また、テレビジ
ョンのオンスクリーン表示用に表示メモリを兼用して使
用する場合、従来は２画面分の表示メモリが必要であっ
たが、本発明では１画面分の表示メモリだけで兼用する
ことができる。
【図１】本発明の構成を示す構成図
【図２】行属性メモリ１１の構成を示す構成図
【図３】本発明の動作を説明する説明図
【図４】シリアルアトリビュートモードでの表示メモリ
の使用方法を説明する説明図
の使用方法を説明する説明図
【図５】パラレルアトリビュートモードでの表示メモリ
の使用方法を説明する説明図
の使用方法を説明する説明図
１０…表示画面行カウンタ １１…行属性アドレス １２…アドレス発生回路 １３…表示メモリ １４…ＣＧ
Claims (1)
- 【請求項１】 表示装置の行アドレスに相当する第１の
アドレスを発生する手段と、 前記第１のアドレスを基に第２のアドレスと、文字の種
類と文字属性とを示すコードを同一に格納する第１のモ
ードか、別々に格納する第２のモードかを示すモード指
示信号と、映像を表示するか否かを示す表示可否信号と
を発生する手段と、 前記第２のアドレスとモード指示信号と表示可否信号と
を入力し、前記表示装置に表示する表示データの格納さ
れた行アドレスである第３のアドレスを発生する手段
と、 前記表示装置に表示する表示データが多数格納されてお
り、前記第３のアドレスに格納されている表示データを
出力する表示メモリ手段と、 前記メモリ手段より出力された表示データとモード指示
信号と表示可否信号とを入力し、表示データを前記表示
装置で表示する画像データに変換し、出力する手段とを
具備したことを特徴とする表示メモリ制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3303222A JPH05145906A (ja) | 1991-11-19 | 1991-11-19 | 表示メモリ制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3303222A JPH05145906A (ja) | 1991-11-19 | 1991-11-19 | 表示メモリ制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05145906A true JPH05145906A (ja) | 1993-06-11 |
Family
ID=17918351
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3303222A Pending JPH05145906A (ja) | 1991-11-19 | 1991-11-19 | 表示メモリ制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05145906A (ja) |
-
1991
- 1991-11-19 JP JP3303222A patent/JPH05145906A/ja active Pending
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