JPH0513783A - Integrated pressure sensor - Google Patents

Integrated pressure sensor

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JPH0513783A
JPH0513783A JP16724891A JP16724891A JPH0513783A JP H0513783 A JPH0513783 A JP H0513783A JP 16724891 A JP16724891 A JP 16724891A JP 16724891 A JP16724891 A JP 16724891A JP H0513783 A JPH0513783 A JP H0513783A
Authority
JP
Japan
Prior art keywords
silicon chip
diaphragm
film resistor
pressure sensor
probing
Prior art date
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Pending
Application number
JP16724891A
Other languages
Japanese (ja)
Inventor
Kazuhisa Ikeda
和久 池田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Denso Corp
Original Assignee
NipponDenso Co Ltd
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Filing date
Publication date
Application filed by NipponDenso Co Ltd filed Critical NipponDenso Co Ltd
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Publication of JPH0513783A publication Critical patent/JPH0513783A/en
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Abstract

PURPOSE:To provide an integrated pressure sensor wherein a stylus-pressure stress is hardly propagated to a piezoresistance layer by means of a new structure. CONSTITUTION:A thin diaphragm 2 is formed in the central part of a square silicon chip 1. Piezoresistance layers 3a, 3b, 3c, 3d by an impurity diffusion operation are formed on the diaphragm 2. A signal processing circuit provided with a thin-film resistor for adjustment use is formed in the peripheral part of the silicon chip 1. Two each of pads 6, for probing use, which are used to adjust the resistance value of the thin-film resistor for adjustment use are arranged at four corners of the silicon chip 1.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】この発明は、信号処理回路を集積
化した集積化圧力センサに関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an integrated pressure sensor in which a signal processing circuit is integrated.

【0002】[0002]

【従来の技術】信号処理回路を集積化した集積化圧力セ
ンサにおいては、図6に示すように、シリコンチップ2
0の一部に薄肉のダイヤフラム21が形成され、そのダ
イヤフラム部にピエゾ抵抗層22が配置されている。
又、シリコンチップ20の周辺部に信号処理回路が形成
され、同信号処理回路には調整用薄膜抵抗体が備えられ
ている。そして、プロービング用パッド(電極)23に
プローバを押し当てた状態で調整用薄膜抵抗体の抵抗値
を調整してセンサの出力調整を行っている。
2. Description of the Related Art In an integrated pressure sensor in which a signal processing circuit is integrated, as shown in FIG.
A thin diaphragm 21 is formed in a part of 0, and a piezoresistive layer 22 is arranged in the diaphragm portion.
Further, a signal processing circuit is formed in the peripheral portion of the silicon chip 20, and the signal processing circuit is provided with an adjusting thin film resistor. Then, the output of the sensor is adjusted by adjusting the resistance value of the adjusting thin-film resistor while the prober is pressed against the probing pad (electrode) 23.

【0003】この調整用薄膜抵抗体のトリミング時に、
プロービングの針圧応力がピエゾ抵抗層22に伝搬し、
その応力の影響によりセンサ出力が大きく変動してしま
う。そこで、特開平1−236659号公報では、ダイ
ヤフラムとプロービング用パッド23との間に溝を形成
して、この溝により、プロービング時に発生する表面応
力がダイヤフラムに伝搬するのを低減している。
At the time of trimming the thin film resistor for adjustment,
Probing stylus stress propagates to the piezoresistive layer 22,
The sensor output fluctuates greatly due to the influence of the stress. Therefore, in Japanese Patent Laid-Open No. 1-236659, a groove is formed between the diaphragm and the probing pad 23, and this groove reduces the propagation of the surface stress generated during probing to the diaphragm.

【0004】[0004]

【発明が解決しようとする課題】ところが、この構造を
採用すると、溝を設けるための工数が増えるとともに、
溝を設けるためにチップ面積が大きくなってしまう。
However, when this structure is adopted, the number of steps for forming the groove is increased, and at the same time,
Since the groove is provided, the chip area becomes large.

【0005】この発明の目的は、新規なる構造にてピエ
ゾ抵抗層に針圧応力が伝搬しにくい集積化圧力センサを
提供することにある。
An object of the present invention is to provide an integrated pressure sensor having a novel structure in which stylus stress is less likely to propagate to the piezoresistive layer.

【0006】[0006]

【課題を解決するための手段】第1の発明は、方形のシ
リコンチップの中央部に薄肉のダイヤフラムが形成さ
れ、そのダイヤフラムにピエゾ抵抗層が配置され、さら
に、シリコンチップの周辺部に調整用薄膜抵抗体を有す
る信号処理回路を形成した集積化圧力センサにおいて、
前記調整用薄膜抵抗体の抵抗値を調整するためのプロー
ビング用パッドを、前記シリコンチップの隅部にのみ配
置した集積化圧力センサをその要旨とする。
According to a first aspect of the present invention, a thin diaphragm is formed in a central portion of a rectangular silicon chip, a piezoresistive layer is arranged on the diaphragm, and a peripheral portion of the silicon chip is used for adjustment. In an integrated pressure sensor formed with a signal processing circuit having a thin film resistor,
The gist is an integrated pressure sensor in which probing pads for adjusting the resistance value of the adjusting thin-film resistor are arranged only at the corners of the silicon chip.

【0007】第2の発明は、方形のシリコンチップの中
央部に薄肉のダイヤフラムが形成され、そのダイヤフラ
ムにピエゾ抵抗層が配置され、さらに、シリコンチップ
の周辺部に調整用薄膜抵抗体を有する信号処理回路を形
成した集積化圧力センサにおいて、前記調整用薄膜抵抗
体の抵抗値を調整するためのプロービング用パッドを、
シリコンチップとなるシリコンウェハでの前記ピエゾ抵
抗層の短軸方向のスクライブラインに配置した集積化圧
力センサをその要旨とする。
According to a second aspect of the present invention, a thin diaphragm is formed in a central portion of a rectangular silicon chip, a piezoresistive layer is arranged on the diaphragm, and a signal having an adjusting thin film resistor in the peripheral portion of the silicon chip. In an integrated pressure sensor having a processing circuit, a probing pad for adjusting the resistance value of the adjusting thin film resistor,
The gist is an integrated pressure sensor arranged on a scribe line in the minor axis direction of the piezoresistive layer on a silicon wafer to be a silicon chip.

【0008】[0008]

【作用】第1の発明は、プロービングの際にはプロービ
ング用パッドに針圧が加わるが、プロービング用パッド
がシリコンチップの隅部にのみ配置されているので、ピ
エゾ抵抗層にはその応力が伝搬しにくくなる。その結
果、特性の揃ったセンサとなる。
In the first aspect of the invention, stylus pressure is applied to the probing pad during probing, but since the probing pad is arranged only at the corner of the silicon chip, the stress propagates to the piezoresistive layer. Hard to do. As a result, the sensor has uniform characteristics.

【0009】第2の発明は、プロービングの際にはプロ
ービング用パッドに針圧が加わるが、プロービング用パ
ッドがシリコンウェハでのピエゾ抵抗層の短軸方向のス
クライブラインに配置されているので、ピエゾ抵抗層に
はその応力が伝搬しにくくなる。その結果、特性の揃っ
たセンサとなる。
According to the second aspect of the present invention, stylus pressure is applied to the probing pad during probing, but the probing pad is arranged on the scribe line in the minor axis direction of the piezoresistive layer on the silicon wafer. The stress is less likely to propagate to the resistance layer. As a result, the sensor has uniform characteristics.

【0010】[0010]

【実施例】(第1実施例)以下、この発明を具体化した
一実施例を図面に従って説明する。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS (First Embodiment) An embodiment of the present invention will be described below with reference to the drawings.

【0011】図2には本実施例の集積化圧力センサの斜
視図を示し、図1には集積化圧力センサの平面図を示
す。方形のシリコンチップ1には、その中央部に薄肉の
ダイヤフラム2が形成され、同ダイヤフラム2は正方形
となっている。ダイヤフラム2上には不純物拡散による
4つのピエゾ抵抗層3a,3b,3c,3dが配置され
ている。このピエゾ抵抗層3a,3b,3c,3dにて
ホイーストーンブリッジ回路が形成されている。
FIG. 2 is a perspective view of the integrated pressure sensor of this embodiment, and FIG. 1 is a plan view of the integrated pressure sensor. A thin diaphragm 2 is formed in the central portion of a rectangular silicon chip 1, and the diaphragm 2 has a square shape. On the diaphragm 2, four piezoresistive layers 3a, 3b, 3c and 3d formed by impurity diffusion are arranged. A Wheatstone bridge circuit is formed by the piezoresistive layers 3a, 3b, 3c and 3d.

【0012】又、図2に示すように、シリコンチップ1
の周辺部には信号処理回路4が集積化して形成され、こ
の信号処理回路4は調整用薄膜抵抗体5を有している。
信号処理回路4はピエゾ抵抗層3a,3b,3c,3d
より生ずる信号を処理(増幅)するものである。
Further, as shown in FIG. 2, the silicon chip 1
A signal processing circuit 4 is integrated and formed in the peripheral part of the signal processing circuit 4. The signal processing circuit 4 has an adjusting thin film resistor 5.
The signal processing circuit 4 includes piezoresistive layers 3a, 3b, 3c and 3d.
It processes (amplifies) the resulting signal.

【0013】又、図1に示すように、シリコンチップ1
の隅部には隅ごとに2つずつのプロービング用パッド6
が配置されている。このプロービング用パッド6は、信
号処理回路4と電気接続されており、ピエゾ抵抗層3
a,3b,3c,3dより生ずる信号を外部に取り出す
ためのものである。つまり、図2に示すプローバ7によ
りプロービング(接触)することにより、調整用薄膜抵
抗体5の抵抗値を調整するための取出用パッド(電極)
である。
Also, as shown in FIG. 1, a silicon chip 1
2 probing pads 6 in each corner
Are arranged. The probing pad 6 is electrically connected to the signal processing circuit 4, and the piezoresistive layer 3 is provided.
It is for taking out signals generated from a, 3b, 3c and 3d to the outside. That is, the extraction pad (electrode) for adjusting the resistance value of the adjustment thin film resistor 5 by probing (contacting) with the prober 7 shown in FIG.
Is.

【0014】このようにすることにより、プロービング
時に発生する針圧応力がピエゾ抵抗層3a,3b,3
c,3dに伝搬するのを防ぎ、図6に示すセンサに比べ
針圧による出力調整誤差が低減される。
By doing so, the stylus stress generated during probing causes the piezoresistive layers 3a, 3b, 3
Propagation to c and 3d is prevented, and an output adjustment error due to stylus pressure is reduced as compared with the sensor shown in FIG.

【0015】上記についてのFEM解析結果を図3,4
に示す。この解析は、図3のように(110)面のシリ
コンチップ1におけるダイヤフラム2の中央部にピエゾ
抵抗層3a,3bを配置するとともに周辺部にピエゾ抵
抗層3c,3dを配置し、A,B,C,D及びE点に力
を加えたものである。中央部のピエゾ抵抗層3a,3b
の半径方向(r方向)に発生する応力σr-centetと周辺
部のピエゾ抵抗層3c,3dのr方向に発生する応力σ
r-sideの応力差(=σr-centet−σr-side)は、図4に
示す結果となる。A,B及びC点の結果より、ピエゾ部
発生応力差(=σr-centet−σr-side)は、力を加える
箇所がピエゾ抵抗層3a,3b,3c,3dより離れて
いた方が、小さくなることが分かる。又、C点及びE点
の結果より、ピエゾ抵抗係数の0の方向(t方向)に力
を加えたE点の方が、ピエゾ部発生応力差が、小さくな
っている。さらに、D点においては、上記2つの効果が
重なって、最も小さいピエゾ部発生応力差になったと考
えられる。
The FEM analysis results for the above are shown in FIGS.
Shown in. In this analysis, as shown in FIG. 3, the piezoresistive layers 3a and 3b are arranged in the central part of the diaphragm 2 in the silicon chip 1 on the (110) plane, and the piezoresistive layers 3c and 3d are arranged in the peripheral part. , C, D and E points are applied. Piezoresistive layers 3a and 3b in the central portion
Stress σ r-centet generated in the radial direction (r direction) and stress σ generated in the r direction of the peripheral piezoresistive layers 3c and 3d.
The r-side stress difference (= σ r-centet −σ r-side ) is the result shown in FIG. From the results of points A, B, and C, it is found that the piezo portion generated stress difference (= σ r-centet −σ r-side ) is greater when the point where the force is applied is farther from the piezoresistive layers 3a, 3b, 3c, and 3d. It turns out that it becomes smaller. Further, from the results of the points C and E, the piezo portion generated stress difference is smaller at the point E where a force is applied in the direction of the piezoresistive coefficient 0 (t direction). Further, at point D, it is considered that the above-mentioned two effects are overlapped with each other, resulting in the smallest piezo portion generated stress difference.

【0016】従って、出力調整誤差はゲージ部発生応力
差に比例しているので、シリコンチップ1の4隅にプロ
ービング用パッド6を配置した時が出力調整誤差が最も
小さくなる。
Therefore, since the output adjustment error is proportional to the stress difference generated in the gauge portion, the output adjustment error is minimized when the probing pads 6 are arranged at the four corners of the silicon chip 1.

【0017】これは、(110)面では、ピエゾ抵抗に
対して、半径方向(r方向)に力を加えるより、半径方
向に垂直な方向(t方向)に力を加えた方が、ピエゾ抵
抗係数の結晶方位依存性によりピエゾ部に影響する応力
が小さくなるものと考えられる。又、プロービングによ
り、力を加える点が、ピエゾ部より離れていた方が、応
力がシリコン表面を伝搬する際、減衰するので、ピエゾ
部に影響する応力が小さくなると考えられる。
On the (110) plane, the piezoresistive force is more exerted in the direction (t direction) perpendicular to the radial direction than in the radial direction (r direction). It is considered that the stress that affects the piezo portion is reduced due to the crystal orientation dependence of the coefficient. Further, it is considered that the stress applied to the piezo portion is reduced when the stress is propagated on the silicon surface when the point where the force is applied is separated from the piezo portion by the probing.

【0018】このように本実施例では、方形のシリコン
チップ1の中央部に薄肉のダイヤフラム2を形成し、そ
のダイヤフラム2にピエゾ抵抗層3a,3b,3c,3
dを配置するとともに、シリコンチップ1の周辺部に調
整用薄膜抵抗体5を有する信号処理回路4を形成した。
そして、調整用薄膜抵抗体5の抵抗値を調整するための
プロービング用パッド6を、シリコンチップ1の隅部に
のみ配置した。よって、プロービングの際にはプロービ
ング用パッド6に針圧が加わるが、プロービング用パッ
ド6がシリコンチップ1の隅部にのみ配置されているの
で、ピエゾ抵抗層3a,3b,3c,3dにはその応力
が伝搬しにくくなる。その結果、従来のセンサのように
ダイヤフラムとプロービング用パッドとの間に溝を設け
ることなく、新規なる構造にてピエゾ抵抗層に針圧応力
が伝搬しにくくして特性の揃ったセンサとすることがで
きる。
As described above, in this embodiment, the thin diaphragm 2 is formed in the central portion of the rectangular silicon chip 1, and the piezoresistive layers 3a, 3b, 3c, 3 are formed on the diaphragm 2.
The signal processing circuit 4 having the adjusting thin film resistor 5 was formed in the peripheral portion of the silicon chip 1 while the d was arranged.
Then, the probing pad 6 for adjusting the resistance value of the adjusting thin-film resistor 5 was arranged only at the corner of the silicon chip 1. Therefore, stylus pressure is applied to the probing pad 6 at the time of probing, but since the probing pad 6 is arranged only at the corner of the silicon chip 1, the piezoresistive layers 3a, 3b, 3c, 3d are not affected. It becomes difficult for stress to propagate. As a result, unlike a conventional sensor, a groove having no groove is provided between the diaphragm and the probing pad, and a stylus stress is less likely to propagate to the piezoresistive layer with a new structure, so that the sensor has uniform characteristics. You can

【0019】尚、この実施例の応用例としては、(10
0)面においても、ピエゾ抵抗係数の0の方向でのチッ
プの隅部にのみプロービング用パッド6を配置しても、
前記と同様の効果が得られる。 (第2実施例)次に、第2実施例を第1実施例との相違
点のみ説明する。
As an application example of this embodiment, (10
Also in the (0) plane, even if the probing pad 6 is arranged only at the corner of the chip in the direction of the piezoresistance coefficient of 0,
The same effect as described above can be obtained. (Second Embodiment) Next, only the difference between the second embodiment and the first embodiment will be described.

【0020】図5に示すように、(110)面のシリコ
ンチップ1となるシリコンウェハ8において、直交する
スクライブライン9でのピエゾ抵抗層3a,3b,3
c,3dの短軸方向のスクライブライン9aにプロービ
ング用パッド6が配置されている。
As shown in FIG. 5, the piezoresistive layers 3a, 3b, 3 at the scribe lines 9 orthogonal to each other in the silicon wafer 8 which becomes the silicon chip 1 on the (110) plane.
Probing pads 6 are arranged on scribe lines 9a in the minor axis directions of c and 3d.

【0021】このように本実施例では、調整用薄膜抵抗
体5の抵抗値を調整するためのプロービング用パッド6
を、シリコンチップ1となるシリコンウェハ8でのピエ
ゾ抵抗層3a,3b,3c,3dの短軸方向のスクライ
ブライン9aに配置したので、プロービングの際にはプ
ロービング用パッド6に針圧が加わるが、プロービング
用パッド6がシリコンウェハ8でのピエゾ抵抗層3a,
3b,3c,3dの短軸方向のスクライブライン9aに
配置されているので、ピエゾ抵抗層3a,3b,3c,
3dにはその応力が伝搬しにくくなる。その結果、特性
の揃ったセンサとなる。
As described above, in this embodiment, the probing pad 6 for adjusting the resistance value of the adjusting thin film resistor 5 is used.
Is arranged on the scribe line 9a in the short axis direction of the piezoresistive layers 3a, 3b, 3c, 3d on the silicon wafer 8 to be the silicon chip 1, so that stylus pressure is applied to the probing pad 6 during probing. , The probing pad 6 is a piezoresistive layer 3a on the silicon wafer 8,
The piezoresistive layers 3a, 3b, 3c, 3b, 3c, 3d are arranged on the scribe line 9a in the minor axis direction.
It becomes difficult for the stress to propagate to 3d. As a result, the sensor has uniform characteristics.

【0022】[0022]

【発明の効果】以上詳述したように本発明によれば、新
規なる構造にてピエゾ抵抗層に針圧応力が伝搬しにくい
集積化圧力センサを提供することができる優れた効果を
発揮する。
As described in detail above, according to the present invention, it is possible to provide an integrated pressure sensor having a novel structure in which stylus pressure stress is less likely to propagate to the piezoresistive layer.

【図面の簡単な説明】[Brief description of drawings]

【図1】第1実施例のセンサの平面図である。FIG. 1 is a plan view of a sensor according to a first embodiment.

【図2】センサの斜視図である。FIG. 2 is a perspective view of a sensor.

【図3】測定箇所を説明するためのセンサの平面図であ
る。
FIG. 3 is a plan view of a sensor for explaining measurement points.

【図4】各測定箇所での発生応力差を示す図である。FIG. 4 is a diagram showing a difference in stress generated at each measurement point.

【図5】第2実施例のセンサの平面図である。FIG. 5 is a plan view of the sensor of the second embodiment.

【図6】従来の集積化圧力センサの平面図である。FIG. 6 is a plan view of a conventional integrated pressure sensor.

【符号の説明】[Explanation of symbols]

1 シリコンチップ 2 ダイヤフラム 3a,3b,3c,3d ピエゾ抵抗層 4 信号処理回路 5 調整用薄膜抵抗体 6 プロービング用パッド 8 シリコンウェハ 9a スクライブライン 1 Silicon chip 2 diaphragm 3a, 3b, 3c, 3d piezoresistive layer 4 Signal processing circuit 5 Thin film resistor for adjustment 6 Probing pad 8 Silicon wafer 9a scribe line

Claims (2)

【特許請求の範囲】[Claims] 【請求項1】 方形のシリコンチップの中央部に薄肉の
ダイヤフラムが形成され、そのダイヤフラムにピエゾ抵
抗層が配置され、さらに、シリコンチップの周辺部に調
整用薄膜抵抗体を有する信号処理回路を形成した集積化
圧力センサにおいて、 前記調整用薄膜抵抗体の抵抗値を調整するためのプロー
ビング用パッドを、前記シリコンチップの隅部にのみ配
置したことを特徴とする集積化圧力センサ。
1. A rectangular silicon chip is formed with a thin diaphragm in a central portion thereof, a piezoresistive layer is arranged on the diaphragm, and a signal processing circuit having a thin film resistor for adjustment is formed in the peripheral portion of the silicon chip. In the integrated pressure sensor described above, a probing pad for adjusting the resistance value of the adjusting thin film resistor is arranged only at a corner of the silicon chip.
【請求項2】 方形のシリコンチップの中央部に薄肉の
ダイヤフラムが形成され、そのダイヤフラムにピエゾ抵
抗層が配置され、さらに、シリコンチップの周辺部に調
整用薄膜抵抗体を有する信号処理回路を形成した集積化
圧力センサにおいて、 前記調整用薄膜抵抗体の抵抗値を調整するためのプロー
ビング用パッドを、シリコンチップとなるシリコンウェ
ハでの前記ピエゾ抵抗層の短軸方向のスクライブライン
に配置したことを特徴とする集積化圧力センサ。
2. A thin diaphragm is formed in the central portion of a rectangular silicon chip, a piezoresistive layer is arranged on the diaphragm, and a signal processing circuit having a thin film resistor for adjustment is formed in the peripheral portion of the silicon chip. In the integrated pressure sensor, the probing pad for adjusting the resistance value of the adjusting thin film resistor is arranged on the scribe line in the minor axis direction of the piezoresistive layer on the silicon wafer that becomes the silicon chip. A featured integrated pressure sensor.
JP16724891A 1991-07-08 1991-07-08 Integrated pressure sensor Pending JPH0513783A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002131161A (en) * 2000-10-27 2002-05-09 Denso Corp Semiconductor pressure sensor

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JPS63118629A (en) * 1986-11-06 1988-05-23 Sumitomo Electric Ind Ltd Adjusting method for bridge circuit of semiconductor pressure sensor
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