JPH05130152A - 自動等化器 - Google Patents
自動等化器Info
- Publication number
- JPH05130152A JPH05130152A JP3313784A JP31378491A JPH05130152A JP H05130152 A JPH05130152 A JP H05130152A JP 3313784 A JP3313784 A JP 3313784A JP 31378491 A JP31378491 A JP 31378491A JP H05130152 A JPH05130152 A JP H05130152A
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- JP
- Japan
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- signal
- circuit
- digital
- tap coefficient
- coefficient control
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- Filters That Use Time-Delay Elements (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】
【目的】 フェージング補償特性を犠牲にすることな
く、良好な収束性を発揮することが可能な自動等化器を
得る。 【構成】 Ａ／Ｄ変換器１１、トランスバーサルフィル
タ１２、タップ係数制御回路１３に加えて、復調器の同
期外れを検出する同期外れ検出回路１４を設ける。タッ
プ係数制御回路１３には夫々タップ係数制御信号を出力
する第１ないし第ｎの積分器３１〜３５を任意にリセッ
トするリセット回路３７を設け、このリセット回路３７
を同期外れ検出回路１４の出力信号に基づいて動作さ
せ、同期外れから引き込みを行うときは、予め定められ
た数の積分器をリセットするように構成する。
く、良好な収束性を発揮することが可能な自動等化器を
得る。 【構成】 Ａ／Ｄ変換器１１、トランスバーサルフィル
タ１２、タップ係数制御回路１３に加えて、復調器の同
期外れを検出する同期外れ検出回路１４を設ける。タッ
プ係数制御回路１３には夫々タップ係数制御信号を出力
する第１ないし第ｎの積分器３１〜３５を任意にリセッ
トするリセット回路３７を設け、このリセット回路３７
を同期外れ検出回路１４の出力信号に基づいて動作さ
せ、同期外れから引き込みを行うときは、予め定められ
た数の積分器をリセットするように構成する。
Description
【０００１】
【産業上の利用分野】本発明は自動等化に関し、特にデ
ジタル無線通信システムの復調器において、フェージン
グによる伝搬路の波形歪や、他無線システムからの干渉
を自動的に除去するデジタル自動等化器に関する。
ジタル無線通信システムの復調器において、フェージン
グによる伝搬路の波形歪や、他無線システムからの干渉
を自動的に除去するデジタル自動等化器に関する。
【０００２】
【従来の技術】近年、デジタル無線通信方式において、
周波数の利用効率を高めるため変調方式の多値化が進ん
でいる。一方、多値数が増すにつれてフェージングによ
る伝搬路の波形歪や交差偏波間の干渉（コチャネル干
渉）や、他無線システムからの干渉（ＦＭ干渉等）等の
影響が大きくなり、これらの線形歪や干渉を除去する自
動等化器の開発が進められている。この自動等化器の１
つとしてトランスバーサルフィルタのタップ係数を適応
制御するトランスバーサル形等化器が実用化されてい
る。
周波数の利用効率を高めるため変調方式の多値化が進ん
でいる。一方、多値数が増すにつれてフェージングによ
る伝搬路の波形歪や交差偏波間の干渉（コチャネル干
渉）や、他無線システムからの干渉（ＦＭ干渉等）等の
影響が大きくなり、これらの線形歪や干渉を除去する自
動等化器の開発が進められている。この自動等化器の１
つとしてトランスバーサルフィルタのタップ係数を適応
制御するトランスバーサル形等化器が実用化されてい
る。
【０００３】従来の全デジタル形トランスバーサル等化
器の一例を図２に示す。同図に示すように、従来の全デ
ジタル形トランスバーサル等化器は、Ａ／Ｄ（アナログ
・デジタル）変換器１１、トランスバーサルフィルタ１
２、及びタップ係数制御回路１３で構成される。ここで
は、簡略化のために入力信号として一次元ベースバンド
信号を考えているが、多値直交変調信号を復調した場合
に生じる同相及び直交の二次元の成分を持つベースバン
ド信号が入力である場合も本等化器を組み合わせること
により等化システムを簡単に構成することができる。
器の一例を図２に示す。同図に示すように、従来の全デ
ジタル形トランスバーサル等化器は、Ａ／Ｄ（アナログ
・デジタル）変換器１１、トランスバーサルフィルタ１
２、及びタップ係数制御回路１３で構成される。ここで
は、簡略化のために入力信号として一次元ベースバンド
信号を考えているが、多値直交変調信号を復調した場合
に生じる同相及び直交の二次元の成分を持つベースバン
ド信号が入力である場合も本等化器を組み合わせること
により等化システムを簡単に構成することができる。
【０００４】この等化器は、端子１に入力された復調器
（図示せず）からの入力ベースバンド信号はＡ／Ｄ変換
器１１で標本，量子化され２進信号列に変換されトラン
スバーサルフィルタ１２に入力される。トランスバーサ
ルフィルタ１２は遅延回路２１，２２，２３，２４と、
乗算器２５，２５，２７，２８，２９と、加算器３０と
で構成される５タップ形であり、主タップ１０３の他に
−２タップ１０１，−１タップ１０２，＋１タップ１０
４及び＋２タップ１０５を有する。夫々のタップ出力信
号は、乗算器２７，２５，２６，２８，２９に夫々入力
されタップ係数１１３，１１１，１１２，１１４，１１
５が乗ぜられて加算器３０に入力される。加算器３０の
出力はフェージングによる符号間干渉が除去されたもの
となりトランスバーサルフィルタ１２の出力となる。
（図示せず）からの入力ベースバンド信号はＡ／Ｄ変換
器１１で標本，量子化され２進信号列に変換されトラン
スバーサルフィルタ１２に入力される。トランスバーサ
ルフィルタ１２は遅延回路２１，２２，２３，２４と、
乗算器２５，２５，２７，２８，２９と、加算器３０と
で構成される５タップ形であり、主タップ１０３の他に
−２タップ１０１，−１タップ１０２，＋１タップ１０
４及び＋２タップ１０５を有する。夫々のタップ出力信
号は、乗算器２７，２５，２６，２８，２９に夫々入力
されタップ係数１１３，１１１，１１２，１１４，１１
５が乗ぜられて加算器３０に入力される。加算器３０の
出力はフェージングによる符号間干渉が除去されたもの
となりトランスバーサルフィルタ１２の出力となる。
【０００５】以上のようにして、トランスバーサルフィ
ルタ１２で符号間干渉が除去された出力信号が端子２に
出力される。トランスバーサルフィルタ１２の各タップ
係数１１３，１１１，１１２，１１４，１１５はタップ
係数制御回路１３で決定される。タップ係数制御回路１
３は、積分器３３，３１，３２，３４，３５、及び相関
器３６より構成される。相関回路３６は、送信信号の推
定値と等化後のデジタル信号の差を表す誤差信号１２２
と、Ａ／Ｄ変換器１１の判定出力信号１２１とを入力と
し各タップに対応する相関値１３６，１３４，１３５，
１３７，１３８を出力する。相関回路３６の夫々の出力
１３６，１３４，１３５，１３７，１３８は積分回路３
３，３１，３２，３４，３５により時間平均されトラン
スバーサルフィルタ１２の各タップを制御するタップ係
数１１３，１１１，１１２，１１４，１１５となる。
ルタ１２で符号間干渉が除去された出力信号が端子２に
出力される。トランスバーサルフィルタ１２の各タップ
係数１１３，１１１，１１２，１１４，１１５はタップ
係数制御回路１３で決定される。タップ係数制御回路１
３は、積分器３３，３１，３２，３４，３５、及び相関
器３６より構成される。相関回路３６は、送信信号の推
定値と等化後のデジタル信号の差を表す誤差信号１２２
と、Ａ／Ｄ変換器１１の判定出力信号１２１とを入力と
し各タップに対応する相関値１３６，１３４，１３５，
１３７，１３８を出力する。相関回路３６の夫々の出力
１３６，１３４，１３５，１３７，１３８は積分回路３
３，３１，３２，３４，３５により時間平均されトラン
スバーサルフィルタ１２の各タップを制御するタップ係
数１１３，１１１，１１２，１１４，１１５となる。
【０００６】
【発明が解決しようとする課題】このような自動等化器
は、大きなフェージングによる波形歪を除去するために
はタップ数を増加させることが好ましい。しかしなが
ら、タップ数を多くすると収束性が損なわれる。従来の
自動等化器は、トランスバーサルフィルタのタップ数が
固定である為、両方の特性を満足することができず、フ
ェージング補償特性と収束性の一方を犠牲にしなければ
ならないという問題がある。本発明の目的は、フェージ
ング補償特性を犠牲にする事なく良好な収束性を発揮す
ることができる自動等化器を提供することにある。
は、大きなフェージングによる波形歪を除去するために
はタップ数を増加させることが好ましい。しかしなが
ら、タップ数を多くすると収束性が損なわれる。従来の
自動等化器は、トランスバーサルフィルタのタップ数が
固定である為、両方の特性を満足することができず、フ
ェージング補償特性と収束性の一方を犠牲にしなければ
ならないという問題がある。本発明の目的は、フェージ
ング補償特性を犠牲にする事なく良好な収束性を発揮す
ることができる自動等化器を提供することにある。
【０００７】
【課題を解決するための手段】本発明の自動等化器は、
Ａ／Ｄ変換器、トランスバーサルフィルタ、タップ係数
制御回路に加えて、復調器の同期外れを検出する同期外
れ検出回路を設け、かつタップ係数制御回路には夫々タ
ップ係数制御信号を出力する第１ないし第ｎの積分器を
任意にリセットするリセット回路を設け、このリセット
回路を同期外れ検出回路の出力信号に基づいて動作さ
せ、同期外れから引き込みを行うときは、予め定められ
た数の積分器をリセットするように構成する。
Ａ／Ｄ変換器、トランスバーサルフィルタ、タップ係数
制御回路に加えて、復調器の同期外れを検出する同期外
れ検出回路を設け、かつタップ係数制御回路には夫々タ
ップ係数制御信号を出力する第１ないし第ｎの積分器を
任意にリセットするリセット回路を設け、このリセット
回路を同期外れ検出回路の出力信号に基づいて動作さ
せ、同期外れから引き込みを行うときは、予め定められ
た数の積分器をリセットするように構成する。
【０００８】
【作用】同期外れ検出回路が同期外れを検出し、同期外
れから引込みを行うときはリセット回路は予め設定され
た数の積分器をリセットし、少ないタップ数とする。
又、収束された状態ではリセットを解除し、多くのタッ
プ数とする。
れから引込みを行うときはリセット回路は予め設定され
た数の積分器をリセットし、少ないタップ数とする。
又、収束された状態ではリセットを解除し、多くのタッ
プ数とする。
【０００９】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明のトランスバーサル形自動等化器の一
実施例の回路図であり、この等化器はＡ／Ｄ変換器１
１、トランスバーサルフィルタ１２、タップ係数制御回
路１３、及び同期外れ検出回路１４から構成される。前
記Ａ／Ｄ変換器１１及びトランスバーサルフィルタ１２
は従来と同じであり、端子１に入力された信号の符号間
干渉が除去されて端子２に出力される様子も従来例と同
じであるのでここでは説明を省略する。
る。図１は本発明のトランスバーサル形自動等化器の一
実施例の回路図であり、この等化器はＡ／Ｄ変換器１
１、トランスバーサルフィルタ１２、タップ係数制御回
路１３、及び同期外れ検出回路１４から構成される。前
記Ａ／Ｄ変換器１１及びトランスバーサルフィルタ１２
は従来と同じであり、端子１に入力された信号の符号間
干渉が除去されて端子２に出力される様子も従来例と同
じであるのでここでは説明を省略する。
【００１０】前記同期外れ検出回路１４の端子３には、
復調器に含まれ復調器の搬送波再生を制御する搬送波再
生回路の出力信号が入力される。この同期外れ検出回路
１４は端子３に入力された搬送波再生制御信号１００を
監視し、復調器による再生搬送波が受信信号と非同期状
態になると直ちに搬送波非同期信号１２３を出力する。
この同期外れ検出回路は、例えば特開昭48−17661 号の
様な構成で実現することができる。一方、タップ係数制
御回路１３は、積分回路３１，３２，３３，３４，３５
と相関回路３６に加えて、端子３に入力する搬送波非同
期信号１２３に基づき積分器のリセットを行うリセット
回路３７が設けられる。
復調器に含まれ復調器の搬送波再生を制御する搬送波再
生回路の出力信号が入力される。この同期外れ検出回路
１４は端子３に入力された搬送波再生制御信号１００を
監視し、復調器による再生搬送波が受信信号と非同期状
態になると直ちに搬送波非同期信号１２３を出力する。
この同期外れ検出回路は、例えば特開昭48−17661 号の
様な構成で実現することができる。一方、タップ係数制
御回路１３は、積分回路３１，３２，３３，３４，３５
と相関回路３６に加えて、端子３に入力する搬送波非同
期信号１２３に基づき積分器のリセットを行うリセット
回路３７が設けられる。
【００１１】次に、以上の構成の等化器の動作を説明す
る。尚、ここで、トランスバーサルフィルタのタップ係
数がフェージング補償のための最適値であるか或いは最
適値の近傍にあり波形歪を受けた信号を除去している状
態を収束、それ以外の状態を発散と定義する。発散時に
収束性を高めるためには、タップ数はあまり多くない方
が良い。ところが、収束時にフェージング補償特性を高
めるためにはタップ数を増やした方が良い。
る。尚、ここで、トランスバーサルフィルタのタップ係
数がフェージング補償のための最適値であるか或いは最
適値の近傍にあり波形歪を受けた信号を除去している状
態を収束、それ以外の状態を発散と定義する。発散時に
収束性を高めるためには、タップ数はあまり多くない方
が良い。ところが、収束時にフェージング補償特性を高
めるためにはタップ数を増やした方が良い。
【００１２】本発明においては、収束，発散の判断を前
記搬送波非同期信号１２３を用いて行う。即ち、搬送波
非同期信号１２３が発生していなければ収束、発生中は
発散と解釈する。又、リセット回路３７には発散した場
合リセットを行う積分回路を予め設定しておく。ここで
は仮にリセットを行う積分回路を積分回路３１，３５と
する。
記搬送波非同期信号１２３を用いて行う。即ち、搬送波
非同期信号１２３が発生していなければ収束、発生中は
発散と解釈する。又、リセット回路３７には発散した場
合リセットを行う積分回路を予め設定しておく。ここで
は仮にリセットを行う積分回路を積分回路３１，３５と
する。
【００１３】フェージングが非常に大きい場合やシステ
ムの起動時には、自動等化器は発散している。搬送波非
同期信号１２３によって発散中と判断した場合、リセッ
ト回路３７は積分回路３１，３５にリセット信号を出力
する。各タップの積分回路３１，３２，３３，３４，３
５のうち積分回路３１，３５はリセットされているため
その出力、つまりタップ係数１１１，１１５はゼロとな
り、他の積分回路３２，３３，３４は、各タップの相関
値１３５，１３６，１３７をそれぞれ積分し、各タップ
係数１１２，１１３，１１４を出力する。つまり、自動
等化器が発散している間は、３タップの自動等化器とし
て動作することになる。
ムの起動時には、自動等化器は発散している。搬送波非
同期信号１２３によって発散中と判断した場合、リセッ
ト回路３７は積分回路３１，３５にリセット信号を出力
する。各タップの積分回路３１，３２，３３，３４，３
５のうち積分回路３１，３５はリセットされているため
その出力、つまりタップ係数１１１，１１５はゼロとな
り、他の積分回路３２，３３，３４は、各タップの相関
値１３５，１３６，１３７をそれぞれ積分し、各タップ
係数１１２，１１３，１１４を出力する。つまり、自動
等化器が発散している間は、３タップの自動等化器とし
て動作することになる。
【００１４】一方、フェージングが小さくなり自動等化
器が収束すると、リセット回路３７は搬送波非同期信号
１２３により判断しリセット解除を積分器３１，３５に
出力する。このリセット解除に従い各積分器３１，３
２，３３，３４，３５は各タップ係数１１１，１１２，
１１３，１１４，１１５を出力する。これにより、５タ
ップの自動等化器として動作することになる。
器が収束すると、リセット回路３７は搬送波非同期信号
１２３により判断しリセット解除を積分器３１，３５に
出力する。このリセット解除に従い各積分器３１，３
２，３３，３４，３５は各タップ係数１１１，１１２，
１１３，１１４，１１５を出力する。これにより、５タ
ップの自動等化器として動作することになる。
【００１５】以上により、従来の自動等化器と同等の収
束特性を持たせたまま、より大きなフェージングを補償
することができる。尚、本発明の自動等化器は、同相及
び直交の２つの成分を持つ二次元ベースバンド信号が入
力の場合及びタップ係数が５タップ以外の場合にも容易
に適用することが可能である。
束特性を持たせたまま、より大きなフェージングを補償
することができる。尚、本発明の自動等化器は、同相及
び直交の２つの成分を持つ二次元ベースバンド信号が入
力の場合及びタップ係数が５タップ以外の場合にも容易
に適用することが可能である。
【００１６】
【発明の効果】以上説明したように本発明によれば、ト
ランスバーサルフィルタのタップ係数が収束しているか
否かを検出することによりタップ数を制御して、収束中
はタップ数を増やすことによりトランスバーサルフィル
タのもつ最大限の能力を発揮することが可能となる。又
タップ係数が発散している間はタップ数を従来の自動等
化器と同様の数に制限することにより、その収束性も従
来と同様の特性を得ることができる。
ランスバーサルフィルタのタップ係数が収束しているか
否かを検出することによりタップ数を制御して、収束中
はタップ数を増やすことによりトランスバーサルフィル
タのもつ最大限の能力を発揮することが可能となる。又
タップ係数が発散している間はタップ数を従来の自動等
化器と同様の数に制限することにより、その収束性も従
来と同様の特性を得ることができる。
【図１】本発明の自動等化器の一実施例のブロック図で
ある。
ある。
【図２】従来の自動等化器の一例のブロック図である。
１１ Ａ／Ｄ変換器 １２ トランスバーサルフィルタ １３ タップ係数制御回路 １４ 同期外れ検出回路 ２１〜２４ 遅延回路 ２５〜２９ 乗算器 ３０ 加算器 ３１〜３５ 積分器 ３６ 相関回路 ３７ リセット回路
Claims (1)
- 【請求項１】 デジタル無線方式の復調装置に用いられ
る自動等化器であって、多値ベースバンド信号をデジタ
ル信号に変換するアナログ・デジタル変換器と、前記デ
ジタル信号を第１ないし第ｎのタップ係数制御信号に基
づき自動等化するデジタル型トランスバーサルフィルタ
と、前記トランスバーサルフィルタにタップ係数制御信
号を出力するタップ係数制御回路と、復調器の同期外れ
を検出する同期外れ検出回路とを備え、前記タップ係数
制御回路は、前記アナログ・デジタル変換器又はデジタ
ル形トランスバーサルフィルタのいずれか一方の判定出
力を第１の入力とし前記デジタル形トランスバーサルフ
ィルタの出力のうち送信信号の推定値と前記等化された
デジタル信号との誤差分を表す誤差信号を第２の入力信
号として第１ないし第ｎタップの相関値を出力する相関
回路と、前記第１ないし第ｎのタップ係数制御信号を積
分し出力する第１ないし第ｎの積分器と、前記第１ない
し第ｎの積分器を任意にリセットするリセット回路とを
有し、前記リセット回路は前記同期外れ検出回路の出力
信号に基づき、同期外れから引き込みを行うときは、予
め定められた数の積分器をリセットするように構成した
ことを特徴とする自動等化器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31378491A JP3371256B2 (ja) | 1991-10-31 | 1991-10-31 | 自動等化器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31378491A JP3371256B2 (ja) | 1991-10-31 | 1991-10-31 | 自動等化器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05130152A true JPH05130152A (ja) | 1993-05-25 |
| JP3371256B2 JP3371256B2 (ja) | 2003-01-27 |
Family
ID=18045490
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP31378491A Expired - Lifetime JP3371256B2 (ja) | 1991-10-31 | 1991-10-31 | 自動等化器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3371256B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN1294732C (zh) * | 2003-10-31 | 2007-01-10 | 三洋电机株式会社 | 自适应均衡器 |
| JP2009094942A (ja) * | 2007-10-11 | 2009-04-30 | Fujitsu Microelectronics Ltd | 受信装置及び受信方法 |
| JP2013534385A (ja) * | 2010-07-30 | 2013-09-02 | センサス・ユーエスエー・インコーポレイテッド | Ｇｆｓｋ受信機のアーキテクチャと方法 |
-
1991
- 1991-10-31 JP JP31378491A patent/JP3371256B2/ja not_active Expired - Lifetime
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN1294732C (zh) * | 2003-10-31 | 2007-01-10 | 三洋电机株式会社 | 自适应均衡器 |
| JP2009094942A (ja) * | 2007-10-11 | 2009-04-30 | Fujitsu Microelectronics Ltd | 受信装置及び受信方法 |
| US8457189B2 (en) | 2007-10-11 | 2013-06-04 | Fujitsu Semiconductor Limited | Receiving apparatus having equalizer, and receiving method |
| JP2013534385A (ja) * | 2010-07-30 | 2013-09-02 | センサス・ユーエスエー・インコーポレイテッド | Ｇｆｓｋ受信機のアーキテクチャと方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3371256B2 (ja) | 2003-01-27 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| S533 | Written request for registration of change of name |
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