JPH0469053A - Ａ／ｄコンバータ内蔵型ｄｃ―ｄｃコンバータ - Google Patents
Ａ／ｄコンバータ内蔵型ｄｃ―ｄｃコンバータInfo
- Publication number
- JPH0469053A JPH0469053A JP17347390A JP17347390A JPH0469053A JP H0469053 A JPH0469053 A JP H0469053A JP 17347390 A JP17347390 A JP 17347390A JP 17347390 A JP17347390 A JP 17347390A JP H0469053 A JPH0469053 A JP H0469053A
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- JP
- Japan
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- output voltage
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- 239000003990 capacitor Substances 0.000 abstract description 5
- 238000006243 chemical reaction Methods 0.000 description 4
- 238000010586 diagram Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、Ａ／Ｄコンバータを内蔵したＤＣＤＣコンバ
ータに関するものである。
ータに関するものである。
従来の技術
近年、ＤＣ−ＤＣコンバータはより高精度な出力電圧を
取り出し、かつ低消費電力化の実現が求められている。
取り出し、かつ低消費電力化の実現が求められている。
以下に従来のＤＣ−ＤＣコンバータについて説明する。
第２図は従来のＤＣ−ＤＣコンバータの電圧変換制御回
路を示すものである。第２図において、１は基準電圧発
生回路である。２は出力電圧分圧回路で、抵抗により出
力電圧を分圧する。３は比較器である。４は基準クロッ
ク発生回路で、５はＮＡＮＤゲートである。６はＮチャ
ネルＭＯ３ＦＥＴで、７はコイルである。８はコンデン
サで、９はダイオードである。以上のように構成された
ＤＣ−ＤＣコンバータについて以下その動作について説
明する。
路を示すものである。第２図において、１は基準電圧発
生回路である。２は出力電圧分圧回路で、抵抗により出
力電圧を分圧する。３は比較器である。４は基準クロッ
ク発生回路で、５はＮＡＮＤゲートである。６はＮチャ
ネルＭＯ３ＦＥＴで、７はコイルである。８はコンデン
サで、９はダイオードである。以上のように構成された
ＤＣ−ＤＣコンバータについて以下その動作について説
明する。
まず出力電圧を抵抗によって分圧した電圧を、比較器に
おいて基準電圧と比較することによって、ＮチャネルＭ
Ｏ３ＦＥＴを制御する。これによって一定の出力電圧を
得るものである。
おいて基準電圧と比較することによって、ＮチャネルＭ
Ｏ３ＦＥＴを制御する。これによって一定の出力電圧を
得るものである。
発明が解決しようとする課題
しかしながら上記の従来の構成では、出力電圧を分圧す
る抵抗の精度にばらつきがあるために、高精度な出力電
圧が得られない。また上記の抵抗の精度を上げることが
容易でない。また回路構成上一義的な出力電圧の値しか
取り出せない。
る抵抗の精度にばらつきがあるために、高精度な出力電
圧が得られない。また上記の抵抗の精度を上げることが
容易でない。また回路構成上一義的な出力電圧の値しか
取り出せない。
本発明はこのような従来の問題を解決するもので、出力
変動の少ない高精度な出力電圧を有しかつ任意の出力電
圧を取り出せるＤＣ−ＤＣコンバータを提供することを
目的とする。
変動の少ない高精度な出力電圧を有しかつ任意の出力電
圧を取り出せるＤＣ−ＤＣコンバータを提供することを
目的とする。
課題を解決するための手段
この目的を達成するために本発明のＡ／Ｄコンバータ内
蔵型ＤＣ−ＤＣコンバータは、ＤＣ−ＤＣコンバータの
出力のレベルが、あらかじめ設定されたメモリ回路の値
と一致するかを比較する比較器と、この比較器の比較結
果に基づいて基準クロック発生回路を制御する制御手段
とを備えたＤＣＤＣコンバータにおいて、上記制御手段
は、基準クロック信号を発生する基準クロック発生回路
とあらかじめ出力信号レベルを設定するメモリ回路と出
力信号レベルをＡ／Ｄ変換するためのＡ／Ｄコンバータ
回路とを備え、上記二つを比較する比較器と、上記の比
較結果に基づいて、上記基準クロック発生回路の出力を
制御する回路を備えた構成を有している。
蔵型ＤＣ−ＤＣコンバータは、ＤＣ−ＤＣコンバータの
出力のレベルが、あらかじめ設定されたメモリ回路の値
と一致するかを比較する比較器と、この比較器の比較結
果に基づいて基準クロック発生回路を制御する制御手段
とを備えたＤＣＤＣコンバータにおいて、上記制御手段
は、基準クロック信号を発生する基準クロック発生回路
とあらかじめ出力信号レベルを設定するメモリ回路と出
力信号レベルをＡ／Ｄ変換するためのＡ／Ｄコンバータ
回路とを備え、上記二つを比較する比較器と、上記の比
較結果に基づいて、上記基準クロック発生回路の出力を
制御する回路を備えた構成を有している。
作用
本発明の上記の構成によれば、Ａ／Ｄコン１＜ −夕回
路の精度が高まり、出力電圧の精度が向上する。またメ
モリ回路の値を任意に設定することによってそれに応じ
た任意の出力電圧が取り出せる。
路の精度が高まり、出力電圧の精度が向上する。またメ
モリ回路の値を任意に設定することによってそれに応じ
た任意の出力電圧が取り出せる。
実施例
以下本発明の実施例について、図面を参照しながら説明
する。第１図は本発明の実施例におけるＡ／Ｄコンバー
タ内蔵型ＤＣ−ＤＣコンバータの電圧変換制御回路を示
す回路図である。第１図において、１１はメモリ回路、
１２はＡ／Ｄコン／く−タ回路、１３は比較器、１４は
基準クロック発生回路、１５はＮＡＮＤゲート、１６は
ＮチャネルＭＯ８ＦＥＴ、１７はコイル、１８はコンデ
ンサ、１９はダイオードである。
する。第１図は本発明の実施例におけるＡ／Ｄコンバー
タ内蔵型ＤＣ−ＤＣコンバータの電圧変換制御回路を示
す回路図である。第１図において、１１はメモリ回路、
１２はＡ／Ｄコン／く−タ回路、１３は比較器、１４は
基準クロック発生回路、１５はＮＡＮＤゲート、１６は
ＮチャネルＭＯ８ＦＥＴ、１７はコイル、１８はコンデ
ンサ、１９はダイオードである。
以上のように構成されたＡ／Ｄコンバータ内蔵型ＤＣ−
ＤＣコンバータについて、以下その動作について説明す
る。
ＤＣコンバータについて、以下その動作について説明す
る。
まずＤＣ−ＤＣコンバータの出力電圧を、Ａ／Ｄコンバ
ータ回路１２でデジタルに変換し、あらかじめ設定した
メモリ回路１１の値と比較する。
ータ回路１２でデジタルに変換し、あらかじめ設定した
メモリ回路１１の値と比較する。
メモリ回路の値より低いとき比較器１３の出力が高レベ
ルになり、基準クロック発生回路１４の出力がＮＡＮＤ
ゲート１５を通ってＮチャネルＭＯ８ＦＥＴ１６をオン
させる。スイッチオンの半サイクルにおいてコイル１７
にエネルギーが蓄積され、次のスイッチオンの半サイク
ルにおいてコイル１７に蓄積された磁力エネルギーが逆
起電圧として発生し、ダイオード１９を順バイアス方向
にして、出力端子にあるコンデンサ１８をチャージする
。
ルになり、基準クロック発生回路１４の出力がＮＡＮＤ
ゲート１５を通ってＮチャネルＭＯ８ＦＥＴ１６をオン
させる。スイッチオンの半サイクルにおいてコイル１７
にエネルギーが蓄積され、次のスイッチオンの半サイク
ルにおいてコイル１７に蓄積された磁力エネルギーが逆
起電圧として発生し、ダイオード１９を順バイアス方向
にして、出力端子にあるコンデンサ１８をチャージする
。
この動作をＡ／Ｄコンバータ回路１２の出力電圧がメモ
リ回路１１の設定値と一致するまでおこない、高くなる
と比較器１３の出力が低レベルとなって基準クロック発
生回路１４の出力を停止させ、コンデンサ１８へのチャ
ージを停止する。
リ回路１１の設定値と一致するまでおこない、高くなる
と比較器１３の出力が低レベルとなって基準クロック発
生回路１４の出力を停止させ、コンデンサ１８へのチャ
ージを停止する。
このようにしてＡ／Ｄコンバータ回路１２の出力電圧の
値とメモリ回路１１の値とを比較することによって、Ｄ
Ｃ−ＤＣコンバータの出力電圧の値を一定に保つ。
値とメモリ回路１１の値とを比較することによって、Ｄ
Ｃ−ＤＣコンバータの出力電圧の値を一定に保つ。
以上のように本実施例によれば、ＤＣ−ＤＣコンバータ
の出力段に、従来の抵抗による出力電圧分圧回路に対し
て高精度なＡ／Ｄコンバータを用い、また従来の基準電
圧発生回路に対してメモリ回路を用いて、出力電圧を基
準電圧値と比較器により比較することによって正確な電
圧制御が実現でき、高精度なりＣ−ＤＣコンバータの出
力電圧が得られる。またメモリ回路の値を任意に設定す
ることによってそれに応じた任意の出力電圧を取り出す
ことができる。
の出力段に、従来の抵抗による出力電圧分圧回路に対し
て高精度なＡ／Ｄコンバータを用い、また従来の基準電
圧発生回路に対してメモリ回路を用いて、出力電圧を基
準電圧値と比較器により比較することによって正確な電
圧制御が実現でき、高精度なりＣ−ＤＣコンバータの出
力電圧が得られる。またメモリ回路の値を任意に設定す
ることによってそれに応じた任意の出力電圧を取り出す
ことができる。
発明の効果
以上のように本発明はＡ／Ｄコンバータ回路とメモリ回
路を用いることによって、高精度な出力電圧が得られ、
またメモリ回路の値を任意に設定することによってそれ
に応じた任意の出力電圧を取り出すことができる優れた
ＤＣ−ＤＣコンバータを実現できるものである。またＣ
ＭＯ８構造にすることによって、低消費電力化を図るこ
とができる。
路を用いることによって、高精度な出力電圧が得られ、
またメモリ回路の値を任意に設定することによってそれ
に応じた任意の出力電圧を取り出すことができる優れた
ＤＣ−ＤＣコンバータを実現できるものである。またＣ
ＭＯ８構造にすることによって、低消費電力化を図るこ
とができる。
第１図は本発明の実施例におけるＡ／Ｄコンバータ内蔵
型ＤＣ−ＤＣコンバータの電圧変換制御回路図、第２図
は従来のＤＣ−ＤＣコンバータの電圧変換制御回路図で
ある。 １１・・・・・・メモリ回路、１２・・・・・・Ａ／Ｄ
コンバータ回路、１３・・・・・・比較器、１４・・・
・・・基準クロック発生回路、１５・・・・・・ＮＡＮ
Ｄゲート、１６・・・・・・ＮチャネルＭＯ８ＦＥＴ０ 代理人の氏名 弁理士 粟野重孝 ほか１名７５・ＮＡ
ＮＤ′ｆ−ト １６ ・ Ｎチャ宇ル閃Ｏ３ＦＥＴ
型ＤＣ−ＤＣコンバータの電圧変換制御回路図、第２図
は従来のＤＣ−ＤＣコンバータの電圧変換制御回路図で
ある。 １１・・・・・・メモリ回路、１２・・・・・・Ａ／Ｄ
コンバータ回路、１３・・・・・・比較器、１４・・・
・・・基準クロック発生回路、１５・・・・・・ＮＡＮ
Ｄゲート、１６・・・・・・ＮチャネルＭＯ８ＦＥＴ０ 代理人の氏名 弁理士 粟野重孝 ほか１名７５・ＮＡ
ＮＤ′ｆ−ト １６ ・ Ｎチャ宇ル閃Ｏ３ＦＥＴ
Claims (1)
- ＤＣ−ＤＣコンバータの出力のレベルがあらかじめ設定
されたメモリ回路の値と一致するかを比較する比較器と
、この比較器の比較結果に基づいて基準クロック発生回
路を制御する制御手段とを備えたＤＣ−ＤＣコンバータ
において、上記制御手段は、基準クロック信号を発生す
る基準クロック発生回路と、あらかじめ出力信号レベル
を設定するメモリ回路と、出力信号レベルをＡ／Ｄ変換
するためのＡ／Ｄコンバータ回路とを備え、上記メモリ
回路の出力と上記Ａ／Ｄコンバータ回路の出力を比較す
る比較器と、上記の比較結果に基づいて、上記基準クロ
ック発生回路の出力を制御する回路を備えたことを特徴
とするＡ／Ｄコンバータ内蔵型ＤＣ−ＤＣコンバータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17347390A JPH0469053A (ja) | 1990-06-29 | 1990-06-29 | Ａ／ｄコンバータ内蔵型ｄｃ―ｄｃコンバータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17347390A JPH0469053A (ja) | 1990-06-29 | 1990-06-29 | Ａ／ｄコンバータ内蔵型ｄｃ―ｄｃコンバータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0469053A true JPH0469053A (ja) | 1992-03-04 |
Family
ID=15961137
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17347390A Pending JPH0469053A (ja) | 1990-06-29 | 1990-06-29 | Ａ／ｄコンバータ内蔵型ｄｃ―ｄｃコンバータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0469053A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015515172A (ja) * | 2012-02-24 | 2015-05-21 | クゥアルコム・インコーポレイテッドＱｕａｌｃｏｍｍ Ｉｎｃｏｒｐｏｒａｔｅｄ | 負荷スイッチコントローラのための方法および装置 |
-
1990
- 1990-06-29 JP JP17347390A patent/JPH0469053A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015515172A (ja) * | 2012-02-24 | 2015-05-21 | クゥアルコム・インコーポレイテッドＱｕａｌｃｏｍｍ Ｉｎｃｏｒｐｏｒａｔｅｄ | 負荷スイッチコントローラのための方法および装置 |
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