JPH0461561A - 画像処理装置 - Google Patents
画像処理装置Info
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- JPH0461561A JPH0461561A JP2171838A JP17183890A JPH0461561A JP H0461561 A JPH0461561 A JP H0461561A JP 2171838 A JP2171838 A JP 2171838A JP 17183890 A JP17183890 A JP 17183890A JP H0461561 A JPH0461561 A JP H0461561A
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- 230000002093 peripheral effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 4
- 238000000034 method Methods 0.000 description 3
- 101000685663 Homo sapiens Sodium/nucleoside cotransporter 1 Proteins 0.000 description 2
- 101000821827 Homo sapiens Sodium/nucleoside cotransporter 2 Proteins 0.000 description 2
- 102100023116 Sodium/nucleoside cotransporter 1 Human genes 0.000 description 2
- 102100021541 Sodium/nucleoside cotransporter 2 Human genes 0.000 description 2
- 230000003111 delayed effect Effects 0.000 description 1
- 238000001914 filtration Methods 0.000 description 1
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
- 230000016507 interphase Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
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- Image Processing (AREA)
- Editing Of Facsimile Originals (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、イメージスキャナやファクシミリ装置に利用
する。特に、読み取られた画像信号のフィルタ処理を行
う手段に関する。
する。特に、読み取られた画像信号のフィルタ処理を行
う手段に関する。
本発明は、画像信号に対するフィルタ処理手段において
、 適応したフィルタ処理を画像信号を入力する都度行うこ
とにより、 画像信号の再現性を向上させることができるようにした
ものである。
、 適応したフィルタ処理を画像信号を入力する都度行うこ
とにより、 画像信号の再現性を向上させることができるようにした
ものである。
画像処理装置では、一般に、画像の再現性を向上させる
たｔに画像信号に対してフィルタ処理を行う。フィルタ
処理は近年はディジタル回路を使用した処理が主流であ
る。これは画素単位に入力される画像信号の積和などを
演算するものであり、そのフィルタ特性は、注目画素と
参照画素の離散距離と、タップ数および積和時の各タッ
プ画素の重み付は係数とにより決定される。
たｔに画像信号に対してフィルタ処理を行う。フィルタ
処理は近年はディジタル回路を使用した処理が主流であ
る。これは画素単位に入力される画像信号の積和などを
演算するものであり、そのフィルタ特性は、注目画素と
参照画素の離散距離と、タップ数および積和時の各タッ
プ画素の重み付は係数とにより決定される。
従来、この種のフィルタ処理を行う画像処理装置は、あ
らかじめ設定されたフィルタ特性により入力される画像
信号を一律に処理していた。このフィルタ特性としては
、解像度補正の目的から高域強調特性が使用されること
が多い。
らかじめ設定されたフィルタ特性により入力される画像
信号を一律に処理していた。このフィルタ特性としては
、解像度補正の目的から高域強調特性が使用されること
が多い。
このような従来の画像処理装置は、あらかじめ設定され
たフィルタ特性により入力される画像信号を一律に処理
しているので、原画像に最適なフィルタ処理結果が必ず
しも得られない欠点がある。
たフィルタ特性により入力される画像信号を一律に処理
しているので、原画像に最適なフィルタ処理結果が必ず
しも得られない欠点がある。
また、高域強調特性を強くすると、画像エツジ部で強調
効果によるいわゆる縁が付き、視覚上好ましくない欠点
がある。
効果によるいわゆる縁が付き、視覚上好ましくない欠点
がある。
本発明は、このような欠点を除去するもので、画像に対
して最適なフィルタ処理結果が得られる画像処理装置を
提供することを目的とする。
して最適なフィルタ処理結果が得られる画像処理装置を
提供することを目的とする。
本発明は、画像データの内の注目画素データと、この注
目画素データに対応する画素から所定の相間距離にある
画素に対応する参照画素データとを画素単位に入力され
るたびに一時格納する画素格納手段と、この画素格納手
段のそれぞれの出力が与えられる乗算回路を含むフィル
タ手段と、複数個のフィルタ係数を格納し、与えられた
指示信号に応じたフィルタ係数を上記乗算回路のそれぞ
れに与える係数記憶手段であるフィルタ係数記憶回路と
を備えた画像処理装置において、上記係数記憶手段は、
複数個のフィルタ係数を格納し、この複数個のフィルタ
係数のひとつを選択して上記乗算回路のそれぞれに与え
る選択手段を備えたことを特徴とする。
目画素データに対応する画素から所定の相間距離にある
画素に対応する参照画素データとを画素単位に入力され
るたびに一時格納する画素格納手段と、この画素格納手
段のそれぞれの出力が与えられる乗算回路を含むフィル
タ手段と、複数個のフィルタ係数を格納し、与えられた
指示信号に応じたフィルタ係数を上記乗算回路のそれぞ
れに与える係数記憶手段であるフィルタ係数記憶回路と
を備えた画像処理装置において、上記係数記憶手段は、
複数個のフィルタ係数を格納し、この複数個のフィルタ
係数のひとつを選択して上記乗算回路のそれぞれに与え
る選択手段を備えたことを特徴とする。
ここで、上記選択手段は、上記画素格納手段に格納され
た周辺画素データの平均値データを求める演算手段と、
この演算手段で求められた平均値データと上記画素格納
手段に格納された注目画素データとの差分を求め、この
差分に相当の指示信号を上記係数記憶手段に与える減算
回路とを備えることが望まれる。
た周辺画素データの平均値データを求める演算手段と、
この演算手段で求められた平均値データと上記画素格納
手段に格納された注目画素データとの差分を求め、この
差分に相当の指示信号を上記係数記憶手段に与える減算
回路とを備えることが望まれる。
また、上記選択手段は、入力される画像データの１ライ
ンに相当する画素数を計数する計数手段と、この計数手
段の計数結果と別に入力されるフィルタ処理範囲サイズ
を示すマスク信号とに基づき複数の画素処理イネーブル
信号の画素数を演算して、この画素数を示す画素数信号
を生成する画素数演算手段と、この画素数信号に基づき
上記係数記憶手段をイネーブルにするイネーブル信号を
発生するイネーブル信号発生手段とを備えることが好ま
しい。
ンに相当する画素数を計数する計数手段と、この計数手
段の計数結果と別に入力されるフィルタ処理範囲サイズ
を示すマスク信号とに基づき複数の画素処理イネーブル
信号の画素数を演算して、この画素数を示す画素数信号
を生成する画素数演算手段と、この画素数信号に基づき
上記係数記憶手段をイネーブルにするイネーブル信号を
発生するイネーブル信号発生手段とを備えることが好ま
しい。
一律の処理に代わり、フィルタ特性を原画像に応じて変
化させた処理を行い、画像信号の再現性を向上させる。
化させた処理を行い、画像信号の再現性を向上させる。
また、画像エツジ部分については、段階的にフィルタ特
性を設定して、いわゆる縁付き現象の発生を防止する。
性を設定して、いわゆる縁付き現象の発生を防止する。
以下、本発明の一実施例について図面を参照して説明す
る。第１図は、この一実施例を示すブロック図である。
る。第１図は、この一実施例を示すブロック図である。
この実施例は、第１図に示すように、画像デー夕の内の
注目画素データと、この注目画素データに対応する画素
から所定の相間距離にある画素に対応する参照画素デー
タとを画素単位に入力されるたびに一時格納する画素格
納手段である１画素遅延素子９ａ 、 ９ｂおよび９Ｃ
と、この画素格納手段のそれぞれの出力が与えられる乗
算回路１０ａ１１０ｂおよびＩＯＣを含むフィルタ手段
である有限時間インパルス応答フィルタと、複数個のフ
ィルタ係数を格納し、与えられた指示信号に応じたフィ
ルタ係数を上記乗算回路１０ａ、１０ｂおよびＩＯＣの
それぞれに与える係数記憶手段であるフィルタ係数記憶
回路７とを備え、さらに、本発明の特徴とする手段とし
て、上記係数記憶手段は、複数個のフィルタ係数を格納
し、この複数個のフィルタ係数のひとつを選択して上記
乗算回路１０ａ 、 １０ｂおよびＩＯＣのそれぞれに
与える選択手段を備え、ここで、上記選択手段は、上記
画素格納手段に格納された周辺画素データの平均値デー
タを求める演算手段である平均値演算回路５と、この演
算手段で求められた平均値データと上記画素格納手段に
格納された注目画素データとの差分を求め、この差分に
相当の指示信号を上記係数記憶手段に与える減算回路６
と、入力される画像データの１ラインに相当する画素数
を計数する計数手段である１ライン画素数計数回路１と
、この計数手段の計数結果と別に入力されるフィルタ処
理範囲サイズを示すマスク信号とに基づき複数の画素処
理イネーブル信号の画素数を演算して、この画素数を示
す画素数信号を生成する画素格納手段である画像処理イ
ネーブル信号画素数演算回路４と、この画素数信号に基
づき上記係数記憶手段をイネーブルにするイネーブル信
号を発生するイネーブル信号発生手段である画像処理イ
ネーブル信号ＥＮＩ発生回路２および画像処理イネーブ
ル信号ＥＮ２発生回路３とを備える。
注目画素データと、この注目画素データに対応する画素
から所定の相間距離にある画素に対応する参照画素デー
タとを画素単位に入力されるたびに一時格納する画素格
納手段である１画素遅延素子９ａ 、 ９ｂおよび９Ｃ
と、この画素格納手段のそれぞれの出力が与えられる乗
算回路１０ａ１１０ｂおよびＩＯＣを含むフィルタ手段
である有限時間インパルス応答フィルタと、複数個のフ
ィルタ係数を格納し、与えられた指示信号に応じたフィ
ルタ係数を上記乗算回路１０ａ、１０ｂおよびＩＯＣの
それぞれに与える係数記憶手段であるフィルタ係数記憶
回路７とを備え、さらに、本発明の特徴とする手段とし
て、上記係数記憶手段は、複数個のフィルタ係数を格納
し、この複数個のフィルタ係数のひとつを選択して上記
乗算回路１０ａ 、 １０ｂおよびＩＯＣのそれぞれに
与える選択手段を備え、ここで、上記選択手段は、上記
画素格納手段に格納された周辺画素データの平均値デー
タを求める演算手段である平均値演算回路５と、この演
算手段で求められた平均値データと上記画素格納手段に
格納された注目画素データとの差分を求め、この差分に
相当の指示信号を上記係数記憶手段に与える減算回路６
と、入力される画像データの１ラインに相当する画素数
を計数する計数手段である１ライン画素数計数回路１と
、この計数手段の計数結果と別に入力されるフィルタ処
理範囲サイズを示すマスク信号とに基づき複数の画素処
理イネーブル信号の画素数を演算して、この画素数を示
す画素数信号を生成する画素格納手段である画像処理イ
ネーブル信号画素数演算回路４と、この画素数信号に基
づき上記係数記憶手段をイネーブルにするイネーブル信
号を発生するイネーブル信号発生手段である画像処理イ
ネーブル信号ＥＮＩ発生回路２および画像処理イネーブ
ル信号ＥＮ２発生回路３とを備える。
次に、この実施例の動作を説肋する。
端子Ｔ１から入力される画像信号ＩＤは、１ライン遅延
素子８で１ライン分遅延され、１画素遅延素子９ａ 、
９ｂおよび９ｃに順次入力され、それぞれの出力として
ＩＤＩ、ＩＤ２およびＩＤ３信号が得られる。ここで、
■ライン分遅延するのは後述の画像処理イネーブル信号
ＥＮＯ１ＥＮＩおよびＥＮ２とタイミングを一致させる
ためである。ＩＤ２信号は、中心データすなわちフィル
タ処理の注目画素として扱われる。ＩＤＩおよびＪＤ３
信号は平均値演算回路５に入力され、この回路で平均値
が演算され、ＡＶＲ信号として出力される。減算回路６
にはＡＶＲ信号と注目画素を示すＩＤ２信号とが入力さ
れ、この二つの信号の差分がＤＩＦ信号として出力され
る。フィルタ係数記憶回路７は、このＤＩＦ信号の値に
応じて、格納されているフィルタ係数信号Ｃ０ＥＦ １
、Ｃ０ＥＦ２およびＣ０ＥＦ３を乗算回路ｌＱａ 、
１０ｂおよび１０ｃにそれぞれ入力する。１画素遅延素
子９ａ、９ｂおよび９ｃと、乗算回路１０ａ 、 １０
ｂおよび１０ｃと、加算回路１１とは３タツプのＦＩＲ
フィルタを構成しており、画像信号ＩＤに対してフィル
タ処理を行い、その結果を端子Ｔ２から画像信号ＯＤと
して８カする。
素子８で１ライン分遅延され、１画素遅延素子９ａ 、
９ｂおよび９ｃに順次入力され、それぞれの出力として
ＩＤＩ、ＩＤ２およびＩＤ３信号が得られる。ここで、
■ライン分遅延するのは後述の画像処理イネーブル信号
ＥＮＯ１ＥＮＩおよびＥＮ２とタイミングを一致させる
ためである。ＩＤ２信号は、中心データすなわちフィル
タ処理の注目画素として扱われる。ＩＤＩおよびＪＤ３
信号は平均値演算回路５に入力され、この回路で平均値
が演算され、ＡＶＲ信号として出力される。減算回路６
にはＡＶＲ信号と注目画素を示すＩＤ２信号とが入力さ
れ、この二つの信号の差分がＤＩＦ信号として出力され
る。フィルタ係数記憶回路７は、このＤＩＦ信号の値に
応じて、格納されているフィルタ係数信号Ｃ０ＥＦ １
、Ｃ０ＥＦ２およびＣ０ＥＦ３を乗算回路ｌＱａ 、
１０ｂおよび１０ｃにそれぞれ入力する。１画素遅延素
子９ａ、９ｂおよび９ｃと、乗算回路１０ａ 、 １０
ｂおよび１０ｃと、加算回路１１とは３タツプのＦＩＲ
フィルタを構成しており、画像信号ＩＤに対してフィル
タ処理を行い、その結果を端子Ｔ２から画像信号ＯＤと
して８カする。
フィルタ係数記憶回路７には、別に画像処理イネーブル
信号ＥＮｏＸＥＮＩおよびＥＮ２が第３図に示すタイム
チャートで入力されており、画像エツジ部近傍で段階的
にフィルタ係数を設定する。
信号ＥＮｏＸＥＮＩおよびＥＮ２が第３図に示すタイム
チャートで入力されており、画像エツジ部近傍で段階的
にフィルタ係数を設定する。
１ライン画素数計数回路１は、端子Ｔ４〜Ｔ７から入力
される５ＹＮＣ信号、ＶＥＮＢ信号、ＨＥＮＢ信号およ
びＣＫ倍信号より、先頭１ラインの画像信号を入力中に
その画素数を計数し、ＣＮＴＯ信号として出力する。こ
こで、５ＹＮＣ信号は１ラインごとの区切りを示す同期
信号、ＶＥＮＢ信号は１ページの区切りを示す信号、Ｈ
ＥＮＢ信号は１ラインの画像信号の区切りを示す信号、
ＣＫ倍信号端子Ｔ１から入力される入力画像信号ＩＤに
同期した画素クロックである。画像処理イネーブル信号
画素数演算回路４は、端子Ｔ３から入力される画像エツ
ジからの画素数を示すＭＡ Ｓ Ｋ信号とＣＮＴＯ信号
とから、第２および第３の画像処理イネーブル信号の画
Ｓ数をＣＮＴｌ信号およびＣＮＴ２信号として出力する
。画像処理イネーブル信号ＥＮＩ発生回路２および画像
処理イネーブル信号ＥＮ２発生回路３は、ＣＮＴ１信号
およびＣＮＴ２信号により、画像処理イネーブル信号Ｅ
ＮＩ信号およびＥＮ２信号をフィルタ係数記憶回路７に
出力する。
される５ＹＮＣ信号、ＶＥＮＢ信号、ＨＥＮＢ信号およ
びＣＫ倍信号より、先頭１ラインの画像信号を入力中に
その画素数を計数し、ＣＮＴＯ信号として出力する。こ
こで、５ＹＮＣ信号は１ラインごとの区切りを示す同期
信号、ＶＥＮＢ信号は１ページの区切りを示す信号、Ｈ
ＥＮＢ信号は１ラインの画像信号の区切りを示す信号、
ＣＫ倍信号端子Ｔ１から入力される入力画像信号ＩＤに
同期した画素クロックである。画像処理イネーブル信号
画素数演算回路４は、端子Ｔ３から入力される画像エツ
ジからの画素数を示すＭＡ Ｓ Ｋ信号とＣＮＴＯ信号
とから、第２および第３の画像処理イネーブル信号の画
Ｓ数をＣＮＴｌ信号およびＣＮＴ２信号として出力する
。画像処理イネーブル信号ＥＮＩ発生回路２および画像
処理イネーブル信号ＥＮ２発生回路３は、ＣＮＴ１信号
およびＣＮＴ２信号により、画像処理イネーブル信号Ｅ
ＮＩ信号およびＥＮ２信号をフィルタ係数記憶回路７に
出力する。
第２図は、画像エツジ部での縁の発生を視覚的に示した
図であり、入力画像に対して高域強調特性のフィルタ処
理を行った場合を表しており、前述のように、画像処理
イネーブル信号に基づき画像エツジ部で段階的フィルタ
係数を設定することにより解決される。
図であり、入力画像に対して高域強調特性のフィルタ処
理を行った場合を表しており、前述のように、画像処理
イネーブル信号に基づき画像エツジ部で段階的フィルタ
係数を設定することにより解決される。
本実施例では、主走査方向における３タツプＦＩＲフイ
ルタについて説明したが、副走査ならびに主・副走査方
向を組み合わせた構成が可能なことは明白であり、本発
明を限定するものではない。
ルタについて説明したが、副走査ならびに主・副走査方
向を組み合わせた構成が可能なことは明白であり、本発
明を限定するものではない。
また、注目画素と周辺画素の相間距離については、フィ
ルタ処理とは別に設定可能であることも明白であり、本
発明を限定するものではない。
ルタ処理とは別に設定可能であることも明白であり、本
発明を限定するものではない。
本発明は、以上説明したように、入力画像に適応してフ
ィルタ処理を行うことにより、画像信号の再現性を向上
させ、また複数の画像処理イネーブル信号により入力画
像のエツジ部で段階的にフィルタ特性を設定することに
より、フィルタ処理による不自然な縁を防止する効果が
ある。
ィルタ処理を行うことにより、画像信号の再現性を向上
させ、また複数の画像処理イネーブル信号により入力画
像のエツジ部で段階的にフィルタ特性を設定することに
より、フィルタ処理による不自然な縁を防止する効果が
ある。
第１図は本発明実施例の構成を示すブロック構成図。
第２図は入力画像エツジ部における縁の説明ならびに３
通りの画像処理イネーブル信号の相関関係を示す図。 第３図は本発明実施例の動作を示すタイムチャート。 １・・・１ライン画素数計数回路、２・・・画像処理イ
ネーブル信号ＥＮＩ発生回路、３・・・画像処理イネー
ブル信号ＥＮ２発生回路、４・・・画像処理イネーブル
信号画素数演算回路、５・・・平均値演算回路、６・・
・減算回路、７・・・フィルタ係数記憶回路、８・・１
ライン遅延素子、９ａ 、９ｂ 、９ｃ・・・１画素遅
延素子、１０ａ、１０ｂ、１０Ｃ・・・乗算回路、１１
・・・加算回路、ＴＩ、Ｔ２、Ｔ３、Ｔ４、Ｔ５、Ｔ６
、ＴＩ・・・端子。
通りの画像処理イネーブル信号の相関関係を示す図。 第３図は本発明実施例の動作を示すタイムチャート。 １・・・１ライン画素数計数回路、２・・・画像処理イ
ネーブル信号ＥＮＩ発生回路、３・・・画像処理イネー
ブル信号ＥＮ２発生回路、４・・・画像処理イネーブル
信号画素数演算回路、５・・・平均値演算回路、６・・
・減算回路、７・・・フィルタ係数記憶回路、８・・１
ライン遅延素子、９ａ 、９ｂ 、９ｃ・・・１画素遅
延素子、１０ａ、１０ｂ、１０Ｃ・・・乗算回路、１１
・・・加算回路、ＴＩ、Ｔ２、Ｔ３、Ｔ４、Ｔ５、Ｔ６
、ＴＩ・・・端子。
Claims (1)
- 【特許請求の範囲】 １、画像データの内の注目画素データと、この注目画素
データに対応する画素から所定の相間距離にある画素に
対応する参照画素データとを画素単位に入力されるたび
に一時格納する画素格納手段と、 この画素格納手段のそれぞれの出力が与えられる乗算回
路を含むフィルタ手段と、複数個のフィルタ係数を格納
し、与えられた指示信号に応じたフィルタ係数を上記乗
算回路のそれぞれに与える係数記憶手段であるフィルタ
係数記憶回路とを備えた画像処理装置において、 上記係数記憶手段は、複数個のフィルタ係数を格納し、 この複数個のフィルタ係数のひとつを選択して上記乗算
回路のそれぞれに与える選択手段 を備えたことを特徴とする画像処理装置。 ２、上記選択手段は、上記画素格納手段に格納された周
辺画素データの平均値データを求める演算手段と、この
演算手段で求められた平均値データと上記画素格納手段
に格納された注目画素データとの差分を求め、この差分
に相当の指示信号を上記係数記憶手段に与える減算回路
とを備えた請求項１記載の画像処理装置。 ３、上記選択手段は、入力される画像データの１ライン
に相当する画素数を計数する計数手段と、この計数手段
の計数結果と別に入力されるフィルタ処理範囲サイズを
示すマスク信号とに基づき複数の画素処理イネーブル信
号の画素数を演算して、この画素数を示す画素数信号を
生成する画素数演算手段と、この画素数信号に基づき上
記係数記憶手段をイネーブルにするイネーブル信号を発
生するイネーブル信号発生手段とを備えた請求項２記載
の画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2171838A JPH0461561A (ja) | 1990-06-29 | 1990-06-29 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2171838A JPH0461561A (ja) | 1990-06-29 | 1990-06-29 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0461561A true JPH0461561A (ja) | 1992-02-27 |
Family
ID=15930696
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2171838A Pending JPH0461561A (ja) | 1990-06-29 | 1990-06-29 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0461561A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0633535A4 (en) * | 1993-01-22 | 1994-11-24 | Olympus Optical Co | IMAGE PROCESSING UNIT. |
| US8089639B2 (en) | 2006-05-31 | 2012-01-03 | Kyocera Mita Corporation | Image forming apparatus with image density change portion for gradually reducing image density from an outer periphery of a character toward an inside |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63204973A (ja) * | 1987-02-20 | 1988-08-24 | Ricoh Co Ltd | 中間調画像処理装置 |
| JPH0332160A (ja) * | 1989-06-29 | 1991-02-12 | Nec Corp | 画像処理装置 |
-
1990
- 1990-06-29 JP JP2171838A patent/JPH0461561A/ja active Pending
Patent Citations (2)
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|---|---|---|---|---|
| JPS63204973A (ja) * | 1987-02-20 | 1988-08-24 | Ricoh Co Ltd | 中間調画像処理装置 |
| JPH0332160A (ja) * | 1989-06-29 | 1991-02-12 | Nec Corp | 画像処理装置 |
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| EP0633535A1 (en) * | 1993-01-22 | 1995-01-11 | Olympus Optical Co., Ltd. | Image processor |
| US5608824A (en) * | 1993-01-22 | 1997-03-04 | Olympus Optical Co., Ltd. | Image processing apparatus in which filters having different filtering characteristics can be switched among themselves |
| US8089639B2 (en) | 2006-05-31 | 2012-01-03 | Kyocera Mita Corporation | Image forming apparatus with image density change portion for gradually reducing image density from an outer periphery of a character toward an inside |
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