JPH04367250A - Manufacture of semiconductor chip - Google Patents
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Abstract
Description
【0001】0001
【産業上の利用分野】 本発明は半導体チップの製造
方法に関し、特にパターン形成されたウェハを切断し、
半導体チップを製造する方法に関する。[Industrial Application Field] The present invention relates to a method for manufacturing semiconductor chips, and particularly to a method for manufacturing a semiconductor chip, in which a patterned wafer is cut,
The present invention relates to a method of manufacturing a semiconductor chip.
【0002】0002
【従来の技術】 従来より行われている方法を以下に
説明する。図4および図5は従来における半導体チップ
を製造方法を説明する図である。ウェハ表面パターン2
1が形成されたウェハ20表面に、接着剤22aを介し
てベースフィルム23aを貼り付ける。このベースフィ
ルム23aによりウェハ表面パターン21は保護される
〔図4(a) 〕。[Prior Art] A conventional method will be described below. 4 and 5 are diagrams illustrating a conventional method of manufacturing a semiconductor chip. Wafer surface pattern 2
A base film 23a is attached to the surface of the wafer 20 on which 1 is formed via an adhesive 22a. The wafer surface pattern 21 is protected by this base film 23a [FIG. 4(a)].
【0003】次に、ウェハ20の裏面側より、一定の厚
さx削り裏面を研磨する。その後、ウェハ20に付着し
ている汚れおよび水を除去する〔図4(b) 〕。次に
、ウェハ20の表面に貼られているベースフィルム23
aを取り除いた後、ウェハ20の特性のチェックを行う
〔図4(c) 〕。次に、ウェハ20の裏面に接着材2
2bを介してベースフィルム23bを貼り付け、また、
ウェハ20側の接着材22b上に固定治具24を接着す
る。この工程により、ダイシング時にチップが不安定に
ならないよう固定される〔図4(d)〕。[0003] Next, the back surface of the wafer 20 is ground to a certain thickness x and polished. Thereafter, dirt and water adhering to the wafer 20 are removed [FIG. 4(b)]. Next, the base film 23 attached to the surface of the wafer 20
After removing a, the characteristics of the wafer 20 are checked [FIG. 4(c)]. Next, adhesive 2 is applied to the back side of the wafer 20.
Paste the base film 23b through 2b, and
A fixing jig 24 is bonded onto the adhesive 22b on the wafer 20 side. This step fixes the chip so that it does not become unstable during dicing [FIG. 4(d)].
【0004】次に、ウェハ表面パターン21を認識し、
位置決めしてウェハ表面20の所定位置を刃物25によ
り切断し、個々のチップ30を形成する。その後、ウェ
ハ20に付着している汚れおよび水を除去する〔図4(
e) 〕。次に、ベースフィルム23b側から突き上げ
治具27によりチップ30をベースフィルム23bから
剥がすと同時に、チップ30表面から吸着治具26でそ
のチップ30を保持する〔図5(a) 〕。Next, the wafer surface pattern 21 is recognized,
After positioning, a predetermined position on the wafer surface 20 is cut by the blade 25 to form individual chips 30. Thereafter, dirt and water adhering to the wafer 20 are removed [Fig. 4 (
e) ]. Next, the chip 30 is peeled off from the base film 23b using the push-up jig 27 from the base film 23b side, and at the same time, the chip 30 is held from the surface of the chip 30 using the suction jig 26 [FIG. 5(a)].
【0005】次に、剥がしたチップ30をそのまま吸着
治具26でダイパット29側へ移送し、ダイパット29
にそのチップ30を接合材料28を介して接合する〔図
5(b) 〕。Next, the peeled chip 30 is transferred as it is to the die pad 29 side using the suction jig 26, and
Then, the chip 30 is bonded via the bonding material 28 [FIG. 5(b)].
【0006】[0006]
【発明が解決しようとする課題】 ところで、従来の
方法によれば以下の問題点がある。
(1) ウェハサイズが大きくなるにつれ、裏面研磨さ
れたウェハを取扱う時にストレスが生じるため、クラッ
ク、ワレ等が発生する。
(2) ウェハ表面を露出させた状態での工程であるか
ら、A.ウェハ表面の酸化を防止するための保管設備お
よび条件設定が必要である。
B.ダイシングに発生するSiクズがチップ表面に付着
し、洗浄しても汚れが完全に除去できない為、汚れ不良
となる。
C.ウェハのダイシング中に刃物が破損すると、チップ
の表面側にワレ、カケが発生し、不良となる。
D.ダイシングに残ったSiクズがダイボンドの際にチ
ップ表面および吸着治具に付着し、チップ表面を引っ掻
き、不良とする。
E.ダイボンドミスにより、チップ表面にダメージを与
える。
(3) 吸着治具をチップサイズ毎に必要とするため、
切り換え頻度が高くなり、稼働率が低下する。
(4) 1枚のウェハに対して2枚のテープを使用する
必要がある。
(5) チップ表面検出時に、表面状態のばらつきによ
り検出エラーが発生する。
(6) ダイシング時の刃物でチップを完全にカットす
る場合、べースフィルムを少し切る必要があるため、刃
物の寿命が短くなり、コストアップとなる。一方、一部
切り残す場合でも、刃物の寿命を長くすることができ、
安定にカットできるが、後処理としてブレイクする工程
が必要があり、Siクズが飛散する。[Problems to be Solved by the Invention] However, the conventional method has the following problems. (1) As the wafer size increases, stress occurs when handling the wafer whose back side has been polished, resulting in cracks, cracks, etc. (2) Since the process is performed with the wafer surface exposed, A. Storage equipment and conditions must be set to prevent oxidation of the wafer surface. B. Si debris generated during dicing adheres to the chip surface and cannot be completely removed even after cleaning, resulting in contamination defects. C. If the cutter breaks during wafer dicing, cracks and chips will occur on the front side of the chips, resulting in defects. D. Si debris left after dicing adheres to the chip surface and suction jig during die bonding, scratches the chip surface, and makes it defective. E. Die bonding mistakes can damage the chip surface. (3) Since a suction jig is required for each chip size,
The frequency of switching increases and the operating rate decreases. (4) It is necessary to use two tapes for one wafer. (5) When detecting the chip surface, detection errors occur due to variations in the surface condition. (6) When cutting chips completely with a cutting tool during dicing, it is necessary to cut the base film a little, which shortens the life of the cutting tool and increases costs. On the other hand, even if some parts are left uncut, the life of the knife can be extended.
Although it can be stably cut, it requires a breaking process as a post-processing process, and Si debris is scattered.
【0007】本発明は、以上の問題点を解決すべくなさ
れたもので、半導体チップの製造方法を合理化し、不良
率低減をはかることのできる半導体チップの製造方法を
提供することを目的とする。The present invention has been made to solve the above-mentioned problems, and an object of the present invention is to provide a semiconductor chip manufacturing method that can streamline the semiconductor chip manufacturing method and reduce the defective rate. .
【0008】[0008]
【課題を解決するための手段】 本発明は以上の問題
点を解決すべくなされたものであり、請求項1および請
求項2に対応する発明を以下、それぞれ発明1,発明2
とする。発明1は、表面パターンが形成されたウェハを
個々のチップに切断し、それぞれのチップをダイパット
に接着する工程において、上記ウェハにその表面パター
ン側から所定の深さに切り込みを入れ、その後そのウェ
ハの表面パターン側にベースフィルムを接着した後、そ
のウェハの裏面を研磨することにより、個々のチップに
分割し、その後それらのチップを各々ダイパット上の接
着材料に、上記ベースフィルムの裏面側から突き上げる
ことにより、上記ベースフィルムから分離し、上記ダイ
パットに接着させることを特徴としている。[Means for Solving the Problems] The present invention has been made to solve the above problems, and the inventions corresponding to claims 1 and 2 are hereinafter referred to as invention 1 and invention 2, respectively.
shall be. Invention 1 is to cut a wafer on which a surface pattern is formed into individual chips, and in the process of bonding each chip to a die pad, cut into the wafer to a predetermined depth from the surface pattern side, and then After adhering a base film to the surface pattern side of the wafer, the back side of the wafer is polished to separate it into individual chips, and then each of these chips is pushed up from the back side of the base film onto the adhesive material on the die pad. Accordingly, it is characterized in that it is separated from the base film and adhered to the die pad.
【0009】また発明2は、表面パターンが形成された
ウェハを個々のチップに切断し、それぞれのチップをダ
イパットに接着する工程において、上記ウェハの表面パ
ターン側にベースフィルムを接着した後、そのウェハの
裏面を研磨し、その後そのウェハの裏面側から所定位置
を切断することにより、個々のチップに分割し、その後
それらのチップを各々ダイパット上の接着材料に、上記
ベースフィルムの裏面側から突き上げることにより、上
記ベースフィルムから分離し、上記ダイパットに接着さ
せることを特徴としている。[0009] In addition, in the second invention, in the step of cutting the wafer on which the surface pattern is formed into individual chips and bonding each chip to a die pad, after bonding a base film to the surface pattern side of the wafer, the wafer is The wafer is divided into individual chips by polishing the back side of the wafer, and then cutting at a predetermined position from the back side of the wafer, and then each of the chips is pushed up onto the adhesive material on the die pad from the back side of the base film. It is characterized in that it is separated from the base film and adhered to the die pad.
【0010】0010
【作用】 発明1では、ウェハのカット深さがベース
フィルムまで達する必要がなく、ウェハをカットした後
の工程はウェハの表面はベースフィルムが密着している
ので、その表面はダメージを受けない。発明2では、全
工程においてウェハの表面はベースフィルムが密着した
状態で行われるので、その表面はダメージを受けない。[Operation] In invention 1, the cutting depth of the wafer does not need to reach the base film, and in the step after cutting the wafer, the surface of the wafer is in close contact with the base film, so the surface is not damaged. In invention 2, the entire process is performed with the base film in close contact with the surface of the wafer, so the surface is not damaged.
【0011】また、発明1および発明2に共通する作用
として、各チップはベースフィルムの裏面側から突き上
げ、ダイパット上の接着剤に接着する工程を設けたから
、各チップをベースフィルムから分離し、ダイパットに
接着させる。[0011] Also, as a common feature of Inventions 1 and 2, each chip is pushed up from the back side of the base film and is bonded to the adhesive on the die pad, so each chip is separated from the base film and placed on the die pad. Glue to.
【0012】0012
【実施例】 図1は本発明1に対応する実施例(以下
実施例1という)を示す経時的断面図である。以下、図
面に基づいて詳細に説明する。まず、ウェハ表面パター
ンが形成されているウェハWの特性のチェックをする〔
図1(a) 〕。次に、図に示すように刃物2によりウ
ェハWを半分程度xを切り残した状態で、個々のチップ
形状にカットする。したがって、全チップはばらばらに
ならず、つながった状態である。その後、ウェハWに付
着している汚れと水を除去する〔図1(b) 〕。[Example] Fig. 1 is a chronological cross-sectional view showing an example (hereinafter referred to as Example 1) corresponding to the present invention 1. A detailed description will be given below based on the drawings. First, check the characteristics of the wafer W on which the wafer surface pattern is formed [
Figure 1(a)]. Next, as shown in the figure, the wafer W is cut into individual chip shapes with a cutter 2 leaving approximately half of the wafer x uncut. Therefore, all the chips are not separated and remain connected. Thereafter, dirt and water adhering to the wafer W are removed [FIG. 1(b)].
【0013】次に、次工程で行われる裏面研磨を行う際
にチップを固定するために、ウェハWの表面側に接着剤
3を介して、ベースフィルム4を貼付する。またウェハ
Wの周囲に固定治具5を設けておく〔図1(c) 〕。
次に、ウェハWの裏面側から、一定量ウェハWを削り個
々のチップCにする。その後、ウェハWに付着している
汚れと水を除去する〔図1(d) 〕。Next, a base film 4 is attached to the front side of the wafer W via an adhesive 3 in order to fix the chips during rear surface polishing performed in the next step. Further, a fixing jig 5 is provided around the wafer W [FIG. 1(c)]. Next, a certain amount of the wafer W is ground into individual chips C from the back side of the wafer W. Thereafter, dirt and water adhering to the wafer W are removed [FIG. 1(d)].
【0014】次に、ベースフィルム4上に接着されてい
るチップCの裏面を検出し、チップCをベースフィルム
4側から突上げ治具8により突上げることにより、矢附
の方向に移動するダイパット7に付着している接合材料
6に付着させ、その接合材料6の接着力でチップCをベ
ースフィルム4から剥がし、チップCはダイパット7に
付着した状態で移送される〔図1(e) 〕。Next, the die pad moves in the direction of the arrow by detecting the back side of the chip C adhered to the base film 4 and pushing up the chip C from the base film 4 side using the pushing up jig 8. The chip C is attached to the bonding material 6 attached to the die pad 7, and the chip C is peeled off from the base film 4 by the adhesive force of the bonding material 6, and the chip C is transferred while being attached to the die pad 7 [FIG. 1(e)] .
【0015】図2および図3は本発明2に対応する実施
例(以下実施例2という)を示す経時的断面図である。
以下、図面に基づいて詳細に説明する。まず、ウェハ表
面パターンが形成されているウェハWの特性のチェック
をする〔図2(a) 〕。次に、次工程で行われる裏面
研磨およびダイシングを行う際にチップを固定するため
に、ウェハWと固定治具5とに接着剤3を介し、パター
ン9にしたがって位置決めした状態でベースフィルム4
を貼付する。次に、ウェハW裏面側から、一定量ウェハ
Wを削る〔図2(b)−1,2 〕。FIGS. 2 and 3 are sectional views over time showing an embodiment (hereinafter referred to as Embodiment 2) corresponding to the second invention. A detailed description will be given below based on the drawings. First, the characteristics of the wafer W on which the wafer surface pattern is formed are checked [FIG. 2(a)]. Next, in order to fix the chips when back polishing and dicing are performed in the next process, an adhesive 3 is interposed between the wafer W and the fixing jig 5, and the base film 4 is positioned in accordance with the pattern 9.
Attach. Next, the wafer W is shaved by a certain amount from the back side of the wafer W [FIG. 2(b)-1, 2].
【0016】次に、固定治具5側のパターン9を認識す
ることにより、位置決めして所定位置を刃物2により切
断し、個々のチップCにする。その後、ウェハWに付着
している汚れと水を除去する〔図2(c) 〕。次に、
ベースフィルム4上に接着されているチップCの裏面を
検出し、チップCをベースフィルム4側から突上げ治具
8により突上げることにより、矢附の方向に移動するダ
イパット7に付着している接合材料6に付着させ、その
接合材料6の接着力でチップCをベースフィルム4から
剥がし、チップCはダイパット7に付着した状態で移送
される〔図3〕。Next, by recognizing the pattern 9 on the fixture 5 side, it is positioned and cut at a predetermined position with the blade 2 to form individual chips C. Thereafter, dirt and water adhering to the wafer W are removed [FIG. 2(c)]. next,
By detecting the back side of the chip C adhered on the base film 4 and pushing up the chip C from the base film 4 side using the pushing up jig 8, the chip C is attached to the die pad 7 moving in the direction indicated by the arrow. The chip C is attached to a bonding material 6, and the adhesive force of the bonding material 6 peels the chip C from the base film 4, and the chip C is transferred while being attached to the die pad 7 (FIG. 3).
【0017】以上述べた実施例1および実施例2は、先
に上げた問題点に対し、従来と比較しての効果を表1に
示す。Table 1 shows the effects of Embodiment 1 and Embodiment 2 described above in comparison with the conventional technique in dealing with the problems mentioned above.
【0018】[0018]
【表1】[Table 1]
【0019】表1に示すように、特に実施例1ではウェ
ハを半分程度切り残した状態でテープを貼り付け、ウェ
ハを研磨する工程であるから、刃物は従来に比べ長持ち
する点を顕著な効果としてあげることができる。また、
実施例2では最終工程のダイボンドンディングまでチッ
プ表面にベースフィルムが密着し、その表面が保護され
ているから、ウェハにワレ、クラックが発生せず、また
ウェハ表面が酸化されたり、汚染されたりせず、ダイボ
ンド中のトラブルによるワレ、カケ不良が起きない点を
顕著な効果としてあげることができる。As shown in Table 1, especially in Example 1, since the process involved attaching tape to the wafer with about half of it left uncut and polishing the wafer, the knife had a remarkable effect in that it lasted longer than before. It can be given as follows. Also,
In Example 2, the base film is in close contact with the chip surface until the final process of die bonding, and the surface is protected, so no cracks or cracks occur on the wafer, and the wafer surface is not oxidized or contaminated. First, a notable effect is that cracking and chipping defects due to trouble during die bonding do not occur.
【0020】また、実施例1および実施例2の共通した
効果として、チップの大きさ毎の専用の吸着治具および
部品が不要となることから、治具切り換え頻度は低下し
、また稼働率は上昇する点、また、チップ表面がベース
フィルムと密着している為、移載中にダメージを受けな
いことからダイボンド中のSiクズ付着等によるヒッカ
キ不良が起こらない点をあげることができる。In addition, as a common effect of Examples 1 and 2, there is no need for special suction jigs and parts for each chip size, so the frequency of changing jigs is reduced, and the operating rate is improved. In addition, since the chip surface is in close contact with the base film, it will not be damaged during transfer, so there will be no hiccup defects due to Si debris adhering during die bonding.
【0021】[0021]
【発明の効果】 以上説明したように、本発明によれ
ばウェハ表面にベースフィルムを貼った状態で各々の工
程を行うから、ウェハ表面の酸化,汚染を防ぎまた、各
工程中に発生する不良を低減することができる。また、
ベースフィルムは1枚で済み、特に発明1では、ウェハ
をカットする刃物の寿命を長くできる等、その製造工程
を合理化することができるとともに、コストを低減する
ことができる。[Effects of the Invention] As explained above, according to the present invention, each process is performed with a base film pasted on the wafer surface, so oxidation and contamination of the wafer surface are prevented, and defects occurring during each process are prevented. can be reduced. Also,
Only one base film is required, and in particular, in invention 1, the life of the blade for cutting the wafer can be extended, the manufacturing process can be streamlined, and costs can be reduced.
【図1】 本発明実施例1を説明する図。FIG. 1 is a diagram illustrating Embodiment 1 of the present invention.
【図2】 本発明実施例2を説明する図[Fig. 2] Diagram explaining Embodiment 2 of the present invention
【図3】
本発明実施例2を説明する図[Figure 3]
Diagram explaining Embodiment 2 of the present invention
【図4】 従来例を説明
する図[Figure 4] Diagram explaining a conventional example
【図5】 従来例を説明する図[Figure 5] Diagram explaining the conventional example
1・・・・ウェハ表面パターン 2・・・・刃物 3・・・・接着剤 4・・・・ベースフィルム 5・・・・固定治具 6・・・・接合材料 7・・・・ダイパット 8・・・・突上げ治具 9・・・・パターン 1...Wafer surface pattern 2... cutlery 3...Adhesive 4...Base film 5...Fixing jig 6...Joining material 7...Die pad 8... Push-up jig 9...pattern
Claims (2)
々のチップに切断し、それぞれのチップをダイパットに
接着する工程において、上記ウェハにその表面パターン
側から所定の深さに切り込みを入れ、その後そのウェハ
の表面パターン側にベースフィルムを接着した後、その
ウェハの裏面を研磨することにより、個々のチップに分
割し、その後それらのチップを各々ダイパット上の接着
材料に、上記ベースフィルムの裏面側から突き上げるこ
とにより、上記ベースフィルムから分離し、上記ダイパ
ットに接着させることを特徴とする半導体チップの製造
方法。Claim 1: In the process of cutting a wafer on which a surface pattern is formed into individual chips and bonding each chip to a die pad, the wafer is cut to a predetermined depth from the surface pattern side, and then the wafer is cut into individual chips. After adhering a base film to the front pattern side of the wafer, the back side of the wafer is divided into individual chips by polishing, and then each of the chips is applied to the adhesive material on the die pad from the back side of the base film. A method for manufacturing a semiconductor chip, characterized in that the semiconductor chip is separated from the base film and adhered to the die pad by pushing up.
々のチップに切断し、それぞれのチップをダイパットに
接着する工程において、上記ウェハの表面パターン側に
ベースフィルムを接着した後、そのウェハの裏面を研磨
し、その後そのウェハの裏面側から所定位置を切断する
ことにより、個々のチップに分割し、その後それらのチ
ップを各々ダイパット上の接着材料に、上記ベースフィ
ルムの裏面側から突き上げることにより、上記ベースフ
ィルムから分離し、上記ダイパットに接着させることを
特徴とする半導体チップの製造方法。2. In the step of cutting the wafer on which the surface pattern is formed into individual chips and bonding each chip to a die pad, after bonding a base film to the surface pattern side of the wafer, the back surface of the wafer is The wafer is divided into individual chips by polishing and then cutting at predetermined positions from the back side of the wafer, and then each of the chips is pushed up onto the adhesive material on the die pad from the back side of the base film. A method for manufacturing a semiconductor chip, comprising separating it from a base film and adhering it to the die pad.
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Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6184109B1 (en) | 1997-07-23 | 2001-02-06 | Kabushiki Kaisha Toshiba | Method of dividing a wafer and method of manufacturing a semiconductor device |
US6294439B1 (en) | 1997-07-23 | 2001-09-25 | Kabushiki Kaisha Toshiba | Method of dividing a wafer and method of manufacturing a semiconductor device |
US6337258B1 (en) | 1999-07-22 | 2002-01-08 | Kabushiki Kaisha Toshiba | Method of dividing a wafer |
KR100452661B1 (en) * | 1999-02-03 | 2004-10-14 | 가부시끼가이샤 도시바 | Method of dividing wafers and manufacturing semiconductor devices |
JP2009170455A (en) * | 2008-01-10 | 2009-07-30 | Toshiba Corp | Method of manufacturing semiconductor device |
JP2010056213A (en) * | 2008-08-27 | 2010-03-11 | Denso Corp | Method for mounting semiconductor device |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3447602B2 (en) | 1999-02-05 | 2003-09-16 | シャープ株式会社 | Method for manufacturing semiconductor device |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS53100765A (en) * | 1977-02-15 | 1978-09-02 | Toshiba Corp | Production of semiconductor device |
JPS5552235A (en) * | 1978-10-13 | 1980-04-16 | Toshiba Corp | Fastening of semiconductor wafer on substrate |
JPS618938A (en) * | 1984-06-25 | 1986-01-16 | Toshiba Corp | Manufacture of semiconductor device |
JPS63261851A (en) * | 1987-04-20 | 1988-10-28 | Nec Corp | Manufacture of semiconductor element |
-
1991
- 1991-06-14 JP JP3143082A patent/JP2737859B2/en not_active Expired - Lifetime
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS53100765A (en) * | 1977-02-15 | 1978-09-02 | Toshiba Corp | Production of semiconductor device |
JPS5552235A (en) * | 1978-10-13 | 1980-04-16 | Toshiba Corp | Fastening of semiconductor wafer on substrate |
JPS618938A (en) * | 1984-06-25 | 1986-01-16 | Toshiba Corp | Manufacture of semiconductor device |
JPS63261851A (en) * | 1987-04-20 | 1988-10-28 | Nec Corp | Manufacture of semiconductor element |
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6184109B1 (en) | 1997-07-23 | 2001-02-06 | Kabushiki Kaisha Toshiba | Method of dividing a wafer and method of manufacturing a semiconductor device |
US6294439B1 (en) | 1997-07-23 | 2001-09-25 | Kabushiki Kaisha Toshiba | Method of dividing a wafer and method of manufacturing a semiconductor device |
KR100452661B1 (en) * | 1999-02-03 | 2004-10-14 | 가부시끼가이샤 도시바 | Method of dividing wafers and manufacturing semiconductor devices |
US6337258B1 (en) | 1999-07-22 | 2002-01-08 | Kabushiki Kaisha Toshiba | Method of dividing a wafer |
KR100383206B1 (en) * | 1999-07-22 | 2003-05-12 | 가부시끼가이샤 도시바 | Wafer dividing method and manufacturing method of semiconductor device |
JP2009170455A (en) * | 2008-01-10 | 2009-07-30 | Toshiba Corp | Method of manufacturing semiconductor device |
JP2010056213A (en) * | 2008-08-27 | 2010-03-11 | Denso Corp | Method for mounting semiconductor device |
Also Published As
Publication number | Publication date |
---|---|
JP2737859B2 (en) | 1998-04-08 |
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