JPH04308412A - Composite relay - Google Patents

Composite relay

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Publication number
JPH04308412A
JPH04308412A JP3006493A JP649391A JPH04308412A JP H04308412 A JPH04308412 A JP H04308412A JP 3006493 A JP3006493 A JP 3006493A JP 649391 A JP649391 A JP 649391A JP H04308412 A JPH04308412 A JP H04308412A
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JP
Japan
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data
circuit
abnormality
input
phase
Prior art date
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Pending
Application number
JP3006493A
Other languages
Japanese (ja)
Inventor
Toshio Nakada
中田 敏男
Yoshio Shinshi
誉夫 進士
Masayoshi Kataue
片上 雅義
Kazunori Nishimura
和徳 西村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Omron Corp
Tokyo Gas Co Ltd
Nishishiba Electric Co Ltd
Original Assignee
Omron Corp
Tokyo Gas Co Ltd
Nishishiba Electric Co Ltd
Omron Tateisi Electronics Co
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Filing date
Publication date
Application filed by Omron Corp, Tokyo Gas Co Ltd, Nishishiba Electric Co Ltd, Omron Tateisi Electronics Co filed Critical Omron Corp
Priority to JP3006493A priority Critical patent/JPH04308412A/en
Publication of JPH04308412A publication Critical patent/JPH04308412A/en
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Abstract

PURPOSE:To easily perform post-accident troubleshooting by providing a data inputting, commanding, and holding means and holding data after abnormality occurs. CONSTITUTION:A CPU 6 which works as a commanding means respectively outputs a data holding or discarding command signal, display driving command signal, and output driving command signal to a data hold circuit 8, display drive circuit 10, and output drive circuit 12 on the basis of input data from a data input circuit 4 and the setting of a setting circuit 14. The circuit 8 is provided with storing areas 1-100 and respectively stores 50 pieces of data before abnormality and 1 piece of data at the time of abnormality in the areas 1-50 and 51 when the abnormality occurs in data. After a driving command is given, the section 8 stores 49 pieces of data after the abnormality in the areas 52-100. As a result, the cause of the abnormality can be examined and analyzed from the 100 pieces of data and troubleshooting can be easily performed.

Description

【発明の詳細な説明】[Detailed description of the invention]

【0001】0001

【産業上の利用分野】本発明は電気系統の異常を検知し
て遮断器を開放動作させる発電機用保護継電器としても
好適な複合型継電器に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a composite relay suitable as a protective relay for a generator that detects an abnormality in an electrical system and opens a circuit breaker.

【0002】0002

【従来の技術】従来の発電機用保護継電器は、電気系統
の保護に必要な整定値を持ち、電気系統における電流と
か電圧とかがその整定値を越えるか、あるいは下回った
ときに遮断器を開放動作させて故障点を切り離すように
なっている。
[Prior Art] Conventional protective relays for generators have a set value necessary to protect the electrical system, and open the circuit breaker when the current or voltage in the electrical system exceeds or falls below the set value. It is designed to operate and isolate the point of failure.

【0003】0003

【発明が解決しようとする課題】この保護継電器では電
気系統の事故を検知してその故障点を切り離すといった
目的を果たすことができるものの、事故後における原因
究明等への資料提供に対して寄与するものとは言いがた
く、例えば事故が配電線路における事故に原因を有する
ものであるか、遮断器の誤動作によるものか等、その解
析にはたいへん面倒な作業を要するものであった。
[Problem to be solved by the invention] Although this protective relay can serve the purpose of detecting an accident in the electrical system and isolating the failure point, it does not contribute to providing materials for investigating the cause after an accident. It is difficult to say, for example, whether the accident was caused by an accident on the power distribution line or by a malfunction of a circuit breaker, and the analysis required very troublesome work.

【0004】そこで、本発明においては、事故の原因解
析に必要なデータを事故後においても保持できるように
することで、事故後ではその保持されたデータに基づい
てその故障対策を容易に行うことができるようにしたも
のである。
[0004] Therefore, in the present invention, by making it possible to retain data necessary for analyzing the cause of an accident even after the accident, it is possible to easily take countermeasures against the failure based on the retained data after the accident. It was made so that it could be done.

【0005】[0005]

【課題を解決するための手段】本発明の複合型継電器に
おいては、データ入力手段と、指令手段と、データ保持
手段とを有しており、データ入力手段は、電気系統から
の入力をデータ化して出力するものであり、指令手段は
、所定時間毎にデータを格納廃棄する第1指令と、異常
データの入力に応答して異常データ発生前後のデータを
保持する第2指令とを出力するものであり、データ保持
手段は、第1指令に応答して格納エリアにデータを格納
し、かつ廃棄していくとともに、第2指令に応答して異
常データ発生前後のデータを格納エリアに保持するもの
であることを特徴としている。
[Means for Solving the Problems] The composite relay of the present invention has a data input means, a command means, and a data holding means, and the data input means converts input from an electrical system into data. The command means outputs a first command to store and discard data at predetermined time intervals, and a second command to hold data before and after the occurrence of abnormal data in response to input of abnormal data. The data holding means stores and discards data in the storage area in response to the first command, and holds data before and after the occurrence of abnormal data in the storage area in response to the second command. It is characterized by being

【0006】[0006]

【作用】異常データの入力時には、その異常データの入
力前後のデータがデータ保持手段に保持されてあるから
、当該複合型継電器においては、電気系統の事故を検知
してその故障点を切り離すととともに、事故後において
は、その異常データに基づいてその事故の原因が電気系
統にあるかとか、遮断器にあるかとか、電気系統にあれ
ばその原因はどこに所在するのか、といった究明、解析
を簡易に行うことができ、したがって、事故後での故障
対策を容易に行うことができる。
[Operation] When abnormal data is input, the data before and after the input of the abnormal data is held in the data holding means, so the composite relay can detect an accident in the electrical system and isolate the fault point. After an accident, based on the abnormality data, it is easy to investigate and analyze whether the cause of the accident is in the electrical system or the circuit breaker, and if it is in the electrical system, where the cause is located. Therefore, it is possible to easily take measures against failures after an accident.

【0007】[0007]

【実施例】以下、本発明の実施例を図1ないし図3を参
照して詳細に説明する。
Embodiments Hereinafter, embodiments of the present invention will be explained in detail with reference to FIGS. 1 to 3.

【0008】図1を参照して、本発明の実施例に係る複
合型継電器1は、発電機保護用として適用されたもので
あって、該複合型継電器1は、R,S,T各3相からな
る配電線路2に対して、第1および第2変流器CT1,
CT2、電圧検出用トランスPT、零相変流器ZCT、
および零相電圧検出装置ZPDを介して接続されている
Referring to FIG. 1, a composite relay 1 according to an embodiment of the present invention is applied to protect a generator. For the distribution line 2 consisting of phases, first and second current transformers CT1,
CT2, voltage detection transformer PT, zero-phase current transformer ZCT,
and are connected via a zero-phase voltage detection device ZPD.

【0009】ここで、第1および第2変流器CT1,C
T2は、3相配電線路2内の負荷電流を、電圧検出用ト
ランスPTは、3相配電線路2内の負荷電圧を、零相変
流器ZCTは3相配電線路2内の零相電流を、零相電圧
検出装置ZPDは3相配電線路2内の零相電圧を、それ
ぞれ検出し、その検出値を複合型継電器1に出力する。
Here, the first and second current transformers CT1, C
T2 measures the load current in the three-phase distribution line 2, voltage detection transformer PT measures the load voltage in the three-phase distribution line 2, and zero-phase current transformer ZCT measures the zero-phase current in the three-phase distribution line 2. , the zero-phase voltage detection device ZPD detects the zero-phase voltage within the three-phase distribution line 2, and outputs the detected value to the composite relay 1.

【0010】本複合型継電器1は、構成的には大きくわ
けて、データ入力回路4、指令手段としてのCPU6、
およびデータ保持回路8と、その他として、表示駆動回
路10、出力駆動回路12、整定回路14、およびデー
タ伝送回路16を有している。
[0010] The present composite relay 1 is roughly divided into two components: a data input circuit 4, a CPU 6 as a command means,
In addition to the data holding circuit 8, the display drive circuit 10, the output drive circuit 12, the setting circuit 14, and the data transmission circuit 16 are also included.

【0011】データ入力回路4は、電気系統としての3
相配電線路2から与えられる負荷電流、負荷電圧、零相
電流、零相電圧、およびその他をデータとして取り込む
とともに、これら各データを適宜処理してCPU6に出
力するものであって、以下、具体的にその構成を説明す
ることにする。
[0011] The data input circuit 4 has three
It takes in the load current, load voltage, zero-sequence current, zero-sequence voltage, and others given from the phase distribution line 2 as data, processes each of these data as appropriate, and outputs it to the CPU 6. I will explain its structure below.

【0012】すなわち、第1および第2変流器CT1,
CT2でそれぞれ検出された3相配電線路2内の負荷電
流は、内部変流器4ー1,4ー2でさらに変流されての
ち、過入力保護回路4ー3,4ー4で3相配電線路1か
らの侵入サージ成分を吸収されるとともに、整流回路4
ー5,4ー6で整流されてから、レベル変換回路4ー7
,4ー8で直流レベルに変換されてCPU6のA/D変
換端子6ー1,6ー2に対してR相とT相の各負荷電流
信号として与えられる。
That is, the first and second current transformers CT1,
The load currents in the three-phase distribution line 2 detected by CT2 are further transformed by internal current transformers 4-1 and 4-2, and then transformed into three-phase distribution lines by over-input protection circuits 4-3 and 4-4. The intrusion surge component from the electric line 1 is absorbed, and the rectifier circuit 4
-5, 4-6, then level conversion circuit 4-7
, 4-8, the signal is converted to a DC level and given to the A/D conversion terminals 6-1, 6-2 of the CPU 6 as R-phase and T-phase load current signals.

【0013】電圧検出用トランスPTで検出された3相
配電線路2の負荷電圧は、低圧トランス4ー9でさらに
低圧に変換され、各過入力保護回路4ー10,4ー11
で侵入サージを吸収される。
The load voltage of the three-phase power distribution line 2 detected by the voltage detection transformer PT is further converted to a lower voltage by the low voltage transformer 4-9, and then the load voltage of the three-phase power distribution line 2 detected by the voltage detection transformer PT is further converted to a lower voltage by the low voltage transformer 4-9.
The intrusion surge is absorbed.

【0014】そして、一方の過入力保護回路4ー10を
介する負荷電圧は、ゼロクロス回路4ー12で交流波形
から該交流波形のゼロクロス点を用いて方形波形(グラ
ンド電位を中心にして±に変化するもの)に変換され、
かつ波形整形回路4ー13でグランド電位から+側に変
化するように波形整形されてクロックパルス(CPU6
がそのクロックパルスの立ち上がりから立ち下がりまで
の1周期を時間計測して、負荷電圧の周波数確認用とし
て用いるもの)とされてからCPU6の割り込み端子6
ー3に与えられると同時に、増幅回路4ー14で増幅さ
れて実効値/直流(RMS/DC)変換回路4ー15で
実効値から直流レベルに変換されてからCPU6のA/
D変換端子6ー4に不足電圧と過電圧判定のデータとし
て与えられる。
The load voltage passing through one of the over-input protection circuits 4-10 is changed from an AC waveform to a rectangular waveform (changes ± with the ground potential as the center) using the zero-crossing points of the AC waveform in the zero-crossing circuit 4-12. ) is converted into
Then, the waveform shaping circuit 4-13 shapes the waveform so that it changes from the ground potential to the + side, and generates a clock pulse (CPU 6
measures one cycle from the rise to the fall of the clock pulse and uses it to check the frequency of the load voltage), and then interrupts the interrupt terminal 6 of the CPU 6.
At the same time, it is amplified by an amplifier circuit 4-14, converted from an effective value to a DC level by an RMS/DC conversion circuit 4-15, and then sent to the A/3 of the CPU 6.
It is given to the D conversion terminal 6-4 as data for determining undervoltage and overvoltage.

【0015】また、他方の過入力保護回路4ー11を介
する負荷電圧は、電圧/周波数(V/F)変換回路4ー
16で電圧から周波数に変換されたうえで電力値を取り
出すために掛算回路4ー17の一方入力部に与えられる
The load voltage that passes through the other over-input protection circuit 4-11 is converted from voltage to frequency by a voltage/frequency (V/F) conversion circuit 4-16, and then multiplied to obtain the power value. It is applied to one input section of the circuit 4-17.

【0016】第1変流器CT1からの負荷電流はまた、
内部変流器4ー18でさらに変流されてから過入力保護
回路4ー19を経て掛算回路4ー17の他方入力部に与
えられる。
The load current from the first current transformer CT1 is also:
After being further current-transformed by an internal current transformer 4-18, it is applied to the other input section of the multiplication circuit 4-17 via an over-input protection circuit 4-19.

【0017】掛算回路4ー17の各入力部にそれぞれ与
えられた負荷電圧と負荷電流はここで電力値を得るため
に掛け算されてのち積分回路4ー20でパルス状態の掛
け算出力を直流にするために積分されてCPU6のA/
D変換端子6ー5に対して電力(逆電力)信号として与
えられる。
The load voltage and load current applied to each input section of the multiplication circuit 4-17 are multiplied here to obtain a power value, and then the multiplication output in a pulse state is converted to DC in an integration circuit 4-20. A/ of CPU6 is integrated for
It is given as a power (reverse power) signal to the D conversion terminal 6-5.

【0018】零相変流器ZCTで検出された零相電流は
、内部変流器4ー21でさらに変流されてから、過入力
保護回路4ー22を経てゲイン調整回路4ー23で次段
の増幅回路のゲインのためにゲイン調整され、さらにフ
ィルタ増幅回路4ー24で高調波除去と増幅とを受けて
レベル変換回路4ー25を経てCPU6のA/D変換端
子6ー6に対して零相電流信号として与えられる。
The zero-sequence current detected by the zero-sequence current transformer ZCT is further transformed by an internal current transformer 4-21, passed through an over-input protection circuit 4-22, and then transformed by a gain adjustment circuit 4-23. The gain is adjusted for the gain of the stage amplifier circuit, and further subjected to harmonic removal and amplification in the filter amplifier circuit 4-24, and then passed through the level conversion circuit 4-25 to the A/D conversion terminal 6-6 of the CPU 6. is given as a zero-sequence current signal.

【0019】ここで、フィルタ増幅回路4ー24の出力
は、位相判別回路4ー26の一方入力部にも与えられる
Here, the output of the filter amplifier circuit 4-24 is also given to one input section of the phase discrimination circuit 4-26.

【0020】零相電圧検出装置ZPDで検出された零相
電圧は、内部部変流器4ー27でさらに変流されてから
過入力保護回路4ー28およびフィルタ増幅回路4ー2
9を経て位相判別回路4ー26の他方入力部に与えられ
る。
The zero-phase voltage detected by the zero-phase voltage detection device ZPD is further transformed by an internal current transformer 4-27, and then sent to an over-input protection circuit 4-28 and a filter amplifier circuit 4-2.
9 to the other input section of the phase discrimination circuit 4-26.

【0021】位相判別回路4ー26の各入力部にそれぞ
れ与えられた零相電流と零相電圧はここで地絡事故が構
内事故であるか構外事故であるかを判別するための位相
判別を受けてからCPU6のI/O端子6ー7に対して
該位相が動作位相か不動作位相かのデータを示す信号と
して与えられる。ここで、フィルタ増幅回路4ー29を
経た零相電圧はレベル変換回路4ー30を介してCPU
6のA/D変換端子6ー8に対して直流の零相電圧信号
として与えられる。
The zero-sequence current and zero-sequence voltage applied to each input section of the phase discrimination circuit 4-26 are subjected to phase discrimination to determine whether the ground fault is an on-premises or off-premises fault. After receiving the signal, it is applied to the I/O terminals 6-7 of the CPU 6 as a signal indicating whether the phase is an operating phase or an inactive phase. Here, the zero-phase voltage that has passed through the filter amplifier circuit 4-29 is sent to the CPU via the level conversion circuit 4-30.
It is given to the A/D conversion terminal 6-8 of No. 6 as a DC zero-phase voltage signal.

【0022】CPU6はこれら各端子に入力されてくる
データ入力回路4からの入力データと整定回路14の整
定値とに基づいて、データ保持回路8(ここでのデータ
の格納、廃棄、および保持については後述。)に対して
データ保持または廃棄の指令信号を、表示駆動回路10
に対して表示駆動指令信号(各継電器要素のいずれかが
動作したことを示す信号で、これに応答して該表示駆動
回路10はそれに対応した表示器を駆動する)を、出力
駆動回路12に対して出力駆動指令信号(継電器要素に
事故入力が印加されて整定値を越えたとき、時間整定経
過後にCPU6から出力される信号であって、該出力駆
動回路12はこれに応答して所要の遮断器を駆動する)
を、それぞれ出力する。
Based on the input data from the data input circuit 4 and the setting value of the setting circuit 14, which are input to each terminal, the CPU 6 controls the data holding circuit 8 (where data is stored, discarded, and held). will be described later.), the display drive circuit 10 sends a command signal to retain or discard data.
A display drive command signal (a signal indicating that one of the relay elements has operated, in response to which the display drive circuit 10 drives the corresponding display) is sent to the output drive circuit 12. On the other hand, the output drive command signal (a signal output from the CPU 6 after a set time has elapsed when an accident input is applied to a relay element and exceeds the set value, and the output drive circuit 12 responds to the required signal) (drives circuit breaker)
are output respectively.

【0023】CPU6はまた、データ伝送回路16を介
して当該継電器1に接続されているパーソナルコンピュ
ータにデータを伝送することで、該パーソナルコンピュ
ータでのデータ確認と事故解析に役立たせるようにする
とともに、パーソナルコンピュータからデータ伝送回路
16を介してデータ消却などの指令を与えられる。
The CPU 6 also transmits data to the personal computer connected to the relay 1 via the data transmission circuit 16 so that the data is useful for data confirmation and accident analysis on the personal computer. Commands such as data deletion are given from the personal computer via the data transmission circuit 16.

【0024】CPU6の動作を図2のフローチャートそ
の1とその2、および図3のメモリマップを参照して説
明する。
The operation of the CPU 6 will be explained with reference to flowcharts 1 and 2 of FIG. 2 and a memory map of FIG. 3.

【0025】フローチャートその1におけるステップn
1でデータ入力回路4から各種データを取り込む。ステ
ップn2においては、CPU6が取り込んだ各データの
内、事故解析に必要とする負荷電流、負荷電圧、および
電力をフローチャートのその2に従う各ステップn2ー
1、n2ー2、およびn2ー3でデータ保持回路8に格
納、移行、廃棄をする。ここで、データ保持回路8は、
図3の(a)のように格納エリア1〜100を有してい
る。そして、ステップn2ー1において、10mSタイ
マーをスタートするとともに、ステップn2ー2でタイ
ムアップすると、ステップn2ー3で、まず格納エリア
1にデータ1を格納する。つぎに、ステップn3に戻っ
て格納データが異常であるかどうかを判定する。異常で
なければ、ステップn2で、格納エリア2にデータ2を
格納する。こうして、データが異常でなければ、格納エ
リア1〜100のすべてに10mS×100、つまり、
1秒間で図3の(a)のように100個のデータ1〜1
00が格納されることになる。
Step n in flowchart part 1
1, various data are taken in from the data input circuit 4. In step n2, among the various data taken in by the CPU 6, the load current, load voltage, and power required for accident analysis are collected in steps n2-1, n2-2, and n2-3 according to part 2 of the flowchart. It is stored in the holding circuit 8, transferred, and discarded. Here, the data holding circuit 8 is
As shown in FIG. 3(a), it has storage areas 1 to 100. Then, in step n2-1, a 10 mS timer is started, and when the timer expires in step n2-2, data 1 is first stored in storage area 1 in step n2-3. Next, the process returns to step n3 to determine whether the stored data is abnormal. If there is no abnormality, data 2 is stored in storage area 2 in step n2. In this way, if the data is not abnormal, 10 mS x 100 is applied to all storage areas 1 to 100, that is,
100 pieces of data 1 to 1 as shown in Figure 3(a) in 1 second
00 will be stored.

【0026】なお、ステップn2ー3では、格納エリア
100にデータが格納されているために、新たにデータ
を格納できるようにするために、格納エリア1に格納さ
れている最旧のデータ1は廃棄され、各格納エリア内の
データを前段の格納エリアに移行させ、これによって、
格納エリア100を空きエリアとし、そこに最新のデー
タが格納できるようにする。こうして、データ保持回路
8の各格納エリアには1秒間分のデータ1〜100が格
納される。
Note that in step n2-3, since the data is stored in the storage area 100, in order to be able to store new data, the oldest data 1 stored in the storage area 1 is The data in each storage area is migrated to the previous storage area, thereby
A storage area 100 is made an empty area so that the latest data can be stored there. In this way, data 1 to 100 for one second are stored in each storage area of the data holding circuit 8.

【0027】つぎに、ステップn3においては、格納エ
リアに格納のデータが整定値を越えたかあるいは下回っ
たかどうか、つまりデータが異常であるかどうかを判定
し、異常でなければ前述のようにステップn2に移行し
てデータの格納を継続するのであるが、異常であればそ
の異常状態の継続時間を監視し、例えば電圧の単なる変
動にすぎないとか、要は本来の異常であるかどうかを判
定するため、ステップn4でその継続時間監視のための
タイマーをスタートさせる。このタイマーはデータの異
常状態が整定時間として定められた1秒間の間継続する
かどうかを判定するものであり、1秒間継続しなければ
異常でない、つまりその異常状態が一過性のものであり
、問題がなかったと判定する。そのため、ステップn5
とn6とでその1秒間の間に上記状態が継続中であるか
どうかを判定し、継続中にタイムアップすれば、電気系
統とか継電器等に異常があるとしてステップn7で表示
駆動回路10と出力駆動回路12とにそれぞれ駆動指令
を出力し、表示器を点灯させたり遮断器を作動させたり
所要の動作を行う。そして、ステップn8とn9ではそ
れぞれステップn1とn2と同様の処理を行ってデータ
を格納していき、ステップn10で駆動指令後のデータ
格納数が49個(これらは格納エリア52〜100に格
納されるデータ)を越えたかどうかを判定し、越えてい
ればステップn11で駆動指令前のデータ51個分(こ
れらは格納エリア1〜51に格納されるデータ)と駆動
指令後のデータ49個とをデータ保持回路8に記憶保持
させる。結局、データ保持回路8には、図3の(b)に
示すようにデータ異常時には、駆動指令前としては異常
前の50個分のデータab1〜ab50が格納エリア1
〜50に、異常時の1個分のデータa1が格納エリア5
1に、駆動指令後は、異常後の49個分のデータaa1
〜aa49が格納エリア52〜100に保持されること
になる。
Next, in step n3, it is determined whether the data stored in the storage area exceeds or falls below a set value, that is, whether the data is abnormal or not, and if it is not abnormal, step n2 is performed as described above. If there is an abnormality, the duration of the abnormal state is monitored to determine whether it is just a change in voltage, or whether it is an actual abnormality. Therefore, in step n4, a timer for monitoring the duration is started. This timer determines whether the abnormal state of the data continues for one second, which is set as the settling time.If it does not continue for one second, it is not abnormal, that is, the abnormal state is temporary. , it is determined that there is no problem. Therefore, step n5
and n6, it is determined whether the above state is continuing during that 1 second, and if the time is up while it is continuing, it is determined that there is an abnormality in the electrical system or relay, etc., and the output is sent to the display drive circuit 10 in step n7. A drive command is output to each of the drive circuits 12, and necessary operations such as lighting a display or operating a circuit breaker are performed. Then, in steps n8 and n9, the same processing as in steps n1 and n2 is performed to store data, and in step n10, the number of data stored after the drive command is 49 (these are stored in storage areas 52 to 100). It is determined whether or not the data has exceeded the specified data, and if it has, in step n11, 51 pieces of data before the drive command (these are data stored in storage areas 1 to 51) and 49 data after the drive command are stored. The data holding circuit 8 is caused to hold the memory. As a result, as shown in FIG. 3(b), in the data holding circuit 8, when data is abnormal, 50 pieces of data ab1 to ab50 before the abnormality are stored in the storage area 1.
~50, one piece of data a1 at the time of abnormality is stored in area 5.
1, after the drive command, 49 pieces of data aa1 after the abnormality
~aa49 will be held in storage areas 52-100.

【0028】その結果、本実施例では、その100個の
データから事故の原因究明・解析を容易に行うことがで
きる。
As a result, in this embodiment, the cause of the accident can be easily investigated and analyzed from the 100 pieces of data.

【0029】なお、上記実施例では指令手段としてはC
PU6、データ保持回路としてはCPU6とは別のメモ
リで構成したが、CPU6に内蔵のメモリをデータ保持
回路として用いてよく、本発明ではかかるデータ保持回
路構成も含む。
In the above embodiment, the command means is C.
Although the PU 6 and the data holding circuit are configured with a memory separate from the CPU 6, the memory built into the CPU 6 may be used as the data holding circuit, and the present invention includes such a data holding circuit configuration.

【0030】[0030]

【発明の効果】本発明によれば、異常データの入力時に
は、その異常データの入力前後のデータがデータ保持手
段に保持されるようにしたから、電気系統の事故後にお
いては、その異常データに基づいて事故原因が電気系統
にあるかとか、遮断器にあるかとか、あるいは電気系統
にあればその原因はどこに所在するのか、といった究明
、解析を簡易に行うことができ、したがって、事故後で
の故障対策を容易に行うことができる。
[Effects of the Invention] According to the present invention, when abnormal data is input, the data before and after the input of the abnormal data is held in the data holding means. Based on this, it is possible to easily investigate and analyze whether the cause of the accident is in the electrical system, the circuit breaker, or if it is in the electrical system, where the cause is located. Failure countermeasures can be easily taken.

【図面の簡単な説明】[Brief explanation of drawings]

【図1】本発明の実施例に係る複合型継電器の構成を示
すブロック図である。
FIG. 1 is a block diagram showing the configuration of a composite relay according to an embodiment of the present invention.

【図2】動作説明に供するフローチャートである。FIG. 2 is a flowchart for explaining the operation.

【図3】メモリマップを示す図である。FIG. 3 is a diagram showing a memory map.

【符号の説明】[Explanation of symbols]

1  複合型継電器 2  3相配電線路 4  データ入力回路 6  CPU 8  データ保持回路 1. Composite relay 2 3-phase distribution line 4 Data input circuit 6 CPU 8 Data retention circuit

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】  データ入力手段(4)と、指令手段(
6)と、データ保持手段(8)とを有しており、データ
入力手段(4)は、電気系統(2)からの入力をデータ
化して出力するものであり、指令手段(6)は、所定時
間毎にデータを格納廃棄する第1指令と、異常データの
入力に応答して異常データ発生前後のデータを保持する
第2指令とを出力するものであり、データ保持手段(8
)は、第1指令に応答して格納エリアにデータを格納し
、かつ廃棄していくとともに、第2指令に応答して異常
データ発生前後のデータを格納エリアに保持するもので
あることを特徴とする複合型継電器。
Claim 1: Data input means (4) and command means (
6) and data holding means (8), the data input means (4) converts input from the electrical system (2) into data and outputs the data, and the command means (6) includes: The data holding means (8
) is characterized in that it stores and discards data in the storage area in response to the first command, and retains data before and after the occurrence of abnormal data in the storage area in response to the second command. Composite type relay.
JP3006493A 1991-01-23 1991-01-23 Composite relay Pending JPH04308412A (en)

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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS49117944A (en) * 1973-03-16 1974-11-11
JPS605725A (en) * 1983-06-20 1985-01-12 株式会社明電舎 Data recording system of digital protecting relaying device

Patent Citations (2)

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