JPH04298051A - Field effect transistor of high electron mobility - Google Patents

Field effect transistor of high electron mobility

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JPH04298051A
JPH04298051A JP6346491A JP6346491A JPH04298051A JP H04298051 A JPH04298051 A JP H04298051A JP 6346491 A JP6346491 A JP 6346491A JP 6346491 A JP6346491 A JP 6346491A JP H04298051 A JPH04298051 A JP H04298051A
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JP
Japan
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layer
island
band gap
gate electrode
field effect
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JP6346491A
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Japanese (ja)
Inventor
Akihiko Okuhora
明彦 奥洞
Mikio Kamata
幹夫 鎌田
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Sony Corp
Original Assignee
Sony Corp
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Abstract

PURPOSE:To reduce gate leakage current in this device which isolates circuit elements by a mesa type construction. CONSTITUTION:A substrate 1 is overlaid with a layer 11 having a band gap larger than that of at last a channel layer under the coat zone with the extension of a gate electrode 7 on the side face (6a) of an insular operating region 6 consisting of a lamination of a channel forming layer 3 and a carrier (electron) supply layer 5 of larger band gap.

Description

【発明の詳細な説明】[Detailed description of the invention]

【0001】0001

【産業上の利用分野】本発明は、高電子移動度電界効果
トランジスタHEMTに係る。
FIELD OF THE INVENTION The present invention relates to high electron mobility field effect transistors HEMT.

【0002】0002

【従来の技術】従来、2次元電子ガスチャンネルによる
高電子移動度電界効果トランジスタ即ち、HEMT、特
にこれを回路素子とする集積回路においては、図4にそ
の拡大平面図を示し、図5に図4のA−A線上の断面図
を示すように、例えば半絶縁性のIII −V 化合物
半導体基体1上に、必要に応じてチャンネル形成層3、
スペーサ層4、キャリア(電子)供給層5が、順次MO
CVD法(有機金属気相成長法)によってエピキタキシ
ャル成長されてなり、その上層からメサエッチングが施
されて、メサ溝10によって各動作領域を構成する複数
(図においては1つのみが示されている)の島状動作領
域6が、互いに電気的に分離されて形成される。
2. Description of the Related Art Conventionally, an enlarged plan view of a high electron mobility field effect transistor (HEMT) using a two-dimensional electron gas channel, particularly an integrated circuit using this as a circuit element, is shown in FIG. As shown in the cross-sectional view taken along line A-A of No. 4, for example, a channel forming layer 3 is formed on a semi-insulating III-V compound semiconductor substrate 1 as necessary.
The spacer layer 4 and the carrier (electron) supply layer 5 are sequentially formed into MO
It is epitaxially grown by the CVD method (metal-organic chemical vapor deposition method), and mesa etching is performed from the upper layer to form a plurality of mesa grooves 10 forming each operating region (only one is shown in the figure). The island-like operating regions 6 (which are connected to each other) are formed to be electrically isolated from each other.

【0003】そしてこれら互いに分離された島状動作領
域6上に、キャリア供給層5に対してショットキーバリ
アを形成するショットキー金属より成るゲート電極7が
島状動作領域6を横切るように形成され、これを挟んで
その両側にソース電極8及びドレイン電極9が夫々例え
ばアロイされて被着される。
A gate electrode 7 made of Schottky metal and forming a Schottky barrier with respect to the carrier supply layer 5 is formed on the island-like operating regions 6 separated from each other so as to cross the island-like operating regions 6. A source electrode 8 and a drain electrode 9 are deposited, for example, in an alloyed manner, on both sides of the electrode.

【0004】ゲート電極7は、例えばその端子導出のた
めに島状領域6即ちメサ部を横切ってメサ周辺のメサ溝
10内に延在する延在部7aを有して成る。
The gate electrode 7 has, for example, an extending portion 7a extending across the island region 6, that is, the mesa portion, and into the mesa groove 10 around the mesa, for leading out the terminal thereof.

【0005】このHEMTにおいては、そのチャンネル
形成層3のキャリア供給層5側の界面にゲート電極7へ
の所定の印加電圧によってチャンネル即ち2次元電子ガ
ス層チャンネルの形成がなされるものであって、このた
め、チャンネル形成層3のバンドギャップ幅はキャリア
供給層5におけるそれよりも小なる化合物半導体層によ
って構成される。
In this HEMT, a channel, that is, a two-dimensional electron gas layer channel, is formed at the interface of the channel forming layer 3 on the carrier supply layer 5 side by applying a predetermined voltage to the gate electrode 7. Therefore, the channel forming layer 3 is composed of a compound semiconductor layer whose band gap width is smaller than that of the carrier supply layer 5.

【0006】したがって、この島状領域6の側面6aに
臨むチャンネル形成層3に直接的にゲート電極7の延在
部7aが被着形成される場合、このチャンネル形成層3
の側面のゲート電極7の延在部7aとの接触部に、本来
のショットキーゲート部よりショットキーバリアが小さ
い、いわば寄生のショットキー接合が形成され、これが
ゲート漏洩電流を発生する。
Therefore, when the extending portion 7a of the gate electrode 7 is formed directly on the channel forming layer 3 facing the side surface 6a of the island region 6, the channel forming layer 3
A so-called parasitic Schottky junction, which has a smaller Schottky barrier than the original Schottky gate part, is formed at the contact part with the extension part 7a of the gate electrode 7 on the side surface of the gate electrode 7, and this causes a gate leakage current.

【0007】例えば、この種のHEMTとして半絶縁性
InP基体1上に、例えばバンドギャップが大きく、又
基体1と格子整合するAlInAsよりなるバッファー
層2、バンドギャップの小さいInGaAsよりなるア
ンドープのチャンネル形成層3、更にこの上に例えばA
lInAsよりなるアンドープのスペーサー層4を介し
てn形のバンドギャップの大なるAlInAsキャリア
供給層11が順次エピキタキシャル成長された構成をと
る(例えば特公平−6294号公報参照)。
For example, in this type of HEMT, a buffer layer 2 made of AlInAs, which has a large band gap and is lattice matched to the substrate 1, and an undoped channel made of InGaAs, which has a small band gap, are formed on a semi-insulating InP substrate 1. Layer 3, and on top of this, for example, A
The structure is such that an n-type AlInAs carrier supply layer 11 with a large band gap is epitaxially grown in sequence through an undoped spacer layer 4 made of lInAs (see, for example, Japanese Patent Publication No. 6294).

【0008】この構成をとる場合、そのチャンネル形成
層3は、キャリア供給層5に比して相対的にそのバンド
ギャップ幅が小さいことはもとより、これを構成するI
nGaAsは、特にその材料自体のバンドギャップ幅が
小さいことから、これに島状領域6の側面6aにおいて
、直接的にゲート電極7の延在部7aが被着される場合
、このチャンネル形成層3との間にショットキーバリア
が特に低い寄生のショットキー接合が生ずることからゲ
ート漏洩電流が著しくなり、このようにゲート電極7の
延在部7aを島状動作領域6の側面6aに這わすことに
問題が生じる。
[0008] When this configuration is adopted, the channel forming layer 3 not only has a relatively small bandgap width compared to the carrier supply layer 5 but also has an I
Since nGaAs has a particularly small bandgap width as a material itself, when the extending portion 7a of the gate electrode 7 is directly deposited on the side surface 6a of the island-like region 6, this channel forming layer 3 Since a parasitic Schottky junction with a particularly low Schottky barrier occurs between A problem arises.

【0009】[0009]

【発明が解決しようとする課題】このような課題の解決
をはかるものとして本出願人の出願に係る特願平1−1
91874号出願「高電子移動度電界効果トランジスタ
」の提案がなされた。このHEMTにおいては、島状動
作領域と略々同等の高さの橋脚島状部を形成し、この橋
脚島状部と本来の島状動作領域とにさし戻って延在部を
形成して、島状領域6の側面6aから延在部を浮かすよ
うな構成とするものである。
[Problems to be Solved by the Invention] In order to solve these problems, Japanese Patent Application No. 1-1 filed by the present applicant
No. 91874 application ``High Electron Mobility Field Effect Transistor'' was proposed. In this HEMT, a pier island is formed with approximately the same height as the island-shaped operating area, and an extension part is formed by extending back into the pier island and the original island-shaped operating area. , the extension portion is configured to float above the side surface 6a of the island-like region 6.

【0010】然し乍ら、このような方法による場合、こ
のゲート電極が基体から浮上していることから、機械的
強度に問題が生じて来る場合がある。
However, when such a method is used, a problem may arise in mechanical strength because the gate electrode is floating above the base body.

【0011】本発明においては、上述したHEMTにお
いて、そのゲート電極の延在部を島状動作領域の側面に
沿うように配置するにも拘らず上述したゲート漏洩電流
の発生を効果的に回避することが出来るようにする。
In the present invention, in the HEMT described above, the occurrence of the gate leakage current described above is effectively avoided even though the extended portion of the gate electrode is arranged along the side surface of the island-like operating region. Make things possible.

【0012】0012

【課題を解決するための手段】本発明は図1Aにその一
例の略称的断面図を示し、図1Bに図1AのB−B線上
の略線的断面図を示すように、絶縁性ないしは半絶縁性
基体1上に少なくともチャンネル形成層3と、これに比
しバンドギャップの大なるキャリア供給層5とが順次積
層された島状の動作領域6と、この島状動作領域6上か
ら外側に延びるゲート電極7とを有し、このゲート電極
7の延在部7aが島状領域6の側面6aに、チャンネル
形成層3のバンドギャップより大なるバンドギャップを
有する層11を介して接するように延在させる。
[Means for Solving the Problems] As shown in FIG. 1A, which is a schematic cross-sectional view of an example thereof, and FIG. 1B, which is a schematic cross-sectional view taken along the line BB in FIG. An island-shaped operating region 6 in which at least a channel-forming layer 3 and a carrier supply layer 5 with a larger band gap than the channel-forming layer 5 are sequentially laminated on an insulating substrate 1; The gate electrode 7 has an extending gate electrode 7, and the extending portion 7a of the gate electrode 7 is in contact with the side surface 6a of the island-like region 6 via a layer 11 having a band gap larger than the band gap of the channel forming layer 3. Extend.

【0013】[0013]

【作用】上述した本発明構成によれば、メサ即ち島状動
作領域6の側面6aに特にバンドギャップの小なるチャ
ンネル形成層3が臨む場合においても、これとゲート電
極7の延在部7aとの間にはバンドギャップの大なる層
11が介在することから、この層11とゲート電極7即
ちその延在部7aとの間には充分ショットキーバリアが
高い接合が形成されることから、このバンドギャップの
大なる層11のバンドギャップを、キャリア供給層5に
於けるバンドギャップと同等ないしはそれ以上に選定す
れば、このチャンネル形成層3に対するゲート電流の漏
洩を制御することが出来る。
[Function] According to the above-described structure of the present invention, even when the channel forming layer 3 having a particularly small band gap faces the side surface 6a of the mesa or island-like operating region 6, this and the extending portion 7a of the gate electrode 7 Since a layer 11 with a large band gap is present between the two layers, a junction with a sufficiently high Schottky barrier is formed between this layer 11 and the gate electrode 7, that is, its extension 7a. If the band gap of the layer 11 with a large band gap is selected to be equal to or greater than the band gap in the carrier supply layer 5, leakage of gate current to the channel forming layer 3 can be controlled.

【0014】[0014]

【実施例】図1を参照して本発明の一例を説明するも、
その理解を容易にするために、図2を参照して本発明に
よる電界効果トランジスタHEMTをその製造方法の一
例と共に詳細に説明する。
[Example] An example of the present invention will be explained with reference to FIG.
To facilitate understanding, the field effect transistor HEMT according to the present invention will be described in detail with reference to FIG. 2 along with an example of its manufacturing method.

【0015】この場合、図2Aに示すように、例えば半
絶縁性InP基体1上に順次必要に応じて例えばAlI
nAsよりなるバッファー層2、アンドープのInGa
Asチャンネル形成層3、同様に必要に応じてアンドー
プのAlInAsよりなるスペーサー層4、n形のAl
InAsよりなるキャリア供給層5を順次MOCVD等
によってエピキタキシャル成長する。
In this case, as shown in FIG. 2A, for example, AlI is sequentially deposited on the semi-insulating InP substrate 1 as necessary.
Buffer layer 2 made of nAs, undoped InGa
An As channel forming layer 3, a spacer layer 4 made of undoped AlInAs as needed, and an n-type Al
A carrier supply layer 5 made of InAs is sequentially epitaxially grown by MOCVD or the like.

【0016】そして図2A中破線図示の位置まで周知の
技術によって、チャンネル形成層3上からメサエッチン
グを施し、図2Bに示すように、メサ溝10によって囲
まれたメサ状の複数個(図によっては1個のみ示されて
いる)の島状動作領域6を形成する。そしてこの島状動
作領域6上を含んで全面的に例えばキャリア(電子)供
給層5と同一材料のバンドギャップの大なる層11をエ
ピキタキシャル成長する。
Then, mesa etching is performed from above the channel forming layer 3 to the position indicated by the broken line in FIG. 2A using a well-known technique, and as shown in FIG. (only one is shown) forms an island-like operating region 6. Then, a layer 11 with a large bandgap made of the same material as the carrier (electron) supply layer 5 is epitaxially grown over the entire surface including the island-like operating region 6.

【0017】図2Cに示すように、このバンドギャップ
大なる層11がキャリア供給層5と同様にn形、つまり
導電性を有する場合には、他の島状領域6との間を電気
的に分離するエッチングを施して欠除部12を形成する
As shown in FIG. 2C, when this large bandgap layer 11 is n-type like the carrier supply layer 5, that is, has conductivity, there is no electrical connection between it and the other island-like region 6. Separating etching is performed to form the cutout portion 12.

【0018】その後、この層11上にゲート電極7を形
成する金属層を、その島状動作領域6上を含んで全面的
に蒸着等によって形成し、フォトグラフィによる選択的
エッチングを行って例えば島状動作領域6を横切り、メ
サ溝10上に延びる延在部7aを有するストライプ状の
ゲート電極7を構成する。
Thereafter, a metal layer for forming the gate electrode 7 is formed on this layer 11 by vapor deposition or the like over the entire surface including the island-like operating region 6, and selectively etched by photography to form, for example, an island. A striped gate electrode 7 having an extension portion 7a extending across the active region 6 and above the mesa groove 10 is formed.

【0019】又このゲート電極7の両側に図1A及びB
で示すように、ソース及びドレイン各電極8及び9を夫
々アロイ等によって形成する。このようにすれば本発明
によるHEMTを構成することが出来る。尚、上述した
例においてはバンドギャップが大なる層11がキャリア
供給層5と同一材料によって構成した場合であるが、島
状動作領域上におけるキャリア供給層5の形成を省略し
、図2Bに説明したバンドギャップの大なる層11を、
キャリア供給層5と兼ねしめることが出来る。
1A and B on both sides of this gate electrode 7.
As shown in , the source and drain electrodes 8 and 9 are formed of an alloy or the like. In this way, the HEMT according to the present invention can be constructed. In the above example, the layer 11 with a large band gap is made of the same material as the carrier supply layer 5, but the formation of the carrier supply layer 5 on the island-like operating region is omitted and the explanation is shown in FIG. 2B. The layer 11 with a large band gap,
It can also serve as the carrier supply layer 5.

【0020】更に又、図2で説明した例においては、キ
ャリア供給層5と同一材料のバンドギャップの大なる層
11を島状動作領域6の側面6aを覆って形成した場合
であるが、少なくとも、この層11は、ゲート電極7の
延在部7aが形成される部分において、島状動作領域6
の側面6aに形成すればよいものである。
Furthermore, in the example explained with reference to FIG. 2, the layer 11 with a large band gap made of the same material as the carrier supply layer 5 is formed to cover the side surface 6a of the island-like operating region 6, but at least , this layer 11 has an island-like operating region 6 in a portion where the extension portion 7a of the gate electrode 7 is formed.
It is sufficient if it is formed on the side surface 6a of the.

【0021】又、上述した例においてはキャリア供給層
5と同一材料によってバンドギャップの大なる層11を
構成した場合であるが、他のバンドギャップの大なる化
合物半導体層によって形成することも出来る。
Further, in the above example, the layer 11 with a large band gap is formed of the same material as the carrier supply layer 5, but it can also be formed with another compound semiconductor layer with a large band gap.

【0022】更に図2に説明した例においてはチャンネ
ル形成層3上にスペーサー層4を介してキャリア供給層
5を形成するようにしたHEMTに適用した場合である
が、スペーサー層4が存在しないものに適用することも
出来る。
Further, in the example illustrated in FIG. 2, the case is applied to a HEMT in which the carrier supply layer 5 is formed on the channel forming layer 3 via the spacer layer 4, but it is applicable to a HEMT in which the spacer layer 4 is not present. It can also be applied to

【0023】又、例えば図3に示すように、キャリア供
給層5として、スペーサー4を兼ねるアンドープ層の真
性(i形)の例えばAlInAsを所要の厚さにエピタ
キシし、そのエピタキシを停止した状態でその表面にn
形の不純物例えばSiの原料ガスSiH6 を供給して
アンドープのAlInAs上にそのドーピングが飽和す
る濃度をもって不純物ドーピングを行う、即ち所謂プレ
ナードーピング層5Aを形成する。そしてこれを実質的
キャリア供給層とすることも出来る。
Further, as shown in FIG. 3, for example, an undoped layer of intrinsic (i-type) AlInAs, which also serves as a spacer 4, is epitaxied to a required thickness as the carrier supply layer 5, and the epitaxy is stopped. n on its surface
A source gas of SiH6, for example, Si, is supplied and the undoped AlInAs is doped with the impurity at a concentration such that the doping is saturated, that is, a so-called planar doping layer 5A is formed. This can also be used as a substantial carrier supply layer.

【0024】この場合においてはバンドギャップの大な
る層11としては、不純物を含まない即ちアンドープ層
のAlInAsによって構成することが出来、この場合
には、図2Cで説明した他部との分離を行う欠除部12
を形成するためのエッチングを省略することが出来る。
In this case, the layer 11 with a large band gap can be made of AlInAs that does not contain impurities, that is, an undoped layer, and in this case, the layer 11 is separated from other parts as explained in FIG. 2C. Deleted part 12
Etching for forming can be omitted.

【0025】又、更に相互コンダクタンスGmを大とす
るために層11の、ゲート電極7の形成部直下において
、これを肉薄とするエッチング溝を形成する構成をとる
ことも出来る。
Furthermore, in order to further increase the mutual conductance Gm, it is also possible to form an etched groove in the layer 11 directly below the area where the gate electrode 7 is formed.

【0026】その他、上述した例に限らず、種々の構成
を有するHEMTに本発明を適用することが出来る。
In addition, the present invention can be applied to HEMTs having various configurations, not limited to the above-mentioned example.

【0027】[0027]

【発明の効果】上述したように本発明によれば、ゲート
電極7の延在部7aを島状動作領域6の側面6a上に這
わせるにも拘らず、これと少なくともバンドギャップの
小さいチャンネル形成層との間にバンドギャップの大な
る層11が介在するようにしたことによって、ここにバ
リヤの高さが小さいショットキー接合が形成されてゲー
ト漏洩電流が増大するような不都合を確実に回避するこ
とが出来る。
As described above, according to the present invention, although the extended portion 7a of the gate electrode 7 extends over the side surface 6a of the island-like operating region 6, it is possible to form a channel with at least a small band gap. By interposing the layer 11 with a large band gap between the two layers, it is possible to reliably avoid problems such as the formation of a Schottky junction with a small barrier height and an increase in gate leakage current. I can do it.

【図面の簡単な説明】[Brief explanation of drawings]

【図1】本発明による高電子移動度電界効果トランジス
タの平面図及び断面図である。
FIG. 1 is a plan view and a cross-sectional view of a high electron mobility field effect transistor according to the present invention.

【図2】本発明による電界効果トランジスタの一例の製
造工程図である。
FIG. 2 is a manufacturing process diagram of an example of a field effect transistor according to the present invention.

【図3】本発明による電界効果トランジスタの他の例の
断面図である。
FIG. 3 is a cross-sectional view of another example of a field effect transistor according to the invention.

【図4】従来の高電子移動度電界効果トランジスタの平
面図である。
FIG. 4 is a plan view of a conventional high electron mobility field effect transistor.

【図5】図4のA−A線上の断面図である。FIG. 5 is a sectional view taken along line AA in FIG. 4;

【符号の説明】[Explanation of symbols]

1  基体 2  バッファ層 3  チャンネル形成層 4  スペーサー層 5  キャリア供給層 6  島状動作領域 6a  側面 7  ゲート電極 7a  延在部 11  バンドギャップの大なる層 1 Base 2 Buffer layer 3 Channel forming layer 4 Spacer layer 5 Carrier supply layer 6 Island-like operating area 6a Side 7 Gate electrode 7a Extension part 11. Large bandgap layer

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】  絶縁性ないしは半絶縁性基体上に、少
なくともチャンネル層とこれに比し、バンドギャップが
大なるキャリア供給層とが順次積層された島状の動作領
域と、該島状動作領域上からその外側に延在する延在部
を有するゲート電極とを有し、該ゲート電極の上記延在
部が上記島状動作領域の側面に、上記チャンネル形成層
のバンドギャップより大なるバンドギャップを有するバ
ンドギャップの大なる層を介して接するように構成した
ことを特徴とする高電子移動度電界効果トランジスタ。
1. An island-shaped operating region in which at least a channel layer and a carrier supply layer having a larger band gap than the channel layer are sequentially laminated on an insulating or semi-insulating substrate; and the island-shaped operating region. a gate electrode having an extending portion extending from above to the outside thereof, and the extending portion of the gate electrode has a bandgap larger than the bandgap of the channel forming layer on a side surface of the island-like operating region. 1. A high electron mobility field effect transistor characterized in that the high electron mobility field effect transistor is configured such that the transistors are in contact with each other through a layer having a large band gap.
JP6346491A 1991-03-27 1991-03-27 Field effect transistor of high electron mobility Pending JPH04298051A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010238975A (en) * 2009-03-31 2010-10-21 Asahi Kasei Electronics Co Ltd Semiconductor device, and method of manufacturing the same

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010238975A (en) * 2009-03-31 2010-10-21 Asahi Kasei Electronics Co Ltd Semiconductor device, and method of manufacturing the same

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