JPH0414311A - Comparator circuit - Google Patents
Comparator circuitInfo
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- JPH0414311A JPH0414311A JP11889790A JP11889790A JPH0414311A JP H0414311 A JPH0414311 A JP H0414311A JP 11889790 A JP11889790 A JP 11889790A JP 11889790 A JP11889790 A JP 11889790A JP H0414311 A JPH0414311 A JP H0414311A
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Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、ヒステリシス幅を定電流回路によって制御が
可能で、かつ、入力インピーダンスが非常に高いヒステ
リシス付きのコンパレータ回路に関する。DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a comparator circuit with hysteresis whose hysteresis width can be controlled by a constant current circuit and whose input impedance is very high.
従来の技術
従来のヒステリシス幅の制御可能なヒステリシス付きコ
ンパレータ回路を第2図に示す。以下図面を用いてその
構成と動作を説明すると、非反転入力端子7に抵抗6を
接続し、抵抗6の他端をヒステリシス付きコンパレータ
のプラス側入力端子5とする。非反転入力端子7は、さ
らに第1のダイオード8のアノードに接続される。第1
のダイオード8のカソードは、第2のダイオード9のカ
ソードと接続し、さらに定電流源10のソース側に接続
される。第2のダイオード9のアノードは、前記、コン
パレータ1の出力端子11に接続される。以上のような
回路構成において、反転入力端子4をマイナス側入力端
子とすると、マイナス側入力端子4に入力される電圧を
V2(以後、V2と記す。)、プラス側入力端子5に入
力される電圧をV+(以後、Vlと記す。)、出力端子
11に出力される電圧Vo(以後、Voと記す。)、ま
た、コンパレータの非反転入力端子7の電圧をVs(以
後、Vsと記す。)とすると、VsくV2の状態からV
s>V2の状態に変わったときのVsは、定電流源10
の電流をIo(以後、IOと記す。)、抵抗の値をR(
以後、Rと記す。)とすると、
V s = Vl −RX I o ・・・・・(I
)となる。また、Vs>V2の状態からVs<V2の状
態に変わったときのVsは、Vs=V1 である。した
がってヒステリシス幅は、RXIoとなり、ヒステリシ
ス幅を小さくしたい場合でも、I。2. Description of the Related Art A conventional comparator circuit with hysteresis whose hysteresis width can be controlled is shown in FIG. The configuration and operation will be described below with reference to the drawings. A resistor 6 is connected to the non-inverting input terminal 7, and the other end of the resistor 6 is used as the positive input terminal 5 of a comparator with hysteresis. The non-inverting input terminal 7 is further connected to the anode of the first diode 8. 1st
The cathode of the diode 8 is connected to the cathode of the second diode 9 and further connected to the source side of the constant current source 10 . The anode of the second diode 9 is connected to the output terminal 11 of the comparator 1. In the above circuit configuration, if the inverting input terminal 4 is the negative input terminal, the voltage input to the negative input terminal 4 is V2 (hereinafter referred to as V2), and the voltage input to the positive input terminal 5 is V2 (hereinafter referred to as V2). The voltage is V+ (hereinafter referred to as Vl), the voltage Vo output to the output terminal 11 (hereinafter referred to as Vo), and the voltage at the non-inverting input terminal 7 of the comparator is Vs (hereinafter referred to as Vs). ), then Vs decreases from the state of V2 to V
When the state changes to s>V2, Vs is the constant current source 10
The current is Io (hereinafter referred to as IO), and the resistance value is R(
Hereinafter, it will be referred to as R. ), then V s = Vl −RX I o ...(I
). Further, when the state of Vs>V2 changes to the state of Vs<V2, Vs is Vs=V1. Therefore, the hysteresis width is RXIo, and even if you want to make the hysteresis width smaller, I.
の大きさでヒステリシス幅を制御できる。The hysteresis width can be controlled by the size of .
発明が解決しようとする課題
このような従来のコンパレータ回路では、コンパレータ
のプラス側入力端子5から定電流1oを引き込むため、
プラス側入力端子に接続される信号源インピーダンスが
十分に低くないと入力電圧値がずれてしまうという問題
点がある。Problems to be Solved by the Invention In such a conventional comparator circuit, in order to draw a constant current 1o from the positive input terminal 5 of the comparator,
If the impedance of the signal source connected to the positive input terminal is not sufficiently low, there is a problem that the input voltage value will deviate.
本発明は、このような従来の課題を解決するもので、ヒ
ステリシス幅を生じさせる電流を別の定電流源より供給
することにより、出力インピーダンスの高い信号源を接
続しても入力電圧値がずれないようにし、かつ、その定
電流の切り換えをダイオードスイッチで行うことにより
少ない素子数でヒステリシス幅を生ずるコンパレータを
提供するのを目的とする。The present invention solves these conventional problems by supplying a current that causes a hysteresis width from another constant current source, so that even if a signal source with high output impedance is connected, the input voltage value will not deviate. It is an object of the present invention to provide a comparator that can generate a hysteresis width with a small number of elements by switching the constant current using a diode switch.
課題を解決するための手段
上記の目的を達成するため、本発明のコンパレータは、
コンパレータのプラス側電源端子にプラスの電源を接続
し、マイナス側電源端子には、マイナスの電源を接続し
、前記コンパレータの非反転入力端子に抵抗を接続し、
前記、抵抗の他端をヒステリシス付きコンパレータのプ
ラス側入力端子とし、前記、コンパレータの反転入力端
子をヒステリシス付きコンパレータのマイナス側入力端
子とする。前記、コンパレータの非反転入力端子は、さ
らに第1のダイオードのアノードに接続され、第1のダ
イオードのカソードは、第2のダイオードのカソードに
接続され、さらに、第1の定電流源のソース側に接続さ
れる。前記、第2のダイオードのアノードは、前記、コ
ンパレータの出力端子に接続される。前記、コンパレー
タの出力端子は、さらに、インバータの入力に接続され
る。前記、インバータの出力は、第4のダイオードのカ
ソードに接続され、前記、第4のダイオードのアノード
は、第3のダイオードのアノードと、第2の定電流源の
シンク側に接続される。前記、第3のダイオードのカソ
ードは、前記、ヒステリシス付きコンパレータのプラス
側入力端子に接続される。前記コンパレータの出力端子
は、前記、ヒステリシス付きコンパレータの出力端子と
なるように構成されている。Means for Solving the Problems In order to achieve the above object, the comparator of the present invention has the following features:
A positive power source is connected to the positive power terminal of the comparator, a negative power source is connected to the negative power terminal of the comparator, and a resistor is connected to the non-inverting input terminal of the comparator.
The other end of the resistor is a positive input terminal of a comparator with hysteresis, and the inverting input terminal of the comparator is a negative input terminal of the comparator with hysteresis. The non-inverting input terminal of the comparator is further connected to the anode of the first diode, the cathode of the first diode is connected to the cathode of the second diode, and the source side of the first constant current source is connected to the non-inverting input terminal of the comparator. connected to. The anode of the second diode is connected to the output terminal of the comparator. The output terminal of the comparator is further connected to the input of an inverter. The output of the inverter is connected to the cathode of the fourth diode, and the anode of the fourth diode is connected to the anode of the third diode and the sink side of the second constant current source. The cathode of the third diode is connected to the positive input terminal of the comparator with hysteresis. The output terminal of the comparator is configured to be the output terminal of the comparator with hysteresis.
作用
この構成によって、ヒステリシス幅は、従来のように入
力信号によって作るのでな(、別の定電流源によって作
るため、入力インピーダンスが非常に高(、かつ定電流
と抵抗の大きさの積で、容易に、正確なヒステリシス幅
の制御が可能となる。Effect With this configuration, the hysteresis width is not created by the input signal as in the conventional case (but is created by another constant current source), so the input impedance is very high (and it is the product of the constant current and the size of the resistance, It becomes possible to easily and accurately control the hysteresis width.
実施例
以下本発明の一実施例のコンパレータ回路を第1図を参
照しながら説明する。Embodiment A comparator circuit according to an embodiment of the present invention will be described below with reference to FIG.
図において、従来例の第2図と同一機能を有する素子に
は、同一の符号を付して説明を省略する。第1のダイオ
ード8のアノードは、非反転入力端子7に、前記ダイオ
ード8のカソードは、コンパレータ1の出力端子11に
アノードを接続した第2のダイオード9のカソードとと
もに、第1の定電流源10のソース側に接続され、前記
コンパレータ1の出力端子11は、さらに、インバータ
12の入力端が接続され、前記インバータ12の出力側
は、第4のダイオード13のカソードに接続され、前記
、第4のダイオード13のアノードは、第3のダイオー
ド14のアノードとともに、第2の定電流源15のシン
ク側に接続され、前記、第3のダイオード14のカソー
ドは、非反転入力端子7に接続された抵抗6の他端に接
続されている。In the figure, elements having the same functions as those in the conventional example shown in FIG. The anode of the first diode 8 is connected to the non-inverting input terminal 7, and the cathode of the diode 8 is connected to the cathode of the second diode 9 whose anode is connected to the output terminal 11 of the comparator 1. The output terminal 11 of the comparator 1 is further connected to the input terminal of an inverter 12, and the output side of the inverter 12 is connected to the cathode of a fourth diode 13. The anode of the diode 13 is connected to the sink side of the second constant current source 15 together with the anode of the third diode 14, and the cathode of the third diode 14 is connected to the non-inverting input terminal 7. It is connected to the other end of the resistor 6.
以上のように構成されたヒステリシス付きのコンパレー
タ回路の動作を説明すると、プラス側入力端子5の入力
電圧v1が反転入力端子4の入力電圧v2に対して、v
、<v2の状態からVl 〉V2の状態に移って行(と
、非反転入力端子7の電圧Vsは、抵抗6の抵抗値をR
6、第1の定電流源電流および第1の定電流源電流をI
Oとすると、
V s =V −1o X Rs ・・・・・・(2
)となるので、V+の値がV2よりIoXRsだけ高く
なったときコンパレータ1の出力端子11の出力電圧V
oは、ローレベルVOtからハイレベルVO)Iへと切
り換わり、第2のダイオード9がオンし、第1のダイオ
ードがオフする。またこのとき、V o = VOHの
ため、第4のダイオード13は、オンし、第3のダイオ
ード14はオフするので、第2の定電流源電流は、第4
のダイオード13と第2のダイオード9を径で、第1の
定電流源10へ流れる。この間はVs=V1の関係が成
立している。To explain the operation of the comparator circuit with hysteresis configured as above, the input voltage v1 of the positive input terminal 5 is
, <v2 to the state of Vl >V2 (and the voltage Vs of the non-inverting input terminal 7 changes the resistance value of the resistor 6 to R
6. The first constant current source current and the first constant current source current are I
When O, V s = V −1o X Rs ・・・・・・(2
), so when the value of V+ becomes higher than V2 by IoXRs, the output voltage V of the output terminal 11 of the comparator 1
o switches from low level VOt to high level VO)I, the second diode 9 is turned on, and the first diode is turned off. At this time, since V o = VOH, the fourth diode 13 is turned on and the third diode 14 is turned off, so the second constant current source current is equal to the fourth diode 13.
The current flows through the diode 13 and the second diode 9 to the first constant current source 10. During this time, the relationship Vs=V1 holds true.
つぎに、V、>V2 (D状態からv、 <V2 (7
)状態に移って行くと、V、=Vs =v2のときに、
VoはVO)IからvoLへと切り換わるために、第4
のダイオード13および第2のダイオード9はオフし、
第1のダイオード8および第3のダイオード14がオン
し、式C)の状態となる。Next, V, > V2 (from D state v, < V2 (7
) state, when V, = Vs = v2,
Vo is the fourth in order to switch from VO)I to voL.
diode 13 and second diode 9 are turned off,
The first diode 8 and the third diode 14 are turned on, resulting in the state of formula C).
このとき、第2の定電流源より抵抗R6を通して流され
た電流Ioは、第1の定電流源が電流IOを引っばって
いるために、コンパレータの非反転入力端子7へ流れ込
む電流は減少するため、コンパレータ1の入力インピー
ダンスは非常に高(なり、ヒステリシス幅は、IoXR
6となり、ヒステリシス幅を、小さくとる場合でも、I
Oで正確に制御することができ、なおかつ、R6を小さ
(することができる。At this time, the current Io flowing from the second constant current source through the resistor R6 decreases because the first constant current source is pulling the current IO. Therefore, the input impedance of comparator 1 is very high (and the hysteresis width is IoXR
6, and even if the hysteresis width is set small, I
O can be accurately controlled, and R6 can be made small.
発明の効果
以上のように、本発明によれば、ヒステリシス幅を小さ
くとる場合でも、抵抗R6を小さくすることができ、し
かも、電流1oで、ヒステリシス幅を正確に制御するこ
とができる入力インピーダンスが非常に高いヒトテリシ
ス付きコンパレータを構成することができる実用性の高
いコンパレータを提供できる。Effects of the Invention As described above, according to the present invention, even when the hysteresis width is set small, the resistance R6 can be made small, and the input impedance is such that the hysteresis width can be accurately controlled at a current of 1o. It is possible to provide a highly practical comparator that can be configured as a comparator with extremely high human teresis.
第1図は本発明の一実施例のコンパレータ回路の回路図
、第2図は従来例のコンパレータ回路の回路図である。
1・・・・・・コンパレータ、2・・・・・・プラス側
電源端子、3・・・・・・マイナス側電源端子、4・・
・・・・反転入力端子、5・・・・・・プラス側入力端
子、6・・・・・・抵抗(R6)、7・・・・・・非反
転入力端子、8・・・・・・第1のダイオード、9・・
・・・・第2のダイオード、10・・・・・・第1の定
電流源、11・・・・・・出力端子、12・・・・・・
インバータ、13・・・・・・第4のダイオード、14
・・・・・・第3のダイオード、15・・・・・・第2
の定電流源。
代理人の氏名 弁理士 粟野重孝 ほか1名第1図
コンハルレータ
第2図FIG. 1 is a circuit diagram of a comparator circuit according to an embodiment of the present invention, and FIG. 2 is a circuit diagram of a conventional comparator circuit. 1...Comparator, 2...Positive side power terminal, 3...Minus side power terminal, 4...
...Inverting input terminal, 5...Positive input terminal, 6...Resistor (R6), 7...Non-inverting input terminal, 8...・First diode, 9...
...Second diode, 10...First constant current source, 11...Output terminal, 12...
Inverter, 13...Fourth diode, 14
...Third diode, 15...Second
constant current source. Name of agent: Patent attorney Shigetaka Awano and one other person Figure 1 Conhalrator Figure 2
Claims (1)
ス側入力端子とするコンパレータにおいて、前記非反転
入力端子に第1のダイオードのアノードを接続し、出力
端子に第2のダイオードのアノードを接続し、さらに前
記第1のダイオードのカソードと前記第2のダイオード
のカソードを第1の定電流源のソース側に接続し、さら
に前記出力端子をインバータの入力に接続し、前記イン
バータの出力と第4のダイオードのカソードを接続し、
また、前記第4のダイオードのアノードと第3のダイオ
ードのアノードを第2の定電流源のシンク源に接続し、
さらに前記第3のダイオードのカソードを前記プラス側
入力端子に接続した回路構成を有するコンパレータ回路
。In a comparator in which a resistor is connected to a non-inverting input terminal and the other end of the resistor is a positive input terminal, an anode of a first diode is connected to the non-inverting input terminal, and an anode of a second diode is connected to the output terminal. further, the cathode of the first diode and the cathode of the second diode are connected to the source side of the first constant current source, and the output terminal is connected to the input of the inverter, and the output terminal of the inverter is connected to the source side of the first constant current source. and connect the cathode of the fourth diode,
Further, the anode of the fourth diode and the anode of the third diode are connected to a sink source of a second constant current source,
Furthermore, the comparator circuit has a circuit configuration in which the cathode of the third diode is connected to the positive input terminal.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11889790A JPH0414311A (en) | 1990-05-08 | 1990-05-08 | Comparator circuit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11889790A JPH0414311A (en) | 1990-05-08 | 1990-05-08 | Comparator circuit |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0414311A true JPH0414311A (en) | 1992-01-20 |
Family
ID=14747870
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11889790A Pending JPH0414311A (en) | 1990-05-08 | 1990-05-08 | Comparator circuit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0414311A (en) |
-
1990
- 1990-05-08 JP JP11889790A patent/JPH0414311A/en active Pending
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