JPH0382336A - Power distributing circuit provided with overcurrent detection - Google Patents
Power distributing circuit provided with overcurrent detectionInfo
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02H—EMERGENCY PROTECTIVE CIRCUIT ARRANGEMENTS
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- H02H3/08—Emergency protective circuit arrangements for automatic disconnection directly responsive to an undesired change from normal electric working condition with or without subsequent reconnection ; integrated protection responsive to excess current
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Abstract
Description
【産業上の利用分野】
本発明は、負荷に対して、より詳しくは過電流状態を検
出する手段を含むような回路に対して負荷電流を供給す
るための電力分配回路に関する。FIELD OF THE INVENTION The present invention relates to a power distribution circuit for supplying load current to a load, and more particularly to a circuit including means for detecting an overcurrent condition.
負荷へ負荷電流を供給し、過電流検出手段を含む電力分
配回路は公知である。例えば米国特許4゜705、99
7号および4.654.586号を参照。このような回
路は、典型的に負荷の低電位側に位置するように負荷と
大地との間に設けられた電流スイッチを含む。過電流検
出手段は、低電位側のスイ・ノチにおける電流レベルに
応答する。典型的にこのような回路は、典型的に演算増
幅器回路で構成される過電流検出デバイスに負のバイア
スを与えるために2極性の電源を必要とする。Power distribution circuits that supply load current to a load and include overcurrent detection means are known. For example, U.S. Patent 4°705,99
See No. 7 and No. 4.654.586. Such circuits include a current switch placed between the load and ground, typically on the low potential side of the load. The overcurrent detection means is responsive to the current level at the low potential side switch. Typically such circuits require a bipolar power supply to provide a negative bias to the overcurrent detection device, which is typically comprised of an operational amplifier circuit.
車のように典型的に単一極性の電源が供給される環境下
では、2極性の電源を必要とする上述の先行技術回路を
用いることはできない。高電位側の電源スィッチに電流
検知用のMOSFETを用いることも公知である。しか
しながら、これらのデバイスは、検知回路をICに集積
することにより達成される、より複雑な制御回路を用い
る。
従って、本発明の目的は、負荷の高電位側に位置するス
イッチを有し、そして、負荷における過電流状態を検出
するための、単純で信頼できるディスクリートの回路手
段を有する電力分配回路を提供することにある。この電
力分配回路は好ましくは、スイッチあるいは負荷の破壊
を防止するために過電流状態の検知するや否やスイッチ
を介して電流を遮断する手段を含む。以下の型の回路は
、典型的には車で供給されるような単一1i源での使用
に特に適している。
本発明の別の目的は、典型的に車で遭遇するような大き
い温度変化に拘わらず、正確にかつ確実に機能する過電
流保護を有する電力分配回路を提供することにある。
本発明の別の目的は、容易に入手できるディスクリート
の要素を使用して安価に製造できる過電流保護を有する
電流分配回路を提供することにある。In a typically unipolar powered environment such as a car, the prior art circuits described above which require a bipolar power supply cannot be used. It is also known to use a MOSFET for current detection in a power switch on the high potential side. However, these devices use more complex control circuitry, which is accomplished by integrating the sensing circuitry into an IC. It is therefore an object of the present invention to provide a power distribution circuit having a switch located on the high potential side of the load and having simple and reliable discrete circuit means for detecting overcurrent conditions in the load. There is a particular thing. The power distribution circuit preferably includes means for interrupting current through the switch upon detection of an overcurrent condition to prevent destruction of the switch or load. The following types of circuits are particularly suitable for use with single 1i sources, such as those typically supplied in vehicles. Another object of the invention is to provide a power distribution circuit with overcurrent protection that functions accurately and reliably despite the large temperature changes typically encountered in vehicles. Another object of the invention is to provide a current distribution circuit with overcurrent protection that is inexpensive to manufacture using readily available discrete components.
本発明の好ましい様式によれば、負荷に負荷電流を供給
するための電力分配回路が提供される。
この回路は、電源に接続するための電力ノードと、負荷
に接続するための負荷ノードと、および電力/−ドから
負荷メートへ電流を供給するための高電位の電流経路を
含む。高電位の電流経路は、制御端子に結合される制御
信号により状態が制御される電流スイッチを含む。この
電力分配回路は、更に、高電位の電流経路の状態に応答
する、一つの確実な過電流検出回路を含む。過電流検出
回路は、高電位の電流経路における電流が所定のレベル
を超過したときの検出を行う。電力分配回路は好ましく
は更に、過電流状態が検出されたとき、負荷への電流を
ターンオフするための電流遮断手段を含む。
正確で信頼できる過電流検出のために本発明の特に好ま
しい実施例では、高電位の電流経路における電流スイッ
チは、多数の端子を有するマルチセルのデバイスを含み
、多数の端子として、電力手段に接続された第1の主の
電流端子、多数のデバイスセルを電気的負荷に接続する
第2の主電流端子、主のデバイス電流に一般に比例する
電流を与えるように、一つの終端が少数のデバイスセル
に接続される第1の補助端子、および、一つの終端が多
数のデバイスセルに接続される第2の補助端子を備える
。本実施例における過電流検出回路は好ましくは、第1
の補助端子と大地間に接続された一つの分岐を有し、こ
の分岐は、トランジスタのようなバイアス制御されるイ
ンピーダンス変換デバイスおよび、インピーダンス変換
デバイスと接地間に設けられ、一端に主のデバイス電流
にほぼ比例する電圧を与える抵抗の直列回路を備え、ま
た、第2の補助端子と接地手段の間に接続され、第1の
分岐のインピーダンス変換デバイスのためにバイアス電
流を与える別の分岐を含む。
前述の過電流検出回路におけるインピーダンス変換デバ
イスは、高電位側の第1の補助ノード(接続点〉から低
電位の抵抗への電流を有利に結合する。このことが抵抗
を望ましくは以下に記述するような低い値にできる。According to a preferred aspect of the invention, a power distribution circuit is provided for supplying load current to a load. The circuit includes a power node for connecting to a power source, a load node for connecting to a load, and a high potential current path for supplying current from the power node to the load mate. The high potential current path includes a current switch whose state is controlled by a control signal coupled to a control terminal. The power distribution circuit further includes a positive overcurrent detection circuit responsive to high potential current path conditions. The overcurrent detection circuit detects when the current in the high potential current path exceeds a predetermined level. The power distribution circuit preferably further includes current interrupt means for turning off current to the load when an overcurrent condition is detected. In a particularly preferred embodiment of the invention for accurate and reliable overcurrent detection, the current switch in the high potential current path comprises a multi-cell device with a large number of terminals connected to the power means as a large number of terminals. a first main current terminal connecting a large number of device cells to an electrical load; a second main current terminal connecting a large number of device cells to an electrical load; one termination connecting a small number of device cells to provide a current generally proportional to the main device current; A first auxiliary terminal is connected to the terminal, and a second auxiliary terminal is connected to a plurality of device cells. The overcurrent detection circuit in this embodiment preferably has a first
The branch has one branch connected between the auxiliary terminal of the transistor and ground, which branch is connected to a bias-controlled impedance conversion device such as a transistor, and between the impedance conversion device and ground, and has one end connected to the main device current. a series circuit of resistors providing a voltage approximately proportional to , and also including another branch connected between the second auxiliary terminal and the grounding means and providing a bias current for the impedance transformation device of the first branch. . The impedance transformation device in the above-mentioned overcurrent detection circuit advantageously couples the current from the first auxiliary node on the high potential side to the resistor at the lower potential, which is preferably described below. It can be set to a low value such as
【実施例]
図において、別にことわりがない限り、同じ参照番号は
同じ部分を示す。
第1図は、典型的な“H”ブリッジ回路10に結合して
用いられた本発明の電力分配回路の一般的な概略図を示
す。第1図の電力分配回路は、付随的にHブリッジ回路
10に結びついた制御回路12を含む。
Hブリッジ回路10を検討すると、負荷の足L0が水平
方向に延在し、そして電気モータのような負荷14を含
む。垂直の足り、は、負荷の足L0の左端ノード16と
、典型的には車への応用のために12ボルトである上部
ノード18との間に延在する。負荷の足り、は、ノード
16と、典型的には大地電位であるノード20との間に
延在する。
負荷の足り、は、負荷の足L0の右端のノード22と上
部ノード18’との間に接続される。負荷の足し4は、
ノード22と大地ノード20′との間に接続される。
“垂直”および“水平”に関連して、Hブリッジの回路
10の種々の足の向きは、゛当然、単に記述の目的のた
めであり、実際のHブリッジ回路の配置を正確に描いて
いる場合もあるがそうでない場合もある。
空想線で示したように、高電位のノード18および18
’は一般には相互接続され、大地ノード20および20
°も同し理由により相互接続される。
負荷の足し、ないしL4内には個々に電流スイッチS、
ないしS4が含まれる。これらのスイッチは、それらの
ゲートG、ないしG4に与えられる個々の信号により制
御される。ここで用いたように、“ゲート”という言葉
は、電流スイッチのスイッチング状態を変化するための
あらゆる形態の制御手段を包含する。そういうわけで“
ゲート”という言葉は、例えばバイポーラトランジスタ
の“ベース”と同意義語とされる。
負荷14に矢印25で示した向きに直流電流を流すため
に、適切な信号がスイッチS1とS、のゲートG、とG
4に個々に印加されてこれらのスイッチがオンにされ、
他方、この間、スイッチS、とS、のゲートに適切な信
号が印加されてこれらのスイッチがオフにされる。逆に
、矢印27の向きに負荷14に直流電流を流すために、
スイッチS、とS、がそれらのゲートへの適切な制御に
より導通にされ、他方、スイッチS1と84はこの間オ
フに保たれる。
負荷14あるいはHブリッジ回路IOの高電位側の足に
位置するスイッチSlおよびSa(“高電位スイッチ”
)を破壊するような過電流状態を防止するために、制御
回路12の一部として示された、過電流検出器24およ
び30が高電位の足り、およびL3における個々の電気
的状態に応答する。
好ましい構成では、過電流検出器24は、第2A図およ
び第3図に関連して以下に記述されるスイッチS、にお
ける電気的状態に応答する。
続いて第1図において、検出器24により過電流状態が
検出されたとき、ゲート無効回路26は、通常のゲート
制御機能28を無効にして上記のスイッチS1およびS
4を確実にオフ状態にする。同様に、検出器30によっ
てスイッチS、で過電流状態の検出時にゲート無効回路
32は、通常のゲート制御機能34がスイッチS、およ
びS、をターンオンするのを阻止する。
スイッチS1および過電流検出器24は第2A図でより
詳細に示されている。スイッチS、および過電流検出器
30は、スイッチSIおよび検出器24に対応する構成
を有する。第2A図を見ると、スイッチS、は、商標“
’HE X S ense″で販売されているような、
MO8FETデバイ又のシンボルで示されている。HE
X S enseのデバイスSlの主の負荷端子は、
端子16および18で示される。端子16は、スイッチ
S、の主のソース端子であり、端子18は、スイッチの
唯一のドレイン端子である。ゲートG、は第1図の電流
スイッチSlのゲートG、に対応する。
HE X S enseデバイスS、は、更に2個の補
助端子40および42を備える。補助端子40および4
2の主端子16への相互関係は第3図のスイ・ノチS1
の回路図に関連して説明する。第3図におけるセルC8
ないしCnは、HE X 5enseデバイスS1の個
々のセルを示している。共通のゲートG1は、セルC8
ないしCnの各々のゲートに対して共通のゲート信号を
与える。ドレイン電極18は、ドレイン電極18は、す
べてのセルC3ないしCnに対して共通のドレイン電極
として機能する。ソース端子16は、スイッチS1の大
多数のセル、即ち、セルC1ないしCnに対して共通の
ソースとして機能し、一方、端子42は、小さい金属化
抵抗(不図示)を除いてソース電極16と共通に接続さ
れる補助のソース電極として機能する。補助端子40は
、スイッチS1のセルの少数、即ちセルC3とC7のみ
に対してソース電極として機能する。
数千あるいはより多くのセルを有する実際のデノくイス
において、補助端子40は、おそらく数百のセルに対し
てソースとして機能する。
HE X S enseデバイスSlは集積回路で形成
され、そのセルの各々は他のセルと同じ特性を持つ。
この理由のために、ドレインから補助ソース40に流れ
る電流は、ドレイン18から主ソース16へ流れる電流
にほぼ比例し、ここでその比例は、端子40に接続され
た少数のセル数対、端子16に接続された大多数のセル
数の比率により決定される。
HE X S enseデバイスS1の更なる詳細は、
譲受人により1986年に刊行したNo、AN−959
の“パワーMO3FETの応用ノート”に示されており
、ここで参考として述べる。
上述したスイッチS1のマルチセル構造の記述から、H
E X S enseデバイスの代わりに他のタイプの
マルチセルのスイッチングデバイスをここで使用され得
るということは当業者には明白であろう。例をあげれば
、マルチセルのサイリスクチバイスが適切な置き換えに
適う。
第2A図に戻り、補助端子40および42は、PNPバ
イポーラトランジスタ44および46と抵抗48および
50よりなる電流検知回路43に接続されている。補助
端子40を流れるスイッチSIからの電流は、バイアス
信号で制御されるトランジスタ44に導かれ、その結果
、抵抗48に電圧降下を生じさせる。トランジスタ44
のベース電流を無視すると、抵抗48に生じる電圧降下
は、端子40に流れる電流に比例し、それ故、端子16
に流れる負荷電流に比例する。ノード52における電圧
はその結果、負荷電流に比例する。
トランジスタ44は、高電位側の補助ノード4′0から
低電位側の抵抗48へ結合するインピーダンス変換デバ
イスとして機能する。このことが、抵抗48を以下に限
定するような好ましい低い値とすることを可能にする。
回路43の、ベースとコレクタを短絡し、P−Nダイオ
ードとして機能するトランジスタ46は、ミラー回路に
対してバイアス電流を与える。トランジスタ44および
46は、エミッタからベースへの等しいターンオンしき
い値を有するように好ましくは整合されたシリコンで形
成される。
負荷(過電流トリップ箇所にて)に過電流状態が生じた
とき、電流検出回路43の抵抗48および50は、必ず
しもそうではないが、好ましくは、これらの抵抗に等し
い電流が流れるように選択される。回路設計者は、補助
端子4.0に接続されたH E X S enseスイ
ッチS、におけるセル数対、負荷14に接続されたこの
ようなスイッチにおけるセル数の比率に基づき、ノード
52の電圧が負荷電流に直線的に変化するよう、抵抗4
8および50を選択することができる。回路設計者は、
しかしながら、前述の比率と異なった比率に基づき、ノ
ード52での電圧が負荷電流に直線的に変化するように
抵抗48および50を選択することができる。これによ
り、回路設計者は、ノード52での相対的な電圧変化を
負荷14での電流レベルの変化に変えるために、抵抗4
8および50を選択することができる。
ノード(第2A図)のライン電圧が公称12Vにあって
は、PNPトランジスタ44および46は、一般に20
0のβ値と60Vの降伏電圧を有し、そして抵抗48お
よび50は、一般にそれぞれ487Ωおよび9.lKΩ
の値を有する。ターンオン時の尖ったいずれの電流電位
をも除去するために、付加的に0.001または0.O
1μFのキャパシタ49(空想線で示した)が抵抗48
に対して接続される。
電流検出回路43のノード52の電圧は、コンパレータ
62の入力ツードロ0に印加され、他方の入力ノードに
は、過電流レベルを決定するために選択された基準電圧
レベル64が接続される。
世較器62の出力部は、標準の5Vの論理回路で都合よ
く処理が行えるように、12Vから5Vへのレベルシフ
ター66に接続される。ノード60の電圧が基準レベル
電圧64の電圧を超過したとき、コンパレータ62は、
出力し、電圧基準シフター66で処理されて第1図およ
び第4図に関連して述べたゲート無効回路26に印加さ
れる。
電流検出回路43は、コンパレータ62のノード60に
負荷電流に正確に比例した電圧を与える、他のいずれの
回路により置き換えることができる。
好ましい別の電流検出回路は、第2B図に回路70とし
て示されている。第2A図の回路43と同様に、第2B
図の回路70は、好ましくは、2個のバイポーラトラン
ジスタ44′および46′と抵抗48°および50’を
備える。回路70のトランジスタ44°および抵抗48
′は、第2A図の回路43の同一の符号の素子と同じよ
うに機能する。
しかしながら、別にPNPバイポーラトランジスタ72
がトランジスタ46°に結合して設けられている。トラ
ンジスタ72の付加により、周囲温度の大きい変化にも
拘わらず回路70を一定に動作させ、供給電圧が変化し
たとき、動作の安定性を幾分か改善する。
整合したシリコントランジスタ44および46を除けば
、双方の電流検出回路43および70(第2A図および
第2B図)は、安価なディスクリートの個別な素子で有
利に形成される。
電流検出回路70において、PNP)ランジスタ44’
、46’および72は好ましくは、一般に200のβ値
と、60Vの降伏電圧を有し、そして、抵抗48”およ
び抵抗50′は好ましくは、それぞれ240Ωおよび6
.5にΩを有する。ターンオン時の尖った電流の電位を
除去するために付加的に分流用のキャパシタ49′(空
想線で示した)が抵抗48′に対して接続される。一般
的にその値は0.001または0.01μFである。
第4図において、第1図に関して述べたゲート無効回路
26がより詳細に示されている。第4図を検討すると、
一般的には5vである、過電流検出1124からの過電
流信号は、CMOSナントゲート(不図示)で形成され
るリセット/セットのラッチ80のリセット端子に与え
られる。ラッチ80のリセット端子に印加される信号は
、ゲート制御機能28からセット/リセットのラッチ8
0のセット人力部に印加される、マイクロプロセッサよ
りの5vの信号のいずれをも無効にする。セット/リセ
ットのラッチ80の出力は、ブリドライバ回路82によ
り処理され、スイッチSIおよびS4(第1図)のゲー
トG、およびG4に対して適当なバイアス信号として供
給される。
高電位側のゲートGlおよびG3には、好ましくは供給
電圧よりおよそ12V高いバイアス用電圧が供給され、
この電圧は、通常の電圧倍増回路(不図示)で発生して
もよい。これに対し、低電位側のゲートG、およびG、
に対し、バイアス用電圧として一般に12Vの供給電圧
が印加される。ブリドライバ回路82は、前述したバイ
アス用電圧を与えるためにゲート無効回路32(第1図
)の対応するブリドライバ回路(不図示)と協力動作す
る。
前述のブリドライバ回路は、図示したように、制御スイ
ッチS、およびS3を制御するラッチ80からの一つの
論理人力と、他の二つのスイッチを制御する他の論理人
力(不図示)を有するように設計できる。これとは別に
、ブリドライバ回路は、つの論理人力のトグルスイッチ
S、およびS2、あるいは反対に、トグルS3および$
4と同様な他の論理入力を有するように設計できる。
ブリドライバ回路82およびスイッチS、およびS、に
対するその対応部は、負荷に対して他の方向に電流の流
れを生じる前に一方向に流れる電流が十分となるように
、ゲートG、ないしG4に対する制御信号に遅延を与え
るように設計することもできる。これとは別に、一般的
にはマイクロプロセッサで実行されるゲート制御機能2
8および34(第1図)がこのような遅延を与えてもよ
い。
第5図は、半発明のより一般化された形態を示しており
、−電流のスイッチSI′が負荷14’の高電位側に設
けられる。過電流検出器24′、ゲート無効回路26′
、およびゲート制御機能28′は、上述した°゛H”ブ
リッジ型の電力分配器と同一の符号を付した部品と対応
する。
第6図は、この発明の更に別の実施例を示しており、第
2A図と同一の要素には同一の番号を付している。第6
図は、第2A図と異なるのは、抵抗90がトランジスタ
44および46のベースと接地との間に接続され、又、
トランジスタ46のコレクタが直接に接地される。第6
図の回路は、温度変化に起因する電圧、電流およびトラ
ンジスタノヘータの変化を伴う電流比の変化が見いださ
れている。これらの問題は、第2A図の回路でほとんど
避けられる。しかしながら、第6図の回路は、第2A図
および2B図の回路の動作の原理を示しており、いくつ
かの応用には十分である。第6図の回路において、抵抗
48は、1000Ωの抵抗値を有し、抵抗90は、50
にΩないし100にΩの抵抗を有する。
【発明の効果】
負荷電流を負荷に供給するための電力分配回路を述べた
。この電力分配回路は、負荷の過電流状態を検出するた
めの過電流検出回路を含む。本発明の電力分配回路は、
負荷に選択できる極性の電流を供給するための“H”ブ
リッジ形態の回路を含んでもよい。付加的に、いわゆる
カレントミラーの概念を適用した正確で信頼性のある過
電流検出回路を含んでもよい。本発明の電力分配回路は
、安価で容易に調達できるディスクリートの要素を用い
ることができる。
本発明は、好ましい実施例に関連して述べたが、当業者
に対しては他の多くの変形が明白となる。
それ故、本発明は、明細書だけで限定されず、付記した
請求の範囲にのみにより限定される。[Example] In the figures, the same reference numbers indicate the same parts unless otherwise specified. FIG. 1 shows a general schematic diagram of the power distribution circuit of the present invention used in conjunction with a typical "H" bridge circuit 10. The power distribution circuit of FIG. 1 optionally includes a control circuit 12 coupled to an H-bridge circuit 10. The power distribution circuit of FIG. Considering the H-bridge circuit 10, the load leg L0 extends horizontally and includes a load 14, such as an electric motor. The vertical leg extends between the leftmost node 16 of load leg L0 and the top node 18, which is typically 12 volts for automotive applications. The load factor extends between node 16 and node 20, which is typically at ground potential. The load foot is connected between the rightmost node 22 and the upper node 18' of the load foot L0. Load addition 4 is
It is connected between the node 22 and the ground node 20'. The various leg orientations of the H-bridge circuit 10 with respect to "vertical" and "horizontal" are, of course, for descriptive purposes only and do not accurately depict the layout of the actual H-bridge circuit. Sometimes it's true, sometimes it's not. High potential nodes 18 and 18 as shown in phantom lines
' are generally interconnected and earth nodes 20 and 20
° are also interconnected for the same reason. In addition to the load, or in L4, there is an individual current switch S,
to S4 are included. These switches are controlled by individual signals applied to their gates G to G4. As used herein, the term "gate" encompasses all forms of control means for changing the switching state of a current switch. That’s why “
The word "gate" is synonymous with the "base" of a bipolar transistor, for example. In order to cause a direct current to flow through the load 14 in the direction shown by the arrow 25, an appropriate signal is applied to the gate G of the switches S1 and S. , and G
4 are applied individually to turn on these switches,
On the other hand, during this time, appropriate signals are applied to the gates of switches S and S to turn them off. Conversely, in order to flow a DC current to the load 14 in the direction of the arrow 27,
Switches S, and S are made conductive by appropriate controls on their gates, while switches S1 and 84 are kept off during this time. Switches Sl and Sa (“high potential switches”) located on the high potential side leg of the load 14 or the H-bridge circuit IO
), overcurrent detectors 24 and 30, shown as part of the control circuit 12, respond to the presence of a high potential and a respective electrical condition at L3. . In a preferred configuration, overcurrent detector 24 is responsive to an electrical condition at switch S, described below in connection with FIGS. 2A and 3. Continuing in FIG. 1, when an overcurrent condition is detected by detector 24, gate disable circuit 26 disables normal gate control function 28 and switches S1 and S described above.
Make sure to turn 4 off. Similarly, upon detection of an overcurrent condition at switch S by detector 30, gate disable circuit 32 prevents normal gate control function 34 from turning on switches S and S. Switch S1 and overcurrent detector 24 are shown in more detail in FIG. 2A. Switch S and overcurrent detector 30 have configurations corresponding to switch SI and detector 24. Looking at Figure 2A, switch S is the trademark “
Like those sold at 'HEX Sense',
The MO8FET device is shown as a symbol. H.E.
The main load terminal of the device Sl of X S sense is
Shown at terminals 16 and 18. Terminal 16 is the main source terminal of switch S, and terminal 18 is the only drain terminal of the switch. Gate G corresponds to gate G of current switch Sl in FIG. The HEX sense device S further includes two auxiliary terminals 40 and 42. Auxiliary terminals 40 and 4
2 to the main terminal 16 is Sui Nochi S1 in FIG.
This will be explained in relation to the circuit diagram. Cell C8 in Figure 3
to Cn designate the individual cells of the HEX 5ense device S1. Common gate G1 is connected to cell C8
A common gate signal is applied to each gate of Cn to Cn. The drain electrode 18 functions as a common drain electrode for all cells C3 to Cn. Source terminal 16 serves as a common source for the majority of cells of switch S1, ie, cells C1 to Cn, while terminal 42 is connected to source electrode 16 with the exception of a small metallized resistor (not shown). It functions as a commonly connected auxiliary source electrode. Auxiliary terminal 40 serves as a source electrode for only a small number of cells of switch S1, namely cells C3 and C7. In an actual denomination device with thousands or more cells, the auxiliary terminal 40 would likely serve as a source for several hundred cells. The HEX sense device Sl is formed of an integrated circuit, each of its cells having the same characteristics as the other cells. For this reason, the current flowing from the drain to the auxiliary source 40 is approximately proportional to the current flowing from the drain 18 to the main source 16, where the proportionality is greater than the small number of cells connected to the terminal 40 versus the terminal 16 determined by the ratio of the majority of cells connected to the Further details of the HE X S sense device S1 can be found at
No. AN-959 published in 1986 by the assignee.
It is shown in "Application Notes for Power MO3FET" and is described here for reference. From the description of the multi-cell structure of switch S1 mentioned above, H
It will be obvious to those skilled in the art that other types of multi-cell switching devices may be used here instead of EXS sense devices. For example, a multi-cell thyristor device would be a suitable replacement. Returning to FIG. 2A, auxiliary terminals 40 and 42 are connected to a current sensing circuit 43 consisting of PNP bipolar transistors 44 and 46 and resistors 48 and 50. Current from switch SI flowing through auxiliary terminal 40 is directed to transistor 44 controlled by a bias signal, resulting in a voltage drop across resistor 48 . transistor 44
Neglecting the base current of , the voltage drop across resistor 48 is proportional to the current flowing through terminal 40 and therefore
proportional to the load current flowing through the The voltage at node 52 is then proportional to the load current. Transistor 44 functions as an impedance conversion device that couples from auxiliary node 4'0 on the high potential side to resistor 48 on the low potential side. This allows resistor 48 to have a preferred low value, such as: Transistor 46 of circuit 43, which shorts the base and collector and functions as a PN diode, provides a bias current to the mirror circuit. Transistors 44 and 46 are preferably formed of matched silicon to have equal turn-on thresholds from emitter to base. Resistors 48 and 50 of current sensing circuit 43 are preferably, but not necessarily, selected such that a current equal to their resistance flows when an overcurrent condition occurs in the load (at the overcurrent trip point). Ru. The circuit designer determines that the voltage at node 52 is based on the ratio of the number of cells in the HEX sense switch S, connected to the auxiliary terminal 4.0 to the number of cells in such a switch connected to the load 14. Resistor 4 so that it changes linearly with the load current.
8 and 50 can be selected. The circuit designer
However, resistors 48 and 50 may be selected based on ratios different from those described above so that the voltage at node 52 varies linearly with load current. This allows the circuit designer to use resistor 4 to convert the relative voltage change at node 52 into a change in current level at load 14.
8 and 50 can be selected. With the line voltage at the node (FIG. 2A) nominally 12V, PNP transistors 44 and 46 are typically 20V.
have a β value of 0 and a breakdown voltage of 60V, and resistors 48 and 50 are typically 487Ω and 9.5Ω, respectively. lKΩ
has the value of In order to eliminate any sharp current potential at turn-on, an additional 0.001 or 0. O
A 1 μF capacitor 49 (shown as a phantom line) connects the resistor 48
connected to. The voltage at node 52 of current detection circuit 43 is applied to the input of comparator 62, the other input node of which is connected to a reference voltage level 64 selected for determining the overcurrent level. The output of the comparator 62 is connected to a 12V to 5V level shifter 66 for convenient processing with standard 5V logic circuits. When the voltage at node 60 exceeds the voltage at reference level voltage 64, comparator 62
It is output, processed by a voltage reference shifter 66, and applied to the gate override circuit 26 described in connection with FIGS. 1 and 4. Current sensing circuit 43 may be replaced by any other circuit that provides a voltage at node 60 of comparator 62 that is exactly proportional to the load current. Another preferred current sensing circuit is shown as circuit 70 in FIG. 2B. Similar to the circuit 43 of FIG. 2A, the circuit 43 of FIG.
The illustrated circuit 70 preferably includes two bipolar transistors 44' and 46' and resistors 48° and 50'. Transistor 44° and resistor 48 of circuit 70
' functions in the same manner as the similarly labeled elements of circuit 43 of FIG. 2A. However, separately the PNP bipolar transistor 72
is coupled to transistor 46°. The addition of transistor 72 provides constant operation of circuit 70 despite large changes in ambient temperature and provides some improvement in stability of operation as the supply voltage changes. With the exception of matched silicon transistors 44 and 46, both current sensing circuits 43 and 70 (FIGS. 2A and 2B) are advantageously formed from inexpensive discrete individual components. In the current detection circuit 70, the PNP) transistor 44'
, 46' and 72 preferably have a β value of generally 200 and a breakdown voltage of 60V, and resistors 48'' and 50' preferably have a β value of 240Ω and 60V, respectively.
.. It has Ω at 5. A shunt capacitor 49' (shown in phantom) is additionally connected to resistor 48' to remove the sharp current potential during turn-on. Typically its value is 0.001 or 0.01 μF. In FIG. 4, the gate override circuit 26 described with respect to FIG. 1 is shown in more detail. Considering Figure 4, we find that
The overcurrent signal from overcurrent detection 1124, typically 5 volts, is provided to the reset terminal of a reset/set latch 80 formed by a CMOS Nant gate (not shown). A signal applied to the reset terminal of latch 80 is applied to the set/reset latch 8 from gate control function 28.
A set of 0 disables any 5V signal from the microprocessor applied to the human power section. The output of set/reset latch 80 is processed by Bridriver circuit 82 and provided as an appropriate bias signal to gates G and G4 of switches SI and S4 (FIG. 1). The high potential side gates Gl and G3 are preferably supplied with a bias voltage approximately 12V higher than the supply voltage;
This voltage may be generated by a conventional voltage doubling circuit (not shown). On the other hand, the gates G and G on the low potential side,
On the other hand, a supply voltage of 12V is generally applied as a bias voltage. The bridriver circuit 82 cooperates with a corresponding bridriver circuit (not shown) of the gate disable circuit 32 (FIG. 1) to provide the bias voltage described above. The aforementioned Bridriver circuit has one logic input from the latch 80 that controls the control switch S and S3 as shown, and another logic input (not shown) that controls the other two switches. It can be designed to Apart from this, the Bridriver circuit has two logical human-powered toggle switches S and S2 or, conversely, toggle S3 and $
It can be designed to have other logic inputs similar to 4. The bridriver circuit 82 and its counterpart for switches S and S are configured to provide sufficient current flow to gates G through G4 so that sufficient current flows in one direction before causing current flow in the other direction to the load. It can also be designed to give a delay to the control signal. Apart from this, there is a gate control function 2 which is generally performed by a microprocessor.
8 and 34 (FIG. 1) may provide such a delay. FIG. 5 shows a more generalized form of the semi-invention, in which a -current switch SI' is provided on the high potential side of the load 14'. Overcurrent detector 24', gate invalidation circuit 26'
, and the gate control function 28' correspond to parts with the same reference numbers as in the °H" bridge type power divider described above. FIG. 6 shows yet another embodiment of the invention. , the same elements as in Fig. 2A are given the same numbers.
The figure differs from FIG. 2A in that a resistor 90 is connected between the bases of transistors 44 and 46 and ground;
The collector of transistor 46 is directly grounded. 6th
The circuit shown in the figure is found to have a change in current ratio with changes in voltage, current and transistor resistance due to temperature changes. These problems are largely avoided in the circuit of FIG. 2A. However, the circuit of FIG. 6 illustrates the principle of operation of the circuit of FIGS. 2A and 2B and is sufficient for some applications. In the circuit of FIG. 6, resistor 48 has a resistance value of 1000Ω, and resistor 90 has a resistance value of 50Ω.
It has a resistance of 1 to 100 Ω. [Effects of the Invention] A power distribution circuit for supplying load current to a load has been described. This power distribution circuit includes an overcurrent detection circuit for detecting an overcurrent condition of the load. The power distribution circuit of the present invention includes:
A circuit in the form of an "H" bridge may be included to provide current of selectable polarity to the load. Additionally, an accurate and reliable overcurrent detection circuit applying the so-called current mirror concept may be included. The power distribution circuit of the present invention can use discrete components that are inexpensive and easily procured. Although the invention has been described in conjunction with a preferred embodiment, many other variations will be apparent to those skilled in the art. Therefore, the invention is limited not only by the specification, but only by the scope of the appended claims.
第1図は、いわゆる“H”ブリッジ回路に用いた本発明
の概略を示す部分ブロック図、
第2A図は、第1図の電流スイッチs1および過電流検
出器24の部分ブロック図、
第2B図は、第2A図の過電流検出器に用いることので
きる選択的な電流検出回路のブロック図、第3図は、第
1図のスイッチs1を実行するために使用される多区画
の電流スイッチの概略図、第4図は、第1図のゲート無
効回路26内に含まれるサブ回路のブロック図、
第5図は、本発明の一般的な形態のブロック図、第6図
は、本発明の別の実施例の回路ブロック図である。
10・・・Hブリッジ回路、
12・・・制御回路、14・・・負荷、16.18,2
0.22・・・ノード、24.30・・・過電流検出器
、
26.32・・・ゲート無効回路、
28・・・ゲート制御機能、
40.42・・・補助端子、
43・・・電流検出回路、
44.46・・・トランジスタ、
48.50・・・抵抗、
49・・・キャパシタ、
62・・・コンパレータ、
64・・・基準電圧レベル、
66・・・電圧基準シフター
70・・・電流検出回路、
72・・・トランジスタ、
L、ないしL4・・・負荷の足、
Slないしs4・・・電流スイッチ、
G、ないしG1・・ゲート、
CIないしCn・・・セルFIG. 1 is a partial block diagram schematically showing the present invention used in a so-called "H" bridge circuit, FIG. 2A is a partial block diagram of the current switch s1 and overcurrent detector 24 of FIG. 1, and FIG. 2B is a block diagram of a selective current sensing circuit that may be used in the overcurrent detector of FIG. 2A, and FIG. 3 is a block diagram of a multi-section current switch used to implement switch s1 of FIG. 4 is a block diagram of a subcircuit included in the gate disabling circuit 26 of FIG. 1; FIG. 5 is a block diagram of a general form of the present invention; and FIG. 6 is a block diagram of a general form of the present invention. FIG. 3 is a circuit block diagram of another embodiment. 10... H bridge circuit, 12... Control circuit, 14... Load, 16.18,2
0.22... Node, 24.30... Overcurrent detector, 26.32... Gate invalidation circuit, 28... Gate control function, 40.42... Auxiliary terminal, 43... Current detection circuit, 44.46...Transistor, 48.50...Resistor, 49...Capacitor, 62...Comparator, 64...Reference voltage level, 66...Voltage reference shifter 70...・Current detection circuit, 72...Transistor, L, or L4...Leg of load, Sl or s4...Current switch, G, or G1...Gate, CI or Cn...Cell
Claims (10)
あって、 電源に接続するための電力ノードと、 負荷に接続するための負荷ノードと、 スイッチ状態が制御端子に結びついた制御信号により制
御される電流スイッチを備え、電力ノードから負荷ノー
ドに電流を供給するための高電位電流経路と、 高電位電流経路の電気的状態に応答し、かつ、高電位電
流経路における電流レベルを検出するための電流検出回
路であって、第1の補助端子と大地間に接続され、主の
デバイス電流にほぼ比例した電圧を一端に生じさせる抵
抗および、トランジスタのようなバイアス信号で制御さ
れるインピーダンス変換デバイスの直列回路を含む一つ
の分岐と、第2の補助端子と接地手段の間に接続され、
第1の分岐のインピーダンス変換デバイスのためにバイ
アス電流を与える別の分岐とを含む電流検出経路と、 を備えたことを特徴とする電力分配回路。(1) A power distribution circuit for supplying load current to a load, which includes a power node for connecting to a power source, a load node for connecting to a load, and a control signal whose switch state is connected to a control terminal. a high potential current path for supplying current from a power node to a load node; and a controlled current switch responsive to an electrical condition of the high potential current path and detecting a current level in the high potential current path. a current sensing circuit for a device comprising a resistor connected between a first auxiliary terminal and ground and producing a voltage at one end approximately proportional to the main device current, and an impedance transformation controlled by a bias signal, such as a transistor; connected between one branch containing the series circuit of the device and a second auxiliary terminal and the grounding means;
and another branch providing a bias current for the impedance conversion device of the first branch.
超過する電流を検出したとき、高電位電流経路の電流ス
イッチをターンオフするための電流遮断手段を更に備え
る請求項1記載の電力分配回路。(2) The power distribution circuit according to claim 1, further comprising current interrupting means for turning off a current switch in the high potential current path when the current detection circuit detects a current exceeding a predetermined level in the high potential current path. .
の端子を有するマルチセルのデバイスを含み、多数の端
子として、電力手段に接続された第1の主電流端子、多
数のデバイスセルを負荷の足の個々のノード端に接続す
る第2の主電流端子、主のデバイス電流に一般に比例す
る電流を与えるように、一つの終端が少数のデバイスセ
ルに接続される第1の補助端子、および、一つの終端が
多数のデバイスセルに接続される第2の補助端子を備え
、電流検出回路が第1および第2の補助端子の電気的状
態に応答する請求項1記載の電力分配回路。(3) The current switch in the current path of high potential includes a multi-cell device with a large number of terminals, the first main current terminal connected to the power means, a large number of device cells connected to the foot of the load. a second main current terminal that connects to individual node ends of the main current terminal, a first auxiliary terminal that has one end connected to a small number of device cells to provide a current that is generally proportional to the main device current; 2. The power distribution circuit of claim 1, further comprising a second auxiliary terminal having one end connected to a plurality of device cells, and wherein the current sensing circuit is responsive to electrical conditions of the first and second auxiliary terminals.
結合された第2のインピーダンス変換デバイスを更に備
え、前記第2のインピーダンス変換手段は、上記のバイ
アス信号で制御されるインピーダンス置換デバイスに結
合される請求項1記載の電力分配回路。(4) further comprising a second impedance conversion device coupled between the load node and the ground within the other branch, the second impedance conversion means being an impedance replacement device controlled by the bias signal; 2. The power distribution circuit of claim 1, wherein the power distribution circuit is coupled to.
のノード端および負荷に接続するための手段を有する負
荷の足と、 電流を負荷に供給するために電源に接続するための電源
手段と、 負荷電流を電源に戻すための経路を与える接地手段と、 第1の方向に負荷に負荷電流を供給するための第1の電
流経路であって、電力手段と負荷の足の第1のノード端
との間に接続された第1の高電位の足および、負荷の足
の第2のノード端と接地手段との間に接続された第1の
低電位の足を備える、第1の電流経路と、 第2の方向に負荷に負荷電流を供給するための第2の電
流経路であって、電力手段と負荷の足の第2のノード端
との間に接続された第2の高電位の足および、負荷の足
の第1のノード端と接地手段との間に接続された第2の
低電位の足を備える、第2の電流経路と、 を備え、 高および低電位の足は、それぞれ電流スイッチを備え、
そのスイッチング状態が制御端子に結びついた制御信号
により制御され、 電力分配回路は更に、第1および第2の高電位の足の電
流レベルを検出するために、これらの足におけるそれぞ
れの電気的状態に応答する第1および第2の電流検出回
路を備えたことを特徴とする電力分配回路。(5) an "H" bridge type power distribution circuit having two node ends and a load leg having means for connecting to the load, and a power source for connecting to a power supply for supplying current to the load; means for providing a path for the load current to return to the power supply; and a first current path for supplying the load current to the load in a first direction, the first current path between the power means and the load. a first high potential leg connected between a node end of the load leg and a first low potential leg connected between a second node end of the load leg and the grounding means; a second current path for supplying a load current to the load in a second direction, the second current path connected between the power means and a second node end of the leg of the load; a second current path comprising a high potential leg and a second low potential leg connected between the first node end of the load leg and the grounding means; Each leg is equipped with a current switch,
The switching state is controlled by a control signal coupled to the control terminal, and the power distribution circuit is further coupled to the respective electrical states in the first and second high potential legs to detect current levels in the legs. A power distribution circuit comprising responsive first and second current detection circuits.
の電流検出回路が所定のレベルの超過を検出したとき、
このような足における電流スイッチを少なくともターン
オフするための電流遮断手段を更に備えた請求項5記載
の電力分配回路。(6) when the respective current detection circuits associated with the first and second high potential legs detect an excess of a predetermined level;
6. The power distribution circuit of claim 5 further comprising current interrupting means for turning off at least a current switch in such foot.
チは、多数の端子を有するマルチセルのデバイスを含み
、多数の端子として、電力手段に接続された第1の主電
流端子、多数のデバイスセルを負荷の足の個々のノード
端に接続する第2の主電流端子、主のデバイス電流に一
般に比例する電流を与えるように、一つの終端が少数の
デバイスセルに接続される第1の補助端子、および、一
つの終端が多数のデバイスセルに接続される第2の補助
端子を備え、電流検出回路が第1および第2の補助端子
の電気的状態に応答する請求項5記載の電力分配回路。(7) The current switch in the first and second high potential legs comprises a multi-cell device with a number of terminals, as the number of terminals the first main current terminal connected to the power means, a number of devices a second main current terminal that connects the cells to individual node ends of the load legs; a first auxiliary, one end of which is connected to a small number of device cells to provide a current that is generally proportional to the main device current; 6. The power distribution of claim 5, comprising a terminal and a second auxiliary terminal having one termination connected to a plurality of device cells, and wherein the current sensing circuit is responsive to electrical conditions of the first and second auxiliary terminals. circuit.
に結合された第2のインピーダンス変換デバイスを更に
備え、前記第2のインピーダンス変換手段は、上記バイ
アス制御のインピーダンス変換デバイスに結合される請
求項5記載の電力分配回路。(8) further comprising a second impedance conversion device coupled between the load node and the ground within the other branch, the second impedance conversion means coupled to the bias-controlled impedance conversion device; The power distribution circuit according to claim 5.
イスは、共に第1および第2のバイポーラトランジスタ
をそれぞれ備え、更に第3のバイポーラトランジスタを
備え、該第3のトランジスタのエミッタおよびコレクタ
は、第1および第2のバイポーラトランジスタの共通ベ
ースと接地間に接続され、該第3のトランジスタのベー
ス電極は、第2の分岐におけるトランジスタおよび抵抗
間のノードに接続される請求項4記載の電力分配回路。(9) The first and second impedance conversion devices described above both include first and second bipolar transistors, respectively, and further include a third bipolar transistor, and the emitter and collector of the third transistor are 5. The power distribution circuit of claim 4, wherein the power distribution circuit is connected between the common base of the first and second bipolar transistors and ground, and the base electrode of the third transistor is connected to a node between the transistor and the resistor in the second branch. .
バイスは、共に第1および第2のバイポーラトランジス
タをそれぞれ備え、更に第3のバイポーラトランジスタ
を備え、該第3のトランジスタのエミッタおよびコレク
タは、第1および第2のバイポーラトランジスタの共通
ベースと接地間に接続され、該第3のトランジスタのベ
ース電極は、第2の分岐におけるトランジスタおよび抵
抗間のノードに接続される請求項8記載の電力分配回路
。(10) The first and second impedance conversion devices described above both include first and second bipolar transistors, respectively, and further include a third bipolar transistor, and the emitter and collector of the third transistor are 9. The power distribution circuit of claim 8, wherein the power distribution circuit is connected between the common base of the first and second bipolar transistors and ground, and the base electrode of the third transistor is connected to a node between the transistor and the resistor in the second branch. .
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