JPH0370261B2 - - Google Patents
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- Publication number
- JPH0370261B2 JPH0370261B2 JP21284385A JP21284385A JPH0370261B2 JP H0370261 B2 JPH0370261 B2 JP H0370261B2 JP 21284385 A JP21284385 A JP 21284385A JP 21284385 A JP21284385 A JP 21284385A JP H0370261 B2 JPH0370261 B2 JP H0370261B2
- Authority
- JP
- Japan
- Prior art keywords
- protection key
- memory protection
- program
- transmission means
- word
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- 230000005540 biological transmission Effects 0.000 claims description 20
- 230000010365 information processing Effects 0.000 claims description 5
- 238000000605 extraction Methods 0.000 description 5
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000012790 confirmation Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Landscapes
- Storage Device Security (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は記憶保護キー制御装置に関し、特にパ
イプライン制御を行う情報処理システムにおいて
プログラム状態語の変更に伴う記憶保護キー変更
の制御を行う記憶保護キー制御装置に関する。
イプライン制御を行う情報処理システムにおいて
プログラム状態語の変更に伴う記憶保護キー変更
の制御を行う記憶保護キー制御装置に関する。
従来、この種の記憶保護キー制御装置は、プロ
グラム状態語の変更に伴い実行プログラムの参照
情報への読出し、格納および実行に関する許可ま
たは禁止を表示する記憶保護キーを変更するとき
には、プログラム状態語内のに新たな記憶保護キ
ーが確定するのを待つてからプログラム状態語よ
り記憶保護キーを伝達手段を介してオペランド取
出し回路に伝達するという制御を行つていた。
グラム状態語の変更に伴い実行プログラムの参照
情報への読出し、格納および実行に関する許可ま
たは禁止を表示する記憶保護キーを変更するとき
には、プログラム状態語内のに新たな記憶保護キ
ーが確定するのを待つてからプログラム状態語よ
り記憶保護キーを伝達手段を介してオペランド取
出し回路に伝達するという制御を行つていた。
上述した従来の記憶保護キー制御装置は、プロ
グラム状態語の変更に伴つて記憶保護キーを変更
するときには新たな記憶保護キーがパイプライン
の最下段に存在するプログラム状態語に伝達され
て確定するまで待つてから記憶保護キーをオペラ
ンド取出し回路に伝達していたので、記憶保護キ
ーの変更に多くの時間を要し、パイプライン制御
を行う情報処理システムの性能を低下させるとい
う欠点がある。
グラム状態語の変更に伴つて記憶保護キーを変更
するときには新たな記憶保護キーがパイプライン
の最下段に存在するプログラム状態語に伝達され
て確定するまで待つてから記憶保護キーをオペラ
ンド取出し回路に伝達していたので、記憶保護キ
ーの変更に多くの時間を要し、パイプライン制御
を行う情報処理システムの性能を低下させるとい
う欠点がある。
本発明の目的は、プログラム状態語の確定を待
つことなしに新たな記憶保護キーをオペランド取
出し回路に伝達することができるようにした記憶
保護キー制御装置を提供することにある。
つことなしに新たな記憶保護キーをオペランド取
出し回路に伝達することができるようにした記憶
保護キー制御装置を提供することにある。
本発明の記憶保護キー制御装置は、パイプライ
ン制御を行う情報処理システムの記憶保護キー制
御装置において、命令の順序の制御および実行中
のプログラムに関連したシステム状況を保持し表
示するプログラム状態語と、演算実行結果を保持
するレジスタと、前記プログラム状態語より実行
プログラムの参照情報への読出し、格納および実
行に関する許可または禁止の情報である記憶保護
キーを伝達する第1の伝達手段と、前記演算実行
結果を保持するレジスタより前記記憶保護キーと
同様の記憶保護キーを伝達する第2の伝達手段
と、前記プログラム状態語の変更に伴う前記記憶
保護キーの変更時に新たなプログラム状態語の確
定するまでは前記第2の伝達手段より伝達された
前記記憶保護キーを選択しそれ以外のときには前
記第1の伝達手段より伝達された前記記憶保護キ
ーを選択してオペランド取出し回路に供給する選
択手段とを有する。
ン制御を行う情報処理システムの記憶保護キー制
御装置において、命令の順序の制御および実行中
のプログラムに関連したシステム状況を保持し表
示するプログラム状態語と、演算実行結果を保持
するレジスタと、前記プログラム状態語より実行
プログラムの参照情報への読出し、格納および実
行に関する許可または禁止の情報である記憶保護
キーを伝達する第1の伝達手段と、前記演算実行
結果を保持するレジスタより前記記憶保護キーと
同様の記憶保護キーを伝達する第2の伝達手段
と、前記プログラム状態語の変更に伴う前記記憶
保護キーの変更時に新たなプログラム状態語の確
定するまでは前記第2の伝達手段より伝達された
前記記憶保護キーを選択しそれ以外のときには前
記第1の伝達手段より伝達された前記記憶保護キ
ーを選択してオペランド取出し回路に供給する選
択手段とを有する。
次に、本発明について図面を参照して詳細に説
明する。
明する。
図は本発明の記憶保護キー制御装置の一実施例
を示すブロツク図である。本実施例の記憶保護キ
ー制御装置は、命令語1と、命令解読回路2と、
アドレス生成回路3と、オペランド取出し回路4
と、記憶装置5と、装置保護キー6と、演算レジ
スタ7と、プログラム状態語8と、プログラム状
態語8より記憶保護キーを伝達する第1の伝達手
段9と、演算レジスタ7より記憶保護キーを伝達
する第2の伝達手段10と、選択回路11とから
構成されている。
を示すブロツク図である。本実施例の記憶保護キ
ー制御装置は、命令語1と、命令解読回路2と、
アドレス生成回路3と、オペランド取出し回路4
と、記憶装置5と、装置保護キー6と、演算レジ
スタ7と、プログラム状態語8と、プログラム状
態語8より記憶保護キーを伝達する第1の伝達手
段9と、演算レジスタ7より記憶保護キーを伝達
する第2の伝達手段10と、選択回路11とから
構成されている。
命令語解読回路2は、命令語1の情報を受けて
命令の解読を行う回路である。
命令の解読を行う回路である。
アドレス生成回路3は、命令語解読回路2で解
読された命令語1の情報を基に演算実行に必要な
情報の記憶装置5内の実アドレスを算出する回路
である。
読された命令語1の情報を基に演算実行に必要な
情報の記憶装置5内の実アドレスを算出する回路
である。
記憶装置5は、命令およびデータが格納されて
いる回路であつてソフトウエアにより複数に区分
されて制御されており、32ビツトからなる実アド
レスによりアクセスされる。
いる回路であつてソフトウエアにより複数に区分
されて制御されており、32ビツトからなる実アド
レスによりアクセスされる。
装置保護キー6は、記憶装置5のソフトウエア
により複数に区分された1区分に対して1つずつ
存在し、その区分への実行プログラムの参照情報
の読出し、格納および実行に関する許可または禁
止を表示するものであり、3ビツトよりなる。
により複数に区分された1区分に対して1つずつ
存在し、その区分への実行プログラムの参照情報
の読出し、格納および実行に関する許可または禁
止を表示するものであり、3ビツトよりなる。
プログラム状態語8は、命令の順序の制御およ
び現在実行中のプログラムに関連したシステム情
況を保持し表示するものであり、64ビツトより構
成され、第13ビツトから第15ビツトの3ビツトに
実行プログラムの参照情報の読出し、格納および
実行に関する許可または禁止を表す記憶保護キー
が格納されている。
び現在実行中のプログラムに関連したシステム情
況を保持し表示するものであり、64ビツトより構
成され、第13ビツトから第15ビツトの3ビツトに
実行プログラムの参照情報の読出し、格納および
実行に関する許可または禁止を表す記憶保護キー
が格納されている。
第1の伝達手段9は、プログラム状態語8内の
実行プログラムの参照情報への読出し、格納およ
び実行に関する許可または禁止を表す情報である
記憶保護キーを選択装置11に伝達する手段であ
る。
実行プログラムの参照情報への読出し、格納およ
び実行に関する許可または禁止を表す情報である
記憶保護キーを選択装置11に伝達する手段であ
る。
第2の伝達手段10は、プログラム状態語8が
変更される命令が実行され、その実行結果として
得られた新たなプログラム状態語を演算レジスタ
7が保持しているときに、新たな記憶保護キーを
演算レジスタ7より選択装置11に伝達する手段
である。
変更される命令が実行され、その実行結果として
得られた新たなプログラム状態語を演算レジスタ
7が保持しているときに、新たな記憶保護キーを
演算レジスタ7より選択装置11に伝達する手段
である。
選択回路11は、通常、プログラム状態語8か
ら第1の伝達手段9を介して伝達された記憶保護
キーを選択してオペランドへ取出し回路4に供給
するが、プログラム状態語8が変更される命令が
実行されその実行結果として得られた新たなプロ
グラム状態語を演算レジスタ7が保持していると
きには、演算レジスタ7から第2の伝達手段10
を介して伝達された記憶保護キーを選択してオペ
ランド取出し回路4に供給する回路である。
ら第1の伝達手段9を介して伝達された記憶保護
キーを選択してオペランドへ取出し回路4に供給
するが、プログラム状態語8が変更される命令が
実行されその実行結果として得られた新たなプロ
グラム状態語を演算レジスタ7が保持していると
きには、演算レジスタ7から第2の伝達手段10
を介して伝達された記憶保護キーを選択してオペ
ランド取出し回路4に供給する回路である。
オペランド取出し回路4は、アドレス生成回路
3で生成された実アドレスと選択回路11により
選択された記憶保護キーとを用いて記憶装置5に
アクセスを行う回路である。このアクセスを行う
際には、供給された記憶保護キーと装置保護キー
6との大小を比較し、記憶保護キーが装置保護キ
ー6より小さいか等しければオペランドの取出し
を行い演算レジスタ7にオペランドの供給を行う
が、記憶保護キーが装置保護キー6より大きけれ
ばオペランドの取出しが禁止されるためにオペラ
ンド取出しの例外を検出して処理を終了する。
3で生成された実アドレスと選択回路11により
選択された記憶保護キーとを用いて記憶装置5に
アクセスを行う回路である。このアクセスを行う
際には、供給された記憶保護キーと装置保護キー
6との大小を比較し、記憶保護キーが装置保護キ
ー6より小さいか等しければオペランドの取出し
を行い演算レジスタ7にオペランドの供給を行う
が、記憶保護キーが装置保護キー6より大きけれ
ばオペランドの取出しが禁止されるためにオペラ
ンド取出しの例外を検出して処理を終了する。
演算レジスタ7は、オペランド取出し回路4の
動作により記憶装置5からオペランドが供給され
て演算が実行される際に用いられるレジスタであ
る。
動作により記憶装置5からオペランドが供給され
て演算が実行される際に用いられるレジスタであ
る。
次に、このように構成された本実施例の記憶保
護キー制御装置の動作について具体的な値を用い
て詳細に説明する。
護キー制御装置の動作について具体的な値を用い
て詳細に説明する。
今、プログラム状態語8が16進数の
“1FF8100000112000”(“ ”は16進数を表す。以
下同様)という情報を保持し、命令語1がプログ
ラム状態語8を変更する命令である“92102000”
を供給され、装置保護キー6が全区分とも2進数
の“001”(2)(“ ”(2)は2進数を表す。以下同様)
である場合について考える。
“1FF8100000112000”(“ ”は16進数を表す。以
下同様)という情報を保持し、命令語1がプログ
ラム状態語8を変更する命令である“92102000”
を供給され、装置保護キー6が全区分とも2進数
の“001”(2)(“ ”(2)は2進数を表す。以下同様)
である場合について考える。
命令語1の“92102000”が命令語解読回路2に
より解読され、アドレス生成回路3にアドレス生
成に必要な命令語1の第12ビツトから第31ビツト
の“02000”の情報が供給される。アドレス生成
回路3は、命令解読回路2より供給されたアドレ
ス生成に必要な命令語1の第12ビツトから第31ビ
ツトの“02000”の情報から実アドレス
“00120000”を生成する。
より解読され、アドレス生成回路3にアドレス生
成に必要な命令語1の第12ビツトから第31ビツト
の“02000”の情報が供給される。アドレス生成
回路3は、命令解読回路2より供給されたアドレ
ス生成に必要な命令語1の第12ビツトから第31ビ
ツトの“02000”の情報から実アドレス
“00120000”を生成する。
選択回路11は、プログラム状態語8から第1
の伝達手段9を介して伝達された記憶保護キーを
選択する状態にあり、プログラム状態語8
“92102000”内の第13ビツトから第15ビツトの
“000”(2)を記憶保護キーとする。
の伝達手段9を介して伝達された記憶保護キーを
選択する状態にあり、プログラム状態語8
“92102000”内の第13ビツトから第15ビツトの
“000”(2)を記憶保護キーとする。
オペランド取出し回路4は、選択回路11によ
り供給された記憶保護キー“000”(2)とアドレス生
成回路3より供給された実アドレス“00120000”
とを用いて記憶装置5にアクセスする。このと
き、記憶保護キーは“000”(2)であり装置保護キー
6は“001”(2)であるから保護キー記憶の方が装置
保護キー6より小さく実行プログラムの参照情報
への読出し、格納および実行は許可されるので、
オペランド取出し回路4はオペランドの取出しを
正常に行うことができ、演算レジスタ7に記憶装
置5の実アドレス“00120000”から8バイトに格
納されている“1FF9100000113000”が供給され
る。
り供給された記憶保護キー“000”(2)とアドレス生
成回路3より供給された実アドレス“00120000”
とを用いて記憶装置5にアクセスする。このと
き、記憶保護キーは“000”(2)であり装置保護キー
6は“001”(2)であるから保護キー記憶の方が装置
保護キー6より小さく実行プログラムの参照情報
への読出し、格納および実行は許可されるので、
オペランド取出し回路4はオペランドの取出しを
正常に行うことができ、演算レジスタ7に記憶装
置5の実アドレス“00120000”から8バイトに格
納されている“1FF9100000113000”が供給され
る。
演算レジスタ7は、この“1FF9100000113000”
のデータを得て、これを新たなプログラム状態語
としてプログラム状態語8に格納する動作を開始
する。このとき同時に、第2の伝達手段10も動
作し、演算レジスタ7の保持する新たなプログラ
ム状態語の第13ビツトから第15ビツトの“001”(2)
を選択回路11に伝達する。
のデータを得て、これを新たなプログラム状態語
としてプログラム状態語8に格納する動作を開始
する。このとき同時に、第2の伝達手段10も動
作し、演算レジスタ7の保持する新たなプログラ
ム状態語の第13ビツトから第15ビツトの“001”(2)
を選択回路11に伝達する。
選択回路11は、第2の伝達手段10より伝達
される記憶保護キー“001”(2)を選択し、オペラン
ド取出し回路4にこの新たな記憶保護キー“001”
(2)を供給する。したがつて、この時点で次命令の
命令取出しが可能となる。
される記憶保護キー“001”(2)を選択し、オペラン
ド取出し回路4にこの新たな記憶保護キー“001”
(2)を供給する。したがつて、この時点で次命令の
命令取出しが可能となる。
次命令の命令取出しが可能となつた後、新たな
プログラム状態語がプログラム状態語8に確定す
る。このプログラム状態語8の確定後は、選択回
路11は第1の伝達手段9より伝達された記憶保
護キーを選択するようになり、プログラム状態語
8からの記憶保護キーに基づいて記憶装置5の記
憶保護が行われる通常の制御状態に復帰する。
プログラム状態語がプログラム状態語8に確定す
る。このプログラム状態語8の確定後は、選択回
路11は第1の伝達手段9より伝達された記憶保
護キーを選択するようになり、プログラム状態語
8からの記憶保護キーに基づいて記憶装置5の記
憶保護が行われる通常の制御状態に復帰する。
以上説明したように本発明は、演算実行結果を
保持するレジスタより実行プログラムの参照情報
への読出し、格納および実行に関する許可または
禁止の情報である記憶保護キーを伝達する第2の
伝達手段を設けることにより、プログラム状態語
の変更に伴い記憶保護キーを変更するときにプロ
グラム状態語に記憶保護キーが確定しなくても演
算実行結果を保持するレジスタに記憶保護キーが
確定したならば新たな記憶保護キーを伝達するこ
とが可能となり、パイプライン制御を行う情報処
理システムの性能を向上させることができるとい
う効果がある。
保持するレジスタより実行プログラムの参照情報
への読出し、格納および実行に関する許可または
禁止の情報である記憶保護キーを伝達する第2の
伝達手段を設けることにより、プログラム状態語
の変更に伴い記憶保護キーを変更するときにプロ
グラム状態語に記憶保護キーが確定しなくても演
算実行結果を保持するレジスタに記憶保護キーが
確定したならば新たな記憶保護キーを伝達するこ
とが可能となり、パイプライン制御を行う情報処
理システムの性能を向上させることができるとい
う効果がある。
図は本発明の一実施例を示す記憶保護キー制御
装置のブロツク図である。 図において、1…命令語、2…命令語解読回
路、3…アドレス生成回路、4…オペランド取出
し回路、5…記憶装置、6…装置保護キー、7…
演算レジスタ、8…プログラム状態語、9…第1
の伝達手段、10…第2の伝達手段、11…選択
回路である。
装置のブロツク図である。 図において、1…命令語、2…命令語解読回
路、3…アドレス生成回路、4…オペランド取出
し回路、5…記憶装置、6…装置保護キー、7…
演算レジスタ、8…プログラム状態語、9…第1
の伝達手段、10…第2の伝達手段、11…選択
回路である。
Claims (1)
- 【特許請求の範囲】 1 パイプライン制御を行う情報処理システムの
記憶保護キー制御装置において、 命令の順序の制御および実行中のプログラムに
関連したシステム状況を保持し表示するプログラ
ム状態語と、 演算実行結果を保持するレジスタと、 前記プログラム状態語より実行プログラムの参
照情報への読出し、格納および実行に関する許可
または禁止の情報である記憶保護キーを伝達する
第1の伝達手段と、 前記演算実行結果を保持するレジスタより前記
記憶保護キーと同様の記憶保護キーを伝達する第
2の伝達手段と、 前記プログラム状態語の変更に伴う前記記憶保
護キーの変更時に新たなプログラム状態語の確定
するまでは前記第2の伝達手段より伝達された前
記記憶保護キーを選択しそれ以外のときには前記
第1の伝達手段より伝達された前記記憶保護キー
を選択してオペランド取出し回路に供給する選択
手段と、 を有することを特徴とする記憶保護キー制御装
置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21284385A JPS6272045A (ja) | 1985-09-25 | 1985-09-25 | 記憶保護キ−制御装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21284385A JPS6272045A (ja) | 1985-09-25 | 1985-09-25 | 記憶保護キ−制御装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6272045A JPS6272045A (ja) | 1987-04-02 |
JPH0370261B2 true JPH0370261B2 (ja) | 1991-11-07 |
Family
ID=16629255
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP21284385A Granted JPS6272045A (ja) | 1985-09-25 | 1985-09-25 | 記憶保護キ−制御装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6272045A (ja) |
-
1985
- 1985-09-25 JP JP21284385A patent/JPS6272045A/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS6272045A (ja) | 1987-04-02 |
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