JPH0334453A - プルアップ低抗内蔵集積回路 - Google Patents
プルアップ低抗内蔵集積回路Info
- Publication number
- JPH0334453A JPH0334453A JP16675589A JP16675589A JPH0334453A JP H0334453 A JPH0334453 A JP H0334453A JP 16675589 A JP16675589 A JP 16675589A JP 16675589 A JP16675589 A JP 16675589A JP H0334453 A JPH0334453 A JP H0334453A
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- JP
- Japan
- Prior art keywords
- output
- integrated circuit
- pull
- signal
- resistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
- 230000010365 information processing Effects 0.000 description 1
Landscapes
- Semiconductor Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野〕
本発明は、情報処理装置等に使用される集積回路に関し
、特に出力信号をプルアップするための抵抗を内蔵した
プルアップ抵抗内蔵集積回路に関ケる。
、特に出力信号をプルアップするための抵抗を内蔵した
プルアップ抵抗内蔵集積回路に関ケる。
［従来の技術］
従来、この種の集積回路は第２図に示すようになってい
た。
た。
すなわち、第２図において、２０は集積回路であり、そ
の内部には出力バッファ１２か内蔵されている。また、
集積回路２０には所要の端子か設けてあり、１３は出力
制御端子で、出力バッファ１２に接続され、出力バッフ
ァ１２の出力を制御する。１４は入力信号端子であり、
出力バッファ１２に接続され、他の電子機器からの電気
信号を入力し出力バッファ１２に信号を送る。１５はＧ
ＮＤ端子であり、集積回路２０の安定を図る。
の内部には出力バッファ１２か内蔵されている。また、
集積回路２０には所要の端子か設けてあり、１３は出力
制御端子で、出力バッファ１２に接続され、出力バッフ
ァ１２の出力を制御する。１４は入力信号端子であり、
出力バッファ１２に接続され、他の電子機器からの電気
信号を入力し出力バッファ１２に信号を送る。１５はＧ
ＮＤ端子であり、集積回路２０の安定を図る。
さらに、１６は電源端子であり集積回路２０への電力供
給源である。１７は出力信号端子であり、バッファ回路
１２に接続され、入力信号端子１４から入力された電気
信号を出力ライン１８を通じて集積回路２０の外部へ出
力を行なう。
給源である。１７は出力信号端子であり、バッファ回路
１２に接続され、入力信号端子１４から入力された電気
信号を出力ライン１８を通じて集積回路２０の外部へ出
力を行なう。
したがって、このような構成からなる集積回路によれば
、入力信号端子１４から入力した電気信号は、通常、出
力バッファ１２を通過し、出力信号端子１７から外部に
出力され、出力ライン１８によって他の電子機器に入力
される。
、入力信号端子１４から入力した電気信号は、通常、出
力バッファ１２を通過し、出力信号端子１７から外部に
出力され、出力ライン１８によって他の電子機器に入力
される。
［解決すべき課８］
上述した従来の４Ｊ、、ｔａ回路は、プルアップ抵抗を
内蔵していなかった。このため集積回路２０からの出力
がハイインピーダンスになるときであっても、電気信号
の信号レベルは通常と同じし゛ベル、すなわちハイレベ
ルとローレベルとの中間レベルであった。
内蔵していなかった。このため集積回路２０からの出力
がハイインピーダンスになるときであっても、電気信号
の信号レベルは通常と同じし゛ベル、すなわちハイレベ
ルとローレベルとの中間レベルであった。
この場合、ハイインピーダンス出力に合わせ、電気信号
の出力信号レベルなハイレベルにするには、集積回路２
０とは別に、第２図に示すような外付のプルアップ抵抗
２１を設け、これによって出力信号をプルアップしてや
らなければならなかった。
の出力信号レベルなハイレベルにするには、集積回路２
０とは別に、第２図に示すような外付のプルアップ抵抗
２１を設け、これによって出力信号をプルアップしてや
らなければならなかった。
また、集積回路２０と別に、外部に設置することからプ
リント基板上の実装スペースが狭くなるという問題も生
した。
リント基板上の実装スペースが狭くなるという問題も生
した。
本発明は、上述した問題点にかんがみてなされたもので
、実積回路にプルアップ抵抗を内蔵することによって、
ハイインピーダンス出力に容易に対応てきるとともに、
実装スペースの縮小化を図ることかできるプルアップ抵
抗内蔵集積回路の提供を目的とする。
、実積回路にプルアップ抵抗を内蔵することによって、
ハイインピーダンス出力に容易に対応てきるとともに、
実装スペースの縮小化を図ることかできるプルアップ抵
抗内蔵集積回路の提供を目的とする。
［課題の解決手段］
」二足目的を遠戚するために本ＡＩＪＪは、電気信号の
人力信号端子と接続する出力バッファと、この出力バッ
ファに接続し、該出力バッファの出力を制御する出力制
御端子と、前記出力バッファに接続し該出力バッファか
らの信号を外部に出力する出力信号端子とを具備する集
積回路において、前記出力バッファと出力信号端子との
間にプルアップ抵抗を設けた構成としである。
人力信号端子と接続する出力バッファと、この出力バッ
ファに接続し、該出力バッファの出力を制御する出力制
御端子と、前記出力バッファに接続し該出力バッファか
らの信号を外部に出力する出力信号端子とを具備する集
積回路において、前記出力バッファと出力信号端子との
間にプルアップ抵抗を設けた構成としである。
［実施例］
以下１本発明の一実施例について、図面を参照して説明
する。
する。
第１図は本発明の一実施例に係るプルアップ抵抗内蔵集
積回路のブロック図である。なお、先に示した第２図と
同一部分には、同一符号を付し、その部分の詳細な説明
は省略する。
積回路のブロック図である。なお、先に示した第２図と
同一部分には、同一符号を付し、その部分の詳細な説明
は省略する。
図面において、１０は集積回路であり、この集積回路ｌ
Ｏの内部には、プルアップ抵抗１１が内蔵されている。
Ｏの内部には、プルアップ抵抗１１が内蔵されている。
このプルアップ抵抗１１は、一端部が電源端子１６に１
１統され、他端部は出力バッファ１２と出力信号端子１
７との間をつなぐ信号ライン１８に接続されている。
１統され、他端部は出力バッファ１２と出力信号端子１
７との間をつなぐ信号ライン１８に接続されている。
したがって、このような構成からなるプルアップ抵抗内
蔵集積回路によれば、まず、入力信号端子１４から入力
された電気信号は出力バッファ１２へ送られる。一方、
出力がハイインピーダンスになるときは、出力バッファ
１２は、出力制御端子１３からの信号によってハイイン
ピーダンス出力になるよう制御される。
蔵集積回路によれば、まず、入力信号端子１４から入力
された電気信号は出力バッファ１２へ送られる。一方、
出力がハイインピーダンスになるときは、出力バッファ
１２は、出力制御端子１３からの信号によってハイイン
ピーダンス出力になるよう制御される。
次に、出力バッファ１２に入力された電気信号もハイイ
ンピーダンスになるため、これに合わせて電気信号の出
力信号レベルかプルアップ抵抗１１によりプルアップさ
れる。このとき、出力ライン１８は電源端子１６に接続
されているので、出力信号レベルはハイレベルに保たれ
ることになる。
ンピーダンスになるため、これに合わせて電気信号の出
力信号レベルかプルアップ抵抗１１によりプルアップさ
れる。このとき、出力ライン１８は電源端子１６に接続
されているので、出力信号レベルはハイレベルに保たれ
ることになる。
［発明の効果］
以上説明したように本発明は、プルアップ抵抗を集積回
路に内蔵することによって、ハイインピーダンス出力に
容易に対応できるとともに、外付する必要がないことか
ら実装スペースの縮小化を憫ることができるといった効
果かある。
路に内蔵することによって、ハイインピーダンス出力に
容易に対応できるとともに、外付する必要がないことか
ら実装スペースの縮小化を憫ることができるといった効
果かある。
第１図は本発明の一実施例に係るプルアップ抵抗内蔵集
積回路のブロック図、第２図は従来の集積回路のブロッ
ク図である。 ｌＯ：集積回路 ｌｌニブルアップ抵抗１２：出力
バッファ １３：出力制御端子１４：入力信号端子 １
６：電源端子 １７：出力信号端子
積回路のブロック図、第２図は従来の集積回路のブロッ
ク図である。 ｌＯ：集積回路 ｌｌニブルアップ抵抗１２：出力
バッファ １３：出力制御端子１４：入力信号端子 １
６：電源端子 １７：出力信号端子
Claims (1)
- 電気信号の入力信号端子と接続する出力バッファと、こ
の出力バッファに接続し該出力バッファの出力を制御す
る出力制御端子と、前記出力バッファに接続し該出力バ
ッファからの信号を外部に出力する出力信号端子とを具
備する集積回路において、前記出力バッファと出力信号
端子との間にプルアップ抵抗を設けたことを特徴とする
プルアップ内蔵集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16675589A JPH0334453A (ja) | 1989-06-30 | 1989-06-30 | プルアップ低抗内蔵集積回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16675589A JPH0334453A (ja) | 1989-06-30 | 1989-06-30 | プルアップ低抗内蔵集積回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0334453A true JPH0334453A (ja) | 1991-02-14 |
Family
ID=15837132
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16675589A Pending JPH0334453A (ja) | 1989-06-30 | 1989-06-30 | プルアップ低抗内蔵集積回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0334453A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2000059089A1 (en) * | 1999-03-29 | 2000-10-05 | Tyco Electronics Corporation | Integrated switch devices with enhanced functionalities |
| US6222716B1 (en) | 1999-03-29 | 2001-04-24 | Justin Chiang | Power line protection devices and methods for providing overload protection to multiple outputs |
| US8528141B2 (en) | 2004-04-29 | 2013-09-10 | Monti-Werkzeuge Gmbh | Dressing device for power brush |
-
1989
- 1989-06-30 JP JP16675589A patent/JPH0334453A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2000059089A1 (en) * | 1999-03-29 | 2000-10-05 | Tyco Electronics Corporation | Integrated switch devices with enhanced functionalities |
| US6222716B1 (en) | 1999-03-29 | 2001-04-24 | Justin Chiang | Power line protection devices and methods for providing overload protection to multiple outputs |
| US8528141B2 (en) | 2004-04-29 | 2013-09-10 | Monti-Werkzeuge Gmbh | Dressing device for power brush |
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