JPH03220836A - 非同期伝送モード交換装置 - Google Patents

非同期伝送モード交換装置

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JPH03220836A
JPH03220836A JP2016817A JP1681790A JPH03220836A JP H03220836 A JPH03220836 A JP H03220836A JP 2016817 A JP2016817 A JP 2016817A JP 1681790 A JP1681790 A JP 1681790A JP H03220836 A JPH03220836 A JP H03220836A
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Japan
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cell
switch control
cell channel
atm cell
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Manabu Kagawa
学 香川
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NEC Corp
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NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、非同期伝送モード（Ａｓｙｎｃｈｒｏｎｏｕ
ｓ　Ｔｒ−ａｎｓｆｅｒ　Ｍｏｄｅ　、以下ＡＴＭとい
う。）交換装置に利用する。特に、交換制御手段に関す
る。
〔概要〕
本発明は、ビットスライス処理を行うＡＴＭセル通話路
を備えた非同期伝送モード交換装置において、 ＡＴＭセル通話路と同一構成の制御情報通話路を設けて
この２種類のセル通話路を共通に制御することにより、 スイッチ多段構成時でも高速スイッチングを実現するこ
とができるようにしたものである。
〔従来の技術〕
ＣＣＩＴＴ勧告では、ＡＴＭ交換方式のセルフオーマッ
トとしてセル長５３バイト中、ユーザ情報エリアに４８
バイトが割り当てられ、ヘッダに５バイトが割り当てら
れ、呼識別子や優先順位などのスイッチングに必要な情
報はすべてヘッダの所定位置に収められる。
〔発明が解決しようとする問題点〕
このような従来例では、ＡＴＭセルは第２図に示すよう
にそのヘッダに含まれるＶ　ＣＩ　（ＶｅｒｔｕａｌＣ
ａｌｌ　Ｉｄｅｎｔｉｔｙ）により目的とする交換機内
での出力ポート番号が検索されるので、セルが多段のス
イッチを通過する場合に各段ごとにＶＣＩから目的出力
ポート番号を検索することが必要になる欠点がある。
本発明はこのような欠点を除去するもので、スイッチ多
段構成時でも高速なスイッチングが実行できる非同期伝
送モード交換装置を提供することを目的とする。
〔問題点を解決するための手段〕
本発明は、通信データを所定数のｎビット構成バイトか
らなる固定長に分割したブロックに宛先およびこの通信
データの属性を含むヘッダが付加されたセルを単位とし
て交換処理を行う交換手段を有する非同期伝送モード交
換装置において、上記セルのスイッチングに必要な制御
情報を上記ヘッダから抽出して新たなセルを構成する手
段と、上記交換手段は、ｎビットに並列展開された上記
セルの１ビツト分の通話路と等しい構成の通話路を上記
新たなセルに対して備え、さらに、上記セルおよび上記
新たなセルを共通に制御する制御手段を備えたことを特
徴とする。
〔作用コ ＡＴＭセルのヘッドからセルのスイッチングに必要な制
御情報を抽出してスイッチ制御情報セルを構成し、この
セルの通話路ユニットとしてＡＴＭセルの通話路ユニッ
トと同一構成のものを設け、この２種類のセル通話路を
共通に制御する。これにより、スイッチ多段構成時でも
高速スイッチングを実現することができ、かつ、新規サ
ービス追加時の制御系の変更を容易に行うことができる
。
〔実施例〕
以下、本発明の一実施例について図面を参照して説明す
る。
すなわち、この実施例は、通信データを所定数のｎビッ
ト構成バイトからなる固定長に分割したブロックに宛先
およびこの通信データの属性を含むヘッダが付加された
セルを単位として交換処理を行う交換手段を有し、さら
に、本発明の特徴とする手段として、上記セルのスイッ
チングに必要な制御情報を上記ヘッダから抽出して新た
なセルを構成する手段と、上記交換手段は、ｎビットに
並列展開された上記セルの１ビツト分の通話路であるＡ
ＴＭセル通話路ユニット１〜８と等しい構成の通話路で
あるスイッチ制御情報セル通話路ユニット９を上記新た
なセルに対して備え、さらに、上記セルおよび上記新た
なセルを共通に制御する制御手段であるスイッチ制！１
１Ｒ１０を備える。
次に、この実施例の動作を説明する。この実施例は、第
１図に示すように、同一ハードウェアであるＡＴＭセル
通話路ユニット１〜８に対しでＡＴＭセル通話路を経由
するＡＴＭセル１バイト単位に各々１ビツトづつ割り当
てられ（以下、ビットスライスという。）８並列処理が
行われる。
スイッチ制御情報セル通話路ユニット９はＡＴＭセル通
話路ユニット１〜８と同じハードウェアである。スイッ
チ制御情報セル通話路ユニット９を付加することによる
ハードウェアの増加は通話路全体の１７８であり、スイ
ッチ制御情報セル長は５３バイト／８＝５３ビツト長と
なる。スイッチ制御部１０はスイッチ制御情報セルをも
とに制御信号を発生し、ＡＴＭセル通話路ユニット１〜
８およびスイッチ制御情報セル通話路ユニット９を同等
に制御する。結果としてスイッチ制御情報セル通話路ユ
ニット９はＡＴＭセル通話路ユニット１〜８と同じハー
ドウェアであり、制御信号で制御されるので、スイッチ
制御情報セルはＡＴＭセルに付随していくことになる。
第３図に示すように、スイッチ多段構成時に次段、次々
段での目的出力ポート番号を初段のｖＣＩの検索でスイ
ッチ制御情報セルに書き込むことでＶＣＩの検索回数を
減らすことができる。
〔発明の効果〕
本発明は、以上説明したように、ビットスライス処理を
行うＡＴＭセル通話路に用いたハードウェアの１ユニツ
トをそのままスイッチ制御情報セル用の通話路に用いる
ので、スイッチ多段構成時に高速なスイッチングが実現
でき、また、スイッチ制御部もＡＴＭＴＭ０１ッダを参
照することなくスイッチ制御情報セルを参照すればよく
、通話路系と制御系とが分かれた形になり、システムの
新規サービス追加時に制御系のみ変更すればよく、新規
サービスに対する拡張性が高くなる効果がある。
【図面の簡単な説明】
第１図は、本発明実施例の構成を示す構成図。 第２図は、ＡＴＭセルヘッダ内ＶＣＩ検索によす＃ｌＯ
出力ポートへＡＴＭＴＭ０１イッチングされる状態を示
す図。 第３図は、３段スイッチ構成で初段のＶＣＩ検索により
スイッチ制御情報セルに初段、第２段、第３段での目的
出力ポート番号が書き込まれてスイッチングされる状態
を示す図。 １〜８・・・ＡＴＭセル通話路ユニット、９・・・スイ
ッチ制御情報セル通話路ユニット、１０・・・スイッチ
制御部。

Claims (1)

  1. 【特許請求の範囲】 １、通信データを所定数のｎビット構成バイトからなる
    固定長に分割したブロックに宛先およびこの通信データ
    の属性を含むヘッダが付加されたセルを単位として交換
    処理を行う交換手段を備えた非同期伝送モード交換装置
    において、 上記セルのスイッチングに必要な制御情報を上記ヘッダ
    から抽出して新たなセルを構成する手段と、 上記交換手段は、ｎビットに並列展開された上記セルの
    １ビット分の通話路と等しい構成の通話路を上記新たな
    セルに対して備え、さらに、上記セルおよび上記新たな
    セルを共通に制御する制御手段を備えた ことを特徴とする非同期伝送モード交換装置。
JP2016817A 1990-01-25 1990-01-25 非同期伝送モード交換装置 Pending JPH03220836A (ja)

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