JPH0293881U - - Google Patents
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- Publication number
- JPH0293881U JPH0293881U JP234989U JP234989U JPH0293881U JP H0293881 U JPH0293881 U JP H0293881U JP 234989 U JP234989 U JP 234989U JP 234989 U JP234989 U JP 234989U JP H0293881 U JPH0293881 U JP H0293881U
- Authority
- JP
- Japan
- Prior art keywords
- video
- bank
- cpu
- display device
- signal
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
Description
第１図はこの考案の一実施例によるビデオ表示
装置を示す構成図、第２図はこの考案の他の実施
例を示す構成図、第３図は従来のビデオ表示装置
を示す構成図である。 １はＣＰＵ、２はビデオＲＡＭ、２１はビデオ
ＲＡＭバンク０、２２はビデオＲＡＭバンク１、
３はビデオ信号生成部、４はビデオ制御部、５１
はＣＰＵアドレスバス、５２はＣＰＵデータバス
、５３はＲ／信号、５４は垂直同期タイミング
信号、５５はビデオＲＡＭアクセス制御信号、５
６はビデオ信号、６は表示部。なお、図中、同一
符号は同一又は相当部分を示す。
装置を示す構成図、第２図はこの考案の他の実施
例を示す構成図、第３図は従来のビデオ表示装置
を示す構成図である。 １はＣＰＵ、２はビデオＲＡＭ、２１はビデオ
ＲＡＭバンク０、２２はビデオＲＡＭバンク１、
３はビデオ信号生成部、４はビデオ制御部、５１
はＣＰＵアドレスバス、５２はＣＰＵデータバス
、５３はＲ／信号、５４は垂直同期タイミング
信号、５５はビデオＲＡＭアクセス制御信号、５
６はビデオ信号、６は表示部。なお、図中、同一
符号は同一又は相当部分を示す。
Claims (1)
- ２つのメモリバンクを持ち、一方のバンクをビ
デオ制御部がアクセスしている間は、反対側のバ
ンクをＣＰＵがアクセスできるように構成したこ
とを特徴とするビデオ表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP234989U JPH0293881U (ja) | 1989-01-12 | 1989-01-12 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP234989U JPH0293881U (ja) | 1989-01-12 | 1989-01-12 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0293881U true JPH0293881U (ja) | 1990-07-25 |
Family
ID=31203037
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP234989U Pending JPH0293881U (ja) | 1989-01-12 | 1989-01-12 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0293881U (ja) |
-
1989
- 1989-01-12 JP JP234989U patent/JPH0293881U/ja active Pending
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