JPH0265197A - 多層プリント基板 - Google Patents
多層プリント基板Info
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- JPH0265197A JPH0265197A JP21493188A JP21493188A JPH0265197A JP H0265197 A JPH0265197 A JP H0265197A JP 21493188 A JP21493188 A JP 21493188A JP 21493188 A JP21493188 A JP 21493188A JP H0265197 A JPH0265197 A JP H0265197A
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- dielectric
- layer
- printed circuit
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- 239000004020 conductor Substances 0.000 claims abstract description 52
- 238000010586 diagram Methods 0.000 description 4
- 238000012545 processing Methods 0.000 description 4
- 238000013461 design Methods 0.000 description 3
- 238000000034 method Methods 0.000 description 3
- 239000004593 Epoxy Substances 0.000 description 2
- IDCBOTIENDVCBQ-UHFFFAOYSA-N TEPP Chemical compound CCOP(=O)(OCC)OP(=O)(OCC)OCC IDCBOTIENDVCBQ-UHFFFAOYSA-N 0.000 description 1
- 238000004891 communication Methods 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
Landscapes
- Production Of Multi-Layered Print Wiring Board (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
高周波信号を処理する通信用回路等のプリント基板に関
し、 プリント基板上の素子又は部品相互間の接続を容易にし
、また、干渉に対して影響を受は難くすることを目的と
し、 少くとも、ストリップ導体が形成されたストリップ導体
層と、該ストリップ導体層を被包するようにその両側に
積層された第1および第2の誘電体層と、該ストリップ
導体層と対向する側において該誘電体層のそれぞれの面
に全面的に形成された第1および第2の導体層とを有し
、これらが所定の特性インピーダンスを有するダイエレ
クトリック・ローデツド・ストリップラインを構成する
ように形成され、該導体層および該誘電体層を貫通して
多層プリント基板の素子装着面から該ストリップ導体に
スルーホールが接続され、該スルーホールおよび該ダイ
エレクトリック・ローデツド・ストリップラインを介し
て、プリント板装着素子相互間を接続するように構成す
る。
し、 プリント基板上の素子又は部品相互間の接続を容易にし
、また、干渉に対して影響を受は難くすることを目的と
し、 少くとも、ストリップ導体が形成されたストリップ導体
層と、該ストリップ導体層を被包するようにその両側に
積層された第1および第2の誘電体層と、該ストリップ
導体層と対向する側において該誘電体層のそれぞれの面
に全面的に形成された第1および第2の導体層とを有し
、これらが所定の特性インピーダンスを有するダイエレ
クトリック・ローデツド・ストリップラインを構成する
ように形成され、該導体層および該誘電体層を貫通して
多層プリント基板の素子装着面から該ストリップ導体に
スルーホールが接続され、該スルーホールおよび該ダイ
エレクトリック・ローデツド・ストリップラインを介し
て、プリント板装着素子相互間を接続するように構成す
る。
本発明は、回路素子、部品を装着し、これらの相互を接
続するプリントa板に関するものであり、特に、同軸ケ
ーブルを用いて接続を行うような、高周波信号処理回路
用のプリント基板であって、配線接続を容易にし、更に
、相互干渉を少なくする多層プリント基板に関する。
続するプリントa板に関するものであり、特に、同軸ケ
ーブルを用いて接続を行うような、高周波信号処理回路
用のプリント基板であって、配線接続を容易にし、更に
、相互干渉を少なくする多層プリント基板に関する。
などの二次的障害が発生することがあり、その対策が難
しい。また、同軸ケーブルは、ある半径以下では曲げる
ことはできないから、ケーブル布線設計に制限が多い。
しい。また、同軸ケーブルは、ある半径以下では曲げる
ことはできないから、ケーブル布線設計に制限が多い。
このため、基板上の部品、素子の配量の制約が生じ、効
率の良い実装が難しく、又、部品配置によって、信号間
の干渉、特性劣化が発生するという問題に遭遇している
。
率の良い実装が難しく、又、部品配置によって、信号間
の干渉、特性劣化が発生するという問題に遭遇している
。
本発明は、直流から200MHz程度までの周波数の信
号を処理する回路を、容易かつ干渉を生じさせずに形成
することが可能なプリント基板を提供することにある。
号を処理する回路を、容易かつ干渉を生じさせずに形成
することが可能なプリント基板を提供することにある。
中間周波からマイクロ波にかけた高速信号を処理する回
路をプリント基板上で構成する場合、同軸ケーブルを用
いて部品又は素子相互間の接続を行なっている。
路をプリント基板上で構成する場合、同軸ケーブルを用
いて部品又は素子相互間の接続を行なっている。
しかしながら同軸ケーブルを用いた場合、ケーブル布線
経路によって信号間に相互干渉が生じる〔課題を解決す
るための手段〕 上述した課題を解決するため、本発明においては、同軸
ケーブルを用いることなく、同軸ケーブルに代えてプリ
ント基板内にダイエレクトリック・ローデツド・ストリ
ップラインを形成し、このストリップラインをスルーホ
ール(又はピアホール)で接続する多層プリント基板を
提供する。
経路によって信号間に相互干渉が生じる〔課題を解決す
るための手段〕 上述した課題を解決するため、本発明においては、同軸
ケーブルを用いることなく、同軸ケーブルに代えてプリ
ント基板内にダイエレクトリック・ローデツド・ストリ
ップラインを形成し、このストリップラインをスルーホ
ール(又はピアホール)で接続する多層プリント基板を
提供する。
すなわら、本発明の多層プリント基板は、第1図(a)
(b)にその原理ブロック図を示すように、少くとも、
ストリップ導体22−1 、22−2が形成されたスト
リップ導体層22と、該ストリップ導体層を被包するよ
うにその両側に積層された第1および第2の誘電体層1
2 、13と、該ストリップ導体層と対向する側におい
て該誘電体層のそれぞれの面に全面的に形成された第1
および第2の導体121 、23とを有し、これらが所
定の特性インピーダンスを有するダイエレクトリック・
ローデツド・ストリップラインを構成するように形成さ
れ、さらに、該導体層21又は23および該誘電体層1
2又は13を貫通して多層プリント基板の素子装着面1
00 、200から該ストリップ導体にスルーホール3
1 、32が接続される。
(b)にその原理ブロック図を示すように、少くとも、
ストリップ導体22−1 、22−2が形成されたスト
リップ導体層22と、該ストリップ導体層を被包するよ
うにその両側に積層された第1および第2の誘電体層1
2 、13と、該ストリップ導体層と対向する側におい
て該誘電体層のそれぞれの面に全面的に形成された第1
および第2の導体121 、23とを有し、これらが所
定の特性インピーダンスを有するダイエレクトリック・
ローデツド・ストリップラインを構成するように形成さ
れ、さらに、該導体層21又は23および該誘電体層1
2又は13を貫通して多層プリント基板の素子装着面1
00 、200から該ストリップ導体にスルーホール3
1 、32が接続される。
該スルーホールおよび該ダイエレクトリック・ローデツ
ド・ストリップラインを介して、プリント板装着素子相
互間を接続する。
ド・ストリップラインを介して、プリント板装着素子相
互間を接続する。
尚、第1図(a)は外観図、第1図(b)は、第1図(
a)の線A−A ’における部分断面図を示す。
a)の線A−A ’における部分断面図を示す。
第1図(b)に図示の如(、導体層21 、23の間に
誘電体層12 、13が挿入され、この誘電体層にスト
リップ導体22−1 、22−2が埋設された構成が、
所定の特性インピーダンスZ0のストリップライン41
、42を構成する。このストリップラインを「ダイエ
レクトリック・ローデツド・ストリップライン(DLS
L)と呼ぶ。DH5Lの特性インピーダンスZ0は、誘
電体層12 、13の誘電率と、その厚さb、ス[・リ
ップ導体の幅W、厚さ【とした場合、例えば、t/W<
0.11の場合、次式で表わされる(例えば、”5TR
IP LINE CIRCUIT DESIGN″pp
、33−37゜Microwave As5ociat
es Burliagton、 Mass、)。
誘電体層12 、13が挿入され、この誘電体層にスト
リップ導体22−1 、22−2が埋設された構成が、
所定の特性インピーダンスZ0のストリップライン41
、42を構成する。このストリップラインを「ダイエ
レクトリック・ローデツド・ストリップライン(DLS
L)と呼ぶ。DH5Lの特性インピーダンスZ0は、誘
電体層12 、13の誘電率と、その厚さb、ス[・リ
ップ導体の幅W、厚さ【とした場合、例えば、t/W<
0.11の場合、次式で表わされる(例えば、”5TR
IP LINE CIRCUIT DESIGN″pp
、33−37゜Microwave As5ociat
es Burliagton、 Mass、)。
またストリップ導体22−1の幅が充分広く、w /
b≧0.35の場合、特性インピーダンスZoは、次式
で表わされる。
b≧0.35の場合、特性インピーダンスZoは、次式
で表わされる。
但し、a宜 +aZ 二定数
に=f (ε、t/b) ・・・(4)
OL S Lの構造条件によっては、種々の特性インピ
ーダンスが定義できる。
OL S Lの構造条件によっては、種々の特性インピ
ーダンスが定義できる。
以上のことから、第1図(a)(b)に図示の構造によ
り、所定の特性インピーダンスを有するD L S l
、がプリント基板内に形成できることが判る。
り、所定の特性インピーダンスを有するD L S l
、がプリント基板内に形成できることが判る。
この0LSLにスルーホール31 、32を接続するこ
とにより、プリント基板上、100 、200の部品8
1 、82相互間を、同軸ケーブルと同等の機能を有す
るDLSLによって、接続することができる。すなわち
、プリント基板内のDLSLを介して特性インピーダン
スをもって接続される。
とにより、プリント基板上、100 、200の部品8
1 、82相互間を、同軸ケーブルと同等の機能を有す
るDLSLによって、接続することができる。すなわち
、プリント基板内のDLSLを介して特性インピーダン
スをもって接続される。
部品はプリント基板1の両面100 、200に装着可
能である。
能である。
DLSLは複数形成させることができる。この場合、D
LSL相互が干渉し合わないようにしておく。その1つ
は、所定の距離を離すことであり(参照、前出の文献p
pH1〜116)、0LSLをシールドすることである
。
LSL相互が干渉し合わないようにしておく。その1つ
は、所定の距離を離すことであり(参照、前出の文献p
pH1〜116)、0LSLをシールドすることである
。
尚、W体層21 、23が上下に設けられているので、
プリント基板の垂直方向においては、他からの干渉、他
への干渉はない。導体層21 、23は接地される。
プリント基板の垂直方向においては、他からの干渉、他
への干渉はない。導体層21 、23は接地される。
本発明の第1の実施例の多層プリント基板の断面図、お
よびその部分拡大図を第2図および第3図に示す。
よびその部分拡大図を第2図および第3図に示す。
第2図の多層プリント基板は、先ず誘電体層14が形成
され、導体層23が形成され、誘電体層13が形成され
、その上に所定のパターンのストリップ導体22−1〜
22−3が形成され、その上にストリップ導体を被包す
るように誘電体層12が形成され、導体層21が形成さ
れ、誘電体層11が形成された、いわゆる多層プリント
基板構造となっている。この構造において、基板の部品
装着面100 、200の両側から、ストリップ導体2
21〜22−3に接続する穴が形成され導電性部材が充
填されてスルーホール31〜33が形成される。
され、導体層23が形成され、誘電体層13が形成され
、その上に所定のパターンのストリップ導体22−1〜
22−3が形成され、その上にストリップ導体を被包す
るように誘電体層12が形成され、導体層21が形成さ
れ、誘電体層11が形成された、いわゆる多層プリント
基板構造となっている。この構造において、基板の部品
装着面100 、200の両側から、ストリップ導体2
21〜22−3に接続する穴が形成され導電性部材が充
填されてスルーホール31〜33が形成される。
誘電体層11〜14の厚さ11〜14はそれぞれ、0.
3鰭であり、導体層21 、23、ストリップ導体層2
2、の厚さtは20I!rnである。従って、多層プリ
ント基板の全体の厚さ1 = 1.2tmである。また
誘電体層12 、13の厚さb # 0.6 m+であ
る。誘電体としては、例えばエポキシ−ガラス、エポキ
シ−テトロン等であり、その誘電率εは4〜5.3〜4
である。ストリップ導体22−1 、22−2の幅Wは
、例えば、w=100−であり、上記条件の下、特性イ
ンピーダンス、例えば、Zo=75Ω、を満足するよう
に決められる。
3鰭であり、導体層21 、23、ストリップ導体層2
2、の厚さtは20I!rnである。従って、多層プリ
ント基板の全体の厚さ1 = 1.2tmである。また
誘電体層12 、13の厚さb # 0.6 m+であ
る。誘電体としては、例えばエポキシ−ガラス、エポキ
シ−テトロン等であり、その誘電率εは4〜5.3〜4
である。ストリップ導体22−1 、22−2の幅Wは
、例えば、w=100−であり、上記条件の下、特性イ
ンピーダンス、例えば、Zo=75Ω、を満足するよう
に決められる。
ここで、隣接するストリップ導体22−1 、22−2
が余り近づきすぎると相互干渉が生じる。そこで、両者
の間隔Sを相互干渉が生じないように光分離しておく。
が余り近づきすぎると相互干渉が生じる。そこで、両者
の間隔Sを相互干渉が生じないように光分離しておく。
例えばs>iobとする。
本発明の第2実施例の多層プリント基板の構成図を第4
図(a)(b)に示す。第4図(a)は第2図の部分断
面図、第4図(b)は第4図(a)の線v−v ’にお
ける平面図である。
図(a)(b)に示す。第4図(a)は第2図の部分断
面図、第4図(b)は第4図(a)の線v−v ’にお
ける平面図である。
この実施例は、第3図に図示の如く、隣接するストリッ
プ導体相互を距離Sだけ離す代わりに、ストリップ導体
22−1をその両側にプリント基板の垂直方向に貫通す
る複数のスルーホール95−1〜95−7 、96−1
〜96−7を設け、ストリップ導体22−1を電気的に
シールドするようにしたものである。これらスルーホー
ルは接地される。
プ導体相互を距離Sだけ離す代わりに、ストリップ導体
22−1をその両側にプリント基板の垂直方向に貫通す
る複数のスルーホール95−1〜95−7 、96−1
〜96−7を設け、ストリップ導体22−1を電気的に
シールドするようにしたものである。これらスルーホー
ルは接地される。
隣接するスルーホールの間隔pは、理論的にはλ/4以
下であればよい(λはシールドしようとする信号の波長
である)、信号処理回路の最高周波数を200MHzと
した場合、ストリップ導体22−1から他の回路、又は
他の回路からストリップ導体22−1への干渉をなくす
には、p=37.5cm以下であればよい。実際には、
余裕をみて、更に1/10程度にして数センチメートル
ピッチでスルーホールを設ければよい。
下であればよい(λはシールドしようとする信号の波長
である)、信号処理回路の最高周波数を200MHzと
した場合、ストリップ導体22−1から他の回路、又は
他の回路からストリップ導体22−1への干渉をなくす
には、p=37.5cm以下であればよい。実際には、
余裕をみて、更に1/10程度にして数センチメートル
ピッチでスルーホールを設ければよい。
本発明の実施に当っては、以上に述べたものの他、種々
の変形形態を採ることができる。例えば、多層プリント
基板としては、D L S Lを複数段形成させること
ができ、この場合、導体層21 、23は隣接する上下
のDLSLと共用することができる。
の変形形態を採ることができる。例えば、多層プリント
基板としては、D L S Lを複数段形成させること
ができ、この場合、導体層21 、23は隣接する上下
のDLSLと共用することができる。
本発明の多層プリント基板は、直流〜200Ml1z程
度までの信号処理回路に好適に用いられ得る。
度までの信号処理回路に好適に用いられ得る。
尚、低周波信号処理用配線は、従来と同様、基板面に配
線パターンを形成して行う。
線パターンを形成して行う。
以上述べたように、本発明においては、ダイエレクトリ
ック・ローデツド・ストリップラインを内蔵し、このス
トリップラインをスルーホールを介して接続する多層プ
リント基板を形成することにより、同軸ケーブルを用い
ることなく、コンパクトで、プリント基板に装着する回
路部品の配置の制約を受けない、プリント基板回路を構
成することができる。
ック・ローデツド・ストリップラインを内蔵し、このス
トリップラインをスルーホールを介して接続する多層プ
リント基板を形成することにより、同軸ケーブルを用い
ることなく、コンパクトで、プリント基板に装着する回
路部品の配置の制約を受けない、プリント基板回路を構
成することができる。
第1図(a)(b)は本発明の多層プリント基板の原理
ブロック図、 第2図〜第4図(a)(b)は本発明の実施例の多層プ
リント基板を示す図である。 (符号の説明) 1・・・多層プリント基板、 11〜14・・・誘電体層、 21 、23・・・導
体層、22・・・マイクロストリップ導体層、22−1
、22−2・・・マイクロストリップ導体、31 、
32・・・スルーホール、 41 、42・・・ダイエレクトリック・ローデツド・
ストリップ・ライン(DLSL)、 81・・・部品、 1.00.200・・・部
品装着面。 本発明の第1実施例の多層プリント板部分断面区名 = 第2図の部分拡大図 名 ニ (a) 断面図 本発明の第2実施例の多層プリント板構成区名 図
ブロック図、 第2図〜第4図(a)(b)は本発明の実施例の多層プ
リント基板を示す図である。 (符号の説明) 1・・・多層プリント基板、 11〜14・・・誘電体層、 21 、23・・・導
体層、22・・・マイクロストリップ導体層、22−1
、22−2・・・マイクロストリップ導体、31 、
32・・・スルーホール、 41 、42・・・ダイエレクトリック・ローデツド・
ストリップ・ライン(DLSL)、 81・・・部品、 1.00.200・・・部
品装着面。 本発明の第1実施例の多層プリント板部分断面区名 = 第2図の部分拡大図 名 ニ (a) 断面図 本発明の第2実施例の多層プリント板構成区名 図
Claims (1)
- 1.少くとも、ストリップ導体(22−1,22−2)
が形成されたストリップ導体層(22)と、該ストリッ
プ導体層を被包するようにその両側に積層された第1お
よび第2の誘電体層(12,13)と、該ストリップ導
体層と対向する側において該誘電体層のそれぞれの面に
全面的に形成された第1および第2の導体層(21,2
3)とを有し、これらが所定の特性インピーダンスを有
するダイエレクトリック・ローデツド・ストリップライ
ンを構成するように形成され、 該導体層(21又は23)および該誘電体層(12又は
13)を貫通して多層プリント基板の素子装着面(10
0,200)から該ストリップ導体にスルーホール(3
1,32)が接続され、 該スルーホールおよび該ダイエレクトリック・ローデッ
ド・ストリップラインを介して、プリント板装着素子相
互間を接続するように構成したことを特徴とする、多層
プリント基板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21493188A JPH0265197A (ja) | 1988-08-31 | 1988-08-31 | 多層プリント基板 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21493188A JPH0265197A (ja) | 1988-08-31 | 1988-08-31 | 多層プリント基板 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0265197A true JPH0265197A (ja) | 1990-03-05 |
Family
ID=16663943
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP21493188A Pending JPH0265197A (ja) | 1988-08-31 | 1988-08-31 | 多層プリント基板 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0265197A (ja) |
-
1988
- 1988-08-31 JP JP21493188A patent/JPH0265197A/ja active Pending
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