JPH0246248U - - Google Patents

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JPH0246248U
JPH0246248U JP12403888U JP12403888U JPH0246248U JP H0246248 U JPH0246248 U JP H0246248U JP 12403888 U JP12403888 U JP 12403888U JP 12403888 U JP12403888 U JP 12403888U JP H0246248 U JPH0246248 U JP H0246248U
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JP
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memory
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board
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Description

【図面の簡単な説明】
第１図及び第２図は本考案のＩ／Ｏボードのボ
ード情報割付検査装置の１実施例のブロツク図及
び動作説明用フローチヤート、第３図は従来例の
動作説明用フローチヤートである。 １…Ｉ／Ｏボード、２…ＣＰＵ、４…第１のメ
モリ、５…第２のメモリ、６…比較手段。

Claims (1)

  1. 【実用新案登録請求の範囲】 信号入出力用の複数のＩ／Ｏボードと、 パワーオンリセツト、ハードウエアリセツトな
    どの初期リセツト時に前記各Ｉ／Ｏボードの種類
    、枚数、機能などのボード情報を前記各Ｉ／Ｏボ
    ードに割り付ける中央処理部と、 前記初期リセツト時に前記各Ｉ／Ｏボードに割
    り付けられたボード情報を記憶する第１のメモリ
    と、 前記各Ｉ／Ｏボードに割り付けられたボード情
    報を定期的に更新記憶する第２のメモリと、 前記第１のメモリの記憶内容と前記第２のメモ
    リの更新された記憶内容とを比較し、前記両記憶
    内容が一致しないときに異常検知信号を出力する
    比較手段と を備えたＩ／Ｏボードのボード情報割付検査装
    置。
JP12403888U 1988-09-22 1988-09-22 Pending JPH0246248U (ja)

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JP12403888U JPH0246248U (ja) 1988-09-22 1988-09-22

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JPH0246248U true JPH0246248U (ja) 1990-03-29

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ID=31373426

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JP12403888U Pending JPH0246248U (ja) 1988-09-22 1988-09-22

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