JPH0227753B2 - Deetachikusekisochi - Google Patents
DeetachikusekisochiInfo
- Publication number
- JPH0227753B2 JPH0227753B2 JP16571883A JP16571883A JPH0227753B2 JP H0227753 B2 JPH0227753 B2 JP H0227753B2 JP 16571883 A JP16571883 A JP 16571883A JP 16571883 A JP16571883 A JP 16571883A JP H0227753 B2 JPH0227753 B2 JP H0227753B2
- Authority
- JP
- Japan
- Prior art keywords
- data
- memory
- processing
- fixed storage
- storage memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 238000013500 data storage Methods 0.000 claims description 11
- 238000000034 method Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
- 238000013459 approach Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、ランダムに発生するデ−タを取込
み、必要なデ−タ処理を施した後に、固定蓄積メ
モリ（例えば、デイスケツト、テ−プなど）に蓄
積するデ−タ蓄積装置に関するものである。
み、必要なデ−タ処理を施した後に、固定蓄積メ
モリ（例えば、デイスケツト、テ−プなど）に蓄
積するデ−タ蓄積装置に関するものである。
従来例の構成とその問題点
従来のデ−タ蓄積装置について第１図を用いて
説明する。１はデ−タ入力部、２はデ−タ入力部
１からのデ−タを取込む入力バツフア、３は入力
バツフア２の内容を必要に応じ処理したデ−タを
蓄積する処理メモリ、４は処理メモリ３の内容を
蓄積するデイスケツトあるいはテ−プ等の固定蓄
積メモリ、５は入力バツフア２の動作の運用及び
停止を制御する手動スイツチである。デ−タ入力
部１でデ−タを受取ると、デ−タは順次入力バツ
フア２に蓄積される。蓄積されたデ−タは蓄積さ
れた順番に必要な処理が行なわれ、処理メモリ３
に入る。次いでその内容は固定蓄積メモリ４に移
され蓄積される。これらの動作が繰り返される
と、固定蓄積メモリ４には次々とデ−タが入るた
め、最大蓄積容量を越えるともはや蓄積できなく
なるため、さらにデ−タが入力される時は固定蓄
積メモリ４を新しいものに交換する必要が生ず
る。従来装置においては、この時には、一たん手
動スイツチ５で入力バツフア２の動作を停止さ
せ、入力デ−タが入らないようにしてから固定蓄
積メモリ４を新しいものに交換していた。また再
度運用状態に戻す時には、手動スイツチ５を運用
例に切換える必要があり、この間本来取込まれる
はずのデ−タは捨てられてしまう事になる。それ
を防ぐ為には、固定蓄積メモリ４の交換を、デ−
タが入力されない時期を見はからつて行なわなく
てはならないという問題があつた。
説明する。１はデ−タ入力部、２はデ−タ入力部
１からのデ−タを取込む入力バツフア、３は入力
バツフア２の内容を必要に応じ処理したデ−タを
蓄積する処理メモリ、４は処理メモリ３の内容を
蓄積するデイスケツトあるいはテ−プ等の固定蓄
積メモリ、５は入力バツフア２の動作の運用及び
停止を制御する手動スイツチである。デ−タ入力
部１でデ−タを受取ると、デ−タは順次入力バツ
フア２に蓄積される。蓄積されたデ−タは蓄積さ
れた順番に必要な処理が行なわれ、処理メモリ３
に入る。次いでその内容は固定蓄積メモリ４に移
され蓄積される。これらの動作が繰り返される
と、固定蓄積メモリ４には次々とデ−タが入るた
め、最大蓄積容量を越えるともはや蓄積できなく
なるため、さらにデ−タが入力される時は固定蓄
積メモリ４を新しいものに交換する必要が生ず
る。従来装置においては、この時には、一たん手
動スイツチ５で入力バツフア２の動作を停止さ
せ、入力デ−タが入らないようにしてから固定蓄
積メモリ４を新しいものに交換していた。また再
度運用状態に戻す時には、手動スイツチ５を運用
例に切換える必要があり、この間本来取込まれる
はずのデ−タは捨てられてしまう事になる。それ
を防ぐ為には、固定蓄積メモリ４の交換を、デ−
タが入力されない時期を見はからつて行なわなく
てはならないという問題があつた。
発明の目的
本発明は上記従来の欠点を解消するものであ
り、運用中にデ−タの取込みを停止する事なく固
定蓄積メモリの交換を行なえ、しかも固定蓄積メ
モリの交換操作をきわめて容易に行なうことので
きるデ−タ蓄積装置を提供することを目的とす
る。
り、運用中にデ−タの取込みを停止する事なく固
定蓄積メモリの交換を行なえ、しかも固定蓄積メ
モリの交換操作をきわめて容易に行なうことので
きるデ−タ蓄積装置を提供することを目的とす
る。
発明の構成
上記目的を達成するため、本発明のデ−タ蓄積
装置は、入力デ−タを取込んでデ−タ処理する処
理手段と、この処理手段により処理されたデ−タ
を蓄積記憶し、かつ記憶容量が限度に達した時お
よび外部の手動スイツチが操作された時に記憶内
容を固定蓄積メモリに移してクリアされる処理メ
モリとを備えた構成である。
装置は、入力デ−タを取込んでデ−タ処理する処
理手段と、この処理手段により処理されたデ−タ
を蓄積記憶し、かつ記憶容量が限度に達した時お
よび外部の手動スイツチが操作された時に記憶内
容を固定蓄積メモリに移してクリアされる処理メ
モリとを備えた構成である。
実施例の説明
以下、本発明の一実施例について、図面に基づ
いて説明する。
いて説明する。
第２図は本発明の一実施例におけるデ−タ蓄積
装置の回路ブロツク図で、６はデ−タ入力部、７
はデ−タ入力部６からデ−タを取込む入力バツフ
ア、８は入力バツフア７の内容を必要に応じ処理
したデ−タを順次蓄積する処理メモリ、９は処理
メモリ８がフルになつた時、あるいは手動スイツ
チ１０が操作された時に、処理メモリ８の内容を
蓄積する固定蓄積メモリである。
装置の回路ブロツク図で、６はデ−タ入力部、７
はデ−タ入力部６からデ−タを取込む入力バツフ
ア、８は入力バツフア７の内容を必要に応じ処理
したデ−タを順次蓄積する処理メモリ、９は処理
メモリ８がフルになつた時、あるいは手動スイツ
チ１０が操作された時に、処理メモリ８の内容を
蓄積する固定蓄積メモリである。
次に動作を説明する、デ−タ入力部６でデ−タ
を受取ると、デ−タは順次入力バツフア７に蓄積
される。蓄積されたデ−タは、順番に必要な処理
が行なわれ、処理メモリ８に順番に入る。デ−タ
が次々と入力されて処理メモリ８がフルになる
と、処理メモリ８の内容が固定蓄積メモリ９に移
る。それと同時に処理メモリ８の内容はクリアさ
れて、再度蓄積可能な状態となる。通常はこの動
作を繰り返す事になるが、固定蓄積メモリ９への
蓄積が続けられて、最大蓄積容量に近づいたら、
固定蓄積メモリ９を新しいものに交換する必要が
ある。この時には、手動スイツチ１０を操作する
ことにより、処理メモリ８の内容はこの時点で固
定蓄積メモリ９移り、その内容はクリアされる。
そして処理メモリ８がフルになるまでの間は固定
蓄積メモリ９に対するアクセスは無いから、固定
蓄積メモリ９の交換が行なえる。なお、処理メモ
リ８は容量を大きくしてあるので、固定蓄積メモ
リ９の交換時間は充分に取れる。また、固定蓄積
メモリ９交換後は、再度手動スイツチ１０の操作
等は不用であり、運用状態はそのまま続行でき
る。
を受取ると、デ−タは順次入力バツフア７に蓄積
される。蓄積されたデ−タは、順番に必要な処理
が行なわれ、処理メモリ８に順番に入る。デ−タ
が次々と入力されて処理メモリ８がフルになる
と、処理メモリ８の内容が固定蓄積メモリ９に移
る。それと同時に処理メモリ８の内容はクリアさ
れて、再度蓄積可能な状態となる。通常はこの動
作を繰り返す事になるが、固定蓄積メモリ９への
蓄積が続けられて、最大蓄積容量に近づいたら、
固定蓄積メモリ９を新しいものに交換する必要が
ある。この時には、手動スイツチ１０を操作する
ことにより、処理メモリ８の内容はこの時点で固
定蓄積メモリ９移り、その内容はクリアされる。
そして処理メモリ８がフルになるまでの間は固定
蓄積メモリ９に対するアクセスは無いから、固定
蓄積メモリ９の交換が行なえる。なお、処理メモ
リ８は容量を大きくしてあるので、固定蓄積メモ
リ９の交換時間は充分に取れる。また、固定蓄積
メモリ９交換後は、再度手動スイツチ１０の操作
等は不用であり、運用状態はそのまま続行でき
る。
このように本実施例によれば、まつたく運用を
停止する事なく固定蓄積メモリ９を交換できる。
停止する事なく固定蓄積メモリ９を交換できる。
発明の効果
以上説明したように本発明によれば、デ−タ蓄
積動作を停止する事なく固定蓄積メモリの交換が
行なえるともに、交換後の操作がまつたく不用と
なる。
積動作を停止する事なく固定蓄積メモリの交換が
行なえるともに、交換後の操作がまつたく不用と
なる。
第１図は従来のデ−タ蓄積装置の回路ブロツク
図、第２図は本発明の一実施例におけるデ−タ蓄
積装置の回路ブロツク図である。 ６……デ−タ入力部、７……入力バツフア、８
……処理メモリ、９……固定蓄積メモリ、１０…
…手動スイツチ。
図、第２図は本発明の一実施例におけるデ−タ蓄
積装置の回路ブロツク図である。 ６……デ−タ入力部、７……入力バツフア、８
……処理メモリ、９……固定蓄積メモリ、１０…
…手動スイツチ。
Claims (1)
- １ 入力デ−タを取込んでデ−タ処理する処理手
段と、この処理手段により処理されたデ−タを蓄
積記憶し、かつ記憶容量が限度に達した時および
外部の手動スイツチが操作された時に記憶内容を
固定蓄積メモリに移してクリアされる処理メモリ
とを備えたデ−タ蓄積装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16571883A JPH0227753B2 (ja) | 1983-09-07 | 1983-09-07 | Deetachikusekisochi |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16571883A JPH0227753B2 (ja) | 1983-09-07 | 1983-09-07 | Deetachikusekisochi |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6057570A JPS6057570A (ja) | 1985-04-03 |
| JPH0227753B2 true JPH0227753B2 (ja) | 1990-06-19 |
Family
ID=15817742
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16571883A Expired - Lifetime JPH0227753B2 (ja) | 1983-09-07 | 1983-09-07 | Deetachikusekisochi |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0227753B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR910017360A (ko) * | 1990-03-27 | 1991-11-05 | 이우에 사또시 | 디지탈 오디오 테이프 레코더의 신호처리 회로 |
-
1983
- 1983-09-07 JP JP16571883A patent/JPH0227753B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6057570A (ja) | 1985-04-03 |
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