JPH02187787A - 表示パネル装置 - Google Patents
表示パネル装置Info
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- JPH02187787A JPH02187787A JP1007372A JP737289A JPH02187787A JP H02187787 A JPH02187787 A JP H02187787A JP 1007372 A JP1007372 A JP 1007372A JP 737289 A JP737289 A JP 737289A JP H02187787 A JPH02187787 A JP H02187787A
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- panels
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- 239000011295 pitch Substances 0.000 abstract description 6
- 239000000758 substrate Substances 0.000 description 7
- 238000000034 method Methods 0.000 description 5
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Classifications
-
- G—PHYSICS
- G02—OPTICS
- G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
- G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
- G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour
- G02F1/13—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour based on liquid crystals, e.g. single liquid crystal display cells
- G02F1/133—Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
- G02F1/1333—Constructional arrangements; Manufacturing methods
- G02F1/13336—Combining plural substrates to produce large-area displays, e.g. tiled displays
Landscapes
- Physics & Mathematics (AREA)
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- General Physics & Mathematics (AREA)
- Optics & Photonics (AREA)
- Devices For Indicating Variable Information By Combining Individual Elements (AREA)
- Liquid Crystal (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は各種の画像表示に利用される表示パネル装置に
関するものである。
関するものである。
従来の技術
近年、各種の表示画素が開発され、これら表示画素をマ
トリクス配列した表示パネル装置が実用化された。そし
て、大画面による表示の要望から、現在では画像表示装
置に表示画面の大型化が要望されている。
トリクス配列した表示パネル装置が実用化された。そし
て、大画面による表示の要望から、現在では画像表示装
置に表示画面の大型化が要望されている。
発明が解決しようとする問題点
上述のような大型の表示パネル装置を製作する方法とし
ては、−枚の大型の基板上に大量の画素を形成する方法
が存する。しかし、この方法では大型の製造設備を要し
、多数の画素を基板上に製作するために表示パネル装置
の歩留りが低い。
ては、−枚の大型の基板上に大量の画素を形成する方法
が存する。しかし、この方法では大型の製造設備を要し
、多数の画素を基板上に製作するために表示パネル装置
の歩留りが低い。
また、大型の表示パネル装置を製作する他の方法として
は、比較的小型の表示パネルを複数個製作し、これを接
続して大型の表示パネル装置を得るという方法も尤えら
れる。しかし、この方法では各パネル間の電気的接続が
複雑になって接触不良等が発生しやすく、実用化は困難
である。
は、比較的小型の表示パネルを複数個製作し、これを接
続して大型の表示パネル装置を得るという方法も尤えら
れる。しかし、この方法では各パネル間の電気的接続が
複雑になって接触不良等が発生しやすく、実用化は困難
である。
問題点を解決するための手段
マトリクス配置された多数の表示画素と導通した駆動電
極が一縁部に配設された矩形の表示パネルを設け、複数
個の表示パネルを駆動電極が外側に位置するように連続
配置する。。
極が一縁部に配設された矩形の表示パネルを設け、複数
個の表示パネルを駆動電極が外側に位置するように連続
配置する。。
作用
マトリクス配置された多数の表示画素と導通した駆動電
極が一縁部に配設された矩形の表示パネルを設け、複数
個の表示パネルを駆動電極が外側に位置するように連続
配置したことにより、複数個の表示パネルで大型の表示
画面を形成できる。
極が一縁部に配設された矩形の表示パネルを設け、複数
個の表示パネルを駆動電極が外側に位置するように連続
配置したことにより、複数個の表示パネルで大型の表示
画面を形成できる。
実施例
本発明の第一の実施例を第１図及び第２図に基づいて説
明する。この表示パネル装置１では、表示画素２をマト
リクス状に配列した二枚の表示パネル３．、３．を並設
したものである１、そして、１）；ｊ記各表示画素２を
マトリクス配線している行電極Ｘ１〜Ｘ４と列電極Ｙ１
〜Ｙ、は、前記表示パネル３、、３．の−縁部に連設し
た駆動電極である入出力端子４に導通しており、この入
出力端子４を介して別個に形成した外部配線基板５に接
続されている。なお、この表示パネル装置１では、表示
パネル３ ３．を連設した状態で画素ピッチＰが同一に
なるように表示画素２が配列されている。
明する。この表示パネル装置１では、表示画素２をマト
リクス状に配列した二枚の表示パネル３．、３．を並設
したものである１、そして、１）；ｊ記各表示画素２を
マトリクス配線している行電極Ｘ１〜Ｘ４と列電極Ｙ１
〜Ｙ、は、前記表示パネル３、、３．の−縁部に連設し
た駆動電極である入出力端子４に導通しており、この入
出力端子４を介して別個に形成した外部配線基板５に接
続されている。なお、この表示パネル装置１では、表示
パネル３ ３．を連設した状態で画素ピッチＰが同一に
なるように表示画素２が配列されている。
このような構成において、各表示画素２は電極Ｘ、Ｙか
ら入力する画像情報に従って発光し、ドツトマトリクス
方式により画像を表示する。なお、この表示パネル装置
１では、並設した表示パネル３８，３□間に電気的接続
を要しないため、これら表示パネル３．３２間の間隙は
極めて小さくなっており、画素密度を落すことなく二枚
の表示パネル３．３□の画素ピッチＰが一定となってい
る。
ら入力する画像情報に従って発光し、ドツトマトリクス
方式により画像を表示する。なお、この表示パネル装置
１では、並設した表示パネル３８，３□間に電気的接続
を要しないため、これら表示パネル３．３２間の間隙は
極めて小さくなっており、画素密度を落すことなく二枚
の表示パネル３．３□の画素ピッチＰが一定となってい
る。
つまり、これら二枚の表示パネル３．、３．は等価的に
一つの表示画面を形成している。
一つの表示画面を形成している。
つぎに、本発明の第二の実施例を第３図に基づいて説明
する。この表示パネル装置６は、四枚の表示パネル３．
〜３４を縦横に配列したものである。
する。この表示パネル装置６は、四枚の表示パネル３．
〜３４を縦横に配列したものである。
なお、各電極Ｘ、Ｙは、この表示パネル装置６の両側に
配設された二枚の外部配線基板５．．５２に接続されて
いる。
配設された二枚の外部配線基板５．．５２に接続されて
いる。
さらに、本発明の第三の実施例を第４図に基づいて説明
する。この表示パネル装置７は、三枚の表示パネル３〜
３３を線形に連続配置したものである。
する。この表示パネル装置７は、三枚の表示パネル３〜
３３を線形に連続配置したものである。
このような構成において、これら表示パネル装置６，７
は前述した表示パネル装置ｌと同様に機能する。上述の
ように、これらの表示パネル装置６．７では、構造が同
一の複数個の表示パネル３、〜３．を組合わせることで
、面積が大きい表示画面や長い表示画面を得ている。
は前述した表示パネル装置ｌと同様に機能する。上述の
ように、これらの表示パネル装置６．７では、構造が同
一の複数個の表示パネル３、〜３．を組合わせることで
、面積が大きい表示画面や長い表示画面を得ている。
また、本発明の第四の実施例を第５図ないし第１１図に
基づいて説明する。この表示パネル装置であるＥＣＤ
（エレクトロクロミックデイスプレィ）８では、別個に
製作した表示基板９と駆動回路基板１０とを異方導電性
シート１１で接合して表示パネルを形成するようになっ
ている。なお、前記表示基板９の表面には、表示画素で
あるＥＣ画素１２が４行×４列のマトリクス状に設けら
れている。また、第６図に例示するように、これら１：
、Ｃ画素１２は、透明な共通電極１３、ＷＯ３などから
なる発色層１４、Ｌｉなどを含む固体電解質層１５、対
向電極１６等を透明基板１７上に順次積層形成すること
などにより形成されており、前記対向電極１６は、カー
ボンペーストをスクリーン印刷することなどで前記表示
基板９の裏面から微小に突出している。一方、前記駆動
回路基板１０内には各ＥＣ画素１２に対応して駆動回路
１９が形成されており、これら駆動回路１９と導通した
電極パッド２０が前記駆動回路基板１０の表面に設けら
れている。そして、前記駆動回路１９と導通した駆動電
極２１は、前記駆動回路基板ｌＯの一縁部に配設されて
いる。なお、この表示パネル装置８では、第７図に例示
するように、前記部材９〜１１からなる表示パネルはベ
ース２２に保持されて連続配置されている。そして、前
記駆動回路基板１０の駆動電極２１は、第８図及び第９
図に例示するように、異方導電性シート２３を介するな
どして、各駆動電極２１と対向するように電極パッド２
４が形成されたＦＰＣ（フレキシブル配線基板）２５に
より外部機器（図示せず）等と接続される。
基づいて説明する。この表示パネル装置であるＥＣＤ
（エレクトロクロミックデイスプレィ）８では、別個に
製作した表示基板９と駆動回路基板１０とを異方導電性
シート１１で接合して表示パネルを形成するようになっ
ている。なお、前記表示基板９の表面には、表示画素で
あるＥＣ画素１２が４行×４列のマトリクス状に設けら
れている。また、第６図に例示するように、これら１：
、Ｃ画素１２は、透明な共通電極１３、ＷＯ３などから
なる発色層１４、Ｌｉなどを含む固体電解質層１５、対
向電極１６等を透明基板１７上に順次積層形成すること
などにより形成されており、前記対向電極１６は、カー
ボンペーストをスクリーン印刷することなどで前記表示
基板９の裏面から微小に突出している。一方、前記駆動
回路基板１０内には各ＥＣ画素１２に対応して駆動回路
１９が形成されており、これら駆動回路１９と導通した
電極パッド２０が前記駆動回路基板１０の表面に設けら
れている。そして、前記駆動回路１９と導通した駆動電
極２１は、前記駆動回路基板ｌＯの一縁部に配設されて
いる。なお、この表示パネル装置８では、第７図に例示
するように、前記部材９〜１１からなる表示パネルはベ
ース２２に保持されて連続配置されている。そして、前
記駆動回路基板１０の駆動電極２１は、第８図及び第９
図に例示するように、異方導電性シート２３を介するな
どして、各駆動電極２１と対向するように電極パッド２
４が形成されたＦＰＣ（フレキシブル配線基板）２５に
より外部機器（図示せず）等と接続される。
つぎに、前記駆動回路１９の電気的な構成を第１０図及
び第１１図に基づいて説明する。まず、各駆動回路１９
には、各々前記ＥＣ画素１２と接続されるＦＦ回路（フ
リップフロップ回路）２６が設けられている。そこで、
二ＯＦＦ回路２６の一対の入力電極は、一方に遅延回路
（図示せず）を接続するなどして給電電極２７．２８に
導通されている。また、このｌ” Ｆ回路２６の出力電
極はアース電極２９に導通されている。さらに、このＦ
Ｆ回路２６のトリガ電極はＴＦＴ３０のソースに導通さ
れており、このＴＦＴ３０のゲートとドレインとは、行
電極３１と列電極３２とに導通されている。また、前記
ＦＦ回路２６のスイッチング電極は薄膜で形成されたス
イッチングトランジスタ３３のゲートに導通されている
。さらに、このスイッチングトランジスタ３３のソース
には、正負に逆転した電圧を印加してＥＣ画素１２の発
色消色を行なう給電回路（図示せず）が接続される表示
電極３４が導通されており、ドレインには前記電極パッ
ド２０が導通されている。これにより、各ＥＣ画素１２
は給電回路と通電可能になっている。
び第１１図に基づいて説明する。まず、各駆動回路１９
には、各々前記ＥＣ画素１２と接続されるＦＦ回路（フ
リップフロップ回路）２６が設けられている。そこで、
二ＯＦＦ回路２６の一対の入力電極は、一方に遅延回路
（図示せず）を接続するなどして給電電極２７．２８に
導通されている。また、このｌ” Ｆ回路２６の出力電
極はアース電極２９に導通されている。さらに、このＦ
Ｆ回路２６のトリガ電極はＴＦＴ３０のソースに導通さ
れており、このＴＦＴ３０のゲートとドレインとは、行
電極３１と列電極３２とに導通されている。また、前記
ＦＦ回路２６のスイッチング電極は薄膜で形成されたス
イッチングトランジスタ３３のゲートに導通されている
。さらに、このスイッチングトランジスタ３３のソース
には、正負に逆転した電圧を印加してＥＣ画素１２の発
色消色を行なう給電回路（図示せず）が接続される表示
電極３４が導通されており、ドレインには前記電極パッ
ド２０が導通されている。これにより、各ＥＣ画素１２
は給電回路と通電可能になっている。
なお、−１−記電極２８，２９，３１．３２は前記駆動
回路基板１０の一縁部に配置されて前記駆動電極２１を
形成している。また、前記ＦＦ回路２６は二つのＴＦＴ
３５ａ、３５ｂと抵抗３６ａ、３６ｂとから構成されて
いる。
回路基板１０の一縁部に配置されて前記駆動電極２１を
形成している。また、前記ＦＦ回路２６は二つのＴＦＴ
３５ａ、３５ｂと抵抗３６ａ、３６ｂとから構成されて
いる。
このような構成において、この表示パネル装置であるＥ
ＣＤ８も、同一構造に量産した表示基板９と駆動回路基
板ｌＯとから、等価的に大型の表示画面を得ている。つ
まり、簿膜技術等により多数の画素を同時に製作するＥ
ＣＤなとは、ＬＥＤのように各々別個に製作された画素
を連続配置した表示装置と異なり、通常では装置を大型
化すると歩留りの低下が著しいが、本発明によるｌ’：
ＣＩ）８では、量産した小型の表示パネルを連続配置
して大画面を形成するので装置の歩留りが良い１゜また
、本実施例のＥＣＤ８の画像表示動作について説明する
。まず、給電電極２７．２８から印加され、遅延回路に
よりタイミングがずれた電圧により、ＦＦ回路２６から
ゲートに流れる電圧は生じず、通常、スイッチングトラ
ンジスタ３３はＯＦＦ状態となっている。そこで、外部
機器の信号出力回路等から行列電極３１．３２に発せら
れた画像信号による主走査副走査の同期によりＴ Ｆｒ
２Ｏが作動し、所定ＯＦＦ回路２６がＯＮ状態＝８ になる。すると、このＦＦ回路２６内で、給電電極２８
からアース電極２９に印加されていた電圧が、スイッチ
ングトランジスタ３３のゲートに印加されることになる
。これにより、各スイッチングトランジスタ３３は、表
示する画像に対応して、それぞれＯＮ、ＯＦＦ状態に設
定される。そこで、表示電極３４に接続された給電回路
から所望により正負電圧を印加することで、全ＥＣ画素
１２が同時に発色及び消色を行ない、速やかに画像表示
及び画像消去が行なわれる。
ＣＤ８も、同一構造に量産した表示基板９と駆動回路基
板ｌＯとから、等価的に大型の表示画面を得ている。つ
まり、簿膜技術等により多数の画素を同時に製作するＥ
ＣＤなとは、ＬＥＤのように各々別個に製作された画素
を連続配置した表示装置と異なり、通常では装置を大型
化すると歩留りの低下が著しいが、本発明によるｌ’：
ＣＩ）８では、量産した小型の表示パネルを連続配置
して大画面を形成するので装置の歩留りが良い１゜また
、本実施例のＥＣＤ８の画像表示動作について説明する
。まず、給電電極２７．２８から印加され、遅延回路に
よりタイミングがずれた電圧により、ＦＦ回路２６から
ゲートに流れる電圧は生じず、通常、スイッチングトラ
ンジスタ３３はＯＦＦ状態となっている。そこで、外部
機器の信号出力回路等から行列電極３１．３２に発せら
れた画像信号による主走査副走査の同期によりＴ Ｆｒ
２Ｏが作動し、所定ＯＦＦ回路２６がＯＮ状態＝８ になる。すると、このＦＦ回路２６内で、給電電極２８
からアース電極２９に印加されていた電圧が、スイッチ
ングトランジスタ３３のゲートに印加されることになる
。これにより、各スイッチングトランジスタ３３は、表
示する画像に対応して、それぞれＯＮ、ＯＦＦ状態に設
定される。そこで、表示電極３４に接続された給電回路
から所望により正負電圧を印加することで、全ＥＣ画素
１２が同時に発色及び消色を行ない、速やかに画像表示
及び画像消去が行なわれる。
発明の効果
本発明は、上述のようにマトリクス配置された多数の表
示画素と導通した駆動電極が一縁部に配設された矩形の
表示パネルを設け、複数個の表示パネルを駆動電極が外
側に位置するように連続配置したことにより、複数個の
表示パネルから大型の表示画面を形成でき、さらに、連
続配置された表示パネル上の画素ピッチが同一になるよ
うに各表示パネルに表示画素を配置することで、画素ピ
ッチが均一な大型の表示画面を得ることもできる等の効
果を有するものである。
示画素と導通した駆動電極が一縁部に配設された矩形の
表示パネルを設け、複数個の表示パネルを駆動電極が外
側に位置するように連続配置したことにより、複数個の
表示パネルから大型の表示画面を形成でき、さらに、連
続配置された表示パネル上の画素ピッチが同一になるよ
うに各表示パネルに表示画素を配置することで、画素ピ
ッチが均一な大型の表示画面を得ることもできる等の効
果を有するものである。
第１図は本発明の第一の実施例の正面図、第２図は表示
パネルの説明図、第３図は第二の実施例の正面図、第４
図は第三の実施例の正面図、第５図は第四の実施例の分
解斜視図、第６図は分解側面図、第７図は側面図、第８
図及び第９図は要部の縦断側面図、第１Ｏ図は駆動回路
の回路図、第１１図は駆動回路の説明図である。 １．６，７．８・・・表示パネル装置、２，１２・・・
表示画素、３，９〜１１・・・表示パネル、４，２１・
・・駆動電極 １ｍ −Ｔ Ｎ ｌ”）：ｔ Ｊ こ 図 図 Ｚ」 」Ｏ Ｊ」０！
パネルの説明図、第３図は第二の実施例の正面図、第４
図は第三の実施例の正面図、第５図は第四の実施例の分
解斜視図、第６図は分解側面図、第７図は側面図、第８
図及び第９図は要部の縦断側面図、第１Ｏ図は駆動回路
の回路図、第１１図は駆動回路の説明図である。 １．６，７．８・・・表示パネル装置、２，１２・・・
表示画素、３，９〜１１・・・表示パネル、４，２１・
・・駆動電極 １ｍ −Ｔ Ｎ ｌ”）：ｔ Ｊ こ 図 図 Ｚ」 」Ｏ Ｊ」０！
Claims (1)
- 【特許請求の範囲】 １、マトリクス配置された多数の表示画素と導通した駆
動電極が一縁部に配設された矩形の表示パネルを設け、
複数個の前記表示パネルを前記駆動電極が外側に位置す
るように連続配置したことを特徴とする表示パネル装置
。 ２、連続配置された表示パネル上の画素ピッチが同一に
なるように前記各表示パネルに表示画素を配置したこと
を特徴とする請求項１記載の表示パネル装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1007372A JPH02187787A (ja) | 1989-01-13 | 1989-01-13 | 表示パネル装置 |
| KR1019890006576A KR920008236B1 (ko) | 1988-05-17 | 1989-05-17 | 일렉트로크로믹 표시장치 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1007372A JPH02187787A (ja) | 1989-01-13 | 1989-01-13 | 表示パネル装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02187787A true JPH02187787A (ja) | 1990-07-23 |
Family
ID=11664139
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1007372A Pending JPH02187787A (ja) | 1988-05-17 | 1989-01-13 | 表示パネル装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02187787A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| USRE37945E1 (en) | 1995-01-13 | 2002-12-31 | Seiko Epson Corporation | Liquid crystal display device and manufacturing method thereof |
| EP2234162A3 (en) * | 1998-08-07 | 2011-03-09 | LG Electronics Inc. | Organic electroluminescent display panel and method for fabricating the same |
| WO2015052187A1 (en) * | 2013-10-08 | 2015-04-16 | Plastic Logic Limited | Transistor array routing |
| EP2572560A4 (en) * | 2010-07-08 | 2018-03-28 | Nokia Technologies Oy | Flexible apparatus |
-
1989
- 1989-01-13 JP JP1007372A patent/JPH02187787A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| USRE37945E1 (en) | 1995-01-13 | 2002-12-31 | Seiko Epson Corporation | Liquid crystal display device and manufacturing method thereof |
| EP2234162A3 (en) * | 1998-08-07 | 2011-03-09 | LG Electronics Inc. | Organic electroluminescent display panel and method for fabricating the same |
| EP2572560A4 (en) * | 2010-07-08 | 2018-03-28 | Nokia Technologies Oy | Flexible apparatus |
| WO2015052187A1 (en) * | 2013-10-08 | 2015-04-16 | Plastic Logic Limited | Transistor array routing |
| US9876034B2 (en) | 2013-10-08 | 2018-01-23 | Flexenable Limited | Transistor array routing |
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