JPH0214573A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH0214573A JPH0214573A JP16562488A JP16562488A JPH0214573A JP H0214573 A JPH0214573 A JP H0214573A JP 16562488 A JP16562488 A JP 16562488A JP 16562488 A JP16562488 A JP 16562488A JP H0214573 A JPH0214573 A JP H0214573A
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- semiconductor device
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- coil
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Links
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、基板上に設けた複数のユニット素子を並列
にした大電力半導体装置の製造方法に関するものである
。
にした大電力半導体装置の製造方法に関するものである
。
第4図に、並列構造を持つ従来の大電力半導体装置の一
例として、静電誘導サイリスタ(以下、SIサイリスタ
という)の断面を示す。図において、(1)はアンード
電極、(2)はカソード電極、(8)はゲート電極、(
4)は絶縁性を持つ表面保護用のシリコン酸化膜、(至
)はn型シリコンからなる基板、αυはアノードとなる
p要領域、α2は埋め込みゲートとなるp要領域、aっ
はエピタキシャル成長によシ形成されたn型領域、Iは
カソードとなるn型領域である、第4図の直線X−X及
びY−Yの間は1つのユニット素子という。一般には、
1枚の基板(至)の上にユニット素子を複数個形成され
、並列に接続することにより使用される。
例として、静電誘導サイリスタ(以下、SIサイリスタ
という)の断面を示す。図において、(1)はアンード
電極、(2)はカソード電極、(8)はゲート電極、(
4)は絶縁性を持つ表面保護用のシリコン酸化膜、(至
)はn型シリコンからなる基板、αυはアノードとなる
p要領域、α2は埋め込みゲートとなるp要領域、aっ
はエピタキシャル成長によシ形成されたn型領域、Iは
カソードとなるn型領域である、第4図の直線X−X及
びY−Yの間は1つのユニット素子という。一般には、
1枚の基板(至)の上にユニット素子を複数個形成され
、並列に接続することにより使用される。
上記のような半導体装置は設計上又は製造上において様
々な原因により、各ユニット素子に流れている電流は必
ずしも均一ではない。このため、電流は局部的に集中し
、大量な熱が発生し、半導体素子を破壊する。特に、大
口径の大電力半導体装置の設計、開発に電流の均一的な
流れは重要な課題である。今まで、電流分布の測定は困
難であるので、半導体素子の開発において膨大な数の実
験をしても、最適条件が決定できずその対策が課題であ
った。
々な原因により、各ユニット素子に流れている電流は必
ずしも均一ではない。このため、電流は局部的に集中し
、大量な熱が発生し、半導体素子を破壊する。特に、大
口径の大電力半導体装置の設計、開発に電流の均一的な
流れは重要な課題である。今まで、電流分布の測定は困
難であるので、半導体素子の開発において膨大な数の実
験をしても、最適条件が決定できずその対策が課題であ
った。
この発明は、かかる課題を解、決するためになされたも
ので、電流の分布を調べることによって実験の進行方向
を解実に把握して開発工数を大幅に減少することができ
る半導体装置の製造方法である。
ので、電流の分布を調べることによって実験の進行方向
を解実に把握して開発工数を大幅に減少することができ
る半導体装置の製造方法である。
この発明に係る半導体装置の製造方法は、半導体装置の
表面にある絶縁性を持つシリコン酸化膜の上に金属膜例
えばアルミニュウム膜を全面的に形成し、この金属膜を
写真製版法によって、検出コイルを形成する。
表面にある絶縁性を持つシリコン酸化膜の上に金属膜例
えばアルミニュウム膜を全面的に形成し、この金属膜を
写真製版法によって、検出コイルを形成する。
上記検出コイルでユニット素子ごとの電流を検出できる
ので、電流分布を知ることが可能になり、実験の進行、
開発工数の削減に寄与する。
ので、電流分布を知ることが可能になり、実験の進行、
開発工数の削減に寄与する。
以下、上記のn型シリコン基板にp型埋め込みゲート構
造を持つSIサイリスタを例として、この発明の実施に
ついて説明する。
造を持つSIサイリスタを例として、この発明の実施に
ついて説明する。
第1図(al 、 (t)lはこの発明の半導体装置の
製造方法の一実施例を説明するための断面図である。こ
れらの図において従来例の第4図と同一符号は同一部分
を示す。また(6)は検出コイル、(γ)は金属膜であ
る。
製造方法の一実施例を説明するための断面図である。こ
れらの図において従来例の第4図と同一符号は同一部分
を示す。また(6)は検出コイル、(γ)は金属膜であ
る。
次に製造工程について説明する。
まず、第1図(alに示すように、半導体素子のカンー
ド側の主表面に全面的に除去可能な物質、例えば半導体
装置の製造で広く使用されている写真製版用感光剤等か
らなる保護膜(5)を表面全面に形成し、コイルを形成
しようとする所だけ保護膜(5)を除去する。その上に
真空蒸着法などで金属膜(γ)例えばアルミニュウム膜
を形成する。
ド側の主表面に全面的に除去可能な物質、例えば半導体
装置の製造で広く使用されている写真製版用感光剤等か
らなる保護膜(5)を表面全面に形成し、コイルを形成
しようとする所だけ保護膜(5)を除去する。その上に
真空蒸着法などで金属膜(γ)例えばアルミニュウム膜
を形成する。
次に第1図(1)]に示すように保護膜(6)及びその
上に付いている金属膜(γ)を検出コイル(6)を残し
て除去する。このようにして電流の検出コイル(6)が
できる。単位ユニットにおけるカソード電極(2)及び
検出コイル(6)の平面配置は第2図に示す。
上に付いている金属膜(γ)を検出コイル(6)を残し
て除去する。このようにして電流の検出コイル(6)が
できる。単位ユニットにおけるカソード電極(2)及び
検出コイル(6)の平面配置は第2図に示す。
このようにして得られたSIサイリスタは、検出コイル
(6)を持ち、各ユニットの電流分流は簡単に測定でき
る。
(6)を持ち、各ユニットの電流分流は簡単に測定でき
る。
なお、上記実施例ではSエサイリスタを例として述べた
が、この発明はこれに限定されることはなく、ユニット
素子が複数個並列接続された構造を有する他の半導体装
置にも適用可能である。
が、この発明はこれに限定されることはなく、ユニット
素子が複数個並列接続された構造を有する他の半導体装
置にも適用可能である。
また、この発明の金属膜コイルは単層構造に限られるも
のではなく、感度の向上をするために第3図に示すよう
な多層構造も適用可能である。
のではなく、感度の向上をするために第3図に示すよう
な多層構造も適用可能である。
この発明は以上説明したとおシ、半導体装置の表面絶縁
保護膜の上に金属膜を形成し、写真製版で検出コイルが
でき、このコイルより並列構造半導体装置の各ユニット
の電流分流を簡単な方法で測定できるという効果がある
。
保護膜の上に金属膜を形成し、写真製版で検出コイルが
でき、このコイルより並列構造半導体装置の各ユニット
の電流分流を簡単な方法で測定できるという効果がある
。
第1図はこの発明に係る半導体装置の製造方法の一実施
例を示す断面図、第2図は第1図に示す半導体装置の電
極及び検出コイルを示す平面配置図、第3図はこの発明
の他の実施例を説明するための断面図、第4図は従来の
並列構造を持つ半導体装置を説明するための断面図であ
る。 図において(2)はカソード電極、(8)はゲート電極
、(4)はシリコン酸化膜、(6)は保護膜、(6)は
検出コイル、(γ)は金属膜、(至)は基板、Uはp型
領域、Cl31、(14はn型領域である。 なお、各図中の同一符号は同−又は相当部分を示す。
例を示す断面図、第2図は第1図に示す半導体装置の電
極及び検出コイルを示す平面配置図、第3図はこの発明
の他の実施例を説明するための断面図、第4図は従来の
並列構造を持つ半導体装置を説明するための断面図であ
る。 図において(2)はカソード電極、(8)はゲート電極
、(4)はシリコン酸化膜、(6)は保護膜、(6)は
検出コイル、(γ)は金属膜、(至)は基板、Uはp型
領域、Cl31、(14はn型領域である。 なお、各図中の同一符号は同−又は相当部分を示す。
Claims (1)
- ユニット素子を複数個接続して並列構造を持つ大電力半
導体装置の各ユニットの電極の周囲に、金属膜のコイル
を形成し、このコイルにより各ユニットの電流分流を調
べることを特徴とする半導体装置の製造方法、
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16562488A JPH0214573A (ja) | 1988-06-30 | 1988-06-30 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16562488A JPH0214573A (ja) | 1988-06-30 | 1988-06-30 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0214573A true JPH0214573A (ja) | 1990-01-18 |
Family
ID=15815900
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16562488A Pending JPH0214573A (ja) | 1988-06-30 | 1988-06-30 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0214573A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP1153752A3 (en) * | 2000-04-14 | 2003-08-20 | Canon Kabushiki Kaisha | Semiconductor device, ink tank provided with such device and method of manufacturing such device |
US7102647B2 (en) | 2001-06-26 | 2006-09-05 | Microsoft Corporation | Interactive horizon mapping |
-
1988
- 1988-06-30 JP JP16562488A patent/JPH0214573A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP1153752A3 (en) * | 2000-04-14 | 2003-08-20 | Canon Kabushiki Kaisha | Semiconductor device, ink tank provided with such device and method of manufacturing such device |
US6719394B2 (en) | 2000-04-14 | 2004-04-13 | Canon Kabushiki Kaisha | Semiconductor device, ink tank provided with such semiconductor device, ink jet cartridge, ink jet recording apparatus, method for manufacturing such semiconductor device, and communication system, method for controlling pressure, memory element, security system of ink jet recording apparatus |
US7102647B2 (en) | 2001-06-26 | 2006-09-05 | Microsoft Corporation | Interactive horizon mapping |
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