JPH02104327U - - Google Patents

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JPH02104327U
JPH02104327U JP1220689U JP1220689U JPH02104327U JP H02104327 U JPH02104327 U JP H02104327U JP 1220689 U JP1220689 U JP 1220689U JP 1220689 U JP1220689 U JP 1220689U JP H02104327 U JPH02104327 U JP H02104327U
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JP
Japan
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thin film
film transistor
gate
switching thin
line
Prior art date
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Application number
JP1220689U
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Publication date
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  • Thin Film Transistor (AREA)
  • Liquid Crystal (AREA)

Description

【図面の簡単な説明】
第1図は本考案の第1の実施例を示すTFTア
クテイブマトリツクス液晶表示素子の回路図、第
2図は本考案の第2の実施例を示すTFTアクテ
イブマトリツクス液晶表示素子の回路図、第3図
は従来のTFTアクテイブマトリツクス液晶表示
素子の回路図である。 1……ゲートライン、2……データライン、3
……画素電極、4……対向電極、LC……液晶、
CLC……コンデンサ、T……スイツチング用
薄膜トランジスタ、T……第2の薄膜トランジ
スタ、G,G……ゲート電極、S,S
…ソース電極、D,D……ドレイン電極、R
L……出力用負液、5……接地ライン、6……接
地用配線。

Claims (1)

  1. 【実用新案登録請求の範囲】 液晶層をはさんで対向する一対の透明基板のう
    ち一方の基板面に、多数本のゲートラインと、こ
    のゲートラインと直交する多数本のデータライン
    と、前記ゲートラインとデータラインとの各交差
    部にそれぞれ配置された多数のスイツチング用薄
    膜トランジスタと、この各スイツング用薄膜トラ
    ンジスタのソース電極にそれぞれ接続された多数
    の画素電極とを形成し、他方の基板面に、前記画
    素電極と対向する対向電極を形成したTFTアク
    テイブマトリツクス液晶表示素子において、 前記一方の基板面に、上記各スイツチング用薄
    膜トランジスタにそれぞれ対応させて第2の薄膜
    トランジスタを設け、前記第2の薄膜トランジス
    タのゲート電極は、この第2の薄膜トランジスタ
    と対応する上記スイツチング用薄膜トランジスタ
    に映像信号を供給するデータラインに接続し、前
    記第2の薄膜トランジスタのソース、ドレイン電
    極の一方は、この第2の薄膜トランジスタと対応
    する上記スイツチング用薄膜トランジスタのゲー
    ト電極が接続されているゲートラインに出力用負
    荷を介して接続し、前記第2の薄膜トランジスタ
    のソース、ドレイン電極の他方は、接地ラインま
    たは前記ゲートラインの前段のゲートラインに接
    続するとともに、前記第2の薄膜トランジスタと
    前記出力用負荷との間に、上記スイツチング用薄
    膜トランジスタのドレイン電極を接続したことを
    特徴とするTFTアクテイブマトリツクス液晶表
    示素子。
JP1220689U 1989-02-06 1989-02-06 Pending JPH02104327U (ja)

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JPH02104327U true JPH02104327U (ja) 1990-08-20

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JP1220689U Pending JPH02104327U (ja) 1989-02-06 1989-02-06

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JP (1) JPH02104327U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07111341A (ja) * 1993-10-12 1995-04-25 Nec Corp 電流制御型発光素子アレイ

Cited By (1)

* Cited by examiner, † Cited by third party
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JPH07111341A (ja) * 1993-10-12 1995-04-25 Nec Corp 電流制御型発光素子アレイ

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